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CN104700803A - 一种移位寄存器、栅极驱动电路、显示面板及显示装置 - Google Patents

一种移位寄存器、栅极驱动电路、显示面板及显示装置 Download PDF

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CN104700803A CN201510137120.0A CN201510137120A CN104700803A CN 104700803 A CN104700803 A CN 104700803A CN 201510137120 A CN201510137120 A CN 201510137120A CN 104700803 A CN104700803 A CN 104700803A
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Abstract

本发明公开了一种移位寄存器、栅极驱动电路、显示面板及显示装置，该移位寄存器包括输入模块、复位模块、上拉模块、第一节点下拉模块、第二节点下拉模块，输出控制模块，以及输出降噪模块；输入模块用于拉高第一节点的电位；复位模块用于拉低第一节点的电位；上拉模块用于拉高第二节点的电位；第一节点下拉模块用于拉低第一节点的电位；第二节点下拉模块用于拉低第二节点的电位；输出控制模块控制扫描信号输出端输出第二时钟信号端的信号或将低电平信号端与第三节点导通，这样实现了移位寄存器在对应时间段输出扫描信号的功能，同时，输出降噪模块将第三节点的信号进行滤波降噪后输出到扫描信号输出端，从而降低输出到扫描信号输出端的信号噪声。

Description

一种移位寄存器、栅极驱动电路、显示面板及显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种移位寄存器、栅极驱动电路、显示面板及显示装置。
背景技术
目前，随着液晶显示技术的发展，液晶面板业竞争越来越激烈，降低液晶显示面板的生产成本成为面板商提高竞争力的首选方案，而为了降低显示面板的生产成本，一般地，相关技术领域的技术人员利用显示面板的边缘搭建栅极驱动电路，栅极驱动电路包括多个移位寄存器，每个移位寄存器对应一条栅线，多个移位寄存器采用串联设置，相邻两个移位寄存器之间有逐级传递的触发信号，每个移位寄存器接收到触发信号后，向对应栅线输出栅线扫描信号，并把触发信号输送给下一级单元电路以实现栅极驱动的功能，这样的设计可以省去在显示面板的边框区域单独设置栅极驱动芯片，有利于实现显示面板的窄边框设计，同时降低了相关产品的生产成本，提高了显示产品的市场竞争力。
一般地，现有的移位寄存器的电路结构，如图1所示，其对应的输入输出时序图，如图2所示，从图2可以看出，移位寄存器在正常开启工作时，第一节点PU的电位在第一时间段被拉高，在第二阶段被继续拉高，进而控制开关晶体管T7开启，使得扫描信号输出端对应输出扫描信号，然而由于第一节点PU输出的电压信号有噪声(如图2中标注的区域A所示)，且第一节点PU在第一次被拉高时产生的信号的电位较高，通过电容C1的充放电过程，易造成扫描信号输出端输出的扫描信号有较大噪声(如图2中标注的区域B所示)，进而造成移位寄存器电路功耗较大，降低了显示面板的良率。
因此，如何降低移位寄存器输出的扫描信号的噪声，降低功耗，从而提高显示面板的良率，是本领域技术人员亟需解决的技术问题。
发明内容
本发明实施例提供了一种移位寄存器、栅极驱动电路、显示面板及显示装置，用以解决现有技术中存在的移位寄存器输出的扫描信号的噪声较大，功耗较大的问题。
本发明实施例提供了一种移位寄存器，包括：输入模块、复位模块、上拉模块、第一节点下拉模块、第二节点下拉模块、输出控制模块，以及输出降噪模块；其中，
所述输入模块的输入端与第一参考信号端相连，控制端与信号输入端相连，输出端与第一节点相连，所述输入模块用于在所述信号输入端的控制下拉高所述第一节点的电位；
所述复位模块的输入端与第二参考信号端相连，控制端与复位信号端相连，输出端与所述第一节点相连，所述复位模块用于在所述复位信号端的控制下拉低所述第一节点的电位；
所述上拉模块的输入端和控制端分别与第一时钟信号端相连，输出端与第二节点相连，所述上拉模块用于在所述第一时钟信号端的控制下拉高所述第二节点的电位；
所述第一节点下拉模块的输入端与低电平信号端相连，控制端与所述第二节点相连，输出端与所述第一节点相连，所述第一节点下拉模块用于在所述第二节点的控制下拉低所述第一节点的电位；
所述第二节点下拉模块的输入端与低电平信号端相连，第一控制端与所述第一节点相连，第二控制端与扫描信号输出端相连，输出端与所述第二节点相连，所述第二节点下拉模块用于在所述第一节点和所述扫描信号输出端的控制下拉低所述第二节点的电位；
所述输出控制模块连接于所述低电平信号端、第二时钟信号端相连、所述第一节点、所述第二节点、第三节点和所述扫描信号输出端之间，所述输出控制模块用于在所述第一节点的控制下控制所述扫描信号输出端输出所述第二时钟信号端的信号，以及在所述第二节点的控制下将所述低电平信号端与所述第三节点导通；
所述输出降噪模块的输入端与所述第三节点相连，控制端与高电平信号端相连，输出端与所述扫描信号输出端相连，所述输出降噪模块用于将所述第三节点的信号进行滤波降噪后传输到所述扫描信号输出端。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述输出降噪模块，具体包括：第一开关晶体管；
所述第一开关晶体管的栅极与所述高电平信号端相连，源极与所述第三节点相连，漏极与所述扫描信号输出端相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述输出控制模块，具体包括：第一输出控制模块和第二输出控制模块；其中，
所述第一输出控制模块连接于所述第一节点、所述第三节点、所述第二时钟信号端，以及所述扫描信号输出端之间，所述第一输出控制模块用于在所述第一节点的控制下，控制所述扫描信号输出端输出所述第二时钟信号端的信号；
所述第二输出控制模块连接于所述低电平信号端、所述第三节点和所述第二节点之间，所述第二输出控制模块用于在所述第二节点的控制下，将所述低电平信号端与所述第三节点导通。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第一输出控制模块，具体包括：第二开关晶体管和第一电容；其中，
所述第二开关晶体管的栅极与所述第一节点相连，源极与所述第二时钟信号端相连，漏极与所述扫描信号输出端相连；
所述第一电容连接于所述第一节点与所述第三节点之间。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第二输出控制模块，具体包括：第三开关晶体管和第二电容；其中，
所述第三开关晶体管的栅极与所述第二节点相连，源极与所述低电平信号端相连，漏极与所述第三节点相连；
所述第二电容连接于所述第二节点和所述低电平信号端之间。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第二节点下拉模块，具体包括：第一下拉模块和第二下拉模块；其中，
所述第一下拉模块的输入端与所述低电平信号端相连，控制端与所述第一节点相连，输出端与所述第二节点相连，所述第一下拉模块用于在所述第一节点的控制下拉低所述第二节点的电位；
所述第二下拉模块的输入端与所述低电平信号端相连，控制端与所述扫描信号输出端相连，输出端与所述第二节点相连，所述第二下拉模块用于在所述扫描信号输出端输出扫描信号时进一步拉低所述第二节点的电位。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第一下拉模块，具体包括：第四开关晶体管；
所述第四开关晶体管的栅极与所述第一节点相连，源极与所述低电平信号端相连，漏极与所述第二节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第二下拉模块，具体包括：第五开关晶体管；
所述第五开关晶体管的栅极与所述扫描信号输出端相连，源极与所述低电平信号端相连，漏极与所述第二节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述输入模块，具体包括：第六开关晶体管；
所述第六开关晶体管的栅极与所述信号输入端相连，源极与所述第一参考信号端相连，漏极与所述一节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述复位模块，具体包括：第七开关晶体管；
所述第七开关晶体管的栅极与所述复位信号端相连，源极与所述第二参考信号端相连，漏极与所述一节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述第一节点下拉模块，具体包括：第八开关晶体管；
所述第八开关晶体管的栅极与所述第二节点相连，源极与所述低电平信号端相连，漏极与所述一节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述上拉模块，具体包括：第九开关晶体管；
所述第九开关晶体管的栅极和源极分别与所述第一时钟信号端相连，漏极与所述第二节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，还包括：传输模块；
所述传输模块连接于所述输入模块的输出端、所述复位模块的输出端、所述第一节点下拉模块的输出端、所述第二节点下拉模块的第一控制端和所述第一节点之间，所述传输模块用于对所述输入模块的输出端和所述复位模块的输出端输出的信号进行滤波降噪后输出到所述第一节点。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器中，所述传输模块，具体包括：第十开关晶体管；
所述第十开关晶体管的栅极与所述高电平信号端相连，源极分别与所述输入模块的输出端和所述复位模块的输出端相连，漏极与所述第一节点相连。
本发明实施例提供了一种栅极驱动电路，包括级联的多个本发明实施例提供的上述移位寄存器，除第一个移位寄存器和最后一个移位寄存器之外，其余每个移位寄存器的扫描信号输出端均向与其相邻的下一个移位寄存器的信号输入端输入触发信号，并向与其相邻的上一个移位寄存器的复位信号端输入复位信号；第一个移位寄存器的扫描信号输出端向第二个移位寄存器的信号输入端输入触发信号；最后一个移位寄存器的扫描信号输出端向自身以及上一个移位寄存器的复位信号端输入复位信号。
本发明实施例提供了一种显示面板，包括本发明实施例提供的上述栅极驱动电路。
本发明实施例提供了一种显示装置，包括本发明实施例提供的上述显示面板。
本发明实施例的有益效果包括：
本发明实施例提供了一种移位寄存器、栅极驱动电路、显示面板及显示装置，该移位寄存器包括输入模块、复位模块、上拉模块、第一节点下拉模块、第二节点下拉模块，输出控制模块，以及输出降噪模块；其中，输入模块用于在信号输入端的控制下拉高第一节点的电位；复位模块用于在复位信号端的控制下拉低第一节点的电位；上拉模块用于在第一时钟信号端的控制下拉高第二节点的电位；第一节点下拉模块用于在第二节点的控制下拉低第一节点的电位；第二节点下拉模块用于在第一节点和扫描信号输出端的控制下拉低第二节点的电位；输出控制模块用于在第一节点控制下，控制扫描信号输出端输出第二时钟信号端的信号，以及在第二节点的控制下将低电平信号端与第三节点导通，这样实现了移位寄存器在对应时间段输出扫描信号的功能，同时，输出降噪模块将第三节点的信号进行滤波降噪，且将滤波降噪后的信号输出到扫描信号输出端，从而降低输出到扫描信号输出端的信号噪声，提高信号的无损耗传输，降低功耗，进而提高显示面板的良率。
附图说明
图1为现有技术中移位寄存器的结构示意图；
图2为现有的移位寄存器的输入输出时序图；
图3为本发明实施例提供的移位寄存器的结构示意图；
图4-图7分别为本发明实施例提供的移位寄存器的具体结构示意图；
图8为本发明实施例提供的移位寄存器的输入输出时序图；
图9为本发明实施例提供的栅极驱动电路的结构示意图。
具体实施方式
下面结合附图，对本发明实施例提供的移位寄存器、栅极驱动电路、显示面板及显示装置的具体实施方式进行详细地说明。
本发明实施例提供了一种移位寄存器，如图3所示，可以包括：输入模块01、复位模块02、上拉模块03、第一节点下拉模块04、第二节点下拉模块05、输出控制模块06，以及输出降噪模块07；其中，
输入模块01的输入端与第一参考信号端CN相连，控制端与信号输入端Input相连，输出端与第一节点P1相连，输入模块01用于在信号输入端Input的控制下拉高第一节点P1的电位；
复位模块02的输入端与第二参考信号端CNB相连，控制端与复位信号端Reset相连，输出端与第一节点P1相连，复位模块02用于在复位信号端Reset的控制下拉低第一节点P1的电位；
上拉模块03的输入端和控制端分别与第一时钟信号端CLK相连，输出端与第二节点P2相连，上拉模块03用于在第一时钟信号端CLK的控制下拉高第二节点P2的电位；
第一节点下拉模块04的输入端与低电平信号端VGL相连，控制端与第二节点P2相连，输出端与第一节点P1相连，第一节点下拉模块04用于在第二节点P2的控制下拉低第一节点P1的电位；
第二节点下拉模块05的输入端与低电平信号端VGL相连，第一控制端与第一节点P1相连，第二控制端与扫描信号输出端Out相连，输出端与第二节点P2相连，第二节点下拉模块05用于在第一节点P1和扫描信号输出端Out的控制下拉低第二节点P2的电位；
输出控制模块06连接于低电平信号端VGL相连、第二时钟信号端CLKB、第一节点P1、第二节点P2、第三节点P3和扫描信号输出端Out之间，输出控制模块06用于在第一节点P1的控制下控制扫描信号输出端Out输出第二时钟信号端CLKB的信号，以及在第二节点P2的控制下将低电平信号端VGL与第三节点P3导通；
输出降噪模块07的输入端与第三节点P3相连，控制端与高电平信号端VGH相连，输出端与扫描信号输出端Out相连，输出降噪模块07用于将第三节点P3的信号进行滤波降噪后输出到扫描信号输出端Out。
本发明实施例提供的上述移位寄存器中，包括输入模块01、复位模块02、上拉模块03、第一节点下拉模块04、第二节点下拉模块05，输出控制模块06，以及输出降噪模块07；其中，输入模块01用于拉高第一节点P1的电位；复位模块02用于拉低第一节点P1的电位；上拉模块03用于拉高第二节点P2的电位；第一节点下拉模块用于拉低第一节点P1的电位；第二节点下拉模块用于拉低第二节点P2的电位；输出控制模块06用于在第一节点P1的控制下控制扫描信号输出端Out输出第二时钟信号端CLKB的信号，以及在第二节点P2的控制下将低电平信号端VGL与第三节点P3导通；这样实现了移位寄存器在对应时间段输出扫描信号的功能，同时，输出降噪模块07将第三节点P3的信号进行滤波降噪后输出到扫描信号输出端Out，从而降低扫描信号输出端Out的信号噪声，提高信号的无损耗传输，降低功耗，进而提高显示面板的良率。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图4所示，输出降噪模块07，可以具体包括：第一开关晶体管T1；第一开关晶体管T1的栅极与高电平信号端VGH相连，源极与第三节点P3相连，漏极与扫描信号输出端Out相连。
具体地，在高电平信号端VGH的控制下，第一开关晶体管T1处于常开状态，作为单管传输门工作，将第三节点P3的信号进行滤波降噪，且将滤波降噪后的信号传输到扫描信号输出端Out，从而降低扫描信号输出端Out的信号噪声，提高信号的无损耗传输，降低功耗，进而提高显示面板的良率。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图5所示，输出控制模块06，可以具体包括：第一输出控制模块061和第二输出控制模块062；其中，
第一输出控制模块061连接于第一节点P1、第三节点P3、第二时钟信号端CLKB，以及扫描信号输出端Out之间，第一输出控制模块061用于在第一节点P1的控制下，控制扫描信号输出端Out输出第二时钟信号端CLKB的信号；
第二输出控制模块062连接于低电平信号端VGL、第三节点P3和第二节点P2之间，第二输出控制模块062用于在第二节点P2的控制下，将低电平信号端VGL与第三节点P3导通。
具体地，第一输出控制模块061在第一节点P1的控制下，对应输出第二时钟信号端CLKB的信号，第二输出控制模块062在第二节点P2的控制下，将低电平信号端VGL与第三节点P3导通，实现移位寄存器在对应时间段向对应栅线输出扫描信号，驱动显示面板实现逐行扫描，同时第三节点P3的信号经过第一开关晶体管T1的滤波降噪后输出到扫描信号输出端Out，可以降低扫描信号输出端Out的信号噪声。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图5所示，第一输出控制模块061，可以具体包括：第二开关晶体管T2和第一电容C1；其中，第二开关晶体管T2的栅极与第一节点P1相连，源极与第二时钟信号端CLKB相连，漏极与扫描信号输出端Out相连；第一电容C1连接于第一节点P1与第三节点P3之间。
具体地，当第一节点P1的电位被拉高时，第二开关晶体管T2处于导通状态，导通的第二开关晶体管T2将第二时钟信号端CLKB与扫描信号输出端Out导通，同时第一电容C1对第一节点P1的电位起到自举作用，进一步保持第一节点P1的电位。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图5所示，第二输出控制模块062，可以具体包括：第三开关晶体管T3和第二电容C2；其中，第三开关晶体管T3的栅极与第二节点P2相连，源极与低电平信号端VGL相连，漏极与第三节点P3相连；第二电容C2连接于第二节点P2和低电平信号端VGL之间。
具体地，当第二节点P2的电位被拉高时，第三开关晶体管T3处于导通状态，导通的第三开关晶体管T3将低电平信号端VGL与第三节点P3导通，第三节点P3的信号经过第一开关晶体管T1的滤波降噪后输出到扫描信号输出端Out，可以降低扫描信号输出端Out的信号噪声。同时第二电容C2可以进一步保持第二节点P2的电位，降低第二节点P2的电压信号的噪声。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6所示，第二节点下拉模块05，可以具体包括：第一下拉模块051和第二下拉模块052；其中，第一下拉模块051的输入端与低电平信号端VGL相连，控制端与第一节点P1相连，输出端与第二节点P2相连，第一下拉模块051用于在第一节点P1的控制下拉低第二节点P2的电位；第二下拉模块052的输入端与低电平信号端VGL相连，控制端与扫描信号输出端Out相连，输出端与第二节点P2相连，第二下拉模块052用于在扫描信号输出端Out输出扫描信号时进一步拉低第二节点P2的电位。
具体地，第一下拉模块051和第二下拉模块052分别在第一节点P1的电位被拉高时和扫描信号输出端Out输出扫描信号时，对应拉低第二节点P2的电位，可以进一步降低第二节点P2的信号噪声。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6所示，第一下拉模块051，可以具体包括：第四开关晶体管T4；第四开关晶体管T4的栅极与第一节点P1相连，源极与低电平信号端VGL相连，漏极与第二节点P2相连。
具体地，当第一节点P1的电位被拉高时，第四开关晶体管T4处于导通状态，导通的第四开关晶体管T4将低电平信号端VGL与第二节点P2导通，进而拉低第二节点P2的电位，降低第二节点P2的信号噪声。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图6所示，第二下拉模块052，可以具体包括：第五开关晶体管T5；第五开关晶体管T5的栅极与扫描信号输出端Out相连，源极与低电平信号端VGL相连，漏极与第二节点P2相连。
具体地，当扫描信号输出端Out输出扫描信号时，第五开关晶体管T5处于导通状态，导通的第五开关晶体管T5将低电平信号端VGL与第二节点P2导通，进而拉低第二节点P2的电位，这样可以进一步降低第二节点P2的信号噪声。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图7所示，输入模块01，可以具体包括：第六开关晶体管T6；第六开关晶体管T6的栅极与信号输入端Input相连，源极与第一参考信号端CN相连，漏极与第一节点P1相连。
具体地，当信号输入端Input输入信号时，第六开关晶体管T6处于导通状态，导通的第六开关晶体管T6将第一参考信号端CN与第一节点P1导通，进而将第一参考信号端CN的信号传递给第一节点P1。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图7所示，复位模块02，可以具体包括：第七开关晶体管T7；第七开关晶体管T7的栅极与复位信号端Reset相连，源极与第二参考信号端CNB相连，漏极与第一节点P1相连。
具体地，当复位信号端Reset输入信号时，第七开关晶体管T7处于导通状态，导通的第七开关晶体管T7将第二参考信号端CNB与第一节点P1导通，进而将第二参考信号端CNB的信号传递给第一节点P1。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图7所示，第一节点下拉模块04，可以具体包括：第八开关晶体管T8；第八开关晶体管T8的栅极与第二节点P2相连，源极与低电平信号端VGL相连，漏极与第一节点P1相连。
具体地，当第二节点P2的电位被拉高时，第八开关晶体管T8处于导通状态，导通的第八开关晶体管T8将第一节点P1与低电平信号端VGL导通，进而将第一节点P1的电位拉低。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图7所示，上拉模块03，可以具体包括：第九开关晶体管T9；第九开关晶体管T9的栅极和源极分别与第一时钟信号端CLK相连，漏极与第二节点P2相连。
具体地，当第一时钟信号端CLK输入高电平信号时，第九开关晶体管T9处于导通状态，导通的第九开关晶体管T9将第一时钟信号端CLK与第二节点P2导通，进而将第二节点P2的电位拉高。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图7所示，还可以包括：传输模块08；传输模块08连接于输入模块01的输出端、复位模块02的输出端、第一节点下拉模块04的输出端、第二节点下拉模块05的第一控制端和第一节点P1之间，传输模块08用于对输入模块01的输出端和复位模块02的输出端输出的信号进行滤波降噪后输出到第一节点P1。
具体地，传输模块08在高电平信号端VGH的控制下处于常开状态，作为单管传输门工作，因此可以将输入模块01和复位模块02输出的信号进行滤波降噪后输出到第一节点P1，进而降低第一节点P1的信号噪声。
在具体实施时，本发明实施例提供的上述移位寄存器中，如图7所示，传输模块08，可以具体包括：第十开关晶体管T10；第十开关晶体管T10的栅极与高电平信号端VGH相连，源极分别与输入模块01的输出端和复位模块的输出端01相连，漏极与第一节点P1相连。
具体地，第十开关晶体管T10在高电平信号端VGH的控制下处于导通状态，作为单管传输门工作，因此可以将输入模块01和复位模块02输出的信号进行滤波降噪后输出到第一节点P1，进而降低第一节点P1的信号噪声。
需要说明的是本发明上述实施例中提到的开关晶体管可以是薄膜晶体管(TFT，Thin Film Transistor)，也可以是金属氧化物半导体场效应管(MOS，Metal Oxide Scmiconductor)，在此不做限定。在具体实施中，这些晶体管的源极和漏极可以互换，不做具体区分。在描述具体实施例时以薄膜晶体管为例进行说明。
进一步地，由于在本发明实施例提供的上述移位寄存器中信号输入端Input和复位信号端Reset为对称设计，可以实现功能互换，因此本发明实施例提供的上述移位寄存器可以实现双向扫描。
一般地，在启动正向扫描时，第一参考信号端CN提供高电平信号，第二参考信号端CNB提供低电平信号。一般地，在反向扫描时，第一参考信号端CN提供低电平信号，第二参考信号端CNB提供高电平信号。
下面结合图7所示的移位寄存器以及图8所示的图7的输入输出时序图，以正向扫描为例对本发明实施例提供的移位寄存器的工作过程作以描述。具体地，选取如图8所示的输入输出时序图中的t1～t3三个阶段。下述描述中以1表示高电平信号，0表示低电平信号。
在t1阶段，Input＝1，CLKB＝0，CLK＝0，Reset＝0，CN＝1，CNB＝0。由于Input＝1，因此第六开关晶体管T6导通，导通的第六开关晶体管T6将第一参考信号端CN与第一节点P1导通，进而将第一节点P1的电位拉高，同时对第一电容C1充电，由于第一节点P1的电位被拉高，因此，第二开关晶体管T2处于导通状态，导通的第二开关晶体管T2将第二时钟信号端CLKB与扫描信号输出端Out导通，由于此时CLKB＝0，因此扫描信号输出端Out输出低电平信号。t1阶段为充电阶段。
在t2阶段，Input＝0，CLKB＝1，CLK＝0，Reset＝0，CN＝1，CNB＝0。由于第一电容C1的自举作用，第一节点P1的电位进一步升高，因此第二开关晶体管T2仍处于导通状态，而此时CLKB＝1，因此，扫描信号输出端Out输出高电平信号。t2阶段为扫描信号输出阶段。
在t3阶段，Input＝0，CLKB＝0，CLK＝1，Reset＝1，CN＝1，CNB＝0。由于Reset＝1，因此第七开关晶体管T7导通，导通的第七开关晶体管T7将第二参考信号端CNB与第一节点P1导通，由于CNB＝0，因此将第一节点P1的电位拉低，由于第一节点P1的电位被拉低，因此，第二开关晶体管T2处于截止状态。由于CLK＝1，因此第九开关晶体管T9导通，导通的第九开关晶体管T9将第一时钟信号端CLK与第二节点P2导通，因此，第二节点P2的电位被拉高，此时，第三开关晶体管T3处于导通状态，导通的第三开关晶体管T3将低电平信号端VGL与第三节点P3导通，第三节点P3的信号经过第一开关晶体管T1的滤波降噪后输出到扫描信号输出端Out，即扫描信号输出端Out输出低电平信号。t3阶段为非扫描信号输出阶段。
在后续时间段，扫描信号输出端Out将一直输出低电平信号，直到某个时间段信号输入端Input再次输入高电平信号时，则该移位寄存器将重复上述工作工程。
基于同一发明构思，本发明实施例提供了一种栅极驱动电路，包括级联的多个本发明实施例提供的上述移位寄存器，除第一个移位寄存器和最后一个移位寄存器之外，其余每个移位寄存器的扫描信号输出端均向与其相邻的下一个移位寄存器的信号输入端输入触发信号，并向与其相邻的上一个移位寄存器的复位信号端输入复位信号；第一个移位寄存器的扫描信号输出端向第二个移位寄存器的信号输入端输入触发信号；最后一个移位寄存器的扫描信号输出端向自身以及上一个移位寄存器的复位信号端输入复位信号。
为了方便说明，图9中仅示出了八个移位寄存器，分别为第1级移位寄存器、第2级移位寄存器、第3级移位寄存器、第4级移位寄存器、第N-3级移位寄存器、第N-2级移位寄存器、第N-1级移位寄存器、第N级移位寄存器。其中，第N-1级移位寄存器的信号输出端Out不仅向与其连接的栅线输出栅开启信号，还向第N-2级移位寄存器输出复位信号，同时还向第N级移位寄存器输出触发信号。
具体地，上述栅极驱动电路中的每个移位寄存器与本发明提供的上述移位寄存器在功能和结构上均相同，重复之处不再赘述。
基于同一发明构思，本发明实施例提供了一种显示面板，包括本发明实施例提供的上述栅极驱动电路。由于该显示面板解决问题的原理与显栅极驱动电路相似，因此该显示面板的实施可以参见上述栅极驱动电路的实施，重复之处不再赘述。
基于同一发明构思，本发明实施例提供了一种显示装置，包括本发明实施例提供的上述显示面板。该显示装置可以应用于手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。由于该显示装置解决问题的原理与显示面板相似，因此该显示装置的实施可以参见上述显示面板的实施，重复之处不再赘述。
本发明实施例提供了一种移位寄存器、栅极驱动电路、显示面板及显示装置，该移位寄存器包括输入模块、复位模块、上拉模块、第一节点下拉模块、第二节点下拉模块，输出控制模块，以及输出降噪模块；其中，输入模块用于在信号输入端的控制下拉高第一节点的电位；复位模块用于在复位信号端的控制下拉低第一节点的电位；上拉模块用于在第一时钟信号端的控制下拉高第二节点的电位；第一节点下拉模块用于在第二节点的控制下拉低第一节点的电位；第二节点下拉模块用于在第一节点和扫描信号输出端的控制下拉低第二节点的电位；输出控制模块用于在第一节点控制下，控制扫描信号输出端输出第二时钟信号端的信号，以及在第二节点的控制下将低电平信号端与第三节点导通，这样实现了移位寄存器在对应时间段输出扫描信号的功能，同时，输出降噪模块将第三节点的信号进行滤波降噪，且将滤波降噪后的信号输出到扫描信号输出端，从而降低输出到扫描信号输出端的信号噪声，提高信号的无损耗传输，降低功耗，进而提高显示面板的良率。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。

Claims (17)

1.一种移位寄存器，其特征在于，包括：输入模块、复位模块、上拉模块、第一节点下拉模块、第二节点下拉模块、输出控制模块，以及输出降噪模块；其中，
所述输入模块的输入端与第一参考信号端相连，控制端与信号输入端相连，输出端与第一节点相连，所述输入模块用于在所述信号输入端的控制下拉高所述第一节点的电位；
所述复位模块的输入端与第二参考信号端相连，控制端与复位信号端相连，输出端与所述第一节点相连，所述复位模块用于在所述复位信号端的控制下拉低所述第一节点的电位；
所述上拉模块的输入端和控制端分别与第一时钟信号端相连，输出端与第二节点相连，所述上拉模块用于在所述第一时钟信号端的控制下拉高所述第二节点的电位；
所述第一节点下拉模块的输入端与低电平信号端相连，控制端与所述第二节点相连，输出端与所述第一节点相连，所述第一节点下拉模块用于在所述第二节点的控制下拉低所述第一节点的电位；
所述第二节点下拉模块的输入端与低电平信号端相连，第一控制端与所述第一节点相连，第二控制端与扫描信号输出端相连，输出端与所述第二节点相连，所述第二节点下拉模块用于在所述第一节点和所述扫描信号输出端的控制下拉低所述第二节点的电位；
所述输出控制模块连接于所述低电平信号端、第二时钟信号端相连、所述第一节点、所述第二节点、第三节点和所述扫描信号输出端之间，所述输出控制模块用于在所述第一节点的控制下控制所述扫描信号输出端输出所述第二时钟信号端的信号，以及在所述第二节点的控制下将所述低电平信号端与所述第三节点导通；
所述输出降噪模块的输入端与所述第三节点相连，控制端与高电平信号端相连，输出端与所述扫描信号输出端相连，所述输出降噪模块用于将所述第三节点的信号进行滤波降噪后输出到所述扫描信号输出端。
2.如权利要求1所述的移位寄存器，其特征在于，所述输出降噪模块，具体包括：第一开关晶体管；
所述第一开关晶体管的栅极与所述高电平信号端相连，源极与所述第三节点相连，漏极与所述扫描信号输出端相连。
3.如权利要求1所述的移位寄存器，其特征在于，所述输出控制模块，具体包括：第一输出控制模块和第二输出控制模块；其中，
所述第一输出控制模块连接于所述第一节点、所述第三节点、所述第二时钟信号端，以及所述扫描信号输出端之间，所述第一输出控制模块用于在所述第一节点的控制下，控制所述扫描信号输出端输出所述第二时钟信号端的信号；
所述第二输出控制模块连接于所述低电平信号端、所述第三节点和所述第二节点之间，所述第二输出控制模块用于在所述第二节点的控制下，将所述低电平信号端与所述第三节点导通。
4.如权利要求3所述的移位寄存器，其特征在于，所述第一输出控制模块，具体包括：第二开关晶体管和第一电容；其中，
所述第二开关晶体管的栅极与所述第一节点相连，源极与所述第二时钟信号端相连，漏极与所述扫描信号输出端相连；
所述第一电容连接于所述第一节点与所述第三节点之间。
5.如权利要求3所述的移位寄存器，其特征在于，所述第二输出控制模块，具体包括：第三开关晶体管和第二电容；其中，
所述第三开关晶体管的栅极与所述第二节点相连，源极与所述低电平信号端相连，漏极与所述第三节点相连；
所述第二电容连接于所述第二节点和所述低电平信号端之间。
6.如权利要求1所述的移位寄存器，其特征在于，所述第二节点下拉模块，具体包括：第一下拉模块和第二下拉模块；其中，
所述第一下拉模块的输入端与所述低电平信号端相连，控制端与所述第一节点相连，输出端与所述第二节点相连，所述第一下拉模块用于在所述第一节点的控制下拉低所述第二节点的电位；
所述第二下拉模块的输入端与所述低电平信号端相连，控制端与所述扫描信号输出端相连，输出端与所述第二节点相连，所述第二下拉模块用于在所述扫描信号输出端输出扫描信号时进一步拉低所述第二节点的电位。
7.如权利要求6所述的移位寄存器，其特征在于，所述第一下拉模块，具体包括：第四开关晶体管；
所述第四开关晶体管的栅极与所述第一节点相连，源极与所述低电平信号端相连，漏极与所述第二节点相连。
8.如权利要求6所述的移位寄存器，其特征在于，所述第二下拉模块，具体包括：第五开关晶体管；
所述第五开关晶体管的栅极与所述扫描信号输出端相连，源极与所述低电平信号端相连，漏极与所述第二节点相连。
9.如权利要求1-8任一项所述的移位寄存器，其特征在于，所述输入模块，具体包括：第六开关晶体管；
所述第六开关晶体管的栅极与所述信号输入端相连，源极与所述第一参考信号端相连，漏极与所述一节点相连。
10.如权利要求1-8任一项所述的移位寄存器，其特征在于，所述复位模块，具体包括：第七开关晶体管；
所述第七开关晶体管的栅极与所述复位信号端相连，源极与所述第二参考信号端相连，漏极与所述一节点相连。
11.如权利要求1-8任一项所述的移位寄存器，其特征在于，所述第一节点下拉模块，具体包括：第八开关晶体管；
所述第八开关晶体管的栅极与所述第二节点相连，源极与所述低电平信号端相连，漏极与所述一节点相连。
12.如权利要求1-8任一项所述的移位寄存器，其特征在于，所述上拉模块，具体包括：第九开关晶体管；
所述第九开关晶体管的栅极和源极分别与所述第一时钟信号端相连，漏极与所述第二节点相连。
13.如权利要求1-8任一项所述的移位寄存器，其特征在于，还包括：传输模块；
所述传输模块连接于所述输入模块的输出端、所述复位模块的输出端、所述第一节点下拉模块的输出端、所述第二节点下拉模块的第一控制端和所述第一节点之间，所述传输模块用于对所述输入模块的输出端和所述复位模块的输出端输出的信号进行滤波降噪后输出到所述第一节点。
14.如权利要求13所述的移位寄存器，其特征在于，所述传输模块，具体包括：第十开关晶体管；
所述第十开关晶体管的栅极与所述高电平信号端相连，源极分别与所述输入模块的输出端和所述复位模块的输出端相连，漏极与所述第一节点相连。
15.一种栅极驱动电路，其特征在于，包括级联的多个如权利要求1-14任一项所述的移位寄存器，除第一个移位寄存器和最后一个移位寄存器之外，其余每个移位寄存器的扫描信号输出端均向与其相邻的下一个移位寄存器的信号输入端输入触发信号，并向与其相邻的上一个移位寄存器的复位信号端输入复位信号；第一个移位寄存器的扫描信号输出端向第二个移位寄存器的信号输入端输入触发信号；最后一个移位寄存器的扫描信号输出端向自身以及上一个移位寄存器的复位信号端输入复位信号。
16.一种显示面板，其特征在于，包括如权利要求15所述的栅极驱动电路。
17.一种显示装置，其特征在于，包括如权利要求16所述的显示面板。
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