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KR890015157A - 고속 디지탈 신호처리 프로세서 - Google Patents

고속 디지탈 신호처리 프로세서 Download PDF

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KR890015157A
KR890015157A KR1019890003321A KR890003321A KR890015157A KR 890015157 A KR890015157 A KR 890015157A KR 1019890003321 A KR1019890003321 A KR 1019890003321A KR 890003321 A KR890003321 A KR 890003321A KR 890015157 A KR890015157 A KR 890015157A
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KR
South Korea
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coefficient
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KR1019890003321A
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Inventor
도오루 바지
히로쯔구 고지마
나리오 스미
요시무네 하기와라
신야 오바
Original Assignee
미다 가쓰시게
가부시끼가이샤 히다찌세이사꾸쇼
다께이 유끼오
히다찌디바이스엔지니어링 가부시끼가이샤
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Filing date
Publication date
Application filed by 미다 가쓰시게, 가부시끼가이샤 히다찌세이사꾸쇼, 다께이 유끼오, 히다찌디바이스엔지니어링 가부시끼가이샤 filed Critical 미다 가쓰시게
Publication of KR890015157A publication Critical patent/KR890015157A/ko
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Publication of KR0130772B1 publication Critical patent/KR0130772B1/ko

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    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F15/00—Digital computers in general; Data processing equipment in general
    • G06F15/16—Combinations of two or more digital computers each having at least an arithmetic unit, a program unit and a register, e.g. for a simultaneous processing of several programs
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F17/00—Digital computing or data processing equipment or methods, specially adapted for specific functions
    • G06F17/10—Complex mathematical operations
    • G06F17/16—Matrix or vector computation, e.g. matrix-matrix or matrix-vector multiplication, matrix factorization

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Abstract

내용 없음

Description

고속 디지탈 신호처리 프로세서
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 1 도는 본 발명의 1실시예에 의한 프로세서의 회로블럭도. 제 5 도는 본 발명이 신호처리 알고리듬, 제10도는 본 발명의 1실시에에 사용되는 제어회로의 회로도.

Claims (2)

  1. 여러개의 데이타로 되는 열벡터 입력신호와 소정수의 계수데이터로 되는 매트릭스를 백터곱하는 것에 의해서 여러개의 데이타로 되는 열벡터 출력신호를 발생하기 위한 디지탈 신호처리 프로세서로서, 상기 열벡터 입력신호의 여러개의 데이타를 직렬로 수신하는 입력수단, 상기 입력수단에 의해 수신된 데이타를 제1의 사이클로 저장하는 제1저장수단, 상기 매트릭스의 상기 소정수의 계수 데이타를 기억하는 계수메모리수단, 상기 제1의 사이클보다 짧은주기를 갖는 제2의 사이클로 상기 계수메모리 수단에서 상기 소정수의 계수데이타중 메트릭스의 행방향의 데이타를 리드하고, 상기 리드된 데이타를 저장하는 제2 저장수단, 상기 제1 저장수단의 출력데이터와 상기 제2저장수단의 출력데이타를 승산하는 승산수단, 상기 승산수단의 출력에 접속된 제3저장수단, 상기 제3저장수단의 출력에 그 제1입력이 접속된 가산수단, 상기 가산수단의 제2입력에그 출력이 접속된 제4저장수단 및 상기 가산수단의 출력에 그 입력이 접속되고, 상기 제4 저장수단의 입력에 그 출력이 접속된 어큐뮬레이터 수단을 포함하는 디지탈 신호처리 프로세서.
  2. 특허청구의 범위 제1항에 있어서, 상기 계수메모리 수단은 그 입력, 그 출력이 독립적으로 엑세스가 가능한 멀티포트 메모리 수단인 디지탈 신호처리 프로세서.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019890003321A 1988-03-18 1989-03-17 고속디지탈신호처리프로세서 KR0130772B1 (ko)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP63063313A JP2690932B2 (ja) 1988-03-18 1988-03-18 ディジタル信号処理プロセッサおよびディシタル信号処理プロセッサシステム
JP63-63313 1988-03-18

Publications (2)

Publication Number Publication Date
KR890015157A true KR890015157A (ko) 1989-10-28
KR0130772B1 KR0130772B1 (ko) 1998-04-15

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KR1019890003321A KR0130772B1 (ko) 1988-03-18 1989-03-17 고속디지탈신호처리프로세서

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JP2690932B2 (ja) 1997-12-17
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JPH01237765A (ja) 1989-09-22
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