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KR950001477A - 기억 회로 - Google Patents

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KR950001477A
KR950001477A KR1019940015135A KR19940015135A KR950001477A KR 950001477 A KR950001477 A KR 950001477A KR 1019940015135 A KR1019940015135 A KR 1019940015135A KR 19940015135 A KR19940015135 A KR 19940015135A KR 950001477 A KR950001477 A KR 950001477A
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KR
South Korea
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data
memory
read
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Prior art date
Application number
KR1019940015135A
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English (en)
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KR100209039B1 (ko
Inventor
마사또 오나야
스스무 야마다
Original Assignee
다까노 야스아끼
상요덴기 가부시끼가이샤
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Publication date
Application filed by 다까노 야스아끼, 상요덴기 가부시끼가이샤 filed Critical 다까노 야스아끼
Publication of KR950001477A publication Critical patent/KR950001477A/ko
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    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F5/00—Methods or arrangements for data conversion without changing the order or content of the data handled
    • G06F5/06—Methods or arrangements for data conversion without changing the order or content of the data handled for changing the speed of data flow, i.e. speed regularising or timing, e.g. delay lines, FIFO buffers; over- or underrun control therefor
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11C—STATIC STORES
    • G11C8/00—Arrangements for selecting an address in a digital store
    • G11C8/12—Group selection circuits, e.g. for memory block selection, chip selection, array selection
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11C—STATIC STORES
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    • G11C7/16—Storage of analogue signals in digital stores using an arrangement comprising analogue/digital [A/D] converters, digital memories and digital/analogue [D/A] converters 
    • G—PHYSICS
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  • General Engineering & Computer Science (AREA)
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  • Pulse Circuits (AREA)
  • Memory System (AREA)

Abstract

본 발명은 복수의 지연 시간 데이타를 용이하게 얻는 것을 목적으로 한다.
데이타 입력부(32)는 메모리(30)에 데이타를 순서재로 기입한다. 데이타 출력부(36)은 메모리(30)의 8개 영역 a내지 f부터 병력해서 데이타를 출력한다. SW1, SW2는 메모리(30)의 8개의 영역 a 내지 f로부터 독출 데이타를 각각 차례로 선택해서 출력한다. SW1, SW2에서 독출 위치를 비켜 놓음으로써 극극의 출력하는 데이타를 메모리가 다른 위치의 것으로 할 수 있다. 이로써 기입과 독출의 시간차가 다른(지연 시간이 다른) 데이타를 동시에 복수 얻을 수 있다.

Description

기억 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 기억 회로의 전체 구성을 도시하는 블럭도. 제2도는 지연 회로의 개략 구성을 도시하는 블럭도.

Claims (1)

  1. 데이타를 기억하는 메모리, 입력되어 오는 데이타를 메모리에 어드레스 순으로 순차 기입하는 라이트 수단, 메모리를 복수의 그룹으로 나누어 각 그룹으로부터 순차 어드레스 순서로 데이타를 독출함으로써 소정 어드레스 떨어진 장소에 기억되어 있는 데이타를 병렬로 순차 출력하는 리드 수단, 리드 수단으로부터의 복수의 출력을 받아 이것을 순차 선택해서 출력하는 제1선택수단 및 리드 수단으로부터의 복수의 출력을 받아 제1선택수단과는 다른 그룹의 출력을 순차 선택서 출력하는 제2선택수단을 포함하고,제1 및 제2선택수단의 출력에 의해 다른 지연 시간 데이타를 얻는 것을 특징으로 하는 기억 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019940015135A 1993-06-30 1994-06-29 기억 회로 KR100209039B1 (ko)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP5189094A JPH0784870A (ja) 1993-06-30 1993-06-30 記憶回路
JP93-189094 1993-06-30

Publications (2)

Publication Number Publication Date
KR950001477A true KR950001477A (ko) 1995-01-03
KR100209039B1 KR100209039B1 (ko) 1999-07-15

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ID=16235243

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KR1019940015135A KR100209039B1 (ko) 1993-06-30 1994-06-29 기억 회로

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EP (1) EP0632458B1 (ko)
JP (1) JPH0784870A (ko)
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DE (1) DE69413459T2 (ko)

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EP0632458A2 (en) 1995-01-04
DE69413459D1 (de) 1998-10-29
DE69413459T2 (de) 1999-02-11
JPH0784870A (ja) 1995-03-31
EP0632458B1 (en) 1998-09-23
EP0632458A3 (en) 1995-05-17
US5500825A (en) 1996-03-19
KR100209039B1 (ko) 1999-07-15

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