Nothing Special   »   [go: up one dir, main page]

DE102012104731B4 - Halbleitervorrichtungsbaugruppe und Verfahren zum Ausbilden dieser - Google Patents

Halbleitervorrichtungsbaugruppe und Verfahren zum Ausbilden dieser Download PDF

Info

Publication number
DE102012104731B4
DE102012104731B4 DE102012104731.6A DE102012104731A DE102012104731B4 DE 102012104731 B4 DE102012104731 B4 DE 102012104731B4 DE 102012104731 A DE102012104731 A DE 102012104731A DE 102012104731 B4 DE102012104731 B4 DE 102012104731B4
Authority
DE
Germany
Prior art keywords
semiconductor chip
conductive elements
assembly
molding compound
package
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
DE102012104731.6A
Other languages
English (en)
Other versions
DE102012104731A1 (de
Inventor
Yu-feng Chen
Chun-Hung Lin
Han-Ping Pu
Ming-Da Cheng
Kai-Chiang Wu
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Taiwan Semiconductor Manufacturing Co TSMC Ltd
Original Assignee
Taiwan Semiconductor Manufacturing Co TSMC Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Taiwan Semiconductor Manufacturing Co TSMC Ltd filed Critical Taiwan Semiconductor Manufacturing Co TSMC Ltd
Publication of DE102012104731A1 publication Critical patent/DE102012104731A1/de
Application granted granted Critical
Publication of DE102012104731B4 publication Critical patent/DE102012104731B4/de
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/03Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
    • H01L25/04Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
    • H01L25/065Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L27/00
    • H01L25/0657Stacked arrangements of devices
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/50Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
    • H01L21/56Encapsulations, e.g. encapsulation layers, coatings
    • H01L21/565Moulds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/28Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
    • H01L23/31Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
    • H01L23/3107Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/02Bonding areas ; Manufacturing methods related thereto
    • H01L24/03Manufacturing methods
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/02Bonding areas ; Manufacturing methods related thereto
    • H01L24/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L24/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/11Manufacturing methods
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L24/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L24/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/03Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
    • H01L25/10Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices having separate containers
    • H01L25/105Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices having separate containers the devices being of a type provided for in group H01L27/00
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/50Multistep manufacturing processes of assemblies consisting of devices, each device being of a type provided for in group H01L27/00 or H01L29/00
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/03Manufacturing methods
    • H01L2224/033Manufacturing methods by local deposition of the material of the bonding area
    • H01L2224/0333Manufacturing methods by local deposition of the material of the bonding area in solid form
    • H01L2224/03334Manufacturing methods by local deposition of the material of the bonding area in solid form using a preform
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/03Manufacturing methods
    • H01L2224/038Post-treatment of the bonding area
    • H01L2224/0383Reworking, e.g. shaping
    • H01L2224/0384Reworking, e.g. shaping involving a mechanical process, e.g. planarising the bonding area
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/03Manufacturing methods
    • H01L2224/039Methods of manufacturing bonding areas involving a specific sequence of method steps
    • H01L2224/0391Forming a passivation layer after forming the bonding area
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/0401Bonding areas specifically adapted for bump connectors, e.g. under bump metallisation [UBM]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • H01L2224/05075Plural internal layers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • H01L2224/05099Material
    • H01L2224/051Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/05147Copper [Cu] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • H01L2224/05099Material
    • H01L2224/051Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05163Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
    • H01L2224/05166Titanium [Ti] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001Internal layers
    • H01L2224/05099Material
    • H01L2224/051Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05163Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
    • H01L2224/05181Tantalum [Ta] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/0556Disposition
    • H01L2224/05571Disposition the external layer being disposed in a recess of the surface
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/06Structure, shape, material or disposition of the bonding areas prior to the connecting process of a plurality of bonding areas
    • H01L2224/061Disposition
    • H01L2224/0618Disposition being disposed on at least two different sides of the body, e.g. dual array
    • H01L2224/06181On opposite sides of the body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/11Manufacturing methods
    • H01L2224/113Manufacturing methods by local deposition of the material of the bump connector
    • H01L2224/1133Manufacturing methods by local deposition of the material of the bump connector in solid form
    • H01L2224/11334Manufacturing methods by local deposition of the material of the bump connector in solid form using preformed bumps
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/11Manufacturing methods
    • H01L2224/118Post-treatment of the bump connector
    • H01L2224/1183Reworking, e.g. shaping
    • H01L2224/1184Reworking, e.g. shaping involving a mechanical process, e.g. planarising the bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/11Manufacturing methods
    • H01L2224/119Methods of manufacturing bump connectors involving a specific sequence of method steps
    • H01L2224/1191Forming a passivation layer after forming the bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13005Structure
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/1301Shape
    • H01L2224/13012Shape in top view
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/1301Shape
    • H01L2224/13012Shape in top view
    • H01L2224/13013Shape in top view being rectangular or square
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/1301Shape
    • H01L2224/13012Shape in top view
    • H01L2224/13014Shape in top view being circular or elliptic
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/1302Disposition
    • H01L2224/13022Disposition the bump connector being at least partially embedded in the surface
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/1302Disposition
    • H01L2224/13023Disposition the whole bump connector protruding from the surface
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13075Plural core members
    • H01L2224/13078Plural core members being disposed next to each other, e.g. side-to-side arrangements
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • H01L2224/131Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • H01L2224/131Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/13101Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
    • H01L2224/13111Tin [Sn] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • H01L2224/131Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/13101Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
    • H01L2224/13113Bismuth [Bi] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • H01L2224/131Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/13101Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
    • H01L2224/13116Lead [Pb] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • H01L2224/131Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/13138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/13139Silver [Ag] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • H01L2224/131Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/13138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/13147Copper [Cu] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • H01L2224/131Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/13138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/13155Nickel [Ni] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16135Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/16145Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16135Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/16145Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
    • H01L2224/16147Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked the bump connector connecting to a bonding area disposed in a recess of the surface
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/17Structure, shape, material or disposition of the bump connectors after the connecting process of a plurality of bump connectors
    • H01L2224/171Disposition
    • H01L2224/1718Disposition being disposed on at least two different sides of the body, e.g. dual array
    • H01L2224/17181On opposite sides of the body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32135Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/32145Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73201Location after the connecting process on the same surface
    • H01L2224/73203Bump and layer connectors
    • H01L2224/73204Bump and layer connectors the bump connector being embedded into the layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • H01L2224/8119Arrangement of the bump connectors prior to mounting
    • H01L2224/81191Arrangement of the bump connectors prior to mounting wherein the bump connectors are disposed only on the semiconductor or solid-state body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • H01L2224/8119Arrangement of the bump connectors prior to mounting
    • H01L2224/81193Arrangement of the bump connectors prior to mounting wherein the bump connectors are disposed on both the semiconductor or solid-state body and another item or body to be connected to the semiconductor or solid-state body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • H01L2224/818Bonding techniques
    • H01L2224/81801Soldering or alloying
    • H01L2224/81815Reflow soldering
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/04All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
    • H01L2225/065All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/06503Stacked arrangements of devices
    • H01L2225/06513Bump or bump-like direct electrical connections between devices, e.g. flip-chip connection, solder bumps
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/04All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
    • H01L2225/065All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/06503Stacked arrangements of devices
    • H01L2225/06517Bump or bump-like direct electrical connections from device to substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/10All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers
    • H01L2225/1005All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/1011All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement
    • H01L2225/1017All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement the lowermost container comprising a device support
    • H01L2225/1023All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement the lowermost container comprising a device support the support being an insulating substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/10All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers
    • H01L2225/1005All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/1011All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement
    • H01L2225/1047Details of electrical connections between containers
    • H01L2225/1058Bump or bump-like electrical connections, e.g. balls, pillars, posts
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/10All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers
    • H01L2225/1005All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/1011All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement
    • H01L2225/1076Shape of the containers
    • H01L2225/1088Arrangements to limit the height of the assembly
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/498Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
    • H01L23/49811Additional leads joined to the metallisation on the insulating substrate, e.g. pins, bumps, wires, flat leads
    • H01L23/49816Spherical bumps on the substrate for external connection, e.g. ball grid arrays [BGA]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/562Protection against mechanical damage
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/00014Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/013Alloys
    • H01L2924/014Solder alloys
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/049Nitrides composed of metals from groups of the periodic table
    • H01L2924/04944th Group
    • H01L2924/04941TiN
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/049Nitrides composed of metals from groups of the periodic table
    • H01L2924/04955th Group
    • H01L2924/04953TaN
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/12Passive devices, e.g. 2 terminal devices
    • H01L2924/1204Optical Diode
    • H01L2924/12042LASER
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/13Discrete devices, e.g. 3 terminal devices
    • H01L2924/1304Transistor
    • H01L2924/1305Bipolar Junction Transistor [BJT]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/13Discrete devices, e.g. 3 terminal devices
    • H01L2924/1304Transistor
    • H01L2924/1306Field-effect transistor [FET]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/13Discrete devices, e.g. 3 terminal devices
    • H01L2924/1304Transistor
    • H01L2924/1306Field-effect transistor [FET]
    • H01L2924/13091Metal-Oxide-Semiconductor Field-Effect Transistor [MOSFET]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/14Integrated circuits
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/153Connection portion
    • H01L2924/1531Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
    • H01L2924/15311Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a ball array, e.g. BGA
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Computer Hardware Design (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
  • Wire Bonding (AREA)

Abstract

Halbleitervorrichtungsbaugruppe, umfassend:
eine erste Halbleiterchipbaugruppe (120B) mit leitenden Elementen (117B), die teilweise in einer Formmasse (121) eingebettet sind, wobei ein Teil der leitenden Elemente (117B) an einer Oberfläche der Formmasse (121) freigelegt ist, und wobei die Formmasse (121) wenigstens einen ersten Halbleiterchip bedeckt, wobei die leitenden Elemente (117B) direkt an die Formmasse (121) angrenzen;
Metallkontaktflächen (122B), die in der ersten Halbleiterchipbaugruppe (120B) eingebettet sind, wobei die leitenden Elemente (117B) die Metallkontaktflächen (122B) kontaktieren, und wobei die Metallkontaktflächen (122B) elektrisch mit einer Vorrichtung in dem ersten Halbleiterchip in der ersten Halbleiterchipbaugruppe (120B) verbunden sind; und
eine zweite Halbleiterchipbaugruppe (110*) mit Metallkontaktflächen (112**) und Kupfersäulen (104**) auf den Metallkontaktflächen (112**), wobei die Anzahl der Kupfersäulen (104**) auf jeder Metallkontaktfläche (112**) zwei oder mehr ist, wobei die leitenden Elemente (117B) der ersten Halbleiterchipbaugruppe (120B) mit den Kupfersäulen (104**) auf den Metallkontaktflächen (112**) der zweiten Halbleiterchipbaugruppe (110*) gebondet sind, um Verbindungselemente auszubilden.

Description

  • Die vorliegende Erfindung betrifft Mechanismen zum Ausbilden von Verbindungselementen für eine Baugruppe-auf-Baugruppe.
  • Halbleitervorrichtungen werden bei einer Vielzahl von elektronischen Anwendungen verwendet, wie beispielsweise bei PC's, Mobiltelefonen, Digitalkameras und anderen elektronischen Gegenständen. Halbleitervorrichtungen werden typischerweise hergestellt, indem sequenziell isolierende oder dielektrische Schichten, leitende Schichten und Halbleiterschichten über einem Halbleitersubstrat abgeschieden und dann unter Verwendung von Lithographie strukturiert werden, um Schaltkreiskomponenten und Elemente auszubilden.
  • Die Halbleiterindustrie verbessert stetig die Integrationsdichte von verschiedenen elektronischen Komponenten (z. B. Transistoren, Dioden, Widerstände, Kondensatoren, usw.), indem kontinuierlich die minimalen Strukturgrößen reduziert werden, was es erlaubt, mehr Komponenten in einen gegebenen Bereich zu integrieren. Diese kleineren elektronischen Komponenten erfordern bei einigen Anwendungen auch kleinere Baugruppen, die eine geringere Fläche und/oder eine geringere Höhe als frühere Baugruppen aufweisen.
  • Dementsprechend wurden neue Packtechniken entwickelt, wie Baugruppe-auf-Baugruppe (Package on Package, PoP), bei der eine obere Baugruppe mit einem Vorrichtungschip an eine untere Baugruppe mit einem anderen Vorrichtungschip gebondet wird. Durch das Anwenden dieser neuen Packtechniken kann der Integrationslevel der Baugruppen erhöht werden. Bei diesen relativ neuen Typen von Packtechniken für Halbleiter ergeben sich Herausforderungen bezüglich der Herstellung.
  • DE 197 54 372 A1 zeigt eine Chipanordnung mit einem Chip und einer Umverdrahtungslage aufweisend eine Leiterbahnstruktur mit Anschlussflächen des Chips gegenüberliegend angeordneten Chipkontakten und vom Chip abgewandt angeordneten Anschlusskontakten zur Definition einer äußeren Anschlussflächenanordnung der Chipanordnung.
  • US 2007/0200257 A1 zeigt eine stapelbare Einheit eines integrierten Schaltungssystems, das eine erste integrierte Schaltung ausbildet mit einer darauf vorgesehenen Zwischenverbindung, die eine externe Zwischenverbindung mit einer oberen Spitze und einer unteren Spitze aus einem Leiterrahmen ausbildet, wobei der erste integrierte Schaltkreis auf der externen Zwischenverbindung mit der Zwischenverbindung auf der unteren Spitze und unter der oberen Spitze montiert ist, und eine Verkapselung um die Zwischenverbindung mit einer freiliegenden Oberfläche ausgebildet ist.
  • US 2007/0187826 A1 zeigt eine 3D-Stapelsystemeinheit, umfassend ein Bereitstellen eines Substrats, ein Anbringen einer Ballgitterfeldeinheit in einer umgekehrten Position auf das Substrat, ein Ausbilden einer unteren Einheit, wobei die untere Einheit mit der Ballgitterfeldeinheit und das Substrat durch eine Formmasse eingekapselt ist, und ein Befestigen einer zweiten integrierten Schaltungseinheit über der unteren Einheit.
  • US 2011/0117 700 A1 zeigt, dass ein Abstand zwischen den leitenden Elementen einer Baugruppe-auf-Baugruppe Anordnung mehrere hundert µm betragen kann.
  • Der Erfindung liegt die Aufgabe zugrunde, eine Halbleitervorrichtungsbaugruppe sowie ein Verfahren zum Ausbilden derselben zu schaffen, durch welche kleinere Baugruppengrößen und zusätzliche Verbindungen ermöglicht werden.
  • Diese Aufgabe wird durch die Halbleitervorrichtungsbaugruppe nach Anspruch 1 sowie durch das Verfahren nach Anspruch 6 gelöst.
  • Für ein vollständigeres Verständnis der vorliegenden Erfindung und deren Vorteile wird nun auf die folgende Beschreibung in Verbindung mit den angehängten Zeichnungen Bezug genommen.
    • 1A zeigt eine perspektivische Ansicht einer Baugruppe.
    • 1B zeigt eine Schnittansicht eines Teils einer Baugruppe der 1A entlang der Linie P-P.
    • 1C zeigt eine vergrößerte Schnittansicht des Bereichs 150 der 1B.
    • 1D zeigt eine Öffnung, die gemäß einigen Beispielen unter Verwendung von Laserbohren ausgebildet wird, um ein Verbindungselement mit einem leitenden Objekt auszubilden.
    • 2A zeigt eine Chip-Baugruppe mit leitenden Elementen, die gemäß einigen Ausführungsformen in eine Formmasse eingebettet sind.
    • 2B zeigt, dass die Formmasse gemäß einigen Ausführungsformen teilweise entfernt ist, um leitende Elemente freizulegen.
    • 2C zeigt eine Chip-Baugruppe mit leitenden Elementen, die gemäß einigen Ausführungsformen in eine Formmasse eingebettet sind.
    • 3A-3F zeigen Schnittansichten von Baugruppen, die gemäß einigen Ausführungsformen basierend auf drei Prozessschritten zum Ausbilden von Verbindungselementen bearbeitet sind.
    • 4A zeigt eine Lötkugel über einer Metallkontaktfläche gemäß einigen Ausführungsformen.
    • 4B zeigt gemäß einigen Ausführungsformen ein Diagramm einer maximalen Lötkugelhöhe und eines Durchmessers als Funktion einer UBM (Unterhöckermetallisierung, engl. Under Bump Metallization, UBM) -Schichtgröße.
    • 5 zeigt die Höhe eines Verbindungselements nach einem Reflow als Funktion einer freigelegten Breite einer Lötkugel vor einem Reflow gemäß einigen Ausführungsformen.
    • 6A und 6B zeigen zwei beispielhafte Baugruppen gemäß einigen Ausführungsformen für eine Belastungssimulation an deren Verbindungselementen.
    • 7A zeigt ein Beispiel von Kontakten auf einer Baugruppe.
    • 7B-7C zeigen verschiedene beispielhafte Ausführungsformen von Kontakten auf einer Baugruppe.
  • Entsprechende Bezugszeichen und Symbole in den verschiedenen Figuren beziehen sich im allgemeinen auf entsprechende Teile, soweit es nicht anderweitig angezeigt ist. Die Figuren sind gezeichnet, um die relevanten Aspekte der Ausführungsformen zu illustrieren, und sie sind nicht notwendigerweise maßstabsgetreu gezeichnet.
  • Die Herstellung und die Verwendung von Ausführungsformen der vorliegenden Erfindung sind nachfolgend im Detail diskutiert.
  • 1A zeigt eine perspektivische Ansicht einer Baugruppe 100 mit einer Baugruppe 110, die an eine andere Baugruppe 120 gebondet ist, die wiederum an ein Substrat 130 gebondet ist. Jede Baugruppe, wie Baugruppe 110 oder Baugruppe 120, umfasst wenigstens einen Halbleiterchip (nicht gezeigt). Der Halbleiterchip umfasst ein Substrat, wie es bei der Herstellung von integrierten Halbleiterschaltkreisen verwendet wird, und integrierte Schaltkreise können darin und/oder darauf ausgebildet sein. Das Halbleitersubstrat kann jede beliebige Ausgestaltung mit Halbleitermaterialien aufweisen, diese umfassend, aber nicht begrenzt auf, Bulk-Silizium, einen Halbleiterwafer, ein Silizium-auf-Isolator (silicon-on-insulator, SOI)-Substrat, oder ein Siliziumgermanium-Substrat. Andere Halbleitermaterialien mit Elementen der Gruppe III, IV und V können ebenfalls verwendet werden. Das Substrat 130 kann weiter mehrere Isolationsstrukturen (nicht gezeigt) umfassen, wie Flachgraben-Isolationsstrukturen (shallow trench isolation, STI) oder Strukturen mit lokaler Oxidation von Silizium (local oxidation of silicon, LOCOS). Die Isolationsstrukturen können die verschiedenen mikroelektronischen Elemente definieren und isolieren. Beispiele der verschiedenen mikroelektronischen Elemente, die im Substrat 130 ausgebildet sein können, umfassen Transistoren (z. B. Metalloxidhalbleiter-Feldeffekttransistoren (MOSFET), komplementäre Metalloxidhalbleiter (CMOS)-Transistoren, bipolare Kontakttransistoren (bipolar junction transistor, BJT), Hochspannungstransistoren, Hochfrequenztransistoren, p-Kanal- und/oder n-Kanal-Feldeffekttransistoren (PFETs/ NFETs), usw.), Widerstände, Dioden, Kondensatoren, Induktivitäten, Sicherungen, und andere geeignete Elemente. Verschiedene Arbeitsschritte werden ausgeführt, um die verschiedenen mikroelektronischen Elemente auszubilden, umfassend Abscheidung, Ätzen, Implantation, Photolithographie, Ausheizen, und andere geeignete Prozesse. Die mikroelektronischen Elemente sind untereinander verbunden, um die integrierte Schaltkreisvorrichtung zu bilden, wie eine logische Vorrichtung, Speichervorrichtung (z. B. SRAM), RF-Vorrichtung, Eingang/Ausgang (I/O)-Vorrichtung, System-auf-Chip (system-on-chip, SoC)-Vorrichtung, Kombinationen davon, und andere geeignete Arten von Vorrichtungen.
  • Das Substrat 130 kann aus einem Halbleiterwafer oder einem Teil eines Wafers bestehen. In einigen Ausführungsformen umfasst das Substrat 130 Silizium, Galliumarsenid, Silizium-auf-Isolator (silicon-on-insulator, Sol) oder andere ähnliche Materialien. In einigen Ausführungsformen umfasst das Substrat 130 auch passive Vorrichtungen, wie Widerstände, Kondensatoren, Induktivitäten und Ähnliches, oder aktive Vorrichtungen wie Transistoren. In einigen Ausführungsformen umfasst das Substrat 130 weitere integrierte Schaltkreise. Das Substrat 130 kann weiter Substratdurchgangskontaktierungen (through substrate vias, TSVs) umfassen und kann ein Interposer oder Zwischenelement sein. Weiter kann das Substrat 130 aus anderen Materialien bestehen. Beispielsweise ist das Substrat 130 in einigen Ausführungsformen eine Schaltkreisplatte mit multiplen Schichten. In einigen Ausführungsformen umfasst das Substrat 130 auch Bismaleimidtriazin(BT)-Harz, FR-4 (ein Verbundmaterial, das aus gewobenen Fiberglasfasern mit einem Epoxidharzbinder besteht und das feuerresistent ist), Keramik, Glas, Plastik, Klebestreifen, Film, oder andere Trägermaterialien, die die leitenden Kontaktflächen oder Ebenen tragen können, die erforderlich sind, um leitende Anschlüsse aufzunehmen.
  • Die Baugruppe 110 ist über Verbindungselemente 115 an die Baugruppe 120 gebondet, und Baugruppe 120 ist über Verbindungselemente 125 an das Substrat 130 gebondet. 1B zeigt eine Schnittansicht eines Bereichs der Baugruppe der 1A entlang der Linie P-P. 1B zeigt Verbindungselemente 115 und 125 nahe dem Rand der Baugruppe 100. In einigen Beispielen sind Verbindungselemente 125 nahe dem Zentrum der Baugruppe 120 vorhanden. Ein Bereich 150 in 1B ist durch ein Rechteck markiert, und Details des Bereichs 150 sind in 1C gezeigt.
  • 1C zeigt Details des Bereichs 150 der 1B. Baugruppe 110 umfasst einen Halbleiterchipbereich A, der einen Halbleiterchip (nicht gezeigt) aufweist, der von einer Formmasse 111 bedeckt ist. Die Formmasse 111 befindet sich anfänglich in einer flüssigen Form und wird getrocknet, nachdem sie auf den Halbleiterchip aufgetragen wurde, um wenigstens einen Teil des Halbleiterchips zu bedecken. Beispielsweise kann die Formmasse 111 anfänglich Epoxid, eine Füllmasse (filler), ein Lösungsmittel, usw. umfassen. In einigen Ausführungsformen kann die Formmasse 111 durch Transfervergießen ausgebildet werden, wo ein abgemessenes Vergussmaterial (gewöhnlicherweise eine Duroplaste) vorgeheizt wird, so dass es flüssig ist, bevor es auf das Substrat aufgetragen wird. Nach dem Auftragen wird das Vergussmaterial erhitzt, um den Vergussprozess zu vollenden. Verschiedene Harze können als Vergussmaterialien für das Ausbilden der Formmasse verwendet werden.
  • Baugruppe 110 umfasst auch einen Verteilungsbereich B mit Verbindungsstrukturen, wie einer oder mehrerer Verteilungsschichten (redistribution layers, RDLs), die Verbindungen zwischen dem Halbleiterchip in der Baugruppe und den Verbindungselementen 115 herstellen. Ähnlich umfasst die Baugruppe 120 einen Halbleiterchipbereich A* mit einem Halbleiterchip (nicht gezeigt), der in einer Formmasse 121 eingebettet ist. Die Baugruppe 120 umfasst ebenfalls einen Verteilungsbereich B* mit Verbindungsstrukturen, wie einer oder mehrerer Verteilungsschichten (RDLs), die Verbindungen zwischen dem Halbleiterchip in der Baugruppe und den Verbindungselementen 125 herstellen.
  • Beispielhafte Mechanismen für das Ausbilden der Baugruppen 110 und 120 sind in der am 8. September 2011 eingereichten US-Patentanmeldung Nr. 13/228,244 mit dem Titel „Packaging Methods and Structures Using a Die Attach Film“ dargelegt.
  • 1C zeigt, dass Verbindungselemente 115 mit Metallkontaktflächen 112 der Baugruppe 110 und Metallkontaktflächen 122 der Baugruppe 120 in Kontakt stehen, und dass Verbindungselemente 125 mit Metallkontaktflächen 123 der Baugruppe 120 und Metallkontaktflächen 131 des Substrats 130 in Kontakt stehen. Die Metallkontaktflächen 112 sind elektrisch mit Vorrichtungen in einem Halbleiterchip (nicht gezeigt) in Baugruppe 110 verbunden. Die Metallkontaktflächen 122 sind elektrisch mit Vorrichtungen in einem Halbleiterchip (nicht gezeigt) in der Baugruppe 120 verbunden. 1C zeigt, dass Teile der Verbindungselemente 115 in der Formmasse 121 der Baugruppe 120 eingebettet sind. Die Öffnungen für das Einbetten der Verbindungselemente 115 werden gemäß einigen Ausführungsformen durch Laserbohren ausgebildet. 1D zeigt eine Öffnung 114 für das Einbetten eines Verbindungselements 115, die durch die Verwendung von Laserbohren ausgebildet wurde, um die Formmasse 112 gemäß einigen Ausführungsformen zu entfernen. Die Öffnung 114 weist ein Querschnittsprofil auf, das oben größer und unten kleiner ist, um das Platzieren eines leitenden Elements, wie einer Lötkugel, in der Öffnung zu vereinfachen. Aufgrund der Prozessbegrenzungen des Laserbohrens ist eine Breite W eines oberen Bereichs der Öffnung 114 in einigen Ausführungsformen im Bereich von etwa 0,2 mm bis etwa 0,4 mm. Nach dem Ausbilden der Öffnung 114 wird ein leitendes Objekt 116 (durch die gestrichelte Linie angedeutet), wie eine Lötkugel, in der Öffnung 114 platziert. Der Durchmesser des leitenden Objekts 116 ist kleiner als die Breite W der Öffnung 114. Der Abstand zwischen dem oberen Bereich der Öffnung und dem leitenden Objekt 116 ist der Abstand „G“, wie in 1D gezeigt ist. Nach einem Reflow (Rückfluss, Aufschmelzen) steht das leitende Objekt 116 in Kontakt mit einem leitenden Material über der Metallkontaktfläche 112 der Baugruppe 110, um Verbindungselemente 115 auszubilden. 1C zeigt, dass Verbindungselemente 115 nach einem Reflow Metallkontaktflächen 122 kontaktieren und eine Lücke O zur oberen Oberfläche der Formmasse 121 aufweisen. Die leitenden Objekte 116 können einen direkten Kontakt mit Metallkontaktflächen 112 herstellen, die kein anderes leitendes Material über ihrer Oberfläche aufweisen, um die Verbindungselemente 115 auszubilden.
  • Der Abstand P von Verbindungselementen 115 ist durch die Breite W der Öffnungen 114 begrenzt. Die größte Breite W der Öffnung ist im Bereich von etwa 0,23 mm bis etwa 0,5 mm. Der Abstand P ist in einem Bereich von etwa 0,35 mm bis etwa 0,6 mm. Die Höhe H ist so gewählt, dass sie ausreichend ist, um die gesamte Baugruppenhöhe für einen Formfaktor gering zu halten. Die Höhe C zwischen den Baugruppen 110 und 120 wird auch durch die Größe der in den Öffnungen 114 platzierten Verbindungselemente beeinflusst. Die Höhe C ist in einem Bereich von etwa 0,25 mm bis etwa 0,35 mm.
  • Für ein vorteilhaftes Packen ist es wünschenswert, den Abstand P zwischen den Verbindungselementen zu reduzieren, um eine kleinere Baugruppengröße und zusätzliche Verbindungen zu ermöglichen. Deshalb sind neue Mechanismen für das Ausbilden der Verbindungselemente 115 mit kleinerem Abstand P wünschenswert. 2A zeigt eine Chipbaugruppe 120' mit leitenden Elementen 117', die gemäß einigen Ausführungsformen in eine Formmasse 121' eingebettet sind. Die leitenden Elemente 117' werden auf Metallkontaktflächen 122 ausgebildet oder aufgebracht, bevor die Formmasse 121' auf dem Bereich B* der Baugruppe 120' ausgebildet wird. Beispielsweise können leitende Elemente 117' auf Metallkontaktflächen 122 galvanisiert und durch Reflow (Rückfluss, Aufschmelzen) in eine Kugelform gebracht werden. Danach wird die Formmasse 121' über den leitenden Elementen 117' ausgebildet. Alternativ können Metallkugeln auf Metallkontaktflächen 122 platziert und an die Metallkontaktflächen 122 gebondet werden, um leitende Elemente 117' auszubilden. Die leitenden Elemente 117' können aus jedem leitenden Material mit geringem Widerstand bestehen. Beispielsweise können sie aus einem Lötmittel (z.B. Lötzinn) bestehen, einer Lötmittel-Verbindung, Gold, einer Gold-Verbindung, usw.. Beispielhafte Elemente, die in einer Lötmittel-Verbindung enthalten sein können, umfassen Sn, Pb, Ag, Cu, Ni, Bi oder Kombinationen davon.
  • 2B zeigt, dass die Formmasse 121' teilweise entfernt wurde, um die leitenden Elemente 117' gemäß einigen Ausführungsformen freizulegen. Der Entfernungsprozess 160 kann jeder anwendbare Prozess sein, wie Schleifen, Polieren, usw.. Die freigelegten leitenden Elemente 117' weisen eine Breite W1 auf. Da die leitenden Elemente 117' in der Formmasse 121' eingebettet werden, bevor sie freigelegt werden, ist kein Laserbohren erforderlich, um die Öffnungen für die leitenden Elemente 117' auszubilden. Im Ergebnis gibt es keine Lücke zwischen der oberen Oberfläche der Formmasse 121' und den leitenden Elementen 117', wie es bei 1C der Fall ist, wo eine Lücke „O“ vorhanden ist. Weiter kann die Größe (oder Breite) W1 der leitenden Elemente 117' kleiner sein als die der leitenden Elemente 116, da sie nicht länger durch die Größe der Öffnung 114 aufgrund der Beschränkung beim Laserbohren beeinflusst wird. Im Ergebnis kann der Abstand P1 kleiner als der Abstand P der 1C sein. In einigen Ausführungsformen ist der Abstand P1 im Bereich von etwa 100 µm bis etwa 500 µm. In einigen Ausführungsformen ist eine Breite W1 in einem Bereich von etwa 100 µm bis etwa 400µm, was gleich oder kleiner als die Breite W der Öffnungen der oben beschriebenen 1D ist.
  • Bei einer alternativen Ausführungsform können die leitenden Elemente 117" teilweise in der Formmasse eingebettet sein, und ein Teil der leitenden Elemente 117" kann freigelegt sein, wie in 2C gezeigt ist. Eine Form oder ein Film können gegen die Formmasse 121" und die leitenden Elemente 117" während des Ausbildens der Formmasse 121" gedrückt werden, um zu ermöglichen, dass ein Teil der leitenden Elemente 117" freigelegt wird. Die Breite der freigelegten leitenden Elemente 117" ist W2 . Da die leitenden Elemente 117" in der Formmasse 121" eingebettet sind, ist auch ein Abstand P2 der leitenden Elemente 117" kleiner als der Abstand P in der oben beschriebenen 1C. In einigen Ausführungsformen ist der Abstand P2 in einem Bereich von etwa 100 µm bis etwa 500 µm. In einigen Ausführungsformen ist eine Breite W2 in einem Bereich von etwa 100 µm bis etwa 400 µm.
  • 3A zeigt eine Baugruppe 110A mit Kontakten 104A und eine Baugruppe 120A mit leitenden Elementen 117A . Die Kontakte 104A sind ausgebildet, so dass sie Metallkontaktflächen 122A bedecken, und sie bestehen aus einem leitenden Material/leitenden Materialien. In einigen Ausführungsformen bestehen die Kontakte 104A aus einem Lötmittel (z.B. Lötzinn). Die leitende Elemente 117A der Baugruppe 120A werden durch einen unter Bezugnahme auf die 2A und 2B beschriebenen Prozess ausgebildet. Die Kontakte 104A und die leitenden Elemente 117A werden durch Reflow aneinander gebondet, um Verbindungselemente 115A auszubilden, wie in 3B gezeigt ist. Die Höhe eines Verbindungselements 115A ist HA.
  • 3C zeigt eine Baugruppe 110B mit Kontakten 104B und eine Baugruppe 120B mit leitenden Elementen 117B gemäß einigen Ausführungsformen. Die Kontakte 104B sind ausgebildet, so dass sie Metallkontaktflächen 122B bedecken, und sie bestehen aus einem leitenden Material/leitenden Materialien. In einigen Ausführungsformen bestehen die Kontakte 104B aus einem Lötmittel (z.B. Lötzinn). Die leitenden Elemente 117B der Baugruppe 120B werden in einigen Ausführungsformen durch einen Prozess ausgebildet, wie er in 2C beschrieben ist. Die Kontakte 104B und die leitenden Elemente 117 werden durch Reflow aneinander gebondet, um Verbindungselemente 115B auszubilden, wie in 3D gemäß einigen Ausführungsformen gezeigt ist. Die Höhe der Verbindungselemente 115B ist HB .
  • Die Baugruppe 110C weist keine Kontakte (wie Kontakte 104B ) auf den Metallkontaktflächen 122c auf, wie in 3E gezeigt ist. Leitende Elemente 117c sind in direktem Kontakt mit den Metallkontaktflächen 112C , um Verbindungselemente 115c auszubilden, wie in 3F gezeigt ist. Die Höhe der Verbindungselemente 115c ist Hc.
  • 4A zeigt eine Lötkugel 401 über einer Metallkontaktfläche 405 nach einem Reflow gemäß einigen Ausführungsformen. Die Breite der Metallkontaktfläche 405 ist etwa 200 µm, und sie umfasst eine UBM-Schicht (Unterhöckermetallisierungsschicht, under bump metallization (UBM) layer) 402. Die UBM-Schicht 402 kann eine Klebeschicht und/oder eine Nässungsschicht umfassen. In einigen Ausführungsformen kann die UBM-Schicht 402 auch als eine Diffusionssperrschicht dienen. In einigen Ausführungsformen umfasst die UBM-Schicht 402 Titan (Ti), Titannitrid (TiN), Tantalnitrid (TaN), Tantal (Ta), oder Ähnliches. In einigen Ausführungsformen umfasst die UBM-Schicht 402 weiter eine Kupferschicht (copper seed layer).
  • In einigen Ausführungsformen ist die Dicke der UBM-Schicht 402 in einem Bereich von etwa 0,05 µm bis etwa 0,5 µm. Die Lötkugel 401 wird durch Reflow einer runden Lötkugel mit einem Durchmesser von etwa 250 µm über der UBM-Schicht 402 ausgebildet. Das Lötmittel verteilt sich über die Oberfläche der UBM-Schicht 402 und die Oberflächenspannung führt dazu, dass die Lötkugel 401 einen Durchmesser von etwa 246 µm aufweist, wie in 4A gezeigt ist. Die Höhe der Lötkugel 401 ist etwa 216 µm. Das Profil der Reflow-Lötkugel auf einer UBM-Schicht kann durch Simulationswerkzeuge simuliert werden, wie SURFACE EVOLVER oder ANSYS FLUENT. SURFACE EVOLVER ist ein interaktives Programm für das Studieren von Oberflächen, die durch Oberflächenspannung und andere Energieskalen ausgebildet werden, und die verschiedenen Randbedingungen unterliegen. SURFACE EVOLVER wurde am THE GEOMETRY CENTER an der UNIVERSITY OF MINNESOTA entwickelt. ANSYS FLUENT ist ein Simulationswerkzeug von ANSYS INC., Canonsburg, Pennsylvania. Solche Simulationswerkzeuge können verwendet werden, um Lötkugeln mit verschiedenen Breiten und Höhen zu simulieren.
  • 4B zeigt ein Diagramm einer simulierten Lötkugelhöhe nach einem Reflow als Funktion des Durchmessers (also der maximalen Breite) und UBM-Größe (oder Breite) gemäß einigen Ausführungsformen. Die Kurve 410 zeigt eine Kugelhöhe für verschiedene UBM-Größen, wenn die Durchmesser der Lötkugeln (vor dem Reflow) dieselben wie die Breiten (oder Größen) der darunterliegenden UBM-Schichten sind. Die Kurve 410 zeigt, dass, wenn eine Lötkugel mit einem Durchmesser von 200 µm einen Reflow vollzieht, um an eine UBM-Schicht (kreisförmig) mit einem Durchmesser von 200 µm gebondet zu werden, die Kugelhöhe nach einem Reflow 152 µm ist. Wenn der Durchmesser der Kugel vor dem Reflow 250 µm ist, ist die Höhe nach dem Reflow (auf der 250 µm UBM-Schicht) 186 µm. Die Kurve 420 zeigt, dass, wenn eine Lötkugel mit einem Durchmesser von 200 µm einen Reflow vollzieht, um an eine UBM-Schicht (kreisförmig) mit einem Durchmesser von 200 µm gebondet zu werden, die Kugelbreite nach einem Reflow 218 µm ist. Wenn der Durchmesser der Kugel vor dem Reflow 250 µm ist, ist die maximale Breite nach dem Reflow (auf der 250 µm UBM-Schicht) 274 µm. Da die Kugelgrößen vor dem Reflow für die Kurven 410 und 420 mit den Breiten (oder Größen) der UBM-Schichten korrelieren, sind die Kurven 410 und 420 linear.
  • 4B zeigt einen Datenpunkt 411, der die Kugelhöhe nach einem Reflow einer Kugel mit dem Durchmesser 250 µm vor dem Reflow angibt, die an eine UBM-Schicht mit einem Durchmesser von 150 µm gebondet wird. Der Datenpunkt 411 zeigt, dass die Höhe 223 µm ist. 4B zeigt auch einen Datenpunkt 412 der maximalen Breite der Lötkugel nach einem Reflow. Der Datenpunkt 412 zeigt, dass maximale Breite 256 µm ist. Die Datenpunkte 411 und 412 zeigen, dass die Höhe und der Durchmesser auch von der Kugelgröße vor dem Reflow abhängen.
  • Die Datenpunkte der maximalen Kugelbreiten nach dem Reflow helfen, den minimalen Abstand zu bestimmen, der erforderlich ist, um einen Kurzschluss zu verhindern. Eine Toleranz kann zu einer maximalen Breite addiert werden, um den minimalen Abstand für Verbindungselemente zu erhalten. Die Kurve 450 zeigt eine beispielhafte Kurve für den Abstand gemäß einigen Ausführungsformen. Eine Toleranz (M) ist zur maximalen Verbindungselementbreite addiert, und die gesamte Breite ist der minimale Abstand. Die Toleranz M kann sich mit der Kugelgröße (vor dem Reflow) ändern. In einigen Ausführungsformen ist die Toleranz M ein Prozentanteil der maximalen Breite der Reflow-Lötkugeln. In einigen Ausführungsformen ist die Toleranz M im Bereich von etwa 5% bis etwa 7% der maximalen Breite. In einigen Ausführungsformen ist die Toleranz M im Bereich von etwa 5% bis etwa 30% der maximalen Breite.
  • 5 zeigt eine simulierte Höhe HB von Verbindungselementen 115B nach einem Reflow als Funktion einer freigelegten Breite (oder Durchmesser) der Lötkugel W2 vor dem Reflow (wie in 2C gezeigt) gemäß einigen Ausführungsformen. Die Datenpunkte mit gefüllten Dreiecken in 5 sind Datenpunkte von Verbindungen, die durch die Baugruppe 120B und die Baugruppe 110B gebildet werden. Die Datenpunkte mit gefüllten Dreiecken befinden sich auf der Kurve 510. Die eingebetteten Lötkugeln in Baugruppe 120B für die Datenpunkte der Kurve 510 weisen einen Durchmesser von 250 µm auf, und die UBM-Schicht weist ebenfalls einen Durchmesser von 250 µm auf. Die Lötkugeln für die Baugruppe 110B für die Datenpunkte der Kurve 510 weisen einen Durchmesser von 200 µm auf, und die UBM-Schicht weist einen Durchmesser von 250 µm auf. Die Daten zeigen, dass die Höhe HB abnimmt, wenn die freigelegte Breite W2 der eingebetteten Lötkugeln zunimmt.
  • Die Kurve 520 umfasst Datenpunkte mit offenen Dreiecken für eingebettete Lötkugeln mit einem Durchmesser von 250 µm auf UBM-Schichten mit einem Durchmesser von 200 µm, was kleiner als 250 µm für Kurve 510 ist. Der Durchmesser der Lötkugel für die Baugruppe 110B für Kurve 520 ist ebenfalls 200 µm. Die Kurve 520 überlappt fast mit Kurve 510, was zeigt, dass der Einfluss von verschiedenen UBM-Breiten minimal ist, wenn die Differenz 50 µm ist.
  • 5 zeigt auch einen Datenpunkt 511 für Verbindungselemente 115c der 3F, wenn die Baugruppe 110c nicht auf jeder Metallkontaktfläche 112c eine Lötkugel aufweist. Die Baugruppe 120c für Datenpunkt 511 weist auch Lötkugeln mit einem Durchmesser von 250 µm auf einer UBM-Schicht mit einem Durchmesser von 200 µm auf. Ohne die Lötkugeln auf der Baugruppe 120c ist die Höhe der Verbindungselemente 115C um etwa 80 µm geringer (verglichen mit den Kurven 510 und 520). 5 zeigt auch eine Kurve 530 mit Datenpunkten mit gefüllten Quadraten. Die eingebetteten Lötkugeln in Baugruppe 120B für die Datenpunkte der Kurve 530 weisen einen Durchmesser von 250 µm auf, und die UBM-Schicht weist einen Durchmesser von 200 µm auf. Die Preflow-Lötkugeln (Lötkugeln vor einem Reflow) auf der Baugruppe 120B für die Kurve 530 sind kleiner als die Preflow-Lötkugeln auf der Baugruppe 120B der Kurven 510 und 520. Die Lötkugeln für die Baugruppe 110B der Datenpunkte der Kurve 530 weisen einen Durchmesser von 200 µm auf einer UBM-Schicht mit einem Durchmesser von 250 µm auf. Die Lötkugeln auf der Baugruppe 110B der Kurve 530 sind ähnlich zu denen der Kurven 510 und 520. Aufgrund der reduzierten Lötkugelgröße auf der Baugruppe 120B liegen die Datenpunkte auf der Kurve 530 niedriger als die Datenpunkte auf den Kurven 510 und 520.
  • Wie oben erwähnt ist es wünschenswert, eine kleinere Gesamtbaugruppenhöhe zu haben, um einen kleinen Formfaktor zu erreichen. 5 zeigt, dass größere freigelegte Breiten von eingebetteten Lötkugeln in einer geringeren Verbindungshöhe resultieren. Deshalb können die Breiten von freigelegten eingebetteten Lötkugeln erhöht werden, um kleinere Verbindungshöhen zu erreichen. Wenn die freigelegten Breiten gleich oder größer als 100 µm für die oben beschriebenen Baugruppen sind, ist die gesamte Verbindungshöhe gleich oder kleiner als etwa 300 µm.
  • 6A zeigt gemäß einigen Ausführungsformen eine Baugruppe 100A'' mit einer Baugruppe 120A'', die eingebettete Lötkugeln aufweist. Baugruppe 100A'' ist ähnlich zur oben beschriebenen Baugruppe 100, mit Ausnahme davon, dass die Baugruppe 120A'' ähnlich zu den 2C, 3C und 3E eingebettete Lötkugeln in einer Formmasse aufweist, anstelle davon, dass die Lötkugeln wie in 1B in Laserbohrlöchern platziert sind. 6B zeigt gemäß einigen Ausführungsformen eine Baugruppe 100B'' mit einer Baugruppe 120B'', die eingebettete Lötkugeln aufweist. Die Baugruppe 100B'' ist ähnlich zur Baugruppe 100A'' mit Ausnahme davon, dass die Lötkugeln auf der Baugruppe 110B'' ein Volumen aufweisen, das zweimal so groß ist wie das Volumen der Lötkugeln auf der Baugruppe 100A''. Im Ergebnis ist die Höhe HB'' der 6B größer als die Höhe HA'' der 6A. Eine Belastungssimulation zeigt, dass, wenn die Belastung an den Randverbindungselementen 125A'' als Referenzwert verwendet wird (das Belastungsverhältnis ist 1), das Belastungsverhältnis (stress ratio, SR) des Verbindungselements 115A'' 1,2 ist. Im Gegensatz dazu ist das Belastungsverhältnis des Randverbindungselements 125B'' der 6B 1,17, was größer als das Belastungsverhältnis von 1 für das Randverbindungselement 125A'' der 6A ist. Weiter ist das Belastungsverhältnis des Verbindungselements 115B'' 0,85, was kleiner als das Belastungsverhältnis von 1,2 des Verbindungselements 115A'' ist.
  • Der Unterschied in den Belastungsverhältnissen zwischen den zwei Strukturen entsteht aufgrund des zusätzlichen Lötmittelvolumens der Baugruppe 110B'' (das Zweifache des Lötmittelvolumens der Baugruppe 110') und der Höhe HB'', die größer als HA'' ist. In einigen Ausführungsformen wird das Volumen des Lötmittelmaterials in der Lötkugel auf der Baugruppe 110A'' oder 110B'' so gewählt, dass die optimale Herstellausbeute erzielt wird. Beispielsweise, wenn aufgrund einer hohen Belastung ein Risiko eines Brechens der Lötkugel auf den Randverbindungselementen besteht, wie bei 125B'', ist es wünschenswert, die Struktur in 6A mit einem geringeren Lötmittelvolumen auf der Baugruppe 110A'' zu wählen und die Baugruppe-auf-Baugruppe-Höhe HA'' zu verringern. Auf der anderen Seite, wenn ein Brechen des Lötmittels der Randverbindungselemente 125B'' unbedeutend ist und ein Brechen des Lötmittels des Verbindungselements 125A'' von Bedeutung ist, sollte die Struktur der 6B gewählt werden. Dies ist, da 6B eine geringeren Belastung an den Verbindungselement 125A'' aufweist. Die entstehende Belastung wird, wie oben beschrieben, durch die Verwendung eines ANSYS-Belastungssimulators simuliert.
  • Die in den 3A-3D und 6A-6B beschriebenen Baugruppenstrukturen zeigen obere Baugruppen 110A , 110B , 110A'' und 110B'' mit Kontakten 104, die Lötkugeln sind, und die an leitende Elemente 117', 117" der unteren Baugruppen 120A , 120B , 120A'' und 120B'' gebondet sind. Die Kontakte 104 können jedoch aus anderen leitenden Materialien bestehen und andere Formen aufweisen. Beispielsweise können die Kontakte 104* Kupfersäulen sein, wie in 7A gezeigt ist. Kupfersäulen 104* können auf einer UBM-Schicht 102* ausgebildet sein, die die Metallkontaktfläche 112* bedeckt. Die Breite der Kupfersäule 104* (W*) ist im Bereich von etwa 100 µm bis etwa 250 µm. Die Höhe der Kupfersäule 104* (H*) ist im Bereich von etwa 10 µm bis etwa 200 µm. Alternativ können die Kontakte 104** Kupfersäulen sein, die eine Breite aufweisen, die kleiner als die der UBM-Schicht 102* ist, wie in 7B gemäß einigen Ausführungsformen gezeigt ist. Es können gemäß einigen Ausführungsformen zwei oder mehrere solcher kleiner Kupfersäulen auf einer UBM-Schicht 102** vorhanden sein, die die Metallkontaktfläche 112** bedeckt. 7C zeigt verschiedene Draufsichten von Kupfersäulen 104** gemäß einigen Ausführungsformen. Wie in 7C gezeigt ist, können zwei oder mehrere Kontakte 104** mit verschiedenen Formen vorhanden sein. Beispielsweise können die Kontakte 104** kreisförmige Säulen (Pfeiler, Stäbe) sein, verlängerte Säulen (Pfeiler, Stäbe), oder quadratische Säulen (Pfeiler, Stäbe) mit abgerundeten Ecken. Die in 7C gezeigten Ausführungsformen sind lediglich Beispiele. Andere Konfigurationen sind möglich. Beispielsweise könnten die UBM-Schicht 102** nicht kreisförmig sein, und könnte andere Formen aufweisen.
  • Die beschriebenen Ausführungsformen des Mechanismus zum Ausbilden von Verbindungselementen für eine Baugruppe-auf-Baugruppe erlauben kleinere Verbindungselemente mit kleinerem Abstand, was kleinere Baugruppengrößen und zusätzliche Verbindungen erlaubt, verglichen mit existierenden Verbindungselementen. Die leitenden Elemente auf einer Baugruppe sind teilweise in die Formmasse der Baugruppe eingebettet, um an Kontakte oder Metallkontaktflächen einer anderen Baugruppe gebondet zu werden. Durch das Einbetten der leitenden Elemente können diese kleiner sein, und es gibt keine Lücke zwischen den leitenden Elementen und der Formmasse. Ein Abstand der Verbindungselemente kann bestimmt werden, indem eine Abstandstoleranz zu einer maximalen Breite der Verbindungselemente addiert wird. Verschiedene Typen von Kontakten auf der anderen Baugruppe können an die leitenden Elemente gebondet werden.
  • In einigen Ausführungsformen ist eine gepackte Halbleitervorrichtung bereitgestellt. Die gepackte Halbleitervorrichtung umfasst einen Halbleiterchip, der in eine Formmasse (Vergussmaterial) eingebettet ist, und ein leitendes Element, das in die Formmasse eingebettet ist. Das leitende Element ist auf einer Oberfläche der Formmasse freigelegt. Die gepackte Halbleitervorrichtung umfasst auch eine Metallkontaktfläche. Die Metallkontaktfläche kontaktiert das leitende Element und stellt eine elektrische Verbindung zu Vorrichtungen im Halbleiterchip her.
  • In einigen anderen Ausführungsformen ist eine Halbleitervorrichtungsbaugruppe bereitgestellt. Die Halbleitervorrichtungsbaugruppe umfasst eine erste Halbleiterchipbaugruppe mit einem leitenden Element, das in eine Formmasse (Vergussmaterial) eingebettet ist. Das leitende Element ist auf einer Oberfläche der Formmasse freigelegt, und die Formmasse bedeckt wenigstens einen ersten Halbleiterchip. Die Halbleitervorrichtungsbaugruppe umfasst auch eine zweite Halbleiterchipbaugruppe mit einem leitenden Kontakt auf einer Oberfläche. Das leitende Element der ersten Halbleiterchipbaugruppe ist an den leitenden Kontakt der zweiten Halbleiterchipbaugruppe gebondet, um ein Verbindungselement zu bilden.
  • In noch anderen Ausführungsformen ist ein Verfahren für das Ausbilden einer Halbleitervorrichtungsbaugruppe bereitgestellt. Das Verfahren umfasst das Vorbereiten einer ersten Halbleiterchipbaugruppe mit leitenden Elementen, die in eine Formmasse (Vergussmaterial) eingebettet sind, wobei die leitenden Elemente auf einer Oberfläche der Formmasse freigelegt sind. Das Verfahren umfasst auch das Bereitstellen der ersten Halbleiterchipbaugruppe. Das Verfahren umfasst weiter das Bereitstellen einer zweiten Halbleiterchipbaugruppe, und das Bonden des leitenden Elements der ersten Halbleiterchipbaugruppe an Kontakte auf der zweiten Halbleiterchipbaugruppe.

Claims (7)

  1. Halbleitervorrichtungsbaugruppe, umfassend: eine erste Halbleiterchipbaugruppe (120B) mit leitenden Elementen (117B), die teilweise in einer Formmasse (121) eingebettet sind, wobei ein Teil der leitenden Elemente (117B) an einer Oberfläche der Formmasse (121) freigelegt ist, und wobei die Formmasse (121) wenigstens einen ersten Halbleiterchip bedeckt, wobei die leitenden Elemente (117B) direkt an die Formmasse (121) angrenzen; Metallkontaktflächen (122B), die in der ersten Halbleiterchipbaugruppe (120B) eingebettet sind, wobei die leitenden Elemente (117B) die Metallkontaktflächen (122B) kontaktieren, und wobei die Metallkontaktflächen (122B) elektrisch mit einer Vorrichtung in dem ersten Halbleiterchip in der ersten Halbleiterchipbaugruppe (120B) verbunden sind; und eine zweite Halbleiterchipbaugruppe (110*) mit Metallkontaktflächen (112**) und Kupfersäulen (104**) auf den Metallkontaktflächen (112**), wobei die Anzahl der Kupfersäulen (104**) auf jeder Metallkontaktfläche (112**) zwei oder mehr ist, wobei die leitenden Elemente (117B) der ersten Halbleiterchipbaugruppe (120B) mit den Kupfersäulen (104**) auf den Metallkontaktflächen (112**) der zweiten Halbleiterchipbaugruppe (110*) gebondet sind, um Verbindungselemente auszubilden.
  2. Halbleitervorrichtungsbaugruppe nach Anspruch 1, wobei der Abstand (P2) der leitenden Elemente (117B) in einem Bereich von etwa 100 µm bis etwa 500 µm liegt.
  3. Halbleitervorrichtungsbaugruppe nach einem der vorhergehenden Ansprüche, wobei die Kupfersäulen (104**) einer Metallkontaktfläche (112**) auf einer Unterhöckermetallisierungsschicht (102**) ausgebildet sind, wobei die Unterhöckermetallisierungsschicht (102**) die Metallkontaktfläche (112**) bedeckt.
  4. Halbleitervorrichtungsbaugruppe nach Anspruch 3, wobei die Breite jeder Kupfersäule (114**) kleiner als die Breite der Unterhöckermetallisierungsschicht (102**) ist.
  5. Halbleitervorrichtungsbaugruppe nach einem der vorhergehenden Ansprüche, wobei der Querschnitt der Kupfersäulen (114**) kreisförmig, stäbchenförmig oder quadratisch ist.
  6. Verfahren zum Ausbilden einer Halbleitervorrichtungsbaugruppe, umfassend: Vorbereiten einer ersten Halbleiterchipbaugruppe (120B) mit leitenden Elementen (117B), die teilweise in einer Formmasse (121) eingebettet sind, wobei ein Teil der leitenden Elemente (117B) an einer Oberfläche der Formmasse (121) freigelegt ist, wobei die leitenden Elemente (117B) direkt an die Formmasse (121) angrenzen; Bereitstellen der ersten Halbleiterchipbaugruppe (120B); Bereitstellen einer zweiten Halbleiterchipbaugruppe (110*); und direktes Verbinden der leitenden Elemente (117B) der ersten Halbleiterchipbaugruppe (120B) mit Kupfersäulen (104**) auf den Metallkontaktflächen (112**) auf der zweiten Halbleiterchipbaugruppe (110*), wobei die Anzahl der Kupfersäulen (104**) auf jeder Metallkontaktfläche (112**) zwei oder mehr ist, um Verbindungselemente auszubilden.
  7. Verfahren nach Anspruch 6, wobei das Vorbereiten der ersten Halbleiterchipbaugruppe (120B) das Drücken einer Form oder eines Films gegen die Formmasse (121) und die leitenden Elemente (117B) während des Ausbildens der Formmasse (121) umfasst, um zu ermöglichen, dass ein Teil der leitenden Elemente (117B) freigelegt wird.
DE102012104731.6A 2012-02-27 2012-05-31 Halbleitervorrichtungsbaugruppe und Verfahren zum Ausbilden dieser Active DE102012104731B4 (de)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US13/406,031 US9418947B2 (en) 2012-02-27 2012-02-27 Mechanisms for forming connectors with a molding compound for package on package
US13/406,031 2012-02-27

Publications (2)

Publication Number Publication Date
DE102012104731A1 DE102012104731A1 (de) 2013-08-29
DE102012104731B4 true DE102012104731B4 (de) 2019-07-25

Family

ID=48950711

Family Applications (1)

Application Number Title Priority Date Filing Date
DE102012104731.6A Active DE102012104731B4 (de) 2012-02-27 2012-05-31 Halbleitervorrichtungsbaugruppe und Verfahren zum Ausbilden dieser

Country Status (4)

Country Link
US (3) US9418947B2 (de)
CN (1) CN103295986B (de)
DE (1) DE102012104731B4 (de)
TW (2) TWI567906B (de)

Families Citing this family (18)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8624392B2 (en) 2011-06-03 2014-01-07 Taiwan Semiconductor Manufacturing Company, Ltd. Electrical connection for chip scale packaging
US8912668B2 (en) 2012-03-01 2014-12-16 Taiwan Semiconductor Manufacturing Company, Ltd. Electrical connections for chip scale packaging
US9548281B2 (en) 2011-10-07 2017-01-17 Taiwan Semiconductor Manufacturing Company, Ltd. Electrical connection for chip scale packaging
DE102012109922B4 (de) 2012-04-16 2020-04-16 Taiwan Semiconductor Manufacturing Co., Ltd. Package-on-Package-Struktur und Verfahren zur Herstellung derselben
US9219030B2 (en) 2012-04-16 2015-12-22 Taiwan Semiconductor Manufacturing Co., Ltd. Package on package structures and methods for forming the same
US9196573B2 (en) 2012-07-31 2015-11-24 Taiwan Semiconductor Manufacturing Company, Ltd. Bump on pad (BOP) bonding structure
US8829673B2 (en) 2012-08-17 2014-09-09 Taiwan Semiconductor Manufacturing Company, Ltd. Bonded structures for package and substrate
US9673161B2 (en) 2012-08-17 2017-06-06 Taiwan Semiconductor Manufacturing Company, Ltd. Bonded structures for package and substrate
CN104103536A (zh) * 2014-07-15 2014-10-15 南通富士通微电子股份有限公司 Pop封装方法
KR102165024B1 (ko) * 2014-09-26 2020-10-13 인텔 코포레이션 와이어-접합 멀티-다이 스택을 구비한 집적 회로 패키지
JP6319026B2 (ja) * 2014-09-29 2018-05-09 日亜化学工業株式会社 発光装置及びその製造方法
US9806066B2 (en) 2015-01-23 2017-10-31 Samsung Electronics Co., Ltd. Semiconductor package including exposed connecting stubs
US9761566B1 (en) * 2016-04-13 2017-09-12 Taiwan Semiconductor Manufacturing Company, Ltd. Multi-die structure and method of forming same
TWI611530B (zh) * 2016-10-14 2018-01-11 鈺橋半導體股份有限公司 具有散熱座之散熱增益型面朝面半導體組體及製作方法
US10276481B2 (en) * 2017-06-26 2019-04-30 Taiwan Semiconductor Manufacturing Co., Ltd. Package structure having a plurality of conductive balls having narrow width for the ball waist
US20210265237A1 (en) * 2020-02-20 2021-08-26 Sumitomo Electric Industries, Ltd. Semiconductor device and method for producing semiconductor device
CN114664779A (zh) * 2020-12-24 2022-06-24 江苏长电科技股份有限公司 具有电感器件的封装结构及其制造方法
CN117423664A (zh) * 2022-07-08 2024-01-19 长鑫存储技术有限公司 半导体封装组件及制备方法

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE19754372A1 (de) 1997-03-10 1998-09-24 Fraunhofer Ges Forschung Chipanordnung und Verfahren zur Herstellung einer Chipanordnung
US20070187826A1 (en) 2006-02-14 2007-08-16 Stats Chippac Ltd. 3-d package stacking system
US20070200257A1 (en) 2006-02-25 2007-08-30 Stats Chippac Ltd. Stackable integrated circuit package system with multiple interconnect interface
US20110117700A1 (en) 2009-11-18 2011-05-19 Advanced Semiconductor Engineering, Inc. Stackable semiconductor device packages

Family Cites Families (18)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6400574B1 (en) * 2000-05-11 2002-06-04 Micron Technology, Inc. Molded ball grid array
US20020151164A1 (en) 2001-04-12 2002-10-17 Jiang Hunt Hang Structure and method for depositing solder bumps on a wafer
US6908784B1 (en) * 2002-03-06 2005-06-21 Micron Technology, Inc. Method for fabricating encapsulated semiconductor components
KR100493063B1 (ko) 2003-07-18 2005-06-02 삼성전자주식회사 스택 반도체 칩 비지에이 패키지 및 그 제조방법
WO2006013763A1 (ja) * 2004-08-06 2006-02-09 Hamamatsu Photonics K.K. レーザ加工方法及び半導体装置
JP4541253B2 (ja) * 2005-08-23 2010-09-08 新光電気工業株式会社 半導体パッケージ及びその製造方法
EP1790744A1 (de) * 2005-11-28 2007-05-30 Siemens Aktiengesellschaft Verfahren zum Reparieren von Rissen in Bauteilen und Lotmaterial zum Löten von Bauteilen
US7508012B2 (en) * 2006-01-18 2009-03-24 Infineon Technologies Ag Electronic component and method for its assembly
SG149726A1 (en) * 2007-07-24 2009-02-27 Micron Technology Inc Microelectronic die packages with metal leads, including metal leads for stacked die packages, and associated systems and methods
US8349721B2 (en) * 2008-03-19 2013-01-08 Stats Chippac, Ltd. Semiconductor device and method of forming insulating layer on conductive traces for electrical isolation in fine pitch bonding
US8163597B2 (en) * 2009-03-24 2012-04-24 Stats Chippac, Ltd. Semiconductor device and method of forming no-flow underfill material around vertical interconnect structure
US8592995B2 (en) * 2009-07-02 2013-11-26 Taiwan Semiconductor Manufacturing Company, Ltd. Method and structure for adhesion of intermetallic compound (IMC) on Cu pillar bump
US8035235B2 (en) 2009-09-15 2011-10-11 Stats Chippac Ltd. Integrated circuit packaging system with package-on-package and method of manufacture thereof
US8446006B2 (en) * 2009-12-17 2013-05-21 International Business Machines Corporation Structures and methods to reduce maximum current density in a solder ball
US8508954B2 (en) 2009-12-17 2013-08-13 Samsung Electronics Co., Ltd. Systems employing a stacked semiconductor package
US8508045B2 (en) * 2011-03-03 2013-08-13 Broadcom Corporation Package 3D interconnection and method of making same
US8779601B2 (en) * 2011-11-02 2014-07-15 Stmicroelectronics Pte Ltd Embedded wafer level package for 3D and package-on-package applications, and method of manufacture
US9412689B2 (en) * 2012-01-24 2016-08-09 Taiwan Semiconductor Manufacturing Company, Ltd. Semiconductor packaging structure and method

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE19754372A1 (de) 1997-03-10 1998-09-24 Fraunhofer Ges Forschung Chipanordnung und Verfahren zur Herstellung einer Chipanordnung
US20070187826A1 (en) 2006-02-14 2007-08-16 Stats Chippac Ltd. 3-d package stacking system
US20070200257A1 (en) 2006-02-25 2007-08-30 Stats Chippac Ltd. Stackable integrated circuit package system with multiple interconnect interface
US20110117700A1 (en) 2009-11-18 2011-05-19 Advanced Semiconductor Engineering, Inc. Stackable semiconductor device packages

Also Published As

Publication number Publication date
CN103295986A (zh) 2013-09-11
DE102012104731A1 (de) 2013-08-29
TWI567899B (zh) 2017-01-21
TWI567906B (zh) 2017-01-21
US20130221522A1 (en) 2013-08-29
CN103295986B (zh) 2016-12-14
US9418947B2 (en) 2016-08-16
TW201620102A (zh) 2016-06-01
US11282817B2 (en) 2022-03-22
US10553561B2 (en) 2020-02-04
US20160343691A1 (en) 2016-11-24
US20200168583A1 (en) 2020-05-28
TW201336032A (zh) 2013-09-01

Similar Documents

Publication Publication Date Title
DE102012104731B4 (de) Halbleitervorrichtungsbaugruppe und Verfahren zum Ausbilden dieser
DE102020120137B4 (de) Halbleiterpackage und verfahren
DE102016101685B4 (de) Verfahren zur herstellung eines integrierten fan-out-packages
DE102013101192B4 (de) Halbleitergehäuse
DE102018130035B4 (de) Package und verfahren
DE102019128460A1 (de) Halbleiterpackages und verfahren für deren herstellung
DE102016101770A1 (de) Struktur und Bildungsverfahren für Chippaket
DE102019115952A1 (de) Halbleiter-packages
DE112011105992T5 (de) 3D-integriertes Schaltungspaket mit Through-Mold-Kopplungsstrukturen der ersten Ebene
DE102011001405A1 (de) Halbleiter-Kapselung und Stapel von Halbleiterkapselungen
DE102020100002B4 (de) Fan-out-packages und verfahren zu deren herstellung
DE102019118492A1 (de) Eingebettete spannungsreglerstruktur undverfahren zum bilden derselben
DE102020114141B4 (de) Integriertes schaltungspackage und verfahren
DE102019118624A1 (de) Platzierung vom dummy-dies ohne rückseitenaussplitterung
DE102019120381A1 (de) Integriertes schaltungs-package und verfahren
DE102020113988B4 (de) Integrierter-schaltkreis-package und verfahren
DE102019114074A1 (de) Integriertes-schaltkreis-package und verfahren
DE102020124229A1 (de) Halbleitervorrichtung und verfahren
DE102020130962A1 (de) Halbleitervorrichtung und herstellungsverfahren
DE102017122831B4 (de) Gehäusestrukturen und Ausbildungsverfahren
DE102018122228A1 (de) Integriertes Multichip-Fan-Out-Package
DE112022003986T5 (de) Verbindung zwischen chips durch brückenchip
DE102021120241A1 (de) Packagestruktur, halbleitervorrichtung und verfahren zu deren herstellung
DE102019129840B4 (de) Halbleiter-bauelement und verfahren zu dessen herstellung
DE102017122096A1 (de) Gehäusetrukturen und Ausbildungsverfahren

Legal Events

Date Code Title Description
R012 Request for examination validly filed
R016 Response to examination communication
R016 Response to examination communication
R016 Response to examination communication
R018 Grant decision by examination section/examining division
R020 Patent grant now final