JP7191842B2 - 半導体装置およびその製造方法 - Google Patents
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Description
1.半導体装置の第1の実施の形態
1.1 半導体装置の断面図
1.2 半導体装置の製造方法
2.第1実施の形態の変形例
2.1 第1変形例
2.2 第2変形例
3.半導体装置の第2の実施の形態
4.半導体装置の第3の実施の形態
5.半導体装置の第4の実施の形態
6.半導体装置の第5及び第6実施の形態
7.応用例
<1.1 半導体装置の断面図>
図1は、本技術を適用した半導体装置の第1実施の形態の構成例を示す断面図である。
次に、図3および図4を参照して、図1に示した半導体装置1の製造方法について説明する。
<2.1 第1変形例>
図6は、第1実施の形態の第1変形例を示す断面図である。
図7は、第1実施の形態の第2変形例を示す断面図である。
図8は、本技術を適用した半導体装置の第2実施の形態の構成例を示す断面図である。
図9は、本技術を適用した半導体装置の第3実施の形態の構成例を示す断面図である。
図10は、本技術を適用した半導体装置の第4実施の形態の構成例を示す断面図である。
図11および図12は、本技術を適用した半導体装置の第5及び第6実施の形態の構成例を示す断面図である。
本開示に係る技術は、様々な製品へ応用することができる。例えば、本開示に係る技術は、自動車、電気自動車、ハイブリッド電気自動車、自動二輪車、自転車、パーソナルモビリティ、飛行機、ドローン、船舶、ロボット、建設機械、農業機械(トラクター)などのいずれかの種類の移動体に搭載される装置として実現されてもよい。
(1)
表面または表裏面に1層以上の配線を含む配線層が形成されたガラス基板と、
前記ガラス基板に形成された開口部の内側に配置された電子部品と、
前記ガラス基板の前記配線と前記電子部品とを接続する再配線と
を備える半導体装置。
(2)
前記ガラス基板の表面または表裏面において前記配線層が形成されていない領域である配線層未形成領域の開口幅は、前記ガラス基板に形成された前記開口部の開口幅よりも広く構成された
前記(1)に記載の半導体装置。
(3)
前記ガラス基板に形成された前記開口部の前記電子部品以外の領域には、少なくとも樹脂が充填されるように構成された
前記(1)または(2)に記載の半導体装置。
(4)
前記再配線に接続する端子部が形成された面と反対側である前記電子部品の裏面側に、放熱伝導材が充填されるように構成された
前記(1)乃至(3)のいずれかに記載の半導体装置。
(5)
前記配線層は、前記ガラス基板の表面のみに形成され、
前記放熱伝導材は、前記ガラス基板の裏面に到達する高さまで充填されるように構成された
前記(4)に記載の半導体装置。
(6)
前記配線層は、前記ガラス基板の表裏面に形成され、
前記放熱伝導材は、前記ガラス基板の裏面の前記配線層に到達する高さまで充填されるように構成された
前記(4)に記載の半導体装置。
(7)
前記ガラス基板の裏面側に、放熱板をさらに備える
前記(1)乃至(6)のいずれかに記載の半導体装置。
(8)
前記放熱板は、導電性材料で形成され、グランド端子としても機能する
前記(7)に記載の半導体装置。
(9)
前記ガラス基板には、前記開口部が複数形成されており、
複数の前記開口部それぞれの内側に、前記電子部品が配置されている
前記(1)乃至(8)のいずれかに記載の半導体装置。
(10)
前記配線層の前記配線を用いて、アンテナ回路、フィルタ回路、受動素子の少なくとも1つが形成されている
前記(1)乃至(9)のいずれかに記載の半導体装置。
(11)
前記電子部品は、アンテナ、フィルタ、パワーアンプ、スイッチ、低ノイズアンプ、フェーズシフタ、ミキサ、PLL、または、受動素子のいずれかを少なくとも含む部品である
前記(1)乃至(10)のいずれかに記載の半導体装置。
(12)
前記配線層は、前記ガラス基板の表面側のみに形成され、
前記ガラス基板の裏面側に、ディスクリート部品をさらに備える
前記(1)乃至(11)のいずれかに記載の半導体装置。
(13)
前記配線層は、前記ガラス基板の表裏面の両方に形成され、
前記ガラス基板の裏面側の前記配線層の上に、半導体素子をさらに備える
前記(1)乃至(11)のいずれかに記載の半導体装置。
(14)
ガラス基板の表面または表裏面に、1層以上の配線を含む配線層を形成し、
前記ガラス基板に開口部を形成して、前記開口部の内側に電子部品を配置し、
前記ガラス基板の前記配線と前記電子部品とを接続する再配線を形成する
半導体装置の製造方法。
(15)
前記ガラス基板の表面または表裏面の前記配線層を覆うレジストを形成し、
前記レジストが形成されていない領域の前記ガラス基板を除去して、前記ガラス基板に前記開口部を形成し、
前記ガラス基板に形成された前記開口部の開口幅は、前記レジストの未形成領域の開口幅よりも広く形成される
前記(14)に記載の半導体装置の製造方法。
(16)
前記開口部の端面から前記配線層の端面までの平面方向の距離は、前記レジストの端面から前記配線層の端面までの平面方向の距離よりも短い
前記(15)に記載の半導体装置の製造方法。
(17)
前記開口部の内側に前記電子部品を配置した後、前記電子部品の裏面に樹脂を充填し、さらに、前記樹脂の一部を除去して、放熱伝導材を充填する
前記(14)乃至(16)のいずれかに記載の半導体装置の製造方法。
(18)
前記開口部の内側に前記電子部品を配置する際、ブロック形状の放熱伝導材を前記電子部品の裏面に貼り付けた前記電子部品を前記開口部の内側に配置し、前記ブロック形状の放熱伝導材の周囲に樹脂を充填する
前記(14)乃至(16)のいずれかに記載の半導体装置の製造方法。
Claims (17)
- 表面または表裏面に1層以上の配線を含む配線層が形成されたガラス基板と、
前記ガラス基板に形成された開口部の内側に配置された電子部品と、
前記ガラス基板の前記配線と前記電子部品とを接続する再配線と
を備え、
前記ガラス基板の表面または表裏面において前記配線層が形成されていない領域である配線層未形成領域の開口幅が、前記ガラス基板に形成された前記開口部の幅よりも広く構成された
半導体装置。 - 前記ガラス基板に形成された前記開口部の前記電子部品以外の領域には、少なくとも樹脂が充填されるように構成された
請求項1に記載の半導体装置。 - 前記再配線に接続する端子部が形成された面と反対側である前記電子部品の裏面側に、放熱伝導材が充填されるように構成された
請求項1に記載の半導体装置。 - 前記配線層は、前記ガラス基板の表面のみに形成され、
前記放熱伝導材は、前記ガラス基板の裏面に到達する高さまで充填されるように構成された
請求項3に記載の半導体装置。 - 前記配線層は、前記ガラス基板の表裏面に形成され、
前記放熱伝導材は、前記ガラス基板の裏面の前記配線層に到達する高さまで充填されるように構成された
請求項3に記載の半導体装置。 - 前記ガラス基板の裏面側に、放熱板をさらに備える
請求項1に記載の半導体装置。 - 前記放熱板は、導電性材料で形成され、グランド端子としても機能する
請求項6に記載の半導体装置。 - 前記ガラス基板には、前記開口部が複数形成されており、
複数の前記開口部それぞれの内側に、前記電子部品が配置されている
請求項1に記載の半導体装置。 - 前記配線層の前記配線を用いて、アンテナ回路、フィルタ回路、受動素子の少なくとも1つが形成されている
請求項1に記載の半導体装置。 - 前記電子部品は、アンテナ、フィルタ、パワーアンプ、スイッチ、低ノイズアンプ、フェーズシフタ、ミキサ、PLL、または、受動素子のいずれかを少なくとも含む部品である
請求項1に記載の半導体装置。 - 前記配線層は、前記ガラス基板の表面側のみに形成され、
前記ガラス基板の裏面側に、ディスクリート部品をさらに備える
請求項1に記載の半導体装置。 - 前記配線層は、前記ガラス基板の表裏面の両方に形成され、
前記ガラス基板の裏面側の前記配線層の上に、半導体素子をさらに備える
請求項1に記載の半導体装置。 - ガラス基板の表面または表裏面に、1層以上の配線を含む配線層を形成し、
前記ガラス基板に開口部を形成して、前記開口部の内側に電子部品を配置し、
前記ガラス基板の前記配線と前記電子部品とを接続する再配線を形成し、
前記ガラス基板の表面または表裏面において前記配線層が形成されていない領域である配線層未形成領域の開口幅が、前記ガラス基板に形成された前記開口部の幅よりも広く形成される
半導体装置の製造方法。 - 前記ガラス基板の表面または表裏面の前記配線層を覆うレジストを形成し、
前記レジストが形成されていない領域の前記ガラス基板を除去して、前記ガラス基板に前記開口部を形成し、
前記ガラス基板に形成された前記開口部の開口幅は、前記レジストの未形成領域の開口幅よりも広く形成される
請求項13に記載の半導体装置の製造方法。 - 前記開口部の端面から前記配線層の端面までの平面方向の距離は、前記レジストの端面から前記配線層の端面までの平面方向の距離よりも短い
請求項14に記載の半導体装置の製造方法。 - 前記開口部の内側に前記電子部品を配置した後、前記電子部品の裏面に樹脂を充填し、さらに、前記樹脂の一部を除去して、放熱伝導材を充填する
請求項13に記載の半導体装置の製造方法。 - 前記開口部の内側に前記電子部品を配置する際、ブロック形状の放熱伝導材を前記電子部品の裏面に貼り付けた前記電子部品を前記開口部の内側に配置し、前記ブロック形状の放熱伝導材の周囲に樹脂を充填する
請求項13に記載の半導体装置の製造方法。
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EP4131360A4 (en) * | 2020-03-31 | 2023-11-15 | Sony Semiconductor Solutions Corporation | SEMICONDUCTOR DEVICE |
KR20220001311A (ko) * | 2020-06-29 | 2022-01-05 | 삼성전자주식회사 | 반도체 패키지, 및 이를 가지는 패키지 온 패키지 |
CN114495736A (zh) * | 2020-11-12 | 2022-05-13 | 深圳市奥拓电子股份有限公司 | 一种微led显示面板、显示模组以及led显示屏 |
US10993014B1 (en) * | 2020-12-21 | 2021-04-27 | Airtouch (Shanghai) Intelligent Technology Co.,Ltd | Integrated circuit packages in headphones and method for forming and operating the same |
US20220216171A1 (en) * | 2021-01-06 | 2022-07-07 | Huawei Technologies Co., Ltd. | Chip package structure, preparation method, and electronic device |
KR102718344B1 (ko) * | 2021-04-05 | 2024-10-18 | 한국전자통신연구원 | 광인터커넥션 모듈의 제작 방법 및 응용 |
CN113675158B (zh) * | 2021-07-06 | 2024-01-05 | 珠海越亚半导体股份有限公司 | 循环冷却嵌埋封装基板及其制作方法 |
KR102613002B1 (ko) * | 2021-09-30 | 2023-12-13 | 한국전자기술연구원 | 반도체 패키지 및 그 제조방법 |
Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007123524A (ja) | 2005-10-27 | 2007-05-17 | Shinko Electric Ind Co Ltd | 電子部品内蔵基板 |
JP2011216635A (ja) | 2010-03-31 | 2011-10-27 | Murata Mfg Co Ltd | 電子部品内蔵基板、電子回路モジュール、および電子部品内蔵基板の製造方法 |
WO2013047520A1 (ja) | 2011-09-30 | 2013-04-04 | 株式会社フジクラ | 部品内蔵基板実装体及びその製造方法並びに部品内蔵基板 |
JP2015050457A (ja) | 2013-08-29 | 2015-03-16 | サムソン エレクトロ−メカニックス カンパニーリミテッド. | 電子部品内蔵基板及びその製造方法 |
JP2016076510A (ja) | 2014-10-02 | 2016-05-12 | 太陽誘電株式会社 | 回路モジュール |
JP2016213466A (ja) | 2015-05-11 | 2016-12-15 | サムソン エレクトロ−メカニックス カンパニーリミテッド. | ファンアウト半導体パッケージ及びその製造方法 |
US20170263522A1 (en) | 2016-03-10 | 2017-09-14 | Samsung Electro-Mechanics Co., Ltd. | Electronic component package and method of manufacturing the same |
Family Cites Families (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4092890B2 (ja) * | 2001-05-31 | 2008-05-28 | 株式会社日立製作所 | マルチチップモジュール |
US7135357B2 (en) * | 2003-10-06 | 2006-11-14 | E. I. Du Pont De Nemours And Company | Process for making an organic electronic device having a roughened surface heat sink |
JP4850392B2 (ja) * | 2004-02-17 | 2012-01-11 | 三洋電機株式会社 | 半導体装置の製造方法 |
WO2009118950A1 (ja) * | 2008-03-27 | 2009-10-01 | イビデン株式会社 | 多層プリント配線板の製造方法 |
JP2009246144A (ja) * | 2008-03-31 | 2009-10-22 | Panasonic Corp | 電子部品内蔵基板及びその製造方法とこれを用いた半導体装置 |
JP2010147267A (ja) * | 2008-12-19 | 2010-07-01 | Renesas Technology Corp | 半導体集積回路装置および半導体集積回路装置の製造方法 |
JP2011077075A (ja) * | 2009-09-29 | 2011-04-14 | Oki Electric Industry Co Ltd | 発熱性電子素子内蔵のモジュール基板及びその製造方法 |
JP2015231009A (ja) * | 2014-06-06 | 2015-12-21 | セイコーエプソン株式会社 | 電子デバイスパッケージ用基板および電子デバイスパッケージ用基板の製造方法 |
JP6428164B2 (ja) * | 2014-10-31 | 2018-11-28 | 日立化成株式会社 | 半導体装置及びその製造方法 |
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US10199337B2 (en) * | 2015-05-11 | 2019-02-05 | Samsung Electro-Mechanics Co., Ltd. | Electronic component package and method of manufacturing the same |
-
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Patent Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007123524A (ja) | 2005-10-27 | 2007-05-17 | Shinko Electric Ind Co Ltd | 電子部品内蔵基板 |
JP2011216635A (ja) | 2010-03-31 | 2011-10-27 | Murata Mfg Co Ltd | 電子部品内蔵基板、電子回路モジュール、および電子部品内蔵基板の製造方法 |
WO2013047520A1 (ja) | 2011-09-30 | 2013-04-04 | 株式会社フジクラ | 部品内蔵基板実装体及びその製造方法並びに部品内蔵基板 |
JP2015050457A (ja) | 2013-08-29 | 2015-03-16 | サムソン エレクトロ−メカニックス カンパニーリミテッド. | 電子部品内蔵基板及びその製造方法 |
JP2016076510A (ja) | 2014-10-02 | 2016-05-12 | 太陽誘電株式会社 | 回路モジュール |
JP2016213466A (ja) | 2015-05-11 | 2016-12-15 | サムソン エレクトロ−メカニックス カンパニーリミテッド. | ファンアウト半導体パッケージ及びその製造方法 |
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