JP5767294B2 - 半導体装置 - Google Patents
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Description
図1は本発明の実施の形態1の半導体装置の構造の一例を示す平面図、図2は図1に示す半導体装置の構造を示す側面図、図3は図1に示すA−A線に沿って切断した構造を示す断面図、図4は図1に示すB−B線に沿って切断した構造を示す断面図である。また、図5は図1に示す半導体装置におけるワイヤリング状態の一例を示す部分平面図、図6は図5に示すA−A線に沿って切断した構造を示す部分断面図、図7は図1に示す半導体装置の第2吊りリード上で切断した構造を示す断面図である。
図24は本発明の実施の形態2の半導体装置の構造の一例を示す平面図、図25は図24に示す半導体装置の構造を示す側面図、図26は図24に示すA−A線に沿って切断した構造を示す断面図、図27は図24に示すB−B線に沿って切断した構造を示す断面図、図28は図24に示す半導体装置の第2吊りリード上で切断した構造を示す断面図である。
1a インナリード(リードの一部)
1aa 上面
1ab 下面
1b アウタリード(リードの他部)
1c ダイパッド(タブ、チップ搭載部)
1ca 上面(主面、表面、チップ搭載面)
1cb 下面(裏面、実装面)
1cc 第1辺
1cd 第2辺
1ce 主面
1cf 裏面
1d バスバー(ブリッジバー、セクションバー)
1da 上面(主面、表面、チップ搭載面)
1db 下面(裏面)
1dc 第3辺
1dd 第4辺
1de 第5辺
1e 第1吊りリード(吊りリード)
1ea 上面
1eb 下面
1f 第1折り曲げ部(折り曲げ部)
1g 第2吊りリード
1h 第2折り曲げ部(折り曲げ部)
1i テープ材
1j 上面
1k 下面
1m ダム
2 半導体チップ
2a 主面
2b 裏面
2c 電極パッド
3 封止体
3a 表面(主面、上面)
3b 実装面(裏面、下面)
3c 側面
3d 第1ゲートレジン
3e 第2ゲートレジン
4 ワイヤ
5 QFP(半導体装置)
6 Agペースト(接着材)
7 吐出ノズル
8 コレット
9 キャピラリ
10 ボンディングステージ
11 リード押さえ治具
12 樹脂成型金型(成型金型)
12a 上型
12aa 第1キャビティ
12ab 第1ゲート
12ac 第1パーティング面
12b 下型
12ba 第2キャビティ
12bb 第2ゲート
12bc 第2パーティング面
12bd 底面
13 封止用樹脂(樹脂)
14a 充填方向
14b レジン流動方向
15 外装めっき
16 マザーボード(実装基板)
16a 端子
16b 電極パッド
16c 主面
17 ヒートスプレッダ(放熱板)
18 ヒートシンク(放熱板)
19 半田
20 QFP(半導体装置)
21 QFP(半導体装置)
30 QFP
Claims (7)
- チップ搭載面、および前記チップ搭載面とは反対側の露出面を有するダイパッドと、
折り曲げ部を有し、前記ダイパッドを支持する第1吊りリードと、
前記ダイパッドの周囲に配置され、かつ、前記第1吊りリードを介して前記ダイパッドと繋がるバスバーと、
折り曲げ部をそれぞれ有し、前記バスバーのうちの前記第1吊りリードが繋がる部分とは異なる部分にそれぞれ繋がる複数の第2吊りリードと、
前記複数の第2吊りリードのうちの互いに隣り合う第2吊りリード間に配置され、かつ、前記バスバーよりも前記ダイパッドから遠い位置に配置された複数のリードと、
主面、前記主面上に形成された複数の電極パッド、および前記主面とは反対側の裏面を有し、前記裏面が前記ダイパッドの前記チップ搭載面と対向するように、前記ダイパッドの前記チップ搭載面上に搭載された半導体チップと、
前記半導体チップの前記複数の電極パッドと前記複数のリードとをそれぞれ電気的に接続する複数のワイヤと、
前記ダイパッドの前記露出面が露出するように、前記複数のリードのそれぞれの一部、前記バスバー、前記半導体チップおよび前記複数のワイヤを封止する封止体と、
を含み、
前記ダイパッドは、一対の第1辺と、前記第1辺と交差する一対の第2辺と、を有しており、
前記バスバーは、前記ダイパッドの前記第1辺と並ぶ一対の第3辺と、前記ダイパッドの前記第2辺と並ぶ一対の第4辺と、を有しており、
前記バスバーの前記第3辺および前記第4辺のそれぞれにおいて、複数の前記第1吊りリードが設けられており、
前記バスバーは、前記ダイパッドの前記チップ搭載面と同じ側の面である第1面と、前記第1面とは反対側の第2面と、を有し、
前記複数のリードのそれぞれは、前記ダイパッドの前記チップ搭載面と同じ側の面である第3面と、前記第3面とは反対側の第4面と、を有し、
断面視において、前記バスバーは、前記封止体の厚さ方向における前記リードの前記第4面と前記バスバーの前記第1面との間隔が、前記封止体の厚さ方向における前記バスバーの前記第2面と前記ダイパッドの前記チップ搭載面との間隔より大きくなるように、前記リードと前記ダイパッドとの間に配置されている、半導体装置。 - 前記バスバーのうちの前記第1吊りリードが繋がる部分の両脇には、くびれが形成されている、請求項1記載の半導体装置。
- チップ搭載面、および前記チップ搭載面とは反対側の露出面を有するダイパッドと、
折り曲げ部を有し、前記ダイパッドを支持する第1吊りリードと、
前記ダイパッドの周囲に配置され、かつ、前記第1吊りリードを介して前記ダイパッドと繋がるバスバーと、
折り曲げ部をそれぞれ有し、前記バスバーのうちの前記第1吊りリードが繋がる部分とは異なる部分にそれぞれ繋がる複数の第2吊りリードと、
前記複数の第2吊りリードのうちの互いに隣り合う第2吊りリード間に配置され、かつ、前記バスバーよりも前記ダイパッドから遠い位置に配置された複数のリードと、
主面、前記主面上に形成された複数の電極パッド、および前記主面とは反対側の裏面を有し、前記裏面が前記ダイパッドの前記チップ搭載面と対向するように、前記ダイパッドの前記チップ搭載面上に搭載された半導体チップと、
前記半導体チップの前記複数の電極パッドと前記複数のリードとをそれぞれ電気的に接続する複数のワイヤと、
前記ダイパッドの前記露出面が露出するように、前記複数のリードのそれぞれの一部、前記バスバー、前記半導体チップおよび前記複数のワイヤを封止する封止体と、
を含み、
前記ダイパッドは、一対の第1辺と、前記第1辺と交差する一対の第2辺と、を有しており、
前記バスバーは、前記ダイパッドの前記第1辺と並ぶ一対の第3辺と、前記ダイパッドの前記第2辺と並ぶ一対の第4辺と、を有しており、
前記バスバーの前記第3辺および前記第4辺のそれぞれにおいて、複数の前記第1吊りリードが設けられており、
前記封止体は、前記ダイパッドの前記チップ搭載面と同じ側の面である上面と、前記上面とは反対側の下面と、を有し、
前記バスバーは、前記ダイパッドの前記チップ搭載面と同じ側の面である第1面と、前記第1面とは反対側の第2面と、を有し、
前記複数のリードのそれぞれは、前記ダイパッドの前記チップ搭載面と同じ側の面である第3面と、前記第3面とは反対側の第4面と、を有し、
断面視において、前記バスバーは、前記封止体の厚さ方向における前記リードの前記第4面と前記バスバーの前記第1面との間隔が、前記封止体の厚さ方向における前記バスバーの前記第2面と前記封止体の前記下面との間隔より大きくなるように、前記リードと前記封止体の前記下面との間に配置されており、
前記ダイパッドの前記露出面は、前記封止体の前記下面から露出している、半導体装置。 - 前記バスバーのうちの前記第1吊りリードが繋がる部分の両脇には、くびれが形成されている、請求項3記載の半導体装置。
- チップ搭載面、および前記チップ搭載面とは反対側の露出面を有するダイパッドと、
折り曲げ部を有し、前記ダイパッドを支持する第1吊りリードと、
前記ダイパッドの周囲に配置され、かつ、前記第1吊りリードを介して前記ダイパッドと繋がるバスバーと、
折り曲げ部をそれぞれ有し、前記バスバーのうちの前記第1吊りリードが繋がる部分とは異なる部分にそれぞれ繋がる複数の第2吊りリードと、
前記複数の第2吊りリードのうちの互いに隣り合う第2吊りリード間に配置され、かつ、前記バスバーよりも前記ダイパッドから遠い位置に配置された複数のリードと、
主面、前記主面上に形成された複数の電極パッド、および前記主面とは反対側の裏面を有し、前記裏面が前記ダイパッドの前記チップ搭載面と対向するように、前記ダイパッドの前記チップ搭載面上に搭載された半導体チップと、
前記半導体チップの前記複数の電極パッドと前記複数のリードとをそれぞれ電気的に接続する複数のワイヤと、
前記ダイパッドの前記露出面が露出するように、前記複数のリードのそれぞれの一部、前記バスバー、前記半導体チップおよび前記複数のワイヤを封止する封止体と、
を含み、
前記ダイパッドは、一対の第1辺と、前記第1辺と交差する一対の第2辺と、を有しており、
前記バスバーは、前記ダイパッドの前記第1辺と並ぶ一対の第3辺と、前記ダイパッドの前記第2辺と並ぶ一対の第4辺と、を有しており、
前記バスバーの前記第3辺および前記第4辺のそれぞれにおいて、複数の前記第1吊りリードが設けられており、
前記封止体は、上面と、前記上面とは反対側の面であり、かつ、前記ダイパッドの前記チップ搭載面と同じ側の面である下面と、を有し、
前記バスバーは、第1面と、前記第1面とは反対側の面であり、かつ、前記ダイパッドの前記チップ搭載面と同じ側の面である第2面と、を有し、
前記複数のリードのそれぞれは、第3面と、前記第3面とは反対側の面であり、かつ、前記ダイパッドの前記チップ搭載面と同じ側の面である第4面と、を有し、
断面視において、前記バスバーは、前記封止体の厚さ方向における前記リードの前記第3面と前記バスバーの前記第2面との間隔が、前記封止体の厚さ方向における前記バスバーの前記第1面と前記封止体の前記上面との間隔より大きくなるように、前記リードと前記封止体の前記上面との間に配置されており、
前記ダイパッドの前記露出面は、前記封止体の前記上面から露出している、半導体装置。 - 前記バスバーのうちの前記第1吊りリードが繋がる部分の両脇には、くびれが形成されている、請求項5記載の半導体装置。
- 前記半導体チップは、ダイボンド材を介して、前記ダイパッドの前記チップ搭載面上に搭載されている、請求項1、3または5の何れかに記載の半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2013209861A JP5767294B2 (ja) | 2013-10-07 | 2013-10-07 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2013209861A JP5767294B2 (ja) | 2013-10-07 | 2013-10-07 | 半導体装置 |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2012208061A Division JP5420737B2 (ja) | 2012-09-21 | 2012-09-21 | 半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2014030049A JP2014030049A (ja) | 2014-02-13 |
JP5767294B2 true JP5767294B2 (ja) | 2015-08-19 |
Family
ID=50202378
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2013209861A Active JP5767294B2 (ja) | 2013-10-07 | 2013-10-07 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP5767294B2 (ja) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2015176907A (ja) | 2014-03-13 | 2015-10-05 | ルネサスエレクトロニクス株式会社 | 半導体装置 |
JP6770452B2 (ja) | 2017-01-27 | 2020-10-14 | ルネサスエレクトロニクス株式会社 | 半導体装置 |
US20240047438A1 (en) | 2020-12-18 | 2024-02-08 | Rohm Co., Ltd. | Semiconductor equipment |
DE112021006144T5 (de) | 2020-12-25 | 2023-09-07 | Rohm Co., Ltd. | Halbleiterbauteil |
JPWO2022196294A1 (ja) | 2021-03-19 | 2022-09-22 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3154579B2 (ja) * | 1993-02-23 | 2001-04-09 | 三菱電機株式会社 | 半導体素子搭載用のリードフレーム |
JPH07231069A (ja) * | 1994-02-17 | 1995-08-29 | Fujitsu Ltd | 半導体装置及びその製造方法及びこれに使用されるリードフレーム |
JP2002076234A (ja) * | 2000-08-23 | 2002-03-15 | Rohm Co Ltd | 樹脂封止型半導体装置 |
JP4611579B2 (ja) * | 2001-07-30 | 2011-01-12 | ルネサスエレクトロニクス株式会社 | リードフレーム、半導体装置およびその樹脂封止法 |
JP4628996B2 (ja) * | 2006-06-01 | 2011-02-09 | 新光電気工業株式会社 | リードフレームとその製造方法及び半導体装置 |
-
2013
- 2013-10-07 JP JP2013209861A patent/JP5767294B2/ja active Active
Also Published As
Publication number | Publication date |
---|---|
JP2014030049A (ja) | 2014-02-13 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20141225 |
|
A131 | Notification of reasons for refusal |
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A521 | Written amendment |
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A01 | Written decision to grant a patent or to grant a registration (utility model) |
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R150 | Certificate of patent or registration of utility model |
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