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JP2691799B2 - リードフレームに接合された介在ダイ取付基板を有する集積回路パッケージ設計 - Google Patents

リードフレームに接合された介在ダイ取付基板を有する集積回路パッケージ設計

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JP2691799B2
JP2691799B2 JP5514969A JP51496993A JP2691799B2 JP 2691799 B2 JP2691799 B2 JP 2691799B2 JP 5514969 A JP5514969 A JP 5514969A JP 51496993 A JP51496993 A JP 51496993A JP 2691799 B2 JP2691799 B2 JP 2691799B2
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Description

【発明の詳細な説明】 発明の背景 1.技術分野。この発明は、集積回路のためのパッケージ
ング技術に関し、より特定的にはさまざまなサイズの集
積回路のダイを共通のリードフレームに装着するための
技術および集積回路パッケージの熱的性能を向上させる
ための技術に関する。
2.背景技術。従来の半導体集積回路パッケージでは、集
積回路のダイのボンディングパッドへの電気的接続は、
典型的には銅を含む材料のストリップを打ち抜きまたは
化学的にエッチングしてできた薄い金属製リードフレー
ムによってなされる。集積回路のダイはリードフレーム
の中央に位置付けられたダイ取付パドルまたはパッドに
装着される。ダイ取付パドルは形としては矩形であり、
その4つの角の各々で放射状に延びる支持ビームによっ
て支持される。リードフレームはいくつかの細い、狭い
間隔で置かれた導電性のリードを含み、それらはダイの
縁から離れるように放射状に延びる。リードはダイから
逸れ、モールドされたパッケージの外部壁を通って延
び、そこでパッケージのための外部のI/Oリードを形成
する。リードの最も内側の端はボンディングフィンガと
呼ばれる。非常に細い金のワイヤは一方の端でダイ上の
ボンディングパッドに接合され、他方の端でリードフレ
ームのボンディングフィンガに接合される。狭い間隔で
置かれたボンディングフィンガを有するリードフレーム
を製造するには、化学的なエッチング技術が用いられ
る。I/Oリードの数が増えるにつれ、およびダイのサイ
ズが縮小するにつれて、リードフレームのボンディング
フィンガの間の間隔は狭まるので、ボンディングフィン
ガの間の要求される間隔がリードフレーム材料自体の厚
さに近づくと、化学的エッチングを用いてさえもリード
フレームを製造することは困難になる。
I/Oリードが増えることと、ダイのサイズが縮小する
こととにともなうもう1つの問題は、リード間に最低限
の間隔を保つには集まるリードの端のボンディングフィ
ンガがダイからある特定の距離だけ離れて位置付けられ
なければならないので、ダイ上のボンディングパッドか
らボンディングフィンガまでの距離が長くなるというこ
とである。ボンディングワイヤの長さが150ミルを越え
ると、ダイとリードフレームとがプラスチックエポキシ
のモールド成形材料内に封止されてパッケージの本体を
形成する際に、長く細い典型的には金であるボンディン
グワイヤが、プラスチックエポキシのモールド成形材料
の流れで、一緒に流されるまたは破壊されてしまう、
「ワイヤ−ウォッシュ」と呼ばれる製造上の問題が起こ
るかもしれない。したがって、この問題を最小限に抑え
るためボンディングワイヤの長さがおよそ150ミルに制
限されていることもある。
このワイヤウォッシュリードフレーム接続の問題に対
する解決策の1つは、ダイとボンディングフィンガとの
間に「ブリッジ」を介在させて、それらの間の距離がボ
ンディングワイヤのより短い2つのセグメントによって
渡され得るようにするということである。
そのようなブリッジの1つがコムストック(Comstoc
k)らによる「集積回路のダイからリードへのフレーム
相互接続アセンブリおよびその方法」と題された米国特
許第4,754,317号で開示されている。本特許出願の図面
の図1は、コムストック317号の引用例に類似する先行
技術の集積回路パッケージアセンブリ10の断面図を示
す。集積回路のダイ12の頂部表面にはボンディングパッ
ド13が設けられ、それらには集積回路のパッケージング
技術において知られている技術によってボンディングワ
イヤが取付けられている。ダイ12は従来的にはダイ取付
パッド14に装着されており、それは典型的に示されるボ
ンディングフィンガ16を有するリードのためのリードフ
レームアセンブリの一部分である。ダイ12は絶縁された
ブリッジ部材または基板アセンブリ18内に形成される中
央キャビティ17の中に置かれる。基板アセンブリは比較
的厚い絶縁層22上に形成される導体を含む。導体20はボ
ンディングフィンガ16と導体20との間のギャップに渡さ
れる典型的な第1のボンディングワイヤ24のための介在
接続点として働く。導体20はまた、ダイ12のボンディン
グパッド13の1つと導体20のうち1つとの間のギャップ
に渡される典型的な第2のボンディングワイヤ26のため
の介在接続点としても働く。封止プラスチックエポキシ
材料がダイおよびリードフレームのまわりでモールドさ
れ、集積回路パッケージアセンブリ10のための本体30を
形成する。そこに導体が形成され、ダイの外部周辺とリ
ードフレームのボンディングフィンガにおける内部周辺
との間に置かれた介在基板アセンブリ18を用いる技術
は、ボンディング−ワイヤの沈下(bonding−wire sa
g)とボンディング−ワイヤの浸食(bonding−wire was
h)とを減じる。I/O接続の各々については、ワイヤの1
本が基板アセンブリの導電経路の一方端とダイとの間で
接合され、別のワイヤが基板アセンブリ上の導電経路の
他方端とリードフレーム上のボンディングフィンガとの
間で接合される。
グリーンバーグ(Greenberg)らによる「高密度I/Oリ
ード接続による半導体パッケージ」と題された米国特許
第4,774,635号は、半導体パッケージング技術を開示す
る。本特許出願のための図面における図2は、グリーン
バーグ635号の構造に類似する集積回路のダイ42のため
の先行技術の集積回路パッケージアセンブリ40を示す。
ダイ42はその頂部表面にボンディングパッド43を有して
おり、それらには集積回路パッケージング技術において
知られている技術によってボンディングワイヤが取付け
られている。ダイ42は従来的にはリード46のためのリー
ドフレームアセンブリの一部である従来のダイ取付パッ
ド44へ装着される。パッケージアセンブリ40は介在絶縁
層52を含み、その頂部表面に非常に薄くもろい導電性の
フィンガ54が形成されている。導電性のフィンガ54はそ
の一端でリードフレームのボンディングフィンガ46に接
合される。導電性のフィンガ54は集積回路のダイ42のボ
ンディングパッドから延びるボンディングワイヤ60によ
り覆われなければならないギャップを短くする。ダイ42
は絶縁層52の中央領域内に形成されるキャビティ62の中
に置かれる。この技術には、薄くもろい導電性のフィン
ガ54がそれぞれのボンディングフィンガ46に対し正確に
整列されかつ組立てられることが必要であり、これには
高価な製造設備と工程ステップとが要求されるというこ
とに注意されたい。
コムストック317号の特許とグリーンバーグ635号の特
許とで説明される構造は、ダイがリードフレームの中央
に設けられたキャビティの中に嵌まらなければならない
のである一定のサイズのみの集積回路のダイでしか用い
られないものとして制限される。したがって、さまざま
なダイのサイズに対処するにはいくつかの異なったサイ
ズのリードフレームが予め製造されなければならない。
ゆえに、いくつかつの異なったサイズのダイで共通に
用いられる標準規格のリードフレームまたは標準規格で
ないリードフレームのいずれにもいつくかの異なったサ
イズのダイを装着するための集積回路のパッケージング
技術が必要であることは明白である。製造コストを実質
的に低減するには、規格化され打ち抜かれたリードフレ
ームが、いくつかのダイのサイズに対して利用可能であ
ることが好ましい。
ダイにおける矩形の形状とリードにおける集中パター
ンとのため、ボンディングパッドとそれに対応するボン
ディングフィンガとの間の距離は、ボンディングパッド
がダイの角近くに位置付けられているか、ダイの辺の中
点近くに位置付けられているかに応じて変化する。たと
えば、ダイの角近くにボンディングパッドのためのボン
ディング距離は150ミルを大幅に越えるであろうし、一
方で辺の中点近くにおけるボンディングのためのボンデ
ィング距離はおよそ150ミルであろう。したがって長い
ボンディングワイヤスパンにわたる介在ブリッジポイン
トをオプションで設けることができる集積回路パッケー
ジング技術が必要とされる。
時には集積回路のダイの下部表面に取付けられたダイ
取付パッドから集積回路のダイが電気的に絶縁されるこ
とが必要である。これにはダイの下部表面と導電性のダ
イ取付パッドとの間に誘電性の材料を用いることが要求
される。典型的にはダイが小さいほどより良好な熱の放
散特性がそのパッケージング構成から要求される。した
がって、ダイがリードフレームのダイ取付パッドの部分
から電気的には絶縁されるが、熱によっては接続される
ということを可能にする集積回路の技術が必要である。
発明の開示 ゆえに、この発明の目的はリードフレームのリードか
ら集積回路のダイへのワイヤ−ボンディング接続を提供
するための装置および方法を提供することである。
この発明のこの目的および他の目的に従って、集積回
路のダイのためのパッケージ設計構成が提供される。パ
ッケージは中央領域から延びる複数個のボンディングフ
ィンガを有するリードフレームを含む。電気的に絶縁さ
れた熱伝導性の基板が提供され、これはその周辺に沿っ
てボンディングフィンガの端が接合される第1の表面を
有する。基板はセラミック材料のような熱伝導性の材料
から形成される。集積回路のダイはリードフレームの中
央領域に対応する基板の中央エリアに取付けられる。い
くつかの導電性のボンディングアイランドまたは導電線
が、電気的に絶縁された熱伝導性の基板の第1の表面上
に形成される。導電線はセラミック基板の中央エリアか
ら延び、集積回路のダイ上のボンディングパッドから延
びるボンディングワイヤのためのそれぞれの介在取付エ
リアを提供する。導電線はさらに、リードフレームのボ
ンディングフィンガと導電線との間のより短いボンディ
ングワイヤの取付のための介在取付エリアをも提供す
る。
ボンディングアイランドとして働く導電線は、半導体
製造技術を用いての薄膜材料の堆積によって、または印
刷技術を用いての厚膜材料の堆積によって形成される。
長尺の矩形パターンまたはジグザグパターンのようなさ
まざまな形および構成の導電線ができる。導電線の各パ
ターンの端では、適切なボンディングパッドエリアが設
けられる。
この発明は、集積回路のダイのボンディングパッドの
すべてに導電線をつけることはしないという選択肢を提
供する。導電線は、典型的にはダイの角で見られるたと
えば150ミル(0.150インチ)より長いボンディング距離
に対して提供される。
代替例としては、電気的に絶縁された熱伝導性のパッ
ドが従来のリードフレームのダイ取付パッドに取付けら
れる。
リードフレームのボンディングフィンガの端を電気的
に絶縁された熱伝導性の基板の周辺に接合するステップ
を含む、集積回路のダイをパッケージングする方法が提
供される。集積回路のダイは基板の中央エリアに取付け
られる。ボンディングワイヤは、集積回路のダイ上のボ
ンディングパッドの間から電気的に絶縁された熱伝導性
の基板上に形成される複数個の導電線またはボンディン
グアイランドのそれぞれへ取付けられる。ボンディング
ワイヤはリードフレームのボンディングフィンガと複数
個の導電線の1つとの間にも取付けられる。
この方法は、電気的に絶縁された熱伝導性基板上に厚
膜を印刷することによって、または基板上に薄膜を堆積
させることによって導電線を形成するステップを含む。
この発明は、セラミック基板上に形成されるリードフ
レームまたは導電線を変えることなく、ダイのさまざま
なサイズに即座に対応する。したがって、この発明に従
えば標準規格のリードフレームまたは共通のリードフレ
ームのいずれをも用いることができる。この発明は導電
線を用いてダイへの接続を与える集積回路のダイへの接
続を可能にする。
電気的に絶縁されたセラミックのダイ取付基板を用い
ることで、ダイ全体をリードフレームから電気的に分離
し、一方で熱伝導性のダイ取付セラミック基板に良好な
熱的性能を提供することができる。
この発明の方法はまた、集積回路のダイ上のボンディ
ングパッドとそれに対応するリードフレームのボンディ
ングフィンガとの間の距離が150ミルよりも大きい場合
のみ導電線またはボンディングアイランドを形成するこ
とをも提供する。
ダイの角でのように、特定のボンディングワイヤの長
さが150ミルを超える場合には、介在導電線が用いられ
る。必要とするボンディングワイヤの長さが150ミルよ
り少ないダイ上のボンディングパッドへの接続には、導
電線の使用は必要ではない。ゆえに、この発明はダイの
特定のサイズに対する必要性と集積回路のダイの各ボン
ディングパッドのワイヤ−ボンディングの長さに対する
要求とに適合される、柔軟性のある技術を提供する。標
準規格のリードフレームの標準規格のダイ取付パドルの
使用にも、この発明は適応する。
図面の簡単な説明 この明細書の中で援用されかつその一部分をなす添付
の図面は、この発明の実施例を図解し、説明とともにこ
の発明の原理を説明する役割を持つ。
図1は、ダイとボンディングフィンガとの間のギャッ
プに渡される2本のより短いボンディングワイヤのため
の介在接続点として働くよう固定される、介在導電性基
板またはブリッジ部材を備えたリードフレームを有する
先行技術の集積回路パッケージアセンブリの断面図であ
る。
図2は、別の先行技術の集積回路パッケージアセンブ
リの断面図であって、このアセンブリは導電性のフィン
ガがそこに形成された絶縁テープ層を有し、その導電性
のフィンガは外に向かって延びかつリードフレームのボ
ンディングフィンガの端に接合される。
図3は、上に集積回路のダイが装着され、かつさまざ
まなサイズの集積回路のダイをリードフレームのボンデ
ィングフィンガへ2本のより短いボンディングワイヤで
接続するための介在接点として働く導電線が上に形成さ
れる、電気的に絶縁された熱伝導性基板を用いる、集積
回路のパッケージの断面図である。
図4は、図3の集積回路のパッケージ配列の平面図あ
って、導電線の上に重なる基板と集積回路のダイを示
す。
図5は、ダイ、リードフレームのボンディングフィン
ガ、および介在導電線が取付けられた、電気的に絶縁さ
れた熱伝導性の基板の断面図である。
図6は、図5の配列の平面的な部分図であって、導電
線またはボンディングアイランドのための1つのパター
ンを示す。
図7は、図5の導電線またはボンディングアイランド
の代替的な配列の平面的な部分図である。
図8は、リードフレームのボンディングフィンガに直
接に接続される導電線がそこに形成された、電気的に絶
縁された熱伝導性の基板を示す断面図である。
図9は、従来のリードフレームのダイ取付パッドに装
着される、電気的に絶縁された熱伝導性の基板を示す断
面図である。
図10は、従来のリードフレームのダイ取付パッドに装
着される電気的に絶縁された熱伝導性基板を示す断面図
であって、熱伝導性基板は、その頂部表面上にで形成さ
れかつセラミック基板の下まで延びてさまざまなサイズ
の集積回路のダイのための2つのより短いボンディング
ワイヤの介在接点として働く導電線またはボンディング
アイランドを含む。
図11は、図10の集積回路パッケージ配列の平面図であ
って、リードフレームのダイ取付パッドに装着された基
板と、基板上の導電線の上に重なる集積回路とを示す。
産業上の応用のためのベストモード この発明の好ましい実施例をここで詳細に参照し、そ
の例は添付の図面で図解される。発明は好ましい実施例
との関連で説明されるが、発明をこれらの実施例に制限
するということは意図されていないことが理解されるで
あろう。その反対に、この発明は後に記載する請求の範
囲によって規定されるこの発明の精神および範囲の中に
含まれるであろう代替例、変形および等価物を包含する
ということが意図されている。
図3および図4は、この発明による集積回路パッケー
ジ構成100を示す。発明のこの実施例は、電気的に絶縁
された熱伝導性基板102を集積回路のダイ104のためのボ
ンディングパッドとして用いる。電気的に絶縁された熱
伝導性基板102は、窒化アルミナ、酸化ベリリウム、非
常に薄い重合体フィルムまたは良好な熱伝導特性を有す
る等価材料のような、セラミック材料で形成される。セ
ラミック基板102は、リードフレームの典型的には106と
して示されるリードのボンディングフィンガ端へ接合さ
れる。セラミック基板102は集積回路のダイ104のための
電気的に絶縁された熱伝導性のダイ取付パッドとして働
く。集積回路のパッケージ構成におけるこの実施例で
は、リードフレームは(図1および2で参照番号14、44
で示されるような)従来の金属製ダイ取付パッドを有し
ていないので従来のものではなく、リードフレームはリ
ード106とともに金属材料の薄いシートから形成され
る。リードはモールドされたパッケージの外部壁からセ
ラミック基板102の中央領域に向かって集中する。
典型的には110として示される導電線は、基板102上に
形成される。これらの線110は2本のより短いボンディ
ングワイヤのための介在接点として働き、これらのボン
ディングワイヤはさまざまなサイズのダイをリードのボ
ンディングフィンガ端に接続するのに用いられる。導電
線110はセラミック基板102の中央エリアから外へ向かっ
て延び、集積回路のダイ104上の(典型的には114として
示される)ボンディングパッドから延びる第1のより短
いボンディングワイヤ112を取付けるための介在取付位
置を提供する。導電線110はまた、ボンディングフィン
ガ106へ延びる第2のより短いボンディングワイヤ116を
取付けるための介在取付エリアをも提供する。
図4も、集積回路のダイ上のワイヤ−ボンディングパ
ッドとボンディングフィンガとの間の全体的な距離また
はボンド−ワイヤの長さが150ミルよりも大きくない場
合に対処する、オプションの使用配列を示す。こういう
場合は、ダイの辺の中点近くにあるリード120に対して
起こり得る。
ボンド−ワイヤの長さが150ミルより大きくない、オ
プションの使用状況では、代替例としては対応する導電
線122を使わずに、中点のボンディングパッド126からの
ボンディングワイヤ124が、ダイ104上のボンディングパ
ッド126から直接にボンディングフィンガ120へ行くよう
にすることもできる。
ワイヤ−ボンドの長さが常に150ミルより小さいこと
が知られているオプションの配列においては、ダイ上の
位置に対応する導電線は除去され、ボンディングワイヤ
130は図4で示されるようにボンディングフィンガとボ
ンディングパッド134との間で直接に接続される。
ダイ104はセラミック基板102に取付けられる。セラミ
ック基板102は、特定的にはダイ104からリードフレーム
のボンディング−フィンガ端106への熱の良導体であ
る。熱伝導性セラミック基板102を使用することで、結
果として集積回路パッケージの熱的性能が向上する。
図5は、この発明による代替的なパッケージング構成
を示す。電気的に絶縁された熱伝導性セラミック基板15
2は、その上部表面に集積回路ダイ154を取付けられてい
る。リードフレームボンディングフィンガ156も、セラ
ミック基板152の上部表面に取付けられている。介在導
電線または介在物158が、たとえば薄膜形成技術または
厚膜印刷技術を用いて、セラミック基板152の上部表面
上に堆積される。ダイと介在物158との間では、ボンデ
ィングワイヤ160で接続がなされる。介在物158とボンデ
ィングフィンガ156との間では、ボンディングワイヤ162
で接続がなされる。ダイ154は介在物158に接触せず、さ
まざまなサイズのダイがこの配列によって対処されるの
で、どのボンディングワイヤの長さも150ミルより小さ
く維持できるということに注目されたい。
導電線のための厚膜のまたは印刷されたパターンを提
供するには、1つの技術は液体エポキシ印刷を用いるこ
とである。表面に導電線のパターンのポジ型に持ち上げ
られた浮き彫りが形成された印刷工具が提供される。印
刷工具は金で充填されたエポキシ材料の中に浸され、セ
ラミック基板の表面上に金で充填されたエポキシ材料が
付けられる。
図6は、図5の一般的なボンディングアイランドまた
は導電線158のパターンの別の代替的実施例を示す平面
図である。導電性材料の長尺のストリップ170は、電気
的に絶縁された熱伝導性基板172の上部表面上に形成さ
れる、堆積された薄膜または印刷された厚膜を用いてセ
ラミック基板172の上部表面上に形成される。典型的に
は174として示される短いボンディングワイヤは、集積
回路のダイ178上のボンディングパッド176とボンディン
グパッド170の内側端177との間を接続する。ボンディン
グパッド170の外側端179は短いボンディングワイヤ181
でボンディングフィンガ180の内側端へ接続される。ダ
イ上のボンディングパッドとそれらに対応するボンディ
ングフィンガとの間の距離が150ミルより小さいパッケ
ージ構成については、介在するボンディングアイランド
が全く使われないということを図6は示す。たとえば、
単一のボンディングワイヤ182はダイ178上のボンディン
グパッド184をそれぞれのボンディングフィンガ186へ接
続する。介在する導電線すなわちボンディングアイラン
ドは、対応するボンディングフィンガまでの距離がダイ
の辺の中点近くのボンディングパッドに対するものより
も大きい、ダイの角近くのボンディングパッドに対して
最も頻繁に必要とされる。
図7は図5の一般的ボンディングアイランド158の別
の代替的パターンを示しており、パターンはセラミック
基板191上に形成される、(典型的には190として示され
る)ジグザグ形の導電性ストリップを含む。導電性スト
リップ190はその内側端に第1のボンディングエリア192
を有する。ボンディングエリア192と集積回路のダイ198
上のボンディングパッド196との間で第1の短いボンデ
ィングワイヤ194が接続される。第2のボンディングエ
リア200には第2の短いボンディングワイヤ202の一方端
が取付けられている。第2の短いボンディングワイヤ20
2の他方端はセラミック基板191に固定されているボンデ
ィングフィンガ204へ取付けられる。この図はまた、150
ミル未満のボンディング距離に対しては、ボンディング
ワイヤ206は直接にダイ198上のボンディングパッド208
とボンディングフィンガ210との間で接続されるという
ことを示す。
図8は、上部表面に集積回路のダイが取付けられた、
電気的に絶縁された熱伝導性セラミック基板220を示
す。導電線224がセラミック基板220上に形成される。リ
ードフレームのボンディングフィンガ226は導電線224に
直接接続される。この配列により、集積回路のダイ222
上の1つのボンディングパッドにつき2つのボンディン
グワイヤは必要でなくなる。単一の短いボンディングワ
イヤ228が、ダイ222上のボンディングパッドと導電線22
4との間で接続されて示される。
図9は、上部表面に集積回路のダイ232が装着され
た、電気的に絶縁された熱伝導性セラミック基板230を
示す。リードフレームのボンディングフィンガ236は、
電気的に絶縁された熱伝導性セラミック基板230へ接着
剤によって直接接合される。ワイヤ−ボンドワイヤ238
はダイ232上のボンディングパッドとボンディングフィ
ンガ236との間で接続される。
図10は、従来のリードフレームのダイ取付パッド242
へ装着された、電気的に絶縁された熱伝導性セラミック
基板240を示す。発明のこの実施例では、導電線244はセ
ラミック基板の上部表面上に形成される。集積回路のダ
イ246は、線244を介してセラミック基板240へ装着され
る。図で示されるように線244をダイの下まで延在させ
ることによって、これらの線244は異なるサイズのダイ
に対処できるように設計されている。線244は、2本の
より短いボンディングワイヤ248、250のための介在接点
として働く。
図11は、図10の集積回路パッケージ配列の平面図であ
る。セラミック基板240はリードフレームのダイ取付パ
ッド242へ装着される。集積回路のダイはセラミック基
板240の上部表面に位置付けられた導電線244の内側端に
重なって示される。ボンディングワイヤ260、262はボン
ディングパッドとそれらに対応するボンディングフィン
ガとの間で直接に接合されて示される。
ボンディングパッドとボンディングフィンガとの間で
のボンディングワイヤ260、262の直接的な接続により、
基板上の導体へのボンディングワイヤの短絡は回避され
る傾向にあるが、これはなぜかというと、集積回路のダ
イ246は導体より上に上げられるからである。これはた
とえばダイが本質的にはキャビティの中の低いところに
据えられて、それにより直接に接合されたワイヤはブリ
ッジ上の導体に接触しやすくなる、図1との比較によ
る。
この発明に従って、集積回路のダイをパッケージング
するための方法が提供される。リードフレームのボンデ
ィングフィンガの端は、電気的に絶縁された熱伝導性基
板の周辺に接合される。集積回路のダイは基板の中央エ
リアに取付けられる。ボンディングワイヤは、集積回路
のダイ上のボンディングパッドと、電気的に絶縁された
熱伝導性基板上に形成される複数個の導電線またはボン
ディングアイランドの1つとの間に取付けられる。ボン
ディングワイヤはリードフレームのボンディングフィン
ガと複数個の導電線またはボンディングアイランドの1
つとの間でも取付けられる。
この方法は、電気的に絶縁された熱伝導性セラミック
基板上に厚膜または薄膜を形成することにより、導電線
またはボンディングアイランドを形成するステップを含
む。ボンディング導電線またはボンディングアイランド
は、集積回路のダイ上のボンディングパッドと、対応す
るリードフレームのボンディングフィンガとの間の距離
が典型的には150ミルを超える場合にオプションで形成
される。
以上に述べたこの発明の特定の実施例の説明は、図解
および説明の目的のために提示されてきた。それらは徹
底的なものとしても、開示されたそのままの形式に発明
を制限するものとしても意図されておらず、上述の教示
に照らして多くの修正および変形が可能であることは明
白である。これらの実施例は、本発明の原理とその実用
的応用とを最もよく説明し、それにより当業者が、この
発明およびと企図される特定の使用に適するさまざまな
修正を伴なうさまざまな実施例を最もよく利用すること
ができるようにするために、選択かつ記述されてきたも
のである。この発明の範囲は以下に述べる請求の範囲と
それらに等価なものとによって規定されることが意図さ
れている。
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭58−192354(JP,A) 特開 平3−89539(JP,A)

Claims (2)

    (57)【特許請求の範囲】
  1. 【請求項1】集積回路のダイをパッケージングするため
    の集積回路パッケージ構成であって、 中央領域に向かって延びる複数個のボンディングフィン
    ガを有するリードフレームと、 前記リードフレームの中央領域に位置付けられ、前記集
    積回路のダイを装着するためのダイ取付パドルを形成す
    る、電気的に絶縁された熱伝導性ダイ取付基板とを含
    み、前記基板はボンディングフィンガの端が前記ダイ取
    付基板の周囲に隣接して固定される第1の表面を有し、
    前記集積回路のダイはダイ取付基板の第1の表面の中央
    エリアへ固定され、さらに 電気的に絶縁された熱伝導性ダイ取付基板の第1の表面
    上に形成される複数個の導電性ボンディング線を含み、
    前記導電性ボンディング線は前記ダイ取付基板の中央エ
    リアから延び、前記導電性ボンディング線の各々は前記
    集積回路のダイ上のボンディングパッドと前記導電性ボ
    ンディング線との間に延びるボンディングワイヤのそれ
    ぞれを取付けるための介在取付エリアのそれぞれを提供
    し、前記導電性ボンディング線は集積回路のダイが前記
    導電性ボンディング線の上に重なる一方でなお導電性ボ
    ンディング線の露出した部分をそれぞれの介在取付エリ
    アとしてそれぞれのボンディングワイヤに提供するよう
    ダイ取付基板の中央エリアから延び、さらに 前記導電性ボンディング線の各々を前記リードフレーム
    の対応するボンディングフィンガへ電気的に接続するた
    めの手段を含み、 前記リードフレーム上の対応するボンディングフィンガ
    から0.150インチより近くに位置づけられた前記集積回
    路のダイ上のボンディングパッドは、そのボンディング
    パッドのための前記導電性ボンディング線を提供されて
    いない、パッケージ構成。
  2. 【請求項2】前記導電性ボンディング線の各々を対応す
    る前記リードフレームのボンディングフィンガへ電気的
    に接続するための前記手段は、前記導電性ボンディング
    線と対応するボンディングフィンガとの間でそれぞれが
    接続される第2のボンディングワイヤを含む、請求項1
    に記載のパッケージ構成。
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5598031A (en) * 1993-06-23 1997-01-28 Vlsi Technology, Inc. Electrically and thermally enhanced package using a separate silicon substrate
JP2002515175A (ja) * 1993-06-23 2002-05-21 ブイ・エル・エス・アイ・テクノロジー・インコーポレイテッド 別個のシリコンサブストレートを用いる電気的および熱的に向上したパッケージ
US5757070A (en) * 1995-10-24 1998-05-26 Altera Corporation Integrated circuit package
AU7130700A (en) * 1999-10-14 2001-04-23 Motorola, Inc. Reconfigurable pinout ball grid array
TWI325617B (en) 2006-12-18 2010-06-01 Chipmos Technologies Inc Chip package and method of manufacturing the same
CN111492476A (zh) * 2017-10-10 2020-08-04 Z格鲁公司 具有引线框架的灵活且集成的模块封装的组装

Family Cites Families (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5694762A (en) * 1979-12-28 1981-07-31 Fujitsu Ltd Plug-in type package
US4754317A (en) * 1986-04-28 1988-06-28 Monolithic Memories, Inc. Integrated circuit die-to-lead frame interconnection assembly and method
US4774635A (en) * 1986-05-27 1988-09-27 American Telephone And Telegraph Company At&T Bell Laboratories Semiconductor package with high density I/O lead connection
EP0351581A1 (de) * 1988-07-22 1990-01-24 Oerlikon-Contraves AG Hochintegrierte Schaltung sowie Verfahren zu deren Herstellung
JP2519806B2 (ja) * 1989-09-12 1996-07-31 株式会社東芝 樹脂封止型半導体装置

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