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CN108320692A - 移位寄存器单元及驱动方法、栅极驱动电路、显示面板 - Google Patents

移位寄存器单元及驱动方法、栅极驱动电路、显示面板 Download PDF

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CN108320692A CN201810151810.5A CN201810151810A CN108320692A CN 108320692 A CN108320692 A CN 108320692A CN 201810151810 A CN201810151810 A CN 201810151810A CN 108320692 A CN108320692 A CN 108320692A
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Abstract

本公开涉及一种移位寄存器单元、移位寄存器单元的驱动方法、栅极驱动电路及显示面板，涉及显示技术领域。该移位寄存器单元包括：输入模块、上拉模块、存储电容、输出模块，用于在第一电压信号的控制下将所述第一电压信号传输至信号输出端；输出控制模块，用于在所述上拉节点的电压信号和第一选择信号的控制下将第一电压信号或第二电源信号传输至信号输出端，以及，在所述上拉节点的电压信号和第二选择信号的控制下将第一电压信号或第二电源信号传输至信号输出端。本公开可提高检测精度。

Description

移位寄存器单元及驱动方法、栅极驱动电路、显示面板
技术领域
本公开涉及显示技术领域，尤其涉及一种移位寄存器单元、移位寄存器单元的驱动方法、栅极驱动电路及其显示面板。
背景技术
随着光学技术和半导体技术的发展，以液晶显示器(Liquid Crystal Display，LCD)和有机发光二极管显示器(Organic Light Emitting Diode，OLED)为代表的平板显示器具有轻薄、能耗低、反应速度快、色纯度佳、以及对比度高等特点，在显示领域占据了主导地位。
近些年来显示装置呈现出了高集成度以及低成本的发展趋势。以阵列基板行驱动(Gate Driver on Array，GOA)技术为代表，利用GOA技术将栅极驱动电路集成于阵列基板的周边区域，从而在实现窄边框设计的同时，有效提高显示装置的集成度，并降低其制造成本。GOA电路中的每一级移位寄存器单元的输出端与一对应的栅线相连，用于向该栅线输出栅极扫描信号，以实现逐行扫描功能。但是，当前的6phaseCLK的GOA单元中，不能同时实现奇偶分行和双向扫描的功能，使得检测的画面较少，检测精准度较差，从而导致显示异常。
需要说明的是，在上述背景技术部分公开的信息仅用于加强对本公开的背景的理解，因此可以包括不构成对本领域普通技术人员已知的现有技术的信息。
发明内容
本公开的目的在于提供一种移位寄存器单元、移位寄存器单元的驱动方法、栅极驱动电路及其显示面板，进而至少在一定程度上克服由于相关技术的限制和缺陷而导致的检测精度较低的问题。
本公开的其他特性和优点将通过下面的详细描述变得显然，或部分地通过本公开的实践而习得。
根据本公开的一个方面，提供一种移位寄存器单元，包括：
输入模块，用于在输入信号的控制下将第一电源信号传输至上拉节点；
上拉模块，用于在所述上拉节点的电压信号的控制下将时钟信号传输至第一节点；
存储电容，连接于所述上拉节点与所述第一节点之间；
输出模块，用于在第一电压信号的控制下将所述第一电压信号传输至信号输出端；
输出控制模块，用于在所述上拉节点的电压信号和第一选择信号的控制下将第一电压信号或第二电源信号传输至信号输出端，以及，在所述上拉节点的电压信号和第二选择信号的控制下将第一电压信号或第二电源信号传输至信号输出端。
在本公开的一种示例性实施例中，所述输出控制模块包括：
第一开关元件，其控制端连接所述上拉节点，第一端用于接收所述第二电源信号，第二端连接第二开关元件的第一端；
所述第二开关元件，其控制端用于接收所述第一选择信号和/或第二选择信号，第一端连接所述第一开关元件的第二端，第二端连接第三开关元件的控制端；
第三开关元件，其控制端连接所述第二开关元件的第二端，第一端用于接收所述第二电源信号，第二端连接所述信号输出端。
在本公开的一种示例性实施例中，所述输出模块包括：
第四开关元件，其控制端和第一端均用于接收所述第一电压信号，第二端连接第三开关元件的控制端；
第五开关元件，其控制端和第一端均用于接收所述第一电压信号，第二端连接所述信号输出端。
在本公开的一种示例性实施例中，所述移位寄存器单元还包括：
复位模块，用于在复位信号的控制下将第二电源信号传输至所述上拉节点或所述第一节点；
降噪模块，用于在第一电压信号的控制下将所述第二电源信号传输至所述第一节点。
在本公开的一种示例性实施例中，所述输入模块包括：
第六开关元件，其控制端用于接收所述输入信号，第一端用于接收所述第一电源信号，第二端连接所述上拉节点。
在本公开的一种示例性实施例中，所述上拉模块包括：
第七开关元件，其控制端连接所述上拉节点，第一端用于接收所述时钟信号，第二端连接所述第一节点。
在本公开的一种示例性实施例中，所述降噪模块包括：
第八开关元件，其控制端连接所述上拉节点，第一端用于接收所述第二电源信号，第二端连接第九开关元件的控制端；
所述第九开关元件，其控制端连接所述第八开关元件的第二端，第一端用于接收所述第二电源信号，第二端连接所述第一节点；
第十开关元件，其控制端和第一端均用于接收所述第一电压信号，第二端连接所述第九开关元件的控制端。
在本公开的一种示例性实施例中，所述复位模块包括：
第十一开关元件，其控制端用于接收所述复位信号，第一端用于接收所述第二电源信号，第二端连接所述上拉节点；
第十二开关元件，其控制端用于接收所述复位信号，第一端用于接收所述第二电源信号，第二端连接所述第一节点。
根据本公开的一个方面，提供一种栅极驱动电路，包括多个级联的上述任意一项所述的移位寄存器单元；
其中，第M级移位寄存器单元的信号输出端的输出信号为第M+3级移位寄存器单元的输入信号；
第M+3级移位寄存器单元的信号输出端的输出信号为第M级移位寄存器单元的复位信号。
在本公开的一种示例性实施例中，级联的所述移位寄存器单元之间的时钟信号反相。
在本公开的一种示例性实施例中，所述栅极驱动电路的扫描方式包括正向扫描或者反向扫描；
正向扫描时，第一电源信号为高电平，第二电源信号为低电平；
反向扫描时，第一电源信号为低电平，第二电源信号为高电平。
根据本公开的一个方面，提供一种移位寄存器单元的驱动方法，用于驱动上述任意一项所述的移位寄存器单元，包括：
在第一选择信号、第二选择信号以及上拉节点的电压信号均为高电平时，将第一电压信号传输至信号输出端；
在第一选择信号、第二选择信号和/或上拉节点的电压信号为低电平时，将第二电源信号传输至信号输出端。
根据本公开的一个方面，提供一种显示面板，包括显示区域和周边区域；其中，所述周边区域设置有上述任意一项所述的栅极驱动电路。
本公开示例性实施方式所提供的移位寄存器单元、移位寄存器单元的驱动方法、栅极驱动电路及其显示面板，通过输出控制电路中上拉节点以及第一选择信号和/或第二选择信号的控制下，将高电平或者低电平信号传输至信号输出端，从而实现选择输出，进一步可以同时实现选择扫描和双向扫描，提高检测精度，从而提供更多的显示画面。
应当理解的是，以上的一般描述和后文的细节描述仅是示例性和解释性的，并不能限制本公开。
附图说明
此处的附图被并入说明书中并构成本说明书的一部分，示出了符合本公开的实施例，并与说明书一起用于解释本公开的原理。显而易见地，下面描述中的附图仅仅是本公开的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1示意性示出本公开示例性实施例中移位寄存器单元的结构示意图；
图2示意性示出本公开示例性实施例中移位寄存器单元正向扫描的工作时序图；
图3示意性示出本公开示例性实施例中移位寄存器单元反向扫描的工作时序图；
图4示意性示出本公开示例性实施例中栅极驱动电路的级联结构图。
附图标记：
M1-M12 第一至第十二开关元件
C 存储电容
Input 输入信号
Output 信号输出端
PU 上拉节点
N1 第一节点
CLK 时钟信号
CLK1-CLK6 第一时钟信号至第六时钟信号
RST 复位信号
VDD 第一电源信号
VGL/VSS 第二电源信号
GCH 第一电压信号
ODD 第一选择信号
EVEN 第二选择信号
具体实施方式
现在将参考附图更全面地描述示例实施方式。然而，示例实施方式能够以多种形式实施，且不应被理解为限于在此阐述的范例；相反，提供这些实施方式使得本公开将更加全面和完整，并将示例实施方式的构思全面地传达给本领域的技术人员。所描述的特征、结构或特性可以以任何合适的方式结合在一个或更多实施方式中。
此外，附图仅为本公开的示意性图解，并非一定是按比例绘制。图中相同的附图标记表示相同或类似的部分，因而将省略对它们的重复描述。附图中所示的一些方框图是功能实体，不一定必须与物理或逻辑上独立的实体相对应。可以采用软件形式来实现这些功能实体，或在一个或多个硬件模块或集成电路中实现这些功能实体，或在不同网络和/或处理器装置和/或微控制器装置中实现这些功能实体。
本示例实施方式提出了一种移位寄存器单元，用于提供栅极扫描信号，以控制TFT的开启与关闭，从而实现信号的传输。如图1所示，所述移位寄存器单元可以包括：
输入模块10，用于在输入信号Input的控制下将第一电源信号VDD传输至上拉节点PU；
上拉模块20，用于在所述上拉节点PU的电压信号的控制下将时钟信号CLK传输至第一节点N1；
存储电容C，连接于所述上拉节点PU与所述第一节点N1之间；
输出模块30，用于在第一电压信号GCH的控制下将所述第一电压信号GCH传输至信号输出端Output；
输出控制模块40，用于在所述上拉节点PU的电压信号和第一选择信号ODD的控制下将第一电压信号GCH或第二电源信号VGL传输至信号输出端Output，以及，在所述上拉节点PU的电压信号和第二选择信号EVEN的控制下将第一电压信号GCH或第二电源信号VGL传输至信号输出端Output。
除此之外，所述移位寄存器单元还可以包括：
降噪模块50，用于在第一电压信号GCH的控制下将所述第二电源信号VGL传输至所述第一节点N1。
复位模块60，用于在复位信号RST的控制下将第二电源信号VGL传输至所述上拉节点PU或所述第一节点N1。
本公开示例性实施方式所提供的移位寄存器单元，通过输出控制电路中上拉节点以及第一选择信号和/或第二选择信号的控制下，将高电平或者低电平信号传输至信号输出端，从而实现选择输出，进一步可以同时实现选择扫描和双向扫描，提高检测精度，从而提供更多的显示画面。
下面结合图1对本示例实施方式中的移位寄存器单元进行详细的说明。如图1中所示，以第一开关元件至第十二开关元件均为N型晶体管为例，控制端可以为晶体管的栅极，第一端可以为晶体管的源极，第二端可以为晶体管的漏极；但需要说明的是，晶体管的源极和漏极并不进行严格区分，因此也可能是第一端为晶体管的漏极，第二端为晶体管的源极。其中：
具体而言，输入模块10可以包括第六开关元件M6，其控制端用于接收输入信号Input，第一端用于接收第一电源信号VDD，第二端连接上拉节点PU。
上拉模块20可以包括第七开关元件M7，其控制端连接上拉节点PU，第一端用于接收时钟信号CLK，第二端连接第一节点N1。
输出模块30可以包括第四开关元件M4以及第五开关元件M5，其中，第四开关元件M4的控制端和第一端均用于接收第一电压信号GCH，第二端连接第三开关元件M3的控制端；第五开关元件M5的控制端和第一端均用于接收第一电压信号GCH，第二端连接信号输出端Output。
输出控制模块40具体可以包括第一开关元件M1、第二开关元件M2以及第三开关元件M3，其中，第一开关元件M1的控制端连接上拉节点PU，第一端用于接收第二电源信号VGL，第二端连接第二开关元件M2的第一端；第二开关元件M2的控制端用于接收第一选择信号ODD和/或第二选择信号EVEN，第一端连接第一开关元件M1的第二端，第二端连接第三开关元件M3的控制端；第三开关元件M3的控制端连接第二开关元件M2的第二端，第一端用于接收第二电源信号VGL，第二端连接信号输出端Output。
降噪模块50可以包括第八开关元件M8、第九开关元件M9以及第十开关元件M10，其中，第八开关元件M8的控制端连接上拉节点PU，第一端用于接收第二电源信号VGL，第二端连接第九开关元件M9的控制端；第九开关元件M9的控制端连接所述第八开关元件M8的第二端，第一端用于接收第二电源信号VGL，第二端连接第一节点N1；第十开关元件M10的控制端和第一端均用于接收第一电压信号GCH，第二端连接第九开关元件M9的控制端。可以通过降噪模块中的开关元件，在非输出时间起到降噪作用，维持输出的低电平，从而防止误输出。
复位模块60可以包括第十一开关元件M11和第十二开关元件M12，其中，第十一开关元件M11的控制端用于接收复位信号RST，第一端用于接收第二电源信号VSS，第二端连接上拉节点PU；第十二开关元件M12的控制端用于接收复位信号RST，第一端用于接收第二电源信号VGL，第二端连接第一节点N1。复位模块用于将上拉节点PU和第一节点N1的电压信号拉低。
在本示例实施方式中，所有开关元件可以采用MOS管(Metal OxideSemiconductor，金属-氧化物-半导体场效应晶体)或者是晶体管，具体而言，第一开关元件至第十二开关元件均可以均采用N型MOS管。除此之外，第一开关元件至第十二开关元件也可以采用P型MOS管。需要说明的是：针对不同的晶体管类型，各个信号端的电平信号需要相应的调整变化。
下面，结合图2所示的正向扫描工作时序图，以及图4所示的级联关系图，对控制时序运行到每个阶段的移位寄存器单元的工作原理进行具体的说明。其中，第一电源信号VDD为高电平信号，第二电源信号VGL/VSS为低电平信号，第一电压信号GCH为高电平信号，第一选择信号ODD以及第二选择信号EVEN可以为高电平信号或低电平信号。
所述移位寄存器单元的工作过程具体可以包括以下阶段：
首先需要说明的是，第一电压信号GCH一直为高电平信号，因此第四开关元件和第五开关元件一直保持打开状态。每一行移位寄存器分别对应一个时钟信号，因此第一行移位寄存器单元至第六行移位寄存器单元分别对应第一时钟信号CLK1至第六时钟信号CLK6。
第一阶段t1：在前三行移位寄存器单元的输入信号Input为起始信号STV时，如果STV为高电平信号，则对应的前三行中每一行移位寄存器单元的第六开关元件M6均在高电平信号STV的作用下而打开，以将第一电源信号VDD经过第六开关元件M6传输至上拉节点PU，从而对存储电容C进行充电，进而使得第一开关元件M1和第七开关元件M7在上拉节点PU的控制下而打开。
第二阶段t2：当第一级中第一行移位寄存器单元的时钟信号CLK1由低变为高后，M1打开，由于M9的控制端信号为高，因此信号输出端Output的电压信号为高电平，也就是说G(1)输出为高电平，同时G(1)作为S(4)为下一级的移位寄存器单元提供输入信号，以对第四行移位寄存器单元的上拉节点PU点进行充电。
第三阶段t3：当第一级第二行移位寄存器单元中的时钟信号CLK2由低变为高时，M1打开；由于M9的控制端信号为高，因此信号输出端Output的电压信号为高电平，也就是说G(2)输出为高电平，同时G(2)作为S(5)为下一级的移位寄存器单元提供输入信号，以对第五行移位寄存器单元的上拉节点PU点进行充电。
第四阶段t4：当第一级第三行移位寄存器单元中的时钟信号CLK3由低变为高时，M1打开；由于M9的控制端信号为高电平，因此信号输出端Output的电压信号为高电平，也就是说G(3)输出为高电平，同时G(3)作为S(6)为下一级的移位寄存器单元提供输入信号，以对第六行移位寄存器单元的上拉节点PU点进行充电。
第五阶段t5：当第一级第四行移位寄存器单元中的时钟信号CLK4由低变为高时，由于第二阶段t2中，G(1)作为S(4)对第四行的上拉节点PU进行充电，因此M1打开；如果M9的控制端接收到高电平信号，则G(4)输出为高电平，同时G(4)作为S(7)为下一级移位寄存器单元提供输入信号，同时G(4)作为RST1对第一行移位寄存器单元进行复位。
第六阶段t6：时钟信号CLK5由低变为高。因为第三阶段中G(2)作为S(5)对第五行移位寄存器单元的上拉节点PU进行充电，使其为高电平信号，所以M1打开；如果M9的控制端接收到高电平信号，则G(5)输出为高电平。G(5)作为S(8)为下一级移位寄存器单元提供输入信号，同时G(5)作为RST2对第二行移位寄存器单元进行复位。
当接收到下级复位信号时，上拉节点PU的电压信号被M11拉低至第二电源信号VSS，同时第一节点N1的电压信号被M12拉低至第二电源信号VGL，因而M1关闭，M3打开，信号输出端Output的输出信号为低电平。
由上可知，信号输出端Output受到上拉节点的电压信号、第二开关元件M2控制端信号ODD/EVEN以及第一电压信号GCH的控制。其中，第一选择信号ODD与移位寄存器单元中的奇数行连接，用于控制移位寄存器单元中奇数行的输出信号；第二选择信号EVEN与移位寄存器单元中的偶数行连接，用于控制移位寄存器单元中偶数行的输出信号。
当上拉节点PU的电压信号为高电平，M1打开；第二开关元件M2控制端接收到高电平信号时，M2打开，则第二电源信号VGL通过M1和M2传输至第三开关元件M3的控制端，因此M3关闭；此时第一电压信号GCH经过M5传输至信号输出端Output，使得信号输出端Output的输出信号为高电平，也就是说对应的栅极驱动信号为高电平，因此对应的TFT开启。
如果第二开关元件M2控制端接收到低电平信号，M2关闭，第一电压信号GCH通过M4传输至第三开关元件M3的控制端，因此M3打开；此时第二电源信号VGL经过M3传输至信号输出端Output，使得信号输出端Output的输出信号为低电平，也就是说对应的栅极驱动信号为低电平，因此对应的TFT关闭。
如果上拉节点PU的电压信号为低电平，M1关闭；第二开关元件M2控制端接收到高电平信号时，M2打开，此时第一电压信号GCH通过M4传输至第三开关元件M3的控制端，因此M3打开；第二电源信号VGL经过M3传输至信号输出端Output，使得信号输出端Output的输出信号为低电平，也就是说对应的栅极驱动信号为低电平，因此对应的TFT关闭。
综上所述，只有M1和M2同时打开时，信号输出端Output的输出信号为高电平，使得对应的TFT打开时才能实现检测。通过本示例中的输出控制模块，可以通过使第一选择信号ODD为高电平信号输出奇数行；或者可以使第二选择信号EVEN为高电平信号输出偶数行；或者可以使第一选择信号ODD和第二选择信号EVEN同时为高电平信号，同时输出奇数行和偶数行，从而实现奇数行和偶数行的选择输出。
需要说明的是：在上述第六阶段t6之后，在一帧扫描时间内，各级移位寄存器单元根据实际情况重复上述第二阶段t2至第六阶段t6即可。
基于上述过程可知，通过输出控制模块中上拉节点的电压信号以及第一选择信号和/或第二选择信号的控制下，将高电平信号或者低电平信号传输至信号输出端，实现奇偶行选择输出，进一步可以同时实现奇偶行选择扫描和双向扫描，提高检测精度，从而提供更多的显示画面。
本示例实施方式还提出了一种栅极驱动电路，可以应用于包括一个或多个时钟信号CLK的GOA电路中；如图4所示，所述栅极驱动电路可以包括多个级联的上述移位寄存器单元；其中，第M级移位寄存器单元的信号输出端Output的输出信号为第M+3级移位寄存器单元的输入信号Input，第M+3级移位寄存器单元的信号输出端Output的输出信号为第M级移位寄存器单元的复位信号RST。需要说明的是，每行移位寄存器单元均对应一个时钟信号，且级联的两行移位寄存器单元之间的时钟信号互为反相关系。
具体而言，第一移位寄存器单元SR1、第二移位寄存器单元SR2、第三移位寄存器单元SR3中的输入信号均可以为一起始信号STV；第四移位寄存器单元SR4的输入信号为第一移位寄存器单元SR1的输出信号，第一移位寄存器单元SR1中的复位信号为第四移位寄存器单元SR4的输出信号。需要注意的是，当时钟信号CLK1为高电平时，时钟信号CLK4为低电平。
在此基础上，所述栅极驱动电路的扫描方式可以包括正向扫描或者反向扫描。当采用正向扫描时，第一级移位寄存器单元中的第一电源信号VDD为起始信号，则第一电源信号为高电平，第二电源信号为低电平；当采用反向扫描时，第二电源信号VSS为起始信号，因此第一电源信号为低电平，第二电源信号为高电平。除此之外，当进行反向扫描时，各移位寄存器之间的级联关系与正向扫描相同，此处不再赘述。
需要说明的是：所述栅极驱动电路中的各模块单元的具体细节已经在对应的移位寄存器单元中进行了详细的描述，这里不再赘述。
本示例实施方式还提出了一种栅极驱动电路的驱动方法，可以用于驱动上述栅极驱动电路，具体包括：
在第一选择信号、第二选择信号以及上拉节点的电压信号均为高电平时，将第一电压信号传输至信号输出端；
在第一选择信号、第二选择信号和/或上拉节点的电压信号为低电平时，将第二电源信号传输至信号输出端。
具体地，在第一选择信号ODD、第二选择信号EVEN、上拉节点的电压信号均为高电平时，信号输出端的输出信号为高电平，可以实现奇数行和偶数行的选择输出。在上拉节点的电压信号或者第一选择信号ODD、第二选择信号EVEN中的任意一个为低电平时，信号输出端的输出信号为低电平。
本示例实施方式还提出了一种显示面板，包括显示区域和周边区域，且在周边区域设置有上述的栅极驱动电路。
基于此可知，本实施例利用GOA技术将栅极驱动电路集成于显示面板的周边，从而实现窄边框面板的设计，同时还可降低显示面板的制造成本。
其中，所述显示面板具体可以为LCD显示面板、OLED显示面板、PLED(PolymerLight-Emitting Diode，高分子发光二极管)显示面板、PDP(Plasma Display Panel，等离子显示面板)等，这里对于显示面板的适用不做具体的限制。
本示例实施方式还提供一种显示装置，包括上述的显示面板。其中，所述显示装置例如可以包括手机、平板电脑、电视机、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
本领域技术人员在考虑说明书及实践这里公开的发明后，将容易想到本公开的其它实施方案。本申请旨在涵盖本公开的任何变型、用途或者适应性变化，这些变型、用途或者适应性变化遵循本公开的一般性原理并包括本公开未公开的本技术领域中的公知常识或惯用技术手段。说明书和实施例仅被视为示例性的，本公开的真正范围和精神由所附的权利要求指出。

Claims (13)

1.一种移位寄存器单元，其特征在于，包括：
输入模块，用于在输入信号的控制下将第一电源信号传输至上拉节点；
上拉模块，用于在所述上拉节点的电压信号的控制下将时钟信号传输至第一节点；
存储电容，连接于所述上拉节点与所述第一节点之间；
输出模块，用于在第一电压信号的控制下将所述第一电压信号传输至信号输出端；
输出控制模块，用于在所述上拉节点的电压信号和第一选择信号的控制下将第一电压信号或第二电源信号传输至信号输出端，以及，在所述上拉节点的电压信号和第二选择信号的控制下将第一电压信号或第二电源信号传输至信号输出端。
2.根据权利要求1所述的移位寄存器单元，其特征在于，所述输出控制模块包括：
第一开关元件，其控制端连接所述上拉节点，第一端用于接收所述第二电源信号，第二端连接第二开关元件的第一端；
所述第二开关元件，其控制端用于接收所述第一选择信号和/或第二选择信号，第一端连接所述第一开关元件的第二端，第二端连接第三开关元件的控制端；
第三开关元件，其控制端连接所述第二开关元件的第二端，第一端用于接收所述第二电源信号，第二端连接所述信号输出端。
3.根据权利要求1所述的移位寄存器单元，其特征在于，所述输出模块包括：
第四开关元件，其控制端和第一端均用于接收所述第一电压信号，第二端连接第三开关元件的控制端；
第五开关元件，其控制端和第一端均用于接收所述第一电压信号，第二端连接所述信号输出端。
4.根据权利要求1所述的移位寄存器单元，其特征在于，所述移位寄存器单元还包括：
复位模块，用于在复位信号的控制下将第二电源信号传输至所述上拉节点或所述第一节点；
降噪模块，用于在第一电压信号的控制下将所述第二电源信号传输至所述第一节点。
5.根据权利要求1所述的移位寄存器单元，其特征在于，所述输入模块包括：
第六开关元件，其控制端用于接收所述输入信号，第一端用于接收所述第一电源信号，第二端连接所述上拉节点。
6.根据权利要求1所述的移位寄存器单元，其特征在于，所述上拉模块包括：
第七开关元件，其控制端连接所述上拉节点，第一端用于接收所述时钟信号，第二端连接所述第一节点。
7.根据权利要求4所述的移位寄存器单元，其特征在于，所述降噪模块包括：
第八开关元件，其控制端连接所述上拉节点，第一端用于接收所述第二电源信号，第二端连接第九开关元件的控制端；
所述第九开关元件，其控制端连接所述第八开关元件的第二端，第一端用于接收所述第二电源信号，第二端连接所述第一节点；
第十开关元件，其控制端和第一端均用于接收所述第一电压信号，第二端连接所述第九开关元件的控制端。
8.根据权利要求4所述的移位寄存器单元，其特征在于，所述复位模块包括：
第十一开关元件，其控制端用于接收所述复位信号，第一端用于接收所述第二电源信号，第二端连接所述上拉节点；
第十二开关元件，其控制端用于接收所述复位信号，第一端用于接收所述第二电源信号，第二端连接所述第一节点。
9.一种栅极驱动电路，其特征在于，包括多个级联的权利要求1-8任意一项所述的移位寄存器单元；
其中，第M级移位寄存器单元的信号输出端的输出信号为第M+3级移位寄存器单元的输入信号；
第M+3级移位寄存器单元的信号输出端的输出信号为第M级移位寄存器单元的复位信号。
10.根据权利要求9所述的栅极驱动电路，其特征在于，级联的所述移位寄存器单元之间的时钟信号反相。
11.根据权利要求9所述的栅极驱动电路，其特征在于，所述栅极驱动电路的扫描方式包括正向扫描或者反向扫描；
正向扫描时，第一电源信号为高电平，第二电源信号为低电平；
反向扫描时，第一电源信号为低电平，第二电源信号为高电平。
12.一种移位寄存器单元的驱动方法，用于驱动权利要求1-8任意一项所述的移位寄存器单元；其特征在于，包括：
在第一选择信号、第二选择信号以及上拉节点的电压信号均为高电平时，将第一电压信号传输至信号输出端；
在第一选择信号、第二选择信号和/或上拉节点的电压信号为低电平时，将第二电源信号传输至信号输出端。
13.一种显示面板，其特征在于，包括显示区域和周边区域；其中，所述周边区域设置有权利要求9-11任意一项所述的栅极驱动电路。
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