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CN106935206B - 移位寄存器单元、移位寄存器电路及驱动方法、显示面板 - Google Patents

移位寄存器单元、移位寄存器电路及驱动方法、显示面板 Download PDF

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CN106935206B CN201710321958.4A CN201710321958A CN106935206B CN 106935206 B CN106935206 B CN 106935206B CN 201710321958 A CN201710321958 A CN 201710321958A CN 106935206 B CN106935206 B CN 106935206B
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Abstract

本公开涉及一种移位寄存器单元、移位寄存器电路及其驱动方法、显示面板。该移位寄存器单元包括：输入模块，响应输入信号将输入信号传至上拉节点；复位模块，响应复位信号将第一电源信号传至上拉节点；输出模块，响应上拉节点将时钟信号传至信号输出端；第一下拉控制模块，响应上拉节点将第一电源信号传至第一和第二下拉控制节点及下拉节点；第二下拉控制模块，响应第二电源信号将第二电源信号传至第一下拉控制节点，响应第一下拉控制节点将第二电源信号传至第二下拉控制节点，响应第二下拉控制节点将第二电源信号传至下拉节点；下拉模块，响应下拉节点将第一电源信号传至上拉节点和信号输出端。本公开可保证信号正常输出并改善降噪能力。

Description

移位寄存器单元、移位寄存器电路及驱动方法、显示面板
技术领域
本公开涉及显示技术领域，尤其涉及一种移位寄存器单元、移位寄存器电路及其驱动方法、显示面板。
背景技术
随着光学技术和半导体技术的发展，以液晶显示器(Liquid Crystal Display，LCD)和有机发光二极管显示器(Organic Light Emitting Diode，OLED)为代表的平板显示器具有轻薄、能耗低、反应速度快、色纯度佳、以及对比度高等特点，在显示领域占据了主导地位。近些年来显示装置呈现出了高集成度以及低成本的发展趋势。以阵列基板行驱动(Gate Driver on Array，GOA)技术为代表，利用GOA技术将栅极驱动电路集成于阵列基板的周边区域，从而在实现窄边框设计的同时，可有效降低显示装置的制造成本。
图1为现有技术中常用的一种GOA电路原理图。其中，第八晶体管M8和第九晶体管M9构成降噪处理单元，用于在下拉节点PD的控制下进行降噪处理，且下拉节点PD的电位越高，降噪处理的效果越好。而下拉节点PD的电位由上拉节点PU控制，具体而言，在上拉节点PU为高电位时，第四晶体管M4和第五晶体管M5充分导通，则下拉控制节点PD-CN和下拉节点PD受到第一电源电压VSS的影响下拉为低电位，且第七晶体管M7在下拉控制节点PD-CN的控制下关闭，故下拉节点PD保持低电位。为了达到更好的降噪效果，需要在降噪时提高下拉节点PD的电位，具体可通过提高第二电源电压VDD的电位来实现。但是，第二电源电压VDD过高的电位会使第六晶体管M6充分导通，以使下拉控制节点PD-CN的电位随之上升，从而第七晶体管M7导通，最终导致下拉节点PD的电位升高。参考图2所示，在上拉节点PU置高时，下拉节点PD本应保持低电位，但在第二电源电压VDD的过高电位作用下使得下拉节点PD的电位异常升高，从而导致GOA电路的输出波形异常，无法正常复位且噪音较大。
需要说明的是，在上述背景技术部分公开的信息仅用于加强对本公开的背景的理解，因此可以包括不构成对本领域普通技术人员已知的现有技术的信息。
发明内容
本公开的目的在于提供一种移位寄存器单元、移位寄存器电路及其驱动方法、显示面板，进而至少在一定程度上克服由于相关技术的限制和缺陷而导致的一个或者多个问题。
本公开的其他特性和优点将通过下面的详细描述变得显然，或部分地通过本公开的实践而习得。
根据本公开的一个方面，提供一种移位寄存器单元，包括：
输入模块，连接信号输入端和上拉节点，用于在所述信号输入端的控制下将输入信号传输至所述上拉节点；
复位模块，连接复位信号端、第一电源信号端和所述上拉节点，用于在所述复位信号端的控制下将第一电源信号传输至所述上拉节点；
输出模块，连接所述上拉节点、时钟信号端和信号输出端，用于在所述上拉节点的控制下将时钟信号传输至所述信号输出端；
第一下拉控制模块，连接所述上拉节点、所述第一电源信号端、第一下拉控制节点、第二下拉控制节点、以及下拉节点，用于在所述上拉节点的控制下将所述第一电源信号分别传输至所述第一下拉控制节点、所述第二下拉控制节点、以及所述下拉节点；
第二下拉控制模块，连接第二电源信号端、所述第一下拉控制节点、所述第二下拉控制节点、以及所述下拉节点，用于在所述第二电源信号端的控制下将第二电源信号传输至所述第一下拉控制节点，在所述第一下拉控制节点的控制下将所述第二电源信号传输至所述第二下拉控制节点，以及在所述第二下拉控制节点的控制下将所述第二电源信号传输至所述下拉节点；
下拉模块，连接所述下拉节点、所述第一电源信号端、所述上拉节点和所述信号输出端，用于在所述下拉节点的控制下将所述第一电源信号分别传输至所述上拉节点和所述信号输出端。
本公开的一种示例性实施例中，所述输入模块包括：
第一开关元件，控制端和第一端连接所述信号输入端、第二端连接所述上拉节点。
本公开的一种示例性实施例中，所述复位模块包括：
第二开关元件，控制端连接所述复位信号端、第一端连接所述第一电源信号端，第二端连接所述上拉节点。
本公开的一种示例性实施例中，所述输出模块包括：
第三开关元件，控制端连接所述上拉节点、第一端连接所述时钟信号端，第二端连接所述信号输出端；
存储电容，连接在所述上拉节点和所述信号输出端之间。
本公开的一种示例性实施例中，所述第一下拉控制模块包括：
第四开关元件，控制端连接所述上拉节点、第一端连接所述第一电源信号端、第二端连接所述第一下拉控制节点；
第五开关元件，控制端连接所述上拉节点、第一端连接所述第一电源信号端、第二端连接所述第二下拉控制节点；
第六开关元件，控制端连接所述上拉节点、第一端连接所述第一电源信号端、第二端连接所述下拉节点。
本公开的一种示例性实施例中，所述第二下拉控制模块包括：
所述第二下拉控制模块包括：
第七开关元件，控制端和第一端连接所述第二电源信号端、第二端连接所述第一下拉控制节点；
第八开关元件，控制端连接所述第一下拉控制节点、第一端连接所述第二电源信号端，第二端连接所述第二下拉控制节点；
第九开关元件，控制端连接所述第二下拉控制节点、第一端连接所述第二电源信号端、第二端连接所述下拉节点。
本公开的一种示例性实施例中，所述下拉模块包括：
第十开关元件，控制端连接所述下拉节点、第一端连接所述第一电源信号端、第二端连接所述上拉节点；
第十一开关元件，控制端连接所述下拉节点、第一端连接所述第一电源信号端、第二端连接所述信号输出端。
本公开的一种示例性实施例中，所有所述开关元件均为N型晶体管或者均为P型晶体管。
根据本公开的一个方面，提供一种移位寄存器电路，包括多个级联的上述的移位寄存器单元；
第M-1级移位寄存器单元的信号输出端连接第M级移位寄存器单元的信号输入端；
第M+1级移位寄存器单元的信号输出端连接第M级移位寄存器单元的复位信号端。
根据本公开的一个方面，提供一种显示面板，包括显示区域和周边区域；所述周边区域设置有上述的移位寄存器电路。
本公开的一种示例性实施例中，所述显示面板还包括：
横纵交错的多条栅线和多条数据线；以及，由相邻所述栅线和相邻所述数据线限定的多个像素单元：
其中，所述栅线用于传输所述移位寄存器电路提供的扫描信号，所述数据线用于传输源极驱动器提供的数据信号。
根据本公开的一个方面，提供一种移位寄存器电路的驱动方法，用于驱动上述的移位寄存器电路；所述驱动方法包括：
在充电阶段，通过输入信号控制输入模块导通，以将所述输入信号传输至上拉节点，并通过所述上拉节点控制第一下拉控制模块导通，以将第一电源信号分别传输至第一下拉控制节点、第二下拉控制节点、以及下拉节点；
在输出阶段，通过所述上拉节点控制所述第一下拉控制模块和输出模块导通，以将所述第一电源信号分别传输至所述第一下拉控制节点、所述第二下拉控制节点、以及所述下拉节点，并将时钟信号传输至信号输出端；
在放电阶段，通过所述上拉节点控制所述第一下拉控制模块导通，以保持所述第一下拉控制节点、所述第二下拉控制节点、以及所述下拉节点的电压；
在复位阶段，通过复位信号控制复位模块导通，以将所述第一电源信号传输至所述上拉节点，通过第二电源信号控制第二下拉控制模块导通，以将所述第二电源信号分别传输至所述第一下拉控制节点、所述第二下拉控制节点、以及所述下拉节点，并通过所述下拉节点控制下拉模块导通，以将所述第一电源信号分别传输至所述上拉节点以及所述信号输出端。
本公开示例性实施方式所提供的移位寄存器单元、移位寄存器电路及其驱动方法、显示面板，在传统移位寄存器单元的基础上增加了一下拉控制节点，并通过第一下拉控制模块和第二下拉控制模块的共同作用实现对第一下拉控制节点、第二下拉控制节点、以及下拉节点的电位的控制。这样一来，在上拉节点处于低电位时，可以关闭第一下拉控制模块的功能，通过第二下拉控制模块充分拉高第一下拉控制节点、第二下拉控制节点、以及下拉节点的电位，以使上拉节点置低时下拉节点的电位足够高，从而改善降噪效果；而在上拉节点处于高电位时，可以通过第一下拉控制模块拉低第一下拉控制节点、第二下拉控制节点、以及下拉节点的电位，同时由于第二下拉控制模块是逐级实现对第一下拉控制节点、第二下拉控制节点、以及下拉节点的电位的控制，因此位于最后端的下拉节点受到第二电源信号的影响最弱，故可以保持下拉节点的低电位不被拉高，即在上拉节点置高时保持下拉节点的电位足够低，从而防止移位寄存器单元的输出异常。基于此，本公开提供的移位寄存器单元可在上拉节点置低时保证下拉节点的电位足够高，上拉节点置高时保证下拉节点的电位足够低，从而保证信号的正常输出并改善降噪能力。
应当理解的是，以上的一般描述和后文的细节描述仅是示例性和解释性的，并不能限制本公开。
附图说明
此处的附图被并入说明书中并构成本说明书的一部分，示出了符合本公开的实施例，并与说明书一起用于解释本公开的原理。显而易见地，下面描述中的附图仅仅是本公开的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1示意性示出现有技术中的GOA电路原理图；
图2示意性示出图1中的GOA电路的模拟波形图；
图3示意性示出本公开示例性实施例中移位寄存器单元的结构示意图；
图4示意性示出本公开示例性实施例中移位寄存器电路的模拟波形图；
图5示意性示出本公开示例性实施例中移位寄存器电路的级联结构图。
具体实施方式
现在将参考附图更全面地描述示例实施方式。然而，示例实施方式能够以多种形式实施，且不应被理解为限于在此阐述的范例；相反，提供这些实施方式使得本公开将更加全面和完整，并将示例实施方式的构思全面地传达给本领域的技术人员。所描述的特征、结构或特性可以以任何合适的方式结合在一个或更多实施方式中。
此外，附图仅为本公开的示意性图解，并非一定是按比例绘制。图中相同的附图标记表示相同或类似的部分，因而将省略对它们的重复描述。附图中所示的一些方框图是功能实体，不一定必须与物理或逻辑上独立的实体相对应。可以采用软件形式来实现这些功能实体，或在一个或多个硬件模块或集成电路中实现这些功能实体，或在不同网络和/或处理器装置和/或微控制器装置中实现这些功能实体。
本示例实施方式提出了一种移位寄存器单元，可改善移位寄存器电路的降噪能力。如图3所示，所述移位寄存器单元可以包括：
输入模块10，连接信号输入端Input和上拉节点PU，用于在所述信号输入端Input的控制下将所述信号输入端Input的输入信号传输至上拉节点PU；
复位模块20，连接复位信号端Reset、第一电源信号端VSS和上拉节点PU，用于在所述复位信号端Reset的控制下将所述第一电源信号端VSS的第一电源信号传输至上拉节点PU；
输出模块30，连接上拉节点PU、时钟信号端CLK和信号输出端Output，用于在所述上拉节点PU的控制下将所述时钟信号端CLK的时钟信号传输至信号输出端Output；
第一下拉控制模块40，连接上拉节点PU、第一电源信号端VSS、第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD，用于在所述上拉节点PU的控制下将所述第一电源信号端VSS的第一电源信号分别传输至第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD；
第二下拉控制模块50，连接第二电源信号端VDD、第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD，用于在所述第二电源信号端VDD的控制下将所述第二电源信号端VDD的第二电源信号分别传输至第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD；
下拉模块60，连接下拉节点PD、第一电源信号端VSS、上拉节点PU和信号输出端Output，用于在所述下拉节点PD的控制下将所述第一电源信号端VSS的第一电源信号分别传输至上拉节点PU以及信号输出端Output。
其中，所述第一电源信号可以为低电平信号，所述第二电源信号可以为高电平信号。
需要说明的是：为了提高降噪处理时下拉节点PD的电位，第二电源信号相对于现有技术设置为一更高的电压，例如通常的高电位设置在24V左右，而本实施例中的第二电源信号设置在33V左右。
本公开示例性实施方式所提供的移位寄存器单元，在传统移位寄存器单元的基础上增加了一下拉控制节点，并通过第一下拉控制模块40和第二下拉控制模块50的共同作用实现对第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD的电位的控制。这样一来，在上拉节点PU处于低电位时，可以关闭第一下拉控制模块40的功能，通过第二下拉控制模块50充分拉高第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD的电位，以使上拉节点PU置低时下拉节点PD的电位足够高，从而改善降噪效果；而在上拉节点PU处于高电位时，可以通过第一下拉控制模块40拉低第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD的电位，同时由于第二下拉控制模块50是逐级实现对第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD的电位的控制，因此位于最后端的下拉节点PD受到第二电源信号的影响最弱，故可以保持下拉节点PD的低电位不被拉高，即在上拉节点PU置高时保持下拉节点PD的电位足够低，从而防止移位寄存器单元的输出异常。基于此，本公开提供的移位寄存器单元可在上拉节点PU置低时保证下拉节点PD的电位足够高，上拉节点PU置高时保证下拉节点PD的电位足够低，从而保证信号的正常输出并改善降噪能力。
基于本示例实施方式提供的所述移位寄存器单元，其工作原理可以包括如下阶段：
S1、在充电阶段，通过信号输入端Input的输入信号控制输入模块10导通，以将输入信号传输至上拉节点PU，并通过上拉节点PU控制第一下拉控制模块40导通，以将第一电源信号端VSS的第一电源信号分别传输至第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD。
其中，本级移位寄存器单元的输入信号可以是上一级移位寄存器单元的输出信号，且当本级移位寄存器单元为第一级移位寄存器单元时，可以以一初始信号STV作为其输入信号。
本阶段可对上拉节点PU进行充电以使其逐渐上升至高电平，同时还可通过第一下拉控制模块40拉低下拉节点PD的电位，防止其对上拉节点PU的电位产生影响。
S2、在输出阶段，通过上拉节点PU控制第一下拉控制模块40和输出模块30导通，以将第一电源信号端VSS的第一电源信号分别传输至第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD，并将时钟信号端CLK的时钟信号传输至信号输出端Output。
其中，本级移位寄存器单元的输出信号可作为像素的扫描信号提供至扫描线。
本阶段上拉节点PU保持为高电平，且在实现信号输出的同时，还通过第一下拉控制模块40拉低下拉节点PD的电位，防止其对信号输出端Output的输出信号产生影响。
S3、在放电阶段，通过上拉节点PU控制第一下拉控制模块40导通，以保持第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD的电压。
本阶段处于信号输出结束后的放电阶段，此时上拉节点PU处于半高电位，信号输出端Output与时钟信号端CLK的电位相同，且下拉节点PD的电位依然处于拉低状态。
本实施例中，由于第二电源信号端VDD的第二电源信号的电位高于现有技术中高电平的电位，因此不可避免的会拉高第一下拉控制节点PD-CN-1的电位，从而导致第二下拉控制节点PD-CN-2的电位也会受到影响，进而影响至下拉节点PD；但由于第二下拉控制节点PD-CN-2的电位所受的影响小于第一下拉控制节点PD-CN-1的电位所受的影响，且下拉节点PD的电位所受的影响也小于第二下拉控制节点PD-CN-2的电位所受的影响，因此通过这种逐级控制的关系，使得第二电源信号对于下拉节点PD的影响已经相对很低，可以忽略不计，从而保证了在该放电阶段下拉节点PD的电位不会异常上升。
S4、在复位阶段，通过复位信号端Reset的复位信号控制复位模块20导通，以将第一电源信号端VSS的第一电源信号传输至上拉节点PU，并通过第二电源信号端VDD的第二电源信号控制第二下拉控制模块50导通，以将第二电源信号端VDD的第二电源信号分别传输至第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD，再通过下拉节点PD控制下拉模块60导通，以将第一电源信号端VSS的第一电源信号分别传输至上拉节点PU以及信号输出端Output。
其中，本级移位寄存器单元的复位信号可以是下一级移位寄存器单元的输出信号。
本阶段可拉低上拉节点PU的电位以及拉高下拉节点PD的电位，通过下拉模块60持续的为上拉节点PU和信号输出端Output放电。由于下拉节点PD与第二电源信号端VDD的第二电源信号的电位相同，而第二电源信号的电位相对较高，因此本实施例的降噪效果得到了明显的改善。
下面结合图3对本示例实施方式中的移位寄存器单元进行详细的说明。
所述输入模块10可以包括：第一开关元件T1，其控制端和第一端连接所述信号输入端Input、第二端连接所述上拉节点PU。
所述复位模块20可以包括：第二开关元件T2，其控制端连接所述复位信号端Reset、第一端连接所述第一电源信号端VSS，第二端连接所述上拉节点PU。
所述输出模块30可以包括：第三开关元件T3，其控制端连接所述上拉节点PU、第一端连接所述时钟信号端CLK，第二端连接所述信号输出端Output；以及存储电容C，连接在所述上拉节点PU和所述信号输出端Output之间。
所述第一下拉控制模块40可以包括：第四开关元件T4，其控制端连接所述上拉节点PU、第一端连接所述第一电源信号端VSS、第二端连接所述第一下拉控制节点PD-CN-1；第五开关元件T5，其控制端连接所述上拉节点PU、第一端连接所述第一电源信号端VSS、第二端连接所述第二下拉控制节点PD-CN-2；第六开关元件T6，其控制端连接所述上拉节点PU、第一端连接所述第一电源信号端VSS、第二端连接所述下拉节点PD。
所述第二下拉控制模块50可以包括：第七开关元件T7，其控制端和第一端连接所述第二电源信号端VDD、第二端连接所述第一下拉控制节点PD-CN-1；第八开关元件T8，其控制端连接所述第一下拉控制节点PD-CN-1、第一端连接所述第二电源信号端VDD，第二端连接所述第二下拉控制节点PD-CN-2；第九开关元件T9，其控制端连接所述第二下拉控制节点PD-CN-2、第一端连接所述第二电源信号端VDD、第二端连接所述下拉节点PD。
所述下拉模块60可以包括：第十开关元件T10，其控制端连接所述下拉节点PD、第一端连接所述第一电源信号端VSS、第二端连接所述上拉节点PU；第十一开关元件T11，其控制端连接所述下拉节点PD、第一端连接所述第一电源信号端VSS、第二端连接所述信号输出端Output。
在本示例实施方式中，所有开关元件均可以采用MOS(Metal OxideSemiconductor，金属-氧化物-半导体场效应晶体管)场效应晶体管，其具体可以均采用P型MOS管或者均采用N型MOS管。需要说明的是：针对不同的晶体管类型，各个信号端的电平信号需要相应的调整变化。
基于上述结构，以所有开关元件均为NMOS为例，结合图4所示的波形图对本实施例中的移位寄存器单元的工作原理进行具体的说明。其中，第一电源信号端VSS的第一电源信号为低电平信号，第二电源信号端VDD的第二电源信号为高电平信号。
所述移位寄存器电路的工作过程可以包括：
在t1阶段，信号输入端Input的输入信号为高电平，第一开关元件T1导通，将输入信号传输至上拉节点PU并对存储电容C充电，则上拉节点PU为高电平；在上拉节点PU的高电平作用下，第四开关元件T4、第五开关元件T5和第六开关元件T6导通，分别将第一电源信号端VSS的第一电源信号传输至第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD，从而保证下拉节点PD为低电平。
在t2阶段，在存储电容C的作用下上拉节点PU保持高电平，第四开关元件T4、第五开关元件T5和第六开关元件T6导通，分别将第一电源信号端VSS的第一电源信号传输至第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD，从而保证下拉节点PD为低电平；同时，时钟信号端CLK的时钟信号为高电平，在上拉节点PU的高电平作用下，第三开关元件T3导通，将时钟信号传输至信号输出端Output，从而输出高电平信号。
在t3阶段，时钟信号端CLK的时钟信号为低电平，而上拉节点PU处于半高电位，此时第三开关元件T3仍导通，信号输出端Output的电位等于时钟信号的低电平电位；在上拉节点PU的作用下，第四开关元件T4、第五开关元件T5和第六开关元件T6依然导通，第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、以及下拉节点PD的电位仍处于拉低状态。
在t4阶段，复位信号端Reset的复位信号为高电平，第二开关元件T2导通，将第一电源信号端VSS的第一电源信号传输至上拉节点PU，以拉低上拉节点PU的电位，则第四开关元件T4、第五开关元件T5和第六开关元件T6均关闭；此时在第二电源信号端VDD的第二电源信号的作用下，第七开关元件T7导通，将第二电源信号传输至第一下拉控制节点PD-CN-1，使得第一下拉控制节点PD-CN-1为高电位，则第八开关元件T8导通，将第二电源信号传输至第二下拉控制节点PD-CN-2，使得第二下拉控制节点PD-CN-2为高电位，则第九开关元件T9导通，将第二电源信号传输至下拉节点PD，使得下拉节点PD为高电位；此时在下拉节点PD的作用下，第十开关元件T10和第十一开关元件T11导通，并通过第一电源信号端VSS的第一电源信号拉低上拉节点PU和信号输出端Output的电位。
本示例实施方式中，由于第二电源信号端VDD的第二电源信号的电位高于现有技术中的高电平电位，因此在降噪阶段下拉节点PD的电位相对较高，从而可以改善降噪效果；在此基础上，当上拉节点PU处于高电位时，一方面可以导通第四开关元件T4、第五开关元件T5和第六开关元件T6以利用第一电源信号拉低第一下拉控制节点PD-CN-1、第二下拉控制节点PD-CN-2、和下拉节点PD的电位，另一方面由于第七开关元件T7、第八开关元件T8和第九开关元件T9的逐级连接关系可削弱第二电源信号对下拉节点PD的影响，因此可保持下拉节点PD的低电位，从而防止移位寄存器单元的输出异常。
本示例实施方式还提出了一种移位寄存器电路，可用作栅极驱动电路。如图5所示，所述移位寄存器电路可以包括多个级联的上述移位寄存器单元；其中，第M-1级移位寄存器单元的信号输出端Output连接第M级移位寄存器单元的信号输入端Input；第M+1级移位寄存器单元的信号输出端Output连接第M级移位寄存器单元的复位信号端Reset。
需要说明的是：所述移位寄存器电路中的各模块单元的具体细节已经在对应的移位寄存器单元中进行了详细的描述，这里不再赘述。
本示例实施方式还提出了一种显示面板，包括显示区域和周边区域。所述显示面板的周边区域可以设置上述的移位寄存器电路。所述显示面板的显示区域可以包括横纵交错的多条栅线和多条数据线，以及由相邻所述栅线和相邻所述数据线限定的多个像素单元：其中，所述栅线用于传输所述移位寄存器电路提供的扫描信号，所述数据线用于传输源极驱动器提供的数据信号。
基于此，本实施方式利用GOA技术将移位寄存器电路集成于显示面板的周边，从而实现窄边框面板的设计，同时还可降低显示面板的制造成本。
本示例实施方式中，所述显示面板具体可以为LCD显示面板、OLED显示面板、PLED(Polymer Light-Emitting Diode，高分子发光二极管)显示面板、PDP(Plasma DisplayPanel，等离子显示面板)等，这里对于显示面板的适用不做具体的限制。
本示例实施方式还提供一种显示装置，包括上述的显示面板。其中，所述显示装置例如可以包括手机、平板电脑、电视机、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
应当注意，尽管在上文详细描述中提及了用于动作执行的设备的若干模块或者单元，但是这种划分并非强制性的。实际上，根据本公开的实施方式，上文描述的两个或更多模块或者单元的特征和功能可以在一个模块或者单元中具体化。反之，上文描述的一个模块或者单元的特征和功能可以进一步划分为由多个模块或者单元来具体化。
此外，尽管在附图中以特定顺序描述了本公开中方法的各个步骤，但是，这并非要求或者暗示必须按照该特定顺序来执行这些步骤，或是必须执行全部所示的步骤才能实现期望的结果。附加的或备选的，可以省略某些步骤，将多个步骤合并为一个步骤执行，以及/或者将一个步骤分解为多个步骤执行等。
通过以上的实施方式的描述，本领域的技术人员易于理解，这里描述的示例实施方式可以通过软件实现，也可以通过软件结合必要的硬件的方式来实现。因此，根据本公开实施方式的技术方案可以以软件产品的形式体现出来，该软件产品可以存储在一个非易失性存储介质(可以是CD-ROM，U盘，移动硬盘等)中或网络上，包括若干指令以使得一台计算设备(可以是个人计算机、服务器、移动终端、或者网络设备等)执行根据本公开实施方式的方法。
本领域技术人员在考虑说明书及实践这里公开的发明后，将容易想到本公开的其它实施方案。本申请旨在涵盖本公开的任何变型、用途或者适应性变化，这些变型、用途或者适应性变化遵循本公开的一般性原理并包括本公开未公开的本技术领域中的公知常识或惯用技术手段。说明书和实施例仅被视为示例性的，本公开的真正范围和精神由所附的权利要求指出。

Claims (12)

1.一种移位寄存器单元，包括：
输入模块，连接信号输入端和上拉节点，用于在所述信号输入端的控制下将输入信号传输至所述上拉节点；
输出模块，连接所述上拉节点、时钟信号端和信号输出端，用于在所述上拉节点的控制下将时钟信号传输至所述信号输出端；
其特征在于，所述移位寄存器单元还包括：
复位模块，连接复位信号端、第一电源信号端和所述上拉节点，用于在所述复位信号端的控制下将第一电源信号传输至所述上拉节点；
第一下拉控制模块，连接所述上拉节点、所述第一电源信号端、第一下拉控制节点、第二下拉控制节点、以及下拉节点，用于在所述上拉节点的控制下将所述第一电源信号分别传输至所述第一下拉控制节点、所述第二下拉控制节点、以及所述下拉节点；
第二下拉控制模块，连接第二电源信号端、所述第一下拉控制节点、所述第二下拉控制节点、以及所述下拉节点，用于在所述第二电源信号端的控制下将第二电源信号传输至所述第一下拉控制节点，在所述第一下拉控制节点的控制下将所述第二电源信号传输至所述第二下拉控制节点，以及在所述第二下拉控制节点的控制下将所述第二电源信号传输至所述下拉节点；
下拉模块，连接所述下拉节点、所述第一电源信号端、所述上拉节点和所述信号输出端，用于在所述下拉节点的控制下将所述第一电源信号分别传输至所述上拉节点和所述信号输出端。
2.根据权利要求1所述的移位寄存器单元，其特征在于，所述输入模块包括：
第一开关元件，控制端和第一端连接所述信号输入端、第二端连接所述上拉节点。
3.根据权利要求1所述的移位寄存器单元，其特征在于，所述复位模块包括：
第二开关元件，控制端连接所述复位信号端、第一端连接所述第一电源信号端，第二端连接所述上拉节点。
4.根据权利要求1所述的移位寄存器单元，其特征在于，所述输出模块包括：
第三开关元件，控制端连接所述上拉节点、第一端连接所述时钟信号端，第二端连接所述信号输出端；
存储电容，连接在所述上拉节点和所述信号输出端之间。
5.根据权利要求1所述的移位寄存器单元，其特征在于，所述第一下拉控制模块包括：
第四开关元件，控制端连接所述上拉节点、第一端连接所述第一电源信号端、第二端连接所述第一下拉控制节点；
第五开关元件，控制端连接所述上拉节点、第一端连接所述第一电源信号端、第二端连接所述第二下拉控制节点；
第六开关元件，控制端连接所述上拉节点、第一端连接所述第一电源信号端、第二端连接所述下拉节点。
6.根据权利要求1所述的移位寄存器单元，其特征在于，所述第二下拉控制模块包括：
第七开关元件，控制端和第一端连接所述第二电源信号端、第二端连接所述第一下拉控制节点；
第八开关元件，控制端连接所述第一下拉控制节点、第一端连接所述第二电源信号端，第二端连接所述第二下拉控制节点；
第九开关元件，控制端连接所述第二下拉控制节点、第一端连接所述第二电源信号端、第二端连接所述下拉节点。
7.根据权利要求1所述的移位寄存器单元，其特征在于，所述下拉模块包括：
第十开关元件，控制端连接所述下拉节点、第一端连接所述第一电源信号端、第二端连接所述上拉节点；
第十一开关元件，控制端连接所述下拉节点、第一端连接所述第一电源信号端、第二端连接所述信号输出端。
8.根据权利要求2-7任一项所述的移位寄存器单元，其特征在于，所有所述开关元件均为N型晶体管或者均为P型晶体管。
9.一种移位寄存器电路，其特征在于，包括多个级联的权利要求1-8任一项所述的移位寄存器单元；
第M-1级移位寄存器单元的信号输出端连接第M级移位寄存器单元的信号输入端；
第M+1级移位寄存器单元的信号输出端连接第M级移位寄存器单元的复位信号端。
10.一种显示面板，包括显示区域和周边区域；其特征在于，所述周边区域设置有权利要求9所述的移位寄存器电路。
11.根据权利要求10所述的显示面板，其特征在于，还包括：
横纵交错的多条栅线和多条数据线；以及，由相邻所述栅线和相邻所述数据线限定的多个像素单元：
其中，所述栅线用于传输所述移位寄存器电路提供的扫描信号，所述数据线用于传输源极驱动器提供的数据信号。
12.一种移位寄存器电路的驱动方法，用于驱动如权利要求9所述的移位寄存器电路；其特征在于，所述驱动方法包括：
在充电阶段，通过输入信号控制输入模块导通，以将所述输入信号传输至上拉节点，并通过所述上拉节点控制第一下拉控制模块导通，以将第一电源信号分别传输至第一下拉控制节点、第二下拉控制节点、以及下拉节点；
在输出阶段，通过所述上拉节点控制所述第一下拉控制模块和输出模块导通，以将所述第一电源信号分别传输至所述第一下拉控制节点、所述第二下拉控制节点、以及所述下拉节点，并将时钟信号传输至信号输出端；
在放电阶段，通过所述上拉节点控制所述第一下拉控制模块导通，以保持所述第一下拉控制节点、所述第二下拉控制节点、以及所述下拉节点的电压；
在复位阶段，通过复位信号控制复位模块导通，以将所述第一电源信号传输至所述上拉节点，通过第二电源信号控制第二下拉控制模块导通，以将所述第二电源信号分别传输至所述第一下拉控制节点、所述第二下拉控制节点、以及所述下拉节点，并通过所述下拉节点控制下拉模块导通，以将所述第一电源信号分别传输至所述上拉节点以及所述信号输出端。
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