KR20090099835A - 다층 인쇄회로기판 및 그 제조방법 - Google Patents
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Abstract
본 발명은 다층 인쇄회로기판 및 그 제조방법에 관한 것으로, 다층 인쇄회로기판은 메탈층의 일면에 회로층을 형성하고, 그 위로 빌드업층 및 솔더 레지스트층을 적층함으로써 제조된다. 이에 따라 제조된 본 발명의 다층 인쇄회로기판은 관통홀을 가지며, 그 표면에 절연막이 형성된 메탈층의 일면에 회로패턴을 포함하는 제1 회로층, 타면에 돌출된 솔더볼 실장용 접속패드를 포함하는 제2 회로층이 형성된 메탈 베이스층, 상기 제1 회로층 상에 형성된 다수의 절연층과 다수의 회로층을 포함하는 빌드업층 및 상기 빌드업층의 최외층에 형성된 솔더 레지스트층을 포함하는 것을 특징으로 하며, 다층 인쇄회로기판의 두께를 줄이는 동시에 휨 강도 및 방열특성을 개선시키는 효과를 갖는다.
메탈층, 절연막, 솔더볼 실장용 접속패드, 방열, 휨, 솔더볼, 캐패시터, 유전체, 솔더 레지스트
Description
본 발명은 다층 인쇄회로기판 및 그 제조방법에 관한 것으로, 더욱 상세하게는 다층 인쇄회로기판의 두께를 줄이는 동시에 휨 강도 및 방열특성을 개선 시킬 수 있는 다층 인쇄회로기판 및 그 제조방법에 관한 것이다.
일반적으로, 인쇄회로기판은 각종 열경화성 합성수지로 이루어진 보드의 일면 또는 양면에 동선으로 배선한 후 보드 상에 IC 또는 전자부품들을 배치 고정하고 이들 간의 전기적 배선을 구현하여 절연체로 코팅한 것이다.
최근, 전자산업의 발달에 전자 부품의 고기능화, 경박단소화에 대한 요구가 급증하고 있고, 이러한 전자부품을 탑재하는 인쇄회로기판 또한 고밀도 배선화 및 박판이 요구되고 있다.
특히, 통상의 빌드업(build-up) 배선 기판은 빌드업층을 코어 기판상에 형성하고, 이 코어기판이 형성되어 있는 상태로 제품으로 사용되기 때문에, 배선 기판 전체의 두께가 커져 버린다는 문제가 있었다. 배선기판의 두께가 큰 경우, 배선의 길이가 길어져 신호처리시간이 많이 소요되고, 결국 고밀도 배선화의 요구에 역행 하게 되는 문제가 있었다.
이러한 문제점을 해결하기 위하여, 코어 기판을 갖지 않는 코어리스 기판이 제안되고 있으며, 도 1에는 이러한 종래의 코어리스 기판의 제조공정이 도시되어 있다. 이하, 도 1을 참고로 종래의 코어리스 기판의 제조공정을 설명하면 다음과 같다.
먼저, 도 1a에 도시된 바와 같이, 제조공정 중 코어리스 기판을 지지하기 위한 메탈 캐리어(10)를 준비한다.
다음, 도 1b에 도시된 바와 같이, 메탈 캐리어(10)의 일면에 메탈 베리어(metal barrier)(11)를 형성하고, 그 위로 회로패턴(12)을 형성한다.
다음, 도 1c에 도시된 바와 같이, 회로패턴(12) 상에 다수의 절연층과 다수의 회로층을 포함하는 빌드업층(13)을 적층한다. 여기서, 빌드업층(13)은 통상의 빌드업 공법을 이용해 적층된다.
다음, 도 1d에 도시된 바와 같이, 메탈 캐리어(10) 및 메탈 베리어(11)을 제거한다.
다음, 도 1e에 도시한 바와 같이, 빌드업층(13)의 상/하 최외층에 솔더 레지스트층(14)을 적층하여 코어리스 기판(15)을 제조한다.
이러한 종래의 코어리스 기판(15)은 제조공정 중에 지지체 기능을 수행하는 메탈 캐리어(10)를 통해 빌드업층(13)을 적층하고, 이후 메탈 캐리어(10)를 제거함으로써 제조되었다.
그러나, 종래의 코어리스 기판(15)은 메탈 캐리어(10)가 제조공정 중에는 지 지체 기능을 수행하나, 제조 후 제거됨으로써 기판의 실제 사용시 기판의 휨이 발생할 뿐만 아니라 전자부품을 사용하여 전자회로를 구성할 때 열이 많이 발생하여 전자부품의 오작동 및 파손의 문제가 있었다.
또한, 메탈캐리어(10)를 제거하는 별도의 공정이 요구될 뿐만 아니라 메탈 캐리어(10)가 제거된 부분의 회로패턴을 보호하기 위해 추가적인 솔더 레지스트층(14)을 형성해야 하는 문제가 있었다.
본 발명은 상기와 같은 문제점을 해결하기 위해 안출된 것으로서, 본 발명의 목적은 열전도도 및 지지강도가 우수한 메탈층이 구비되어 방열성능이 우수하고 기판의 휨을 방지할 수 있는 다층 인쇄회로기판 및 그 제조방법을 제공하기 위한 것이다.
본 발명의 다른 목적은 메탈층이 빌드업층 일면 최외층에 형성됨으로써 솔더 레지스트층의 기능을 동시에 수행함으로써 별도의 PSR공정이 수반될 필요가 없는 다층 인쇄회로기판 및 그 제조방법을 제공하기 위한 것이다.
본 발명에 따른 다층 인쇄회로기판은, 관통홀을 가지며, 그 표면에 절연막이 형성된 메탈층의 일면에 회로패턴을 포함하는 제1 회로층, 타면에 돌출된 솔더볼 실장용 접속패드를 포함하는 제2 회로층이 형성된 메탈 베이스층, 상기 제1 회로층 상에 형성된 다수의 절연층과 다수의 회로층을 포함하는 빌드업층, 및 상기 빌드업층의 최외층에 형성된 솔더 레지스트층을 포함하는 것을 특징으로 한다.
여기서, 상기 메탈층은 스테인레스 강, 알루미늄(Al), 니켈(Ni), 마그네슘(Mg), 아연(Zn), 탄탈륨(Ta), 및 이들의 합금 중 하나로 구성된 것을 특징으로 한다.
또한, 상기 절연막은 절연 수지 코팅막 또는 양극 산화막인 것을 특징으로 한다.
또한, 상기 절연 수지 코팅막은 에폭시 수지 코팅막인 것을 특징으로 한다.
또한, 상기 메탈 베이스층은 내장형 캐패시터의 기능을 하는 것을 특징으로 한다.
또한, 상기 제2 회로층의 솔더볼 실장용 접속패드에 형성되는 솔더볼을 더 포함하는 것을 특징으로 한다.
본 발명에 따른 다층 인쇄회로기판의 제조방법은, (A) 메탈층에 관통홀을 형성하고 그 표면을 절연처리하는 단계, (B) 상기 절연처리된 메탈층의 일면에 회로패턴을 포함하는 제1 회로층, 타면에 솔더볼 실장용 접속패드를 포함하는 제2 회로층을 형성하는 단계, (C) 상기 제1 회로층 상에 다수의 절연층과 다수의 회로층을 포함하는 복수의 빌드업층을 형성하는 단계, 및 (D) 상기 빌드업층의 최외층에 솔더 레지스트층을 형성하는 단계를 포함하는 것을 특징으로 한다.
이때, 상기 관통홀은 레이저 가공 또는 기계 드릴링을 통해 형성되는 것을 특징으로 한다.
또한, 상기 (A) 단계에서 상기 메탈층의 절연 처리는 절연수지를 코팅하거나 양극산화공정에 의해 양극산화막을 형성함으로써 수행되는 것을 특징으로 한다.
또한, 상기 (D) 단계 이후에 상기 솔더 레지스트층에 LDA(Laser direct ablation)에 의해 오픈부를 형성하는 단계를 더 포함하는 것을 특징으로 한다.
본 발명에 따른 다층 인쇄회로기판 및 그 제조방법에 의하면, 메탈 베이스층이 제조공정 중 뿐만 아니라 제조 후에도 빌드업층을 지지함으로써 기판의 휨을 방 지하는 효과를 갖는다.
또한, 전기전도성이 우수한 메탈층이 제공됨으로써 우수한 방열특성을 갖는다.
또한, 메탈층이 빌드업층의 최외층 일면에 형성된 회로패턴을 보호하고, 전기적 절연을 제공함으로써 별도의 PSR공정이 필요 없게 된다.
또한, 메탈 베이스층이 캐패시터로 작용함에 따라 내장형 캐패시터를 포함하는 다층 인쇄회로기판을 제공한다.
이하, 첨부된 도면을 참조하여 본 발명의 바람직한 실시예에 따른 다층 인쇄회로기판 및 그 제조방법을 상세히 설명한다.
도 2는 본 발명의 바람직한 실시예에 따른 다층 인쇄회로기판을 나타낸 도면이다.
본 발명의 바람직한 실시예에 따른 다층 인쇄회로기판은 메탈 베이스층(36), 빌드업층(37) 및 솔더 레지스트층(38)을 포함하여 구성된다.
메탈 베이스층(36)은 층간 연결을 위한 관통홀(31)이 형성되고, 그 표면에 절연막(32)이 형성된 메탈층(30)과 이 메탈층(30)의 일면에 형성된 회로패턴(34)을 포함하는 제1 회로층, 타면에 형성된 솔더볼 실장용 접속패드(35)를 포함하는 제2 회로층을 포함하여 이루어져 있다.
여기서 메탈층(30)은 지지기능 및 방열기능을 수행하기 위한 것으로서, 스테인레스 강, 알루미늄(Al), 니켈(Ni), 마그네슘(Mg), 아연(Zn), 탄탈륨(Ta), 및 이 들의 합금 중 어느 하나로 구성된다.
또한, 절연막(32)은 메탈층(30)의 전기적 절연을 제공하기 위한 것으로서, 절연수지 코팅막 또는 양극산화막인 것이 바람직하다.
한편, 메탈 베이스층(36)은 외부전원과의 연결을 통해 내장형 캐패시터로 사용될 수 있다. 즉, 절연막(32)이 형성된 메탈층(30)이 유전체, 이 유전체의 상/하부에 형성된 회로층이 상/하부 전극으로 작용함으로써, 외부전원과 연결을 통해 내장형 캐패시터로 사용된다.
또한, 솔더볼 실장용 접속패드(35)에는 솔더볼(40)이 부착될 수 있다.
빌드업층(37)은 다수의 절연층과 다수의 회로층을 포함하며, 제1 회로층 위로 형성된다.
솔더 레지스트층(38)은 회로패턴을 보호하고 전기적 절연을 위해 빌드업층(37)의 최외층에 형성된다. 이 솔더 레지스트층(38)에는 다른 전자제품과 연결되는 빌드업층(37)의 최외층에 형성된 접속단자(41)을 노출시키기 위한 오픈부(39)가 형성된다.
도 3은 도 2에 도시된 다층 인쇄회로기판의 제조공정을 나타낸 도면으로서, 이를 참조하여 그 제조공정을 설명하면 다음과 같다.
먼저, 도 3a에 도시된 바와 같이, 메탈층(30)에 양층간 접속을 위한 관통홀(31)을 형성한다.
여기서, 메탈층(30)은 다층 인쇄회로기판의 지지체 기능을 수행하고 방열효율을 개선시키기 위한 것으로서, 스테인레스 강, 알루미늄(Al), 니켈(Ni), 마그네 슘(Mg), 아연(Zn), 탄탈륨(Ta), 및 이들의 합금 중 어느 하나의 금속으로 구성된다. 즉, 이 메탈층(30)의 높은 열전도성 및 높은 강도는 방열성능이 우수한 코어리스 기판의 제조를 가능하게 한다.
또한, 관통홀(31)은 CNC 드릴(Computer Numerical Control drill), CO2 또는 Yag 레이저 드릴 방법에 의해 가공된다.
다음, 도 3b에 도시한 바와 같이, 메탈층(30)의 표면 전체에 절연막(32)을 형성하여 회로층의 형성이 가능하도록 한다.
여기서, 절연막(32)을 형성하는 절연처리공정은 에폭시 등과 같은 절연수지를 코팅하거나 양극 산화(Anodizing) 공정을 이용할 수 있다.
양극 산화 공정에 대해 보다 구체적으로 설명하면, 메탈층(30)을 붕산, 인산, 황산, 크롬산 등의 전해액에 담은 후, 메탈층(30)에 양극을 인가하고 전해액에 음극을 인가함으로써, 메탈층(30)의 표면 전체에 전기적 절연을 수행하는 산화피막층(Al2O4)(즉, 알루미늄 코어에 대한 산화처리를 수행하여 성장시킴)을 성장시킨다.
다음, 도 3c에 도시한 바와 같이, 절연처리된 메탈층(30) 위에 무전해 도금으로 얇은 시드층(seed layer)(33)을 형성한다. 무전해 도금은 비도전성재료의 표면에 화학환원 반응으로 금속을 석출시켜 도전성을 부여하는 표면처리방법으로서, 절연처리된 메탈층(30) 표면상에 전기 분해에 의한 전해 도금을 바로 실시할 수 없기 때문에 먼저 도전성을 부여하기 위해 실시된다.
다음, 도 3d에 도시한 바와 같이, 세미-어디티브(semi-additive) 등의 통상 의 회로패턴 형성 방법을 이용하여 메탈층(30)의 일면에 회로패턴(34)을 포함하는 제1 회로층, 메탈층(30)의 타면에 솔더볼 실장용 접속패드(35)를 포함하는 제2 회로층을 형성하여, 메탈 베이스층(36)을 제조한다.
다음, 도 3e에 도시한 바와 같이, 제1 회로층 상에 다수의 절연층과 다수의 회로층을 포함하는 빌드업층(37)을 적층한다. 여기서, 빌드업층(37)은 통상의 빌드업-방식을 이용하여 적층가능하다.
여기서, 빌드업층(37)은 비아홀을 통해 층간 연결되며, 제1 회로층은 비아홀을 통해 빌드업층(37)의 회로층과 연결된다.
또한, 다수의 절연층은 일반적으로 사용되는 에폭시(epoxy) 수지, 유리 에폭시(glass epoxy) 수지, 알루미나(alumina)를 함유한 에폭시 수지 등으로 이루어질 수 있으며, 이에 한정되는 것은 아니다. 또한, 절연층의 두께는 필요에 따라 다양하게 변경할 수 있으며, 상술한 바와 같이 메탈층(30)이 지지체의 역할을 수행하므로 얇은 두께로 제조가 가능하다.
다음, 도 3f에 도시한 바와 같이, 빌드업층(37)의 상부 최외층에 솔더 레지스트층(38)을 적층하고, 다른 전자부품과의 연결을 위해 빌드업층(37)의 최외층에 형성된 접속단자(41)가 돌출될 수 있도록 오픈부(39)를 형성한다. 여기서, 이 오픈부(39)는 LDA(Laser direct ablation)등과 같은 기계적 가공을 통해 형성가능하다.
한편, 메탈층(30)은 하부 빌드업층(37)의 솔더볼 실장용 접속패드가 노출된 부분을 제외하고, 하부 최외층 회로패턴을 보호하는 솔더 레지스트층의 기능을 수행하게 되므로, 하부에 별도의 PSR공정이 필요 없게 된다.
또한, 제2 회로층의 솔더볼 실장용 접속패드(35)에는 마더보드 또는 전자부품 등과 연결하기 위한 솔더볼(40)이 부착될 수 있다.
이와 같은 제조공정에 의해, 도 2에 도시한 바와 같은 다층 인쇄회로기판이 제조된다.
한편 본 발명은 기재된 실시예에 한정되는 것이 아니고, 본 발명의 사상 및 범위를 벗어나지 않고 다양하게 수정 및 변형을 할 수 있음은 이 기술 분야에서 통상의 지식을 가진 자에게는 자명하다. 따라서, 그러한 변형예 또는 수정예들은 본 발명의 특허청구범위에 속한다 해야 할 것이다.
도 1은 종래 코어리스 기판을 나타내는 도면;
도 2는 본 발명의 바람직한 실시예에 따른 다층 인쇄회로기판을 나타내는 도면; 및
도 3은 도 2에 도시된 다층 인쇄회로기판을 제조하는 바람직한 실시예에 따른 제조공정을 나타내는 도면이다.
<도면부호의 설명>
30 : 메탈층 32 : 절연막
33 : 시드층 34 : 회로패턴
35 : 솔더볼 실장용 접속패드 37 : 빌드업층
38 : 솔더 레지스트층 40 : 솔더볼
Claims (10)
- 관통홀을 가지며, 그 표면에 절연막이 형성된 메탈층의 일면에 회로패턴을 포함하는 제1 회로층, 타면에 돌출된 솔더볼 실장용 접속패드를 포함하는 제2 회로층이 형성된 메탈 베이스층;상기 제1 회로층 상에 형성된 다수의 절연층과 다수의 회로층을 포함하는 빌드업층; 및상기 빌드업층의 최외층에 형성된 솔더 레지스트층을 포함하는 것을 특징으로 하는 다층 인쇄회로기판.
- 청구항 1에 있어서,상기 메탈층은 스테인레스 강, 알루미늄(Al), 니켈(Ni), 마그네슘(Mg), 아연(Zn), 탄탈륨(Ta), 및 이들의 합금 중 하나로 구성된 것을 특징으로 하는 다층 인쇄회로기판.
- 청구항 1에 있어서,상기 절연막은 절연 수지 코팅막 또는 양극 산화막인 것을 특징으로 하는 다층 인쇄회로기판.
- 청구항 3에 있어서,상기 절연 수지 코팅막은 에폭시 수지 코팅막인 것을 특징으로 하는 다층 인쇄회로기판.
- 청구항 1에 있어서,상기 메탈 베이스층은 내장형 캐패시터의 기능을 하는 것을 특징으로 하는 다층 인쇄회로기판.
- 청구항 1에 있어서,상기 제2 회로층의 솔더볼 실장용 접속패드에 형성되는 솔더볼을 더 포함하는 것을 특징으로 하는 다층 인쇄회로기판.
- (A) 메탈층에 관통홀을 형성하고 그 표면을 절연처리하는 단계;(B) 상기 절연처리된 메탈층의 일면에 회로패턴을 포함하는 제1 회로층, 타면에 솔더볼 실장용 접속패드를 포함하는 제2 회로층을 형성하는 단계;(C) 상기 제1 회로층 상에 다수의 절연층과 다수의 회로층을 포함하는 빌드업층을 형성하는 단계; 및(D) 상기 빌드업층의 최외층에 솔더 레지스트층을 형성하는 단계를 포함하는 것을 특징으로 하는 다층 인쇄회로기판의 제조방법.
- 청구항 7에 있어서,상기 관통홀은 레이저 가공 또는 기계 드릴링을 통해 형성되는 것을 특징으로 하는 다층 인쇄회로기판의 제조방법.
- 청구항 7에 있어서,상기 (A) 단계에서 상기 메탈층의 절연 처리는 절연수지를 코팅하거나 양극산화공정에 의해 양극산화막을 형성함으로써 수행되는 것을 특징으로 하는 다층 인쇄회로기판의 제조방법.
- 청구항 7에 있어서,상기 (D) 단계 이후에 상기 솔더 레지스트층에 LDA(Laser direct ablation)에 의해 오픈부를 형성하는 단계를 더 포함하는 것을 특징으로 하는 다층 인쇄회로기판의 제조방법.
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020080025035A KR100969412B1 (ko) | 2008-03-18 | 2008-03-18 | 다층 인쇄회로기판 및 그 제조방법 |
US12/216,428 US20090236130A1 (en) | 2008-03-18 | 2008-07-03 | Multilayered printed circuit board and method of manufacturing the same |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020080025035A KR100969412B1 (ko) | 2008-03-18 | 2008-03-18 | 다층 인쇄회로기판 및 그 제조방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20090099835A true KR20090099835A (ko) | 2009-09-23 |
KR100969412B1 KR100969412B1 (ko) | 2010-07-14 |
Family
ID=41087764
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020080025035A KR100969412B1 (ko) | 2008-03-18 | 2008-03-18 | 다층 인쇄회로기판 및 그 제조방법 |
Country Status (2)
Country | Link |
---|---|
US (1) | US20090236130A1 (ko) |
KR (1) | KR100969412B1 (ko) |
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Also Published As
Publication number | Publication date |
---|---|
US20090236130A1 (en) | 2009-09-24 |
KR100969412B1 (ko) | 2010-07-14 |
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---|---|---|---|
A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
E701 | Decision to grant or registration of patent right | ||
GRNT | Written decision to grant | ||
FPAY | Annual fee payment |
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