JPH1117006A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH1117006A JPH1117006A JP9164688A JP16468897A JPH1117006A JP H1117006 A JPH1117006 A JP H1117006A JP 9164688 A JP9164688 A JP 9164688A JP 16468897 A JP16468897 A JP 16468897A JP H1117006 A JPH1117006 A JP H1117006A
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Abstract
(57)【要約】
【課題】 半導体装置の製造において、工程数が少な
く、膜厚の制御性がよく、膜からのガスの発生に由来す
るピンホールおよび／またはボイドの発生が少なく、不
純物含量が小さく、かつ比誘電率が低い有機高分子絶縁
膜を成膜する方法を提供する。 【解決手段】 有機高分子絶縁膜を形成し得るモノマー
またはオリゴマーであって、好ましくは重合に際して副
反応生成物を発生しないものを気相輸送し半導体基板表
面または下地絶縁膜表面およびその上に設けられた配線
表面において熱重合させて有機高分子膜を成膜する。
く、膜厚の制御性がよく、膜からのガスの発生に由来す
るピンホールおよび／またはボイドの発生が少なく、不
純物含量が小さく、かつ比誘電率が低い有機高分子絶縁
膜を成膜する方法を提供する。 【解決手段】 有機高分子絶縁膜を形成し得るモノマー
またはオリゴマーであって、好ましくは重合に際して副
反応生成物を発生しないものを気相輸送し半導体基板表
面または下地絶縁膜表面およびその上に設けられた配線
表面において熱重合させて有機高分子膜を成膜する。
Description
【０００１】
【発明の属する技術分野】本発明は半導体装置の製造方
法に関するものであり、特に半導体基板上に高分子絶縁
膜を成膜するか、あるいは基板の下地絶縁膜上に設けら
れた半導体素子およびその素子間を結ぶ配線間を絶縁す
る有機高分子絶縁膜を成膜する方法を含む半導体装置の
製造方法に関する。
法に関するものであり、特に半導体基板上に高分子絶縁
膜を成膜するか、あるいは基板の下地絶縁膜上に設けら
れた半導体素子およびその素子間を結ぶ配線間を絶縁す
る有機高分子絶縁膜を成膜する方法を含む半導体装置の
製造方法に関する。
【０００２】
【従来の技術】半導体集積回路の設計ルールは縮小を続
けているが、それに伴って、配線による遅延が増大す
る。つまり配線抵抗、配線間容量が問題となる。配線に
よる遅延を低減するには、特に層間絶縁膜として低い誘
電率を持った絶縁膜を用いることが有効である。非常に
誘電率の低い絶縁膜として有機材料を用いた絶縁膜（有
機絶縁膜）が知られている。こうした有機絶縁膜の成膜
方法としては、スピンコーティング法が広く使われてい
る。
けているが、それに伴って、配線による遅延が増大す
る。つまり配線抵抗、配線間容量が問題となる。配線に
よる遅延を低減するには、特に層間絶縁膜として低い誘
電率を持った絶縁膜を用いることが有効である。非常に
誘電率の低い絶縁膜として有機材料を用いた絶縁膜（有
機絶縁膜）が知られている。こうした有機絶縁膜の成膜
方法としては、スピンコーティング法が広く使われてい
る。
【０００３】こうしたスピンコーティング法による成膜
方法の代表的な例を、Mark R. Schneider : VLSI Multi
level Interconnect Conference, "A MULTILAYER INTER
CONNECT PROCESS FOR VLSI GaAs ICs EMPLOYING POLYIM
IDE INTERLAYER DIELECTRICS" (June 9-10, 1992, p.93
-99)によって以下に説明する。
方法の代表的な例を、Mark R. Schneider : VLSI Multi
level Interconnect Conference, "A MULTILAYER INTER
CONNECT PROCESS FOR VLSI GaAs ICs EMPLOYING POLYIM
IDE INTERLAYER DIELECTRICS" (June 9-10, 1992, p.93
-99)によって以下に説明する。
【０００４】スピンコーティング法では、コーティング
液には成膜原材料とその溶媒とが混合されているのが一
般的である。したがって、成膜に当っては、先ずスピン
コーティング工程を行って後、溶媒を蒸発させる工程を
行う。さらに、成膜原材料を熱により重合または縮合さ
せる工程、例えばポリイミドの場合、アミド酸を加熱縮
合してポリイミドとする工程（硬化工程）を行う。ま
た、上記文献に示されているように、膜によっては濡れ
性等の問題から密着増進剤をコーティング液の塗布に先
立ってコーティングする。この場合もコーティング後、
乾燥工程を行う。
液には成膜原材料とその溶媒とが混合されているのが一
般的である。したがって、成膜に当っては、先ずスピン
コーティング工程を行って後、溶媒を蒸発させる工程を
行う。さらに、成膜原材料を熱により重合または縮合さ
せる工程、例えばポリイミドの場合、アミド酸を加熱縮
合してポリイミドとする工程（硬化工程）を行う。ま
た、上記文献に示されているように、膜によっては濡れ
性等の問題から密着増進剤をコーティング液の塗布に先
立ってコーティングする。この場合もコーティング後、
乾燥工程を行う。
【０００５】上記のように、スピンコート法による成膜
方法では少なくともスピンコーティング、溶媒蒸発およ
び硬化の３工程が必要とされる。
方法では少なくともスピンコーティング、溶媒蒸発およ
び硬化の３工程が必要とされる。
【０００６】
【発明が解決しようとする課題】スピンコーティング法
による成膜方法には以下の問題点がある。
による成膜方法には以下の問題点がある。
【０００７】第１の問題点は、ポリイミドに代表される
スピンコート法による成膜法は工程数が多く、しかも長
時間を要することである。前記のように、成膜工程数は
少なくとも３段階が必要で、密着増進剤のコーティング
および乾燥工程が加わるとさらに工程数は増加する。ま
た、膜硬化時の温度制御が複雑である。
スピンコート法による成膜法は工程数が多く、しかも長
時間を要することである。前記のように、成膜工程数は
少なくとも３段階が必要で、密着増進剤のコーティング
および乾燥工程が加わるとさらに工程数は増加する。ま
た、膜硬化時の温度制御が複雑である。
【０００８】第２の問題点は、スピンコート法を用いる
場合に共通の問題で、膜厚制御が難しいことである。ス
ピンコート法においては、一般的に膜厚の制御は、原料
の粘度と回転数で行うが、原料の粘度によって薄膜化あ
るいは厚膜化が難しい場合があるなど、原料によって膜
厚の制御性が狭まる場合がある。
場合に共通の問題で、膜厚制御が難しいことである。ス
ピンコート法においては、一般的に膜厚の制御は、原料
の粘度と回転数で行うが、原料の粘度によって薄膜化あ
るいは厚膜化が難しい場合があるなど、原料によって膜
厚の制御性が狭まる場合がある。
【０００９】第３の問題点は、これもスピンコート法に
ほぼ共通の問題であるが、膜厚制御のために溶媒を必要
とすることである。成膜過程でこの溶媒は除去しなけれ
ばならないが、加熱等によって完全に除去できない場
合、不純物として膜中に残存することになる。また、溶
媒の蒸発は膜中より発生することになるので、ボイドや
ピンホールの発生要因となる。
ほぼ共通の問題であるが、膜厚制御のために溶媒を必要
とすることである。成膜過程でこの溶媒は除去しなけれ
ばならないが、加熱等によって完全に除去できない場
合、不純物として膜中に残存することになる。また、溶
媒の蒸発は膜中より発生することになるので、ボイドや
ピンホールの発生要因となる。
【００１０】さらに第４の問題点として、ポリイミドの
場合に顕著であるが、成膜時の反応で副生成物が生じる
ことである。これはスピンコートであるかどうかには無
関係であるが、ポリイミドの場合、イミド環を形成する
イミド化反応の時に水が発生する。この水は膜中より発
生するので溶媒と同様の悪影響を膜に与える。ポリイミ
ドに限らず、重合の過程において副生成物の発生を伴う
重合膜は、溶媒同様発生した物質がボイドやピンホール
の発生要因となる。
場合に顕著であるが、成膜時の反応で副生成物が生じる
ことである。これはスピンコートであるかどうかには無
関係であるが、ポリイミドの場合、イミド環を形成する
イミド化反応の時に水が発生する。この水は膜中より発
生するので溶媒と同様の悪影響を膜に与える。ポリイミ
ドに限らず、重合の過程において副生成物の発生を伴う
重合膜は、溶媒同様発生した物質がボイドやピンホール
の発生要因となる。
【００１１】したがって、本発明の目的は、工程数が少
なく、膜厚の制御性が良好であり、かつ、膜内にボイド
および／またはピンホールの発生が少なく、比誘導率の
低い有機高分子絶縁膜を成膜することができる、半導体
装置の製造方法を提供することにある。
なく、膜厚の制御性が良好であり、かつ、膜内にボイド
および／またはピンホールの発生が少なく、比誘導率の
低い有機高分子絶縁膜を成膜することができる、半導体
装置の製造方法を提供することにある。
【００１２】
【課題を解決するための手段】上記の目的は以下に記載
する半導体の製造方法により達成される。
する半導体の製造方法により達成される。
【００１３】有機高分子膜を成膜し得るモノマーまたは
オリゴマーを気相輸送し、半導体基板表面または下地絶
縁膜表面またはその上に設けられた配線表面において熱
重合させて有機高分子絶縁膜を成膜することを特徴とす
る半導体装置の製造方法。
オリゴマーを気相輸送し、半導体基板表面または下地絶
縁膜表面またはその上に設けられた配線表面において熱
重合させて有機高分子絶縁膜を成膜することを特徴とす
る半導体装置の製造方法。
【００１４】本発明においては、上記のように配線表面
において熱重合して有機高分子絶縁膜を下地絶縁膜表面
および配線表面（上面および側面）に成膜し、配線間の
みに該有機高分子絶縁膜が残るようエッチバックするこ
とができる。さらに、上記のように、下地絶縁膜および
配線表面に有機高分子絶縁膜を成膜してのち、その上に
保護絶縁膜を成膜することもできる。
において熱重合して有機高分子絶縁膜を下地絶縁膜表面
および配線表面（上面および側面）に成膜し、配線間の
みに該有機高分子絶縁膜が残るようエッチバックするこ
とができる。さらに、上記のように、下地絶縁膜および
配線表面に有機高分子絶縁膜を成膜してのち、その上に
保護絶縁膜を成膜することもできる。
【００１５】本発明によれば、半導体装置を製造するに
当り、成膜における工程数が減少し、膜からのガスの発
生が防止され、比誘電率が低い層間絶縁膜の成膜が可能
となり、配線間容量が低減し、ＬＳＩの高速化、集積化
がさらに促進されるので、設計の自由度がさらに増すこ
ととなる。
当り、成膜における工程数が減少し、膜からのガスの発
生が防止され、比誘電率が低い層間絶縁膜の成膜が可能
となり、配線間容量が低減し、ＬＳＩの高速化、集積化
がさらに促進されるので、設計の自由度がさらに増すこ
ととなる。
【００１６】
【発明の実施の形態】本発明において用いられるモノマ
ーおよびオリゴマーは有機高分子絶縁膜を生膜し得るも
のである。これらのモノマーおよびオリゴマーは重合に
際して副生成物を発生しないものであることが好まし
い。このようなモノマーおよびオリゴマーとしては、次
のモノマーおよびこれらから生成されたオリゴマーを例
示することができる。 ジビニルシロキサンベンゾシクロブテン ＤＶＳ−ＢＣＢ
ーおよびオリゴマーは有機高分子絶縁膜を生膜し得るも
のである。これらのモノマーおよびオリゴマーは重合に
際して副生成物を発生しないものであることが好まし
い。このようなモノマーおよびオリゴマーとしては、次
のモノマーおよびこれらから生成されたオリゴマーを例
示することができる。 ジビニルシロキサンベンゾシクロブテン ＤＶＳ−ＢＣＢ
【００１７】
【化１】 フッ化ナフタレン
【００１８】
【化２】 ナフタレン
【００１９】
【化３】 マレイミドベンゾシクロブテン
【００２０】
【化４】 パーフロロシクロブテンアロマティックエーテル ＰＦＣＢ
【００２１】
【化５】 フッ化ベンゾシクロブテン ＢＣＢ−Ｆ８
【００２２】
【化６】
【００２３】特に好ましいモノマーおよびオリゴマーと
しては、ベンゾシクロブテンのベンゼン環上にビニル基
のような不飽炭化水素基を有する化合物および以下に示
すような、分子内に１個以上のベンゾシクロブテン構造
を有するものまたはその誘導体、およびこれから生成さ
れたオリゴマーを例示することができる。
しては、ベンゾシクロブテンのベンゼン環上にビニル基
のような不飽炭化水素基を有する化合物および以下に示
すような、分子内に１個以上のベンゾシクロブテン構造
を有するものまたはその誘導体、およびこれから生成さ
れたオリゴマーを例示することができる。
【００２４】
【化７】 （上記式において、Ｑは以下に示す基である。）
【００２５】
【化８】
【００２６】
【化９】
【００２７】
【化１０】
【００２８】
【化１１】
【００２９】
【化１２】
【００３０】
【化１３】
【００３１】
【化１４】
【００３２】
【化１５】
【００３３】
【化１６】
【００３４】
【化１７】
【００３５】
【化１８】
【００３６】モノマーまたはオリゴマーは気相で基板表
面まで送られる。送られたモノマーまたはオリゴマーは
基板表面に吸着され、基板加熱により供給される熱エネ
ルギーにより熱重合され、基板表面に有機高分子膜が成
膜される。モノマーまたはオリゴマーが液体の場合は、
加熱または加熱および不活性気体の通気、あるいは減圧
加熱または減圧加熱および不活性気体の通気などにより
気化して基板表面に送られる。気化されたモノマーまた
はオリゴマーが基板への輸送過程で再凝縮するおそれが
ある場合は輸送ガスを用いて再凝縮を防止することが望
ましい。
面まで送られる。送られたモノマーまたはオリゴマーは
基板表面に吸着され、基板加熱により供給される熱エネ
ルギーにより熱重合され、基板表面に有機高分子膜が成
膜される。モノマーまたはオリゴマーが液体の場合は、
加熱または加熱および不活性気体の通気、あるいは減圧
加熱または減圧加熱および不活性気体の通気などにより
気化して基板表面に送られる。気化されたモノマーまた
はオリゴマーが基板への輸送過程で再凝縮するおそれが
ある場合は輸送ガスを用いて再凝縮を防止することが望
ましい。
【００３７】本発明においては、これらのモノマーまた
はオリゴマーの重合条件は、そのモノマーまたはオリゴ
マーによって異なるが、好ましくは重合温度２００〜４
００℃、重合圧力１０〜１０００ｍＴｏｒｒ、重合時間
３０秒〜１０分の範囲から選択される。モノマーまたは
オリゴマーの供給速度は０．０１〜１ｇ／ｍｉｎとする
のが好ましい。成膜速度はモノマーまたはオリゴマーの
供給速度および重合温度を選択することにより制御され
得る。また、膜厚はモノマーまたはオリゴマーの供給速
度、重合温度、重合時間を選択することにより精密に制
御可能である。
はオリゴマーの重合条件は、そのモノマーまたはオリゴ
マーによって異なるが、好ましくは重合温度２００〜４
００℃、重合圧力１０〜１０００ｍＴｏｒｒ、重合時間
３０秒〜１０分の範囲から選択される。モノマーまたは
オリゴマーの供給速度は０．０１〜１ｇ／ｍｉｎとする
のが好ましい。成膜速度はモノマーまたはオリゴマーの
供給速度および重合温度を選択することにより制御され
得る。また、膜厚はモノマーまたはオリゴマーの供給速
度、重合温度、重合時間を選択することにより精密に制
御可能である。
【００３８】本発明の方法は熱ＣＶＤ法であり、基板表
面での反応によって成膜が進むことから、下地絶縁膜上
に配線などが存在する場合にも、下地絶縁膜上および配
線表面（上面および側面）上に下地形状にコンフォーマ
ルな膜形成が可能となる。このような形状に成膜したの
ち、配線間のみまたは配線側壁のみに膜を残すように他
の部分をエッチバックすることができる。
面での反応によって成膜が進むことから、下地絶縁膜上
に配線などが存在する場合にも、下地絶縁膜上および配
線表面（上面および側面）上に下地形状にコンフォーマ
ルな膜形成が可能となる。このような形状に成膜したの
ち、配線間のみまたは配線側壁のみに膜を残すように他
の部分をエッチバックすることができる。
【００３９】また、このようにして成膜された絶縁膜上
に保護絶縁膜としてプラズマＣＶＤ法、熱ＣＶＤ法また
はスパッタ法による酸化珪素膜のような酸化膜を成膜す
ることができる。保護絶縁膜として窒化珪素のような窒
化膜を成膜してもよい。この保護絶縁膜は、ウェハが加
熱された場合にも、キャップレイヤーとして働き、耐熱
性を向上させる。
に保護絶縁膜としてプラズマＣＶＤ法、熱ＣＶＤ法また
はスパッタ法による酸化珪素膜のような酸化膜を成膜す
ることができる。保護絶縁膜として窒化珪素のような窒
化膜を成膜してもよい。この保護絶縁膜は、ウェハが加
熱された場合にも、キャップレイヤーとして働き、耐熱
性を向上させる。
【００４０】さらに、下地が配線構造を有する場合に
は、酸化膜を用いることで、ＣＭＰ（ケミカルメカニカ
ルポリッシング）を行うことが容易となり、配線構造の
上面の高さで全体を平坦化することができる。
は、酸化膜を用いることで、ＣＭＰ（ケミカルメカニカ
ルポリッシング）を行うことが容易となり、配線構造の
上面の高さで全体を平坦化することができる。
【００４１】図面を参照して本発明を説明すると、本発
明の実施の態様を説明するための断面図である図１にお
いて、反応室９は排気ポンプ６により、好ましくは０．
１〜１０ｍＴｏｒｒに減圧される。反応室９の内部には
基板加熱部５が設けられ、その上に半導体基板４が固定
される。反応室９に供給配管１０を経て原料モノマーま
たはオリゴマー１が気相で供給され、半導体基板４の表
面で基板加熱部５からの熱エネルギーにより、好ましく
は圧力１０〜１０００ｍＴｏｒｒ、温度２００〜４００
℃において熱重合して半導体基板表面上に有機高分子絶
縁膜３が成膜される。２は重合反応した原料モノマーま
たはオリゴマーを示す。７は気化装置であり、気化され
たモノマーは液体モノマーまたはオリゴマー８上を通っ
て供給配管に送られる。
明の実施の態様を説明するための断面図である図１にお
いて、反応室９は排気ポンプ６により、好ましくは０．
１〜１０ｍＴｏｒｒに減圧される。反応室９の内部には
基板加熱部５が設けられ、その上に半導体基板４が固定
される。反応室９に供給配管１０を経て原料モノマーま
たはオリゴマー１が気相で供給され、半導体基板４の表
面で基板加熱部５からの熱エネルギーにより、好ましく
は圧力１０〜１０００ｍＴｏｒｒ、温度２００〜４００
℃において熱重合して半導体基板表面上に有機高分子絶
縁膜３が成膜される。２は重合反応した原料モノマーま
たはオリゴマーを示す。７は気化装置であり、気化され
たモノマーは液体モノマーまたはオリゴマー８上を通っ
て供給配管に送られる。
【００４２】図２は下地絶縁膜上に配線がある場合の実
施態様を説明するための断面図である。この図において
１２は下地絶縁膜であり、１１は配線を示す。本発明に
よる成膜方法は熱ＣＶＤ法であり、表面反応によって成
膜が進むことから、図２（ａ）に示したように、下地に
配線等が存在した場合にも下地形状に従った形状に有機
高分子絶縁膜３の形成が可能である。
施態様を説明するための断面図である。この図において
１２は下地絶縁膜であり、１１は配線を示す。本発明に
よる成膜方法は熱ＣＶＤ法であり、表面反応によって成
膜が進むことから、図２（ａ）に示したように、下地に
配線等が存在した場合にも下地形状に従った形状に有機
高分子絶縁膜３の形成が可能である。
【００４３】図２（ａ）に示したように成膜したのち、
エッチバックを行うことによって図２（ｂ）または
（ｄ）に示したように配線１１の配線間のみまたは配線
側壁のみに有機高分子絶縁膜３を残すこともできる。あ
るいは、図２（ｃ）に示したように、配線にコンフォー
マブルな形状で有機高分子絶縁膜を残すこともできる。
エッチバックを行うことによって図２（ｂ）または
（ｄ）に示したように配線１１の配線間のみまたは配線
側壁のみに有機高分子絶縁膜３を残すこともできる。あ
るいは、図２（ｃ）に示したように、配線にコンフォー
マブルな形状で有機高分子絶縁膜を残すこともできる。
【００４４】図３は有機高分子絶縁膜を成膜したのち、
その上に保護絶縁膜を成膜する実施態様を説明するため
の断面図である。この図において１２は下地絶縁膜、１
１は配線、３は有機高分子絶縁膜を示す。有機高分子絶
縁膜３上に、図３（ａ）に示すように、プラズマＣＶ
Ｄ、熱ＣＶＤまたはスパッタ法で酸化膜を保護膜として
成膜する。保護膜として酸化膜に代えて窒化膜を用いる
こともできる。図２に示したように、下地として配線構
造を有する場合には図３（ａ）に示すように保護膜とし
て酸化膜を用いることで、ＣＭＰ（ケミカルメカニカル
ポリッシング）を行うことが容易となり、図３（ｂ）お
よび（ｄ）に示すように平坦化が容易に行われる。ある
いは図３（ｃ）に示すように配線にコンフォーマブルの
形状とすることもできる。
その上に保護絶縁膜を成膜する実施態様を説明するため
の断面図である。この図において１２は下地絶縁膜、１
１は配線、３は有機高分子絶縁膜を示す。有機高分子絶
縁膜３上に、図３（ａ）に示すように、プラズマＣＶ
Ｄ、熱ＣＶＤまたはスパッタ法で酸化膜を保護膜として
成膜する。保護膜として酸化膜に代えて窒化膜を用いる
こともできる。図２に示したように、下地として配線構
造を有する場合には図３（ａ）に示すように保護膜とし
て酸化膜を用いることで、ＣＭＰ（ケミカルメカニカル
ポリッシング）を行うことが容易となり、図３（ｂ）お
よび（ｄ）に示すように平坦化が容易に行われる。ある
いは図３（ｃ）に示すように配線にコンフォーマブルの
形状とすることもできる。
【００４５】
【実施例】以下の実施例は本発明を具体的に説明するも
のであり、本発明はこれらの実施例により限定されるも
のではない。
のであり、本発明はこれらの実施例により限定されるも
のではない。
【００４６】実施例１ 図１を参照して、気化器７においてジビニルシロキサン
ベンゾシクロブテンを減圧加熱および不活性ガス、ここ
ではヘリウムガスの通気により液体の状態で重合反応の
進む速度が十分に遅い温度、例えば１５０℃において気
化させ、ヘリウムガスとともに供給配管１０を経て反応
室９に送入した。ベンゾシクロブテンのヘリウムガス中
の濃度は５．４３ｖｏｌ％であった。なお、反応室内は
ジビニルシロキサンベンゾシクロブテン供給のため、排
気ポンプ６によって１０ｍＴｏｒｒに保った。
ベンゾシクロブテンを減圧加熱および不活性ガス、ここ
ではヘリウムガスの通気により液体の状態で重合反応の
進む速度が十分に遅い温度、例えば１５０℃において気
化させ、ヘリウムガスとともに供給配管１０を経て反応
室９に送入した。ベンゾシクロブテンのヘリウムガス中
の濃度は５．４３ｖｏｌ％であった。なお、反応室内は
ジビニルシロキサンベンゾシクロブテン供給のため、排
気ポンプ６によって１０ｍＴｏｒｒに保った。
【００４７】反応室内には基板加熱部５が設けられ、そ
の上に固定された半導体基板４は２５０℃に加熱され
た。
の上に固定された半導体基板４は２５０℃に加熱され
た。
【００４８】反応室９に気相で供給されたジビニルシロ
キサンベンゾシクロブテンは、加熱された半導体基板の
表面で熱重合してポリマー膜を形成した。１０分後にと
り出した半導体基板表面にはポリ（ジビニルシロキサン
ベンゾシクロブテン）の厚さ１μｍの絶縁膜が形成され
ていた。この絶縁膜の比誘電率は２．７であった。
キサンベンゾシクロブテンは、加熱された半導体基板の
表面で熱重合してポリマー膜を形成した。１０分後にと
り出した半導体基板表面にはポリ（ジビニルシロキサン
ベンゾシクロブテン）の厚さ１μｍの絶縁膜が形成され
ていた。この絶縁膜の比誘電率は２．７であった。
【００４９】実施例２図２を参照して、半導体基板４に
代えて下地絶縁膜１２上に配線１１を有する基板を用い
たほかは実施例１と同様に操作した。１０分後に図２
（ａ）に示された厚さ１μｍのポリ（ジビニルシロキサ
ンベンゾシクロブテン）の絶縁膜が形成された。
代えて下地絶縁膜１２上に配線１１を有する基板を用い
たほかは実施例１と同様に操作した。１０分後に図２
（ａ）に示された厚さ１μｍのポリ（ジビニルシロキサ
ンベンゾシクロブテン）の絶縁膜が形成された。
【００５０】この絶縁膜をエッチングバックして図２
（ｂ）に示したようにサイドウォールにのみ高分子絶縁
膜を残した。
（ｂ）に示したようにサイドウォールにのみ高分子絶縁
膜を残した。
【００５１】実施例３ 実施例２（図２ａ）において形成された有機高分子絶縁
膜３の上に、ＴＥＯＳ系プラズマＣＶＤ法により厚さ１
μｍの酸化シリコン膜を保護絶縁膜として形成した。
膜３の上に、ＴＥＯＳ系プラズマＣＶＤ法により厚さ１
μｍの酸化シリコン膜を保護絶縁膜として形成した。
【００５２】実施例４ 実施例１においてジビニルシロキサンベンゾシクロブテ
ンに代えてビニルベンゾシクロブテンを用いて同様に操
作した。１０分後、厚さ１μｍのポリ（ビニルベンゾシ
クロブテン）の絶縁膜が半導体基板上に形成された。
ンに代えてビニルベンゾシクロブテンを用いて同様に操
作した。１０分後、厚さ１μｍのポリ（ビニルベンゾシ
クロブテン）の絶縁膜が半導体基板上に形成された。
【００５３】実施例５ ジビニルシロキサンベンゾシクロブテンに代えてビニル
ベンゾシクロブテン２量体を用いて実施例１と同様に操
作した。１０分後、厚さ１μｍのポリ（ビニルベンゾシ
クロブテン）の絶縁膜が半導体基板上に形成された。
ベンゾシクロブテン２量体を用いて実施例１と同様に操
作した。１０分後、厚さ１μｍのポリ（ビニルベンゾシ
クロブテン）の絶縁膜が半導体基板上に形成された。
【００５４】
【発明の効果】本発明によれば、気相で原料供給を行う
ことで、スピンコーティング法で用いられるような溶媒
脱離工程は不要となる。また、成膜中に重合反応がすす
むため、膜硬化工程は不要となる。従って成膜工程数の
短縮が可能となる。また、成膜速度は原料の供給量と成
膜時の基板温度によって制御可能となり、同時に膜厚の
精密な制御が可能となる。
ことで、スピンコーティング法で用いられるような溶媒
脱離工程は不要となる。また、成膜中に重合反応がすす
むため、膜硬化工程は不要となる。従って成膜工程数の
短縮が可能となる。また、成膜速度は原料の供給量と成
膜時の基板温度によって制御可能となり、同時に膜厚の
精密な制御が可能となる。
【００５５】さらに有機高分子絶縁膜の原料であるモノ
マーまたはオリゴマーとして、重合反応の際に副生成物
を発生しないものを用い、半導体基板表面で熱重合反応
させて有機高分子膜を成膜することによって、ボイドや
ピンホールの発生が抑制される。
マーまたはオリゴマーとして、重合反応の際に副生成物
を発生しないものを用い、半導体基板表面で熱重合反応
させて有機高分子膜を成膜することによって、ボイドや
ピンホールの発生が抑制される。
【図面の簡単な説明】
【図１】本発明の実施態様を説明するための断面図であ
る。
る。
【図２】本発明の別の実施態様を説明するための断面図
である。
である。
【図３】本発明のさらに別の実施態様を説明するための
断面図である。
断面図である。
１ 原料モノマーまたはオリゴマー ２ 重合反応した原料モノマーまたはオリゴマー ３ 有機高分子絶縁膜 ４ 半導体基板 ５ 基板加熱部 ６ 排気ポンプ ７ 気化装置 ８ 液体モノマーまたはオリゴマー ９ 反応室 １０ 供給配管 １１ 配線 １２ 下地絶縁膜 １３ 保護絶縁膜
Claims (9)
- 【請求項１】 半導体装置を製造するに当り、有機高分
子絶縁膜を形成し得るモノマーまたはオリゴマーを気相
輸送し、半導体基板表面または下地絶縁膜表面およびそ
の上に設けられた配線表面において熱重合させて有機高
分子絶縁膜を成膜することを特徴とする半導体装置の製
造方法。 - 【請求項２】 該モノマーおよび該オリゴマーが熱重合
に際して副生成物を発生しないものである請求項１に記
載の方法。 - 【請求項３】 該モノマーが分子内にベンゾシクロブテ
ン構造を１個以上有するものまたはその誘導体であり、
該オリゴマーがこのモノマーから生成されたものである
請求項１または２に記載の方法。 - 【請求項４】 半導体装置を製造するに当り、有機高分
子絶縁膜を形成し得る有機モノマーまたはオリゴマーを
気相輸送し、下地絶縁膜表面およびその上に設けられた
配線表面において気相で熱重合させて有機高分子絶縁膜
を成膜し、ついで該配線間のみまたは該配線側壁のみに
該有機高分子絶縁膜が残るように該有機高分子絶縁膜を
エッチバックすることを特徴とする半導体装置の製造方
法。 - 【請求項５】 該モノマーおよび該オリゴマーが熱重合
に際して副生成物を発生しないものである請求項４に記
載の方法。 - 【請求項６】 該モノマーがベンゾブテン構造を１個以
上有するものまたはその誘導体であり、該オリゴマーが
このモノマーから生成されたものである請求項４または
５に記載の方法。 - 【請求項７】 半導体装置を製造するに当り、有機高分
子絶縁膜を生膜し得るモノマーまたはオリゴマーを気相
輸送し、下地絶縁膜表面およびその上に設けられた配線
表面において熱重合させて有機高分子絶縁膜を成膜し、
ついで該高分子絶縁膜上に保護絶縁膜を成膜することを
特徴とする半導体装置の製造方法。 - 【請求項８】 該モノマーおよび該オリゴマーが熱重合
に際して副生成物を発生しないものである請求項７に記
載の方法。 - 【請求項９】 該モノマーがベンゾシクロブテン構造を
１個以上有するものまたはその誘導体であり、該オリゴ
マーがこのモノマーから生成されたものである請求項６
または７に記載の方法。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16468897A JP3244024B2 (ja) | 1997-06-20 | 1997-06-20 | 半導体装置の製造方法 |
| US09/102,052 US6150284A (en) | 1997-06-20 | 1998-06-22 | Method of forming an organic polymer insulating film in a semiconductor device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16468897A JP3244024B2 (ja) | 1997-06-20 | 1997-06-20 | 半導体装置の製造方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH1117006A true JPH1117006A (ja) | 1999-01-22 |
| JP3244024B2 JP3244024B2 (ja) | 2002-01-07 |
Family
ID=15797973
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16468897A Expired - Lifetime JP3244024B2 (ja) | 1997-06-20 | 1997-06-20 | 半導体装置の製造方法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US6150284A (ja) |
| JP (1) | JP3244024B2 (ja) |
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| US6329227B2 (en) | 2000-02-22 | 2001-12-11 | Matsushita Electric Industrial Co., Ltd. | Method of patterning organic polymer film and method for fabricating semiconductor device |
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| US7101591B2 (en) | 2001-06-29 | 2006-09-05 | Nec Corporation | Production method for copolymer film, copolymer film produced by the forming method and semiconductor device using copolymer film |
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| US7000313B2 (en) * | 2001-03-08 | 2006-02-21 | Ppg Industries Ohio, Inc. | Process for fabricating circuit assemblies using electrodepositable dielectric coating compositions |
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| US6671950B2 (en) | 2001-03-08 | 2004-01-06 | Ppg Industries Ohio, Inc. | Multi-layer circuit assembly and process for preparing the same |
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| JP3431222B2 (ja) * | 1993-08-20 | 2003-07-28 | ティーディーケイ株式会社 | 磁気記録媒体の製造方法 |
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1997
- 1997-06-20 JP JP16468897A patent/JP3244024B2/ja not_active Expired - Lifetime
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1998
- 1998-06-22 US US09/102,052 patent/US6150284A/en not_active Expired - Lifetime
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