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JP7396324B2 - パッケージ基板 - Google Patents

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Description

本発明は、パッケージ基板に関する。
特許文献１には、インダクタ又はキャパシタが埋め込まれたパッケージ基板を有する半導体パッケージのシステムが開示されている。スイッチング素子のような能動素子（アクティブ素子）を含む電圧制御装置（以下、ボルテージレギュレータという）がパッケージ基板上に実装されている。ボルテージレギュレータはインダクタ又はキャパシタと一体となって動作する。
インダクタはパッケージ基板中のビア、回路基板中のビア及び回路基板の背面に取り付けられたインダクタコイルで連結される経路により形成されている。
特許文献２には、プリント配線基板及びスイッチングレギュレータが記載されている。
プリント配線基板は、磁性材料を含むシート状のコア基材と、コア基材の内部に設けられたコイルと、コア基材の互いに対向する第１面及び第２面の少なくとも一方の面に設けられた外部回路層とを有している。
コア基材は金属磁性フィラー及び樹脂のコンポジット材料からなるとされている。
米国特許出願公開第２０１１／００５０３３４号明細書 特開２０１８－１８２２２２号公報
特許文献１に記載された技術では、インダクタ及びキャパシタが同一平面上にレイアウトされているため、ＩＣの配線加工技術の微細化によるＩＣのサイズシュリンクに伴い、そのサイズ制約から充分なインダクタンスを得ることができなくなっている。
また、インダクタンスの不足を補うため、回路基板中のビアによる寄生分を活用しているが、回路基板の材料として磁性材料を用いていないため、大きなインダクタンスを確保できないという問題があった。
また、特許文献２に記載されたようにコイル（インダクタ）がコア基材の内部に設けられている場合に、インダクタからの放射ノイズが誤動作を引き起こすという問題があった。そして、ノイズ除去のため余分な素子が必要になるということがあった。
そこで、本発明は、充分なインダクタンスを得ることができ、かつ、インダクタからの放射ノイズを抑制することができるパッケージ基板を提供することを目的とする。
本発明のパッケージ基板は、第１磁性粒子及び樹脂を含む第１磁性層と、上記第１磁性層の少なくとも一方の面に設けられ、上記第１磁性粒子よりも平均扁平率が大きい第２磁性粒子及び樹脂を含む第２磁性層と、を備えるインダクタ層を有し、上記第２磁性粒子は上記第２磁性層の主面に沿った方向での寸法が、上記第２磁性層の厚さ方向での寸法より長い形状の粒子であり、上記第１磁性層の内部にはインダクタとして機能するインダクタ配線が設けられていることを特徴とする。
本発明によれば、充分なインダクタンスを得ることができ、かつ、インダクタからの放射ノイズを抑制することができるパッケージ基板を提供することができる。
図１は、パッケージ基板の一例を模式的に示す断面図である。 図２は、図１に示すパッケージ基板にボルテージレギュレータと負荷を実装した半導体複合装置の一例を模式的に示す断面図である。 図３は、半導体複合装置の回路構成の一例を示すブロック図である。 図４は、インダクタ層の層構成の一例を示す断面写真である。 図５は、インダクタ配線のパターンを模式的に示す平面図である。 図６は、第２磁性層の一例を拡大して示す拡大断面写真である。 図７は、粒子の扁平率を模式的に示す断面図である。 図８は、半導体複合装置をマザー基板に実装した形態の一例を模式的に示す断面図である。 図９は、半導体複合装置をマザー基板に実装した形態の別の一例を模式的に示す断面図である。 図１０は、パッケージ基板の別の一例を模式的に示す断面図である。 図１１は、パッケージ基板の別の一例を模式的に示す断面図である。 図１２は、パッケージ基板の別の一例を模式的に示す断面図である。 図１３は、第２磁性粒子の寸法とインダクタンス低下値の関係を示すグラフである。 図１４は、試験に使用したインダクタ層の寸法を模式的に示す断面図である。 図１５は、第２磁性層と第１磁性層の厚み比とインダクタンスの関係を示すグラフである。 図１６は、第２磁性層と第１磁性層の厚み比と重畳特性の関係を示すグラフである。
以下、本発明のパッケージ基板について説明する。
しかしながら、本発明は、以下の構成に限定されるものではなく、本発明の要旨を変更しない範囲において適宜変更して適用することができる。なお、以下において記載する本発明の各実施形態の望ましい構成を２つ以上組み合わせたものもまた本発明である。
本発明のパッケージ基板は、第１磁性粒子及び樹脂を含む第１磁性層と、第１磁性層の少なくとも一方の面に設けられ、第１磁性粒子よりも平均扁平率が大きい第２磁性粒子及び樹脂を含む第２磁性層と、を備えるインダクタ層を有する。
第２磁性粒子は、第２磁性層の主面に沿った方向での寸法が、第２磁性層の厚さ方向での寸法より長い形状の粒子である。
第１磁性層の内部にはインダクタとして機能するインダクタ配線が設けられている。
パッケージ基板内にインダクタ配線を形成することで、インダクタの面積を大きくすることができるため、充分なインダクタンスを得ることが可能となる。また、インダクタのＱ値が悪化することによる損失を低減することができる。
また、パッケージ基板内にインダクタ配線を形成することにより、インダクタを含む複合部品の小型化を実現することができる。
また、磁性材料を含む第１磁性層内にインダクタ配線を設けることによってインダクタのＱ値を向上させて損失を低減することができる。さらに、扁平率が大きい第２磁性粒子を含む第２磁性層を設けることにより、インダクタからの放射ノイズを抑制することができる。
［パッケージ基板の第１実施形態］
第１実施形態のパッケージ基板は、インダクタ層に加えて、内部にキャパシタが形成されたキャパシタ層を有している。
インダクタ層の第１磁性層と、キャパシタ層の間に、インダクタ層の第２磁性層が位置している
また、インダクタ層の第１磁性層及び第２磁性層並びにキャパシタ層を厚さ方向に貫通するスルーホール導体を備えている。
図１は、パッケージ基板の一例を模式的に示す断面図である。
図２は、図１に示すパッケージ基板にボルテージレギュレータと負荷を実装した半導体複合装置の一例を模式的に示す断面図である。
図３は、半導体複合装置の回路構成の一例を示すブロック図である。
図１に示されるように、パッケージ基板２００は、キャパシタが形成されたキャパシタ層２１０と、インダクタ配線が設けられているインダクタ層２５０とを含む。
キャパシタ層２１０にはキャパシタＣＰ１、インダクタ層２５０にはインダクタＬ１が存在する（キャパシタＣＰ１、インダクタＬ１は図３参照）。
キャパシタ層２１０とインダクタ層２５０の間には樹脂層２２７が設けられている。
キャパシタ層２１０の露出面を絶縁するための絶縁層として樹脂層２２６が設けられている。
インダクタ層２５０の露出面を絶縁するための絶縁層として樹脂層２２８が設けられている。
図２に示す半導体複合装置１において、パッケージ基板２００には、ボルテージレギュレータ（Ｖｏｌｔａｇｅ Ｒｅｇｕｌａｔｏｒ：ＶＲ）１００と、負荷（Ｌｏａｄ）３００とが実装されている。負荷３００は、例えば、論理演算回路あるいは記憶回路などの半導体集積回路（Ｉｎｔｅｇｒａｔｅｄ Ｃｉｒｃｕｉｔ：ＩＣ）である。
また、パッケージ基板２００の実装面には、ボルテージレギュレータ１００及び負荷３００以外の他の電子機器３５０が実装されていてもよい。
ボルテージレギュレータ１００は、半導体スイッチング素子のようなアクティブ素子（図示せず）を含んでおり、当該アクティブ素子のデューティを制御することによって、外部から供給される直流電圧を負荷３００に適した電圧レベルに調整する。
パッケージ基板２００は、その表面にボルテージレギュレータ１００及び負荷３００を実装し、半導体複合装置１を１つのパッケージ部品として構成する。
パッケージ基板２００上には、ノイズ対策としてデカップリング用キャパシタや、チョークインダクタ、サージ保護用のダイオード素子や、分圧用の抵抗素子など、チップ部品が搭載されていてもよい。ボルテージレギュレータの出力から負荷の入力には、例えばチョッパ型の降圧スイッチングレギュレータを構成するために、リップルフィルタとしてインダクタとキャパシタが配置される。
パッケージ基板２００は、負荷３００が実装される面を上面とし、上面に、負荷３００及びボルテージレギュレータ１００等の電子部品を実装するためのランドとそれらを電気的に接続するための上面端子層２０５を有している。パッケージ基板２００の上面とは反対の面である底面には、半導体複合装置１をマザー基板に実装するための底面端子層２７０を有している。底面端子層２７０には、さらに回路を構成するための配線が構成されていてもよい。
図２に示す半導体複合装置１において、インダクタＬ１は、パッケージ基板２００の入力端子ＩＮと出力端子ＯＵＴとの間に接続される。インダクタＬ１は、入力端子ＩＮにおいてボルテージレギュレータ１００に接続され、出力端子ＯＵＴにおいて負荷３００に接続される。キャパシタＣＰ１は、出力端子ＯＵＴと接地端子ＧＮＤ（図２に図示せず）との間に接続される。
ボルテージレギュレータ１００と、パッケージ基板２００内のインダクタＬ１及びキャパシタＣＰ１とで、チョッパ型の降圧スイッチングレギュレータが形成される。インダクタＬ１及びキャパシタＣＰ１は、降圧スイッチングレギュレータのリップルフィルタとして機能する。
当該スイッチングレギュレータによって、例えば、外部から入力される５Ｖの直流電圧が１Ｖに降圧されて、負荷３００に供給される。
パッケージ基板２００は、パッケージ基板２００を貫通するスルーホールをメタライジングしたスルーホール導体２６１、２６２を有する。パッケージ基板がスルーホール導体を有することにより、パッケージ基板２００の厚さ方向において各要素が電気的に接続される。このように、ボルテージレギュレータ１００からリップルフィルタ（キャパシタ層２１０及びインダクタ層２５０）を介し、負荷３００までの電力供給配線を、上面端子層に構成された平面配線を用いることなく、回路面に対し垂直方向に引き回すことのできるスルーホール導体を用いることで、配線のインピーダンスを下げ、かつ回路面のレイアウトを最小化できることから、半導体複合装置のサイズを小さくすることが可能となる。
図３に上記の説明を理解するため、チョッパ型の降圧スイッチングレギュレータを例にボルテージレギュレータから負荷までの回路とスルーホール導体の構成の関係を示す。図３に示すとおり、ボルテージレギュレータ（ＶＲ）１００の出力から負荷（Ｌｏａｄ）３００の入力までの電力供給配線が、インダクタＬ１を介し、最短、最小面積で接続される。このような構成はパッケージ基板のような薄型の基板構成をもつ半導体複合装置で特に有効である。
次に、パッケージ基板を構成するインダクタ層の詳細について説明する。
インダクタ層はパッケージ基板の構成要素の一つである基板内部配線の一部にインダクタンス成分を持たせたものである。
インダクタ層は、第１磁性粒子及び樹脂を含む第１磁性層と、第１磁性層の少なくとも一方の面に設けられ、第１磁性粒子よりも平均扁平率が大きい第２磁性粒子及び樹脂を含む第２磁性層とを備える。
第１磁性層の内部にはインダクタとして機能するインダクタ配線が設けられている。
また、第２磁性層の表面に設けられた外部回路層を備えても構わない。
図４は、インダクタ層の層構成の一例を示す断面写真である。
図４に示すインダクタ層２５０は、第１磁性層１０と、第２磁性層２０とを備える。第２磁性層２０は第１磁性層１０の一方の面及び他方の面に設けられている。第１磁性層１０の上面に設けられている第２磁性層２０を上面側第２磁性層２０ａとし、第１磁性層１０の下面に設けられている第２磁性層２０を下面側第２磁性層２０ｂとする。
第１磁性層１０は、第１磁性粒子１１と樹脂１２を含む。また、第１磁性層１０の内部にはインダクタ配線１３が設けられている。
第１磁性粒子１１の材料としては、センダスト（Ｆｅ－Ｓｉ－Ａｌ）（μ＝５以上、４０以下：μは透磁率を示す。）、Ｆｅ－Ｓｉ－Ｂ（μ＝５以上、４０以下）、Ｆｅ－Ｓｉ－Ｃｒ（μ＝５以上、３５以下）、珪素鋼（Ｆｅ－Ｓｉ）（μ＝５以上、３０以下）、鉄（Ｆｅ）（μ＝５以上、２５以下）等を使用することができる。
上記に示す透磁率は、第１磁性粒子の形状による影響も含む透磁率である。
第１磁性粒子の材料としての透磁率は、例えば、センダスト（μ＝４０００以上、１２０００以下）、Ｆｅ－Ｓｉ－Ｂ（μ＝５００以上、４０００以下）、Ｆｅ－Ｓｉ－Ｃｒ（μ＝３００以上、４０００以下）、Ｆｅ（μ＝１００以上、５０００以下）とすることができる。
第１磁性粒子は球状の粒子であることが好ましい。第１磁性粒子が球状であると充填性に優れており、磁性粒子の配合割合を高くすることができる。
球状の粒子としては、後述する扁平率の定義に沿って測定した扁平率が１／３（≒０．３３）以下である粒子を使用することができる。
第１磁性層における第１磁性粒子の充填率は５０％以上であることが好ましい。充填率は図４に示すような断面写真において第１磁性層中の第１磁性粒子が占める面積の割合として算出することができる。この算出においてインダクタ配線１３の占める面積は第１磁性層の面積から除外する。
第１磁性層１０を構成する樹脂１２としては、エポキシ、フェノール又はポリイミドなどの樹脂が挙げられる。
インダクタ配線１３としては、電鋳法あるいは圧延法によって厚さ１００μｍ程度に形成された銅のコア材（銅箔）を、フォトレジストなどでコイル状にパターニングした後にエッチングすることによって形成される金属配線を使用することができる。
インダクタ配線は、インダクタとして機能する配線である。
第１磁性層の主面に沿った平面を上面視した際に、インダクタ配線は、電流が流れる向きが異なる複数の直線が連結され、複数の直線を連結する連結部の形状が直線又は曲線である一本の配線であり、一の直線において電流が流れる向きと、当該一の直線と隣接する直線において電流が流れる向きとが異なることが好ましい。
図５は、インダクタ配線のパターンを模式的に示す平面図である。
図５に示すインダクタ配線１３は、電流が流れる向きが異なる複数の直線である直線１４ａ、直線１４ｂ、直線１４ｃ及び直線１４ｄが、連結部１５ａ、連結部１５ｂ及び連結部１５ｃで連結されている一本の配線である。連結部１５ａ、連結部１５ｂ及び連結部１５ｃはいずれも曲線である。
隣接する直線である直線１４ａと直線１４ｂ、直線１４ｂと直線１４ｃ、直線１４ｃと直線１４ｄでは、いずれも電流の流れる向きが異なっている。
また、インダクタ配線１３はその一方端（ＩＮ）がスルーホール導体２６１に電気的に接続され、他方端（ＯＵＴ）がスルーホール導体２６２に電気的に接続されている。
図５にはグランドライン（ＧＮＤ）として使用されるスルーホール導体２６３を合わせて示している。
インダクタ配線をこのような形状にすることにより、直線形状の配線では取得できないインダクタンスを高い面積効率で取得できる。
インダクタ配線をインダクタとして機能させるために、インダクタ配線は、その一方端と他方端を直線でつなぐような配線パターンではないことが好ましい。
上記例では、隣接する直線間において電流の流れる向きはちょうど反対向きとなっているが、電流の流れる向きが異なっていればよいので、反対向きである場合に限定されるものではない。
隣接する直線間において電流の流れる向きが異なるということは、ヘリカル形状、スパイラル形状、渦巻き形状のように配線が巻いている形状の配線とは異なる配線であることを意味している。
上記例のインダクタ配線は、配線が巻いていない形状の配線であるともいえる。配線が巻いていない形状の配線であると、ノイズを低減することができる。
インダクタ配線のパターンがいわゆるミアンダ配線という形状であってもよい。また、複数の直線と連結部からなる配線であって連結部の数が２以上である配線であってもよい。連結部の数は３以上であることがより好ましく、１０以下であることが好ましい。
ヘリカル形状、スパイラル形状のような配線では配線の厚みを厚くすることが難しいが、上記の例のような形状の配線であると、配線の厚みを厚くすることができるため、配線抵抗を小さくでき、大電流を流すことが可能となる。
上記例のインダクタ配線は、単層の配線である。単層の配線であると多層配線において層間を接続するためのビアが不要のため、配線を厚くすることができ、配線の断面積を大きくすることができる。
また、配線が重ならずに配置されるため、発熱箇所が集中せず、放熱性が向上するのでこの観点からも大電流を流すことが可能となる。
インダクタ配線の厚さは、大電流を流すことに適した配線とするために１００μｍ以上であることが好ましい。また、パッケージ基板の薄型化の観点からは３００μｍ以下であることが好ましい。
インダクタ配線の幅は、５０μｍ以上であることが好ましい。また、インダクタ配線の幅を大きくすることによって配線抵抗を小さくすることができる。また、大電流を流すことに適した配線とすることができる。また、インダクタ配線の幅は、１０００μｍ以下であることが好ましい。
また、インダクタ配線を含む第１磁性層を上面視した平面図（図５に示すような平面図）において、第１磁性層の全体の面積に占めるインダクタ配線の面積の割合が２０％以上であることが好ましく、４０％以上であることがより好ましい。
インダクタ配線の面積の割合を２０％以上とすると、配線抵抗を抑えながら、インダクタンスを大きくすることができる。
インダクタ配線は、配線の厚み／配線の幅で表わされるアスペクト比が０．２以上であることが好ましい。
アスペクト比は図４において、「両矢印ｔで示す長さ（配線の厚み）／両矢印ｗで示す長さ（配線の幅）」で表される値である。
アスペクト比が０．２以上であると、配線の厚さが厚いので大電流を流すことが可能である。
また、アスペクト比は４以下であることが好ましい。
第２磁性層は、第１磁性層の少なくとも一方の面に設けられる。
図４に示すインダクタ層２５０では、第２磁性層２０は第１磁性層１０の一方の面及び他方の面に設けられている。このような第２磁性層の内部構造について図６を参照して説明する。
図６は、第２磁性層の一例を拡大して示す拡大断面写真である。
第２磁性層２０は、第２磁性粒子２１と樹脂２２とを含む。
第２磁性粒子２１の材料としては、センダスト（Ｆｅ－Ｓｉ－Ａｌ）（μ＝４０以上、２００以下）、Ｆｅ－Ｓｉ－Ｂ（μ＝４０以上、１００以下）、Ｆｅ－Ｓｉ－Ｃｒ（μ＝３５以上、８０以下）、珪素鋼（Ｆｅ－Ｓｉ）（μ＝３５以上、６０以下）等を使用することができる。
上記に示す透磁率は、第２磁性粒子の形状による影響も含む透磁率である。
第２磁性粒子の材料としての透磁率は、例えば、センダスト（μ＝４０００以上、１２０００以下）、Ｆｅ－Ｓｉ－Ｂ（μ＝５００以上、４０００以下）、Ｆｅ－Ｓｉ－Ｃｒ（μ＝３００以上、４０００以下）とすることができる。 第２磁性粒子は、第１磁性粒子より平均扁平率が大きい粒子である。
図７は、粒子の扁平率を模式的に示す断面図である。
粒子の断面形状において、粒子の寸法が最も小さくなる方向をＺ方向とし、Ｚ方向に直交する２つの方向のうち、粒子の寸法が長くなる方向をＸ方向とする。そして、Ｘ方向の寸法(直径)を長径ａ、Ｚ方向の寸法(直径)を短径ｂとしたときに、扁平率ｆはｆ＝１－（ｂ／ａ）で表される。粒子の形状が球径(断面は円)であれば扁平率は０となり、粒子の形状が完全につぶれた形状であれば扁平率は１となる。
第１磁性粒子は球状の粒子であることが好ましいので、扁平率は０に近い。一方、第２磁性粒子はその断面形状が板状であり扁平率が高い粒子となるので、扁平率は１に近くなる。従って、第２磁性粒子の扁平率は第１磁性粒子の扁平率より高くなる。
第１磁性粒子及び第２磁性粒子の扁平率は、図４や図６に示すような断面写真において各粒子の寸法を測定することにより定めることができる。断面写真に含まれる少なくとも１０個の粒子の扁平率を測定して、その平均値として定めることができる。
また、第２磁性粒子は、第２磁性層の主面に沿った方向（図６に両矢印Ｌで示す方向）での寸法が、第２磁性層の厚さ方向での寸法（図６に両矢印Ｔで示す方向）より長い形状の粒子である。このことは、扁平率が大きい第２磁性粒子の配向方向が、第２磁性層の主面に沿った方向であることを意味している。
第２磁性粒子の寸法のうち、第２磁性層の主面に沿った方向での寸法（図７の長径ａに相当）は５０μｍ以上であることが好ましく、１０００μｍ以下であることが好ましい。また、第２磁性層の厚さ方向での寸法（図７の短径ｂに相当）は０．５μｍ以上であることが好ましく、５０μｍ以下であることが好ましい。
また、第２磁性粒子の扁平率が０．９以上であることが好ましい。第２磁性粒子の扁平率は１未満であればよい。
なお、第１磁性粒子の扁平率は１／３（≒０．３３）以下であることが好ましい。第１磁性粒子の扁平率は０でもよく、０以上であればよい。
第２磁性層２０を構成する樹脂２２としては、エポキシ、フェノール又はポリイミドなどの樹脂が挙げられる。第２磁性層２０を構成する樹脂２２の種類は、第１磁性層１０を構成する樹脂１２の種類と同じであってもよく、異なっていてもよい。
第２磁性粒子は扁平率が大きい粒子であり、透磁率において異方性を有する。第２磁性粒子は第２磁性層の主面に沿った方向での寸法が長く、第２磁性層の厚さ方向での寸法が小さいので、第２磁性層の主面に沿った方向での透磁率が高くなる。
このような特性を有する第２磁性層が、第１磁性層の少なくとも一方の面に設けられていると、第１磁性層の内部に設けられたインダクタからの漏れ磁束が第２磁性層から漏れないようにすることができる。すなわち、インダクタからの漏れ磁束をインダクタ層内に閉じ込めることができる。
そのため、インダクタ以外の素子（アクティブ素子、キャパシタ、引き回し配線等）によるインダクタンスへの影響（インダクタンスの低下）を小さくできるとともに、インダクタからの放射ノイズを抑制できる。
第２磁性層は、第２磁性層の主面に沿った方向の透磁率が、第２磁性層の厚さ方向の透磁率よりも高いことが好ましい。
また、第２磁性層の主面に沿った方向の透磁率が、第２磁性層の厚さ方向の透磁率の５倍以上であることが好ましい。
第２磁性層の主面に沿った方向の透磁率が第２磁性層の厚さ方向の透磁率よりも高いと、インダクタからの漏れ磁束をインダクタ層内に閉じ込めることができる。そして、第２磁性層の主面に沿った方向の透磁率が第２磁性層の厚さ方向の透磁率の５倍以上であると、このような効果がより効果的に発揮される。
第２磁性層のその主面方向に沿った方向の透磁率が、第１磁性層のその主面方向に沿った方向の透磁率より高いことが好ましい。
一般的に透磁率が高い材料は充填性が悪く、厚さが厚いインダクタ配線を透磁率の高い材料で充填することは困難である。そこで充填性は高いが、低透磁率の材料で配線を充填した第１磁性層を設け、高透磁率の材料を含み主面方向に沿った方向の透磁率の高い第２磁性層を積層することにより、厚さが厚いインダクタ配線に対する充填性と高インダクタンスを両立し、インダクタからの放射ノイズを抑制することができる。
このような効果をより効果的に発揮させるために、第２磁性層のその主面に沿った方向の透磁率が、第１磁性層のその主面に沿った方向の透磁率の１．５倍以上であることが好ましい。
第２磁性層、第１磁性層のそれぞれにつき、その主面方向に沿った方向の透磁率及びその厚さ方向の透磁率はネットワークアナライザ等により測定することができる。
次に、パッケージ基板を構成するキャパシタ層の詳細について説明する。
図１に示すキャパシタ層２１０は、キャパシタ部２３０と、出力端子ＯＵＴのスルーホール導体２６２に電気的に接続される導電部２４０と、接地端子ＧＮＤのスルーホール導体（図１に図示せず。図５にスルーホール導体２６３として示す）に電気的に接続される導電部と、これらの周囲に設けられた絶縁部２２５と、を含む。
インダクタ層２５０の第１磁性層１０と、キャパシタ層２１０の間に、インダクタ層２５０の第２磁性層２０が位置している。
上述したように、第２磁性層によりインダクタからの放射ノイズを抑制することができるので、インダクタとキャパシタとの間に生じる磁気的な結合による表面波ノイズ伝播を抑制することができ、パッケージ基板の品質を向上させることができる。
また、キャパシタによるインダクタンスへの影響（インダクタンスの低下）を小さくすることができる。
本実施形態では、キャパシタ部２３０は、金属からなる陽極板２３１を含む。例えば、陽極板２３１は、弁作用金属からなる芯部２３２を有する。陽極板２３１は、芯部２３２の少なくとも一方の主面に設けられた多孔質部２３４を有することが好ましい。多孔質部２３４の表面には誘電体層（図示せず）が設けられており、誘電体層の表面に陰極層２３６が設けられている。これにより、本実施形態では、キャパシタ部２３０は、電解キャパシタ（電解コンデンサ）を形成している。
キャパシタ部２３０が電解キャパシタを形成している場合、陽極板２３１は、いわゆる弁作用を示す弁作用金属からなる。弁作用金属としては、例えば、アルミニウム、タンタル、ニオブ、チタン、ジルコニウムなどの金属単体、又は、これらの金属を少なくとも１種含む合金などが挙げられる。これらの中では、アルミニウム又はアルミニウム合金が好ましい。
陽極板２３１の形状は、平板状であることが好ましく、箔状であることがより好ましい。陽極板２３１は、芯部２３２の少なくとも一方の主面に多孔質部２３４を有していればよく、芯部２３２の両方の主面に多孔質部２３４を有していてもよい。多孔質部２３４は、芯部２３２の表面に形成された多孔質層であることが好ましく、エッチング層であることがより好ましい。
多孔質部２３４の表面に設けられる誘電体層は、多孔質部２３４の表面状態を反映して多孔質になっており、微細な凹凸状の表面形状を有している。誘電体層は、上記弁作用金属の酸化皮膜からなることが好ましい。例えば、陽極板２３１としてアルミニウム箔が用いられる場合、アジピン酸アンモニウムなどを含む水溶液中でアルミニウム箔の表面に対して陽極酸化処理（化成処理ともいう）を行うことにより、酸化皮膜からなる誘電体層を形成することができる。
誘電体層の表面に設けられる陰極層２３６は、例えば、誘電体層の表面に設けられた固体電解質層を含む。陰極層２３６は、さらに、固体電解質層の表面に設けられた導電体層を含むことが好ましい。
固体電解質層を構成する材料としては、例えば、ポリピロール類、ポリチオフェン類、ポリアニリン類などの導電性高分子などが挙げられる。これらの中では、ポリチオフェン類が好ましく、ＰＥＤＯＴと呼ばれるポリ（３，４－エチレンジオキシチオフェン）が特に好ましい。また、上記導電性高分子は、ポリスチレンスルホン酸（ＰＳＳ）などのドーパントを含んでいてもよい。なお、固体電解質層は、誘電体層の細孔（凹部）を充填する内層と、誘電体層を被覆する外層とを含むことが好ましい。
導電体層は、導電性樹脂層及び金属層のうち、少なくとも１層を含む。導電体層は、導電性樹脂層のみでもよく、金属層のみでもよい。導電体層は、固体電解質層の全面を被覆することが好ましい。
導電性樹脂層としては、例えば、銀フィラー、銅フィラー、ニッケルフィラー及びカーボンフィラーからなる群より選択される少なくとも１種の導電性フィラーを含む導電性接着剤層などが挙げられる。
金属層としては、例えば、金属めっき膜、金属箔などが挙げられる。金属層は、ニッケル、銅、銀及びこれらの金属を主成分とする合金からなる群より選択される少なくとも一種の金属からなることが好ましい。なお、「主成分」とは、元素の重量比率が最も大きい元素成分をいう。
導電体層は、例えば、固体電解質層の表面に設けられたカーボン層と、カーボン層の表面に設けられた銅層とを含む。
カーボン層は、固体電解質層と銅層とを電気的及び機械的に接続させるために設けられている。カーボン層は、カーボンペーストをスポンジ転写、スクリーン印刷、ディスペンサ、インクジェット印刷などによって固体電解質層上に塗布することにより、所定の領域に形成することができる。
銅層は、銅ペーストをスポンジ転写、スクリーン印刷、スプレー塗布、ディスペンサ、インクジェット印刷などによってカーボン層上に印刷することにより形成することができる。
出力端子ＯＵＴのスルーホール導体２６２に電気的に接続される導電部２４０は、例えばＡｇ、Ａｕ又はＣｕのような低抵抗の金属を主体として構成される。層間の密着力向上を目的として、上記導電性フィラーと樹脂とを混合した導電性密着材を導電部として設けてもよい。
また、接地端子ＧＮＤのスルーホール導体に電気的に接続される導電部の構成も導電部２４０の構成と同様とすることができる。
絶縁部２２５は、エポキシ、フェノール又はポリイミドなどの樹脂、あるいは、エポキシ、フェノール又はポリイミドなどの樹脂とシリカ又はアルミナなどの無機フィラーとの混合材料のような絶縁材料で構成される。
また、図１に示されるように、キャパシタ部２３０の陰極である陰極層２３６は、ビア導体２４２を介して導電部２４０及びスルーホール導体２６２と電気的に接続されている。
なお、キャパシタ部２３０として、チタン酸バリウムを用いたセラミックキャパシタ、あるいは、窒化ケイ素（ＳｉＮ）、二酸化ケイ素（ＳｉＯ２）、フッ化水素（ＨＦ）などを用いた薄膜キャパシタを用いることも可能である。しかしながら、より薄型で比較的大きな面積のキャパシタ部２３０を形成できること、及び、パッケージ基板２００の剛性及び柔軟性のような機械特性の観点から、キャパシタ部２３０は、アルミニウムなどの金属を基材とするキャパシタであることが好ましく、アルミニウムなどの金属を基材とする電解キャパシタであることがより好ましい。
樹脂層２２６、２２７及び２２８は、各層を互いに接合するための接合材料として使用されるとともに、キャパシタ層２１０及びインダクタ層２５０の露出面を絶縁するための絶縁層として用いられる。キャパシタ層２１０とインダクタ層２５０とは、樹脂層２２７によって接合されている。キャパシタ層２１０の表面には樹脂層２２６が形成されており、インダクタ層２５０の底面には樹脂層２２８が形成されている。樹脂層２２６、２２７及び２２８は、例えば、エポキシ、ポリイミド又はフェノールなどの樹脂、あるいは、エポキシ、ポリイミド又はフェノールなどの樹脂とシリカ又はアルミナなどの無機フィラーとの混合材料のような絶縁材料で形成される。スルーホール導体との密着性を確保するために、樹脂層としてエポキシ樹脂を主体とする材料を用いることが好ましい。
樹脂層２２６の表面には、ボルテージレギュレータ１００などの機器を実装するためのランド及びそれらを接続するための配線を含む上面端子層２０５が形成されている。パッケージ基板２００に実装される機器は、はんだバンプ１２０を介して、上面端子層２０５のランドあるいは端子と電気的に接続される。
上面端子層２０５は、銅（Ｃｕ）、金（Ａｕ）又は銀（Ａｇ）などの低抵抗の金属材料で形成される。なお、上面端子層２０５は、樹脂層２２６の表面のみに形成される場合には限られず、例えば樹脂層２２６の内部に複数層にわたって形成されるものであってもよい。なお、上面端子層２０５の実装面に形成されるランドあるいは端子の表面は、機器の実装を容易にするために、ニッケル／金（Ｎｉ／Ａｕ）めっき、ニッケル／鉛／金（Ｎｉ／Ｐｂ／Ａｕ）めっき、あるいはプリフラックス処理などの表面処理が施されていることが好ましい。また、機器の表面実装時のはんだ流れを防止するために、上面端子層２０５の最表層部分にソルダーレジスト層が形成されてもよい。
パッケージ基板２００は、第１磁性層１０及び第２磁性層２０（上面側第２磁性層２０ａ及び下面側第２磁性層２０ｂ）を厚さ方向に貫通するスルーホール導体２６１、スルーホール導体２６２を備えている。スルーホール導体２６１はインダクタ配線の一方端（ＩＮ）と接続されており、スルーホール導体２６２はインダクタ配線の他方端（ＯＵＴ）と接続されている。
また、パッケージ基板２００は、第１磁性層１０及び第２磁性層２０（上面側第２磁性層２０ａ及び下面側第２磁性層２０ｂ）を厚さ方向に貫通し、グランドライン（ＧＮＤ）として使用されるスルーホール導体２６３（図５参照）を備えている。
スルーホール導体を用いることで、配線のインピーダンスを下げ、かつ回路面のレイアウトを最小化できることから、半導体複合装置のサイズを小さくすることが可能となる。
パッケージ基板全体の厚みは、システムの薄型化や、論理演算回路の放熱性などを考慮するため、２．０ｍｍ以下であることが好ましく、１．６ｍｍ以下であることがより好ましい。
インダクタ層の厚みは、パッケージ基板の薄型化が要求されていることから０．５ｍｍ以下であることが好ましく、０．３ｍｍ以下であることがより好ましい。インダクタ層の厚みは、インダクタ層が複数層設けられているときは複数のインダクタ層の厚さの合計として定める。
また、キャパシタ層の厚みは、パッケージ基板の薄型化が要求されていることから１．２ｍｍ以下であることが好ましく、０．８ｍｍ以下であることがより好ましい。キャパシタ層の厚みは、キャパシタ層が複数層設けられているときは複数のキャパシタ層の厚さの合計として定める。
なお、これまでに説明したパッケージ基板２００ではインダクタ層２５０が１層、キャパシタ層２１０が１層設けられているが、所望のインダクタンス値、キャパシタンス値を得るため、インダクタ層２５０及びキャパシタ層２１０が複数層設けられていてもよい。
また、実装面からのインダクタ層２５０とキャパシタ層２１０の積層順が逆となっていてもいい。すなわち、ボルテージレギュレータ１００及び負荷３００が実装される側にインダクタ層２５０が位置していてもよい。
さらには、パッケージ基板は、その目的に応じ、インダクタ層２５０／キャパシタ層２１０／インダクタ層２５０といった多層構成であってもよく、キャパシタ層２１０／インダクタ層２５０／キャパシタ層２１０といった多層構成であってもよい。
図２に示す半導体複合装置１において、インダクタ配線１３とボルテージレギュレータ１００及び負荷３００の間には、第２磁性層２０としての上面側第２磁性層２０ａが位置している。
上述したように、第２磁性層によりインダクタからの放射ノイズを抑制することができるので、インダクタと、ボルテージレギュレータを構成するアクティブ素子及び負荷であるＩＣ等の素子との間に生じる磁気的な結合による表面波ノイズ伝播を抑制することができ、パッケージ基板の品質を向上させることができる。
また、ボルテージレギュレータを構成するアクティブ素子、負荷であるＩＣ等の素子によるインダクタンスへの影響（インダクタンスの低下）を小さくすることができる。
［パッケージ基板の製造方法］
図１に示すようなパッケージ基板を製造する場合、キャパシタ層２１０及びインダクタ層２５０をそれぞれ個別に作製する。その後、キャパシタ層２１０及びインダクタ層２５０を、樹脂層２２６、２２７及び２２８を用いて接合して一体化する。次に、一体化されたキャパシタ層２１０及びインダクタ層２５０にスルーホール導体を形成する。その後、実装面に上面端子層２０５となる電極パターン及び配線パターンを形成することでパッケージ基板２００が完成する。
なお、必要に応じて、実装面と反対の面に底面端子層２７０となる電極パターン及び配線パターンを形成してもよい。
完成したパッケージ基板２００に、ボルテージレギュレータ１００などの機器を実装することにより、半導体複合装置１とすることができる。
パッケージ基板を構成するインダクタ層は以下のプロセスで作製することができる。
まず、Ｃｕ箔の両面にフォトレジストなどによりパターニングを実施するとともに、フォトレジスト開口部をエッチングすることにより所定のパターンのインダクタ配線を形成する。
次に、真空ラミネートや真空プレスにより、第１磁性粒子と樹脂のコンポジット材料である磁性シートをインダクタ配線のパターン間を埋めつつインダクタ配線上に形成する。さらに、熱プレス機によって平坦化及び樹脂の熱硬化処理を行う。これにより、インダクタ配線を含む第１磁性層を形成する。
磁性シートはインダクタ配線に対して、片面ずつ形成してもよい。
次に、第２磁性粒子と樹脂のコンポジット材料である磁性シートを真空ラミネートや真空プレスにより、第１磁性層の上面及び下面に形成する。これにより、第２磁性層を形成する。
なお、第２磁性層は第１磁性層の一方の面のみに形成してもよい。
次に、第２磁性層の表面に樹脂層（例えばＡＢＦ（味の素ビルドアップフィルム）等）を形成する。
そして、上述したように、キャパシタ層とインダクタ層を樹脂層を介して接合して一体化する。
次に、インダクタ配線の取り出し電極に対応する部分に、ドリル、レーザなどによりスルーホールを形成する。
さらに、スルーホール内をめっきすることにより導体を形成してスルーホール導体としてインダクタ配線と接続する。スルーホール内に形成する導体はコンフォーマル又はフィリングのどちらでもよいが、大きな電流を流す場合は、フィリングであることが好ましい。
さらに、実装面に電極パターン及び配線パターンを形成することでパッケージ基板が完成する。
［パッケージ基板及び半導体複合装置のその他の実施形態］
以下に、パッケージ基板及び半導体複合装置のその他の実施形態についていくつかの例を説明する。以下には、上述したパッケージ基板及び半導体複合装置の第１実施形態と相違する事項及び追加事項について説明する。
図８は、半導体複合装置をマザー基板に実装した形態の一例を模式的に示す断面図である。
図８に示す半導体複合装置１Ａに含まれるパッケージ基板２００Ａには、負荷３００をパッケージ基板２００Ａ上に実装した場合に、負荷３００の信号用のグランドラインの端子に接続されるスルーホール導体２６６が設けられる。スルーホール導体２６６は、キャパシタ層２１０に含まれるキャパシタ部２３０及びインダクタ層２５０に含まれるインダクタ配線１３とは電気的に接続されない状態で、底面端子層２７０まで貫通している。そして、はんだバンプ３８０を介して、マザー基板４００のグランドラインに接続される端子４１０に電気的に接続される。
なお、図８においては、負荷３００のグランドラインのスルーホール導体について説明したが、他の電子機器のグランドラインについても同様の構成としてもよい。
図９は、半導体複合装置をマザー基板に実装した形態の別の一例を模式的に示す断面図である。
図９に示す半導体複合装置１Ｂに含まれるパッケージ基板２００Ｂには、負荷３００をパッケージ基板２００Ｂ上に実装した場合に、負荷３００に接続されるスルーホール導体２６７が設けられる。
スルーホール導体２６７は、キャパシタ層２１０に含まれるキャパシタ部２３０及びインダクタ層２５０に含まれるインダクタ配線１３とは電気的に接続されない状態で、底面端子層２７０まで貫通している。そして、はんだバンプ３８０を介して、マザー基板４００のヒートシンク４２０に接続される端子４１０に電気的に接続される。
ヒートシンク４２０は銅ブロック等の熱伝導率の高い部材である。負荷３００の駆動により生じた熱をスルーホール導体２６７を通じてヒートシンク４２０に伝熱させることができる。
すなわち、スルーホール導体２６７は放熱経路として利用されており、このような構成とすることで許容電力を向上させることができる。
スルーホール導体２６７は図９においては３本設けられているが、その本数は限定されるものではない。
図１０は、パッケージ基板の別の一例を模式的に示す断面図である。
図１０に示すパッケージ基板２００Ｃでは、第２磁性層２０が第１磁性層１０の一方の面だけに設けられている。具体的には第１磁性層１０の上側の上面側第２磁性層２０ａが設けられていて、第１磁性層１０の下側に第２磁性層は設けられていない。
図面上では第１磁性層の上側、下側と説明しているが、第２磁性層が第１磁性層の一方の面だけに設けられる場合の好ましい位置は、インダクタ層以外の要素との関係で定まる。第２磁性層が第１磁性層の一方の面だけに設けられる場合は、第１磁性層とキャパシタ層の間に第２磁性層が設けられることが好ましい。また、第１磁性層とパッケージ基板の実装面の間に第２磁性層が設けられることが好ましい。
上述したように、第２磁性層によりインダクタからの放射ノイズを抑制することができるが、放射ノイズを抑制することにより発揮される効果は、インダクタとキャパシタ層又は他の素子との間に第２磁性層が存在する場合に特に有効に発揮されるためである。
図１１及び図１２は、パッケージ基板の別の一例を模式的に示す断面図である。
図１１に示すパッケージ基板２００Ｄ及び図１２に示すパッケージ基板２００Ｅでは、キャパシタ層が設けられていない。
パッケージ基板がキャパシタ層を備えていない場合であっても、パッケージ基板がインダクタ層を備えることによりインダクタンスを得ることができる。
図１１に示すパッケージ基板２００Ｄでは、第２磁性層２０は第１磁性層１０の一方の面及び他方の面に設けられている。
図１２に示すパッケージ基板２００Ｅでは第２磁性層２０が第１磁性層１０の一方の面だけに設けられている。
第２磁性層が設けられていることにより、インダクタからの放射ノイズを抑制することができる。
図１２に示すパッケージ基板２００Ｅのように第２磁性層が第１磁性層の一方の面だけに設けられる場合は、第１磁性層とパッケージ基板の実装面の間に第２磁性層が設けられることが好ましい。
［パッケージ基板の仕様と特性の関係］
パッケージ基板を構成するインダクタ層の仕様と特性の関係を確認した。
図１３は、第２磁性粒子の寸法とインダクタンス低下値の関係を示すグラフである。
図１３には、第２磁性粒子につき、図７に示すＸ方向の寸法(直径)を長径ａ、Ｚ方向の寸法(直径)を短径ｂとしたときの寸法比（ａ／ｂ）と、インダクタ層の外部の引き回し配線の影響によるインダクタンス低下値（引き回し配線がない場合のインダクタンスの値に対する比率［％］）の関係を示している。寸法比の値が大きいほど扁平率の高い粒子であるといえる。
寸法比が大きい粒子、すなわち扁平率が高い粒子を使用すると、第２磁性層の主面に沿った方向の透磁率が高く、磁束をインダクタ層の内部に閉じ込める効果が好適に発揮される。インダクタ層の引き回し配線の影響を受けにくくなり、インダクタンス低下値が小さくなる。
また、インダクタからの放射ノイズを抑制することができる。
インダクタではインダクタンスの規格として規格値から±２０％で規定することが多い。そこで、インダクタンス低下値を２０％以下とできるようにすることを考えると、第２磁性粒子の寸法比が１０以上であることが好ましい。第２磁性粒子の寸法比が１０以上である場合、第２磁性粒子の扁平率は０．９以上となる。
次に、第２磁性層と第１磁性層の厚み比と特性の関係について説明する。
図１４は、試験に使用したインダクタ層の寸法を模式的に示す断面図である。
図１４には、インダクタ層２５０の厚さが５００μｍであり、インダクタ配線１３の厚さが１００μｍであり、上面側第２磁性層２０ａ及び下面側第２磁性層２０ｂの厚さがともにＨμｍ(両矢印Ｈで示す寸法)、第１磁性層１０のうちインダクタ配線１３と第２磁性層２０の間の厚さがＫμｍ（両矢印Ｋで示す寸法）であることを示している。
試験に使用した第２磁性層は、透磁率に異方性を有しており、第２磁性層の主面に沿った方向の透磁率が第２磁性層の厚さ方向の透磁率より大きくなっている。
また、第２磁性層に含まれる第２磁性粒子は、第２磁性層の主面に沿った方向（図６に両矢印Ｌで示す方向）での寸法が、第２磁性層の厚さ方向での寸法（図６に両矢印Ｔで示す方向）より長い形状の粒子である。そして、図７に示すＸ方向の寸法(直径)を長径ａ、Ｚ方向の寸法(直径)を短径ｂとしたときに、ａ：ｂ＝５０：１である粒子である。扁平率は０．９８となる。
第２磁性層のその主面に沿った方向の透磁率：第１磁性層のその主面に沿った方向の透磁率＝２：１である。
図１４に示したインダクタ層２５０において、第２磁性層と第１磁性層の厚み比と特性の関係を図１５及び図１６に示す。
図１５は、第２磁性層と第１磁性層の厚み比とインダクタンスの関係を示すグラフである。
図１６は、第２磁性層と第１磁性層の厚み比と重畳特性の関係を示すグラフである。
図１５及び図１６の横軸には、図１４の寸法ＨとＫの比を下記式の厚み比として示している。
厚み比＝［Ｈ／（Ｈ＋Ｋ）］×１００（％）
図１５及び図１６のグラフは、Ｈ＋Ｋ＝２００μｍで固定して、ＨとＫの割合を変化させて厚み比を算出することにより作成している。
図１５の縦軸にはインダクタンス値（Ｌ値［ｎＨ］）を示している。図１５から、インダクタンス値の観点からは、厚み比が４０％以上、５０％以下の範囲が最も好ましいことが分かる。
図１６の縦軸には直流重畳定格電流値（Ｉｓａｔ［Ａ］）を示している。図１６から、重畳特性の観点からは第２磁性層が薄い方が好ましいことが分かる。従って、重畳特性が高くなるように、第２磁性層は厚くし過ぎないことが好ましい。
実用上は厚み比が３０％以上であることが第２磁性層を設けることによる効果を充分に発揮させるためには好ましい。
このような観点から、厚み比は３０％以上、５０％以下であることが好ましい。
１、１Ａ、１Ｂ 半導体複合装置
１０ 第１磁性層
１１ 第１磁性粒子
１２ 樹脂
１３ インダクタ配線
１４ａ、１４ｂ、１４ｃ、１４ｄ 直線
１５ａ、１５ｂ、１５ｃ 連結部
２０ 第２磁性層
２０ａ 上面側第２磁性層
２０ｂ 下面側第２磁性層
２１ 第２磁性粒子
２２ 樹脂
１００ ボルテージレギュレータ
１２０ はんだバンプ
２００、２００Ａ、２００Ｂ、２００Ｃ、２００Ｄ、２００Ｅ パッケージ基板
２０５ 上面端子層
２１０ キャパシタ層
２２５ 絶縁部
２２６、２２７、２２８ 樹脂層
２３０ キャパシタ部
２３１ 陽極板
２３２ 芯部
２３４ 多孔質部
２３６ 陰極層
２４０ 導電部
２４２ ビア導体
２５０ インダクタ層
２６１、２６２、２６３、２６６、２６７ スルーホール導体
２７０ 底面端子層
３００ 負荷
３８０ はんだバンプ
３５０ 他の電子機器
４００ マザー基板
４１０ マザー基板の端子
４２０ ヒートシンク
ＣＰ１ キャパシタ
Ｌ１ インダクタ

Claims (11)

  1. 第１磁性粒子及び樹脂を含む第１磁性層と、
    前記第１磁性層の少なくとも一方の面に設けられ、前記第１磁性粒子よりも平均扁平率が大きい第２磁性粒子及び樹脂を含む第２磁性層と、
    を備えるインダクタ層を有し、
    前記第２磁性粒子は前記第２磁性層の主面に沿った方向での寸法が、前記第２磁性層の厚さ方向での寸法より長い形状の粒子であり、
    前記第１磁性層の内部にはインダクタとして機能するインダクタ配線が設けられており、
    厚さ方向において前記インダクタ配線と前記第２磁性層の間には前記第１磁性粒子及び樹脂が存在することを特徴とするパッケージ基板。
  2. 前記第１磁性層の主面に沿った平面を上面視した際に、
    前記インダクタ配線は、電流が流れる向きが異なる複数の直線が連結され、前記複数の直線を連結する連結部の形状が直線又は曲線である一本の配線であり、
    一の直線において電流が流れる向きと、当該一の直線と隣接する直線において電流が流れる向きとが異なる、請求項１に記載のパッケージ基板。
  3. 前記インダクタ配線は、配線の厚み／配線の幅で表わされるアスペクト比が０．２以上である請求項１又は２に記載のパッケージ基板。
  4. 前記第２磁性層のその主面に沿った方向の透磁率が、前記第１磁性層のその主面に沿った方向の透磁率より高い請求項１～３のいずれかに記載のパッケージ基板。
  5. 前記第２磁性層のその主面に沿った方向の透磁率が、前記第１磁性層のその主面に沿った方向の透磁率の１．５倍以上である請求項４に記載のパッケージ基板。
  6. 前記第２磁性層は、前記第２磁性層の主面に沿った方向の透磁率が、前記第２磁性層の厚さ方向の透磁率よりも高い請求項１～５のいずれかに記載のパッケージ基板。
  7. 前記第２磁性層の主面に沿った方向の透磁率が、前記第２磁性層の厚さ方向の透磁率の５倍以上である請求項６に記載のパッケージ基板。
  8. 前記第１磁性層及び前記第２磁性層を厚さ方向に貫通するスルーホール導体を備える請求項１～７のいずれかに記載のパッケージ基板。
  9. 内部にキャパシタが形成されたキャパシタ層をさらに有し、
    前記インダクタ層の前記第１磁性層と、前記キャパシタ層の間に、前記インダクタ層の前記第２磁性層が位置している、請求項１～８のいずれかに記載のパッケージ基板。
  10. 前記インダクタ配線は巻いていない形状の配線である、請求項１～９のいずれかに記載のパッケージ基板。
  11. 前記第２磁性層の厚みＨと、前記インダクタ配線と前記第２磁性層の間に存在する前記第１磁性層の厚みＫの厚み比＝［Ｈ／（Ｈ＋Ｋ）］×１００（％）が３０％以上、５０％以下である、請求項１～１０のいずれかに記載のパッケージ基板。
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