JP2006019346A - 構造体と、パワーモジュール基板と、その基板を用いたパワーモジュール、及び、それらの製造方法 - Google Patents
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- 239000000758 substrate Substances 0.000 title claims abstract description 36
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 16
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 claims abstract description 81
- 229910000679 solder Inorganic materials 0.000 claims abstract description 60
- 239000004065 semiconductor Substances 0.000 claims abstract description 51
- 238000007747 plating Methods 0.000 claims abstract description 49
- 229910052759 nickel Inorganic materials 0.000 claims abstract description 37
- 229910052782 aluminium Inorganic materials 0.000 claims abstract description 32
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 claims abstract description 32
- 239000000463 material Substances 0.000 claims description 31
- 230000017525 heat dissipation Effects 0.000 claims description 10
- 238000005476 soldering Methods 0.000 claims description 10
- 238000000034 method Methods 0.000 claims description 5
- 230000006866 deterioration Effects 0.000 abstract description 2
- 239000011248 coating agent Substances 0.000 abstract 1
- 238000000576 coating method Methods 0.000 abstract 1
- 229910052751 metal Inorganic materials 0.000 description 7
- 239000002184 metal Substances 0.000 description 7
- 238000003466 welding Methods 0.000 description 5
- 239000000919 ceramic Substances 0.000 description 2
- 230000008021 deposition Effects 0.000 description 2
- 238000005219 brazing Methods 0.000 description 1
- 238000001816 cooling Methods 0.000 description 1
- 238000005336 cracking Methods 0.000 description 1
- 230000020169 heat generation Effects 0.000 description 1
- 238000005304 joining Methods 0.000 description 1
- 230000003647 oxidation Effects 0.000 description 1
- 238000007254 oxidation reaction Methods 0.000 description 1
- 230000005855 radiation Effects 0.000 description 1
- 230000003252 repetitive effect Effects 0.000 description 1
- 238000007711 solidification Methods 0.000 description 1
- 230000008023 solidification Effects 0.000 description 1
- 238000009736 wetting Methods 0.000 description 1
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L24/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L24/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
- H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
- H01L2224/45001—Core members of the connector
- H01L2224/45099—Material
- H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/45117—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
- H01L2224/45124—Aluminium (Al) as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/8338—Bonding interfaces outside the semiconductor or solid-state body
- H01L2224/83385—Shape, e.g. interlocking features
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/00014—Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
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- H—ELECTRICITY
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/13—Discrete devices, e.g. 3 terminal devices
- H01L2924/1304—Transistor
- H01L2924/1305—Bipolar Junction Transistor [BJT]
- H01L2924/13055—Insulated gate bipolar transistor [IGBT]
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Abstract
【解決手段】 半導体素子5を載置するための支持突起9をアルミニウム製の回路層3に一体に形成し、回路層3上の少なくともはんだが接触する部分にニッケルメッキを施す。支持突起9によって半導体素子5と回路層3上のニッケルメッキ層の間にできた隙間にはんだを充填し、そこに半導体素子5を固定するためのはんだ層6を形成する。
【選択図】 図1
Description
即ち、パワーモジュールのような構造体においては、電気部品と基材の間にはんだの不連続部であるボイドが発生すると、電気部品から基材への放熱性が低下し、また、はんだの歪が大きいと、部品の剥離等を生じ易くなる。そして、このような放熱性の低下や部品の剥離は製品寿命の低下の原因となるため、製品寿命の向上の観点からは特に重要となる。
この構造体は、アルミニウム製の基材の上面に別体のアルミ線材を超音波溶着等によって溶着し、そのアルミ線材の上に電気部品を載置して、基材と電気部品の間にできた比較的大きな隙間にはんだを流入させ、そこにはんだ層を形成したものである。この構造体の場合、基材と電気部品の間の隙間が大きく確保されるため、その隙間にはんだがスムーズに流入してボイドの発生が抑制され、しかも、はんだ層が充分に厚くなることから、はんだ層の歪も低減される。
また、この構造体の製造方法の発明は、基材に電気部品を載置するための支持突起を一体に形成する工程と、その支持突起を含む基材上の少なくともはんだが接触する部分にニッケルメッキを施す工程と、前記支持突起によって電気部品と基材上のニッケルメッキ層の間にできた隙間にはんだを充填する工程と、を含む。
また、この出願のパワーモジュール用基板の製造方法の発明は、回路層に半導体素子を載置するための支持突起を一体に形成する工程と、その支持突起を含む回路層上の少なくともはんだが接触する部分にニッケルメッキを施す工程と、を含む。
また、この出願のパワーモジュールの製造方法の発明は、回路層に半導体素子を載置するための支持突起を一体に形成する工程と、その支持突起を含む回路層の少なくともはんだが接触する部分にニッケルメッキを施す工程と、前記支持突起によって半導体素子と回路層上のニッケルメッキ層の間にできた隙間にはんだを充填する工程と、を含む。
尚、この実施形態では、支持突起9を一体に形成した回路層3と、Niメッキ層、半導体素子5、はんだ層6等が構造体を構成している。
まず、絶縁層2の上下に回路層3と金属層4を接合した後に、回路層3上に前述のような塑性変形によって支持突起9を一体に形成する。そして、この後に支持突起9を含む回路層3上のはんだ導入部にNiメッキ層を形成する。ここまででパワーモジュール用基板1が製造される。
1 パワーモジュール用基板
2 絶縁層
3 回路層(基材)
4 金属層(放熱部材)
5 半導体素子(電気部品)
6 はんだ層
7 放熱板(放熱部材)
8 ヒートシンク
9 支持突起
Claims (13)
- アルミニウム製の基材に電気部品がはんだ固定された構造体において、
前記電気部品を載置するために前記基材に一体に形成された支持突起と、
その支持突起を含む前記基材上の少なくともはんだが接触する部分を被覆するニッケルメッキ層と、
前記支持突起によって電気部品と前記基材上のニッケルメッキ層の間にできた隙間に充填され、電気部品を基材に固定するはんだ層と、を備えたことを特徴とする構造体。 - 前記支持突起は、基材を塑性変形させることによって一体に形成されていることを特徴とする請求項1に記載の構造体。
- 半導体素子をはんだ固定するためのアルミニウム製の回路層が絶縁層の上面に形成されたパワーモジュール用基板において、
前記半導体素子を載置するために前記回路層に一体に形成された支持突起と、
その支持突起を含む前記回路層上の少なくともはんだが接触する部分を被覆するニッケルメッキ層と、を備えたことを特徴とするパワーモジュール用基板。 - 半導体素子をはんだ固定するためのアルミニウム製の回路層が絶縁層の上面に形成され、前記絶縁層の下面に放熱部材が固定されたパワーモジュール用基板において、
前記半導体素子を載置するために前記回路層に一体に形成された支持突起と、
その支持突起を含む前記回路層上の少なくともはんだが接触する部分を被覆するニッケルメッキ層と、を備えたことを特徴とするパワーモジュール用基板。 - 半導体素子をはんだ固定するためのアルミニウム製の回路層が絶縁層の上面に形成され、前記絶縁層の下面に放熱部材を介してヒートシンクが固定されたパワーモジュール用基板において、
前記半導体素子を載置するために前記回路層に一体に形成された支持突起と、
その支持突起を含む前記回路層上の少なくともはんだが接触する部分を被覆するニッケルメッキ層と、を備えたことを特徴とするパワーモジュール用基板。 - 前記支持突起は、前記回路層を塑性変形させることによって一体に形成されていることを特徴とする請求項3〜5のいずれかに記載のパワーモジュール用基板。
- 絶縁層の上面にアルミニウム製の回路層が形成され、その回路層に半導体素子がはんだ固定されたパワーモジュールにおいて、
前記半導体素子を載置するために前記回路層に一体に形成された支持突起と、
その支持突起を含む前記回路層上の少なくともはんだが接触する部分を被覆するニッケルメッキ層と、
前記支持突起によって半導体素子と前記回路層上のニッケルメッキ層の間にできた隙間に充填され、半導体素子を回路層に固定するはんだ層と、を備えたことを特徴とするパワーモジュール。 - 絶縁層の上面にアルミニウム製の回路層が形成され、前記回路層に半導体素子がはんだ固定されると共に、前記絶縁層の下面に放熱部材が固定されたパワーモジュールにおいて、
前記半導体素子を載置するために前記回路層に一体に形成された支持突起と、
その支持突起を含む前記回路層上の少なくともはんだが接触する部分を被覆するニッケルメッキ層と、
前記支持突起によって半導体素子と前記回路層上のニッケルメッキ層の間にできた隙間に充填され、半導体素子を回路層に固定するはんだ層と、を備えたことを特徴とするパワーモジュール。 - 絶縁層の上面にアルミニウム製の回路層が形成され、前記回路層に半導体素子がはんだ固定されると共に、前記絶縁層の下面に放熱部材を介してヒートシンクが固定されたパワーモジュールにおいて、
前記半導体素子を載置するために前記回路層に一体に形成された支持突起と、
その支持突起を含む前記回路層上の少なくともはんだが接触する部分を被覆するニッケルメッキ層と、
前記支持突起によって半導体素子と前記回路層上のニッケルメッキ層の間にできた隙間に充填され、半導体素子を回路層に固定するはんだ層と、を備えたことを特徴とするパワーモジュール。 - 前記支持突起は、前記回路層を塑性変形させることによって一体に形成されていることを特徴とする請求項7〜9のいずれかに記載のパワーモジュール。
- 請求項1または2に記載の構造体の製造方法において、
前記基材に電気部品を載置するための支持突起を一体に形成する工程と、
その支持突起を含む基材上の少なくともはんだが接触する部分にニッケルメッキを施す工程と、
前記支持突起によって電気部品と基材上のニッケルメッキ層の間にできた隙間にはんだを充填する工程と、を含むことを特徴とする構造体の製造方法。 - 請求項3〜6のいずれかに記載のパワーモジュール用基板の製造方法において、
前記回路層に半導体素子を載置するための支持突起を一体に形成する工程と、
その支持突起を含む回路層上の少なくともはんだが接触する部分にニッケルメッキを施す工程と、を含むことを特徴とするパワーモジュール用基板の製造方法。 - 請求項7〜10のいずれかに記載のパワーモジュールの製造方法において、
前記回路層に半導体素子を載置するための支持突起を一体に形成する工程と、
その支持突起を含む回路層上の少なくともはんだが接触する部分にニッケルメッキを施す工程と、
前記支持突起によって半導体素子と回路層上のニッケルメッキ層の間にできた隙間にはんだを充填する工程と、を含むことを特徴とするパワーモジュールの製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004193107A JP4345590B2 (ja) | 2004-06-30 | 2004-06-30 | 構造体と、パワーモジュール基板と、その基板を用いたパワーモジュール、及び、それらの製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004193107A JP4345590B2 (ja) | 2004-06-30 | 2004-06-30 | 構造体と、パワーモジュール基板と、その基板を用いたパワーモジュール、及び、それらの製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2006019346A true JP2006019346A (ja) | 2006-01-19 |
JP4345590B2 JP4345590B2 (ja) | 2009-10-14 |
Family
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2004193107A Expired - Lifetime JP4345590B2 (ja) | 2004-06-30 | 2004-06-30 | 構造体と、パワーモジュール基板と、その基板を用いたパワーモジュール、及び、それらの製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP4345590B2 (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2012059876A (ja) * | 2010-09-08 | 2012-03-22 | Sanken Electric Co Ltd | 半導体モジュール及びその製造方法 |
WO2015144835A1 (de) * | 2014-03-26 | 2015-10-01 | Heraeus Deutschland GmbH & Co. KG | Träger und/oder clip für halbleiterelemente, halbleiterbauelement und verfahren zur herstellung |
JP2020170774A (ja) * | 2019-04-02 | 2020-10-15 | 株式会社デンソー | 半導体モジュール |
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WO2015144835A1 (de) * | 2014-03-26 | 2015-10-01 | Heraeus Deutschland GmbH & Co. KG | Träger und/oder clip für halbleiterelemente, halbleiterbauelement und verfahren zur herstellung |
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JP7156141B2 (ja) | 2019-04-02 | 2022-10-19 | 株式会社デンソー | 半導体モジュール |
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---|---|
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Legal Events
Date | Code | Title | Description |
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A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20070330 |
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|
R150 | Certificate of patent or registration of utility model |
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|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120724 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120724 Year of fee payment: 3 |
|
S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120724 Year of fee payment: 3 |
|
R350 | Written notification of registration of transfer |
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|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120724 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
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