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JP2003271099A - 表示装置および表示装置の駆動方法 - Google Patents

表示装置および表示装置の駆動方法

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JP2003271099A
JP2003271099A JP2002068001A JP2002068001A JP2003271099A JP 2003271099 A JP2003271099 A JP 2003271099A JP 2002068001 A JP2002068001 A JP 2002068001A JP 2002068001 A JP2002068001 A JP 2002068001A JP 2003271099 A JP2003271099 A JP 2003271099A
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light emitting
emitting element
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Semiconductor Energy Laboratory Co Ltd
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Abstract

(57)【要約】 【課題】 時間階調方式を用いた表示装置において、多
階調表示が不要な場合の消費電力の低減を課題とする。 【解決手段】 多階調の第１の表示モードに対して、階
調数を２階調とした第２の表示モードでは、表示装置が
有する信号制御回路のメモリコントローラによって、メ
モリへの下位ビットのデジタルビデオ信号の書き込みを
無くす。また、メモリからの下位ビットのデジタルビデ
オ信号の読み出しを無くす。ソース信号線駆動回路に入
力するデジタル映像信号の情報量を少なくする。この動
作に対応して、デスプレイコントローラは、表示を行う
表示期間を長く設定する。階調を減らすことによって、
第１の表示モードよりフレーム期間を長くすることも可
能になる。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、デジタルビデオ信
号を入力して、画像の表示を行う表示装置に関する。特
に、発光素子を有する表示装置に関する。また、表示装
置を用いた電子機器に関する。
【０００２】
【従来の技術】発光素子を画素毎に配置し、それらの発
光素子の発光を制御することによって、画像を表示を行
う表示装置について以下に説明する。
【０００３】ここで本明細書中では、発光素子は、電界
が生じると発光する有機化合物層を、陽極及び陰極で挟
んだ構造を有する素子（ＯＬＥＤ素子）を示すものとし
て説明を行うが、これに限定されない。
【０００４】また、本明細書中において、発光素子と
は、一重項励起子から基底状態に遷移する際の発光（蛍
光）を利用するものと、三重項励起子から基底状態に遷
移する際の発光（燐光）を利用するものの両方を示すも
のとして説明を行う。
【０００５】有機化合物層としては、正孔注入層、正孔
輸送層、発光層、電子輸送層、電子注入層等が挙げられ
る。発光素子は、基本的に、陽極／発光層／陰極の順に
積み重ねた構造で示されるが、この他に、陽極／正孔注
入層／発光層／電子注入層／陰極の順に積み重ねた構造
や、陽極／正孔注入層／正孔輸送層／発光層／電子輸送
層／電子注入層／陰極の順に積み重ねた構造などがあ
る。
【０００６】表示装置は、ディスプレイと、ディスプレ
イに信号を入力する周辺回路によって構成されている。
【０００７】ディスプレイの構成について、図６にブロ
ック図を示す。
【０００８】図６において、ディスプレイ１００は、ソ
ース信号線駆動回路１１０７と、ゲート信号線駆動回路
１１０８と、画素部１１０９とによって構成されてい
る。画素部は、マトリクス状に画素が配置された構成な
っている。
【０００９】各画素に、薄膜トランジスタ（以下、ＴＦ
Ｔと表記する）が配置されている。ここでは、画素毎に
２つのＴＦＴを配置し、各画素の発光素子の発光を制御
する手法について説明する。
【００１０】図７に、表示装置の画素部の構成を示す。
【００１１】画素部７００には、ソース信号線Ｓ１〜Ｓ
ｘ、ゲート信号線Ｇ１〜Ｇｙ、電源供給線Ｖ１〜Ｖｘが
配置され、ｘ（ｘは自然数）列ｙ（ｙは自然数）行の画
素が配置されている。各画素７０５は、スイッチング用
ＴＦＴ７０１と、駆動用ＴＦＴ７０２と、保持容量７０
３と、発光素子７０４をそれぞれ有している。
【００１２】画素は、ソース信号線Ｓ１〜Ｓｘのうちの
１本Ｓと、ゲート信号線Ｇ１〜Ｇｙのうちの１本Ｇと、
電源供給線Ｖ１〜Ｖｘのうちの１本Ｖと、スイッチング
用ＴＦＴ７０１と、駆動用ＴＦＴ７０２と、保持容量７
０３と、発光素子７０４とによって構成されている。
【００１３】スイッチング用ＴＦＴ７０１のゲート電極
は、ゲート信号線Ｇに接続され、スイッチング用ＴＦＴ
７０１のソース領域とドレイン領域は、一方はソース信
号線Ｓに接続され、もう一方は、駆動用ＴＦＴ７０２の
ゲート電極もしくは、保持容量７０３の一方の電極に接
続されている。駆動用ＴＦＴ７０２のソース領域とドレ
イン領域は、一方は、電源供給線Ｖに接続され、もう一
方は、発光素子７０４の陽極もしくは陰極に接続されて
いる。保持容量７０３の２つの電極のうち、駆動用ＴＦ
Ｔ７０２及びスイッチング用ＴＦＴ７０１に接続されて
いない側は、電源供給線Ｖに接続されている。
【００１４】ここで本明細書中では、駆動用ＴＦＴ７０
２のソース領域もしくはドレイン領域が、発光素子７０
４の陽極と接続されている場合、発光素子７０４の陽極
を画素電極と呼び、陰極を対向電極と呼ぶ。一方、駆動
用ＴＦＴ７０２のソース領域もしくはドレイン領域が、
発光素子７０４の陰極と接続されている場合、発光素子
７０４の陰極を画素電極と呼び、陽極を対向電極と呼
ぶ。
【００１５】また、電源供給線Ｖに与えられる電位を電
源電位といい、対向電極に与えられる電位を対向電位と
呼ぶことにする。
【００１６】スイッチング用ＴＦＴ７０１及び駆動用Ｔ
ＦＴ７０２は、ｐチャネル型ＴＦＴでもｎチャネル型Ｔ
ＦＴでも構わないが、発光素子７０４の画素電極が陽極
の場合、駆動用ＴＦＴ７０２は、ｐチャネル型ＴＦＴが
望ましく、スイッチング用ＴＦＴ８０１は、ｎチャネル
型ＴＦＴが望ましい。一方、画素電極が、陰極の場合、
駆動用ＴＦＴ７０２は、ｎチャネル型ＴＦＴが望まし
く、スイッチング用ＴＦＴ７０１は、ｐチャネル型ＴＦ
Ｔが望ましい。
【００１７】上記構成の画素において、画像を表示する
際の動作を以下に説明する。
【００１８】ゲート信号線Ｇに信号が入力されて、スイ
ッチング用ＴＦＴ７０１のゲート電極の電位が変化し、
ゲート電圧が変化する。こうして導通状態となったスイ
ッチング用ＴＦＴ７０１のソース・ドレイン間を介し
て、ソース信号線Ｓより駆動用ＴＦＴ７０２のゲート電
極に信号が入力される。また、保持容量７０３に信号が
保持される。駆動用ＴＦＴ７０２のゲート電極に入力さ
れた信号によって、駆動用ＴＦＴ７０２のゲート電圧が
変化し、ソース・ドレイン間が導通状態となる。電源供
給線Ｖの電位が、駆動用ＴＦＴ７０２を介して、発光素
子７０４の画素電極に与えられる。こうして、発光素子
７０４は発光する。
【００１９】このような構成の画素において、階調を表
現する手法について説明する。階調の表現の方法には、
大きくわけて、アナログ方式とデジタル方式とがある。
アナログ方式と比べて、デジタル方式は、ＴＦＴのばら
つきに強いと言う点で有利である。ここでは、デジタル
方式の階調表現方法に注目する。デジタル方式の階調表
現方法として、時間階調方式が挙げられる。時間階調方
式の駆動方式について、以下に詳しく説明する。
【００２０】この方式の駆動方法では、表示装置の各画
素が発光する期間を制御することによって、階調を表現
する手法である。１画像を表示する期間を１フレーム期
間とすると、１フレーム期間は、複数のサブフレーム期
間に分割される。
【００２１】サブフレーム期間毎に、点灯もしくは非点
灯とし、つまり、各画素の発光素子を発光させるかさせ
ないして、１フレーム期間あたりに発光素子が発光する
期間を制御し、各画素の階調が表現される。
【００２２】この時間階調方式の駆動方法について、図
５のタイミングチャートを用いて詳しく説明する。な
お、図５においては、４ビットのデジタル映像信号を用
いて階調を表現する場合の例を示す。なお、画素及び画
素部の構成としては、図７に示したものを参照する。こ
こで、対向電位は、外部電源（図示せず）によって、電
源供給線Ｖ１〜Ｖｘの電位（電源電位）と同じ程度の電
位か、電源供給線Ｖ１〜Ｖｘの電位との間に、発光素子
７０４が発光する程度の電位差かを有するように切り換
えることができる。
【００２３】１フレーム期間Ｆは、複数のサブフレーム
期間ＳＦ１〜ＳＦ４に分割される。第１のサブフレーム
期間ＳＦ１において、はじめにゲート信号線Ｇ１が選択
され、ゲート信号線Ｇ１にゲート電極が接続されたスイ
ッチング用ＴＦＴ７０１を有する画素においてそれぞ
れ、ソース信号線Ｓ１〜Ｓｘからデジタル映像信号が入
力される。この入力されたデジタル映像信号によって、
各画素の駆動用ＴＦＴ７０２は、オンの状態もしくはオ
フの状態となる。
【００２４】ここで本明細書中では、ＴＦＴがオンの状
態とは、そのゲート電圧によって、ソース・ドレイン間
が導通状態であることを示すとする。また、ＴＦＴがオ
フの状態とは、そのゲート電圧によって、ソース・ドレ
イン間が、非道通状態であることを示すとする。
【００２５】このとき、発光素子７０４の対向電位は、
電源供給線Ｖ１〜Ｖｘの電位（電源電位）とほぼ等しく
設定されているので、駆動用ＴＦＴ７０２がオンの状態
となった画素においても発光素子７０４は発光しない。
全てのゲート信号線Ｇ１〜Ｇｙについて以上の動作を繰
り返し、書き込み期間Ｔａ１が終了する。なお、第１の
サブフレーム期間ＳＦ１の書き込み期間をＴａ１と呼
ぶ。一般に第ｊ（ｊは自然数）のサブフレーム期間の書
き込み期間をＴａｊと呼ぶことにする。
【００２６】書き込み期間Ｔａ１が終了すると対向電位
が、電源電位との間に発光素子７０４が発光する程度の
電位差を有するように変化する。こうして表示期間Ｔｓ
１が始まる。なお、第１のサブフレーム期間ＳＦ１の表
示期間をＴｓ１と呼ぶ。一般に第ｊ（ｊは自然数）のサ
ブフレーム期間の表示期間をＴｓｊと呼ぶことにする。
表示期間Ｔｓ１において、各画素の発光素子７０４は、
入力された信号に応じて、発光もしくは非発光の状態と
なる。
【００２７】上記動作を全てのサブフレーム期間ＳＦ１
〜ＳＦ４について繰り返し、１フレーム期間Ｆ１が終了
する。ここで、サブフレーム期間ＳＦ１〜ＳＦ４の表示
期間Ｔｓ１〜Ｔｓ４の長さを適宜設定し、１フレーム期
間Ｆあたりで、発光素子７０４が発光したサブフレーム
期間の表示期間の累計によって階調を表現する。つま
り、１フレーム期間中の点灯時間の総和をもって階調を
表現する。
【００２８】一般に、ｎビットのデジタルビデオ信号を
入力して、２n階調を表現する手法について説明する。
このとき、例えば、１フレーム期間をｎ個のサブフレー
ム期間ＳＦ１〜ＳＦｎに分割し、各サブフレーム期間Ｓ
Ｆ１〜ＳＦｎの表示期間Ｔｓ１〜Ｔｓｎの長さの比が、
Ｔｓ１：Ｔｓ２：・・・：Ｔｓｎ−１：Ｔｓｎ＝２0：
２‐1：・・・：２‐n+2：２‐n+1となるように設定す
る。なお、書き込み期間Ｔａ１〜Ｔａｎの長さは同じで
ある。
【００２９】１フレーム期間中に発光素子７０４におい
て、発光状態が選択された表示期間Ｔｓの総和を求める
ことによって、そのフレーム期間におけるその画素の階
調が決まる。例えば、ｎ＝８のとき、全部の表示期間で
画素が発光した場合の輝度を１００％とすると、Ｔｓ８
とＴｓ７において画素が発光した場合には１％の輝度が
表現でき、Ｔｓ６とＴｓ４とＴｓ１を選択した場合には
６０％の輝度が表現できる。
【００３０】
【発明が解決しようとする課題】ここで表示装置は、そ
の消費電力をできるだけ少なくするよう望まれている。
携帯情報機器等に組み込まれ利用される場合、特に消費
電力を小さくすることが望まれている。
【００３１】その場合、上述した４ビットの信号を入力
して、２4の階調を表現する表示装置においては、上位
１ビットの信号のみを用いて階調を表現し、表示装置の
消費電力を小さくする手法が用いられていた。
【００３２】この場合の表示モードにおける表示装置の
駆動方法を示すタイミングチャートを、図９に示す。第
１のサブフレーム期間ＳＦ１において、各画素に信号が
入力される。信号が全ての画素に入力されると、対向電
位が、電源電位との間に発光素子が発光する程度の電位
差を有するように変化する。こうして、各画素の発光素
子は、発光状態もしくは非発光状態となる。この第１の
サブフレーム期間の動作については、前述した表示モー
ドにおける動作と同じである。
【００３３】次に、第２のサブフレーム期間において
も、同様に書き込み期間において、全ての画素にデジタ
ル映像信号が書き込まれるが、その後の表示期間におい
て、対向電極の電位が、電源電位との間に発光素子が発
光する程度の電位差を有するように変化しない。つま
り、第２のサブフレーム期間の表示期間においては、画
素に入力された信号に関わらず、全ての画素の発光素子
は一律に発光しない。この期間を非表示と表記する。
【００３４】上記第２のサブフレーム期間の動作と同様
の動作を、第３のサブフレーム期間及び第４のサブフレ
ーム期間についても繰り返し、１フレーム期間が終了す
る。1フレーム期間のうち、画素が表示を行う期間は、
第１のサブフレーム期間のみである。こうして、画素の
発光素子が発光する回数を減らし、表示装置の消費電力
を少なくすることができる。
【００３５】しかし、このような表示装置では、下位ビ
ットの情報を用いず階調を表現する場合に、上位ビット
に対応するサブフレーム期間以外の期間は、表示装置の
各画素は表示を行わないが、各駆動回路（ソース信号線
駆動回路及びゲート信号線駆動回路）において、デジタ
ル映像信号を各画素に書き込む動作は行われる。このと
き、表示装置の各駆動回路には、スタートパルス、クロ
ックパルス等が入力されて動作し続ける。
【００３６】そのため、少ない情報量で階調表示を行っ
ている場合でも、各駆動回路は、第１の表示モードの駆
動におけるサンプリングの動作と同じだけ、デジタル映
像信号のサンプリング動作を繰り返すことになる。その
ため、サンプリングのために電力が消費され、消費電力
を小さくできないといった問題がある。
【００３７】また、実際に表示を行っているサブフレー
ム期間以外に、表示を行なっていないサブフレーム期間
においては、画素が、一律に発光しない非表示の状態で
あるため、１フレーム期間あたりの有効な表示期間の割
合が少ないといった問題がある。
【００３８】そこで、表現する階調数を減らした駆動を
行う場合に、消費電力が少なく、また、１フレーム期間
あたりの有効な表示期間の占める割合が大きい表示装置
を提供することを課題とする。
【００３９】
【課題を解決するための手段】本発明の表示装置では、
高階調の表示が可能な第１の表示モードと２階調表示で
はあるが低消費電力な第２の表示モードの２つを備え、
それぞれを切り換えて使用することができる。第１の表
示モードに対して、第２の表示モードでは、表示装置が
有する信号制御回路のメモリコントローラによって、メ
モリへの下位ビットのデジタルビデオ信号の書き込みを
無くす。また、メモリからの下位ビットのデジタルビデ
オ信号の読み出しを無くす。こうして、各駆動回路は、
第１の表示モードにおけるデジタル映像信号に対して、
情報量を少なくしたデジタル映像信号をソース信号線駆
動回路に入力する。この動作に対応して、デスプレイコ
ントローラは、各駆動回路（ソース信号線駆動回路及び
ゲート信号先駆動回路）に入力するスタートパルス及び
クロックパルスの周波数を小さく変化させる。これらに
よって、表示に関与する書き込み期間及び表示期間を長
く設定することができる。
【００４０】また、スタートパルス、クロックパルスの
周波数は変えずに表示期間の長さを長くすることも可能
である。さらに、第１の表示モードにくらべて、第２の
表示モードは１フレームの期間自体を長く設定すること
も可能である。また、言うまでもなく、表示内容が確定
し、書き込みが必要ない期間においては、スタートパル
ス、クロックパルスは停止させることが可能である。
【００４１】上記構成によって、第２の表示モードで
は、消費電力が少なく、また、有効な表示期間の占める
割合が大きい表示装置を提供することができる。
【００４２】
【発明の実施の形態】本発明の実施の形態について説明
する。ここでは、第１の表示モードを従来例と同様に４
ビットの例で説明する。
【００４３】本発明の表示装置の駆動方法を示すタイミ
ングチャートを図１に示す。
【００４４】一般に、ｎ（ｎは自然数）ビットのデジタ
ルビデオ信号を入力する表示装置において、第１の表示
モードにおいては、ｎビットのデジタル映像信号を用い
て、ｎ個のサブフレーム期間ＳＦ１〜ＳＦｎによって２
nの階調を表現可能であり、切り換え動作によって、第
２の表示モードにおいては、１ビットのデジタル映像信
号を用いて、２階調を表現する場合についても応用する
ことができる。
【００４５】なお、更に一般的に、ｎ（ｎは自然数）ビ
ットのデジタルビデオ信号を入力する表示装置におい
て、第１の表示モードにおいては、ｎビットのデジタル
映像信号を入力し、ｒ（ｒは自然数）個のサブフレーム
期間を用いてｗ（ｗは、自然数）階調を表現可能であ
り、切り換え動作によって、第２の表示モードにおいて
は、１ビットのデジタル映像信号を用い、２階調を表現
する場合についても応用することができる。ここで、階
調数をサブフレームの２のべき乗にしないのは、表示上
で擬似輪郭などの対策を行なう為である。この内容は特
願２００１−２５７１６３に記載されている。
【００４６】４ビットの信号を入力して、２4階調を表
現する第１の表示モードの場合のタイミングチャートを
図１（Ａ）に示す。
【００４７】1フレーム期間を構成するサブフレーム期
間ＳＦ１〜ＳＦ４のそれぞれの表示期間において、各画
素の発光もしくは非発光状態が選択される。ここで、対
向電位は、書き込み期間中は、電源電位とほぼ同じに設
定され、表示期間においては、電源電位との間に発光素
子が発光する程度の電位差を有するように変化する。こ
の動作については、従来例と同様であるので、詳しい説
明は省略する。
【００４８】図１（Ｂ）に、上位１ビットの信号のみを
用いて階調を表現する第２の表示モードの場合のタイミ
ングチャートを示す。図１（Ａ）に示した第１の表示モ
ードの場合と比較して、書き込み期間及び表示期間が長
く設定されている。
【００４９】そのため、第２の表示モードにおいて、発
光状態が選択された発光素子の輝度は、第１の表示モー
ドにおいて、第１位ビットに対応するサブフレーム期間
の表示期間において発光状態が選択された発光素子の輝
度と比較して、小さくすることができる。よって、第２
の表示モードでは、その表示期間において、発光素子の
陽極と陰極間に印加する電圧を小さく設定することがで
きる。
【００５０】また、図１３に第１の表示モードより第２
の表示モードのフレーム期間を長く設定した例を示す。
時間階調を用いる場合はフレーム期間はあまり長く設定
することはできない。それはフレーム期間を長くすると
それに比例してサブフレーム期間も長くなり、チラツキ
が目に見えるようになるためである。よって、第１の表
示モードはフレーム期間を長くできない。しかし第２の
表示モードは２階調であるので、階調起因のチラツキの
問題は発生しない。よって、フレーム期間を決めるのは
画素での保持時間によってである。ゆえに、画素の容量
を大きくする、リークを減らすなどの方策によって、フ
レーム期間を長くすることが可能になる。フレーム期間
が長くなれば、静止画などでは画面の書き込み回数を削
減できる為、低電力化を図ることができる。
【００５１】図３において、発光素子用電源制御回路３
０５は、発光素子の対向電極の電位（対向電位）を、書
き込み期間中は電源電位とほぼ同じ電位に保たれるよう
にし、表示期間においては電源電位との間に発光素子が
発光する程度の電位差を有するように、制御している。
ここで、発光素子用電源制御回路３０５にも、階調コン
トロール信号３４が入力される。これによって、発光状
態を選択された画素において、発光素子が発光する期間
が長くなった分、発光素子の両電極間にかける電圧が小
さくなるように、発光素子の対向電極の電位を変化させ
る。
【００５２】第２の表示モードにおいて、発光素子の両
電極間に印加する電圧の大きさを小さくすることができ
るので、発光素子の、印加される電圧によるストレスを
少なくすることできる。
【００５３】なお、第１の表示モードと第２の表示モー
ドの２つのモードを切り換える表示装置について示した
が、第１の表示モードと第２の表示モードの他に、更に
細かく、表現する階調の数を変えたモードを設定し、そ
れらの複数の表示モードを切り換えて表示を行う場合
に、適用することができる。
【００５４】ここで、本発明の表示装置のディスプレイ
が有する画素部の構成としては、従来例において、図７
で示した構成の画素を用いることができる。また、それ
以外の公知の構成の画素も、自由に用いることができ
る。
【００５５】また、発明の表示装置のディスプレイが有
するソース信号線駆動回路及びゲート信号線駆動回路に
ついても、公知の構成の回路を自由に用いることができ
る。
【００５６】また、本発明は、発光素子として、ＯＬＥ
Ｄ素子を用いた表示装置だけでなく、ＦＤＰ、ＰＤＰ等
その他の自発光型表示装置などについても適用が可能で
ある。
【００５７】
【実施例】以下に、本発明の実施例について説明する。 （実施例１）
【００５８】時間階調方式の駆動方法を行うための信号
を、ディスプレイのソース信号線駆動回路及びゲート信
号線駆動回路に入力する回路について、図６を用いて説
明する。
【００５９】本明細書中では、表示装置に入力される映
像信号を、デジタルビデオ信号と呼ぶことにする。なお
ここでは、４ビットのデジタルビデオ信号を入力して、
画像を表示する表示装置を例に説明する。ただし、本発
明は４ビットに限定されるものではない。
【００６０】信号制御回路１０１にデジタルビデオ信号
が読み込まれ、ディスプレイ１００にデジタル映像信号
（ＶＤ）を出力する。
【００６１】また、本明細書中では、信号制御回路にお
いてデジタルビデオ信号を編集し、ディスプレイに入力
する信号に変換したものを、デジタル映像信号と呼ぶ。
【００６２】ディスプレイ１００の、ソース信号線駆動
回路１１０７及びゲート信号線駆動回路１１０８を駆動
するための信号は、ディスプレイコントローラ１０２に
よって入力されている。
【００６３】信号制御回路１０１及びディスプレイコン
トローラ１０２の構成について説明する。
【００６４】なお、ディスプレイ１００のソース信号線
駆動回路１１０７は、シフトレジスタ１１１０、ＬＡＴ
（Ａ）１１１１、ＬＡＴ（Ｂ）１１１２によって構成さ
れる。他に、図示していないが、レベルシフタやバッフ
ァ等を設けてもよい。また、本発明はこのような構成に
限定するものではない。
【００６５】信号制御回路１０１は、ＣＰＵ１０４、メ
モリＡ１０５、メモリＢ１１２及びメモリコントローラ
１０３によって構成されている。
【００６６】信号制御回路１０１に入力されたデジタル
ビデオ信号は、メモリコントローラ１０３によって制御
されるスイッチを介してメモリＡ１０５に入力される。
ここで、メモリＡ１０５は、ディスプレイ１００の画素
部１１０９の全画素分の４ビットのデジタルビデオ信号
を、記憶可能な容量を有する。メモリＡ１０５に１フレ
ーム期間分の信号が記憶されると、メモリコントローラ
１０３によって、各ビットの信号が順に読み出され、デ
ジタル映像信号ＶＤとして、ソース信号線駆動回路に入
力される。
【００６７】メモリＡ１０５に記憶された信号の読み出
しが始まると、今度は、メモリＢ１０６にメモリコント
ローラ１０３を介して次のフレーム期間に対応するデジ
タルビデオ信号が入力され、記憶され始める。メモリＢ
１０６もメモリＡ１０５と同様に、表示装置の全画素分
の４ビットのデジタルビデオ信号を記憶可能な容量を有
するとする。
【００６８】このように、信号制御回路１０１は、それ
ぞれ１フレーム期間分ずつの４ビットのデジタルビデオ
信号を記憶することができるメモリＡ１０５及びメモリ
Ｂ１０６を有し、このメモリＡ１０５とメモリＢ１０６
とを交互に用いて、デジタルビデオ信号をサンプリング
する。
【００６９】ここでは、２つのメモリＡ１０５及びメモ
リＢ１０６を、交互に用いて信号を記憶する信号制御回
路１０１について示したが、一般に、複数フレーム分の
情報を記憶することができるメモリを有し、これらのメ
モリを交互に用いることができる。
【００７０】信号制御回路１０１のメモリＡ１０５及び
メモリＢ１０６において、デジタルビデオ信号の入力及
び出力を制御するメモリコントローラ１０３の構成につ
いて、図１１を用いて説明する。
【００７１】上記動作を行う、表示装置のブロック図を
図４に示す。
【００７２】表示装置は、信号線制御回路１０１と、デ
ィスプレイコントローラ１０２と、ディスプレイ１００
とによって構成されている。
【００７３】ディスプレイコントローラ１０２は、ディ
スプレイ１００に、スタートパルスＳＰやクロックパル
スＣＬＫを供給している。
【００７４】信号制御回路１０１は、ＣＰＵ１０４と、
メモリＡ１０５と、メモリＢ１０６と、メモリコントロ
ーラ１０３によって構成されている。
【００７５】図４では、４ビットのデジタルビデオ信号
を入力し、第１の表示モードにおいて、４ビットのデジ
タル映像信号を用いて階調を表現する表示装置を例に示
している。メモリＡ１０５は、デジタルビデオ信号の第
１のビット〜第４のビットの情報をそれぞれ記憶するメ
モリ１０５＿１〜１０５＿４によって構成されている。
同様にメモリＢ１０６も、デジタルビデオ信号の第１の
ビット〜第４のビットの情報をそれぞれ記憶するメモリ
１０６＿１〜１０６＿４によって構成されている。これ
らの各ビットに対応するメモリはそれぞれ、１ビット分
の信号を、１画面を構成する画素数分記憶可能な数の記
憶素子を有している。
【００７６】一般に、ｎビットのデジタル映像信号を用
いて階調を表現することが可能な表示装置において、メ
モリＡは、第１のビット〜第ｎのビットの情報をそれぞ
れ記憶するメモリ１０５＿１〜１０５＿ｎによって構成
される。同様に、メモリＢも、第１のビット〜第ｎのビ
ットの情報をそれぞれ記憶するメモリ１０６＿１〜１０
６＿ｎのよって構成される。これらの各ビットに対応す
るメモリは、それぞれ１ビット分の信号を、１画面を構
成する画素数分記憶可能な容量を有している。
【００７７】メモリコントローラ１０３の構成を、図２
に示す。
【００７８】図２において、メモリコントローラ１０３
は、階調制限回路２０１、メモリＲ／Ｗ回路２０２、基
準発振回路２０３、可変分周回路２０４、ｘカウンタ２
０５ａ、ｙカウンタ２９５ｂ、ｘデコーダ２０６ａ、ｙ
デコーダ２０６ｂによって構成されている。
【００７９】上述したメモリＡ及びメモリＢ等のメモリ
の両方をまとめてメモリと表記する。また、メモリは、
複数の記憶素子によって構成される。それらの記憶素子
は、（ｘ、ｙ）のアドレスによって選択されるものとす
る。
【００８０】ＣＰＵ１０４からの信号が、階調制限回路
２０１を介して、メモリＲ／Ｗ回路２０２に入力され
る。階調制限回路２０１では、第１の表示モードもしく
は第２の表示モードのいずれかに応じて、信号をメモリ
Ｒ／Ｗ回路２０２に入力する。メモリＲ／Ｗ回路２０２
は、階調制限回路２０１の信号に応じて、各ビットに対
応するデジタルビデオ信号それぞれを、メモリに書き込
むかどうかを選択する。同様に、メモリに書き込まれた
デジタル映像信号を読み出す動作を選択する。
【００８１】また、ＣＰＵ１０４からの信号は、基準発
振回路２０３に入力される。基準発振回路２０３からの
信号は、可変分周回路２０４に入力され、適当な周波数
の信号に変換される。ここで、可変分周回路２０４に
は、第１の表示モードもしくは第２の表示モードのいず
れかに応じた階調制限回路２０１からの信号が入力され
ている。この信号によって、可変分周回路２０４からの
信号は、ｘカウンタ２０５ａ及びｘデコーダ２０６ａを
介してメモリのｘアドレスを選択する。同様に、可変分
周回路からの信号は、ｙカウンタ２０５ｂ及びｙデコー
ダ２０６ｂに入力され、メモリｙアドレスを選択する。
【００８２】このような構成のメモリコントローラ１０
３を用いることで、高階調表示が必要ない場合に、信号
制御回路に入力されるデジタルビデオ信号のうち、メモ
リに書き込まれ、またメモリから読み出される信号の情
報量を抑えることができる。また、メモリから信号を読
み出す周波数を変化させることができる。
【００８３】また、ディスプレイコントローラ１０２の
構成について,以下に説明する。
【００８４】図３は、本発明のディスプレイコントロー
ラの構成を示した図である。
【００８５】ディスプレイコントローラ１０２は、基準
クロック発生回路３０１、可変分周回路３０２、水平ク
ロック発生回路３０３、垂直クロック発生回路３０４、
発光素子用電源３０５によって構成されている。
【００８６】ＣＰＵ１０４から入力されるクロック信号
３１は、基準クロック発生回路３０１に入力され、基準
クロックを発生する。この基準クロックは、可変分周回
路３０２を介して、水平クロック発生回路３０３及び垂
直クロック発生回路３０４に入力される。可変分周回路
３０２には、階調コントロール信号３４が入力される。
この信号によって、基準クロックの周波数を変化させ
る。
【００８７】可変分周回路３０２において基準クロック
の周波数を変化させる度合いは、実施者が適宜定めるこ
とができる。
【００８８】また、水平クロック回路３０３には、ＣＰ
Ｕ１０４から水平周期を定める、水平周期信号３２が入
力され、ソース信号線駆動回路用のクロックパルスＳ＿
ＣＬＫ及び、スタートパルスＳ＿ＳＰが出力されてい
る。同様に、垂直クロック発生回路３０４には、ＣＰＵ
１０４から垂直周期を定める垂直周期信号３３が入力さ
れ、ゲート信号線駆動回路用のクロックパルスＧ＿ＣＬ
Ｋ及びスタートパルスＧ＿ＳＰが出力されている。
【００８９】こうして、信号制御回路のメモリコントロ
ーラにおいて、メモリからの下位ビットの信号の読み出
しを無くし、また、メモリからの信号の読み出しの周波
数を小さくする。この動作に対応して、デスプレイコン
トローラは、各駆動回路（ソース信号線駆動回路及びゲ
ート信号先駆動回路）に入力するサンプリングパルスＳ
Ｐ及びクロックパルスＣＬＫの周波数を小さくし、画像
を表現するサブフレーム期間の書き込み期間及び表示期
間を長く設定することができる。
【００９０】例えば、第１の表示モードにおいて、1フ
レーム期間を４つのサブフレーム期間に分割し、それぞ
れのサブフレーム期間の表示期間Ｔｓ１：Ｔｓ２：Ｔｓ
３：Ｔｓ４の比を２0：２-1：２-2：２-3として、４ビ
ットのデジタル映像信号を用いて、２4の階調を表現す
る表示装置を考える。簡単にするために、各サブフレー
ム期間の表示期間Ｔｓ１〜Ｔｓ４の長さを、８、４、
２、１とする。また、各サブフレーム期間の書き込み期
間Ｔａ１〜Ｔａ４の長さを１とする。また、第２の表示
モードにおいて、上位１ビットの信号を用いて階調を表
現する場合を考える。
【００９１】このとき、第２の表示モードにおいて、階
調表現に関与するビットに対応する第１の表示モードに
おけるサブフレーム期間が、１フレーム期間あたりに占
める割合は、９／１９となる。
【００９２】本発明の構成を用いない場合、例えば、従
来例の図９で示したような駆動方法を用いる場合は、第
２の表示モードにおいて、１フレーム期間の内の１０／
９が、表示に関与しない期間となってしまう。
【００９３】一方、本発明は上記構成によって、第２の
表示モードにおいては、ディスプレイの各駆動回路に入
力されるクロック信号等の周波数を変化させ、第１の表
示モードにおける書き込み期間の１９／９倍の長さの書
き込み期間を設定し、同様に表示期間も、第１の表示モ
ードの第１ビットに対応するサブフレーム期間ＳＦ１の
表示期間Ｔｓ１の１９／９倍の長さに設定する。これに
よって、１フレーム期間を、サブフレーム期間ＳＦ１が
占めるようにすることができる。こうして、第２の表示
モードにおいて、１フレーム期間中において表示に関与
しない期間を減らすことができる。
【００９４】こうして、第２の表示モードにおいても、
１フレーム期間あたりの発光素子の表示期間を多くとる
ことができる。
【００９５】前述した信号制御回路１０１、メモリコン
トローラ１０３、ＣＰＵ１０４、メモリ１０５、１０
６、ディスプレイコントローラ１０２は、ディスプレイ
１００と一体化して画素と同一基板上に形成してもよい
し、ＬＳＩチップで形成しディスプレイ１００の基板上
にＣＯＧで貼り付けを行なっても良いし、基板上にＴＡ
Ｂをもちいて貼り付けを行なってもよいし、ディスプレ
イとは別の基板上に形成し、電気配線にて接続を行なっ
ても良い。
【００９６】（実施例２）本実施例では、本発明の表示
装置のソース信号線駆動回路の構成例について説明す
る。ソース信号線駆動回路の構成例を図１５に示す。
【００９７】ソース信号線駆動回路は、シフトレジスタ
１５０１と、走査方向切り換え回路、ＬＡＴ（Ａ）１５
０２及びＬＡＴ（Ｂ）１５０３によって構成されてい
る。なお、図１５では、シフトレジスタ１５０１からの
出力の１つに対応する、ＬＡＴ（Ａ）１５０２の一部と
ＬＡＴ（Ｂ）１５０３の一部のみを図示するが、シフト
レジスタ１５０１からの全ての出力に対して、同様の構
成のＬＡＴ（Ａ）１５０２及びＬＡＴ（Ｂ）１５０３が
対応する。
【００９８】シフトレジスタ１５０１は、クロックドイ
ンバータ、インバータ、ＮＡＮＤによって構成されてい
る。シフトレジスタ１５０７には、ソース信号線駆動回
路用スタートパルスＳ＿ＳＰが入力され、ソース信号線
駆動回路用クロックパルスＳ＿ＣＬＫとその極性が反転
した信号であるソース信号線駆動回路用反転クロックパ
ルスＳ＿ＣＬＫＢによって、クロックドインバータが導
通状態、非導通状態と変化することによって、ＮＡＮＤ
から順に、ＬＡＴ（Ａ）１５０２にサンプリングパルス
を出力する。
【００９９】また、走査方向切り換え回路は、スイッチ
によって構成され、シフトレジスタ１５０１の操作方向
を、図面向かって左右に切り換える働きをする。図１５
では、左右切り換え信号Ｌ／ＲがＬｏの信号に対応する
場合、シフトレジスタ１５０１は、図面向かって左から
右に順にサンプリングパルスを出力する。一方、左右切
り換え信号Ｌ／ＲがＨｉの信号に対応する場合、図面向
かって右から左に順にサンプリングパルスを出力する。
【０１００】各ステージのＬＡＴ（Ａ）１５０２は、ク
ロックドインバータと、インバータによって構成されて
いる。
【０１０１】ここで、各ステージのＬＡＴ（Ａ）１５０
２とは、１本のソース信号線に入力する映像信号を取り
込むＬＡＴ（Ａ）１５０２を示すものとする。
【０１０２】ここでは、実施の形態において説明した信
号制御回路より出力されたデジタル映像信号はＶＤは、
ｐ分割（ｐは自然数）されて入力される。つまり、ｐ本
のソース信号線への出力に対応する信号が並列に入力さ
れる。サンプリングパルスが、バッファを介して、ｐ個
のステージのＬＡＴ（Ａ）１５０２のクロックドインバ
ータに同時に入力されると、ｐ分割された入力信号はｐ
個のステージのＬＡＴ（Ａ）１５０２において、それぞ
れ同時にサンプリングされる。
【０１０３】ここでは、ｘ本のソース信号線に信号電流
を出力するソース信号線駆動回路を例に説明しているの
で、１水平期間あたり、ｘ／ｐ個のサンプリングパルス
が順にシフトレジスタより出力される。各サンプリング
パルスに応じて、ｐ個のステージのＬＡＴ（Ａ）１５０
２は、同時にｐ本のソース信号線への出力に対応するデ
ジタル映像信号をサンプリングする。
【０１０４】本明細書中では、このようにソース信号線
駆動回路に入力するデジタル映像信号を、ｐ相の並列信
号に分割し、ｐ個のデジタル映像信号を１つのサンプリ
ングパルスによって同時に取り込む手法を、ｐ分割駆動
と呼ぶことにする。図１５では４分割を行なっている。
【０１０５】上記分割駆動を行うことによって、ソース
信号線駆動回路のシフトレジスタのサンプリングにマー
ジンを持たせることができる。こうして表示装置の信頼
性を向上させることができる。
【０１０６】各ステージのＬＡＴ（Ａ）１５０２に１水
平期間の信号がすべて入力されると、ラッチパルスＬＳ
及びその極性が反転した、反転ラッチパルスＬＳＢが入
力されて、各ステージのＬＡＴ（Ａ）１５０２に入力さ
れた信号を各ステージのＬＡＴ（Ｂ）１５０３へ一斉に
出力する。
【０１０７】なお、ここで各ステージのＬＡＴ（Ｂ）１
５０３とは、各ステージのＬＡＴ（Ａ）１５０２からの
信号をそれぞれ入力する、ＬＡＴ（Ｂ）回路１５０３の
ことを示すとする。
【０１０８】ＬＡＴ（Ｂ）１５０３の各ステージは、ク
ロックドインバータ及び、インバータによって構成され
ている。ＬＡＴ（Ａ）１５０２の各ステージより出力さ
れた信号は、ＬＡＴ（Ｂ）１５０３に保持されると同時
に、各ソース信号線Ｓ１〜Ｓｘに出力される。
【０１０９】なお、ここでは図示しなかったが、レベル
シフタやバッファ等を適宜設けても良い。
【０１１０】シフタレジスタ１５０１及びＬＡＴ（Ａ）
１５０２、ＬＡＴ（Ｂ）１５０３に入力されるスタート
パルスＳ＿ＳＰ、クロックパルスＳ＿ＣＬＫ等は、発明
の実施の形態で示したディスプレイコントローラから入
力されている。
【０１１１】本発明では、ビット数の少ないデジタル映
像信号を、ソース信号線駆動回路のＬＡＴ（Ａ）に入力
する動作を、信号制御回路によって行い、同時に、ソー
ス信号線駆動回路のシフトレジスタに入力されるクロッ
クパルスＳ＿ＣＬＫや、スタートパルスＳ＿ＳＰ等の周
波数を小さくする動作を、ディスプレイコントローラに
よって行う。
【０１１２】こうして、第２の表示モードにおいて、ソ
ース信号線駆動回路がデジタル映像信号をサンプリング
する動作を少なくして、表示装置の消費電力を抑えるこ
とができる。
【０１１３】なお、本発明の表示装置は、本実施例のソ
ース信号線駆動回路の構成に限らず、公知の構成のソー
ス信号線駆動回路を自由に用いることができる。
【０１１４】（実施例３）本実施例では、本発明の表示
装置のゲート信号線駆動回路の構成例について説明す
る。
【０１１５】ゲート信号線駆動回路は、シフトレジス
タ、走査方向切り換え回路等によって構成されている。
なお、ここでは図示しなかったが、レベルシフタやバッ
ファ等を適宜設けても良い。
【０１１６】シフトレジスタには、スタートパルスＧ＿
ＳＰ、クロックパルスＧ＿ＣＬＫ等が入力されて、ゲー
ト信号線選択信号を出力している。
【０１１７】ゲート信号線駆動回路の構成について、図
１６を用いて説明する。
【０１１８】シフトレジスタ３６０１は、クロックドイ
ンバータ３６０２と３６０３、インバータ３６０４、Ｎ
ＡＮＤ３６０７によって構成されている。シフトレジス
タ２６０１には、スタートパルスＧ＿ＳＰが入力され、
クロックパルスＧ＿ＣＬＫとその極性が反転した信号で
ある反転クロックパルスＧ＿ＣＬＫＢによって、クロッ
クドインバータ３６０２及び３６０３が導通状態、非導
通状態と変化することによって、ＮＡＮＤ３６０７から
順に、サンプリングパルスを出力する。
【０１１９】また、走査方向切り換え回路は、スイッチ
３６０５及びスイッチ３６０６によって構成され、シフ
トレジスタの操作方向を、図面向かって左右に切り換え
る働きをする。図１５では、走査方向切り換え信号Ｕ／
ＤがＬｏの信号に対応する場合、シフトレジスタは、図
面向かって左から右に順に、サンプリングパルスを出力
する。一方、走査方向切り換え信号Ｕ／ＤがＨｉの信号
に対応する場合、図面向かって右から左に順にサンプリ
ングパルスを出力する。
【０１２０】シフトレジスタから出力されたサンプリン
グパルスは、ＮＯＲ３６０８に入力され、イネーブル信
号ＥＮＢと演算される。この演算は、サンプリングパル
スのなまりによって、となり合うゲート信号線が同時に
選択される状況を防ぐために行われる。ＮＯＲ３６０８
から出力された信号は、バッファ３６０９、３６１０を
介して、ゲート信号線Ｇ１〜Ｇｙに出力される。
【０１２１】なお、ここでは図示しなかったが、レベル
シフタやバッファ等を適宜設けても良い。
【０１２２】シフタレジスタに入力されるスタートパル
スＧ＿ＳＰ、クロックパルスＧ＿ＣＬＫ等は、実施の形
態で示したディスプレイコントローラから入力されてい
る。
【０１２３】本発明では、第２の表示モードにおいて、
ゲート信号線駆動回路のシフトレジスタに入力されるク
ロックパルスＧ＿ＣＬＫや、スタートパルスＧ＿ＳＰ等
の周波数を小さくする動作を、ディスプレイコントロー
ラによって行う。
【０１２４】図１６において示したゲート信号先駆動回
路を駆動させる際の動作を、図１８に示す。
【０１２５】こうして、下第２の表示モードにおいて、
ゲート信号線駆動回路のサンプリングの動作を少なく
し、表示装置の消費電力を抑えることができる。
【０１２６】なお、本発明の表示装置は、本実施例のゲ
ート信号線駆動回路の構成に限らず、公知の構成のゲー
ト信号線駆動回路を自由に用いることができる。
【０１２７】本実施例は、実施例１と自由に組み合わせ
て実施することが可能である。
【０１２８】（実施例４）時間階調を用いた表示装置で
は以上に述べてきた、アドレス期間と表示期間を分離す
る方式のほかに、書き込みと表示を同時に行なうような
駆動方法も提案されている。具体的には図８に示すよう
な画素構成を用いたものが、特開２００１−３４３９３
３に開示されている。この方式では従来のスイッチング
ＴＦＴ、駆動ＴＦＴのほかに消去ＴＦＴを追加し、階調
数を向上させることができる。
【０１２９】具体的には、ゲート信号線駆動回路を複数
もうけて、第１の信号線駆動回路で書き込みを行い、全
ラインが書き込み終わる前に第二の信号線駆動回路で消
去を行なうものである。４ビット程度では余り効力はな
いが、階調が６ビット以上になる場合や、擬似輪郭対策
でサブフレームを多く増やさねばならない場合には、非
常に有効な対策である。本発明はこのような駆動方法を
とる表示装置においても適応可能である。図１０にこの
場合のタイミングチャートを示す。図１０では４ビット
目で表示期間を短縮するのに使用している。本実施例は
実施例１〜３と自由に組み合わせることができる。
【０１３０】（実施例５）また、表示できる階調数は少
ないが、実施例４と同様にアドレス期間と表示期間を同
時に行なう方式も提案されている。この場合のタイミン
グチャートを図１１に示す。この場合の画素構成は図７
に示すような従来と同じものである。消去の期間がな
く、アドレス期間より短い表示期間が構成できないた
め、第１の表示モードにおける階調数が少ないという欠
点があるが、回路構成が簡単にできるため、廉価版の表
示装置に適応が可能である。本実施例は実施例１〜３と
自由に組み合わせることができる。
【０１３１】（実施例６）また、以上では時間階調を定
電圧駆動、すなわち、画素中の駆動ＴＦＴを線型領域で
動作させることにより、外部の電源電圧がそのまま発光
素子にかかるように駆動している。しかし、この方式
は、発光素子が劣化し、印加電圧対輝度の特性が変化す
ると、焼きつきになって、表示が悪化すると言う欠点が
ある。そのため、定電流駆動、すなわち、画素中の駆動
ＴＦＴを飽和領域で動作させることにより、駆動ＴＦＴ
を電流源として使う駆動法がある。この場合において
も、駆動ＴＦＴの動作期間を制御することにより、時間
階調は可能である。それについての記述は特願２００１
−２２４４２２に記載されているが、本発明はこのよう
な定電流時間階調についても、適応が可能である。図１
２に示すのは駆動用ＴＦＴの動作点である。定電流駆動
をおこなう場合には動作点２７０５があるような飽和領
域で、低電圧駆動を行なう場合には動作点２７０６があ
るような線型領域で動作をおこなう。 （実施例７）本実施例では、本発明の表示装置を利用し
た電子機器について図１４を用いて説明する。
【０１３２】図１４（Ａ）に本発明の表示装置を用いた
携帯情報端末の模式図を示す。携帯情報端末は、本体２
７０１ａ、操作スイッチ２７０１ｂ、電源スイッチ２７
０１ｃ、アンテナ２７０１ｄ、表示部２７０１ｅ、外部
入力ポート２７０１ｆによって構成されている。本発明
の表示装置は、表示部２７０１ｅに用いることができ
る。
【０１３３】図１４（Ｂ）に本発明の表示装置を用いた
パーソナルコンピュータの模式図を示す。パーソナルコ
ンピュータは、本体２７０２ａ、筐体２７０２ｂ、表示
部２７０２ｃ、操作スイッチ２７０２ｄ、電源スイッチ
２７０２ｅ、外部入力ポート２７０２ｆによって構成さ
れている。本発明の表示装置は、表示部２７０２ｃに用
いることができる。
【０１３４】図１４（Ｃ）に本発明の表示装置を用いた
画像再生装置の模式図を示す。画像再生装置は、本体２
７０３ａ、筐体２７０３ｂ、記録媒体２７０３ｃ、表示
部２７０３ｄ、音声出力部２７０３ｅ、操作スイッチ２
７０３ｆによって構成されている。本発明の表示装置
は、表示部２７０３ｄに用いることができる。
【０１３５】図１４（Ｄ）に本発明の表示装置を用いた
テレビの模式図を示す。テレビは、本体２７０４ａ、筐
体２７０４ｂ、表示部２７０４ｃ、操作スイッチ２７０
４ｄによって構成されている。本発明の表示装置は、表
示部２７０４ｃに用いることができる。
【０１３６】図１４（Ｅ）に本発明の表示装置を用いた
ヘッドマウントディスプレイの模式図を示す。ヘッドマ
ウントディスプレイは、本体２７０５ａ、モニター部２
７０５ｂ、頭部固定バンド２７０５ｃ、表示部２７０５
ｄ、光学系２７０５ｅによって構成されている。本発明
の表示装置は、表示部２７０５ｄに用いることができ
る。
【０１３７】図１４（Ｆ）に本発明の表示装置を用いた
ビデオカメラの模式図を示す。ビデオカメラは、本体２
７０６ａ、筐体２７０６ｂ、接続部２７０６ｃ、受像部
２００６ｄ、接眼部２７０６ｅ、バッテリー２７０６
ｆ、音声入力部２７０６ｇ、表示部２７０６ｈによって
構成されている。本発明の表示装置は、表示部２７０６
ｈに用いることができる。
【０１３８】本発明は、上記応用電子機器に限定され
ず、様々な電子機器に応用することができる。
【０１３９】本実施例は、実施例１〜実施例３と自由に
組み合わせて実施することが可能である。
【０１４０】
【発明の効果】本発明は、上記構成によって、表示装置
の消費電力を抑えることができる。且つ、第２の表示モ
ードにおいて、１フレーム期間あたりの表示期間を長く
とることが可能となり、鮮明な画像表示が可能な表示装
置を提供することが可能となる。
【０１４１】また、１フレーム期間あたりの発光素子の
表示期間を多くとることができるので、１フレームあた
りで同じ明るさを表現する場合、発光素子の陽極と陰極
間に印加する電圧を小さく設定することができる。こう
して、信頼性の高い表示装置を提供することが可能とな
る。
【０１４２】本発明は、発光素子として、ＯＬＥＤ素子
を用いた表示装置だけでなく、ＦＤＰ、ＰＤＰ等その他
の自発光型表示装置などについても適用が可能である。
【図面の簡単な説明】
【図１】 本発明の表示装置の駆動方法を示すタイミ
ングチャートを示す図。
【図２】 本発明の表示装置のメモリコントローラの
構成を示す図。
【図３】 本発明の表示装置のディスプレイコントロ
ーラの構成を示す図。
【図４】 本発明の表示装置の構成を示すブロック
図。
【図５】 時間階調方式の駆動方法を示すタイミング
チャートを示す図。
【図６】 本発明の表示装置の構成を示すブロック
図。
【図７】 表示装置の画素部の構成を示す図。
【図８】 表示装置の画素の構成を示す図。
【図９】 従来の表示装置の駆動方法を示すタイミン
グチャートを示す図。
【図１０】 本発明の表示装置の駆動方法を示すタイミ
ングチャートを示す図。
【図１１】 本発明の表示装置の駆動方法を示すタイミ
ングチャートを示す図。
【図１２】 本発明の駆動ＴＦＴの動作条件を示す図。
【図１３】 本発明の表示装置の駆動方法を示すタイミ
ングチャートを示す図。
【図１４】 本発明の表示装置を用いた電子機器を示す
図。
【図１５】 本発明の表示装置のソース信号線駆動回路
の構成を示す図。
【図１６】 本発明の表示装置のゲート信号線駆動回路
の構成を示す図。
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.7 識別記号 ＦＩ テーマコート゛(参考） Ｇ０９Ｇ 3/20 Ｇ０９Ｇ 3/20 ６３１Ｄ ６４１ ６４１Ｅ ６４１Ｋ Ｈ０４Ｎ 5/68 Ｈ０４Ｎ 5/68 Ｂ

Claims (13)

    【特許請求の範囲】
  1. 【請求項１】ディスプレイと、ディスプレイコントロー
    ラとを有する表示装置において、 １フレーム期間を複数のサブフレーム期間に分割し、 前記サブフレーム期間を、点灯もしくは非点灯とし、前
    記１フレーム期間中の点灯時間の総和をもって階調を表
    現する第１の手段とフレーム期間中にサブフレーム分割
    をしない第２の手段を有し、それらの手段を前記ディス
    プレイコントローラで制御することを特徴とした表示装
    置。
  2. 【請求項２】ディスプレイと、ディスプレイコントロー
    ラとを有する表示装置において１フレーム期間を複数の
    サブフレーム期間に分割し、 前記サブフレーム期間を、点灯もしくは非点灯とし、前
    記１フレーム期間中の点灯時間の総和をもって階調を表
    現する第１の手段と、 フレーム期間をサブフレーム分割せず、且つ、前記第１
    の表示モードより長いフレーム期間を有する第２の手段
    を有することを特徴とした表示装置。
  3. 【請求項３】請求項１乃至請求項２のいずれか一項にお
    いて、前記表示装置はフレームメモリを有し、第１の手
    段ではｎ（ｎは２以上の自然数）ビットのデータを書き
    込み、読み出すことにより表示を行い、第２の手段では
    １ビットのデータを書き込み、読み出すことにより表示
    を行なうことを特徴とした表示装置。
  4. 【請求項４】請求項１乃至請求項３のいずれか一項にお
    いて、表示装置は画素毎に発光素子を有し、前記発光素
    子には特定の電圧が印加され、前記第１の手段において
    発光素子に加えられる電圧は、前記第２の手段において
    発光素子に印加電圧される電圧より高いことを特徴とす
    る表示装置。
  5. 【請求項５】請求項１乃至請求項３のいずれか一項にお
    いて、表示装置は画素毎に発光素子を有し、前記発光素
    子には特定の電流が印加され、前記第１の手段において
    発光素子に加えられる電流は、前記第２の手段において
    発光素子に印加電圧される電流より大きいことを特徴と
    する表示装置。
  6. 【請求項６】請求項１乃至請求項５のいずれか１項にお
    いて、第１の手段は、フレーム期間を書き込み期間、表
    示期間、消去期間の３期間から構成することを特徴とし
    た表示装置。
  7. 【請求項７】ディスプレイと、ディスプレイコントロー
    ラとを有する表示装置の駆動方法において、 １フレーム期間を複数のサブフレーム期間に分割し、 前記サブフレーム期間を、点灯もしくは非点灯とし、前
    記１フレーム期間中の点灯時間の総和をもって階調を表
    現する第１の表示モードとフレーム期間中にサブフレー
    ム分割をしない第２の表示モードを有し、それらの表示
    モードを前記ディスプレイコントローラで制御すること
    を特徴とした表示装置の駆動方法。
  8. 【請求項８】ディスプレイと、ディスプレイコントロー
    ラとを有する表示装置の駆動方法において、 １フレーム期間を複数のサブフレーム期間に分割し、 前記サブフレーム期間を、点灯もしくは非点灯とし、前
    記１フレーム期間中の点灯時間の総和をもって階調を表
    現する第１の表示モードと、 フレーム期間をサブフレーム分割せず、且つ、前記第１
    の表示モードより長いフレーム期間を有する第２の表示
    モードを有することを特徴とした表示装置の駆動方法。
  9. 【請求項９】請求項１乃至請求項２のいずれか一項にお
    いて、前記表示装置はフレームメモリを有し、第１の表
    示モードではｎ（ｎは２以上の自然数）ビットのデータ
    を書き込み、読み出すことにより表示を行い、第２の表
    示モードでは１ビットのデータを書き込み、読み出すこ
    とにより表示を行なうことを特徴とした表示装置の駆動
    方法。
  10. 【請求項１０】請求項１乃至請求項３のいずれか一項に
    おいて、表示装置は画素毎に発光素子を有し、前記発光
    素子には特定の電圧が印加され、前記第１の表示モード
    において発光素子に加えられる電圧は、前記第２の表示
    モードにおいて発光素子に印加電圧される電圧より高い
    ことを特徴とする表示装置の駆動方法。
  11. 【請求項１１】請求項１乃至請求項３のいずれか一項に
    おいて、表示装置は画素毎に発光素子を有し、前記発光
    素子には特定の電流が印加され、前記第１の表示モード
    において発光素子に加えられる電流は、前記第２の表示
    モードにおいて発光素子に印加電圧される電流より大き
    いことを特徴とする表示装置の駆動方法。
  12. 【請求項１２】請求項１乃至請求項５のいずれか１項に
    おいて、第１の表示モードは、書き込み期間、表示期
    間、消去期間の３期間からなることを特徴とした表示装
    置の駆動方法。
  13. 【請求項１３】請求項１乃至請求項１２のいずれか一項
    において、それらを使用した電子機器。
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