DE69728205T2 - Herstellungsverfahren von Verbindungen in einer integrierten Schaltung - Google Patents
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- 238000004519 manufacturing process Methods 0.000 title description 5
- 239000010410 layer Substances 0.000 claims description 68
- 239000011229 interlayer Substances 0.000 claims description 22
- 239000000463 material Substances 0.000 claims description 20
- 238000000034 method Methods 0.000 claims description 19
- 229910003437 indium oxide Inorganic materials 0.000 claims description 16
- PJXISJQVUVHSOJ-UHFFFAOYSA-N indium(iii) oxide Chemical compound [O-2].[O-2].[O-2].[In+3].[In+3] PJXISJQVUVHSOJ-UHFFFAOYSA-N 0.000 claims description 16
- 239000000758 substrate Substances 0.000 claims description 14
- 239000004065 semiconductor Substances 0.000 claims description 12
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 claims description 10
- 239000001301 oxygen Substances 0.000 claims description 10
- 229910052760 oxygen Inorganic materials 0.000 claims description 10
- 238000002161 passivation Methods 0.000 claims description 9
- 238000005530 etching Methods 0.000 claims description 8
- 238000007540 photo-reduction reaction Methods 0.000 claims description 8
- CBENFWSGALASAD-UHFFFAOYSA-N Ozone Chemical compound [O-][O+]=O CBENFWSGALASAD-UHFFFAOYSA-N 0.000 claims description 6
- 239000004020 conductor Substances 0.000 claims description 5
- 230000003647 oxidation Effects 0.000 claims description 5
- 238000007254 oxidation reaction Methods 0.000 claims description 5
- 230000001590 oxidative effect Effects 0.000 claims description 4
- 238000011065 in-situ storage Methods 0.000 claims description 2
- 239000012212 insulator Substances 0.000 description 9
- 238000001020 plasma etching Methods 0.000 description 7
- 229910000765 intermetallic Inorganic materials 0.000 description 3
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 description 2
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 2
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 description 2
- XLOMVQKBTHCTTD-UHFFFAOYSA-N Zinc monoxide Chemical compound [Zn]=O XLOMVQKBTHCTTD-UHFFFAOYSA-N 0.000 description 2
- 229910052782 aluminium Inorganic materials 0.000 description 2
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 2
- 238000000151 deposition Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 239000007769 metal material Substances 0.000 description 2
- 239000000203 mixture Substances 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- 230000003071 parasitic effect Effects 0.000 description 2
- 230000002441 reversible effect Effects 0.000 description 2
- 229910052719 titanium Inorganic materials 0.000 description 2
- 239000010936 titanium Substances 0.000 description 2
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 2
- 229910052721 tungsten Inorganic materials 0.000 description 2
- 239000010937 tungsten Substances 0.000 description 2
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 1
- LVDRREOUMKACNJ-BKMJKUGQSA-N N-[(2R,3S)-2-(4-chlorophenyl)-1-(1,4-dimethyl-2-oxoquinolin-7-yl)-6-oxopiperidin-3-yl]-2-methylpropane-1-sulfonamide Chemical compound CC(C)CS(=O)(=O)N[C@H]1CCC(=O)N([C@@H]1c1ccc(Cl)cc1)c1ccc2c(C)cc(=O)n(C)c2c1 LVDRREOUMKACNJ-BKMJKUGQSA-N 0.000 description 1
- 229910052581 Si3N4 Inorganic materials 0.000 description 1
- 229910004298 SiO 2 Inorganic materials 0.000 description 1
- GWEVSGVZZGPLCZ-UHFFFAOYSA-N Titan oxide Chemical compound O=[Ti]=O GWEVSGVZZGPLCZ-UHFFFAOYSA-N 0.000 description 1
- 238000009825 accumulation Methods 0.000 description 1
- 229910045601 alloy Inorganic materials 0.000 description 1
- 239000000956 alloy Substances 0.000 description 1
- 238000013459 approach Methods 0.000 description 1
- 229910052786 argon Inorganic materials 0.000 description 1
- 238000010420 art technique Methods 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
- 150000001875 compounds Chemical class 0.000 description 1
- 229910052802 copper Inorganic materials 0.000 description 1
- 239000010949 copper Substances 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 239000007789 gas Substances 0.000 description 1
- 229910052738 indium Inorganic materials 0.000 description 1
- APFVFJFRJDLVQX-UHFFFAOYSA-N indium atom Chemical compound [In] APFVFJFRJDLVQX-UHFFFAOYSA-N 0.000 description 1
- 238000001755 magnetron sputter deposition Methods 0.000 description 1
- 229910052751 metal Inorganic materials 0.000 description 1
- 239000002184 metal Substances 0.000 description 1
- 150000002739 metals Chemical class 0.000 description 1
- 235000012239 silicon dioxide Nutrition 0.000 description 1
- 239000000377 silicon dioxide Substances 0.000 description 1
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 1
- OGIDPMRJRNCKJF-UHFFFAOYSA-N titanium oxide Inorganic materials [Ti]=O OGIDPMRJRNCKJF-UHFFFAOYSA-N 0.000 description 1
- 230000003313 weakening effect Effects 0.000 description 1
- 239000011787 zinc oxide Substances 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3205—Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
- H01L21/321—After treatment
- H01L21/3213—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer
- H01L21/32133—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only
- H01L21/32135—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by vapour etching only
- H01L21/32136—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by vapour etching only using plasmas
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
- H01L21/76822—Modification of the material of dielectric layers, e.g. grading, after-treatment to improve the stability of the layers, to increase their density etc.
- H01L21/76823—Modification of the material of dielectric layers, e.g. grading, after-treatment to improve the stability of the layers, to increase their density etc. transforming an insulating layer into a conductive layer
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
- H01L21/76829—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing characterised by the formation of thin functional dielectric layers, e.g. dielectric etch-stop, barrier, capping or liner layers
- H01L21/76834—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing characterised by the formation of thin functional dielectric layers, e.g. dielectric etch-stop, barrier, capping or liner layers formation of thin insulating films on the sidewalls or on top of conductors
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
- H01L23/522—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body
- H01L23/532—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body characterised by the materials
- H01L23/5329—Insulating materials
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
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Description
- Die Erfindung betrifft Verfahren zum Herstellen von integrierten Schaltungen, insbesondere Ätzschritte, die zum Ausbilden metallischer Verbindungen notwendig sind.
- Bei bisherigen Techniken zum Herstellen von integrierten Schaltkreisen müssen vertikale Verbindungen zu Halbleiterbauteilen innerhalb des integrierten Schaltkreises hergestellt werden. Diese werden üblicherweise erzeugt, indem die Halbleiterbauteile mit einer dielektrischen Zwischenschicht bedeckt werden, beispielsweise eine Siliziumdioxid (SiO2)-Schicht, und indem durch diese dielektrische Schicht enge vertikale Löcher geätzt werden, um Abschnitte des darunterliegenden Bauteils freizulegen. Diese Löcher werden mit einem leitenden Material, beispielsweise Wolfram, Aluminium oder Titan, gefüllt, um Kontakte auszubilden, wobei auf die so erzeugte Oberfläche eine Verbindungsschicht aufgebracht wird. Die Verbindungsschicht steht in elektrischem Kontakt mit dem Halbleiterbauteil und kann durch Ätzen gerastert werden, um Zwischenverbindungsleitungen zu definieren.
- Verschiedene leitende Schichten, die aus metallischem Material bestehen, beispielsweise Wolfram, Kupfer, Aluminium, Titan, oder Legierungen solcher Metalle, werden oft verwendet. Um diese Schichten aneinander zu fügen, werden vertikale Verbindungen (Durchkontaktierungen, vias) verwendet.
- Die
1 zeigt einen Querschnitt eines teilweise fertiggestellten integrierten Schaltkreises. Ein Halbleitersubstrat10 mit einem ersten Leitungstyp enthält Sourcebereiche15 und Drainbereiche20 mit einem zweiten Leitungstyp, der dem ersten entgegengesetzt ist. Es können neben den Sourcebereichen15 und den Drainbereichen20 leicht dotierte Drain-(LDD) Abschnitte vorgesehen werden. Zwischen der Source15 und dem Drain20 liegt auf der Halbleiteroberfläche ein Transistorgate-Isolator30 . Eine Gateelektrode35 liegt über dem Gateisolator30 . Diese Merkmale bilden einen üblichen MOS-Transistor37 . Auf der Struktur wurde eine erste dielektrische Zwischenschicht40 abgeschieden. Kontaktlöcher45 ,50 ,55 wurden durch die dielektrische Schicht50 jeweils oberhalb des Drainbereichs20 , des Gatebereichs35 und des Sourcebereichs15 geätzt. Die Kontaktlöcher werden in einem beliebigen geeigneten Prozess mit einem leitenden Material60 gefüllt. Eine erste Verbindungsschicht64 wurde ab geschieden und mit einem Ätzschritt gerastert, um die Zwischenverbindungsleitungen67 ,70 ,75 auszubilden, die jeweils mit dem Drainbereich20 , dem Gatebereich35 und dem Sourcebereich15 in elektrischem Kontakt stehen. - Die Kontaktlöcher
45 ,50 ,55 und die Leitungen67 ,70 ,75 werden üblicherweise durch Plasmaätzen ausgebildet, beispielsweise durch reaktives Ionenätzen (reactive ion etching, RIE). Während solcher Ätzschritte bilden sich auf dem metallischen Teil der Struktur erhebliche elektrische Ladungen. Wenn eine lange Leitung ausgebildet wurde, bewirkt ihre gesamte Länge das Ansammeln von Ladung. In einem komplexen integrierten Schaltkreis kann eine einzelne Leitung eine Länge von mehreren Metern erreichen. - Jede Ladung, die auf den Leitungen
67 ,75 ausgebildet ist, kann durch den Diodenübergang abgeleitet werden, der jeweils durch ein Substrat10 und durch den Drainbereich20 oder Sourcebereich15 ausgebildet ist. Abhängig von der Polarität der Ladung und den Leitungstypen der Source, des Drains und des Substrats, kann diese Ableitung entweder aufgrund von Leitung durch Vorspannung in Durchlassrichtung des Diodenübergangs oder aufgrund eines Leckstrom durch Vorspannung in Sperrichtung der gleichen Diode geschehen. Der Leitungsfluß ist in der Figur durch die Pfeile77 dargestellt. - Für Ladung, die sich auf der Leitung
70 gebildet hat, steht kein solcher Entladeweg zur Verfügung. Die Leitung ist von dem Substrat10 durch den Gateisolator30 isoliert. Es bildet sich eine Ladung, die in der Figur um das Gate35 , um den Kontakt60 und um die Leitung70 mit „+"-Zeichen dargestellt ist, wobei die Ladung auch die andere Polarität haben könnte. Durch diese Ladung liegt an dem Gateisolator30 eine hohe Spannung, wodurch der Gateisolator belastet und geschwächt wird. Eine solche Schwächung verringert die Lebensdauer und die Überspannungsfestigkeit des fertiggestellten integrierten Schaltkreises. - Es wurde vorgeschlagen, parallel zu dem Gateisolator
33 eine Diode anzuschließen, um für die Ladung einen Leckstromweg zu dem Substrat hin vorzusehen. Dies verursacht jedoch einen Leckstrom während des Betriebs des integrierten Schaltkreises. - Im Hinblick auf das Vorangegangene ist es eine Aufgabe der vorliegenden Erfindung, ein Verfahren zum Herstellen von Kontakten in integrierten Schaltkreisen vorzusehen, welches verhindert, das sich Ladung auf den Leitungen des Schaltkreises bildet.
- Eine weitere Aufgabe der vorliegenden Erfindung ist es, ein solches Verfahren vorzusehen, das keine parasitären Leckströme verursacht, die während des Betriebs eines fertiggestellten integrierten Schaltkreises von dem Gate abfließen.
- Eine weitere Aufgabe der vorliegenden Erfindung ist es, ein solches Verfahren vorzusehen, das die Herstellungszeit für die integrierten Schaltkreise nicht wesentlich verlängert.
- Dementsprechend sieht die Erfindung ein Verfahren zum Erzeugen von Leitungen und Kontakten in einem integrierten Schaltkreis vor, das die Schritte umfaßt: Ausbilden einer isolierten Gatekomponente auf einem Halbleitersubstrat, Auftragen einer dielektrischen Schicht, die zumindest teilweise aus fotoreduzierbarem Material besteht, um die Komponente zu überdecken, Ätzen von Löchern in die dielektrische Schicht, um Abschnitte der Komponente freizulegen, Füllen der Löcher mit einem leitenden Material, um Kontaktanschlüsse auszubilden, Photoreduzieren zumindest eines oberen Abschnitts der dielektrischen Zwischenschicht bevor die Verbindungsschicht abgelagert wird, um ihre Leitfähigkeit entsprechend zu erhöhen, Überdecken der resultierenden Struktur mit einer Verbindungsschicht, Ätzen der Verbindungsschicht, um die Leitungen zu definieren, wobei die Leitungen im elektrischen Kontakt zu den Kontaktanschlüssen stehen, und Oxidieren der dielektrischen Zwischenschicht, um ihre Leitfähigkeit zu verringern.
- In einer Ausführung der Erfindung werden weitere Schichten von Kontaktanschlüssen und Verbindungsleitungen ausgebildet.
- Eine Ausführung der Erfindung umfaßt den Schritt des Aufbringens einer Passivierungsschicht auf eine obere Oberfläche des integrierten Schaltkreises, wobei die Passivierungsschicht aus einem Material zusammengesetzt ist, das gegenüber Licht mit einer entsprechenden Wellenlänge undurchlässig ist, um eine versehentliche Photoreduktion der dielektrischen Schichten zu verhindern.
- In einer Ausführung der Erfindung ist das photoreduzierbare Material Indiumoxid und der photoreduzierende Schritt umfaßt das Aussetzen des Zwischendielektrikums gegenüber Licht mit einer Wellenlänge, die kleiner als 35 μm ist.
- In einer Ausführung der Erfindung umfaßt der Schritt des Oxidierens das Aussetzen der dielektrischen Schicht an eine Atmosphäre, die Ozon enthält.
- In einer Ausführung der Erfindung wird das Ozon in situ erzeugt, indem Sauerstoff ultraviolettem Licht ausgesetzt wird.
- Die vorliegende Erfindung umfaßt ferner eine integrierte Schaltkreisstruktur mit einem Halbleitersubstrat, einer dielektrischen Zwischenschicht, die auf dem Substrat angeordnet ist, Kontaktanschlüssen, die durch die dielektrische Schicht hindurch vorgesehen sind, und Leitungen, die in elektrischem Kontakt mit den Kontaktanschlüssen sind, wobei die dielektrische Zwischenschicht ein photoreduzierbares Material in einem Zustand niedriger Leitfähigkeit umfaßt.
- In einer Ausführung der Erfindung sind weitere dielektrische Zwischenschichten vorgesehen, die jeweils Kontaktanschlüsse haben, die durch die Zwischenschichten hindurchführen, und die jeweils mit Leitungen versehen, welche in elektrischem Kontakt mit den Kontaktanschlüssen stehen. Zumindest einige der dielektrischen Zwischenschichten umfassen ein photoreduzierbares Material in einem Zustand niedriger Leitfähigkeit.
- In einer Ausführung der Erfindung ist eine Oberflächen-Passiverungsschicht vorgesehen, die gegenüber Licht mit der entsprechenden Wellenlänge undurchlässig ist, wodurch eine versehentliche Photoreduktion des Materials der dielektrischen Schichten verhindert wird.
- Eine Ausführung der vorliegenden Erfindung wird mit Bezug auf die beigefügten Zeichnungen beispielhaft beschrieben, wobei die Figuren im einzelnen zeigen:
- die
1 zeigt einen Querschnitt einer teilweise fertiggestellten Struktur eines integrierten Halbleiterschaltkreises; - die
2 zeigt die Struktur von1 , welche gemäß der Erfindung modifiziert ist; und - die
3 zeigt einen Querschnitt eines fertiggestellten integrierten Halbleiterschaltkreises gemäß der Erfindung. - Es ist bekannt, daß bestimmte Materialien, beispielsweise Indiumoxid, durch einen Photoreduktionsprozeß leitend gemacht werden können. Diese Materialien können wieder nichtleitend gemacht werden, indem ein entsprechender Oxidationsschritt durchgeführt wird.
- Stöchiometrisches Indiumoxid, In2O3, ist ein Isolator; jedoch erzeugt eine Photoreduktion Sauerstofflücken und überführt das Indiumoxid in eine nichtstöchiometrische Form, InOX (X < 1,5), welche eine hohe Leitfähigkeit aufweist.
- Eine Indiumoxidschicht kann auf einem Substrat durch Gleichstrom-Sputtern mittels eines Magetrons (DC magnetron sputtering) erzeugt werden, wobei ein Indiumtarget in einem Argon/Sauerstoffplasma verwendet wird, welches das Substrat enthält, wobei es eine Reihe anderer möglicher Techniken gibt. Eine solche Schicht kann sich entweder in einer amorphen oder in einer mikrokristallinen Struktur ausbilden. Bei der Verwendung von ausreichend Sauerstoff wird diese Schicht typischerweise mit einer Leitfähigkeit von ungefähr 0,1 bis 1 S/m abgeschieden. Durch das Aussetzen dieser Schicht gegenüber einer Lichtquelle mit einer geeigneten Wellenlänge in einer inerten Atmosphäre findet eine Photoreduktion statt. Für Indiumoxid wird die Wirkung mit ultraviolettem Licht bei einer Wellenlänge kleiner als 35 μm erzielt. Die Leitfähigkeit der Schicht steigt auf ungefähr 100 bis 1000 S/m, die mit der Leitfähigkeit eines metallischen Materials vergleichbar ist. Wenn ein verringerter Anteil an Sauerstoff verwendet wird, kann die Schicht in ihrer reduzierten Form abgeschieden werden, da naturgemäß Sauerstoffleerstellen vorliegen. Wird die Schicht dann einer oxidierenden Atmosphäre ausgesetzt, verringert sich die Leitfähigkeit auf ein niedriges Niveau, typischerweise auf das von stöchiometrischem In2O3, das heißt ungefähr 10–3 S/m.
- Eine solche Oxidation kann beispielsweise in einer Umgebung durchgeführt werden, die Ozon enthält, indem ein Sauerstoff-Partialdruck von 8 kPa (600 torr) in eine Reaktionskammer eingeführt wird, die das Substrat enthält, und indem die Kammer mit einer Quelle für ultraviolettes Licht beleuchtet wird, die oben beschrieben wurde. Während eines solchen Schritts muß die Indiumoxidschicht davor geschützt sein, daß sie direkt ultraviolettem Licht ausgesetzt wird. Es findet eine Oxidation statt, wodurch die Sauerstoffleerstellen gefüllt werden, und die Indiumoxidschicht nähert sich ihrer stöchiometrischen Zusammensetzung In2O3 und einer Leitfähigkeit von 10–3 S/m an.
- Diese Effekte sind vollständig reversibel; es können betragsmäßige Änderungen der Leitfähigkeit von mindestens sechs Größenordnungen erreicht werden. Kristallines Indiumoxid weist eine höhere Leitfähigkeit auf, jedoch ist die geringste Leitfähigkeit, die mit diesem Material erreicht werden kann, hinsichtlich des Betrags um zwei Größenordnungen größer als die Leitfähigkeit von amorphem oder kristallinem Indiumoxid.
- Die
2 zeigt einen Querschnitt eines teilweise fertiggestellten integrierten Schaltkreises, der ein erfindungsgemäßes Verfahren ausführt. Die Transistorstruktur37 ist wie in der1 definiert. Gemäß eines Aspekts der Erfindung wurde eine dielektrische Zwischenschicht80 abgeschieden, die aus einem photoreduzierbarem Material, beispielsweise Indiumoxid, entsteht. Kontaktlöcher45 ,50 ,55 wurden ausgeschnitten und mit einer geeigneten metallischen Verbindung60 füllt, um Anschlußkontakte auszubilden. - Gemäß der Erfindung wird diese dielektrische Zwischenschicht
80 durch Aussetzen gegenüber Licht photoreduziert, das geeignet ist, zumindest die obere Oberfläche der dielektrischen Zwischenschicht zu verändern. Wenn die Schicht80 aus Indiumoxid besteht, kann ultraviolettes Licht mit einer Wellenlänge von weniger als 35 μm und einer Intensität von 4 W/m2 verwendet werden. Nach einem solchen Aussetzen ist zumindest der obere Abschnitt85 der dielektrischen Zwischenschicht80 leitend. Daraufhin wird die Verbindungsschicht64 über der dielektrischen Zwischenschicht80 ausgebildet. - Wenn ein Plasma-Ätzschritt (RIE) durchgeführt wird, um die Leitungen
67 ,70 ,75 zu definieren, wird jegliche Ladung, die sich auf der Gateelektrode35 und der Leitung70 bilden kann, durch den oberen leitenden Abschnitt85 der dielektrischen Zwischenschicht80 an die Source-Drainkontakte55 ,45 geleitet. Diese Leitung ist in der Figur durch die Pfeile90 dargestellt. Die Source- und Drainkontakte entladen die angesammelte Ladung mittels Leitung77 über die Source- und Drainübergänge, wie oben erörtert wurde. Daher bildet sich auf der Gateelektrode35 keine Ladung, und es besteht kein Risiko einer Beschädigung des Gateisolators30 . - Nachdem der Plasma-Ätzschritt vollständig durchgeführt wurde, wird die Struktur einer oxidierenden Umgebung ausgesetzt, um die dielektrische Zwischenschicht
80 in ihrer gesamten Dicke wieder nichtleitend zu machen. Wie oben behandelt, kann dies erreicht werden, indem die Struktur einer Atmosphäre ausgesetzt wird, die Sauerstoff enthält, und indem diese mit einer ultravioletten Quelle, wie bereits beschrieben, so lange beleuchtet wird, bis die Struktur selbst von dem ultraviolettem Licht abgeschirmt ist. Dieser Schritt kann in der gleichen Kammer wie der Schritt des Plasmaätzens durchgeführt werden. - Die
3 zeigt einen Querschnitt eines gemäß dem erfindungsgemäßen Verfahren fertiggestellten integrierten Schaltkreises. Es sind drei Verbindungsschichten vorgesehen, obwohl auch mehr möglich sind. Zwischen der ersten Verbindungsschicht64 und der zweiten Verbindungsschicht92 ist eine zweite dielektrische Zwischenschicht97 ausgebildet. Gemäß der Erfindung besteht diese dielektrische Schicht zumindest teilweise aus einem photoreduzierbarem Material, beispielsweise Indiumoxid. - In die dielektrische Schicht
97 werden oberhalb der Leitungen67 ,70 ,75 der ersten Verbindungsschicht64 Kontaktlöcher100 geätzt. Diese Löcher werden mit einer metallischen Verbindung104 gefüllt, um Verbindungs-Durchkontaktierungen auszubilden. - Die Struktur wird einer Photoreduktion unterworfen, indem sie einer ultravioletten Lichtquelle in einer inerten Atmosphäre ausgesetzt wird, um einen oberen Abschnitt
110 der zweiten dielektrischen Zwischenschicht97 leitend zu machen. Wie oben anhand des oberen Abschnitts85 der dielektrischen Zwischenschicht80 erörtert, erlaubt diese Leitfähigkeit, daß sämtliche Ladungen, die sich auf der Gateelektrode35 ,70 gebildet haben, durch den oberen Abschnitt110 an die Source- und Drainkontakte45 ,55 geleitet werden, so daß der Gateisolator30 keine Schäden erleidet. Diese Leitung ist in der Figur durch die Pfeile113 dargestellt. - Die Struktur wird dann einer Oxidation unterworfen, beispielsweise indem sie einer Atmosphäre ausgesetzt wird, die Ozon enthält, wie bereits beschrieben, um die dielektrische Schicht
97 über ihre gesamte Dicke nichtleitend zu machen. Dies kann in gleicher Weise für eine dritte dielektrische Zwischenschicht115 , Kontaktlöcher120 eine metallische Verbindung125 , einen leitenden oberen Abschnitt130 eine dielektrischen Schicht115 , eine Leitungsschicht135 und für eine dritte Verbindungsschicht95 wiederholt werden. - Am Ende der Behandlung wird über die gesamte Oberfläche des fertiggestellten integrierten Schaltkreises eine Passivierungsschicht
110 aufgebracht. Gemäß eines Aspekts der Erfindung besteht die Passivierungsschicht aus einem Material, das gegenüber jeglichem Licht undurchlässig ist, welches die dielektrische Schichten115 ,97 ,80 leitend machen würde. Dadurch wird vermieden, das die dielektrische Schicht unbeabsichtigt aufgrund von einfallendem ultraviolettem Licht leitend wird. Für eine Ausführung, in der als Dielektrikum Indiumoxid und ultraviolettes Licht mit einer Wellenlänge unterhalb von 35 μm verwendet wird, ist Siliziumnitrid ein geeignetes Passivierungsmaterial. - Die folgende Erfindung erfüllt daher ihre Aufgaben, indem verhindert wird, daß während der Herstellung des integrierten Schaltkreises auf Leitungen des Schaltkreises Ladungen ausgebildet werden; während des Betriebs des fertiggestellten integrierten Schaltkreises fließt kein parasitärer Leckstrom, da das Dielektrikum wieder in einen nichtleitenden Zustand zurückgebracht wird, bevor der Schaltkreis fertiggestellt wird; es werden durch das erfindungsgemäße Verfahren keine langwierigen Prozessschritte hinzugefügt. Tatsächlich wird dem normalen Prozeßfluß nur ein Gasmischungsvorgang und zwei sehr kurze Schritte des Aussetzens gegenüber Licht hinzugefügt. Das Abscheiden der photoreduzierbaren dielektrischen Schichten der Erfindung tritt an die Stelle des Abscheidens einer dielektrischen Schicht
40 , wie sie in bekannten Prozessen stattfindet. - Obwohl die Erfindung nur anhand einer beschränkten Anzahl von Ausführungen beschrieben wurde, liegen dem Fachmann viele Modifikationen nahe. Solche Modifikationen verbleiben innerhalb des Bereichs der Erfindung.
- Insbesondere kann als photoreduzierbares Dielektrikum ein anderes Material als Indiumoxid verwendet werden, beispielsweise Zinkoxid, Titanoxid und Mischungen solcher Verbindungen.
- Jede dielektrische Zwischenschicht kann durch eine erste Unterschicht eines Dielektrikums ausgebildet sein, das photoreduzierbar ist und das in einer zweiten Unterschicht eines photoreduzierbaren Dielektrikums abgedeckt ist.
- Die Erfindung betrifft nicht nur MOS-Transistoren, sondern auch alle Halbleiter, die zumindest eine isolierte Elektrode aufweisen, beispielsweise EPROM-Zellen mit doppeltem Gate.
Claims (9)
- Verfahren zum Erzeugen von Leitungen (
67 ,70 ,75 ) und Kontakten (60 ) in einem integrierten Schaltkreis mit den Schritten: a) Ausbilden einer isolierten Gatekomponente auf einem Halbleitersubstrat (10 ); b) Auftragen einer dielektrischen Schicht (80 ), um die Komponente zu überdecken; c) Ätzen von Löchern (45 ,50 ,55 ) in die dielektrische Schicht, um Abschnitte (20 ,35 ,15 ) der Komponente freizulegen; d) Füllen der Löcher mit einem leitenden Material (60 ), um Kontaktanschlüsse auszubilden; f) Überdecken der resultierenden Struktur mit einer Verbindungsschicht (64 ); g) Ätzen der Verbindungsschicht, um die Leitungen zu definieren, wobei die Leitungen in elektrischem Kontakt mit den Kontaktanschlüssen stehen; dadurch gekennzeichnet, daß: – die dielektrische Schicht ein photoreduzierbares Material umfaßt und das Verfahren ferner die Schritte umfaßt: e) Photoreduzieren zumindest eines oberen Abschnitts (85 ) der dielektrischen Schicht vor einem Überdecken mit der Verbindungsschicht, um dessen Leitfähigkeit entsprechend zu erhöhen; und h) Oxidieren der dielektrischen Schicht, um deren Leitfähigkeit zu verringern. - Verfahren nach Anspruch 1, das ferner den Schritt eines Wiederholens der Schritte (b) bis (h) umfaßt, um weitere Schichten von Kontaktanschlüssen (
105 ,125 ) und Verbindungsleitungen (92 ,95 ) auszubilden. - Verfahren nach Anspruch 1 oder 2, das ferner den Schritt eines Aufbringens einer Passivierungsschicht (
140 ) über eine obere Oberfläche des integrierten Schaltkreises umfaßt, wobei die Passivierungsschicht aus einem lichtundurchlässigen Material zusammengesetzt ist, das dazu geeignet ist eine Photoreduktion der dielektrischen Schichten hervorzurufen. - Verfahren nach Anspruch 1, wobei das photoreduzierbare Material Indiumoxid ist und der photoreduzierende Schritt das Aussetzen der dielektrischen Schicht gegen Licht umfaßt, dessen Wellenlänge kleiner als 35 μm ist.
- Verfahren nach Anspruch 4, wobei der Oxidationsschritt das Aussetzen der dielektrischen Schicht gegen eine Atmosphäre umfaßt, die Ozon enthält.
- Verfahren nach Anspruch 5, wobei das Ozon in situ erzeugt wird, indem Sauerstoff gegen ultraviolettes Licht ausgesetzt wird.
- Integrierte Schaltkreisstruktur mit einem Halbleitersubstrat (
10 ), einer dielektrischen Zwischenschicht (80 ), die auf dem Substrat angeordnet ist, Kontaktanschlüssen (60 ), die durch die dielektrische Zwischenschicht hindurch vorgesehen sind, und Leitungen (67 ,70 ,75 ), die in elektrischem Kontakt mit den Kontaktanschlüssen vorgesehen sind, dadurch gekennzeichnet, daß die dielektrische Zwischenschicht ein photoreduzierbares Material in einem Zustand mit niedriger Leitfähigkeit umfaßt. - Integrierter Schaltkreis nach Anspruch 7, der ferner weitere dielektrische Zwischenschichten (
97 ,115 ) umfaßt, die jeweils Kontaktanschlüsse (105 ,125 ) durch diese hindurch aufweisen und die jeweils mit Leitungen (90 ,95 ) in elektrischem Kontakt mit den Kontaktanschlüssen versehen sind, dadurch gekennzeichnet, daß zumindest einige der dielektrischen Zwischenschichten ein photoreduzierbares Material in einem Zustand mit niedriger Leitfähigkeit umfassen. - Integrierter Schaltkreis nach Anspruch 7 oder 8, der ferner eine Oberflächen-Passivierungsschicht (
140 ) umfaßt, die gegenüber Licht undurchlässig ist und dazu geeignet ist, das Material der dielektrischen Schichten zu photoreduzieren.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
FR9606018A FR2748601B1 (fr) | 1996-05-07 | 1996-05-07 | Procede de formation d'interconnexions dans un circuit integre |
FR9606018 | 1996-05-07 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE69728205D1 DE69728205D1 (de) | 2004-04-29 |
DE69728205T2 true DE69728205T2 (de) | 2005-02-17 |
Family
ID=9492137
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE69728205T Expired - Fee Related DE69728205T2 (de) | 1996-05-07 | 1997-05-02 | Herstellungsverfahren von Verbindungen in einer integrierten Schaltung |
Country Status (4)
Country | Link |
---|---|
US (2) | US5851919A (de) |
EP (1) | EP0806799B1 (de) |
DE (1) | DE69728205T2 (de) |
FR (1) | FR2748601B1 (de) |
Families Citing this family (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6207553B1 (en) * | 1999-01-26 | 2001-03-27 | Advanced Micro Devices, Inc. | Method of forming multiple levels of patterned metallization |
US7265448B2 (en) * | 2004-01-26 | 2007-09-04 | Marvell World Trade Ltd. | Interconnect structure for power transistors |
US7960833B2 (en) * | 2003-10-22 | 2011-06-14 | Marvell World Trade Ltd. | Integrated circuits and interconnect structure for integrated circuits |
US7851872B2 (en) * | 2003-10-22 | 2010-12-14 | Marvell World Trade Ltd. | Efficient transistor structure |
US8319307B1 (en) * | 2004-11-19 | 2012-11-27 | Voxtel, Inc. | Active pixel sensors with variable threshold reset |
US8461628B2 (en) * | 2005-03-18 | 2013-06-11 | Kovio, Inc. | MOS transistor with laser-patterned metal gate, and method for making the same |
JP5096669B2 (ja) * | 2005-07-06 | 2012-12-12 | ルネサスエレクトロニクス株式会社 | 半導体集積回路装置の製造方法 |
JP2009509322A (ja) | 2005-09-15 | 2009-03-05 | エヌエックスピー ビー ヴィ | 半導体装置用構造およびその製造方法 |
US7425910B1 (en) | 2006-02-27 | 2008-09-16 | Marvell International Ltd. | Transmitter digital-to-analog converter with noise shaping |
WO2014036241A2 (en) * | 2012-08-30 | 2014-03-06 | Sensevere, Llc | Corrosive resistant electronic components |
KR101936846B1 (ko) * | 2012-10-24 | 2019-01-11 | 에스케이하이닉스 주식회사 | 반도체 소자 및 그 제조방법 |
CN118471905B (zh) * | 2024-07-10 | 2024-09-27 | 合肥欧益睿芯科技有限公司 | 半导体器件及其制造方法、电子设备 |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3553533A (en) * | 1964-05-14 | 1971-01-05 | Texas Instruments Inc | Dielectric bodies with selectively formed conductive or metallic portions, composites thereof with semiconductor material and methods of making said bodies and composites |
EP0072690A3 (de) * | 1981-08-17 | 1983-11-09 | Fujitsu Limited | MIS Halbleiteranordnung und Verfahren zu deren Herstellung |
JPS58207699A (ja) * | 1982-05-28 | 1983-12-03 | 株式会社日立製作所 | 配線回路基板の製造方法 |
US5459098A (en) * | 1992-10-19 | 1995-10-17 | Marietta Energy Systems, Inc. | Maskless laser writing of microscopic metallic interconnects |
US5517031A (en) * | 1994-06-21 | 1996-05-14 | General Electric Company | Solid state imager with opaque layer |
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US5627094A (en) * | 1995-12-04 | 1997-05-06 | Chartered Semiconductor Manufacturing Pte, Ltd. | Stacked container capacitor using chemical mechanical polishing |
-
1996
- 1996-05-07 FR FR9606018A patent/FR2748601B1/fr not_active Expired - Fee Related
-
1997
- 1997-05-02 DE DE69728205T patent/DE69728205T2/de not_active Expired - Fee Related
- 1997-05-02 EP EP97410048A patent/EP0806799B1/de not_active Expired - Lifetime
- 1997-05-06 US US08/851,803 patent/US5851919A/en not_active Expired - Lifetime
-
1998
- 1998-07-17 US US09/118,291 patent/US6051884A/en not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
US6051884A (en) | 2000-04-18 |
FR2748601A1 (fr) | 1997-11-14 |
EP0806799A1 (de) | 1997-11-12 |
US5851919A (en) | 1998-12-22 |
DE69728205D1 (de) | 2004-04-29 |
FR2748601B1 (fr) | 1998-07-24 |
EP0806799B1 (de) | 2004-03-24 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
8364 | No opposition during term of opposition | ||
8339 | Ceased/non-payment of the annual fee |