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CN217640622U - 显示装置 - Google Patents

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CN217640622U
CN217640622U CN202221109578.7U CN202221109578U CN217640622U CN 217640622 U CN217640622 U CN 217640622U CN 202221109578 U CN202221109578 U CN 202221109578U CN 217640622 U CN217640622 U CN 217640622U
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CN
China
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voltage
area
transistor
line
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CN202221109578.7U
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English (en)
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安珍星
金成虎
成硕济
禹珉宇
李旺宇
李知嬗
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Samsung Display Co Ltd
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    • G09G3/3208—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED]
    • G09G3/3275—Details of drivers for data electrodes
    • G09G3/3283—Details of drivers for data electrodes in which the data driver supplies a variable data current for setting the current through, or the voltage across, the light-emitting elements
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10K—ORGANIC ELECTRIC SOLID-STATE DEVICES
    • H10K59/00—Integrated devices, or assemblies of multiple devices, comprising at least one organic light-emitting element covered by group H10K50/00
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    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10K—ORGANIC ELECTRIC SOLID-STATE DEVICES
    • H10K59/00—Integrated devices, or assemblies of multiple devices, comprising at least one organic light-emitting element covered by group H10K50/00
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Abstract

一种显示装置，显示装置防止在具有不同分辨率的显示区域中的每一个中的闪烁的视觉识别，显示装置包括第一像素电路、第一显示元件、第二像素电路和第二显示元件。第一像素电路包括配置为控制流到第一显示元件的第一电流的第一驱动晶体管和配置为响应于第一扫描信号将第一初始化电压施加到第一像素电路的第一初始化晶体管。第二像素电路包括配置为控制流到第二显示元件的第二电流的第二驱动晶体管和配置为响应于第一扫描信号将具有与第一初始化电压的电平不同的电平的第二初始化电压施加到第二像素电路的第二初始化晶体管。

Description

显示装置
相关申请的交叉引用
本申请要求于2021年5月12日提交的第10-2021-0061641号韩国专利申请的优先权和权益，该韩国专利申请出于所有目的通过引用特此并入，如同在本文中全面阐述一样。
技术领域
本实用新型的实施方式总体上涉及显示装置。
背景技术
通常的显示装置包括显示元件和用于控制施加到显示元件的电信号的电子器件。电子器件包括薄膜晶体管(TFT)、存储电容器和用于将电压和电流提供到电子器件内的各种部件的多个线。
显示装置的应用近来已多样化。此外，由于显示装置已变得更小、更薄且更轻，它们的使用范围已扩大。随着显示装置的用途多样化，已对设计显示装置的形状的各种方法进行了研究。
在此背景技术部分中公开的以上信息仅用于理解本实用新型概念的背景，并且因此，其可能包含不构成现有技术的信息。
实用新型内容
根据本实用新型的说明性实现方式构造的设备能够改善具有有着不同图像分辨率能力的多个显示区域的显示装置的显示质量。
一个或多个实施方式包括防止在具有不同分辨率的多个显示区域中的每一个中视觉识别出闪烁的显示装置。
本实用新型概念的附加特征将在下面的描述中阐述，并且部分地将通过该描述而显而易见，或者可通过实践本实用新型概念而习得。
根据一个或多个实施方式，显示装置包括第一像素电路、连接到第一像素电路的第一显示元件、第二像素电路和连接到第二像素电路的第二显示元件。第一像素电路包括配置为控制流到第一显示元件的第一电流的第一驱动晶体管和配置为响应于第一扫描信号将第一初始化电压施加到第一像素电路的第一初始化晶体管。第二像素电路包括配置为控制流到第二显示元件的第二电流的第二驱动晶体管和配置为响应于第一扫描信号将具有与第一初始化电压的电平不同的电平的第二初始化电压施加到第二像素电路的第二初始化晶体管。
第一初始化电压的电平可高于第二初始化电压的电平。第一初始化晶体管可配置为响应于第一扫描信号将第一初始化电压施加到第一驱动晶体管的栅极，并且第二初始化晶体管可配置为响应于第一扫描信号将第二初始化电压施加到第二驱动晶体管的栅极。第一初始化晶体管可配置为响应于第一扫描信号将第一初始化电压施加到第一显示元件的阳极，并且第二初始化晶体管可配置为响应于第一扫描信号将第二初始化电压施加到第二显示元件的阳极。
第一像素电路还可包括配置为响应于第二扫描信号将第三初始化电压施加到第一显示元件的阳极的第三初始化晶体管，并且第二像素电路还可包括配置为响应于第二扫描信号将第四初始化电压施加到第二显示元件的阳极的第四初始化晶体管。
第三初始化电压的电平可高于第四初始化电压的电平。
第一像素电路还可包括第一扫描晶体管、第一存储电容器和第一补偿晶体管，第一扫描晶体管配置为响应于第三扫描信号将第一数据电压发送到第一驱动晶体管，第一存储电容器具有第一电极和第二电极，第二电极连接到第一驱动晶体管的栅极，第一补偿晶体管配置为响应于第四扫描信号将第一驱动晶体管的漏极连接到第一驱动晶体管的栅极。第二像素电路还可包括第二扫描晶体管、第二存储电容器和第二补偿晶体管，第二扫描晶体管配置为响应于第三扫描信号将第二数据电压发送到第二驱动晶体管，第二存储电容器具有第三电极和第四电极，第四电极连接到第二驱动晶体管的栅极，第二补偿晶体管配置为响应于第四扫描信号将第二驱动晶体管的漏极连接到第二驱动晶体管的栅极。
第一补偿晶体管和第二补偿晶体管的导电类型可与第一扫描晶体管和第二扫描晶体管的导电类型相反，并且可与第一初始化晶体管和第二初始化晶体管的导电类型相同。
第三扫描信号和第四扫描信号可彼此实质上同步。
第一初始化晶体管和第二初始化晶体管的导电类型可与第一驱动晶体管和第二驱动晶体管的导电类型相反。
第二显示元件的发射面积可大于第一显示元件的发射面积。
第一显示元件和第二显示元件可各自设置为多个，并且每单位面积的第一显示元件的数量可大于每单位面积的第二显示元件的数量。
显示装置还可包括衬底、第一电压线和第二电压线，在衬底中限定有第一区域和第二区域，第二区域被第一区域至少部分地围绕，第一电压线与第一区域至少部分地重叠，并且配置为将第一初始化电压发送到第一像素电路，第二电压线与第一区域和第二区域至少部分地重叠，并且配置为将第二初始化电压发送到第二像素电路。第一电压线可在行方向上延伸，并且可具有通过第二区域而彼此物理地间隔开的第一部分和第二部分。
第二电压线可包括围绕第二区域的至少一部分的第一部分和连接到第一部分并且在行方向上延伸的第二部分。第二电压线的第一部分可与第一区域重叠，并且第二电压线的第二部分可与第二区域重叠。
显示装置还可包括第三像素电路和连接到第三像素电路的第三显示元件。第三像素电路可包括配置为控制流到第三显示元件的第三电流的第三驱动晶体管和配置为响应于第一扫描信号将第二初始化电压施加到第三驱动晶体管的栅极的第三初始化晶体管。在平面图中，第二像素电路和第二显示元件可彼此间隔开，并且第三像素电路和第三显示元件可彼此至少部分地重叠。
显示装置还可包括其中限定有第一区域和被第一区域至少部分地围绕的第二区域的衬底。第二区域可包括部件区域和中间区域，中间区域位于第一区域与部件区域之间。第一像素电路和第一显示元件可排列在第一区域中。第二显示元件可排列在第二区域的部件区域中。第二像素电路、第三像素电路和第三显示元件可排列在第二区域的中间区域中。
第一像素电路还可包括第四初始化晶体管，第四初始化晶体管配置为响应于第二扫描信号将第三初始化电压施加到第一显示元件的阳极。第二像素电路还可包括第五初始化晶体管，第五初始化晶体管配置为响应于第二扫描信号将第四初始化电压施加到第二显示元件的阳极。第三像素电路还可包括第六初始化晶体管，第六初始化晶体管配置为响应于第二扫描信号将第四初始化电压施加到第三显示元件的阳极。
第三初始化电压的电平可高于第四初始化电压的电平。
第三显示元件的发射面积可等于第二显示元件的发射面积，并且第三显示元件的发射面积可大于第一显示元件的发射面积。
第一显示元件、第二显示元件和第三显示元件可各自设置为多个。每单位面积的第二显示元件的数量可等于每单位面积的第三显示元件的数量，并且每单位面积的第一显示元件的数量可大于每单位面积的第二显示元件的数量。
显示装置还可包括衬底、焊盘部、多个第一数据线、多个第二数据线、多个辅助行线和多个辅助列线，在衬底中限定有第一显示区域、位于第一显示区域在行方向上的两侧上的第二显示区域以及在第一显示区域和第二显示区域周围的外围区域，焊盘部排列在外围区域中并且包括多个第一焊盘和多个第二焊盘，多个第一数据线各自在列方向上在第一显示区域中延伸并且分别连接到多个第一焊盘，多个第二数据线各自在列方向上在第二显示区域中延伸，多个辅助行线各自在行方向上在第一显示区域和第二显示区域中延伸，多个辅助列线各自在列方向上在第一显示区域和第二显示区域中延伸。多个辅助列线的第一集合可具有分别连接到多个第二焊盘的多个第一列连接部分。多个辅助行线的第一集合可具有将多个第一辅助列线的多个第一列连接部分分别连接到多个第二数据线的多个第一行连接部分。第二初始化电压可施加到多个辅助行线的第二集合中的至少一部分，并且驱动电压可施加到多个辅助列线的第二集合。
第二初始化电压可施加到多个辅助行线的第二集合的第一子集(即，(第2-1)辅助行线)，并且驱动电压可施加到多个辅助行线的第二集合的第二子集(即，第(2-2)辅助行线)。
多个辅助列线的第一集合可具有分别施加有驱动电压的多个第二列连接部分，并且多个辅助列线的第一集合的多个第二列连接部分可与多个辅助列线的第一集合的多个第一列连接部分分别间隔开。
多个辅助行线中的第一集合可具有分别施加有驱动电压的多个第二行连接部分，并且多个辅助行线的第一集合的多个第二行连接部分可与多个辅助行线的第一集合的多个第一行连接部分分别间隔开。
根据一个或多个实施方式，显示装置包括第一像素电路、连接到第一像素电路的第一显示元件、第二像素电路和连接到第二像素电路的第二显示元件。第一像素电路可包括配置为响应于第一扫描信号将第一初始化电压施加到第一显示元件的阳极的第一初始化晶体管，并且第二像素电路可包括配置为响应于第一扫描信号将具有与第一初始化电压的电平不同的电平的第二初始化电压施加到第二显示元件的阳极的第二初始化晶体管。
第一初始化电压的电平可高于第二初始化电压的电平。
第一像素电路还可包括配置为控制流到第一显示元件的第一电流的第一驱动晶体管、配置为响应于第二扫描信号将第一数据电压发送到第一驱动晶体管的第一扫描晶体管以及具有第一电极和第二电极的第一存储电容器，第二电极连接到第一驱动晶体管的栅极。第二像素电路还可包括配置为控制流到第二显示元件的第二电流的第二驱动晶体管、配置为响应于第二扫描信号将第二数据电压发送到第二驱动晶体管的第二扫描晶体管以及具有第三电极和第四电极的第二存储电容器，第四电极连接到第二驱动晶体管的栅极。
第二显示元件的发射面积可大于第一显示元件的发射面积。
第一显示元件和第二显示元件可各自设置为多个，并且每单位面积的第一显示元件的数量大于每单位面积的第二显示元件的数量。
显示装置还可包括其中限定有第一区域和被第一区域至少部分地围绕的第二区域的衬底、与第一区域至少部分地重叠并且配置为将第一初始化电压发送到第一像素电路的第一电压线以及与第一区域和第二区域至少部分地重叠并且配置为将第二初始化电压发送到第二像素电路的第二电压线。第一电压线可在行方向上延伸，并且可具有通过第二区域而彼此物理地间隔开的第一部分和第二部分。
第二电压线可包括围绕第二区域的至少一部分的第一部分以及连接到第一部分并且在行方向上延伸的第二部分。第二电压线的第一部分可与第一区域重叠，并且第二电压线的第二部分可与第二区域重叠。
显示装置还可包括第三像素电路和连接到第三像素电路的第三显示元件。第三像素电路可包括配置为响应于第一扫描信号将第二初始化电压施加到第三显示元件的阳极的第三初始化晶体管。在平面图中，第二像素电路和第二显示元件可彼此间隔开，并且第三像素电路和第三显示元件可彼此至少部分地重叠。
显示装置还可包括其中限定有第一区域和被第一区域至少部分地围绕的第二区域的衬底。第二区域可包括部件区域和中间区域，中间区域位于第一区域与部件区域之间。第一像素电路和第一显示元件可排列在第一区域中。第二显示元件可排列在第二区域的部件区域中。第二像素电路、第三像素电路和第三显示元件可排列在第二区域的中间区域中。
第三显示元件的发射面积可等于第二显示元件的发射面积，并且第三显示元件的发射面积可大于第一显示元件的发射面积。
第一显示元件、第二显示元件和第三显示元件可各自设置为多个。每单位面积的第二显示元件的数量可等于每单位面积的第三显示元件的数量，并且每单位面积的第一显示元件的数量可大于每单位面积的第二显示元件的数量。
显示装置还可包括衬底、焊盘部、多个第一数据线、多个第二数据线、多个辅助行线和多个辅助列线，在衬底中限定有第一显示区域、位于第一显示区域在行方向上的两侧上的第二显示区域以及在第一显示区域和第二显示区域周围的外围区域，焊盘部排列在外围区域中并且包括多个第一焊盘和多个第二焊盘，多个第一数据线各自在列方向上在第一显示区域中延伸并且分别连接到多个第一焊盘，多个第二数据线各自在列方向上在第二显示区域中延伸，多个辅助行线各自在行方向上在第一显示区域和第二显示区域中延伸，多个辅助列线各自在列方向上在第一显示区域和第二显示区域中延伸。多个辅助列线的第一集合可具有分别连接到多个第二焊盘的多个第一列连接部分。多个辅助行线的第一集合可具有将多个辅助列线的第一集合的多个第一列连接部分分别连接到多个第二数据线的多个第一行连接部分。第二初始化电压可施加到多个辅助行线的第二集合中的至少一部分，并且驱动电压可施加到多个辅助列线的第二集合。
第二初始化电压可施加到多个辅助行线的第二集合的第一子集，并且驱动电压可施加到多个辅助行线的第二集合的第二子集。
多个辅助列线的第一集合可具有分别施加有驱动电压的多个第二列连接部分，并且多个辅助列线的第一集合的多个第二列连接部分可与多个辅助列线的第一集合的多个第一列连接部分分别间隔开。
多个辅助行线的第一集合可具有分别施加有驱动电压的多个第二行连接部分，并且多个辅助行线的第一集合的多个第二行连接部分可与多个辅助行线的第一集合的多个第一行连接部分分别间隔开。
这些一般实施方式和特定实施方式可通过使用系统、方法、计算机程序或其组合来实现。
应理解，前面的一般描述和下面的详细描述二者是说明性和解释性的，并且旨在提供对所要求保护的本实用新型的进一步解释。
附图说明
附图被包括以提供对本实用新型的进一步理解并且被并入并构成本说明书的一部分，附图示出了本实用新型的说明性实施方式并且与描述一同用于解释本实用新型概念。
图1是根据本实用新型的原理构造的根据实施方式的显示装置的示意性框图。
图2是根据实施方式的第一像素和第二像素的示意图。
图3是根据另一实施方式的第一像素和第二像素的示意图。
图4是根据实施方式的第一像素的等效电路图。
图5是根据实施方式的第二像素的等效电路图。
图6是根据另一实施方式的第一像素和第二像素的示意图。
图7是根据另一实施方式的第一像素的等效电路图。
图8是根据另一实施方式的第二像素的等效电路图。
图9是根据实施方式的显示装置的示意性透视图。
图10是根据实施方式的显示装置的剖面的一部分的示意性剖面图。
图11是根据实施方式的可包括在图9的显示装置中的显示面板的示意性平面图。
图12是根据另一实施方式的可包括在图9的显示装置中的显示面板的示意性平面图。
图13是根据另一实施方式的显示装置的剖面的一部分的示意性剖面图。
图14是根据另一实施方式的可包括在图9的显示装置中的显示面板的示意性平面图。
图15是根据另一实施方式的可包括在图9的显示装置中的显示面板的示意性平面图。
图16是根据另一实施方式的显示装置的示意性透视图。
图17是根据另一实施方式的显示装置的剖面的一部分的示意性剖面图。
图18是根据实施方式的可包括在图16的显示装置中的显示面板的示意性平面图。
图19是根据另一实施方式的可包括在图16的显示装置中的显示面板的示意性平面图。
图20是根据另一实施方式的可包括在图16的显示装置中的显示面板的示意性平面图。
图21是图20的显示面板的一部分的放大示意性平面图。
图22是图20的显示面板的另一部分的放大示意性平面图。
图23是图20的显示面板的另一部分的放大示意性平面图。
图24是根据另一实施方式的可包括在图16的显示装置中的显示面板的示意性平面图。
图25是根据另一实施方式的可包括在图16的显示装置中的显示面板的示意性平面图。
具体实施方式
在下面的描述中，为了解释的目的，阐述了许多具体细节以便提供对本实用新型的各种实施方式或实现方式的透彻理解。如本文中所使用的，“实施方式”和“实现方式”为可互换的词，它们是采用本文中所公开的本实用新型概念中的一种或多种的设备或方法的非限制性实例。然而，显而易见的是，各种实施方式可在没有这些具体细节或者具有一个或多个等同布置的情况下实践。在其它例子中，公知的结构和设备以框图形式示出以避免不必要地使各种实施方式隐晦。另外，各种实施方式可为不同的，但不必是排他的。例如，在不背离本实用新型概念的情况下，实施方式的特定形状、配置和特性可使用或实现在另一实施方式中。
除非另有说明，否则所示出的实施方式应被理解为提供其中在实践中可实现本实用新型概念的一些方式的变化的细节的说明性特征。因此，除非另有说明，否则各种实施方式的特征、部件、模块、层、膜、面板、区和/或方面等(在下文中单独称为或统称为“元件”)可在不背离本实用新型概念的情况下以其它方式组合、分离、互换和/或重新布置。
交叉影线和/或阴影在附图中的使用通常被提供以阐明相邻元件之间的边界。由此，除非说明，否则无论交叉影线或阴影存在与否都不传达或表明对特定材料、材料性质、尺寸、比例、所示出元件之间的共性和/或元件的任何其它特性、属性、性质等的任何偏好或要求。另外，在附图中，出于清楚和/或描述性目的，元件的尺寸和相对尺寸可被夸大。当实施方式可被不同地实现时，具体工艺顺序可与所描述的顺序不同地执行。例如，两个连续描述的工艺可实质上同时执行或者以与所描述的顺序相反的顺序执行。此外，相同的附图标记表示相同的元件。
当元件或层被称为在另一元件或层“上”、“连接到”或“联接到”另一元件或层时，该元件或层可直接在另一元件或层上、直接连接到或直接联接到另一元件或层，或者可存在有居间元件或层。然而，当元件或层被称为“直接在”另一元件或层“上”、“直接连接到”或“直接联接到”另一元件或层时，则不存在居间元件或层。为此，术语“连接”可是指在具有或不具有居间元件的情况下的物理、电和/或流体连接。此外，x轴、y轴和z轴不限于直角坐标系的三个轴。例如，x轴、y轴和z轴可彼此垂直，或者可表示彼此不垂直的不同方向。为了这种公开的目的，“X、Y和Z中的至少一个”和“选自由X、Y和Z构成的组中的至少一个”可被解释为仅X、仅Y、仅Z、或者X、Y和Z中的两个或更多个的任何组合，诸如以XYZ、XYY、YZ和ZZ为例。如本文中所使用的，术语“和/或”包括相关所列项目中的一个或多个的任何和所有组合。
虽然术语“第一”、“第二”等可在本文中用于描述各种类型的元件，但是这些元件不应受这些术语的限制。这些术语用于将一个元件与另一个元件区分开。因此，在不背离本公开的教导的情况下，下面讨论的第一元件可被称为第二元件。
空间相对术语，诸如“下面(beneath)”、“下方(below)”、“下(under)”、“下部的(lower)”、“上方(above)”、“上部的(upper)”、“上面(over)”、“更高的(higher)”、“侧(side)”(例如，如在“侧壁(sidewall)中”)等，可在本文中出于描述性目的而使用，并且从而用于描述如附图中所示出的一个元件与另一(多)个元件的关系。除了附图中描绘的取向以外，空间相对术语还旨在涵盖装置在使用、操作和/或制造中的不同取向。例如，如果附图中的装置被翻转，则被描述为在其它元件或特征“下方”或“下面”的元件将随后被取向为在其它元件或特征“上方”。因此，术语“下方”能够涵盖上方和下方的取向这两者。此外，装置可以其它方式被取向(例如，旋转90度或在其它取向)，并且由此，本文中使用的空间相对描述词被相应地解释。
本文中所使用的用语是出于描述特定实施方式的目的，而不旨在限制。除非上下文另有明确说明，否则如本文中所使用的单数形式“一(a)”、“一(an)”和“该(the)”也旨在包括复数形式。此外，术语“包括(comprises)”、“包括有(comprising)”、“包括(includes)”和/或“包括有(including)”当在本说明书中使用时指明所陈述的特征、整数、步骤、操作、元件、部件和/或其组的存在，但不排除一个或多个其它特征、整数、步骤、操作、元件、部件和/或其组的存在或添加。还注意，如本文中所使用的，术语“实质上”、“约(about)”以及其它相似术语被用作近似术语而不是程度术语，并且由此，被用于考虑会被本领域普通技术人员认可的测量值、计算值和/或提供值中的固有偏差。
在本文中参照作为理想化实施方式和/或中间结构的示意性图示的剖面图示和/或分解图示对各种实施方式进行描述。由此，由例如制造技术和/或公差所导致的图示的形状的变化将被预期。因此，本文中所公开的实施方式不应必须被解释为限于特定示出的区形状，而是包括由例如制造导致的形状上的偏差。通过这种方式，在附图中示出的区本质上可为示意性的，并且这些区的形状可不反映设备的区的实际形状，并且由此并非必须旨在进行限制。
作为本领域中的惯例，在功能块、单元和/或模块的方面描述并且在附图中示出一些实施方式。本领域技术人员将理解，这些块、单元和/或模块由诸如逻辑电路、分立部件、微处理器、硬连线电路、存储器元件、布线连接等的电子(或光学)电路物理地实现，这些电路可以使用基于半导体的制备技术或其它制造技术形成。在块、单元和/或模块由微处理器或其它类似硬件实现的情况下，可以使用软件(例如，微代码)对它们进行编程和控制以执行本文中讨论的各种功能，并且可选择地，它们可由固件和/或软件驱动。另外预期的是，每个块、单元和/或模块可以由专用硬件实现，或者可以作为执行一些功能的专用硬件和执行其它功能的处理器(例如，一个或多个经编程的微处理器和相关电路)的组合来实现。另外，一些实施方式的每个块、单元和/或模块可以物理地分离为两个或更多个交互且分立的块、单元和/或模块，而不脱离本实用新型概念的范围。此外，一些实施方式的块、单元和/或模块可以物理地组合成更复杂的块、单元和/或模块，而不脱离本实用新型概念的范围。
除非另有定义，否则本文中使用的所有术语(包括技术术语和科学术语)具有与本公开所属的领域中的普通技术人员通常所理解的含义相同的含义。术语，诸如在常用词典中定义的那些术语，应被解释为具有与它们在相关领域的上下文中的含义一致的含义，并且除非在本文中明确如此限定，否则不应在理想的或过于刻板的意义上进行解释。
图1是根据本实用新型的原理构造的根据实施方式的显示装置的示意性框图。
显示装置可为包括其亮度根据电流改变的显示元件(例如，有机发光二极管)的有机发光显示器。可替代地，显示装置可为无机发光显示器或量子点发光显示器。换句话说，显示装置的显示元件的发射层可包括有机材料、包括无机材料、包括量子点、包括有机材料和量子点、包括无机材料和量子点、或者包括有机材料和无机材料。现在将聚焦于并且描述显示装置是有机发光显示器的情况。
参照图1，有机发光显示器100包括显示单元110、栅极驱动器120、数据驱动器130、时序控制器140和电压生成器150。
显示单元110包括像素PX，像素PX包括位于第i行和第j列上的第一像素PX1和位于第i行和第k列上的第二像素PX2。图1示出了位于同一行上的第一像素PX1和第二像素PX2，但是m×n个像素PX可排列成例如矩阵形式。在本文中，m是大于0的自然数，n是大于0的自然数，i是在1至m的范围中的自然数(即，正整数)，j是在1至n的范围中的自然数，并且k是在1至n的范围中的自然数。
在图1中作为实例示出了包括七个晶体管和一个电容器的每个像素PX。然而，本公开不仅适用于采用该特定像素电路的像素PX，而且还同样适用于采用另一像素电路(例如包括两个晶体管和一个电容器的像素电路)的像素PX。
像素PX连接到第一扫描线SL1_1至SL1_m+1、第二扫描线SL2_1至SL2_m、第三扫描线SL3_1至SL3_m、光发射控制线EML_1至EML_m以及数据线DL_1至DL_n。像素PX连接到电源线PL_1至PL_n(未示出)，并且连接到第一电压线VL1或第二电压线VL2。
例如，如图1中所示，第一像素PX1可连接到第一扫描线SL1_i、第二扫描线SL2_i、第三扫描线SL3_i、光发射控制线EML_i、第一数据线DL_j、第一电源线PL_j、第一电压线VL1和第一扫描线SL1_i+1。第二像素PX2可连接到第一扫描线SL1_i、第二扫描线SL2_i、第三扫描线SL3_i、光发射控制线EML_i、第二数据线DL_k、第二电源线PL_k、第二电压线VL2和第一扫描线SL1_i+1。第一扫描线SL1_i+1可被称为用于第一像素PX1和第二像素PX2的第四扫描线。
作为另一实例，第一像素PX1可连接到第一扫描线SL1_i、第二扫描线SL2_i、第三扫描线SL3_i、光发射控制线EML_i、第一数据线DL_j、第一电源线PL_j、第一电压线VL1和第一扫描线SL1_i+1中的一些。例如，第一像素PX1可连接到第一扫描线SL1_i、第一数据线DL_j和第一电源线PL_j。第二像素PX2可连接到第一扫描线SL1_i、第二扫描线SL2_i、第三扫描线SL3_i、光发射控制线EML_i、第二数据线DL_k、第二电源线PL_k、第二电压线VL2和第一扫描线SL1_i+1中的一些。例如，第二像素PX2可连接到第一扫描线SL1_i、第二数据线DL_k和第二电源线PL_k。
数据线DL_1至DL_n和电源线PL_1至PL_n(未示出)可各自在第一方向(或列方向)DR1上延伸，并且可连接到位于同一列上的像素PX。第一扫描线SL1_1至SL1_m+1、第二扫描线SL2_1至SL2_m、第三扫描线SL3_1至SL3_m以及光发射控制线EML_1至EML_m可各自在第二方向(或行方向)DR2上延伸，并且可连接到位于同一行上的像素PX。
第一电压线VL1可各自在第二方向DR2上延伸，并且可连接到位于同一行上的像素PX中的至少一些。第二电压线VL2可各自在第二方向DR2上延伸，并且可连接到位于同一行上的像素PX中的至少一些。例如，位于同一行上的像素PX可连接到第一电压线VL1，或者位于同一行上的像素PX中的一些像素PX可连接到第一电压线VL1并且其它像素PX可连接到第二电压线VL2。
根据实施方式，位于第一行至第m行中的一些行上的像素PX可连接到各自在第二方向DR2上延伸的第一电压线VL1。位于第一行至第m行中的其它行上的像素PX中的一些像素PX可连接到第一电压线VL1，并且其它像素PX可连接到第二电压线VL2。在这种情况下，一些像素PX中的每一个的尺寸(例如，发射面积)可不同于其它像素PX中的每一个的尺寸(例如，发射面积)。
第一扫描线SL1_1至SL1_m各自地将由栅极驱动器120输出的第一扫描信号GW_1至GW_m发送到位于同一行上的像素PX，第二扫描线SL2_1至SL2_m各自地将由栅极驱动器120输出的第二扫描信号GC_1至GC_m发送到位于同一行上的像素PX，第三扫描线SL3_1至SL3_m各自地将由栅极驱动器120输出的第三扫描信号GI_1至GI_m发送到位于同一行上的像素PX，并且第一扫描线SL1_2至SL1_m+1各自地将由栅极驱动器120输出的第四扫描信号GB_1至GB_m发送到位于同一行上的像素PX。第一扫描信号GW_i和第四扫描信号GB_i-1可为通过第一扫描线SL1_i发送的相同信号。
光发射控制线EML_1至EML_m各自地将由栅极驱动器120输出的光发射控制信号EM_1至EM_m发送到位于同一行上的像素PX。数据线DL_1至DL_n各自地将由数据驱动器130输出的数据电压Dm_1至Dm_n发送到位于同一列上的像素PX。位于第i行和第j列上的第一像素PX1接收第一扫描信号GW_i、第二扫描信号GC_i、第三扫描信号GI_i和第四扫描信号GB_i、第一数据电压Dm_j和光发射控制信号EM_i。位于第i行和第k列上的第二像素PX2接收第一扫描信号GW_i、第二扫描信号GC_i、第三扫描信号GI_i和第四扫描信号GB_i、第二数据电压Dm_k和光发射控制信号EM_i。
电源线PL_1至PL_n(未示出)中的每一个将由电压生成器150输出的第一驱动电压ELVDD发送到位于同一列上的像素PX。作为另一实例，第一驱动电压ELVDD可通过各自在第二方向DR2上延伸的电源线发送到位于同一行上的像素PX。
第一电压线VL1中的每一个将由电压生成器150输出的第一初始化电压VINT1发送到位于同一行上的像素PX中的至少一些。第二电压线VL2中的每一个将由电压生成器150输出的第二初始化电压VINT2发送到位于同一行上的像素PX中的至少一些。
第一像素PX1包括第一显示元件和第一驱动晶体管，第一驱动晶体管基于第一数据电压Dm_j来控制流到第一显示元件的第一电流的大小。第一数据电压Dm_j从数据驱动器130输出，并且通过第一数据线DL_j被第一像素PX1接收。例如，第一显示元件可为有机发光二极管。第一显示元件发射具有与从第一驱动晶体管接收的第一电流的大小对应的亮度的光，使得第一像素PX1可表示与第一数据电压Dm_j对应的灰度。
第二像素PX2包括第二显示元件和第二驱动晶体管，第二驱动晶体管基于第二数据电压Dm_k来控制流到第二显示元件的第二电流的大小。第二数据电压Dm_k从数据驱动器130输出，并且通过第二数据线DL_k被第二像素PX2接收。例如，第二显示元件可为有机发光二极管。第二显示元件发射具有与从第二驱动晶体管接收的第二电流的大小对应的亮度的光，使得第二像素PX2可表示与第二数据电压Dm_k对应的灰度。
第一像素PX1和第二像素PX2中的每一个可对应于能够显示全色的单位像素的一部分，例如，子像素。第一像素PX1和第二像素PX2中的每一个还可包括至少一个开关晶体管和至少一个电容器。
例如，第一像素PX1可包括响应于第三扫描信号GI_i将第一初始化电压VINT1施加到第一驱动晶体管的栅极的第一栅极初始化晶体管。第二像素PX2可包括响应于第三扫描信号GI_i将第二初始化电压VINT2施加到第二驱动晶体管的栅极的第二栅极初始化晶体管。可替代地，第一像素PX1可包括响应于第四扫描信号GB_i将第一初始化电压VINT1施加到第一显示元件的阳极的第一阳极初始化晶体管。第二像素PX2可包括响应于第四扫描信号GB_i将第二初始化电压VINT2施加到第二显示元件的阳极的第二阳极初始化晶体管。下面将对第一像素PX1和第二像素PX2进行详细描述。
电压生成器150可生成驱动像素PX所需的电压。例如，电压生成器150可生成第一驱动电压ELVDD、第二驱动电压ELVSS、第一初始化电压VINT1和第二初始化电压VINT2。
电压生成器150可生成用于控制像素PX中的每一个的开关晶体管的第一栅极电压和第二栅极电压，并且可将第一栅极电压和第二栅极电压提供到栅极驱动器120。第一栅极电压的电平可高于第二栅极电压的电平。当开关晶体管是p型MOSFET时，开关晶体管可在第一栅极电压被施加到开关晶体管的栅极时关断，并且开关晶体管可在第二栅极电压被施加到开关晶体管的栅极时导通。第一栅极电压可称为关断电压，并且第二栅极电压可称为导通电压。另一方面，当开关晶体管是n型MOSFET时，开关晶体管可在第一栅极电压被施加到开关晶体管的栅极时导通，并且开关晶体管可在第二栅极电压被施加到开关晶体管的栅极时关断。第一栅极电压可称为导通电压，并且第二栅极电压可称为关断电压。电压生成器150可生成伽马基准电压，并且将伽马基准电压提供到数据驱动器130。
时序控制器140可通过控制栅极驱动器120和数据驱动器130的操作时序来控制显示单元110。显示单元110的像素PX可接收针对每一帧时段的新的数据电压Dm，并且可通过发射具有与数据电压Dm对应的亮度的光来显示与一帧的图像源数据RGB对应的图像。
根据实施方式，一个帧时段可包括栅极初始化时段、数据写入和阳极初始化时段以及发射时段。在栅极初始化时段中，第一初始化电压VINT1或第二初始化电压VINT2可通过与第三扫描信号GI_1至GI_m同步而施加到像素PX。例如，与第三扫描信号GI_i同步可将第一初始化电压VINT1施加到第一像素PX1，并且可将第二初始化电压VINT2施加到第二像素PX2。在数据写入和阳极初始化时段期间，数据电压Dm可与第一扫描信号GW_1至GW_m和第二扫描信号GC_1至GC_m同步地提供到像素PX，并且第一初始化电压VINT1或第二初始化电压VINT2可与第四扫描信号GB_1至GB_m同步地施加到像素PX。例如，可与第一扫描信号GW_i和第二扫描信号GC_i同步地将第一数据电压Dm_j和第二数据电压Dm_k分别提供到第一像素PX1和第二像素PX2，并且可与第四扫描信号GB_i同步地将第一初始化电压VINT1和第二初始化电压VINT2分别施加到第一像素PX1和第二像素PX2。在发射时段中，显示单元110的像素PX发射光。
时序控制器140从外部源接收图像源数据RGB和控制信号CONT。时序控制器140可基于显示单元110和像素PX的特性，将图像源数据RGB转换为图像数据DATA。时序控制器140可将图像数据DATA提供到数据驱动器130。
控制信号CONT可包括垂直同步信号、水平同步信号、数据使能信号和时钟信号。时序控制器140可通过使用控制信号CONT来控制栅极驱动器120和数据驱动器130的操作时序。时序控制器140可通过对水平扫描时段的数据使能信号进行计数来确定帧时段。在这种情况下，可省略从外部源供给的垂直同步信号和水平同步信号。图像源数据RGB包括像素PX的亮度信息。亮度可具有确定的亮度数量，例如，1024(＝210)、256(＝28)或64(＝26)个灰度。
时序控制器140可生成控制信号，控制信号包括用于控制栅极驱动器120的操作时序的栅极时序控制信号GDC和用于控制数据驱动器130的操作时序的数据时序控制信号DDC。
栅极时序控制信号GDC可包括栅极起始脉冲(GSP)、栅极移位时钟(GSC)和栅极输出使能(GOE)信号。GSP在扫描时段的起始时间点被提供到栅极驱动器120，从而生成第一扫描信号。GSC是共同地输入到栅极驱动器120并且因此使GSP移位的时钟信号。GOE信号控制栅极驱动器120的输出。
数据时序控制信号DDC可包括源起始脉冲(SSP)、源采样时钟(SSC)和源输出使能(SOE)信号。SSP控制数据驱动器130的数据采样起始时间点，并且在扫描时段的起始时间点被提供到数据驱动器130。SSC是基于上升沿或下降沿来控制数据驱动器130内的数据的采样操作的时钟信号。SOE信号控制数据驱动器130的输出。根据数据传输方法，可省略提供到数据驱动器130的SSP。
栅极驱动器120通过使用由电压生成器150提供的第一栅极电压和第二栅极电压，响应于由时序控制器140供给的栅极时序控制信号GDC，顺序地生成第一扫描信号GW_1至GW_m、第二扫描信号GC_1至GC_m、第三扫描信号GI_1至GI_m和第四扫描信号GB_1至GB_m。
数据驱动器130响应于从时序控制器140供给的数据时序控制信号DDC，对由时序控制器140供给的图像数据DATA进行采样和锁存，以将图像数据DATA转换为并行数据系统的数据。当将图像数据DATA转换为并行数据系统的数据时，数据驱动器130将图像数据DATA转换为伽马基准信号，即，模拟数据电压。数据驱动器130通过数据线DL_1至DL_n将数据电压Dm_1至Dm_n提供到像素PX。像素PX响应于第一扫描信号GW_1至GW_m接收数据电压Dm_1至Dm_n。
图2示意性地示出了根据实施方式的第一像素PX1和第二像素PX2，并且图3示意性地示出了根据另一实施方式的第一像素PX1和第二像素PX2。图3对应于图2的实施方式的修改，并且因此将通过聚焦于与图2的差异来描述。
参照图2，有机发光显示器的显示单元110可包括第一像素PX1和第二像素PX2。第一像素PX1可包括第一像素电路PC1和连接到第一像素电路PC1的第一显示元件DE1，并且第二像素PX2可包括第二像素电路PC2和连接到第二像素电路PC2的第二显示元件DE2。
尽管在图2中第一像素电路PC1、第一显示元件DE1、第二像素电路PC2和第二显示元件DE2中的每一个的平面形状是矩形的，但是第一像素电路PC1、第一显示元件DE1、第二像素电路PC2和第二显示元件DE2中的每一个的平面形状可改变为诸如菱形、圆形、椭圆形和另一多边形的各种形状中的任何一种。
根据实施方式，如图2中所示，第二显示元件DE2的发射面积可大于第一显示元件DE1的发射面积。
根据实施方式，第二像素电路PC2的尺寸(或面积)可大于第一像素电路PC1的尺寸(或面积)。例如，如稍后将描述的图4和图5中所示，第一像素电路PC1可包括第一驱动晶体管T11和第一存储电容器Cst1，并且第二像素电路PC2可包括第二驱动晶体管T12和第二存储电容器Cst2。在这种情况下，第二驱动晶体管T12的沟道长度可大于第一驱动晶体管T11的沟道长度。可替代地，第二驱动晶体管T12的沟道宽度可大于第一驱动晶体管T11的沟道宽度。可替代地，第二存储电容器Cst2的电容可大于第一存储电容器Cst1的电容。
返回参照图2，第一像素电路PC1和第二像素电路PC2可连接到发送第一扫描信号Sg1的第一扫描线SWL1。第一像素电路PC1可连接到发送第一初始化电压VINT1的第一电压线VL1，并且第二像素电路PC2可连接到发送第二初始化电压VINT2的第二电压线VL2。在这种情况下，第一初始化电压VINT1的电平可不同于第二初始化电压VINT2的电平。例如，第一初始化电压VINT1的电平可高于第二初始化电压VINT2的电平。可替代地，第二初始化电压VINT2的电平可高于第一初始化电压VINT1的电平。
第一扫描线SWL1可对应于图4和图5的第三扫描线GIL或第四扫描线GBL，稍后将对其更详细地进行描述。当第一扫描线SWL1对应于第三扫描线GIL时，第一初始化电压VINT1可与第一扫描信号Sg1同步地施加到第一像素电路PC1的第一驱动晶体管T11的栅极，并且第二初始化电压VINT2可与第一扫描信号Sg1同步地施加到第二像素电路PC2的第二驱动晶体管T12的栅极。当第一扫描线SWL1对应于第四扫描线GBL时，第一初始化电压VINT1可与第一扫描信号Sg1同步地施加到第一显示元件DE1的阳极，并且第二初始化电压VINT2可与第一扫描信号Sg1同步地施加到第二显示元件DE2的阳极。
根据比较例，相同的初始化电压可施加到具有不同尺寸的第一像素电路和第二像素电路。在这种情况下，由于在其中在一些帧没有写入数据电压的低频驱动期间，在第一像素和第二像素中的一个中出现帧之间的亮度差，可能视觉识别到闪烁。
根据实施方式，具有不同电平的第一初始化电压VINT1和第二初始化电压VINT2被分别施加到具有不同尺寸的第一像素电路PC1和第二像素电路PC2，使得第一像素PX1和第二像素PX2两者中的帧之间的亮度差被减小，从而防止闪烁的视觉识别。
根据实施方式，如图2中所示，当在平面图中观察时，第一像素电路PC1和第一显示元件DE1可彼此至少部分地重叠，并且第二像素电路PC2和第二显示元件DE2可彼此至少部分地重叠。
根据另一实施方式，如图3中所示，当在平面图中观察时，第二像素电路PC2和第二显示元件DE2可彼此间隔开。换句话说，第二像素电路PC2和第二显示元件DE2可彼此不重叠。
图4是根据实施方式的第一像素PX1的等效电路图。
参照图4，第一像素PX1连接到分别发送第一扫描信号GW、第二扫描信号GC、第三扫描信号GI和第四扫描信号GB的第一扫描线GWL、第二扫描线GCL、第三扫描线GIL和第四扫描线GBL、发送第一数据电压Dm1的第一数据线DL1以及发送光发射控制信号EM的光发射控制线EML。第一像素PX1连接到发送第一驱动电压ELVDD的第一电源线PL1和发送第一初始化电压VINT1的第一电压线VL1。第一像素PX1包括施加有第二驱动电压ELVSS的公共电极。
第一扫描线GWL对应于图1的第一扫描线SL1_i，第二扫描线GCL对应于图1的第二扫描线SL2_i，第三扫描线GIL对应于图1的第三扫描线SL3_i，第四扫描线GBL对应于图1的第一扫描线SL1_i+1，并且光发射控制线EML对应于图1的光发射控制线EML_i。第一数据线DL1对应于图1的第一数据线DL_j，并且第一电源线PL1对应于图1的第一电源线PL_j。
现在将对包括在第一像素PX1中的器件进行描述。
第一像素PX1包括第一显示元件DE1、第一晶体管T11至第七晶体管T71、第一存储电容器Cst1和第一升压电容器Cbs1。第一显示元件DE1可为具有阳极和阴极的有机发光二极管。阴极可为施加有第二驱动电压ELVSS的公共电极。
第一晶体管T11至第七晶体管T71中的一些可为NMOS(n沟道MOSFET)，并且其它的可为PMOS(p沟道MOSFET)。例如，来自第一晶体管T11至第七晶体管T71之中的第三晶体管T31和第四晶体管T41可为NMOS(n沟道MOSFET)，并且其余的可为PMOS(p沟道MOSFET)。
根据另一实施方式，来自第一晶体管T11至第七晶体管T71之中的第三晶体管T31、第四晶体管T41和第七晶体管T71可为NMOS，并且其余的可为PMOS。可替代地，第一晶体管T11至第七晶体管T71中的仅一个可为NMOS，并且其它的可为PMOS。可替代地，第一晶体管T11至第七晶体管T71中的所有可为NMOS或PMOS。
第一晶体管T11可为其中漏极电流的大小根据栅-源电压来确定的驱动晶体管，并且第二晶体管T21至第七晶体管T71可为根据栅-源电压(实质上的栅极电压)而导通/关断的开关晶体管。
第一晶体管T11可称为第一驱动晶体管，第二晶体管T21可称为第一扫描晶体管，第三晶体管T31可称为第一补偿晶体管，第四晶体管T41可称为第一栅极初始化晶体管，第五晶体管T51可称为第一操作控制晶体管，第六晶体管T61可称为第一光发射控制晶体管，并且第七晶体管T71可称为第一阳极初始化晶体管。
第一存储电容器Cst1连接在第一电源线PL1与第一驱动晶体管T11的栅极之间。第一存储电容器Cst1可具有连接到第一电源线PL1的第二电极CE2和连接到第一驱动晶体管T11的栅极的第一电极CE1。
第一驱动晶体管T11可根据栅-源电压来控制从第一电源线PL1流到第一显示元件DE1的第一电流Id1的大小。第一驱动晶体管T11可包括连接到第一存储电容器Cst1的第一电极CE1的栅极、通过第一操作控制晶体管T51连接到第一电源线PL1的源极以及通过第一光发射控制晶体管T61连接到第一显示元件DE1的漏极。
第一驱动晶体管T11可根据栅-源电压将第一电流Id1输出到第一显示元件DE1。基于第一驱动晶体管T11的栅-源电压与阈值电压之间的差来确定第一电流Id1的大小。第一显示元件DE1可从第一驱动晶体管T11接收第一电流Id1，并且发射具有基于第一电流Id1的大小的亮度的光。
响应于第一扫描信号GW，第一扫描晶体管T21将第一数据电压Dm1发送到第一驱动晶体管T11的源极。第一扫描晶体管T21可具有连接到第一扫描线GWL的栅极、连接到第一数据线DL1的源极和连接到第一驱动晶体管T11的源极的漏极。
响应于第二扫描信号GC，第一补偿晶体管T31将第一驱动晶体管T11的漏极和栅极彼此连接。第一补偿晶体管T31可具有连接到第二扫描线GGL的栅极、连接到第一驱动晶体管T11的栅极的源极和连接到第一驱动晶体管T11的漏极的漏极。
响应于第三扫描信号GI，第一栅极初始化晶体管T41将第一初始化电压VINT1施加到第一驱动晶体管T11的栅极。第一栅极初始化晶体管T41可具有连接到第三扫描线GIL的栅极、连接到第一电压线VL1的源极和连接到第一驱动晶体管T11的栅极的漏极。
响应于第四扫描信号GB，第一阳极初始化晶体管T71将第一初始化电压VINT1施加到第一显示元件DE1的阳极。第一阳极初始化晶体管T71可具有连接到第四扫描线GBL的栅极、连接到第一显示元件DE1的阳极的源极和连接到第一电压线VL1的漏极。
在图4中，第一栅极初始化晶体管T41和第一阳极初始化晶体管T71连接到第一电压线VL1。然而，根据另一实施方式，第一栅极初始化晶体管T41和第一阳极初始化晶体管T71可连接到不同的电压线。稍后将参照图7对此进行描述。
响应于光发射控制信号EM，第一操作控制晶体管T51可将第一电源线PL1连接到第一驱动晶体管T11的源极。第一操作控制晶体管T51可具有连接到光发射控制线EML的栅极、连接到第一电源线PL1的源极和连接到第一驱动晶体管T11的源极的漏极。
响应于光发射控制信号EM，第一光发射控制晶体管T61可将第一驱动晶体管T11的漏极连接到第一显示元件DE1的阳极。第一光发射控制晶体管T61可具有连接到光发射控制线EML的栅极、连接到第一驱动晶体管T11的漏极的源极和连接到第一显示元件DE1的阳极的漏极。
第一扫描信号GW可与第二扫描信号GC实质上同步。第三扫描信号GI可与前一行上的第一扫描信号GW实质上同步。第四扫描信号GB可与第一扫描信号GW实质上同步。根据另一实例，第四扫描信号GB可与下一行上的第一扫描信号GW实质上同步。
第一升压电容器Cbs1可包括连接到第一存储电容器Cst1的第一电极CE1的第一电极CE1'和连接到第一扫描晶体管T21的栅极的第二电极CE2'。第一升压电容器Cbs1的第二电极CE2'可被提供有第一扫描信号GW。第一升压电容器Cbs1可通过在当第一扫描信号GW的提供被停止时的时间点增加第一驱动晶体管T11的栅极的电压来补偿栅极的电压降。
现在将对作为根据实施方式的有机发光显示器的一个像素的第一像素PX1的详细操作过程进行详细描述。
首先，响应于高电平的光发射控制信号EM，第一操作控制晶体管T51和第一光发射控制晶体管T61被关断，并且第一驱动晶体管T11停止输出第一电流Id1，并且第一显示元件DE1停止发射光。
此后，在当接收高电平的第三扫描信号GI时的栅极初始化时段期间，第一栅极初始化晶体管T41导通，并且第一初始化电压VINT1被施加到第一驱动晶体管T11的栅极，即，施加到第一存储电容器Cst1的第一电极CE1。第一存储电容器Cst1存储第一驱动电压ELVDD与第一初始化电压VINT1之间的差(ELVDD-VINT1)。
然后，在当接收低电平的第一扫描信号GW和高电平的第二扫描信号GC时的数据写入时段期间，第一扫描晶体管T21和第一补偿晶体管T31导通，并且通过第一驱动晶体管T11的源极接收第一数据电压Dm1。第一驱动晶体管T11通过第一补偿晶体管T31以二极管形式被连接，并且在正向方向上偏置。第一驱动晶体管T11的栅极电压从第一初始化电压VINT1增加。当第一驱动晶体管T11的栅极电压变成等于通过从第一数据电压Dm1减去第一驱动晶体管T11的阈值电压Vth而获得的数据补偿电压(Dm1-|Vth|)时，第一驱动晶体管T11被关断，并且同时第一驱动晶体管T11的栅极电压停止增加。相应地，第一存储电容器Cst1存储第一驱动电压ELVDD与数据补偿电压(Dm1-|Vth|)之间的差(ELVDD-Dm1+|Vth|)。
在当接收低电平的第四扫描信号GB时的阳极初始化时段期间，第一阳极初始化晶体管T71导通，并且第一初始化电压VINT1被施加到第一显示元件DE1的阳极。通过将第一初始化电压VINT1施加到第一显示元件DE1的阳极，使第一显示元件DE1完全不发射光，可防止与下一帧中的黑色灰度对应的第一显示元件DE1的微光发射。
第一扫描信号GW和第四扫描信号GB可彼此实质上同步。在这种情况下，数据写入时段和阳极初始化时段可为相同的时段。
此后，响应于低电平的光发射控制信号EM，第一操作控制晶体管T51和第一光发射控制晶体管T61可导通，第一驱动晶体管T11可输出与通过从存储在第一存储电容器Cst1中的电压，即，第一驱动晶体管T11的源-栅电压(ELVDD-Dm1+|Vth|)减去第一驱动晶体管T11的阈值电压|Vth|而获得的电压(ELVDD-Dm1)对应的第一电流Id1，并且第一显示元件DE1可发射具有与第一电流Id1的大小对应的亮度的光。
根据实施方式，第一晶体管T11至第七晶体管T71中的至少一个包括包含有氧化物的半导体层，并且其它的包括包含有硅的半导体层。
详细地，直接影响显示设备的亮度的第一驱动晶体管T11包括包含有多晶硅的半导体层，该多晶硅具有高可靠性，并且因此可实现高分辨率显示设备。
因为氧化物半导体具有高载流子迁移率和低泄漏电流，所以即使在驱动时间长时电压降也不大。换句话说，因为即使在低频驱动期间，根据电压降的图像的颜色的变化也不大，所以低频驱动是可能的。
因为如上所述，氧化物半导体具有小的泄漏电流，所以连接到第一驱动晶体管T11的栅极的第一补偿晶体管T31、第一栅极初始化晶体管T41和第一阳极初始化晶体管T71中的至少一个采用氧化物半导体，使得可防止泄漏电流流到第一驱动晶体管T11的栅极并且还可降低功耗。
图5是根据实施方式的第二像素PX2的等效电路图。
参照图5，第二像素PX2连接到分别发送第一扫描信号GW、第二扫描信号GC、第三扫描信号GI和第四扫描信号GB的第一扫描线GWL、第二扫描线GCL、第三扫描线GIL和第四扫描线GBL、发送第二数据电压Dm2的第二数据线DL2以及发送光发射控制信号EM的光发射控制线EML。第二像素PX2连接到发送第一驱动电压ELVDD的第二电源线PL2和发送第二初始化电压VINT2的第二电压线VL2。第二像素PX2包括施加有第二驱动电压ELVSS的公共电极。
第一扫描线GWL对应于图1的第一扫描线SL1_i，第二扫描线GCL对应于图1的第二扫描线SL2_i，第三扫描线GIL对应于图1的第三扫描线SL3_i，第四扫描线GBL对应于图1的第一扫描线SL1_i+1，并且光发射控制线EML对应于图1的光发射控制线EML_i。第二数据线DL2对应于图1的第二数据线DL_k，并且第二电源线PL2对应于图1的第二电源线PL_k。
第二像素PX2包括第二显示元件DE2、第一晶体管T12至第七晶体管T72、第二存储电容器Cst2和第二升压电容器Cbs2。第二显示元件DE2可为具有阳极和阴极的有机发光二极管。阴极可为施加有第二驱动电压ELVSS的公共电极。
第二晶体管T12可为其中漏极电流的大小根据栅-源电压来确定的驱动晶体管，并且第二晶体管T22至第七晶体管T72可为根据栅-源电压(实质上的栅极电压)而导通/关断的开关晶体管。
第一晶体管T12可称为第二驱动晶体管，第二晶体管T22可称为第二扫描晶体管，第三晶体管T32可称为第二补偿晶体管，第四晶体管T42可称为第二栅极初始化晶体管，第五晶体管T52可称为第二操作控制晶体管，第六晶体管T62可称为第二光发射控制晶体管，并且第七晶体管T72可称为第二阳极初始化晶体管。
第二存储电容器Cst2可具有连接到第二电源线PL2的第四电极CE4和连接到第二驱动晶体管T12的栅极的第三电极CE3。
第二升压电容器Cbs2可包括连接到第二存储电容器Cst2的第三电极CE3的第三电极CE3'和连接到第二扫描晶体管T22的栅极的第四电极CE4'。
第二驱动晶体管T12可根据栅-源电压将第二电流Id2输出到第二显示元件DE2。基于第二驱动晶体管T12的栅-源电压与阈值电压之间的差来确定第二电流Id2的大小。第二显示元件DE2可从第二驱动晶体管T12接收第二电流Id2，并且发射具有基于第二电流Id2的大小的亮度的光。
响应于第三扫描信号GI，第二栅极初始化晶体管T42将第二初始化电压VINT2施加到第二驱动晶体管T12的栅极。第二栅极初始化晶体管T42可具有连接到第三扫描线GIL的栅极、连接到第二电压线VL2的源极和连接到第二驱动晶体管T12的栅极的漏极。
响应于第四扫描信号GB，第二阳极初始化晶体管T72将第二初始化电压VINT2施加到第二显示元件DE2的阳极。第二阳极初始化晶体管T72可具有连接到第四扫描线GBL的栅极、连接到第二显示元件DE2的阳极的源极和连接到第二电压线VL2的漏极。
在图5中，第二栅极初始化晶体管T42和第二阳极初始化晶体管T72连接到第二电压线VL2。然而，根据另一实施方式，第二栅极初始化晶体管T42和第二阳极初始化晶体管T72可连接到不同的电压线。稍后将参照图8对此进行描述。
除了第一像素PX1和第二像素PX2分别连接到第一电压线VL1和第二电压线VL2之外，相同的操作过程同样适用于图4的第一像素PX1和图5的第二像素PX2。
第二驱动晶体管T12可对应于图4的第一驱动晶体管T11，第二扫描晶体管T22可对应于图4的第一扫描晶体管T21，第二补偿晶体管T32可对应于图4的第一补偿晶体管T31，第二栅极初始化晶体管T42可对应于图4的第一栅极初始化晶体管T41，第二操作控制晶体管T52可对应于图4的第一操作控制晶体管T51，第二光发射控制晶体管T62可对应于图4的第一光发射控制晶体管T61，并且第二阳极初始化晶体管T72可对应于图4的第一阳极初始化晶体管T71。第二存储电容器Cst2可对应于图4的第一存储电容器Cst1，并且第二升压电容器Cbs2可对应于图4的第一升压电容器Cbs1。
图6是根据另一实施方式的第一像素PX1和第二像素PX2的示意图。图6是对图2的修改，并且因此与图2的不同之处在于电压布线的结构和初始化电压。它们之间的重复内容将用图2的描述代替，并且现在将主要对差异进行描述。
参照图6，第一像素电路PC1和第二像素电路PC2可连接到发送第一扫描信号Sg1的第一扫描线SWL1和发送第二扫描信号Sg2的第二扫描线SWL2。
第一像素电路PC1可连接到发送第一初始化电压VINT1的第一电压线VL1和发送第三初始化电压VINT3的第三电压线VL3。第二像素电路PC2可连接到发送第二初始化电压VINT2的第二电压线VL2和发送第四初始化电压VINT4的第四电压线VL4。
在这种情况下，第一初始化电压VINT1的电平可与第二初始化电压VINT2的电平不同。第三初始化电压VINT3的电平可与第四初始化电压VINT4的电平不同。例如，第三初始化电压VINT3的电平可高于第四初始化电压VINT4的电平。可替代地，第四初始化电压VINT4的电平可高于第三初始化电压VINT3的电平。
第一扫描线SWL1可对应于稍后将描述的图7和图8的第三扫描线GIL，并且第二扫描线SWL2可对应于图7和图8的第四扫描线GBL。第一初始化电压VINT1可与第一扫描信号Sg1同步地施加到第一像素电路PC1的第一驱动晶体管T11(参见图7)的栅极，并且第二初始化电压VINT2可与第一扫描信号Sg1同步地施加到第二像素电路PC2的第二驱动晶体管T12(参见图8)的栅极。第三初始化电压VINT3可与第二扫描信号Sg2同步地施加到第一显示元件DE1的阳极，并且第四初始化电压VINT4可与第二扫描信号Sg2同步地施加到第二显示元件DE2的阳极。
根据实施方式，具有不同电平的第一初始化电压VINT1与第二初始化电压VINT2以及第三初始化电压VINT3与第四初始化电压VINT4被分别施加到具有不同尺寸的第一像素电路PC1和第二像素电路PC2，使得第一像素PX1和第二像素PX2两者中的帧之间的亮度差被减小，从而防止闪烁的视觉识别。
根据实施方式，如图6中所示，当在平面图中观察时，第一像素电路PC1和第一显示元件DE1可彼此至少部分地重叠，并且第二像素电路PC2和第二显示元件DE2可彼此至少部分地重叠。
根据另一实施方式，如图3中所示，当在平面图中观察时，第二像素电路PC2和第二显示元件DE2可彼此间隔开。换句话说，第二像素电路PC2和第二显示元件DE2可彼此不重叠。
图7是根据另一实施方式的第一像素PX1的等效电路图。图7是对图4的修改，并且因此与图4的不同之处在于电压布线的结构和初始化电压。在下文中，它们之间的重复内容将用图4的描述代替，并且将主要对差异进行描述。
参照图7，第一像素PX1连接到发送第一初始化电压VINT1的第一电压线VL1和发送第三初始化电压VINT3的第三电压线VL3。
第一栅极初始化晶体管T41和第一阳极初始化晶体管T71可连接到彼此不同的电压线。例如，如图7中所示，第一栅极初始化晶体管T41可连接到第一电压线VL1，并且第一阳极初始化晶体管T71可连接到第三电压线VL3。
响应于第三扫描信号GI，第一栅极初始化晶体管T41可将第一初始化电压VINT1施加到第一驱动晶体管T11的栅极，并且响应于第四扫描信号GB，第一阳极初始化晶体管T71可将第三初始化电压VINT3施加到第一显示元件DE1的阳极。
第三初始化电压VINT3的电平可高于第一初始化电压VINT1的电平，并且可低于比第二驱动电压ELVSS高了第一显示元件DE1的阈值电压的电压电平。因为第一显示元件DE1具有相对大的尺寸，所以第一显示元件DE1具有显著大的电容。此外，因为第一初始化电压VINT1的电平太低，所以第一显示元件DE1在下一帧中经过相当长的延迟时间后才开始发射光。然而，根据实施方式，第一显示元件DE1的阳极用具有比第一初始化电压VINT1的电平更高的电平的第三初始化电压VINT3进行初始化，使得第一显示元件DE1可在短时间段内开始发射光。换句话说，可解决光发射延迟。
图8是根据另一实施方式的第二像素PX2的等效电路图。图8是对图5的修改，并且因此与图5的不同之处在于电压布线的结构和初始化电压。在下文中，它们之间的重复内容将用图5的描述代替，并且将主要对差异进行描述。
参照图8，第二像素PX2连接到发送第二初始化电压VINT2的第二电压线VL2和发送第四初始化电压VINT4的第四电压线VL4。
第二栅极初始化晶体管T42和第二阳极初始化晶体管T72可连接到不同的电压线。例如，如图8中所示，第二栅极初始化晶体管T42可连接到第二电压线VL2，并且第二阳极初始化晶体管T72可连接到第四电压线VL4。
响应于第三扫描信号GI，第二栅极初始化晶体管T42可将第二初始化电压VINT2施加到第二驱动晶体管T12的栅极，并且响应于第四扫描信号GB，第二阳极初始化晶体管T72可将第四初始化电压VINT4施加到第二显示元件DE2的阳极。
第四初始化电压VINT4的电平可高于第二初始化电压VINT2的电平，并且可低于比第二驱动电压ELVSS高了第二显示元件DE2的阈值电压的电压电平。因为第二显示元件DE2具有相对大的尺寸，所以第二显示元件DE2具有显著大的电容。此外，因为第二初始化电压VINT2的电平太低，所以第二显示元件DE2在下一帧中经过相当长的延迟时间之后才开始发射光。然而，根据实施方式，第二显示元件DE2的阳极用具有比第二初始化电压VINT2的电平更高的电平的第四初始化电压VINT4进行初始化，使得第二显示元件DE2可在短时间段内开始发射光。换句话说，可解决光发射延迟。
图9是根据实施方式的显示装置1的示意性透视图。
参照图9，显示装置1可包括显示区域DA和在显示区域DA周围的外围区域PA。显示区域DA可包括第二区域AR2和围绕第二区域AR2的至少一部分的第一区域AR1。换句话说，第二区域AR2和第一区域AR1可单独地显示图像，或者一起显示图像。外围区域PA可为其中不包括排列的显示元件的非显示区域。显示区域DA可被外围区域PA完全围绕。
图9示出了一个第二区域AR2在第一区域AR1内的定位。根据另一实施方式，显示装置1可具有两个或更多个第二区域AR2，并且多个第二区域AR2可具有不同的形状和不同的尺寸。当在大致垂直于显示装置1的上表面的方向上(在+z方向上)观察时，第二区域AR2可具有诸如圆形形状、椭圆形形状或多边形形状(例如，矩形形状、星形形状或菱形形状)的各种形状中的任何一种。在图9中，当在大致垂直于显示装置1的上表面的方向上观察时，第二区域AR2排列在具有大致矩形形状的第一区域AR1的上部(在+y方向上)的中心处，但是第二区域AR2可排列在第一区域AR1的一侧，例如，右上侧或左上侧上。
显示装置1可通过使用排列在显示区域DA中的多个像素PX来提供图像。显示装置1可通过使用排列在第一区域AR1中的多个第一像素PX1和排列在第二区域AR2中的多个第二像素PX2来提供图像。多个第一像素PX1和多个第二像素PX2中的每一个可包括显示元件。多个第一像素PX1和多个第二像素PX2中的每一个可包括诸如发光二极管(OLED)的显示元件。多个像素PX中的每一个可经由OLED发射例如红色光、绿色光、蓝色光或白色光。多个像素PX中的每一个是指发射不同颜色的光束的子像素，并且可为例如红色子像素、绿色子像素和蓝色子像素中的一个。
在第二区域AR2中，如稍后将参照图10描述的，作为电子元件的部件30可排列在显示面板下方以对应于第二区域AR2。部件30是使用红外光、可见光等的相机，并且可包括拍摄器件。可替代地，部件30可为太阳能电池、闪光灯、照度传感器、接近传感器或虹膜传感器。可替代地，部件30可具有接收声音的功能。为了最小化对部件30的功能的限制，第二区域AR2可包括能够将从部件30输出到外部或从外部朝向部件30行进的光或/和声音透射的透射区域TA。在显示面板和包括显示面板的显示设备中，根据实施方式，当光通过第二区域AR2透射时，第二区域AR2中的透光率可为约10％或更大，例如，40％或更大、25％或更大、50％或更大、85％或更大、或90％或更大。
多个第二像素PX2可排列在第二区域AR2中。多个第二像素PX2可发射光以提供某一图像。由第二区域AR2显示的图像是辅助图像，并且因此可比由第一区域AR1显示的图像具有更低的分辨率。换句话说，当第二区域AR2包括能够透射光和声音的透射区域TA并且在透射区域TA中没有排列像素时，在第二区域AR2中在单位面积上可排列的第二像素PX2的数量可小于在第一区域AR1中在单位面积上排列的第一像素PX1的数量。
图10是根据实施方式的显示装置1的剖面的一部分的示意性剖面图。
参照图10，显示装置1可包括显示面板10和与显示面板10重叠的部件30。覆盖窗可进一步位于显示面板10上面，以保护显示面板10。
显示面板10包括与部件30重叠的第二区域AR2和其上显示有主图像的第一区域AR1。显示面板10可包括衬底1000、位于衬底1000上的显示层DISL和位于衬底1000下方的保护构件PB。因为显示面板10包括衬底1000，所以可理解为第二区域AR2和第一区域AR1限定在衬底1000中。
显示层DISL可包括包含有晶体管TFT的电路层PCL、包括第一显示元件DE1和第二显示元件DE2的显示元件层EDL以及诸如封装衬底的封装构件ENCM。绝缘层IL和IL'可排列在衬底1000与显示层DISL之间以及在显示层DISL内。
衬底1000可包括绝缘材料，诸如玻璃、石英和聚合物树脂。衬底1000可为刚性衬底或可弯曲、可折叠或可卷曲的柔性衬底。
显示面板10可通过使用多个像素PX来提供图像。来自像素PX之中的第一像素PX1可排列在第一区域AR1中，并且来自像素PX之中的第二像素PX2可排列在第二区域AR2中。第一像素PX1可包括包含有晶体管TFT的第一像素电路PC1和连接到第一像素电路PC1的第一显示元件DE1，并且第二像素PX2可包括包含有晶体管TFT的第二像素电路PC2和连接到第二像素电路PC2的第二显示元件DE2。
在第二区域AR2中可排列有其中不具有排列的第二像素PX2的透射区域TA。透射区域TA可透射由排列成对应于第二区域AR2的部件30发射的光/信号或者透射入射到部件30上的光/信号。第二像素PX2和透射区域TA可在第二区域AR2内彼此交替地排列。
在衬底1000与显示层DISL之间以及在显示层DISL内排列的绝缘层IL和IL'中的每一个可具有至少一个开口。从部件30发射或指向部件30的光可穿过绝缘层IL和IL'中的每一个的开口。绝缘层IL和IL'中的每一个的开口可位于透射区域TA中，并且可允许指向部件30的光或从部件30发射的光移动。
显示元件层EDL可被封装构件ENCM覆盖。封装构件ENCM可为封装衬底或薄膜封装层。
根据实施方式，封装构件ENCM可为封装衬底。封装衬底可排列成隔着显示元件层EDL面对衬底1000。在封装衬底与显示元件层EDL之间可存在有间隙。封装衬底可包括玻璃。包括玻璃料等的密封剂可排列在衬底1000与封装衬底之间，并且可排列在以上参照图9描述的外围区域PA中。排列在外围区域PA中的密封剂可围绕显示区域DA，并且防止湿气通过显示面板10的侧表面渗透。
根据另一实施方式，封装构件ENCM可为薄膜封装层。薄膜封装层可包括至少一个无机封装层和至少一个有机封装层。例如，薄膜封装层可包括第一无机封装层、第二无机封装层和介于它们之间的有机封装层。
保护构件PB可附接到衬底1000的下表面，并且可支承和保护衬底1000。保护构件PB可包括对应于第二区域AR2的开口PB_OP。在保护构件PB中包括开口PB_OP可改善第二区域AR2的透光率。保护构件PB可包括聚对苯二甲酸乙二醇酯(PET)或聚酰亚胺(PI)。
第二区域AR2可比排列有部件30的区域具有更大的面积。因此，包括在保护构件PB中的开口PB_OP的面积可与第二区域AR2的面积不同。
多个部件30可排列在第二区域AR2中。多个部件30可执行不同的功能。例如，多个部件30可包括相机(成像器件)、太阳能电池、闪光灯、接近传感器、照度传感器和虹膜传感器中的至少两个。
图11是根据实施方式的可包括在图9的显示装置1中的显示面板10a的示意性平面图。
参照图11，构成显示面板10a的各种部件可排列在衬底1000上。显示面板10a可包括显示区域DA和围绕显示区域DA的外围区域PA。显示区域DA可包括其上显示有主图像的第一区域AR1和包括透射区域TA并且其上显示有辅助图像的第二区域AR2。辅助图像可与主图像一起形成单个完整图像，或者可为独立于主图像的图像。
因为第二区域AR2具有透射区域TA，所以第二区域AR2的分辨率可低于第一区域AR1的分辨率。例如，第二区域AR2的分辨率可为第一区域AR1的分辨率的约1/2、3/8、1/3、1/4、2/9、1/8、1/9、1/12.25或1/16。例如，第一区域AR1的分辨率可为约400ppi或更大，并且第二区域AR2的分辨率可为约200ppi或约100ppi。
如以上参照图9和图10所描述的，第一像素PX1可排列在第一区域AR1中，并且第二像素PX2可排列在第二区域AR2中。图11示出了来自第一像素PX1和第二像素PX2之中的位于同一行上的第一像素PX1和第二像素PX2。
第一像素PX1可包括第一像素电路PC1和第一显示元件DE1，并且第二像素PX2可包括第二像素电路PC2和第二显示元件DE2。
根据实施方式，如图11中所示，第二显示元件DE2的发射面积可大于第一显示元件DE1的发射面积。第二像素电路PC2的尺寸(或面积)可大于第一像素电路PC1的尺寸(或面积)。换句话说，第一显示元件DE1的发射面积和第二显示元件DE2的发射面积可彼此不同，并且第一像素电路PC1的尺寸和第二像素电路PC2的尺寸可彼此不同。
第一像素电路PC1和第二像素电路PC2可电连接到排列在外围区域PA中的外部电路。在外围区域PA中可排列有焊盘部PAD、第一初始化电压供给线11和第二初始化电压供给线12。第一初始化电压供给线11和第二初始化电压供给线12中的每一个可具有其一侧为开口的环形形状，并且可部分地围绕显示区域DA。尽管在图11中示出了第一初始化电压供给线11和第二初始化电压供给线12中的每一个具有其一侧为开口的环形形状，但是第一初始化电压供给线11和第二初始化电压供给线12中的每一个可具有各种其它形状中的任何一种。在外围区域PA中可排列有栅极驱动电路、第一驱动电压供给线和第二驱动电压供给线。
焊盘部PAD可位于衬底1000的一侧上。焊盘部PAD可被暴露而不被绝缘层覆盖，并且可连接到显示电路板20。显示驱动单元22可位于显示电路板20上。
显示驱动单元22可生成被发送到栅极驱动电路的控制信号。显示驱动单元22可生成数据信号，并且所生成的数据信号可经由扇出布线和连接到扇出布线的数据线发送到位于同一列上的像素。
显示驱动单元22可将第一初始化电压VINT1供给到第一初始化电压供给线11，并且可将第二初始化电压VINT2供给到第二初始化电压供给线12。第一初始化电压VINT1可经由连接到第一初始化电压供给线11的第一电压线VL1施加到第一像素PX1的第一像素电路PC1，并且第二初始化电压VINT2可经由连接到第二初始化电压供给线12的第二电压线VL2施加到第二像素PX2的第二像素电路PC2。在这种情况下，第一初始化电压VINT1的电平可不同于第二初始化电压VINT2的电平。
根据实施方式，如图11中所示，第一电压线VL1可具有通过第二区域AR2而彼此物理地间隔开的第一部分VL1a和第二部分VL1b。第一电压线VL1的第一部分VL1a可连接到第一初始化电压供给线11的一侧，并且第一电压线VL1的第二部分VL1b可连接到第一初始化电压供给线11的另一侧。第一电压线VL1的第一部分VL1a和第二部分VL1b中的每一个可在行方向(例如，±x方向)上延伸。
与来自第一像素PX1之中的与第二像素PX2未排列在同一行上的第一像素PX1连接的第一电压线VL1可各自在没有任何间隙的情况下在行方向(例如，±x方向)上延伸。
根据实施方式，如图11中所示，第二电压线VL2可具有第一部分VL2a、第二部分VL2b和第三部分VL2c。第二电压线VL2的第一部分VL2a可将第二电压线VL2的第二部分VL2b连接到第二初始化电压供给线12。第二电压线VL2的第二部分VL2b可围绕第二区域AR2的至少一部分。第二电压线VL2的第三部分VL2c可连接到第二电压线VL2的第二部分VL2b，并且可在行方向(例如，±x方向)上延伸以连接到第二像素PX2的第二像素电路PC2。因为第二电压线VL2的第三部分VL2c在行方向(例如，±x方向)上延伸以连接到排列在同一行上的第二像素PX2，所以可包括有多个第三部分VL2c。
第一像素电路PC1和第二像素电路PC2中的每一个可连接到在行方向(例如，±x方向)上延伸的第一扫描线SWL1。第一扫描线SWL1可顺序地将第一扫描信号发送到第一像素电路PC1和第二像素电路PC2。第一扫描线SWL1可连接到排列在外围区域PA中的栅极驱动电路。
与由第一扫描线SWL1发送的第一扫描信号同步，第一初始化电压VINT1可施加到第一像素电路PC1的第一驱动晶体管的栅极，或者可施加到第一显示元件DE1的阳极。与由第一扫描线SWL1发送的第一扫描信号同步，第二初始化电压VINT2可施加到第二像素电路PC2的第二驱动晶体管的栅极，或者可施加到第二显示元件DE2的阳极。
这样，具有不同电平的第一初始化电压VINT1和第二初始化电压VINT2被施加到具有不同尺寸的第一像素电路PC1和第二像素电路PC2，使得第一像素PX1和第二像素PX2两者中的帧之间的亮度差被减小，从而防止闪烁的视觉识别。换句话说，可防止在具有不同分辨率的第一区域AR1和第二区域AR2两者中在视觉上识别到闪烁。
图12是根据另一实施方式的可包括在图9的显示装置1中的显示面板10b的示意性平面图。图12是对图11的修改，并且因此与图11的不同之处在于电压布线和初始化电压供给线的结构。在下文中，它们之间的重复内容将用图11的描述代替，并且为了简洁起见，将主要对差异进行描述。
参照图12，在显示面板10b的外围区域PA中还可排列有第三初始化电压供给线13和第四初始化电压供给线14。第三初始化电压供给线13和第四初始化电压供给线14中的每一个可具有其一侧为开口的环形形状，并且可部分地围绕显示区域DA。
图12示出了第四初始化电压供给线14、第二初始化电压供给线12、第三初始化电压供给线13和第一初始化电压供给线11顺序地与显示区域DA相邻。然而，第一初始化电压供给线11、第二初始化电压供给线12、第三初始化电压供给线13和第四初始化电压供给线14的排列顺序可改变。
显示驱动单元22可将第三初始化电压VINT3供给到第三初始化电压供给线13，并且可将第四初始化电压VINT4供给到第四初始化电压供给线14。第三初始化电压VINT3可经由连接到第三初始化电压供给线13的第三电压线VL3施加到第一像素PX1的第一像素电路PC1，并且第四初始化电压VINT4可经由连接到第四初始化电压供给线14的第四电压线VL4施加到第二像素PX2的第二像素电路PC2。此时，第三初始化电压VINT3的电平可不同于第四初始化电压VINT4的电平。
根据实施方式，如图12中所示，第三电压线VL3可具有通过第二区域AR2而彼此物理地间隔开的第一部分VL3a和第二部分VL3b。第三电压线VL3的第一部分VL3a可连接到第三初始化电压供给线13的一侧，并且第三电压线VL3的第二部分VL3b可连接到第三初始化电压供给线13的另一侧。第三电压线VL3的第一部分VL3a和第二部分VL3b中的每一个可在行方向(例如，±x方向)上延伸。
与来自第一像素PX1之中的与第二像素PX2未排列在同一行上的第一像素PX1连接的第三电压线VL3可各自在没有间隙的情况下在行方向(例如，±x方向)上延伸。
根据实施方式，如图12中所示，第四电压线VL4可具有第一部分VL4a、第二部分VL4b和第三部分VL4c。第四电压线VL4的第一部分VL4a可将第四电压线VL4的第二部分VL4b连接到第四初始化电压供给线14。第四电压线VL4的第二部分VL4b可围绕第二区域AR2的至少一部分。第四电压线VL4的第三部分VL4c可连接到第四电压线VL4的第二部分VL4b，并且可在行方向(例如，±x方向)上延伸以连接到第二像素PX2的第二像素电路PC2。因为第四电压线VL4的第三部分VL4c在行方向(例如，±x方向)上延伸以连接到排列在同一行上的第二像素PX2，所以可包括有多个第三部分VL4c。
第一像素电路PC1和第二像素电路PC2中的每一个可连接到在行方向(例如，±x方向)上延伸的第二扫描线SWL2。第二扫描线SWL2可顺序地将第二扫描信号发送到第一像素电路PC1和第二像素电路PC2。第二扫描线SWL2可连接到排列在外围区域PA中的栅极驱动电路。
第一初始化电压VINT1可与由第一扫描线SWL1发送的第一扫描信号同步地施加到第一像素电路PC1的第一驱动晶体管的栅极，并且第三初始化电压VINT3可与由第二扫描线SWL2发送的第二扫描信号同步地施加到第一显示元件DE1的阳极。第二初始化电压VINT2可与由第一扫描线SWL1发送的第一扫描信号同步地施加到第二像素电路PC2的第二驱动晶体管的栅极，并且第四初始化电压VINT4可与由第二扫描线SWL2发送的第二扫描信号同步地施加到第二显示元件DE2的阳极。
作为另一实例，第一初始化电压VINT1可与由第一扫描线SWL1发送的第一扫描信号同步地施加到第一显示元件DE1的阳极，并且第三初始化电压VINT3可与由第二扫描线SWL2发送的第二扫描信号同步地施加到第一像素电路PC1的第一驱动晶体管的栅极。第二初始化电压VINT2可与由第一扫描线SWL1发送的第一扫描信号同步地施加到第二显示元件DE2的阳极，并且第四初始化电压VINT4可与由第二扫描线SWL2发送的第二扫描信号同步地施加到第二像素电路PC2的第二驱动晶体管的栅极。
这样，具有不同电平的第一初始化电压VINT1与第二初始化电压VINT2以及第三初始化电压VINT3与第四初始化电压VINT4分别被施加到具有不同尺寸的第一像素电路PC1和第二像素电路PC2，使得第一像素PX1和第二像素PX2两者中的帧之间的亮度差被减小，从而防止闪烁的视觉识别。换句话说，可防止在具有不同分辨率的第一区域AR1和第二区域AR2两者中在视觉上识别到闪烁。
图13是根据另一实施方式的显示装置1'的剖面的一部分的示意性剖面图。图13是对图10的修改，并且因此与图10的不同之处在于第二像素的结构。在下文中，它们之间的重复内容将用图10的描述代替，并且为了简洁起见，将主要对差异进行描述。
参照图13，显示装置1'可包括显示面板10'和与显示面板10'重叠的部件30。在显示面板10'上面还可排列有覆盖窗以保护显示面板10'。
显示面板10'包括与部件30重叠的第二区域AR2和其上显示有主图像的第一区域AR1。显示面板10'可包括衬底1000、位于衬底1000上的显示层DISL、触摸屏层TSL和光学功能层OFL以及位于衬底1000下方的保护构件PB。
根据实施方式，驱动第二显示元件DE2的第二像素电路PC2可不排列在第二区域AR2中，而是可排列在外围区域PA中。根据另一实施方式，外围区域PA可排列在第一区域AR1与第二区域AR2之间。通过这种方式，可进行各种修改。换句话说，第二像素电路PC2可排列成不与第二显示元件DE2重叠。
第二像素电路PC2可包括至少一个薄膜晶体管TFT，并且可通过连接线TWL电连接到第二显示元件DE2。第二像素电路PC2可控制第二显示元件DE2的光发射。第二像素PX2可通过第二显示元件DE2的光发射来实现。连接线TWL可包括透明导电材料。因为连接线TWL可包括具有高透射率的透明导电材料，所以即使当连接线TWL排列在透射区域TA中时，也可确保透射区域TA的透射率。
作为显示元件的第一显示元件DE1和第二显示元件DE2可被薄膜封装层TFEL覆盖或被封装衬底覆盖。根据一些实施方式，薄膜封装层TFEL可包括至少一个无机封装层和至少一个有机封装层，如图13中所示。根据实施方式，薄膜封装层TFEL可包括第一无机封装层1310和第二无机封装层1330以及介于它们之间的有机封装层1320。
第一无机封装层1310和第二无机封装层1330可包括诸如氧化硅(SiO2)、氮化硅(SiNX)、氮氧化硅(SiOXNY)、氧化铝(Al2O3)、氧化钛(TiO2)、氧化钽(Ta2O5)、氧化铪(HfO2)或氧化锌(ZnOx)的至少一种无机绝缘材料，并且可通过化学气相沉积(CVD)形成。氧化锌(ZnOx)可为ZnO和/或ZnO2。有机封装层1320可包括聚合物基材料。聚合物基材料的实例可包括硅基树脂、丙烯酸基树脂、环氧基树脂、聚酰亚胺和聚乙烯。
第一无机封装层1310、有机封装层1320和第二无机封装层1330各自可一体地被设置为覆盖第一区域AR1和第二区域AR2。
触摸屏层TSL可基于外部输入，例如，触摸事件来获得坐标信息。触摸屏层TSL可包括触摸电极和连接到触摸电极的触摸布线。触摸屏层TSL可根据自电容法或互电容法来感测外部输入。
触摸屏层TSL可位于薄膜封装层TFEL上。可替代地，触摸屏层TSL可单独地设置在触摸衬底上，并且然后经由诸如光学透明粘合剂(OCA)的粘合层联接到薄膜封装层TFEL的上表面。根据实施方式，触摸屏层TSL可直接设置在薄膜封装层TFEL上。在这种情况下，在触摸屏层TSL与薄膜封装层TFEL之间可没有粘合层。
光学功能层OFL可包括抗反射层。抗反射层可减小从外部源朝向显示装置1'入射的光(外部光)的反射率。根据一些实施方式，光学功能层OFL可为偏振膜。根据一些实施方式，光学功能层OFL可使用包括黑色矩阵和滤色器的滤光板来实现。
图14是根据另一实施方式的可包括在图9的显示装置1中的显示面板10'a的示意性平面图。图14是对图11的修改，并且因此与图11的不同之处在于第二像素的结构。在下文中，它们之间的重复内容将用图11的描述代替，并且为了简洁起见，将主要对差异进行描述。
参照图14，显示面板10'a可包括显示区域DA和外围区域PA，显示区域DA包括第二区域AR2和围绕第二区域AR2的至少一部分的第一区域AR1，外围区域PA围绕显示区域DA的至少一部分。在这种情况下，第二区域AR2的一侧可接触外围区域PA，如图14中所示。
包括第一显示元件DE1和第一像素电路PC1的第一像素PX1可排列在第一区域AR1中。第一显示元件DE1和第一像素电路PC1可彼此至少部分地重叠。
第二像素PX2的第二显示元件DE2可排列在第二区域AR2中，并且第二像素PX2的第二像素电路PC2可排列在外围区域PA中。驱动第二显示元件DE2的第二像素电路PC2可不排列在第二区域AR2中，而是可排列在外围区域PA中。根据另一实施方式，外围区域PA可排列在第一区域AR1与第二区域AR2之间。通过这种方式，可进行各种修改。换句话说，第二像素电路PC2可排列成不与第二显示元件DE2重叠。
第二像素电路PC2可通过连接线TWL电连接到第二显示元件DE2。第二像素电路PC2可经由连接线TWL来控制第二显示元件DE2的光发射。第二像素PX2可通过第二显示元件DE2的光发射来实现。连接线TWL可包括透明导电材料。因为连接线TWL可包括具有高透射率的透明导电材料，所以即使当连接线TWL排列在透射区域TA中时，也可确保透射区域TA的透射率。
第一像素PX1的第一像素电路PC1可经由第一电压线VL1'连接到第一初始化电压供给线11，以接收第一初始化电压VINT1。第一电压线VL1'可在行方向(例如，±x方向)上延伸，并且可与第一区域AR1至少部分地重叠。
第一电压线VL1'可具有通过第二区域AR2而彼此物理地分离的第一部分VL1'a和第二部分VL1'b。第一电压线VL1'的第一部分VL1'a可连接到第一初始化电压供给线11的一侧，并且第一电压线VL1'的第二部分VL1'b可连接到第一初始化电压供给线11的另一侧。
第二像素PX2的第二像素电路PC2可经由第二电压线VL2'连接到第二初始化电压供给线12，以接收第二初始化电压VINT2。第二电压线VL2'可排列在外围区域PA中，并且在行方向(例如，±x方向)上延伸。第二电压线VL2'的两端可分别连接到第二初始化电压供给线12的一侧和另一侧。
第一像素电路PC1和第二像素电路PC2可连接到第一扫描线SWL1'。第一扫描线SWL1'可具有在行方向(例如，±x方向)上延伸的第一部分SWL1'a、在列方向(例如，±y方向)上延伸的第二部分SWL1'b和在行方向(例如，±x方向)上延伸的第三部分SWL1'c。
第一扫描线SWL1'的第一部分SWL1'a可连接到第一像素电路PC1，第一扫描线SWL1'的第三部分SWL1'c可连接到第二像素电路PC2，并且第一扫描线SWL1'的第二部分SWL1'b可将第一部分SWL1'a连接到第三部分SWL1'c。第一扫描线SWL1'的第一部分SWL1'a可与第一区域AR1至少部分地重叠。第一扫描线SWL1'的第二部分SWL1'b和第三部分SWL1'c可与外围区域PA至少部分地重叠。
第一扫描线SWL1'可顺序地将第一扫描信号发送到第一像素电路PC1和第二像素电路PC2。与由第一扫描线SWL1'发送的第一扫描信号同步，第一初始化电压VINT1可施加到第一像素电路PC1的第一驱动晶体管的栅极，或者可施加到第一显示元件DE1的阳极。与由第一扫描线SWL1'发送的第一扫描信号同步，第二初始化电压VINT2可施加到第二像素电路PC2的第二驱动晶体管的栅极，或者可施加到第二显示元件DE2的阳极。
这样，具有不同电平的第一初始化电压VINT1和第二初始化电压VINT2分别被施加到具有不同尺寸的第一像素电路PC1和第二像素电路PC2，使得第一像素PX1和第二像素PX2两者中的帧之间的亮度差被减小，从而防止闪烁的视觉识别。换句话说，可防止在具有不同分辨率的第一区域AR1和第二区域AR2两者中在视觉上识别到闪烁。
图15是根据另一实施方式的可包括在图9的显示装置1中的显示面板10'b的示意性平面图；图15是对图14的修改，并且因此与图14的不同之处在于电压布线和初始化电压供给线的结构。在下文中，它们之间的重复内容将用图14的描述代替，并且为了简洁起见，将主要对差异进行描述。
参照图15，在显示面板10'b的外围区域PA中还可排列有第三初始化电压供给线13和第四初始化电压供给线14。第三初始化电压供给线13和第四初始化电压供给线14中的每一个可具有其一侧为开口的环形形状，并且可部分地围绕显示区域DA。
第一像素PX1的第一像素电路PC1可经由第三电压线VL3'连接到第三初始化电压供给线13，以接收第三初始化电压VINT3。第三电压线VL3'可在行方向(例如，±x方向)上延伸，并且可与第一区域AR1至少部分地重叠。
第三电压线VL3'可具有通过第二区域AR2而彼此物理地分离的第一部分VL3'a和第二部分VL3'b。第三电压线VL3'的第一部分VL3'a可连接到第三初始化电压供给线13的一侧，并且第三电压线VL3'的第二部分VL3'b可连接到第三初始化电压供给线13的另一侧。
第二像素PX2的第二像素电路PC2可经由第四电压线VL4'连接到第四初始化电压供给线14，以接收第四初始化电压VINT4。第四电压线VL4'可排列在外围区域PA中，并且在行方向(例如，±x方向)上延伸。第四电压线VL4'的两端可分别连接到第四初始化电压供给线14的一侧和另一侧。
第一像素电路PC1和第二像素电路PC2可连接到第二扫描线SWL2'。第二扫描线SWL2'可顺序地将第二扫描信号发送到分别驱动排列在同一行上的第一显示元件DE1和第二显示元件DE2的第一像素电路PC1和第二像素电路PC2。第二扫描线SWL2'可具有在行方向(例如，±x方向)上延伸的第一部分SWL2'a、在列方向(例如，±y方向)上延伸的第二部分SWL2'b和在行方向(例如，±x方向)上延伸的第三部分SWL2'c。
第二扫描线SWL2'的第一部分SWL2'a可连接到第一像素电路PC1，第二扫描线SWL2'的第三部分SWL2'c可连接到第二像素电路PC2，并且第二扫描线SWL2'的第二部分SWL2'b可将第一部分SWL2'a连接到第三部分SWL2'c。第二扫描线SWL2'的第一部分SWL2'a可与第一区域AR1至少部分地重叠。第二扫描线SWL2'的第二部分SWL2'b和第三部分SWL2'c可与外围区域PA至少部分地重叠。
第一初始化电压VINT1可与由第一扫描线SWL1'发送的第一扫描信号同步地施加到第一像素电路PC1的第一驱动晶体管的栅极，并且第三初始化电压VINT3可与由第二扫描线SWL2'发送的第二扫描信号同步地施加到第一显示元件DE1的阳极。第二初始化电压VINT2可与由第一扫描线SWL1'发送的第一扫描信号同步地施加到第二像素电路PC2的第二驱动晶体管的栅极，并且第四初始化电压VINT4可与由第二扫描线SWL2'发送的第二扫描信号同步地施加到第二显示元件DE2的阳极。
这样，具有不同电平的第一初始化电压VINT1与第二初始化电压VINT2以及第三初始化电压VINT3与第四初始化电压VINT4分别被施加到具有不同尺寸的第一像素电路PC1和第二像素电路PC2，使得第一像素PX1和第二像素PX2两者中的帧之间的亮度差被减小，从而防止闪烁的视觉识别。换句话说，可防止在具有不同分辨率的第一区域AR1和第二区域AR2两者中在视觉上识别到闪烁。
图16是根据另一实施方式的显示装置1”的示意性透视图。图16是对图9的修改，并且因此与图9的不同之处在于第二区域的结构。在下文中，它们之间的重复内容将用图9的描述代替，并且为了简洁起见，将主要对差异进行描述。
参照图16，显示装置1”的第二区域AR2可包括部件区域CA和至少部分地围绕部件区域CA的中间区域MA。中间区域MA可位于部件区域CA与第一区域AR1之间。在图16中，第二区域AR2位于第一区域AR1内部。然而，根据另一实施方式，第二区域AR2的一侧可延伸以接触外围区域PA。
第二像素PX2可排列在第二区域AR2的部件区域CA中，并且第三像素PX3可排列在第二区域AR2的中间区域MA中。第二像素PX2和第三像素PX3中的每一个可通过发射光来提供某一图像。由第二区域AR2显示的图像是辅助图像，并且因此可比由第一区域AR1显示的图像具有更低的分辨率。
因为第二区域AR2的部件区域CA可包括能够透射光和声音的透射区域TA，并且在透射区域TA中没有排列第二像素PX2，所以每单位面积的第二像素PX2的数量可小于每单位面积的第一像素PX1的数量。
因为第二区域AR2的中间区域MA不包括透射区域TA，但是包括排列在中间区域MA中的像素电路(例如，图17的第二像素电路PC2)以驱动部件区域CA中的第二像素PX2，所以每单位面积的第三像素PX3的数量可小于每单位面积的第一像素PX1的数量。
因为在第二区域AR2内的分辨率可相同，所以每单位面积的第二像素PX2的数量可等于每单位面积的第三像素PX3的数量。
图17是根据另一实施方式的显示装置1”的剖面的一部分的示意性剖面图。图17是对图10的修改，并且因此与图10的不同之处在于第二区域的结构。在下文中，它们之间的重复内容将用图10的描述代替，并且为了简洁起见，将主要对差异进行描述。
参照图17，显示装置1”可包括显示面板10”和与显示面板10”重叠的部件30。显示面板10”可包括其上显示有辅助图像的第二区域AR2和其上显示有主图像的第一区域AR1。第二区域AR2可包括作为与部件30重叠的区域的部件区域CA和围绕部件区域CA的中间区域MA。
第一显示元件DE1和与其连接的第一像素电路PC1可排列在显示面板10”的第一区域AR1中。第一像素电路PC1可包括至少一个薄膜晶体管TFT，并且可控制第一显示元件DE1的操作。第一像素PX1可通过第一显示元件DE1的光发射来实现。
第二显示元件DE2可排列在显示面板10”的部件区域CA中以实现第二像素PX2。根据实施方式，第二像素电路PC2可排列成不与第二显示元件DE2重叠。换句话说，驱动第二显示元件DE2的第二像素电路PC2可不排列在部件区域CA中，而是可排列在位于第一区域AR1与部件区域CA之间的中间区域MA中。
第二像素电路PC2可包括至少一个薄膜晶体管TFT，并且可通过连接线TWL电连接到第二显示元件DE2。连接线TWL可包括透明导电材料。第二像素电路PC2可控制第二显示元件DE2的操作。第二像素PX2可通过第二显示元件DE2的光发射来实现。
部件区域CA中的没有排列第二显示元件DE2的区域可被限定为透射区域TA。透射区域TA可透射由排列成对应于部件区域CA的部件30发射的光/信号或透射入射到部件30上的光/信号。
将第二像素电路PC2连接到第二显示元件DE2的连接线TWL可排列成与透射区域TA至少部分地重叠。因为连接线TWL可包括具有高透射率的透明导电材料，所以即使当连接线TWL排列在透射区域TA中时，也可确保透射区域TA的透射率。根据实施方式，因为第二像素电路PC2没有排列在部件区域CA中，所以可容易地增加透射区域TA的面积，并且可进一步改善透光率。
在显示面板10”的中间区域MA中可排列有第三显示元件DE3和与其连接的第三像素电路PC3，以实现第三像素PX3。排列在中间区域MA中的第二像素电路PC2和第三像素电路PC3可彼此相邻并且可彼此交替。
如图17中所示，在中间区域MA的第二像素电路PC2和第三像素电路PC3下可排列有底部金属层BML。底部金属层BML可排列成与像素电路重叠以保护像素电路。根据实施方式，底部金属层BML可排列在衬底1000的面对中间区域MA的部分与第二像素电路PC2和第三像素电路PC3之间，以与第二像素电路PC2和第三像素电路PC3重叠。底部金属层BML可防止外部光到达第二像素电路PC2和第三像素电路PC3。根据另一实施方式，底部金属层BML可排列成对应于整个显示区域DA，并且可包括对应于部件区域CA的底部孔。根据另一实施方式，可省略底部金属层BML。
图18是根据实施方式的可包括在图16的显示装置1”中的显示面板10”a的示意性平面图。图18是对图11的修改，并且因此与图11的不同之处在于第二像素和第三像素的结构。在下文中，它们之间的重复内容将用图11的描述代替，并且为了简洁起见，将主要对差异进行描述。
参照图18，显示面板10”a可包括显示区域DA和外围区域PA，显示区域DA包括第二区域AR2和围绕第二区域AR2的至少一部分的第一区域AR1，外围区域PA围绕显示区域DA的至少一部分。第二区域AR2可包括部件区域CA和围绕部件区域CA的至少一部分的中间区域MA。
包括第一显示元件DE1和第一像素电路PC1的第一像素PX1可排列在第一区域AR1中。第一显示元件DE1和第一像素电路PC1可彼此至少部分地重叠。
第二显示元件DE2可排列在第二区域AR2的部件区域CA中，并且第二像素电路PC2以及包括第三显示元件DE3和与第三显示元件DE3连接的第三像素电路PC3的第三像素PX3可排列在第二区域AR2的中间区域MA中。第二像素电路PC2可通过连接线TWL电连接到第二显示元件DE2。第二显示元件DE2和第二像素电路PC2可彼此不重叠，但是第三显示元件DE3和第三像素电路PC3可彼此至少部分地重叠。
根据实施方式，如图18中所示，第二显示元件DE2的发射面积可大于第一显示元件DE1的发射面积。第二显示元件DE2的发射面积可等于第三显示元件DE3的发射面积。第二像素电路PC2的尺寸(或面积)可大于第一像素电路PC1的尺寸(或面积)。第二像素电路PC2的尺寸(或面积)可等于第三像素电路PC3的尺寸(或面积)。
换句话说，第一显示元件DE1的发射面积和第二显示元件DE2的发射面积可彼此不同，并且第一像素电路PC1的尺寸和第二像素电路PC2的尺寸可彼此不同。第一显示元件DE1的发射面积和第三显示元件DE3的发射面积可彼此不同，并且第一像素电路PC1的尺寸和第三像素电路PC3的尺寸可彼此不同。第三像素电路PC3可与第二像素电路PC2实质上相同。第三像素电路PC3可具有与第二像素电路PC2的配置实质上相同的配置。例如，第三像素电路PC3可对应于图5或图8的第二像素电路PC2。
因为第二区域AR2的部件区域CA可包括能够透射光和声音的透射区域TA并且在透射区域TA中没有排列第二显示元件DE2，所以每单位面积的第二显示元件DE2的数量可小于每单位面积的第一显示元件DE1的数量。
因为第二区域AR2的中间区域MA不包括透射区域TA，但是第二像素电路PC2排列在中间区域MA中并且第三显示元件DE3没有排列在第二像素电路PC2上，所以每单位面积的第三显示元件DE3的数量可小于每单位面积的第一显示元件DE1的数量。
因为在第二区域AR2内的分辨率可相同，所以每单位面积的第二显示元件DE2的数量可等于每单位面积的第三显示元件DE3的数量。
第一像素PX1的第一像素电路PC1可经由第一电压线VL1”连接到第一初始化电压供给线11以接收第一初始化电压VINT1。第一电压线VL1”可在行方向(例如，±x方向)上延伸，并且可与第一区域AR1至少部分地重叠。
第一电压线VL1”可具有通过第二区域AR2而彼此物理地分离的第一部分VL1”a和第二部分VL1”b。第一电压线VL1”的第一部分VL1”a可连接到第一初始化电压供给线11的一侧，并且第一电压线VL1”的第二部分VL1”b可连接到第一初始化电压供给线11的另一侧。
第二像素PX2的第二像素电路PC2和第三像素PX3的第三像素电路PC3可经由第二电压线VL2”连接到第二初始化电压供给线12以接收第二初始化电压VINT2。第二电压线VL2”可在行方向(例如，±x方向)上延伸，并且可与第一区域AR1和中间区域MA至少部分地重叠。
第二电压线VL2”可具有通过部件区域CA而彼此物理地分离的第一部分VL2”a和第二部分VL2”b。第二电压线VL2”的第一部分VL2”a可连接到第二初始化电压供给线12的一侧，并且第二电压线VL2”的第二部分VL2”b可连接到第二初始化电压供给线12的另一侧。
排列在同一行上的第一像素电路PC1、第二像素电路PC2和第三像素电路PC3可连接到第一扫描线SWL1”。第一扫描线SWL1”可在行方向(例如，±x方向)上延伸，并且可与第一区域AR1和中间区域MA至少部分地重叠。
第一扫描线SWL1”可具有通过部件区域CA而彼此物理地分离的第一部分SWL1”a和第二部分SWL1”b。第一扫描线SWL1”的第一部分SWL1”a可连接到排列在外围区域PA的一侧上的栅极驱动电路，并且第一扫描线SWL1”的第二部分SWL1”b可连接到排列在外围区域PA的另一侧上的栅极驱动电路。
第一扫描线SWL1”可顺序地将第一扫描信号发送到排列在同一行上的第一像素电路PC1、第二像素电路PC2和第三像素电路PC3。与由第一扫描线SWL1”发送的第一扫描信号同步，第一初始化电压VINT1可施加到第一像素电路PC1的第一驱动晶体管的栅极，或者可施加到第一显示元件DE1的阳极。与由第一扫描线SWL1”发送的第一扫描信号同步，第二初始化电压VINT2可施加到第二像素电路PC2的第二驱动晶体管的栅极，或者可施加到第二显示元件DE2的阳极。与由第一扫描线SWL1”发送的第一扫描信号同步，第二初始化电压VINT2可施加到第三像素电路PC3的第三驱动晶体管的栅极，或者可施加到第三显示元件DE3的阳极。
这样，具有不同电平的第一初始化电压VINT1和第二初始化电压VINT2可分别施加到具有不同尺寸的第一像素电路PC1和第二像素电路PC2，并且相同的第二初始化电压VINT2可施加到具有相同尺寸的第二像素电路PC2和第三像素电路PC3。
图19是根据另一实施方式的可包括在图16的显示装置1”中的显示面板10”b的示意性平面图。图19是对图18的修改，并且因此与图18的不同之处在于电压布线和初始化电压供给线的结构。在下文中，它们之间的重复内容将用图18的描述代替，并且为了简洁起见，将主要对差异进行描述。
参照图19，在显示面板10”b的外围区域PA中还可排列有第三初始化电压供给线13和第四初始化电压供给线14。第三初始化电压供给线13和第四初始化电压供给线14中的每一个可具有其一侧为开口的环形形状，并且可部分地围绕显示区域DA。
第一像素PX1的第一像素电路PC1可经由第三电压线VL3”连接到第三初始化电压供给线13以接收第三初始化电压VINT3。第三电压线VL3”可在行方向(例如，±x方向)上延伸，并且可与第一区域AR1至少部分地重叠。
第三电压线VL3”可具有通过第二区域AR2而彼此物理地分离的第一部分VL3”a和第二部分VL3”b。第三电压线VL3”的第一部分VL3”a可连接到第三初始化电压供给线13的一侧，并且第三电压线VL3”的第二部分VL3”b可连接到第三初始化电压供给线13的另一侧。
第二像素PX2的第二像素电路PC2和第三像素PX3的第三像素电路PC3可经由第四电压线VL4”连接到第四初始化电压供给线14以接收第四初始化电压VINT4。第四电压线VL4”可在行方向(例如，±x方向)上延伸，并且可与第一区域AR1和中间区域MA至少部分地重叠。
第四电压线VL4”可具有通过部件区域CA而彼此物理地分离的第一部分VL4”a和第二部分VL4”b。第四电压线VL4”的第一部分VL4”a可连接到第四初始化电压供给线14的一侧，并且第四电压线VL4”的第二部分VL4”b可连接到第四初始化电压供给线14的另一侧。
排列在同一行上的第一像素电路PC1、第二像素电路PC2和第三像素电路PC3可连接到第二扫描线SWL2”。第二扫描线SWL2”可顺序地将第二扫描信号发送到排列在同一行上的第一像素电路PC1、第二像素电路PC2和第三像素电路PC3。第二扫描线SWL2”可在行方向(例如，±x方向)上延伸，并且可与第一区域AR1和中间区域MA至少部分地重叠。
第二扫描线SWL2”可具有通过部件区域CA而彼此物理地分离的第一部分SWL2”a和第二部分SWL2”b。第二扫描线SWL2”的第一部分SWL2”a可连接到排列在外围区域PA的一侧上的栅极驱动电路，并且第二扫描线SWL2”的第二部分SWL2”b可连接到排列在外围区域PA的另一侧上的栅极驱动电路。
第一初始化电压VINT1可与由第一扫描线SWL1”发送的第一扫描信号同步地施加到第一像素电路PC1的第一驱动晶体管的栅极，并且第三初始化电压VINT3可与由第二扫描线SWL2”发送的第二扫描信号同步地施加到第一显示元件DE1的阳极。第二初始化电压VINT2可与由第一扫描线SWL1”发送的第一扫描信号同步地施加到第二像素电路PC2的第二驱动晶体管的栅极，并且第四初始化电压VINT4可与由第二扫描线SWL2”发送的第二扫描信号同步地施加到第二显示元件DE2的阳极。第二初始化电压VINT2可与由第一扫描线SWL1”发送的第一扫描信号同步地施加到第三像素电路PC3的第三驱动晶体管的栅极，并且第四初始化电压VINT4可与由第二扫描线SWL2”发送的第二扫描信号同步地施加到第三显示元件DE3的阳极。
这样，具有不同电平的第一初始化电压VINT1与第二初始化电压VINT2以及具有不同电平的第三初始化电压VINT3与第四初始化电压VINT4可分别施加到具有不同尺寸的第一像素电路PC1和第二像素电路PC2，并且第二初始化电压VINT2和第四初始化电压VINT4可施加到具有相同尺寸的第二像素电路PC2和第三像素电路PC3。
图20是根据另一实施方式的可包括在图16的显示装置1”中的显示面板10”'a的示意性平面图。图21是图20的显示面板10”'a的部分AA的放大示意性平面图，图22是图20的显示面板10”'a的部分BB的放大示意性平面图，并且图23是图20的显示面板10”'a的部分CC的放大示意性平面图。图20是对图18的修改，并且因此与图18的不同之处在于辅助列线和辅助行线的结构。在下文中，它们之间的重复内容将用图18的描述代替，并且为了简洁起见，将主要对差异进行描述。
参照图20，显示面板10”'a可包括排列在外围区域PA中的驱动电压供给线15。驱动电压供给线15可具有其一侧为开口的环形形状，并且可部分地围绕显示区域DA。从图11的显示驱动单元22接收的第二驱动电压ELVSS可施加到驱动电压供给线15。换句话说，显示驱动单元22可将第二驱动电压ELVSS供给到驱动电压供给线15。
显示面板10”'a可包括多个数据线DL、多个第一电压线VL1”、多个辅助行线SRL和多个辅助列线SCL。多个数据线DL中的一些可称为第一数据线DL1，并且其它的可称为第二数据线DL2。多个辅助行线SRL中的一些可称为第一辅助行线(在本文中也称为“多个辅助行线的第一集合”)SRL1，并且其它的可称为第二辅助行线(在本文中也称为“多个辅助行线的第二集合”)SRL2。多个辅助列线SCL中的一些可称为第一辅助列线(在本文中也称为“多个辅助列线的第一集合”)SCL1，并且其它的可称为第二辅助列线(在本文中也称为“多个辅助列线的第二集合”)SCL2。
在衬底1000中可限定有第一显示区域DA1和位于第一显示区域DA1在第二方向(例如，±x方向)上的两侧上的第二显示区域DA2。在衬底1000中可限定有在第一方向(例如，±y方向)上划分的第三显示区域DA3和第四显示区域DA4。第四显示区域DA4可包括包含有第二区域AR2的第(4-1)显示区域DA4a和位于第(4-1)显示区域DA4a在第一方向(例如，±y方向)上的两侧上的第(4-2)显示区域DA4b。
第一数据线DL1可各自在第一方向(例如，±y方向)上在第一显示区域DA1中延伸，并且可分别连接到第一焊盘P1。第二数据线DL2可各自在第一方向(例如，±y方向)上在第二显示区域DA2中延伸。
第一电压线VL1”中的每一个可在第一显示区域DA1和第二显示区域DA2中在第二方向(例如，±x方向)上延伸。第一电压线VL1”中的至少一些可具有通过第二区域AR2而彼此间隔开的多个部分。
如以上参照图18所述，第一电压线VL1”可连接到第一初始化电压供给线11以接收第一初始化电压VINT1。第一电压线VL1”可连接到排列在第一区域AR1中的像素电路，以将第一初始化电压VINT1发送到像素电路。
作为辅助行线SRL中的一些的第一辅助行线SRL1可排列在第三显示区域DA3中。第一辅助行线SRL1中的每一个可包括第一行连接部分RCP1、第二行连接部分RCP2和第三行连接部分RCP3。第一行连接部分RCP1、第二行连接部分RCP2和第三行连接部分RCP3可彼此间隔开。第三行连接部分RCP3可排列在第一行连接部分RCP1之间，并且第一行连接部分RCP1中的每一个可排列在第二行连接部分RCP2与第三行连接部分RCP3之间。第一行连接部分RCP1、第二行连接部分RCP2和第三行连接部分RCP3中的每一个可在第二方向(例如，±x方向)上在第三显示区域DA3中延伸。
根据实施方式，第一行连接部分RCP1中的每一个的一端可连接到稍后将描述的第一列连接部分CCP1，并且第一行连接部分RCP1中的每一个的另一端可连接到第二数据线DL2。例如，如图21中所示，第一行连接部分RCP1的相应一端可经由第一连接器c1连接到第一列连接部分CCP1，并且第一行连接部分RCP1的相应另一端可经由第二连接器c2连接到第二数据线DL2。第一连接器c1和第二连接器c2可为埋入在绝缘层中形成的接触孔中以将上层连接到下层的部分，或者可为将形成在同一层的一个线与另一个线彼此连接的部分。第一列连接部分CCP1中的每一个可连接到第二焊盘P2以接收电信号。相应地，第二数据线DL2中的每一个可经由与第一列连接部分CCP1中的每一个连接的第一行连接部分RCP1中的每一个来接收电信号。
根据实施方式，第二驱动电压ELVSS可施加到第二行连接部分RCP2。例如，如图20中所示，第二行连接部分RCP2的相应一端可连接到驱动电压供给线15。此外/可替代地，如图21中所示，第二行连接部分RCP2可经由第三连接器c3连接到被施加有第二驱动电压ELVSS的第二辅助列线SCL2。第三连接器c3可为埋入在绝缘层中形成的接触孔中以将上层连接到下层的部分，或者可为将形成在同一层的一个线与另一个线彼此连接的部分。
在图20和图21中，第二驱动电压ELVSS被施加到第二行连接部分RCP2。然而，根据另一实施方式，图1的具有与第二驱动电压ELVSS的电平不同的电平的第一驱动电压ELVDD可施加到第二行连接部分RCP2。例如，第二行连接部分RCP2可经由连接器连接到被施加有第一驱动电压ELVDD的电源线。
根据实施方式，第一驱动电压ELVDD或第二驱动电压ELVSS可施加到第三行连接部分RCP3。例如，第三行连接部分RCP3可经由连接器连接到被施加有第一驱动电压ELVDD的电源线。
作为辅助行线SRL中的其它辅助行线的第二辅助行线SRL2可各自在第二方向(例如，±x方向)上在第四显示区域DA4中延伸。在第(4-1)显示区域DA4a中可排列有作为第二辅助行线SRL2中的一些的第(2-1)辅助行线(在本文中也称为“多个辅助行线的第二集合的第一子集”)SRL2a，并且在第(4-2)显示区域DA4b中可排列有作为第二辅助行线SRL2中的其它第二辅助行线SRL2的第(2-2)辅助行线(在本文中也称为“多个辅助行线的第二集合的第二子集”)SRL2b。第(2-1)辅助行线SRL2a可具有通过第二区域AR2的部件区域CA而彼此间隔开的多个部分。
根据实施方式，第二初始化电压VINT2可施加到第(2-1)辅助行线SRL2a。例如，如图20中所示，第(2-1)辅助行线SRL2a可连接到第二初始化电压供给线12以接收第二初始化电压VINT2。第(2-1)辅助行线SRL2a可连接到排列在第二区域AR2的中间区域MA中的像素电路，以将第二初始化电压VINT2发送到像素电路。第(2-1)辅助行线SRL2a可对应于以上参照图18描述的第二电压线VL2”。换句话说，可省略第二电压线VL2”。在这种情况下，即使在没有排列用于将第二初始化电压VINT2发送到排列在第二区域AR2的中间区域MA的像素电路的特设电压线时，也可利用第(2-1)辅助行线SRL2a将第二初始化电压VINT2发送到像素电路。
因为第二初始化电压VINT2需要被施加到第(2-1)辅助行线SRL2a，所以第(2-1)辅助行线SRL2a可不连接到被施加有第二驱动电压ELVSS的第一辅助列线SCL1的第二列连接部分CCP2和/或第二辅助列线SCL2，如图20和图22中所示。
根据实施方式，第二驱动电压ELVSS可施加到第(2-2)辅助行线SRL2b。例如，如图20中所示，第(2-2)辅助行线SRL2b的相应两端可连接到驱动电压供给线15。此外/可替代地，如图23中所示，第(2-2)辅助行线SRL2b可经由第四连接器c4连接到被施加有第二驱动电压ELVSS的第一辅助列线SCL1的第二列连接部分CCP2。此外/可替代地，第(2-2)辅助行线SRL2b可经由第五连接器c5连接到被施加有第二驱动电压ELVSS的第二辅助列线SCL2。第四连接器c4和第五连接器c5可为埋入在绝缘层中形成的接触孔中以将上层连接到下层的部分，或者可为将形成在同一层的一个线与另一个线彼此连接的部分。
在图20和图23中，第二驱动电压ELVSS被施加到第(2-2)辅助行线SRL2b。然而，根据另一实施方式，第一驱动电压ELVDD可施加到第(2-2)辅助行线SRL2b。例如，第(2-2)辅助行线SRL2b可经由连接器连接到被施加有第一驱动电压ELVDD的电源线。
作为多个辅助列线SCL中的一些的第一辅助列线SCL1可排列在第一显示区域DA1中。第一辅助列线SCL1中的每一个可具有第一列连接部分CCP1和第二列连接部分CCP2。第一列连接部分CCP1和第二列连接部分CCP2可各自在第一方向(例如，±y方向)上在第一显示区域DA1中延伸。第二列连接部分CCP2可分别与第一列连接部分CCP1间隔开。第一列连接部分CCP1可分别连接到第二焊盘P2。如上所述，第一列连接部分CCP1可连接到第一行连接部分RCP1。
根据实施方式，第二驱动电压ELVSS可施加到第二列连接部分CCP2。例如，如图20中所示，第二列连接部分CCP2的相应一端可连接到驱动电压供给线15。此外/可替代地，如图23中所示，第二列连接部分CCP2可经由第四连接器c4连接到第(2-2)辅助行线SRL2b。
在图20和图23中，第二驱动电压ELVSS被施加到第二列连接部分CCP2。然而，根据另一实施方式，第一驱动电压ELVDD可施加到第二列连接部分CCP2。例如，第二列连接部分CCP2可经由连接器连接到被施加有第一驱动电压ELVDD的电源线。此外/可替代地，第二列连接部分CCP2的相应一端可连接到用于供给第一驱动电压ELVDD的电压供给线。电压供给线可排列在外围区域PA中。
作为辅助列线SCL中的一些的第二辅助列线SCL2可各自在第一方向(例如，±y方向)上在第二显示区域DA2中延伸。第二辅助列线SCL2的相应两端可连接到驱动电压供给线15。第二辅助列线SCL2可连接到驱动电压供给线15以接收第二驱动电压ELVSS。
在图20中，第二驱动电压ELVSS被施加到第二辅助列线SCL2。然而，根据另一实施方式，第一驱动电压ELVDD可施加到第二辅助列线SCL2。例如，第二辅助列线SCL2可经由连接器连接到被施加有第一驱动电压ELVDD的电源线。此外/可替代地，第二辅助列线SCL2的相应一端可连接到用于供给第一驱动电压ELVDD的电压供给线。电压供给线可排列在外围区域PA中。
为了增加显示面板10”'a的显示面积，可减小排列在外围区域PA中的驱动电压供给线15的宽度。在显示面板10”'a中可能出现由于集中在具有减小的宽度的驱动电压供给线15中的电流而导致的热量生成。然而，如在实施方式中，当第一辅助行线SRL1的第二行连接部分RCP2、第二辅助行线SRL2、第一辅助列线SCL1的第二列连接部分CCP2和第二辅助列线SCL2电连接到驱动电压供给线15时，电流可通过具有网格形状(或网状结构)的线分布。结果，可防止由于驱动电压供给线15的宽度减小而导致的热量生成。
图24和图25分别是根据其它实施方式的可包括在图16的显示装置1”中的显示面板10”'b和10”'c的示意性平面图。图24和图25是对图19和图20的修改，并且因此与图19和图20的不同之处在于第(2-1)辅助行线的结构。在下文中，它们之间的重复内容将用图19和图20的描述代替，并且为了简洁起见，将主要对差异进行描述。
首先，参照图24，用于初始化驱动晶体管的栅极的第二初始化电压VINT2可施加到第(2-1)辅助行线SRL2a。例如，第(2-1)辅助行线SRL2a可连接到第二初始化电压供给线12以接收第二初始化电压VINT2。第(2-1)辅助行线SRL2a可连接到排列在第二区域AR2的中间区域MA中的像素电路，以将第二初始化电压VINT2发送到像素电路。第(2-1)辅助行线SRL2a可对应于以上参照图18和图19描述的第二电压线VL2”。换句话说，可省略第二电压线VL2”。在这种情况下，即使当没有排列用于将第二初始化电压VINT2发送到排列在第二区域AR2的中间区域MA中的像素电路的特设电压线时，也可利用第(2-1)辅助行线SRL2a将第二初始化电压VINT2发送到像素电路。
在图24中，第二初始化电压VINT2施加到第(2-1)辅助行线SRL2a。然而，根据另一实施方式，如图25中所示，用于在初始化显示元件的阳极中使用的第四初始化电压VINT4可施加到第(2-1)辅助行线SRL2a。例如，第(2-1)辅助行线SRL2a可连接到第四初始化电压供给线14以接收第四初始化电压VINT4。第(2-1)辅助行线SRL2a可连接到排列在第二区域AR2的中间区域MA中的像素电路，以将第四初始化电压VINT4发送到像素电路。第(2-1)辅助行线SRL2a可对应于以上参照图19描述的第四电压线VL4”。换句话说，可省略第四电压线VL4”。在这种情况下，即使在没有排列用于将第四初始化电压VINT4发送到排列在第二区域AR2的中间区域MA中的像素电路的特设电压线时，也可利用第(2-1)辅助行线SRL2a将第四初始化电压VINT4发送到像素电路。
如图24和图25中所示，辅助行线SRL中的至少一些可用于将第二初始化电压VINT2或第四初始化电压VINT4发送到排列在第二区域AR2的中间区域MA中的像素电路。在这种情况下，由于没有排列用于将第二初始化电压VINT2或第四初始化电压VINT4发送到排列在第二区域AR2的中间区域MA中的像素电路的特设电压线，所以可进一步增加每单位面积排列的显示元件的数量。因此，可实现具有高分辨率的显示面板。
虽然以上仅描述了显示装置，但实施方式不限于此。例如，制造这种显示装置的方法也属于本公开的范围。
根据各种实施方式，可通过将具有不同电平的初始化电压施加到排列在具有不同分辨率的显示区域中的像素来防止闪烁的视觉识别。相应地，可防止在显示装置中发生缺陷。当然，本公开的范围并不限于此。
虽然已在本文中描述了某些实施方式和实现方式，但是其它实施方式和变型将通过本描述而显而易见。相应地，本实用新型概念不限于这样的实施方式，而是限于随附的权利要求书以及对于本领域普通技术人员而言显而易见的各种明显变型和等同布置的较宽范围。

Claims (10)

1.一种显示装置，其特征在于，包括：
第一像素电路；
第一显示元件，所述第一显示元件连接到所述第一像素电路；
第二像素电路；以及
第二显示元件，所述第二显示元件连接到所述第二像素电路，
其中，所述第一像素电路包括：
第一驱动晶体管，所述第一驱动晶体管配置为控制流到所述第一显示元件的第一电流；以及
第一初始化晶体管，所述第一初始化晶体管配置为响应于第一扫描信号将第一初始化电压施加到所述第一像素电路，并且
所述第二像素电路包括：
第二驱动晶体管，所述第二驱动晶体管配置为控制流到所述第二显示元件的第二电流；以及
第二初始化晶体管，所述第二初始化晶体管配置为响应于所述第一扫描信号，将具有与所述第一初始化电压的电平不同的电平的第二初始化电压施加到所述第二像素电路。
2.如权利要求1所述的显示装置，其特征在于，所述第一初始化电压的电平高于所述第二初始化电压的电平。
3.如权利要求1所述的显示装置，其特征在于，所述第一初始化晶体管配置为响应于所述第一扫描信号将所述第一初始化电压施加到所述第一驱动晶体管的栅极，并且所述第二初始化晶体管配置为响应于所述第一扫描信号将所述第二初始化电压施加到所述第二驱动晶体管的栅极。
4.如权利要求1所述的显示装置，其特征在于，所述第一初始化晶体管配置为响应于所述第一扫描信号将所述第一初始化电压施加到所述第一显示元件的阳极，并且所述第二初始化晶体管配置为响应于所述第一扫描信号将所述第二初始化电压施加到所述第二显示元件的阳极。
5.如权利要求3所述的显示装置，其特征在于，所述第一像素电路还包括第三初始化晶体管，所述第三初始化晶体管配置为响应于第二扫描信号将第三初始化电压施加到所述第一显示元件的阳极，并且
所述第二像素电路还包括第四初始化晶体管，所述第四初始化晶体管配置为响应于所述第二扫描信号将第四初始化电压施加到所述第二显示元件的阳极。
6.如权利要求5所述的显示装置，其特征在于，所述第三初始化电压的电平高于所述第四初始化电压的电平。
7.如权利要求5所述的显示装置，其特征在于，所述第一像素电路还包括：
第一扫描晶体管，所述第一扫描晶体管配置为响应于第三扫描信号将第一数据电压发送到所述第一驱动晶体管；
第一存储电容器，所述第一存储电容器具有第一电极和第二电极，所述第二电极连接到所述第一驱动晶体管的所述栅极；以及
第一补偿晶体管，所述第一补偿晶体管配置为响应于第四扫描信号将所述第一驱动晶体管的漏极连接到所述第一驱动晶体管的所述栅极，并且
所述第二像素电路还包括：
第二扫描晶体管，所述第二扫描晶体管配置为响应于所述第三扫描信号将第二数据电压发送到所述第二驱动晶体管；
第二存储电容器，所述第二存储电容器具有第三电极和第四电极，所述第四电极连接到所述第二驱动晶体管的所述栅极；以及
第二补偿晶体管，所述第二补偿晶体管配置为响应于所述第四扫描信号将所述第二驱动晶体管的漏极连接到所述第二驱动晶体管的所述栅极。
8.如权利要求7所述的显示装置，其特征在于，所述第一补偿晶体管和所述第二补偿晶体管的导电类型与所述第一扫描晶体管和所述第二扫描晶体管的导电类型相反，并且与所述第一初始化晶体管和所述第二初始化晶体管的导电类型相同。
9.如权利要求7所述的显示装置，其特征在于，所述第三扫描信号和所述第四扫描信号彼此同步。
10.如权利要求1所述的显示装置，其特征在于，所述第一初始化晶体管和所述第二初始化晶体管的导电类型与所述第一驱动晶体管和所述第二驱动晶体管的导电类型相反。
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