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CN115482786B - 像素驱动电路和显示面板 - Google Patents

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CN115482786B CN202211316055.4A CN202211316055A CN115482786B CN 115482786 B CN115482786 B CN 115482786B CN 202211316055 A CN202211316055 A CN 202211316055A CN 115482786 B CN115482786 B CN 115482786B
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Abstract

本申请提供一种像素驱动电路和显示面板，涉及显示技术领域，其中，该像素驱动电路包括数据输入电路、储能电路、发光控制电路、第一开关电路、第二开关电路、第三开关电路和第四开关电路；发光控制电路的输入端通过第一开关电路与第一电源电连接，通过第二开关电路与第二电源电连接，输出端与发光器件的阳极电连接，发光器件的阴极通过第三开关电路与第一电源电连接，通过第四开关电路与第二电源电连接，第一电源输出高电位电压，第二电源输出低电位电压；第二开关电路和第三开关电路在至少部分非发光阶段导通，在发光阶段关断；第一开关电路和第四开关电路在发光阶段导通，在非发光阶段关断。本申请提供的技术方案能够提升OLED的发光强度。

Description

像素驱动电路和显示面板
技术领域
本申请涉及显示技术领域，尤其涉及一种像素驱动电路和显示面板。
背景技术
基于有机发光二极管(Organic Light Emitting Diode，OLED)等发光器件的显示面板，因为具备轻薄、节能、宽视角、色域广、对比度高等特性，而被越来越广泛地应用于电视、手机等产品中。
随着OLED的使用，OLED的发光强度会逐渐降低，影响显示效果。因此，如何提升OLED的发光强度，是本领域技术人员需要解决的一个问题。
发明内容
有鉴于此，本申请提供一种像素驱动电路和显示面板，用以提升OLED的发光强度，提升显示效果。
为了实现上述目的，第一方面，本申请实施例提供一种像素驱动电路，包括：数据输入电路、储能电路、发光控制电路、第一开关电路、第二开关电路、第三开关电路和第四开关电路；
所述数据输入电路与所述发光控制电路的控制端电连接，用于向所述发光控制电路输出数据电压；
所述储能电路的一端与所述发光控制电路的控制端电连接，所述储能电路的另一端与所述发光控制电路的输入端电连接，所述储能电路用于储存电能；
所述发光控制电路的输入端通过所述第一开关电路与第一电源电连接，通过所述第二开关电路与第二电源电连接，所述发光控制电路的输出端与发光器件的阳极电连接，所述发光控制电路用于在发光阶段向所述发光器件输出驱动电流，所述发光器件的阴极通过所述第三开关电路与所述第一电源电连接，通过所述第四开关电路与所述第二电源电连接，所述第一电源输出高电位电压，所述第二电源输出低电位电压；
所述第二开关电路和所述第三开关电路在至少部分非发光阶段导通，在发光阶段关断；所述第一开关电路和所述第四开关电路在所述发光阶段导通，在所述非发光阶段关断。
作为本申请实施例一种可选的实施方式，所述第一开关电路包括第一开关管，所述第四开关电路包括第四开关管；
所述第一开关管的第一极与所述第一电源电连接，所述第一开关管的第二极与所述发光控制电路的输入端电连接，所述第一开关管的控制极与第一扫描线的输出端电连接；
所述第四开关管的第一极与所述第二电源电连接，所述第四开关管的第二极与所述发光器件的阴极电连接，所述第四开关管的控制极与所述第一扫描线的输出端电连接。
作为本申请实施例一种可选的实施方式，所述第一开关管和所述第四开关管均为PMOS管；所述第一扫描线在所述发光阶段输出低电位信号，在所述非发光阶段输出高电位信号。
作为本申请实施例一种可选的实施方式，所述第二开关电路包括第二开关管，所述第三开关电路包括第三开关管；
所述第二开关管的第一极与所述第二电源电连接，所述第二开关管的第二极与所述发光控制电路的输入端电连接，所述第二开关管的控制极与第二扫描线的输出端电连接；
所述第三开关管的第一极与所述第一电源电连接，所述第三开关管的第二极与所述发光器件的阴极电连接，所述第三开关管的控制极与所述第二扫描线的输出端电连接。
作为本申请实施例一种可选的实施方式，所述第二开关管和所述第三开关管均为PMOS管；所述第二扫描线在所述发光阶段输出高电位信号，在至少部分所述非发光阶段输出低电位信号。
作为本申请实施例一种可选的实施方式，所述像素驱动电路还包括：第五开关电路，所述第五开关电路的一端与所述发光控制电路的输入端电连接，所述第五开关电路的另一端与所述发光器件的阴极电连接；
所述非发光阶段包括第一非发光阶段和第二非发光阶段，所述第二非发光阶段位于所述第一非发光阶段和所述发光阶段之间；
所述第五开关电路在所述第一非发光阶段导通，在所述第二非发光阶段和所述发光阶段关断；
所述第二开关电路和所述第三开关电路在所述第二非发光阶段导通，在所述第一非发光阶段和所述发光阶段关断。
作为本申请实施例一种可选的实施方式，所述第五开关电路包括第五开关管，所述第五开关管的第一极与所述发光控制电路的输入端电连接，所述第五开关管的第二极与所述发光器件的阴极电连接，所述第五开关管的控制极与第三扫描线的输出端电连接。
作为本申请实施例一种可选的实施方式，所述第五开关管为PMOS管；所述第三扫描线在所述第一非发光阶段输出低电位信号，在在所述第二非发光阶段和所述发光阶段输出高电位信号。
作为本申请实施例一种可选的实施方式，所述发光控制电路包括第六开关电路、第七开关电路和驱动薄膜晶体管；
所述第六开关电路连接在所述第一开关电路和所述驱动薄膜晶体管的输入端之间，所述第七开关电路连接在所述驱动薄膜晶体管的输出端和所述发光器件的阳极之间；
所述第六开关电路和所述第七开关电路在所述第五开关电路导通时关断，在所述第五开关电路关断时导通。
第二方面，本申请实施例提供一种显示面板，包括多个像素单元，各所述像素单元包括发光器件和如上述第一方面或第一方面任一项所述的像素驱动电路。
本申请实施例提供的像素驱动电路和显示面板，包括数据输入电路、储能电路、发光控制电路、第一开关电路、第二开关电路、第三开关电路和第四开关电路；数据输入电路与发光控制电路的控制端电连接，用于向发光控制电路输出数据电压；储能电路的一端与发光控制电路的控制端电连接，储能电路的另一端与发光控制电路的输入端电连接，储能电路用于储存电能；发光控制电路的输入端通过第一开关电路与第一电源电连接，通过第二开关电路与第二电源电连接，发光控制电路的输出端与发光器件的阳极电连接，发光控制电路用于在发光阶段向发光器件输出驱动电流，发光器件的阴极通过第三开关电路与第一电源电连接，通过第四开关电路与第二电源电连接，第一电源输出高电位电压，第二电源输出低电位电压；第二开关电路和第三开关电路在至少部分非发光阶段导通，在发光阶段关断；第一开关电路和第四开关电路在发光阶段导通，在非发光阶段关断。上述技术方案中，在至少部分非发光阶段，第二开关电路和第三开关电路导通，第一电源和第二电源向发光器件施加反向偏压，消耗发光器件中多余的电子和空穴，在发光阶段，第一开关电路和第四开关电路导通，第一电源和第二电源向发光器件施加正向偏压，发光器件发光，由于此时发光器件中多余的电子和空穴被消耗，从而发光器件的发光强度和发光率得到提升，显示效果提升，发光器件的使用寿命也被延长。
附图说明
图1为本申请实施例提供的显示面板中任意一个像素单元的结构示意图；
图2为图1中像素驱动电路的电路结构示意图；
图3为本申请实施例提供的像素驱动电路的工作时序图。
具体实施方式
下面结合本申请实施例中的附图对本申请实施例进行描述。本申请实施例的实施方式部分使用的术语仅用于对本申请的具体实施例进行解释，而非旨在限定本申请。下面这几个具体的实施例可以相互结合，对于相同或相似的概念或过程可能在某些实施例不再赘述。
发光器件可以是OLED、无机发光二极管(Light Emitting Diodes，LED)、量子点发光二极管(Quantum Dot Light Emitting Diodes，QLED)和次毫米发光二极管(Mini LightEmitting Diodes，Mini LED)等；本申请的实施例后续以发光器件为OLED为例，进行示例性说明。
图1为本申请实施例提供的显示面板中任意一个像素单元的结构示意图，如图1所示，该像素单元可以包括：第一电源VDD、第二电源VSS、像素驱动电路和OLED。
第一电源VDD可以输出高电位电压，第二电源VSS可以输出低电位电压。
像素驱动电路可以包括：数据输入电路10、驱动控制电路20、储能电路30、发光控制电路40、第一开关电路50、第二开关电路60、第三开关电路70、第四开关电路80、第五开关电路90。
数据输入电路10与发光控制电路40的控制端电连接，用于向发光控制电路40输出数据电压。
储能电路30的一端与发光控制电路40的控制端电连接，另一端与发光控制电路40的输入端电连接，储能电路30用于储存电能。
驱动控制电路20连接在数据输入电路10的输出端和发光控制电路40的控制端之间，用以调节发光控制电路40的控制端的电压，以补偿发光控制电路40中的驱动薄膜晶体管401的阈值电压。
发光控制电路40的输入端通过第一开关电路50与第一电源VDD电连接，通过第二开关电路60与第二电源VSS电连接，发光控制电路40的输出端与OLED的阳极电连接，发光控制电路40用于在发光阶段向OLED输出驱动电流。OLED的阴极通过第三开关电路70与第一电源VDD电连接，通过第四开关电路80与第二电源VSS电连接。
在至少部分非发光阶段(例如，在阈值电压补偿阶段和数据电压写入阶段导通)，第二开关电路60和第三开关电路70导通，第一电源VDD和第二电源VSS向OLED施加反向偏压，这样就能够消耗OLED中多余的电子和空穴；在发光阶段，第一开关电路50和第四开关电路80导通，第二开关电路60和第三开关电路70关断，第一电源VDD和第二电源VSS向OLED施加正向偏压，OLED发光，由于此时OLED中多余的电子和空穴已经被消耗，从而OLED的发光强度和发光率得到提升，显示效果提升，OLED的使用寿命也被延长。
可以理解的是，在整个非发光阶段，第一开关电路50和第四开关电路80均关断。
第五开关电路90的一端与发光控制电路40的输入端电连接，第五开关电路90的另一端与OLED的阴极电连接。
非发光阶段可以包括第一非发光阶段(例如，复位阶段)和第二非发光阶段(例如，阈值电压补偿阶段和数据电压写入阶段)，第二非发光阶段位于第一非发光阶段和发光阶段之间。
在第一非发光阶段，第二开关电路60和第三开关电路70关断，第五开关电路90导通，使发光控制电路40中上个发光阶段残留的正负电荷中和；这样在第二非发光阶段，第二开关电路60和第三开关电路70导通，第五开关电路90关断，第一电源VDD和第二电源VSS在向OLED施加反向偏压消耗OLED中多余的电子和空穴时，就可以施加更少的电荷，从而能够降低OLED的功耗。
可以理解的是，在发光阶段，第五开关电路90关断。
在本申请的另一个实施例中，发光控制电路40还可以包括第六开关电路402和第七开关电路403。
第六开关电路402连接在第一开关电路50和驱动薄膜晶体管401的输入端之间，第七开关电路403连接在驱动薄膜晶体管401的输出端和OLED的阳极之间。
第六开关电路402和第七开关电路403在第五开关电路90导通时关断，在第五开关电路90关断时导通，这样就能够在第一非发光阶段，发光控制电路40中上个发光阶段残留的正负电荷中和时，隔离驱动薄膜晶体管401，减少发光控制电路40中正负电荷中和对驱动薄膜晶体管401的影响。
图2为图1中像素驱动电路的电路结构示意图，如图2所示，第一开关电路50可以包括第一开关管T1，第一开关管T1的第一极与第一电源VDD电连接，第一开关管T1的第二极与发光控制电路40的输入端电连接，第一开关管T1的控制极与第一扫描线Scan1的输出端电连接。
第四开关电路80可以包括第四开关管T4，第四开关管T4的第一极与第二电源VSS电连接，第四开关管T4的第二极与OLED的阴极电连接，第四开关管T4的控制极与第一扫描线Scan1的输出端电连接。
第一开关管T1和第四开关管T4可以是PMOS管，也可以是NMOS管。当第一开关管T1和第四开关管T4为PMOS管时，第一开关管T1和第四开关管T4的第一极为源极，第二极为漏极，控制极为栅极；当第一开关管T1和第四开关管T4为NMOS管时，第一开关管T1和第四开关管T4的第一极为漏极，第二极为源极，控制极为栅极。本实施例后续以第一开关管T1和第四开关管T4为PMOS管为例，进行示例性说明。
在第一非发光阶段和第二非发光阶段，第一扫描线Scan1输出高电位信号，第一开关管T1和第四开关管T4关断；在发光阶段，第一扫描线Scan1输出低电位信号，第一开关管T1和第四开关管T4导通。
第二开关电路60可以包括第二开关管T2，第二开关管T2的第一极与第二电源VSS电连接，第二开关管T2的第二极与发光控制电路40的输入端电连接，第二开关管T2的控制极与第二扫描线Scan2的输出端电连接。
第三开关电路70可以包括第三开关管T3，第三开关管T3的第一极与第一电源VDD电连接，第三开关管T3的第二极与OLED的阴极电连接，第三开关管T3的控制极与第二扫描线Scan2的输出端电连接。
第二开关管T2和第三开关管T3可以是PMOS管，也可以是NMOS管。当第二开关管T2和第三开关管T3为PMOS管时，第二开关管T2和第三开关管T3的第一极为源极，第二极为漏极，控制极为栅极；当第二开关管T2和第三开关管T3为NMOS管时，第二开关管T2和第三开关管T3的第一极为漏极，第二极为源极，控制极为栅极。本实施例后续以第二开关管T2和第三开关管T3为PMOS管为例，进行示例性说明。
在第一非发光阶段，第二扫描线Scan2输出高电位信号，第二开关管T2和第三开关管T3关断；在第二非发光阶段，第二扫描线Scan2输出低电位信号，第二开关管T2和第三开关管T3导通；在发光阶段，第二扫描线Scan2输出高电位信号，第二开关管T2和第三开关管T3关断。
第五开关电路90可以包括第五开关管T5，第五开关管T5的第一极与发光控制电路40的输入端电连接，第五开关管T5的第二极与OLED的阴极电连接，第五开关管T5的控制极与第三扫描线Scan3的输出端电连接。
第五开关管T5可以是PMOS管，也可以是NMOS管。当第五开关管T5为PMOS管时，第五开关管T5的第一极为源极，第二极为漏极，控制极为栅极；当第五开关管T5为NMOS管时，第五开关管T5的第一极为漏极，第二极为源极，控制极为栅极。本实施例后续以第五开关管T5为PMOS管为例，进行示例性说明。
在第一非发光阶段，第三扫描线Scan3输出低电位信号，第五开关管T5导通；在第二非发光阶段和发光阶段，第三扫描线Scan3输出高电位信号，第五开关管T5关断。
第六开关电路402可以包括第六开关管T6，第六开关管T6的第一极与第一开关管T1的第二极电连接，第六开关管T6的第二极与驱动薄膜晶体管T9的第一极电连接，第六开关管T6的控制极与第四扫描线Scan4的输出端电连接。
第七开关电路403可以包括第七开关管T7，第七开关管T7的第一极与驱动薄膜晶体管T9的第二极电连接，第七开关管T7的第二极与OLED的阳极电连接，第七开关管T7的控制极与第四扫描线Scan4的输出端电连接。
第六开关管T6和第七开关管T7可以是PMOS管，也可以是NMOS管。当第六开关管T6和第七开关管T7为PMOS管时，第六开关管T6和第七开关管T7的第一极为源极，第二极为漏极，控制极为栅极；当第六开关管T6和第七开关管T7为NMOS管时，第六开关管T6和第七开关管T7的第一极为漏极，第二极为源极，控制极为栅极。本实施例后续以第六开关管T6和第七开关管T7为PMOS管为例，进行示例性说明。
在第一非发光阶段，第四扫描线Scan4输出高电位信号，第六开关管T6和第七开关管T7关断；在第二非发光阶段和发光阶段，第四扫描线Scan4输出低电位信号，第六开关管T6和第七开关管T7导通。
数据输入电路10可以包括第八开关管T8，第八开关管T8的第一极与数据线Data电连接，第八开关管T8的第二极通过驱动控制电路20与驱动薄膜晶体管T9的控制极电连接，第八开关管T8的控制极与第五扫描线Scan5电连接。
第八开关管T8可以是PMOS管，也可以是NMOS管。当第八开关管T8为PMOS管时，第八开关管T8的第一极为源极，第二极为漏极，控制极为栅极；当第八开关管T8为NMOS管时，第八开关管T8的第一极为漏极，第二极为源极，控制极为栅极。本实施例后续以第八开关管T8为PMOS管为例，进行示例性说明。
在第一非发光阶段，第五扫描线Scan5输出高电位信号，第八开关管T8关断；在第二非发光阶段，第五扫描线Scan5输出低电位信号，第八开关管T8导通；在发光阶段，第五扫描线Scan5输出高电位信号，第八开关管T8关断。
储能电路30可以包括电容C1，电容C1的一端与驱动薄膜晶体管T9的控制极电连接，电容C1的另一端与驱动薄膜晶体管T9的第一极电连接。
图3为本申请实施例提供的像素驱动电路的工作时序图，如图3所示，在第一非发光阶段，第一扫描线Scan1、第二扫描线Scan2、第四扫描线Scan4和第五扫描线Scan5输出高电位信号，第三扫描线Scan3输出低电位信号，第五开关管T5导通，驱动薄膜晶体管T9和其他开关管均关断，发光控制电路40中，在上个发光阶段残留的正负电荷中和。
在第二非发光阶段，第一扫描线Scan1和第三扫描线Scan3输出高电位信号，第一开关管T1、第四开关管T4和第五开关管T5关断；第二扫描线Scan2、第四扫描线Scan4和第五扫描线Scan5输出低电位信号，第二开关管T2、第三开关管T3、第六开关管T6、第七开关管T7、第八开关管T8和驱动薄膜晶体管T9导通，第一电源VDD和第二电源VSS向OLED施加反向偏压消耗OLED中多余的电子和空穴。
在发光阶段，第一扫描线Scan1和第四扫描线Scan4输出低电位信号，第一开关管T1、第四开关管T4、第六开关管T6、第七开关管T7和驱动薄膜晶体管T9导通；第二扫描线Scan2、第三扫描线Scan3和五扫描线输出高电位信号，第二开关管T2、第三开关管T3、第五开关管T5和第八开关管T8关断，第一电源VDD和第二电源VSS向OLED施加正向偏压，OLED发光，由于此时OLED中多余的电子和空穴已经被消耗，从而OLED的发光强度和发光率得到提升，显示效果提升，OLED的使用寿命也被延长。
可以理解的是，本申请实施例示意的电路模块并不构成对像素驱动电路的具体限定。在本申请另一些实施例中，像素驱动电路可以包括比图示更多或更少的电路模块，或者组合某些电路模块，或者拆分某些电路模块；每个电路模块可以包括比图示更多或更少的器件。图示的电路模块可以以硬件，软件或软件和硬件的组合实现。
本申请实施例提供的像素驱动电路和显示面板，包括数据输入电路、储能电路、发光控制电路、第一开关电路、第二开关电路、第三开关电路和第四开关电路；数据输入电路与发光控制电路的控制端电连接，用于向发光控制电路输出数据电压；储能电路的一端与发光控制电路的控制端电连接，储能电路的另一端与发光控制电路的输入端电连接，储能电路用于储存电能；发光控制电路的输入端通过第一开关电路与第一电源电连接，通过第二开关电路与第二电源电连接，发光控制电路的输出端与发光器件的阳极电连接，发光控制电路用于在发光阶段向发光器件输出驱动电流，发光器件的阴极通过第三开关电路与第一电源电连接，通过第四开关电路与第二电源电连接，第一电源输出高电位电压，第二电源输出低电位电压；第二开关电路和第三开关电路在至少部分非发光阶段导通，在发光阶段关断；第一开关电路和第四开关电路在发光阶段导通，在非发光阶段关断。上述技术方案中，在至少部分非发光阶段，第二开关电路和第三开关电路导通，第一电源和第二电源向发光器件施加反向偏压，消耗发光器件中多余的电子和空穴，在发光阶段，第一开关电路和第四开关电路导通，第一电源和第二电源向发光器件施加正向偏压，发光器件发光，由于此时发光器件中多余的电子和空穴被消耗，从而发光器件的发光强度和发光率得到提升，显示效果提升，发光器件的使用寿命也被延长。
在上述实施例中，对各个实施例的描述都各有侧重，某个实施例中没有详述或记载的部分，可以参见其它实施例的相关描述。
应当理解，当在本申请说明书和所附权利要求书中使用时，术语“包括”指示所描述特征、整体、步骤、操作、元素和/或组件的存在，但并不排除一个或多个其它特征、整体、步骤、操作、元素、组件和/或其集合的存在或添加。
在本申请中出现的对步骤进行的命名或者编号，并不意味着必须按照命名或者编号所指示的时间/逻辑先后顺序执行方法流程中的步骤，已经命名或者编号的流程步骤可以根据要实现的技术目的变更执行次序，只要能达到相同或者相类似的技术效果即可。
在本申请的描述中，除非另有说明，“/”表示前后关联的对象是一种“或”的关系，例如，A/B可以表示A或B；本申请中的“和/或”仅仅是一种描述关联对象的关联关系，表示可以存在三种关系，例如，A和/或B，可以表示：单独存在A，同时存在A和B，单独存在B这三种情况，其中A，B可以是单数或者复数。
并且，在本申请的描述中，除非另有说明，“多个”是指两个或多于两个。“以下至少一项”或其类似表达，是指的这些项中的任意组合，包括单项或复数项的任意组合。例如，a，b，或c中的至少一项，可以表示：a，b，c，a-b，a-c，b-c，或a-b-c，其中a，b，c可以是单个，也可以是多个。
如在本申请说明书和所附权利要求书中所使用的那样，术语“如果”可以依据上下文被解释为“当...时”或“一旦”或“响应于确定”或“响应于检测到”。类似地，短语“如果确定”或“如果检测到[所描述条件或事件]”可以依据上下文被解释为意指“一旦确定”或“响应于确定”或“一旦检测到[所描述条件或事件]”或“响应于检测到[所描述条件或事件]”。
另外，在本申请说明书和所附权利要求书的描述中，术语“第一”、“第二”、“第三”等是用于区别类似的对象，而不必用于描述特定的顺序或先后次序。应该理解这样使用的数据在适当情况下可以互换，以便这里描述的实施例能够以除了在这里图示或描述的内容以外的顺序实施。
在本申请说明书中描述的参在本申请说明书中描述的参考“一个实施例”或“一些实施例”等意味着在本申请的一个或多个实施例中包括结合该实施例描述的特定特征、结构或特点。由此，在本说明书中的不同之处出现的语句“在一个实施例中”、“在一些实施例中”、“在其他一些实施例中”、“在另外一些实施例中”等不是必然都参考相同的实施例，而是意味着“一个或多个但不是所有的实施例”，除非是以其他方式另外特别强调。
最后应说明的是：以上各实施例仅用以说明本申请的技术方案，而非对其限制；尽管参照前述各实施例对本申请进行了详细的说明，本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分或者全部技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本申请各实施例技术方案的范围。

Claims (9)

1.一种像素驱动电路，其特征在于，包括：数据输入电路、储能电路、发光控制电路、第一开关电路、第二开关电路、第三开关电路、第四开关电路和第五开关电路；
所述数据输入电路与所述发光控制电路的控制端电连接，用于向所述发光控制电路输出数据电压；
所述储能电路的一端与所述发光控制电路的控制端电连接，所述储能电路的另一端与所述发光控制电路的输入端电连接，所述储能电路用于储存电能；
所述发光控制电路的输入端通过所述第一开关电路与第一电源电连接，通过所述第二开关电路与第二电源电连接，所述发光控制电路的输出端与发光器件的阳极电连接，所述发光控制电路用于在发光阶段向所述发光器件输出驱动电流，所述发光器件的阴极通过所述第三开关电路与所述第一电源电连接，通过所述第四开关电路与所述第二电源电连接，所述第一电源输出高电位电压，所述第二电源输出低电位电压；
所述第一开关电路和所述第四开关电路在所述发光阶段导通，在非发光阶段关断；
所述第五开关电路的一端与所述发光控制电路的输入端电连接，所述第五开关电路的另一端与所述发光器件的阴极电连接；
所述非发光阶段包括第一非发光阶段和第二非发光阶段，所述第二非发光阶段位于所述第一非发光阶段和所述发光阶段之间；
所述第五开关电路在所述第一非发光阶段导通，在所述第二非发光阶段和所述发光阶段关断；
所述第二开关电路和所述第三开关电路在所述第二非发光阶段导通，在所述第一非发光阶段和所述发光阶段关断。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述第一开关电路包括第一开关管，所述第四开关电路包括第四开关管；
所述第一开关管的第一极与所述第一电源电连接，所述第一开关管的第二极与所述发光控制电路的输入端电连接，所述第一开关管的控制极与第一扫描线的输出端电连接；
所述第四开关管的第一极与所述第二电源电连接，所述第四开关管的第二极与所述发光器件的阴极电连接，所述第四开关管的控制极与所述第一扫描线的输出端电连接。
3.根据权利要求2所述的像素驱动电路，所述第一开关管和所述第四开关管均为PMOS管；所述第一扫描线在所述发光阶段输出低电位信号，在所述非发光阶段输出高电位信号。
4.根据权利要求1所述的像素驱动电路，其特征在于，所述第二开关电路包括第二开关管，所述第三开关电路包括第三开关管；
所述第二开关管的第一极与所述第二电源电连接，所述第二开关管的第二极与所述发光控制电路的输入端电连接，所述第二开关管的控制极与第二扫描线的输出端电连接；
所述第三开关管的第一极与所述第一电源电连接，所述第三开关管的第二极与所述发光器件的阴极电连接，所述第三开关管的控制极与所述第二扫描线的输出端电连接。
5.根据权利要求4所述的像素驱动电路，其特征在于，所述第二开关管和所述第三开关管均为PMOS管；所述第二扫描线在所述发光阶段输出高电位信号，在至少部分所述非发光阶段输出低电位信号。
6.根据权利要求1-5任一项所述的像素驱动电路，其特征在于，所述第五开关电路包括第五开关管，所述第五开关管的第一极与所述发光控制电路的输入端电连接，所述第五开关管的第二极与所述发光器件的阴极电连接，所述第五开关管的控制极与第三扫描线的输出端电连接。
7.根据权利要求6所述的像素驱动电路，其特征在于，所述第五开关管为PMOS管；所述第三扫描线在所述第一非发光阶段输出低电位信号，在在所述第二非发光阶段和所述发光阶段输出高电位信号。
8.根据权利要求1-5任一项所述的像素驱动电路，其特征在于，所述发光控制电路包括第六开关电路、第七开关电路和驱动薄膜晶体管；
所述第六开关电路连接在所述第一开关电路和所述驱动薄膜晶体管的输入端之间，所述第七开关电路连接在所述驱动薄膜晶体管的输出端和所述发光器件的阳极之间；
所述第六开关电路和所述第七开关电路在所述第五开关电路导通时关断，在所述第五开关电路关断时导通。
9.一种显示面板，其特征在于，包括多个像素单元，各所述像素单元包括发光器件和如权利要求1-8任一项所述的像素驱动电路。
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