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    Intructivo Uso Xilinx 10 ISE

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    Este documento proporciona instrucciones sobre cómo usar Xilinx 10.1 para crear un proyecto, agregar fuentes, simular y programar un dispositivo. Incluye pasos como crear un nuevo proyecto, agregar módulos VHDL, simular el diseño y asignar pines de E/S.

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    Descripción original:

    Pasos básicos para la simulacion y cargado del código.

    Derechos de autor

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    INTRUCTIVO USO XILINX 10.

    1
    File New Project
    Project Location: DIRECTORIO SIN ESPACIO EN LOS NOMRES NI EN
    LA RUTA
    Project Name: sin espacios
    Top-level source type: VHDL
    NEXT
    Device Properties

    Crear una nueva fuente


    Agregar fuentes existentes
    Project Summary

    FINISH4

    Project New Source:


    VHDL Module, File:sin espacios, misma ubicacin, tildar el agregar a
    proyecto

    Define module: agrega entradas y salidas


    FINISH

    TIPEO cdigo despus del begin y de declarar todas las entradas salidas (puertos)
    y las seales.
    Selecciono archivo fuente y tildo implement design:

    Aparece sumarioFITTING STATUS: establece si el cdigo entra o no en el


    dispositivo seleccionado.

    SIMULACION

    Project New Source Test Bench Waveform


    File name:sin espacios, distinto nombre
    Location: misma ruta q antes sin espacios
    NEXT
    Initialize Time: Combinational

    Armo Tabla Temporal y luego Save All

    En ventana sourcesSources FOR: behavioral simulation


    Selecciono el archivo .tbw En ventana process doble clic
    en Xilinx Ise Simulator Simulate BehavioralModel

    CARGAR

    Sources for: Implementation


    User ContraintsFloorplan IO-Pre-Synthesis doble clic
    Yes al cartel.
    Las entradas en color son las ya usadas, las en color gris estn disponibles,
    se debe ver el manual de la placa de CPLD o FPGA para saber cuales usar (PAG
    12)
    EJ: _SWITCH0PIN42 p42
    _SWITCH1PIN40 p40
    _LedPIN1 p1

    Guardo y OK

    Vuelvo al ISE, doble clic en IMPLENT DESIGN


    Implement DesignConfigure Target Device doble clic
    Se abre IMPACT, finish, cargo el archivo .jed , clic derecho sobre
    CPLD, program

    Implement Design synthetice XST > View RTL schematic


    Doble clic sobre la imagen y pasa de caja negra a circuito.

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