Teoría de Muestreo, Discretización, y Reconstrucción de Señales
Teoría de Muestreo, Discretización, y Reconstrucción de Señales
Teoría de Muestreo, Discretización, y Reconstrucción de Señales
Reconstrucción de Señales
Edward Patiño, Paola Rique, Edwin Vargas
Facultad de Ingeniería
Programa de Ingeniería Electrónica extensión Tunja
Universidad Pedagógica y Tecnológica de Colombia
Tunja, Boyacá - Colombia
I. TEORÍA DE MUESTREO
Fig. 5 Muestreo de la señal triangular con una Fm=1,2KHz Fig. 7 Muestreo de la señal triangular con una Fm=300Hz
Se puede observar que con una frecuencia de muestreo al Se puede observar que al tener una frecuencia en la señal
límite del criterio de Nyquist la señal muestreada en cada una muestreadora menor a la frecuencia de la señal original, en
de las figuras anteriores tiene menos tiempo de discretización este caso, de la mitad, se esta perdiendo información de todo
y zonas más grandes de “recorte” donde la señal reconstruida un ciclo de la señal original, en caso de que esta señal tenga
no está definida, en comparación con las simulaciones una frecuencia cada vez menor, la perdida de información al
anteriores. En la simulación de la señal seno, se puede momento de muestrear la señal original va a ser mayor.
observar que el valor máximo de la señal muestreada es de
0,5, con lo cual, al interpolar los valores muestreados para B. Reconstrucción de señales en MATLAB
hacer una reconstrucción, la señal resultante será diferente de
1) Retenedor de orden cero
la señal original.
Se implemento el mismo esquema de Matlab usado
3) Incumpliendo el criterio de Nyquist anteriormente, pero añadiendo un retenedor de orden cero en
Para incumplir el criterio de Nyquist se utilizó una la salida de la señal muestreada 𝑋𝑚(𝑡) para obtener la señal
frecuencia en la señal muestreadora de 1/2 de la frecuencia 𝑋𝑧𝑎ℎ(𝑡), se harán las mismas pruebas anteriores donde se
de la señal de origen, es decir, una frecuencia de 300𝐻𝑧. varió la frecuencia de la señal muestreadora para ver que
ocurre en este caso, con la señal 𝑋𝑧𝑎ℎ(𝑡).
Fig. 8 Esquema reconstrucción de señales en Matlab con retenedor de
orden cero
La señal senoidal se perdió totalmente al hacer la Con esta frecuencia baja, la señal reconstruida es una línea
reconstrucción ya que lo puntos de muestreo coincidían con recta en cero, ya que el retenedor toma el primer valor que deja
su cruce por cero, mientras que de la señal triangular tiene muy pasar la señal muestreadora, y como la frecuencia
poca información para su reconstrucción, con esto se puede seleccionada es múltiplo par de la frecuencia de la señal
ver que usar el criterio de Nyquist al limite no garantiza poder original, coincide que el muestreo siempre es en el cruce por
recuperar la señal original al ser reconstruida. cero de la señal original, con lo cual no se puede reconstruir.
Por esto es importante elegir una frecuencia se muestreo que
c) Incumpliendo el criterio de Nyquist cumpla con el criterio de Nyquist.
Se utilizó una frecuencia en la señal muestreadora de 1/2
de la frecuencia de la señal de origen, es decir, una frecuencia 2) Retenedor de orden uno
de 300𝐻𝑧. Los retenedores de orden n no son prácticos ya que causan
retraso, ruido y además su implementación no es sencilla, el
retenedor de orden uno presenta un retraso de una muestra al
momento de presentar su señal y presenta cierto ruido como
se vera en las siguientes simulaciones.
El esquema del retenedor de orden uno que se implementó
en simulación es el siguiente:
Fig. 13 Reconstrucción de la señal senoidal con una Fm=300Hz Las frecuencias usadas en las simulaciones con este
esquema son las mismas que en el esquema anterior para
poder hacer la comparación de los dos sistemas.
a) Criterio de muestreo de Nyquist
Fig. 16 Reconstrucción de la señal senoidal con una Fm=4,8KHz Fig. 18 Reconstrucción de la señal senoidal con una Fm=1,2KHz
Fig. 17 Reconstrucción de la señal triangular con una Fm=4,8KHz Fig. 19 Reconstrucción de la señal triangular con una Fm=1,2KHz
En comparación con la señal reconstruida con el retenedor Con el criterio de Nyquist al límite y el retenedor de orden
de orden cero, las señales reconstruidas con el retenedor de cero, las señales reconstruidas no se parecen en nada a las
orden uno presenta ruido y un pequeño desface de la señal señales originales.
reconstruida con la señal original.
a) Incumpliendo el criterio de Nyquist
b) Criterio de Nyquist al limite
Fig. 22 Diagrama estructural interno de AD633
C. Multiplicador análogo
El multiplicador se realiza con AD633, es un multiplicador
de cuatro cuadrantes, alimentación entre 8 y 18v dual,
frecuencia máxima de 5MHz, internamente posee 2 Fig. 24 Señal Muestreada a 3.6kHz (Salida del multiplicador)
amplificadores de ganancia unitaria y alta impedancia, un
bloque de multiplicación y uno de suma, para aplicarle una Al usar la FFT del osciloscopio podemos ver los espectros
señal de offset, si se requiere, el Diagrama de estructura de la señal, la señal original es de 600𝐻𝑧, por lo tanto, la
interna se muestra a continuación. frecuencia fundamental debe ser un impulso centrado en esa
frecuencia, al ser muestreada, el espectro se desplaza hasta
𝐹𝑜 ± 𝐹𝑚, por lo tanto, debe haber 2 impulsos en 4,2𝐾𝐻𝑧 y
en 3𝐾𝐻𝑧, el diagrama de espectros se muestra a continuación.
Fig. 25 Diagrama de espectros para el multiplicador
Fig. 27 Señal reconstruida por el LF398
D. Retenedor de orden cero Como se puede ver, a la final se obtiene la señal original,
Para el retenedor de orden cero se utiliza un LF398, el cual cuyo espectro es un impulso centrado en la frecuencia
es un circuito retenedor, los circuitos retenedores mantienen fundamental.
el voltaje de entrada determinado tiempo, este tiempo está
definido por el alto de una señal cuadrada, al igual el tiempo II. SISTEMAS DE ADQUISICIÓN Y DISTRIBUCIÓN DE DATOS
entre cada flanco ascendente define cada cuanto se mantiene
El dispositivo SAD que selecciono el grupo fue la TAD
el voltaje de entrada, de igual forma el circuito debe cumplir
USB-6218.
el teorema de Nyquist, así que la señal lógica debería tener una
frecuencia mayor a 2 ∙ 3,6𝐾ℎ𝑧, es decir, mayor a 7,2𝐾𝐻𝑧, se
colocara una señal de 14𝐾𝐻𝑧 , la topología a usar es la A. Datos técnicos
siguiente.
TABLA I
DATOS TECNICOS LAS ENTRADAS ANALOGAS DEL SAD USB-6218
16 diferencial
Canales
32 simple referenciado
Resolución 16 bits
Canal único 250KS/s
Tasa de actualización Multicanal 250KS/s
Mínimo 0S/s
Voltaje de entrada ±2V, ±1V, ±5V, ±10V
Tiempo de conversión 50ns
TABLA III
DATOS TECNICOS DE LAS I/O DIGITALES DEL SAD USB-6218
Entradas digitales 8
Salidas digitales 8
Resistencias pull-down 47KΩ±1%
B. Modos de operación
Los modos de operación del sistema son: muestreo
continuo, por número de muestras y por demanda. Estos
modos de operación tienen las siguientes configuraciones:
TABLA IV
MODOS DE CONFIGURACIÓN DEL SAD
Configuración Descripción Aplicación
DIFF Utiliza dos entradas simples Lectura de sistemas
para tomar el valor de de medición tipo
entrada, dando como puente. Registro de
resultado la diferencia de mediciones con alta Fig. 29 Venta de visualización de componentes para entrada analógica
valores entre las dos
impedancia.
entradas.
RSE Utiliza una solo entrada y el Modelos de
dato entregado corresponde medición variados.
al valor del puerto
referenciado a la tierra del
sistema.
III. PREGUNTAS
Fig. 32 Ventana de visualizador del generador
A. ¿Qué es un circuito PLL (Phase Locked Loop)? ¿Cuál
Teniendo en cuenta que el dispositivo usado es de es su principio de operación y que aplicaciones tiene?
muestreo rápido, se muestra la señal generada en el programa Un PLL (Phased Locked Loop – Bucle de Fase Fija) es un
de forma similar a la observada en el osciloscopio, pero en este circuito que permite controlar la frecuencia y fase de un
último se presenta un instante de tiempo en el que no se oscilador controlado por tensión mediante una señal externa
muestra información (Vout=0V), el cual no se presenta en el [2].
visualizador del programa, esto puede deberse a la cantidad de
muestras utilizadas y el tiempo entre ellas, sabiendo que al B. ¿Cómo se podría utilizar un circuito multiplicador para
variar dichos parámetros el instante “nulo” se presenta con la modulación de amplitud?
más o menos ocurrencia.
Mirando el datasheet del integrado AD633, se puede hacer
un modulador utilizando la siguiente configuración.
E. Lectura y reconstrucción de una señal con el SAD
El siguiente es un esquema que muestra el montaje de
adquisición y reconstrucción de señales análogas.
Fig. 34 Programa de Lector y reconstrucción de señales LabVIEW Posteriormente la conexión con la DAQ permitirá hacer la
visualización en LabVIEW. Luego se configura la adquisición
de frecuencia como una tarea del contador en Measurement &
Automation Explorer (MAX), indicando el terminal de entrada
al que se conectó la señal a medir.
TABLA V
INTEGRADOS VCO
LMX2592 Sintetizador de frecuencia de banda ancha con VCO
integrado
LMX2581E Sintetizador de frecuencia de banda ancha con VCO
integrado
TRF3722 Modulador de cuadratura de 400 MHz a 4,2 GHz con
banda ancha integrada PLL / VCO
BIBLIOGRAFÍA
Fig. 39 Entrada y salida de un retenedor de primer orden [4] [1] E. Martinez, “Teoria del muestreo de Nyquist,” 2007. [Online].
Available: http://www.eveliux.com/mx/curso/nyquist.html.
No se encontraron aplicaciones de este retenedor, una [2] Á. Torre, “BUCLES DE FASE FIJA ( PLLs ) ( PHASE LOCKED
posible explicación a esto es que presenta retraso en su LOOPS ),” p. 3.
respuesta y presenta ruido en la reconstrucción de las señales. [3] National Instruments, “Cómo Realizar una Medición de Frecuencia,”
2013. [Online]. Available: http://www.ni.com/tutorial/7111/es/.
[4] C. Augusto, “FUNCIÓN DE TRANSFERENCIA DE UN
B. Circuitos convertidores de frecuencia a voltaje RETENEDOR DE PRIMER ORDEN. CONTROL DIGITAL.,” 2018.
Algunos circuitos conversores de frecuencia a voltaje que [Online]. Available: https://temasdecalculo.com/2018/03/26/1-6-
se encontraron son los siguientes: LM331 de National funcion-de-transferencia-de-un-retenedor-de-primer-orden-control-
digital/.
semoconductor y LM2907, LM2917 de Texas Instruments.
[5] “Principios fundamentales detrás de la topología adc Sigma-Delta,”
2016. [Online]. Available: https://www.arrow.com/es-mx/research-
C. Circuitos integrados VCO and-events/articles/fundamental-principles-behind-the-sigma-delta-
adc-topology.
Los siguientes integrados son osciladores controlados por
voltaje que se encontraron en la página de Texas Instruments: