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KR960015134A - 전력 관리상태에 응답하여 다중 클럭된 회로를 클럭하는 클럭 제어기 - Google Patents

전력 관리상태에 응답하여 다중 클럭된 회로를 클럭하는 클럭 제어기 Download PDF

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KR960015134A
KR960015134A KR1019950035989A KR19950035989A KR960015134A KR 960015134 A KR960015134 A KR 960015134A KR 1019950035989 A KR1019950035989 A KR 1019950035989A KR 19950035989 A KR19950035989 A KR 19950035989A KR 960015134 A KR960015134 A KR 960015134A
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케이. 웨이크랜드 칼
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Abstract

집적 프로세서는 단일 모놀리식 회로위에 제조되어 최근의 PIDs의 요구사항인 데이타-집약, 시각-집약 및 음성-집약을 수용하기 위한 회로를 사용한다. 집적 프로세서는 다용도 및 고성능 기능을 성취하기 위하여 CPU 코어, 메모리 컨트롤러 및, 여러 가지 주변기기를 포함한다. 집적 프로세서는 집적 프로세서의 다양한 부시스템을 적절하게 클럭하기 위하여 상이한 주파수로 구성된 클럭신호를 발생하는 다수의 위상동기루프를 포함하는 클럭 제어기를 설치하여 더적은 전력을 소비한다. 클럭 제어기에 의해 여러 부시스템에 제공된 클럭 신호는 단일 크리스탈 오실레이터 입력신호로 부터 유도된다. 전력 관리기는 집적 프로세서에 내장되어 여러 부시스템에 대한 특정 클럭신호의 주파수 및/또는 응용을 제어하는 것은 물론, 다른 전력 관리에 관련된 기능을 제어한다. 집적 프로세서의 핀의 수는 집적프로세서의 소정의 기능에 좌우되어 특정한 외부 핀에 대한 선택적인 다중화를 허용함으로써 결국 최소화된다.

Description

전력 관리상태에 응답하여 다중 클럭된 회로를 클럭하는 클럭 제어기
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 일실시예에 따라 단일 모놀리식 칩위에 내장된 CPU 코어, 메모리 컨트롤러, 여러 주변기기, 클럭 제어기 및 관련된 전력 관리기(power management unit; PMU)를 포함하는 집적 프로세서 시스템의 블록도,
제2도는 본 발명의 일실시예에 따른 클럭 제어기 및 이에 따른 입력/출력 신호의 블록도,
제3도는 본 발명의 일실시예에 따른 전력 관리기 및 이에 따른 입력/출력 신호의 블록도.

Claims (22)

  1. 집적 프로세서내에 구성된 클럭 제어기로서, 단일 주파수에서 클럭되는 입력신호를 수신하고 다수의 출력 신호를 발생하도륵 구성된 주파수 합성장치와, 상기 다수의 출력신호 각각을 수신하기 위하여 연결된 다수의 회로로 구성되며, 상기 출력신호 각각은 상기 주파수 합성장치로 전송되는 다수의 인에이블 신호에 의해 결정되는 개별적인 주파수에서 클럭되는 것을 특징으로 하는 클럭 제어기.
  2. 제1항에 있어서, 상기 주파수 합성장치는 다수의 주파수 곱셈기와 주파수 분주기를 포함하는 것을 특징으로 하는 클럭 제어기.
  3. 제2항에 있어서, 상기 주파수 곱셈기는 직렬로 연결된 위상동기루프 회로를 포함하는 것을 특징으로 하는 클럭 제어기.
  4. 제3항에 있어서, 상기 위상동기루프 회로는 제1, 제2 및 제3위상동기루프 회로를 포함하며, 상기 제1위상동기루프 회로는 상기 입력신호를 수신하기 위하여 연결되고, 상기 제2위상동기루프 회로는 저속 클럭신호를 발생하기 위하여 연결되고, 상기 제3위상동기루프 회로는 고속 클럭신호를 발생하기 위하여 연결되는 것을 특징으로 하는 클럭 제어기.
  5. 제4항에 있어서, 상기 고속 클럭은 상기 저속 클럭신호보다 빠른 속도로 트리거되고, 상기 고속 클럭신호는 주변 상호접속 버스와 상기 제3위상동기루프 회로사이에서 연결된 구성 레지스터에 따라서 상기 주변 상호접속 버스로 송신된 구성신호에 의해 여러 주파수중에서 한 주파수로 프로그램가능한 것을 특징으로 하는 클럭 제어기.
  6. 제4항에 있어서, 상기 클럭 제어기는 상기 저속 클럭신호와 상기 고속 클럭신호를 수신하고 상기 저속 클럭신호나 또는 상기 고속 클럭신호를 상기 스위칭회로의 출력에서 스위칭하는 동적 클럭 스위칭회로를 포함하는 것을 특징으로 하는 클럭 제어기.
  7. 제2항에 있어서, 상기 주파수 분주기는 상기 주파수 곱셈기중 하나의 주파수 곱셈기와 상기 클럭회로의 세트사이에서 병렬로 연결된 카운터 회로의 세트를 포함하는 것을 특징으로 하는 클럭 제어기.
  8. 집적 프로세서내에 구성된 클럭 제어기로서, 오실레이터에 연결된 입력과 제2위상동기루프 회로에 연결된 출력을 가지는 제1위상동기루프 회로, 전력 관리상태를 제어하며, 제어된 전력 관리상태에 따라서 상기 제2위상동기루프 회로를 구동하기 위하여 상기 제2위상동기루프 회로에 연결된 제1인에이블 출력을 가지는 전력 관리기 및, 상기 제2위상동기루프 회로가 구동하는 동안에, 대응하는 다수의 클럭된 회로로 전송된 다수의 클럭신호 각각을 발생하기 위하여 상기 제2위상동기루프 회로의 출력에 연결된 다수의 주파수 분주기로 구성되는 것을 특징으로 하는 클럭 제어기.
  9. 제8항에 있어서, 상기 전력 관리상태는 보통 상태, 저속 상태, 도우즈 상태, 정지 상태 및 일시정지 상태로 구성된 리스트에서 선택된 몇몇 전력 관리상태중 한 상태를 포함하는 것을 특징으로 하는 클럭 제어기.
  10. 제8항에 있어서, 상기 클럭신호는 상이한 주파수로 트리거되는 것을 특징으로 하는 클럭 제어기.
  11. 제8항에 있어서, 상기 클럭신호는 키보드 클럭신호, DMA 클럭신호. 타이머 클럭신호, UART 클럭신호 및 비디오 클럭신호를 포함하는 것을 특징으로 하는 클럭 제어기.
  12. 제8항에 있어서, 상기 클럭 제어기는 상기 제1위상동기루프 회로가 구동된 후 상기 제1인에이블 출력이 액티브인 동안 상기 제2위상동기루프 회로를 턴온하기 위하여 상기 제1인에이블 출력으로 게이트되는 입력과 상기 오실레이터 사이에서 연결된 제1지연회로를 포함하는 것을 특징으로 하는 클럭 제어기.
  13. 제8항에 있어서, 상기 다수의 주파수 분주기증에서 적어도 하나의 분주기는 스위치에 연결된 출력을 포함하며, 상기 스위치는 상기 전력 관리기로 부터 송신되는 제2인에이블 출력에 의한 활동에 적합한 것을 특징으로 하는 클럭 제어기.
  14. 제8항에 있어서, 상기 클럭 제어기는 상기 제2위상동기루프 회로의 출력에 연결된 입력을 구비한 제3위상동기루프 회로를 포함하며, 상기 제3위상동기루프 회로는 프로그램가능한, 다양한 클럭주파수를 제공하도록 구성되는 것을 특징으로 하는 클럭 제어기.
  15. 제14항에 있어서, 상기 제3위상동기루프의 입력은 상기 전력 관리기에서 송신된 제3인에이블 출력을 수신하기 위하여 연결되고, 상기 제3인에이블 출력은 액티브일 때, 상기 전력 관리기에 의해 검색된 전력 관리상태에 따라서 상기 제3위상동기루프의 동작을 인에이블하는 것을 특징으로 하는 클럭 제어기.
  16. 제15항에 있어서, 상기 클럭 제어기는 상기 제2위상동기루프 회로가 구동된 후에 상기 제1 및 제2인에이블 출력이 액티브인 동안 상기 제3위상동기루프 회로를 턴온하기 위하여 상기 제1 및 제2인에이블 출력으로 게이트되는 입력과 오실레이터 사이에서 연결된 제2지연회로를 포함하는 것을 특징으로 하는 클럭 제어기.
  17. 집적 프로세서내의 전력이 관리되는 클럭 제어기로서, 오실레이터에 연결된 입력과 제2위상통기루프 회로에 연결된 출력을 가지는 제1위상동기루프 회로, 상기 제2위상동기루프 회로에 연결되는 입력과 동적 클럭 스위칭회로에 연결되는 출력을 가지는 제3위상동기루프 회로, 인에이블 출력의 제1세트를 발생하고, 발생된 인에이블 출력의 제1세트에 따라서 공동으로 또는 개별적으로 상기 제1, 제2 및 제3위상동기 회로를 구동하기 위하여 상기 제1, 제2 및 제3위상동기 회로에 연결된 출력을 가지는 전력 관리기 및, 상기 주파수 분주기를 공동으로 또는 개별적으로 구동하기 위하여 상기 전력 관리기에 의해 발생되는 인에이블 출력의 제2세트를 수신하는 상기 동적 클럭 스위칭회로의 입력과 상기 제2위상동기루프 회로의 출력에 연결된 다수의 주파수 분주기로 구성되는 것을 특징으로 하는 클럭 제어기.
  18. 제17항에 있어서, 인에이블 출력의 상기 제1 및 제2세트는 예정된 전력 관리 알고리즘에 따라서 상기 전력 관리기로 부터 발생되는 것을 특징으로 하는 클럭 제어기.
  19. 제19항에 있어서, 상기 클럭 제어기는 상기 제2위상동기루프 회로의 출력에 연결된 입력과 비디오 컨트롤러에 연결된 비디오 클럭신호를 발생하기 위하여 비디오 클럭 주파수 분주기를 통해 연결된 상기 제4위상동기루프의 출력을 구비한 제4위상동기루프 회로를 포함하는 것을 특징으로 하는 클럭 제어기.
  20. 제19항에 있어서, 상기 제1, 제2, 제3 및 제4위상동기루프 회로는 각각 주파수 곱셈기를 포함하는 것을 특징으로 하는 클럭 제어기.
  21. 제20항에 있어서, 상기 주파수 곱셈기는 상기 제1, 제2, 제3 및 제4위상동기루프 회로 각각을 위한 상이한 주파수 곱셉인자를 포함하는 것을 특징으로 하는 클럭 제어기.
  22. 제21항에 있어서, 상기 제3위상동기루프 회로를 위한 상기 주파수 곱셈인자는 프로그램가능한 것을 특징으로 하는 클럭 제어기.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019950035989A 1994-10-19 1995-10-18 전력관리상태에응답하여다중클럭된회로를클럭하는클럭제어기 KR100397025B1 (ko)

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