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KR930011726A - 모션보상 텔레비젼과 같은 피드백 시스템용 다중 시리얼 억세스 메모리 - Google Patents

모션보상 텔레비젼과 같은 피드백 시스템용 다중 시리얼 억세스 메모리 Download PDF

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KR930011726A KR1019920021690A KR920021690A KR930011726A KR 930011726 A KR930011726 A KR 930011726A KR 1019920021690 A KR1019920021690 A KR 1019920021690A KR 920021690 A KR920021690 A KR 920021690A KR 930011726 A KR930011726 A KR 930011726A
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Abstract

본 발명에 의해 다중 시리얼 억세스 메모리가 제공된다. 다이나믹 랜덤 억세스 메모리 어레이(30)가 데이타를 입력받고 데이타를 출력하기 위해 어드레스지정되고, 상기 어드레스지정에 의해 제공된 어드레스신호(34,36,38)에 응답하여 어레이(30)로부터 데이터의 행이 출력되게 된다.
복수개의 시리얼 출력포트(44,46,48)가 상기 어레이의 출력에 연결되어 상기 어레이로부터 출력된 데이터의 서로 다른 행을 선택적으로 래치시키게 된다. 그리고, 상기 시리얼 출력포트(44,46,48)는 래치된 데이터를 출력하기 위해 클럭제어되게 된다. 개시된 실시예에서는 상기 시리얼 출력포트의 각각이 상기 메모리 어레이(30)의 폭과 적어도 동일한 길이를 갖는 시프트 레지스터(62,64,66,···,68)를 포함하고 있는데, 이 시프트 레지스터는 제1타이밍신호(42,52)에 응답하여 상기 어레이로부터 데이타의 행을 래치시키고, 제2타이밍신호에 응답하여 래치된 데이터의 행을 시프트시키게 된다. 상기 시프트 레지스터에 연결된 시리얼 억세스 셀렉터는 상기 시리얼 출력포트로부터 시프트된 데이터의 선택된 부분을 출력하게 된다. 이러한 메모리는 모션보상 인터프레임 이미지코딩/디코딩 시스템용의 프레임 스토어로서 응용할 수 있다.

Description

모션보상 텔레비젼과 같은 피드백 시스템용 다중 시리얼 억세스 메모리
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 모션보상 인터프레임 이미지 코딩/디코딩 시스템에 이용되는 피드백 시스템을 나타낸 블럭도.
제2도는 제1도에 도시된 피드백 시스템의 종래예를 나타낸 블럭도.
제3도는 본 발명에 따른 다중 시리얼 억세스 다이나믹 RAM을 나타낸 블럭도.
제8도(a) 내지 제8도(c)는 메모리를 비디오 데이터의 연속적인 프레임으로 채우는 방법을 설명하기 위한 도면이다.

Claims (11)

  1. 다이나믹 랜덤 억세스 메모리 어레이와, 상기 어레이로 데이터를 입력하고 상기 어레이로부터 데이터를 출력하기 위해 상기 어레이를 어드레스지정하는 어드레스지정수단, 상기 어드레스지정수단에 의해 제공된 어드레스신호에 응답하여 상기 어레이로부터 데이터의 행을 출력하는 출력수단, 상기 출력수단에 연결되어 상기 출력수단에 의해 출력된 데이터의 행을 선택적으로 래치시키는 복수개의 시리얼 출력포트 및, 사기 시리얼 출력포트로부터 래치된 데이터를 출력하기 위해 상기 시리얼 출력포트를 클럭제어하는 수단을 구비하여 이루어진 다중 시리얼 억세스 메모리.
  2. 제1항에 있어서, 상기 어레이와 작용적으로 연결되어 상기 어레이로의 억세스를 한번에 상기 시리얼 출력포트중 한개로 제한하는 타이밍수단을 더 구비하여 이루어진 것을 특징으로 하는 다중 시리얼 억세스 메모리.
  3. 제1항에 있어서, 상기 시리얼 출력포트의 각각은, 상기 어레이의 폭과 적어도 동일한 길이를 갖고서, 타이밍수단으로부터의 제1신호에 응답하여 상기 어레이로부터 데이터의 행을 래치시키고, 상기 타이밍수단으로부터의 제2신호에 응답하여 래치된 데이터의 행을 시프트시키는 시프트 레지스터와, 상기 시프트 레지스터에 연결되어 상기 시리얼 출력포트로부터 시프트된 데이터의 선택된 부분을 출력하는 시리얼 억세스 셀렉터로 이루어진 것을 특징으로 하는 다중 시리얼 억세스 메모리.
  4. 제1세트의 워킹 데이터를 저장하기 위한 메모리와, 상기 워킹 데이타로 부터 유도된 1세트의 디스플레이데이터를 저장하기 위한 메모리를 필요로하는 디지탈 텔레비젼장치에 있어서, 다이나믹 랜덤 억세스 메모리 어레이와, 상기 어레이로 데이터를 입력하고 상기 어레이로부터 데이터를 출력하기 위해 상기 어레이를 어드레스지정하는 어드레스지정수단, 상기 어드레스지정수단에 의해 제공된 어드레스신호에 응답하여 상기 어레이로부터 데이터의 행을 출력하는 출력수단, 상기 출력수단에 연결되어 상기 출력수단에 의해 출력된 데이터의 행을 선택적으로 래치시키는 복수개의 시리얼 출력포트 및, 상기 시리얼 출력포트로부터 래치된 데이터를 출력하기 위해 상기 시리얼 출력포트를 클럭제어하는 수단을 구비하여 이루어지고, 상기 시리얼 출력포트중 적어도 한개가 상기어레이로부터 워킹 데이터를 출력하는데 사용되고, 상기 시리얼 출력포트중 적어도 다른 한개가 상기 어레이로부터 디스플레이 데이타를 출력하는데 사용되는 것을 특징으로 하는 디지탈 텔레비젼장치.
  5. 제4항에 있어서, 상기 어레이와 작용적으로 연결되어 상기 어레이로의 억세스를 한번에 상기 시리얼 출력포트중 한개로 제한하는 타이밍수단을 더 구비하여 이루어진 것을 특징으로 하는 디지탈 텔레비젼장치.
  6. 제4항에 있어서, 상기 시리얼 출력포트의 각각은, 상기 어레이의 폭과 적어도 동일한 길이를 갖고서, 타이밍수단으로부터의 제1신호에 응답하여 상기 어레이로부터 데이터의 행을 래치시키고, 상기 타이밍수단으로 부터의 제2신호에 응답하여 래치된 데이터의 행을 시프트시키는 시프트 레지스터와, 상기 시프트 레지스티에 연결되어 상기 시리얼 출력포트로부터 시프트된 데이터의 선택된 부분을 출력하는 시리얼 억세스 셀렉터로 이루어진 것을 특징으로 하는 디지탈 텔레비젼장치.
  7. 제4항에 있어서, 상기 워킹 데이터는 필드 포맷과 프레임 포맷중 한개에서 그 각각의 시리얼 출력포트에 의해 상기 어레이로부터 억세스되고, 상기 디스플레이 데이터는 상기 필드 포맷과 프레임 포맷중 다른 한개에서 그 각각의 시리얼 출력포트에 의해 상기 어레이로부티 억세스되는 것을 특징으로 하는 디지탈 텔레비젼장치.
  8. 제4항에 있어서, 상기 워킹 데이타는 블럭 포맷에서 그 각각의 시리얼 출력포트에 의해 상기 어레이로부처 억세스되고, 상기 디스플레이 데이터는 텔레비젼 라인 포맷에서 그 각각의 시리얼 출력포트에 의해 상기 어레이로부터 억세스되는 것을 특징으로 하는 디지탈 텔레비젼장치.
  9. 제4항에 있어서, 상기 디스플레이 데이터는 현재의 비디오 프레임에 대한 화소 데이터로 이루어지고, 상기 워킹 데이터는 모션보상 차이신호로부터 현재의 비디오신호를 재구성하는데 사용되는 이전의 비디오 프레임으로부터의 화소 데이티로 이루어지며, 상기 어레이는 소정의 모션평가 검색영역을 점유하기에 충분한 워킹 데이터와 함께 상기 현재의 비디오 프레임을 저장하기에 충분한 저장용량을 갖고 있고, 상기 어레이는 연속적인 비디오프레임에 대한 데이터와, 현재의 모션 평가 검색영역을 선행하여 지나간 이전의 프레임에 대한 데이터의 일부를 겹쳐쓰기한 현재의 프레임에 대한 데이터로 채워지는 것을 특징으로 하는 디지탈 텔레비젼장치.
  10. N×K라인[여기서, N은 한개의 비디오 프레임에서의 라인 갯수, K는 수직변위 (DY)에 대응하는 라인 갯수와 적어도 동일한 것]의 비디오 데이터를 저장하는 프레임 스토어 메모리를 준비하는 단계와, 제2비디오 프레임의 N개의 연속적인 라인이 제1비디오 프레임의 마지막 라인의 뒤를 따라서 메모리에 기록되고, 상기 제1비디오프레임이 퍼스트-인 퍼스트-아웃방식에 따라 상기 제2비디오 프레임에 의해 겹쳐쓰기되며 상기 제1비디오 프레임이 상기 메모리에 완전히 기록되면 상기 제1비디오 프레임의 마지막 K라인이 상기 메모리에 남게 되도록, 순환방식으로 연속적인 비디오 프레임으로부터의 데이타로 상기 프레임 스토어 메모리를 채우는 단계로 이루어진 것을 특징으로 하는 최대 수평변위(DX)와 최대 수직변위(DY)를 초과하는 모션을 평가하는 모션보상기용 비디오데이터를 저장하는 방법.
  11. ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019920021690A 1991-11-19 1992-11-19 모션보상 텔레비젼과 같은 피드백 시스템용 다중 시리얼 억세스 메모리와 이것을 이용한 디지탈 텔레비젼장치 및 그 비디오 데이터 저장방법 KR970000604B1 (ko)

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Families Citing this family (71)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6067379A (en) * 1988-12-09 2000-05-23 Cognex Corporation Method and apparatus for locating patterns in an optical image
KR0122741B1 (ko) * 1992-09-23 1997-11-17 배순훈 병렬 구조를 갖는 기억 장치
JPH06189292A (ja) * 1992-12-15 1994-07-08 Sony Corp 動画像復号装置
JP3381077B2 (ja) * 1992-12-04 2003-02-24 ソニー株式会社 動画像復号装置
US7558324B2 (en) 1993-01-18 2009-07-07 Sony Corporation Apparatus for encoding and decoding header data in picture signal transmission
US7075991B1 (en) 1993-01-18 2006-07-11 Sony Corporation Apparatus for encoding and decoding header data in picture signal transmission
US5448310A (en) * 1993-04-27 1995-09-05 Array Microsystems, Inc. Motion estimation coprocessor
US5526050A (en) * 1994-03-31 1996-06-11 Cognex Corporation Methods and apparatus for concurrently acquiring video data from multiple video data sources
FR2719398B1 (fr) * 1994-04-27 1996-07-19 Sgs Thomson Microelectronics Dispositif et procédé d'adressage d'une mémoire cache d'un circuit de compression d'images mobiles.
TW245871B (en) * 1994-08-15 1995-04-21 Gen Instrument Corp Method and apparatus for efficient addressing of dram in a video decompression processor
US5596376A (en) * 1995-02-16 1997-01-21 C-Cube Microsystems, Inc. Structure and method for a multistandard video encoder including an addressing scheme supporting two banks of memory
US5585863A (en) * 1995-04-07 1996-12-17 Eastman Kodak Company Memory organizing and addressing method for digital video images
US6806916B1 (en) 1995-04-28 2004-10-19 Matsushita Electric Industrial Co., Ltd. Video apparatus with image memory function
JP2956527B2 (ja) * 1995-04-28 1999-10-04 松下電器産業株式会社 画像メモリ機能付き映像装置
US6026176A (en) * 1995-07-25 2000-02-15 Cognex Corporation Machine vision methods and articles of manufacture for ball grid array inspection
US5809538A (en) * 1996-02-07 1998-09-15 General Instrument Corporation DRAM arbiter for video decoder
US5805931A (en) * 1996-02-09 1998-09-08 Micron Technology, Inc. Programmable bandwidth I/O port and a communication interface using the same port having a plurality of serial access memories capable of being configured for a variety of protocols
US5872870A (en) * 1996-02-16 1999-02-16 Cognex Corporation Machine vision methods for identifying extrema of objects in rotated reference frames
US5909504A (en) * 1996-03-15 1999-06-01 Cognex Corporation Method of testing a machine vision inspection system
US6259827B1 (en) 1996-03-21 2001-07-10 Cognex Corporation Machine vision methods for enhancing the contrast between an object and its background using multiple on-axis images
US6298149B1 (en) 1996-03-21 2001-10-02 Cognex Corporation Semiconductor device image inspection with contrast enhancement
US5978502A (en) * 1996-04-01 1999-11-02 Cognex Corporation Machine vision methods for determining characteristics of three-dimensional objects
US5719642A (en) * 1996-05-07 1998-02-17 National Science Council Of R.O.C. Full-search block matching motion estimation processor
US6137893A (en) * 1996-10-07 2000-10-24 Cognex Corporation Machine vision calibration targets and methods of determining their location and orientation in an image
US5960125A (en) 1996-11-21 1999-09-28 Cognex Corporation Nonfeedback-based machine vision method for determining a calibration relationship between a camera and a moveable object
US5784108A (en) * 1996-12-03 1998-07-21 Zapex Technologies (Israel) Ltd. Apparatus for and method of reducing the memory bandwidth requirements of a systolic array
US5953130A (en) * 1997-01-06 1999-09-14 Cognex Corporation Machine vision methods and apparatus for machine vision illumination of an object
US5940608A (en) 1997-02-11 1999-08-17 Micron Technology, Inc. Method and apparatus for generating an internal clock signal that is synchronized to an external clock signal
US6912680B1 (en) 1997-02-11 2005-06-28 Micron Technology, Inc. Memory system with dynamic timing correction
US5946244A (en) 1997-03-05 1999-08-31 Micron Technology, Inc. Delay-locked loop with binary-coupled capacitor
US6075881A (en) 1997-03-18 2000-06-13 Cognex Corporation Machine vision methods for identifying collinear sets of points from an image
US5974169A (en) * 1997-03-20 1999-10-26 Cognex Corporation Machine vision methods for determining characteristics of an object using boundary points and bounding regions
US6141033A (en) * 1997-05-15 2000-10-31 Cognex Corporation Bandwidth reduction of multichannel images for machine vision
US6173432B1 (en) * 1997-06-20 2001-01-09 Micron Technology, Inc. Method and apparatus for generating a sequence of clock signals
US6608647B1 (en) 1997-06-24 2003-08-19 Cognex Corporation Methods and apparatus for charge coupled device image acquisition with independent integration and readout
US6101197A (en) 1997-09-18 2000-08-08 Micron Technology, Inc. Method and apparatus for adjusting the timing of signals over fine and coarse ranges
US5978080A (en) * 1997-09-25 1999-11-02 Cognex Corporation Machine vision methods using feedback to determine an orientation, pixel width and pixel height of a field of view
US6208772B1 (en) 1997-10-17 2001-03-27 Acuity Imaging, Llc Data processing system for logically adjacent data samples such as image data in a machine vision system
US6307588B1 (en) 1997-12-30 2001-10-23 Cognex Corporation Method and apparatus for address expansion in a parallel image processing memory
US6157751A (en) * 1997-12-30 2000-12-05 Cognex Corporation Method and apparatus for interleaving a parallel image processing memory
US6025854A (en) * 1997-12-31 2000-02-15 Cognex Corporation Method and apparatus for high speed image acquisition
US5982395A (en) * 1997-12-31 1999-11-09 Cognex Corporation Method and apparatus for parallel addressing of an image processing memory
US6236769B1 (en) 1998-01-28 2001-05-22 Cognex Corporation Machine vision systems and methods for morphological transformation of an image with zero or other uniform offsets
US6282328B1 (en) 1998-01-28 2001-08-28 Cognex Corporation Machine vision systems and methods for morphological transformation of an image with non-uniform offsets
US6381375B1 (en) 1998-02-20 2002-04-30 Cognex Corporation Methods and apparatus for generating a projection of an image
US6215915B1 (en) 1998-02-20 2001-04-10 Cognex Corporation Image processing methods and apparatus for separable, general affine transformation of an image
US6269451B1 (en) 1998-02-27 2001-07-31 Micron Technology, Inc. Method and apparatus for adjusting data timing by delaying clock signal
FR2782878B1 (fr) * 1998-08-28 2000-11-10 Holding Bev Sa Systeme de compression et de decompression de signaux video numeriques
US6338127B1 (en) 1998-08-28 2002-01-08 Micron Technology, Inc. Method and apparatus for resynchronizing a plurality of clock signals used to latch respective digital signals, and memory device using same
US6349399B1 (en) 1998-09-03 2002-02-19 Micron Technology, Inc. Method and apparatus for generating expect data from a captured bit pattern, and memory device using same
US6279090B1 (en) 1998-09-03 2001-08-21 Micron Technology, Inc. Method and apparatus for resynchronizing a plurality of clock signals used in latching respective digital signals applied to a packetized memory device
US6430696B1 (en) 1998-11-30 2002-08-06 Micron Technology, Inc. Method and apparatus for high speed data capture utilizing bit-to-bit timing correction, and memory device using same
US6374360B1 (en) 1998-12-11 2002-04-16 Micron Technology, Inc. Method and apparatus for bit-to-bit timing correction of a high speed memory bus
US6687402B1 (en) 1998-12-18 2004-02-03 Cognex Corporation Machine vision methods and systems for boundary feature comparison of patterns and images
US6381366B1 (en) 1998-12-18 2002-04-30 Cognex Corporation Machine vision methods and system for boundary point-based comparison of patterns and images
US6377713B1 (en) 1999-01-27 2002-04-23 General Instrument Corporation Synchronous DRAM bandwidth optimization for display downsizing of an MPEG-2 image
US6470060B1 (en) * 1999-03-01 2002-10-22 Micron Technology, Inc. Method and apparatus for generating a phase dependent control signal
JP2000358193A (ja) * 1999-06-15 2000-12-26 Matsushita Electric Ind Co Ltd 画像メモリ機能付き映像装置
US6684402B1 (en) 1999-12-01 2004-01-27 Cognex Technology And Investment Corporation Control methods and apparatus for coupling multiple image acquisition devices to a digital data processor
US6748104B1 (en) 2000-03-24 2004-06-08 Cognex Corporation Methods and apparatus for machine vision inspection using single and multiple templates or patterns
US6801989B2 (en) 2001-06-28 2004-10-05 Micron Technology, Inc. Method and system for adjusting the timing offset between a clock signal and respective digital signals transmitted along with that clock signal, and memory device and computer system using same
US7072395B2 (en) * 2001-07-20 2006-07-04 Ess Technology, Inc. Memory control apparatus and efficient search pattern for block-matching motion estimation
US7168027B2 (en) 2003-06-12 2007-01-23 Micron Technology, Inc. Dynamic synchronization of data capture on an optical or other high speed communications link
US7234070B2 (en) 2003-10-27 2007-06-19 Micron Technology, Inc. System and method for using a learning sequence to establish communications on a high-speed nonsynchronous interface in the absence of clock forwarding
WO2005088983A2 (en) * 2004-03-08 2005-09-22 Koninklijke Philips Electronics N.V. Video decoder with scalable compression and buffer for storing and retrieving reference frame data
US8111904B2 (en) 2005-10-07 2012-02-07 Cognex Technology And Investment Corp. Methods and apparatus for practical 3D vision system
JP4987364B2 (ja) * 2006-06-23 2012-07-25 株式会社東芝 ラインメモリ実装装置とテレビジョン受信装置
US8162584B2 (en) 2006-08-23 2012-04-24 Cognex Corporation Method and apparatus for semiconductor wafer alignment
JP4911223B2 (ja) * 2007-06-06 2012-04-04 富士通株式会社 中継装置および端末装置
JP2008304763A (ja) * 2007-06-08 2008-12-18 Hitachi Displays Ltd 表示装置
US9544587B2 (en) 2012-05-14 2017-01-10 Google Technology Holdings LLC Scalable video coding with enhanced base layer

Family Cites Families (19)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3996559A (en) * 1974-11-07 1976-12-07 International Business Machines Corporation Method and apparatus for accessing horizontal sequences, vertical sequences and regularly spaced rectangular subarrays from an array stored in a modified word organized random access memory system
GB1568378A (en) * 1976-01-30 1980-05-29 Micro Consultants Ltd Video processing system
JPS592227B2 (ja) * 1978-08-21 1984-01-17 株式会社日立製作所 雑音除去方式
US4275418A (en) * 1978-09-14 1981-06-23 Micro Consultants Limited Video noise reduction systems
US4321695A (en) * 1979-11-23 1982-03-23 Texas Instruments Incorporated High speed serial access semiconductor memory with fault tolerant feature
US4541075A (en) * 1982-06-30 1985-09-10 International Business Machines Corporation Random access memory having a second input/output port
JPS6072020A (ja) * 1983-09-29 1985-04-24 Nec Corp デュアルポ−トメモリ回路
JPH06101841B2 (ja) * 1984-01-11 1994-12-12 日本電気株式会社 動画像信号の符号化方法およびその装置
US4602275A (en) * 1984-03-19 1986-07-22 Rca Corporation Television memory system
DE3588186T2 (de) * 1985-01-22 1998-12-03 Texas Instruments Inc., Dallas, Tex. Halbleiterspeicher mit Serienzugriff
CA1293565C (en) * 1986-04-28 1991-12-24 Norio Ebihara Semiconductor memory
DE3787324T2 (de) * 1986-06-20 1994-03-31 Sony Corp Videospeicher.
JPH01224993A (ja) * 1988-03-04 1989-09-07 Nec Corp マルチポートメモリ
JP3028963B2 (ja) * 1988-09-21 2000-04-04 株式会社東芝 ビデオメモリ装置
JP2925157B2 (ja) * 1989-02-28 1999-07-28 キヤノン株式会社 データ記憶装置
US5036493A (en) * 1990-03-15 1991-07-30 Digital Equipment Corporation System and method for reducing power usage by multiple memory modules
JPH0782747B2 (ja) * 1990-05-07 1995-09-06 インターナショナル・ビジネス・マシーンズ・コーポレイション ランダムアクセスポートおよびシリアルアクセスポートを有するメモリアレイ
US5057916A (en) * 1990-11-16 1991-10-15 General Instrument Corporation Method and apparatus for refreshing motion compensated sequential video images
US5216503A (en) * 1991-12-24 1993-06-01 General Instrument Corporation Statistical multiplexer for a multichannel image compression system

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