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KR20150039215A - Ｍｐｅｇ-4 ａｖｃ 하이 레벨 코딩에 있어서 ｃａｖｌｃ 4:4:4 인트라 프로파일, ｈｉｇｈ 4:4:4 인트라 프로파일, 및 ｈｉｇｈ 4:4:4 예측 프로파일에 대하여 ｃｏｄｅｄ_ｂｌｏｃｋ_ｆｌａｇ 신택스 엘리먼트 및 ｃｏｄｅｄ_ｂｌｏｃｋ_ｐａｔｔｅｒｎ 신택스 엘리먼트의 신택스를 사용하는 방법 및 장치 - Google Patents

Ｍｐｅｇ-4 ａｖｃ 하이 레벨 코딩에 있어서 ｃａｖｌｃ 4:4:4 인트라 프로파일, ｈｉｇｈ 4:4:4 인트라 프로파일, 및 ｈｉｇｈ 4:4:4 예측 프로파일에 대하여 ｃｏｄｅｄ_ｂｌｏｃｋ_ｆｌａｇ 신택스 엘리먼트 및 ｃｏｄｅｄ_ｂｌｏｃｋ_ｐａｔｔｅｒｎ 신택스 엘리먼트의 신택스를 사용하는 방법 및 장치 Download PDF

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KR20150039215A
KR20150039215A KR1020157005270A KR20157005270A KR20150039215A KR 20150039215 A KR20150039215 A KR 20150039215A KR 1020157005270 A KR1020157005270 A KR 1020157005270A KR 20157005270 A KR20157005270 A KR 20157005270A KR 20150039215 A KR20150039215 A KR 20150039215A
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하오핑 유
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톰슨 라이센싱
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Abstract

PEG-4 AVC 하이 레벨 코딩에서 CAVLC 4:4:4 인트라 프로파일, HIGH 4:4:4 인트라 프로파일, 및 HIGH 4:4:4 예측 프로파일에 대하여 coded_block_flag 신택스 엘리먼트의 신택스를 사용하는 방법 및 장치가 제공된다. 장치는 샘플이 2개의 채도 어레이와 휘도 어레이를 포함하도록 이미지 데이터의 샘플을 인코딩하는 인코딩 파일에 따라서 이미지 데이터를 인코딩하여 결과로서 생긴 비트스트림을 낳는 인코더(100)를 포함한다. 2개의 채도 어레이 각각은 휘도 어레이와 동일한 높이 및 동일한 폭을 갖는다. 인코더(100)는 신택스 엘리먼트를 사용하여 결과로서 생긴 비트스트림에 있어서 적어도 하나의 8x8 블록의 존재를 표시한다.

Description

ＭＰＥＧ-4 ＡＶＣ 하이 레벨 코딩에 있어서 ＣＡＶＬＣ 4:4:4 인트라 프로파일, ＨＩＧＨ 4:4:4 인트라 프로파일, 및 ＨＩＧＨ 4:4:4 예측 프로파일에 대하여 ＣＯＤＥＤ_ＢＬＯＣＫ_ＦＬＡＧ 신택스 엘리먼트 및 ＣＯＤＥＤ_ＢＬＯＣＫ_ＰＡＴＴＥＲＮ 신택스 엘리먼트의 신택스를 사용하는 방법 및 장치{METHODS AND APPARATUS FOR USING SYNTAX FOR THE CODED_BLOCK_FLAG SYNTAX ELEMENT AND THE CODED_BLOCK_PATTERN SYNTAX ELEMENT FOR THE CAVLC 4:4:4 INTRA, HIGH 4:4:4 INTRA, AND HIGH 4:4:4 PREDICTIVE PROFILES IN MPEG-4 AVC HIGH LEVEL CODING}
관련 출원의 상호 참조
본 출원은 2007년 1월 11일자 미국 특허 가출원 제60/884,576호의 우선권의 이익을 주장하며, 그 전체가 본 명세서에 참조로서 포함되어 있다.
기술 분야
본 발명은 대개 비디오 코딩 및 디코딩에 관한 것으로서, 특히, ISO/IEC(International Organization for Standardization/International Electrotechnical Commission) MPEG-4(Moving Picture Experts Group-4) Part 10 AVC(Advanced Video Coding) 표준/ITU-T(International Telecommunication Union, Telecommunication Sector) H.264 권고안(이하, "MPEG-4 AVC 표준"이라 함)에 있어서 HIGH 4:4:4 인트라 프로파일 및 HIGH 4:4:4 예측 프로파일에 대하여 이전에 사용되지 않은 신택스 엘리먼트(syntax element)를 coded_block_flag 신택스 엘리먼트에 사용하는 방법 및 장치에 관한 것이다. 또한, 본 이론은 임의의 블록 사이즈에 대한 MPEG-4 AVC 표준에 있어서 CAVLC 4:4:4 인트파 프로파일의 CAVLC 프로세스의 효율성을 향상시키는 방법 및 장치에 관한 것이다.
이하, 8x8 변환을 사용하는 이미지 블록들에 대한 coded_block_flag 신택스 엘리먼트에 관하여 설명한다.
기존의 CAVLC 4:4:4 인트라 프로파일, HIGH 4:4:4 인트파 프로파일, 및 HIGH 4:4:4 예측 프로파일의 설계에 있어서, 각각의 매크로블록에 대하여 하나의 coded_block_pattern이 코딩되고, separate_color_plane_flag 신택스 엘리먼트가 0인 경우에, 3개의 컬러 성분들 모두에 의해 4 비트의 가변 CodedBlockPatternLuma가 공유된다. 이는 8x8 변환을 사용하는 CABAC(Context Adaptive Binary Arithmetic Coding) 코딩된 블록들, 즉, transform_size_8x8_flag 신택스 엘리먼트가 0이고; entropy_coding_mode_flag 신택스 엘리먼트가 0인 파라미터 셋트를 갖는 경우를 제외하고는 잘 들어맞는다. HIGH 4:4:4 인트파 프로파일, CAVLC 4:4:4 인트라 프로파일, 및 HIGH 4:4:4 예측 프로파일에 대하여 제안된 기존의 매크로블록 계층 신택스, 레시듀얼 데이터 신택스, 및 레시듀얼 블록 CABAC 신택스에 있어서, 컬러 성분들이 매크로블록에서 함께 인코딩되는 경우, transform_size_8x8_flag 신택스 엘리먼트가 0이라면 coded_block_flag 신택스 엘리먼트가 또한 사용된다.
4:4:4 프로파일들의 coded_block_pattern 신택스 엘리먼트에 대한 코드 할당에 있어서, 특히 4:4:4 프로파일들의 coded_block_pattern 신택스 엘리먼트의 기존의 시맨틱으로는, coded_block_pattern 신택스 엘리먼트의 4개의 하위 비트들만이 사용된다. 결과적으로, 4:4:4 프로파일들, 표 9-4의 파트 (b) (chrom_format_idc가 0인 경우)에 있어서, 매크로블록 예측 모드에 대한 coded_block_pattern 신택스 엘리먼트의 값들에 대한 codeNum 신택스 엘리먼트의 할당이 사용되어야 한다.
따라서, CABAC(Context Adaptive Binary Arithmetic Coding)은 이러한 환경에서 coded_block_flag_syntax 신택스 엘리먼트의 부족(deficiency)으로 인하여 HIGH 4:4:4 인트라 프로파일 및 HIGH 4:4:4 예측 프로파일에서의 8x8 블록 사이즈에 적용되는 경우에 유감스럽게도 실패한다. 또한, CAVLC(Context Adaptive Variable Length Coding) 프로세스는 CAVLC 4:4:4 인트라 프로파일에서의 coded_block_pattern 신택스 엘리먼트의 사용에 있어서 어떤 블록 사이즈에 대해서도 비효율적이다.
종래 기술의 이러한 및 기타의 단점 및 불이익들은 ISO/IEC(International Organization for Standardization/International Electrotechnical Commission) MPEG-4(Moving Picture Experts Group-4) Part 10 AVC(Advanced Video Coding) 표준/ITU-T(International Telecommunication Union, Telecommunication Sector) H.264 권고안(이하, "MPEG-4 AVC 표준"이라 함)에 있어서 HIGH 4:4:4 인트라 프로파일 및 HIGH 4:4:4 예측 프로파일에 대하여 이전에 사용되지 않은 신택스 엘리먼트를 coded_block_flag 신택스 엘리먼트에 사용하는 방법 및 장치에 관한 본 발명에 의해서 해소된다.
또한, 본 발명은 coded_block_pattern 신택스 엘리먼트에 대한 매핑 프로세스에 대하여 단색 채도 어레이 타입(a monochrome chroma array type)을 사용함으로써, 임의의 블록 사이즈에 대한 MPEG-4 AVC 표준에 있어서 CAVLC 4:4:4 인트라 프로파일을 위한 CAVLC 프로세스의 효율을 향상시키는 방법 및 장치에 관한 것이다.
본 발명의 일 양태에 따르면, 장치가 제공된다. 본 장치는 샘플이 2개의 채도 어레이와 휘도 어레이를 포함하도록 이미지 데이터의 샘플을 인코딩하는 인코딩 프로파일에 따라서 이미지 데이터를 인코딩하여 결과로서 생긴 비트스트림을 낳는 인코더를 포함한다. 2개의 채도 어레이 각각은 휘도 어레이와 동일한 높이 및 동일한 폭을 갖는다. 인코더는 신택스 엘리먼트를 사용하여 결과로서 생긴 비트스트림에 있어서 적어도 하나의 8x8 블록의 존재를 표시한다.
본 발명의 또 다른 양태에 따르면, 방법이 제공된다. 본 방법은 샘플이 2개의 채도 어레이와 휘도 어레이를 포함하도록 이미지 데이터의 샘플을 인코딩하는 인코딩 프로파일에 따라서 이미지 데이터를 결과로서 생기는 비트스트림이 되도록 인코딩하는 단계를 포함한다. 2개의 채도 어레이 각각은 휘도 어레이와 동일한 높이 및 동일한 폭을 갖는다. 인코딩하는 단계는 신택스 엘리먼트를 사용하여 결과로서 생기는 비트스트림에 있어서 적어도 하나의 8x8 블록의 존재를 표시하는 단계를 포함한다.
본 발명의 또 다른 양태에 따르면, 장치가 제공된다. 본 장치는 샘플이 2개의 채도 어레이와 휘도 어레이를 포함하도록 이미지 데이터의 샘플을 인코딩하는 인코딩 프로파일에 따라서 이전에 인코딩된 비트스트림으로부터 이미지 데이터를 디코딩하는 디코더를 포함한다. 2개의 채도 어레이 각각은 휘도 어레이와 동일한 높이 및 동일한 폭을 갖는다. 디코더는 신택스 엘리먼트를 사용하여 결과로서 생긴 비트스트림에 있어서 적어도 하나의 8x8 블록의 존재를 판정한다.
본 발명의 또 다른 양태에 따르면, 방법이 제공된다. 본 방법은 샘플이 2개의 채도 어레이와 휘도 어레이를 포함하도록 이미지 데이터의 샘플을 인코딩하는 인코딩 프로파일에 따라서 이전에 인코딩된 비트스트림으로부터 이미지 데이터를 디코딩하는 단계를 포함한다. 2개의 채도 어레이 각각은 휘도 어레이와 동일한 높이 및 동일한 폭을 갖는다. 디코딩하는 단계는 신택스 엘리먼트를 사용하여 결과로서 생긴 비트스트림에 있어서 적어도 하나의 8x8 블록의 존재를 판정한다.
본 발명의 또 다른 양태에 따르면, 장치가 제공된다. 본 장치는 샘플이 2개의 채도 어레이와 휘도 어레이를 포함하도록 이미지 데이터의 샘플을 인코딩하는 인코딩 프로파일에 따라서 결과로서 생긴 비트스트림이 되도록 이미지 데이터를 인코딩하는 인코더를 포함한다. 2개의 채도 어레이 각각은 휘도 어레이와 동일한 높이 및 동일한 폭을 갖는다. 인코더는 CAVLC(Context Adaptive Variable Length Coding)를 사용하여 이미지 데이터를 인코딩하며, 단색 채도 어레이 타입을 사용하여 코딩된 블록 패턴 신택스 엘리먼트에 대한 매핑 프로세스를 수행한다.
본 발명의 또 다른 양태에 따르면, 방법이 제공된다. 본 방법은 샘플이 2개의 채도 어레이와 휘도 어레이를 포함하도록 이미지 데이터의 샘플을 인코딩하는 인코딩 프로파일에 따라서 결과로서 생기는 비트스트림이 되도록 이미지 데이터를 인코딩하는 단계를 포함한다. 2개의 채도 어레이 각각은 휘도 어레이와 동일한 높이 및 동일한 폭을 갖는다. 인코딩하는 단계는 CAVLC를 사용하여 이미지 데이터를 인코딩하며, 단색 채도 어레이 타입을 사용하여 코딩된 블록 패턴 신택스 엘리먼트에 대한 매핑 프로세스를 수행한다.
본 발명의 또 다른 양태에 따르면, 장치가 제공된다. 본 장치는 샘플이 2개의 채도 어레이와 휘도 어레이를 포함하도록 이미지 데이터의 샘플을 인코딩하는 인코딩 프로파일에 따라서 이전에 인코딩된 비트스트림으로부터 이미지 데이터를 디코딩하는 디코더를 포함한다. 2개의 채도 어레이 각각은 휘도 어레이와 동일한 높이 및 동일한 폭을 갖는다. 디코더는 CAVLC를 사용하여 이미지 데이터를 디코딩하며, 단색 채도 어레이 타입을 사용하여 코딩된 블록 패턴 신택스 엘리먼트에 대한 매핑 프로세스를 수행한다.
본 발명의 또 다른 양태에 따르면, 방법이 제공된다. 본 방법은 샘플이 2개의 채도 어레이와 휘도 어레이를 포함하도록 이미지 데이터의 샘플을 인코딩하는 인코딩 프로파일에 따라서 이전에 인코딩된 비트스트림으로부터 이미지 데이터를 디코딩하는 단계를 포함한다. 2개의 채도 어레이 각각은 휘도 어레이와 동일한 높이 및 동일한 폭을 갖는다. 디코딩하는 단계는 CAVLC를 사용하여 이미지 데이터를 디코딩하며, 단색 채도 어레이 타입을 사용하여 코딩된 블록 패턴 신택스 엘리먼트에 대한 매핑 프로세스를 수행한다.
본 발명의 이러한 및 기타의 양태, 특징, 및 장점들은 첨부 도면들과 연계하여 읽혀지는 때에 이하의 예시적인 실시예들의 상세한 설명으로부터 더욱 명확해질 것이다.
본 발명은 이하의 예시적인 도면들에 따라서 더 잘 이해될 수 있다.
도 1은 본 발명의 일 실시예에 따라서 본 발명이 적용될 수 있는 일례의 비디오 인코더를 나타낸 블록도이다.
도 2는 본 발명의 일 실시예에 따라서 본 발명이 적용될 수 있는 일례의 비디오 디코더를 나타낸 블록도이다.
도 3은 본 발명의 일 실시예에 따른 일례의 비디오 인코딩 프로세스를 나타낸 흐름도이다.
도 4는 본 발명의 일 실시예에 따른 일례의 비디오 디코딩 프로세스를 나타낸 흐름도이다.
도 5는 본 발명의 일 실시예에 따른 또 다른 예의 비디오 인코딩 프로세스를 나타낸 흐름도이다.
도 6은 본 발명의 일 실시예에 따른 또 다른 예의 비디오 디코딩 프로세스를 나타낸 흐름도이다.
본 발명은 ISO/IEC MPEG-4 PART 10 AVC 표준/ITU-T H. 264 권고안(이하, "MPEG-4 AVC 표준"이라 함)에 있어서 HIGH 4:4:4 인트라 프로파일 및 HIGH 4:4:4 예측 프로파일을 위한 coded_blcok_flag 신택스 엘리먼트에 대하여 이전에 사용되지 않은 신택스 엘리먼트를 사용하는 방법 및 장치에 관한 것이다.
또한, 본 발명은 coded_block_pattern 신택스 엘리먼트를 위한 매핑 프로세스에 대하여 단색 채도 어레이 타입을 사용함으로써, 임의의 블록 사이즈를 위한 MPEG-4 AVC 표준에 있어서 CAVLC 4:4:4 인트라 프로파일에 대한 CAVLC 프로세스의 효율성을 향상시키는 방법 및 장치에 관한 것이다.
본 설명은 본 발명을 예시한다. 따라서, 당업자라면, 본 명세서에 명시적으로 기재하지 않았어도, 본 발명을 구체화하면서 그 개념과 범주내에 포함되는 다양한 배치예를 고안할 수 있는 것을 이해할 수 있을 것이다.
본 명세서에 인용된 모든 예들과 조건의 언어는 기술을 더 발전시키고자 본 발명과 발명자들이 기여한 개념들을 독자들이 이해함에 있어서 도움을 주기 위한 교시를 위한 것으로서, 이러한 구체적으로 인용된 예들과 조건들에 제한됨이 없는 것으로 이해되어야 한다.
또한, 본 명세서에서 그 구체적인 예뿐만이 아니라 본 발명의 원리, 양태, 및 실시예들에 대한 언급은 그 구조적 기능적 균등물 모두를 포괄하고자 한 것이다. 또한, 이러한 균등물들은 향후 개발될 균등물, 즉, 구조에 무관하게 동일한 기능을 수행하도록 개발되는 임의의 구성요소들뿐만 아니라 현재 공지된 균등물을 포함하는 것이다.
따라서, 예를 들어, 당업자라면, 본 명세서에서 제시되는 블록도들은 본 발명을 구체화하는 일례의 회로에 대한 개념적 도면을 표현한 것이라는 것을 이해할 수 있을 것이다. 마찬가지로, 임의의 플로차트, 흐름도, 상태 천이도, 의사코드, 등은 컴퓨터 판독가능 매체에서 실질적으로 표현되어, 컴퓨터 또는 프로세서가 명시적으로 도시되어 있든지 혹은 도시되어 있지 않든지 이러한 컴퓨터 또는 프로세서에 의해 실행될 수 있는 각종 프로세스들을 표현하는 것으로 이해할 수 있을 것이다.
도면에 도시된 각종 구성요소들의 기능은 적절한 소프트웨어와 연계하여 소프트웨어를 실행할 수 있는 하드웨어뿐만 아니라 전용 하드웨어의 사용을 통해 제공될 수 있다. 프로세서에 의해 제공되는 경우, 하나의 전용 프로세서에 의해, 하나의 공유 프로세서에 의해, 또는 그 중 일부는 공유될 수 있는 복수의 개별 프로세서에 의해 기능들이 제공될 수 있다. 또한, "프로세서" 또는 "컨트롤러"라는 용어의 명시적인 사용은 소프트웨어를 실행할 수 있는 하드웨어를 배타적으로 지칭하는 것으로 상정되어야 하는 것이 아니라, 이에 한하지는 않지만, 디지털 신호 프로세서(DSP) 하드웨어, 소프트웨어 저장을 위한 ROM(Read-Only Memory), RAM(Random Access Memory), 및 불휘발성 저장장치를 내재적으로 포함할 수 있는 것이다.
기타의 하드웨어, 종래의 및/또는 특수 제작 하드웨어 또한 포함될 수 있다. 마찬가지로, 도면들에 도시된 임의의 스위치들은 개념적인 것일 뿐이다. 그 기능은 문맥으로부터 더 구체적으로 이해될 수 있는 바와 같이 특정 기법이 구현하는 자에 의해 선택가능하도록 하여 프로그램 논리의 동작을 통해, 전용 논리를 통해, 프로그램 제어 및 전용 논리의 상호작용을 통해, 또는 심지어 수동으로 수행될 수 있다.
그 청구항들에 있어서, 지정된 기능을 수행하는 수단으로서 표현된 임의의 구성요소는, 예를 들어, a) 그 기능을 수행하는 회로 요소들의 조합 또는 b) 기능을 수행하기 위하여 소프트웨어를 실행하는 적절한 회로와 조합되는 펌웨어, 마이크로코드 등을 포함하는 임의의 형태의 소프트웨어를 포함하여, 그 기능을 수행하는 임의의 방법을 포괄하는 것이다. 이러한 청구항들에 정의되는 본 발명은 각종 인용된 수단들에 의해 제공되는 기능들이 청구항들이 요청하는 방식으로 조합되고 결합된다는 사실에 근거한다. 따라서, 그러한 기능들을 제공할 수 있는 임의의 수단은 본 명세서에 나타낸 바와 균등한 것으로 간주된다.
명세서에서 본 발명의 "일 실시예" 또는 "실시예"라고 하는 기재는 실시예와 연계하여 설명되는 특정한 모습, 구조, 특징, 등이 적어도 본 발명의 일 실시예에 포함된다는 것을 의미한다. 따라서, 명세서 전체를 통해 다양한 곳에서 나타나는 "일 실시예에 있어서" 또는 "실시예에 있어서"라는 것은 모두 동일한 실시예를 지칭할 필요는 없다.
본 명세서에 사용되는 "이미지 데이터"라는 어구는 정지 이미지 또는 동영상(움직임을 포함하는 이미지들의 연속) 중 임의의 것에 해당하는 데이터를 지칭하고자 하는 것이다.
또한, 본 명세서에서 사용되는 "하이 레벨 신택스(high level syntax)"라는 것은, 계층적으로 매크로블록 계층 위에 상주하는 비트스트림에 있는 신택스를 지칭한다. 예를 들어, 본 명세서에서 사용되는 하이 레벨 신택스는, 이에 한하지는 않지만, 슬라이스 헤더 레벨, SEI(Supplemental Enhancement Information) 레벨, 픽쳐 파라미터 셋트 레벨, 시퀀스 파라미터 셋트 레벨, 및 NAL 유닛 헤더 레벨에서의 신택스를 지칭할 수 있다.
또한, 본 명세서에 사용되는 바와 같이, 비트스트림에 8x8 블록이 하나 이상 있는 것을 나타내는 신택스 구성요소에 대하여, "이전에 사용되지 않은"이라는 어구는 현재의 또는 이전의 비디오 코딩 표준 및/또는 권고안의 어떠한 것에서도 사용되지 않은 신택스 엘리먼트를 지칭한다.
"및/또는(and/or)"이라는 용어의 사용은, 예를 들어, "A 및/또는 B"의 경우에, 첫번째 열거된 옵션(A)의 선택, 두번째 열거된 옵션(B)의 선택, 또는 양측 옵션(A 및 B) 모두의 선택을 포괄하고자 하는 것으로 이해되어야 한다. 또 다른 예로서, "A, B, 및/또는 C"의 경우, 이러한 어구는 첫번째 열거된 옵션(A)의 선택, 두번째 열거된 옵션(B)의 선택, 세번째 열거된 옵션(C)의 선택, 첫번째 및 두번째 열거된 옵션(A 및 B)의 선택, 첫번째 및 세번째 열거된 옵션(A 및 C)의 선택, 두번째 및 세번째 열거된 옵션(B 및 C)의 선택, 또는 세개의 옵션(A 및 B 및 C)의 선택을 포괄하고자 하는 것이다. 이는 당업자라면 쉽게 이해할 수 있듯이 열거된 많은 항목들에 확장될 수 있다.
또한, 본 명세서에 언급되는 표(Table), 단락(Section), 절(Clause), 부속절(sub-clause), 등은 MPEG-4 AVC 표준에 관한 것으로 이해되어야 한다.
또한, 본 명세서에서는 MPEG-4 AVC 표준에 대하여 본 발명의 하나 이상의 실시예들을 설명하고 있지만, 본 발명은 이러한 표준에 한하지 않으며, 본 발명의 개념을 유지하면서 MPEG-4 AVC 표준의 확장을 포함하여 다른 비디오 코딩 표준, 권고안, 및 그 확장에 대하여 사용될 수 있는 것으로 이해되어야 한다.
도 1을 참조하면, 본 발명이 적용될 수 있는 비디오 인코더가 대략 참조 번호 100으로 표시되어 있다. 비디오 인코더(100)의 입력은 가산 접합(summing junction)(110)의 비반전 입력과 신호 통신하여 연결된다. 가산 접합(110)의 출력은 변환기/양자화기(120)와 신호 통신하여 연결된다. 변환기/양자화기(120)의 출력은 엔트로피 코더(140)와 신호 통신하여 연결된다. 엔트로피 코더(140)의 출력은 인코더(100)의 출력으로서 사용가능하다.
변환기/양자화기(120)의 출력은 역 변환기/양자화기(150)와 신호 통신하여 연결된다. 역 변환기/양자화기(150)의 출력은 디블록 필터(deblock filter)(160)의 입력과 신호 통신하여 연결된다. 디블록 필터(160)의 출력은 참조 픽쳐 저장소(170)와 신호 통신하여 연결된다. 참조 픽쳐 저장소(170)의 제1 출력은 움직임 추정기(180)의 제1 입력과 신호 통신하여 연결된다. 인코더(100)의 입력은 움직임 추정기(180)의 제2 입력과 신호 통신하여 더 연결된다. 움직임 추정기(180)의 출력은 움직임 보상기(190)의 제1 입력과 신호 통신하여 연결된다. 기준 픽쳐 저장소(170)의 제2 출력은 움직임 보상기(190)의 제2 입력과 신호 통신하여 연결된다. 움직임 보상기(190)의 출력은 가산 접합(110)의 반전 입력과 신호 통신하여 연결된다.
도 2를 참조하면, 본 발명이 적용될 수 있는 비디오 디코더가 대략 참조 번호 200으로 표시되어 있다. 비디오 디코더(200)는 비디오 시퀀스를 수신하기 위한 엔트로피 디코더(210)를 포함한다. 엔트로피 디코더(210)의 제1 출력은 역양자화기/역변환기(220)의 입력과 신호 통신하여 연결된다. 역양자화기/역변환기(220)의 출력은 가산 접합(240)의 제1 입력과 신호 통신하여 연결된다.
가산 접합(240)의 출력은 디블록 필터(290)과 신호 통신하여 연결된다. 디블록 필터(290)의 출력은 기준 픽쳐 저장소(250)와 신호 통신하여 연결된다. 기준 픽쳐 저장소(250)는 움직임 보상기(260)의 제1 입력과 신호 통신하여 연결된다. 움직임 보상기(260)의 출력은 가산 접합(240)의 제2 입력과 신호 통신하여 연결된다. 엔트로피 디코더(210)의 제2 출력은 움직임 보상기(260)의 제2 입력과 신호 통신하여 연결된다. 디블록 필터(290)의 출력은 비디오 디코더(200)의 출력으로서 사용가능하다.
전술한 바와 같이, 본 발명은 ISO/IEC MPEG-4 Part 10 AVC 표준/ITU-T H.264 권고안(이하, "MPEG-4 AVC 표준"이라 함)에 있어서 HIGH 4:4:4 인트라 프로파일 및 HIGH 4:4:4 예측 프로파일을 위한 coded_block_flag 신택스 엘리먼트에 대하여 이전에 사용되지 않은 신택스를 사용하는 방법 및 장치에 관한 것이다. 유리하게도, 본 발명은 MPEG-4 AVC 표준 및 그 개정판에 기재된 HIGH 4:4:4 인트라 프로파일 및 HIGH 4:4:4 예측 프로파일의 기존의 구현예들의 상기 문제점들을 적어도 극복한다.
4:4:4 프로파일들의 coded_block_pattern 신택스 엘리먼트에 대한 코드 할당에 대하여, 특히, 4:4:4 프로파일들의 coded_block_pattern 신택스 엘리먼트의 기존의 시맨틱에 있어서, coded_block_pattern 신택스 엘리먼트의 하위 4개 비트만이 사용된다. 결과적으로, 4:4:4 프로파일에 있어서, 매크로블록 예측 모드에 있어서 coded_block_pattern 신택스 엘리먼트의 값들에 대한 codeNum 신택스 엘리먼트의 할당에 관한 표 9-4b (chrom_format_idc는 0)가 사용되어야 한다.
따라서, 일 실시예에 있어서, coded_block_pattern 신택스 엘리먼트에 대하여 다음과 같이 새로운 매핑 프로세스가 제공된다.
기존의 표 9-4a 및 9-4b는 다음과 같이 변경된다. 제안된 변화는 CAVLC 엔트로피 코딩에 관한 것이지만, 완성을 위해서는, 다음과 같이 CAVLC 모드에서의 coded_block_pattern 신택스 엘리먼트에 대하여 전체 단락의 대부분이 제공되는 것으로 이해되어야 한다.
coded_block_pattern 신택스 엘리먼트에 대한 매핑 프로세스에 관하여, 종속절 9.1에 명기된 바와 같이 매핑 프로세스의 입력은 codeNum이다. 매핑 프로세스의 출력은 me(v)로 코딩된 신택스 엘리먼트 coded_block_pattern의 값이다. 표 9-4a 및 표 9-4b는 매크로블록 예측 모드가 Intra_4x4, Intra_8x8 또는 Inter와 같은지 여부에 따른 codeNum에 대한 coded_block_pattern의 할당을 나타낸다. 특히, 표 9-4a는 ChromaArrayType이 1 또는 2인 경우에 관한 것이며, 표 9-4b는 ChromaArrayType이 0 또는 3인 경우에 관한 것이다.
[표 9-4a]
Figure pat00001
Figure pat00002
Figure pat00003
[표 9-4b]
Figure pat00004
ChromaArrayType은 단색 비디오 신호인 경우 0이다. ChromaArrayType은 4:2:0 비디오의 경우 1이다. ChromaArrayType은 4:2:2 비디오의 경우 2이다. ChromaArrayType은 4:4:4 비디오의 경우 3이다.
매크로블록 계층 시맨틱에 관하여 이하의 정의가 사용된다:
transform _ size _8x8_ flag가 1이라면, chroma_format_idc == 3 및 separate_colour_plane_flag== 0인 경우, 현재의 매크로블록에 있어서 휘도 샘플들 및 Cb 샘플들 및 Cr 샘플들에 대하여 레시듀얼 8x8 블록들에 대한 디블록킹 필터 프로세스 이전의 변환 계수 디코딩 프로세스 및 픽쳐 구성 프로세스가 인보크(invoke)될 것을 지정한다. transfor_size_8x8_flag가 0이라면, chroma_format_idc == 3 및 separate_colour_plane_flag == 0인 경우, 현재의 매크로블록에 있어서 휘도 샘플들 및 Cb 샘플들 및 Cb 샘플들에 대하여 레시듀얼 4x4 블록들에 대한 디블록킹 필터 프로세스 이전의 변환 계수 디코딩 프로세스 및 픽쳐 구성 프로세스가 인보크될 것을 지정한다. transform_size_8x8_flag가 비트스트림 내에 있지 않으면, 0과 같은 것으로 추정되게 된다.
매크로블록 예측 시맨틱에 관하여 이하의 정의가 사용된다:
intra _ chroma _ pred _ mode는 표 7-16에 나타낸 바와 같이 Intra_4x4 또는 Intra_16x16 예측을 사용하는 매크로블록들의 채도(chroma)에 대하여 사용되는 공간 예측의 타입을 지정한다. intra_chroma_pred_mode의 값은 0 내지 3의 범위(0 및 3을 포함함)가 된다. chroma_format_idc == 3인 경우, intra_chroma_pred_mode가 비트스트림에 존재하지 않게 된다.
코딩된 블록 패턴에 대한 이진화 프로세스에 관하여 이하가 적용된다:
coded_block_pattern의 이진화는 프리픽스 파트(prefix part)와 서픽스 파트(suffix part)(존재한다면)로 구성된다. 이진화의 서픽스 파트는 cMax = 15로 한 CodedBlockPatternLuma의 FL 이진화에 의해 주어진다. chroma_format_idc가 0이 아닌 경우(단색) 또는 3이 아닐 경우(4:4:4), 서픽스 파트가 존재하며, cMax = 2로 한 CodedBlockPatternChroma의 TU 이진화를 포함한다. coded_block_pattern 신택스 엘리먼트의 값과 CodedBlockPatternLuma 및 CodedBlockPatternChroma의 값 사이의 관계는 종속절 7.4.5와 같이 주어진다.
표 1은 레시듀얼 블록 CABAC 신택스를 나타내며, 이하와 같다:
Figure pat00005
이하, 콘택스트 변수들에 대한 초기화 프로세스를 설명한다.
표 2는 초기화 프로세스에 있어서 각 슬라이스 타입에 대한 신택스 엘리먼트들과 ctxldx와의 관계를 나타낸다.
Figure pat00006
표 3은 1012에서부터 1023까지 ctsldx에 대한 변수 m 및 n의 값들을 나타낸 것으로, 이하와 같다.
Figure pat00007
이진화 프로세스에 관하여 이하를 적용한다: 콘텍스트 인덱스 ctxldx의 가능한 값들은 0 내지 1023의 범위(0 및 1023을 포함함)이다. ctxldxOffset에 할당되는 값은 신택스 엘리먼트의 해당하는 이진화 또는 이진화 파트에 할당되는 ctxldx의 범위의 하위 값을 지정한다.
표 4는 신택스 엘리먼트들 및 관련 이진화 타입들, maxBinIdxCtx 및 ctxIdxOffset을 나타내며, 이하와 같다.
Figure pat00008
Figure pat00009
Figure pat00010
이하, ctxldx의 도출 프로세스에 관하여 설명한다.
표 5는 신택스 엘리먼트들 coded_block_flag, significant_coeff_flag, last_significant_coeff_flag, 및 coeff_abs_level_minus1에 있어서 ctxBlockCat에 대한 ctxldxBlockCatOffset의 할당을 나타내며, 이하와 같다:
Figure pat00011
이하, 신택스 엘리먼트 coded_block_flag에 대한 ctxldxlnc의 도출 프로세스에 관하여 설명한다. 이 프로세스에 대한 입력은 ctxBlockCat이며, 임의의 추가의 입력은 다음과 같이 명시된다:
- ctxBlockCat이 0, 6, 또는 10이면, 추가 입력은 없다;
- 그렇지 않고, ctxBlockCat이 1 또는 2이면, luma4x4Blkldx;
- 그렇지 않고, ctxBlockCat이 3이면, 채도 성분 인덱스 iCbCr;
- 그렇지 않고, ctxBlockCat이 4이면, chroma4x4Blkldx 및 채도 성분 인덱스 iCbCr;
- 그렇지 않고, ctxBlockCat이 5이면, luma8x8Blkldx;
- 그렇지 않고, ctxBlockCat이 7 또는 8이면, cb4x4Blkldx;
- 그렇지 않고, ctxBlockCat이 9이면, cb8x8Blkldx;
- 그렇지 않고, ctxBlockCat이 11 또는 12이면, cr4x4Blkldx;
- 그렇지 않고, (ctxBlockCat이 13이면), cr8x8Blkldx.
이 프로세스의 출력은 ctxldxlnc(ctxBlockCat)이다.
변수 transBlockN (N은 A 또는 B)은 다음과 같이 도출되는 것으로 한다.
- ctxBlockCat이 0, 6, 또는 10이면, 이하가 적용된다.
- 종속절 6.4.10.1에 명시된 이웃하는 매크로블록들에 대한 도출 프로세스가 인보크되며, mbAddrN(N은 A 또는 B)에 출력이 할당된다.
- 변수 transBlockN은 다음과 같이 도출된다.
- mbAddrN이 사용가능하고, 매크로블록 mbAddrN이 Intra_16x16 예측 모드로 코딩되면, 이하가 적용된다.
- ctxBlockCat이 0이면, 매크로블록 mbAddrN의 휘도 DC 블록이 transBlockN에 할당된다.
- 그렇지 않고, ctxBlockCat이 6이면, 매크로블록 mbAddrN의 Cb DC 블록이 transBlockN에 할당된다.
- 그렇지 않고, (ctxBlockCat이 10이면), 매크로블록 mbAddrN의 Cr DC 블록이 transBlockN에 할당된다.
- 그렇지 않으면, transBlockN이 사용가능하지 않은 것으로 마킹된다.
- 그렇지 않고, ctxBlockCat이 1 또는 2이면, 이하가 적용된다.
- 종속절 6.4.10.4에 명시된 이웃하는 4x4 휘도 블록들에 대한 도출 프로세스는 luma4x4Blkldx를 입력으로 하여 인보크되며, mbAddrN, luma4x4BlkldxN에 출력이 할당된다 (N은 A 또는 B).
- 변수 transBlockN은 다음과 같이 도출된다.
- mbAddrN이 사용가능하고, 매크로블록 mbAddrN이 P_Skip, B_Skip, 또는 I_PCM인 mb_type을 갖지 않으며, ((CodedBlockPatternLuma >> (luma4x4BlkldxN >>2))&1)이 매크로블록 mbAddrN에 있어서 0이 아니며, transform_siz_8x8_flag가 매크로블록 mbAddrN에 있어서 0인 경우, 매크로블록 mbAddrN의 인덱스 luma4x4BlkldxN를 갖는 4x4 휘도 블록이 transBlockN에 할당된다.
- 그렇지 않고, mbAddrN이 사용가능하고, 매크로블록 mbAddrN이 P_Skip 또는 B_Skip인 mb_type을 갖지 않으며, ((CodedBlockPatternLuma >> (luma4x4BlkldxN >>2))&1)이 매크로블록 mbAddrN에 있어서 0이 아니며, transform_size_8x8_flag가 매크로블록 mbAddrN에 있어서 1이면, 매크로블록 mbAddrN의 인덱스 (luma4x4BlkldxN>>2)을 갖는 8x8 휘도 블록이 transBlockN에 할당된다.
- 그렇지 않으면, transBlockN이 사용가능하지 않은 것으로 마킹된다.
- 그렇지 않고, ctxBlockCat이 3이면, 이하가 적용된다.
- 종속절 6.4.10.1에 명시된 이웃하는 매크로블록들에 대한 도출 프로세스가 인보크되고, 출력이 mbAddrN에 할당된다(N은 A 또는 B).
- 변수 transBlockN이 이하와 같이 도출된다.
- mbAddrN이 사용가능하고, 매크로블록 mbAddrN이 P-Skip, B_Skip, 또는 I_PCM인 mb_type을 갖지 않으며, CodedBlockPatternChroma가 매크로블록 mbAddrN에 있어서 0이 아니면, 매크로블록 mbAddrN의 채도 성분 iCbCr의 채도 DC 블록이 transBlockN에 할당된다.
- 그렇지 않으면, transBlockN은 사용가능하지 않은 것으로 마킹된다.
- 그렇지 않고, ctxBlockCat이 4이면, 이하가 적용된다.
- 종속절 6.4.10.5에 명시된 이웃하는 4x4 채도 블록들에 대한 도출 프로세스가 chroma4x4Blkldx를 입력으로 하여 인보크되고, mbAddrN, chroma4x4BlkldxN에 출력이 할당된다(N은 A 또는 B).
- 변수 transBlockN이 이하와 같이 도출된다.
- mbAddrN이 사용가능하고, 매크로블록 mbAddrN이 P_Skip, B_Skip, 또는 I_PCM인 mb_type을 갖지 않으며, CodedBlockPatternChroma가 매크로블록 mbAddrN에 있어서 2라면, 매크로블록 mbAddrN의 채도 성분 iCbCr의 chroma4x4BlkldxN을 갖는 4x4 채도 블록이 transBlockN에 할당된다.
- 그렇지 않으면, transBlockN이 사용가능하지 않은 것으로 마킹된다.
- 그렇지 않고, ctxBlockCat이 5이면, 이하가 적용된다.
- 종속절 6.4.8.2에 명시된 이웃하는 8x8 휘도 블록들에 대한 도출 프로세스가 luma8x8Blkldx를 입력으로 하여 인보크되고, 출력이 mbAddrN, luma8x8BlkldxN에 할당된다(N은 A 또는 B).
- 변수 transBlockN은 이하와 같이 도출된다.
- mbAddrN이 사용가능하고, 매크로블록 mbAddrN이 P_Skip, B_Skip, 또는 I_PCM인 mb_type을 갖지 않으며, ((CodedBlockPatternLuma >> luma8x8Blkldx)&1)이 매크로블록 mbAddrN에 있어서 0이 아니며, transform_size_8x8_flag가 매크로블록 mbAddrN에 있어서 1이면, 매크로블록 mbAddrN의 인덱스 luma8x8BlkldxN을 갖는 8x8 휘도 블록이 transBlockN에 할당된다.
- 그렇지 않으면, transBlockN이 사용가능하지 않은 것으로 마킹된다.
- 그렇지 않고, ctxBlockCat이 7 또는 8이면, 이하가 적용된다.
- 종속절 6.4.8.4.1에 명시된 이웃하는 4x4 Cb 블록들에 대한 도출 프로세스는 cb4x4Blkldx를 입력으로 하여 인보크되고, mbAddrN, cb4x4BlkldxN에 출력이 할당된다(N은 A 또는 B).
- 변수 transBlockN이 이하와 같이 도출된다.
- mbAddrN이 사용가능하고, 매크로블록 mbAddrN이 P_Skip, B_Skip, 또는 I_PCM인 mb_type을 갖지 않으며, ((CodedBlockPatternLuma >> (cb4x4BlkldxN >>2))&1)이 매크로블록 mbAddrN에 있어서 0이 아니며, transform_size_8x8_flag가 매크로블록 mbAddrN에 있어서 0이라면, 매크로블록 mbAddrN의 인덱스 cb4x4BlkldxN을 갖는 4x4 Cb 블록이 transBlockN에 할당된다.
- 그렇지 않고, mbAddrN이 사용가능하고, 매크로블록 mbAddrN이 P_Skip 또는 B_Skip인 mb_type을 갖지 않으며, ((CodedBlockPatternLuma >> (cbx4x4BlkldxN >>2))&1)이 매크로블록 mbAddrN에 있어서 0이 아니며, transform_size_8x8_flag가 매크로블록 mbAddrN에 있어서 1이라면, 매크로블록 mbAddrN의 인덱스 (cb4x4BlkldxN>>2)을 갖는 8x8 Cb 블록이 transBlockN에 할당된다.
- 그렇지 않으면, transBlockN이 사용가능하지 않은 것으로 마킹된다.
- 그렇지 않고, ctxBlockCat이 9이면, 이하가 적용된다.
- 종속절 6.4.8.2.1에 명시된 이웃하는 8x8 Cb 블록들에 대한 도출 프로세스가 cb8x8Blkldx를 입력으로 하여 인보크되고, 출력이 mbAddrN, cb8x8BlkldxN에 할당된다(N은 A 또는 B).
- 변수 transBlockN은 이하와 같이 도출된다.
- mbAddrN이 사용가능하고, 매크로블록 mbAddrN이 P_Skip, B_Skip, 또는 I_PCM인 mb_type을 갖지 않으며, ((CodedBlockPatternLuma >> cb8x8Blkldx)&1)이 매크로블록 mbAddrN에 있어서 0이 아니며, transform_size_8x8_flag가 매크로블록 mbAddrN에 있어서 1이면, 매크로블록 mbAddrN의 인덱스 cb8x8BlkldxN을 갖는 8x8 Cb 블록이 transBlockN에 할당된다.
- 그렇지 않으면, transBlockN이 사용가능하지 않은 것으로 마킹된다.
- 그렇지 않고, ctxBlockCat이 11 또는 12이면, 이하가 적용된다.
- 종속절 6.4.8.4.1에 명시된 이웃하는 4x4 Cr 블록들에 대한 도출 프로세스가 cr4x4Blkldx를 입력으로 하여 인보크되고, 출력이 mbAddrN, cr4x4BlkldxN에 할당된다(N은 A 또는 B).
- 변수 transBlockN이 이하와 같이 도출된다.
- mbAddrN이 사용가능하고, 매크로블록 mbAddrN이 P_Skip, B_Skip, 또는 I_PCM인 mb_type을 갖지 않으며, ((CodedBlockPatternLuma >> (cr4x4BlkldxN>>2))&1)이 매크로블록 mbAddrN에 있어서 0이 아니며, transform_size_8x8_flag가 매크로블록 mbAddrN에 있어서 0이라면, 매크로블록 mbAddrN의 인덱스 cr4x4BlkldxN을 갖는 4x4 Cr 블록이 transBlockN에 할당된다.
- 그렇지 않고, mbAddrN이 사용가능하고, 매크로블록 mbAddrN이 P_Skip 또는 B_Skip인 mb_type을 갖지 않으며, ((CodedBlockPatternLuma >> (cr4x4BlkldxN>>2))&1)이 매크로블록 mbAddrN에 있어서 0이 아니며, transform_size_8x8_flag가 매크로블록 mbAddrN에 있어서 1이라면, 매크로블록 mbAddrN의 인덱스 (cr4x4BlkldxN>>2)을 갖는 8x8 Cr 블록이 transBlockN에 할당된다.
- 그렇지 않으면, transBlockN이 사용가능하지 않은 것으로 마킹된다.
- 그렇지 않고, ctxBlockCat이 13이면, 이하가 적용된다.
- 종속절 6.4.8.2.1에 명시된 이웃하는 8x8 Cr 블록들에 대한 도출 프로세스가 cr8x8Blkldx를 입력으로 하여 인보크되고, 출력이 mbAddrN, cr8x8BlkldxN에 할당된다(N은 A 또는 B).
- 변수 transBlockN은 이하와 같이 도출된다.
- mbAddrN이 사용가능하고, 매크로블록 mbAddrN이 P_Skip, B_Skip, 또는 I_PCM인 mb_type을 갖지 않으며, ((CodedBlockPatternLuma >> cr8x8Blkldx)&1)이 매크로블록 mbAddrN에 있어서 0이 아니며, transform_size_8x8_flag가 매크로블록 mbAddrN에 있어서 1이면, 매크로블록 mbAddrN의 인덱스 cr8x8BlkldxN을 갖는 8x8 Cr 블록이 transBlockN에 할당된다.
- 그렇지 않으면, transBlockN이 사용가능하지 않은 것으로 마킹된다.
변수 condTermFlagN(N은 A 또는 B)가 이하와 같이 도출되는 것으로 한다:
- 이하의 조건 중 어느 것이라도 사실이라면, condTermFlagN이 0으로 설정된다.
- mbAddrN이 사용가능하지 않으며, 현재의 매크로블록이 인터 예측 모드(Inter prediction mode)에서 코딩되는 경우.
- mbAddrN이 사용가능하고, transBlockN이 사용가능하지 않으며, 매크로블록 mbAddrN에 대한 mb_type이 I_PCM과 같지 않은 경우.
- 현재의 매크로블록이 인트라 예측 모드(Intra prediction mode)에서 코딩되며, contrained_intra_pred_flag가 1이며, 매크로블록 mbAddrN이 사용가능하며, 인터 예측 모드에서 코딩되었으며, 슬라이스 데이터 분할이 사용되고 있는 경우(nal_unit_type은 2 내지 4(2 및 4를 포함함)의 범위에 있음).
- 그렇지 않고, 이하의 조건 중 어느 것이라도 사실이라면, condTermFlagN이 1로 설정된다.
- mbAddrN이 사용가능하지 않으며, 현재의 매크로블록이 인트라 예측 모드에서 코딩되는 경우.
- 매크로블록 mbAddrN에 대한 mb_type이 I_PCM인 경우.
- 그렇지 않다면, condTermFlagN은 매크로블록 mbAddrN에 대하여 디코딩된 변환 블록 transBlockN의 coded_block_flag의 값과 같게 설정된다.
변수 ctxldxlnc(ctxBlockCat)은 이하와 같이 도출된다:
ctxldxlnc(ctxBlockCat) = condTermFlagA + 2*condTermFlagB
도 3을 참조하면, 일례의 비디오 인코딩 프로세스가 참조 번호 300으로 통칭적으로 표시되어 있다.
인코딩 프로세스(300)는 시작 블록(305)을 포함하며, 시작 블록(305)은 루프 제한 블록(312)으로 제어를 넘긴다. 루프 제한 블록(312)은 이미지 내의 각 블록에 대한 루프를 시작하고, 기능 블록 315에 제어를 넘긴다. 기능 블록 315에서는 현재 이미지 블록의 움직임 보상 또는 공간 예측을 행하고, 제어를 기능 블록 320에 넘긴다. 기능 블록 320에서는 현재의 이미지 블록에서 움직임 보상된 또는 공간 예측된 화상을 감산하여 예측 레시듀얼(prediction residual) 화상을 형성하며, 제어를 기능 블록 330에 넘긴다. 기능 블록 330에서는 예측 레시듀얼 화상을 변환하고 양자화하며, 제어를 기능 블록 335에 넘긴다. 기능 블록 335에서는 예측 레시듀얼 화상을 역변환 및 역양자화하여 코딩된 예측 레시듀얼 화상을 형성하고, 제어를 기능 블록 345에 넘긴다. 기능 블록 345에서는 코딩된 레시듀얼 화상을 예측 화상에 가산하여 코딩된 픽쳐 블록을 형성하고, 제어를 종료 루프 블록 350에 넘긴다. 종료 루프 블록 350에서는 루프를 종료시키고 제어를 기능 블록 355에 넘긴다. 기능 블록 355에서는 적용가능한 경우(즉, 이러한 블록들이 실제로 비트스트림에 존재하는 경우), 8x8 블록의 존재를 표시하기 위하여, 적어도 이미지에 대한 인코딩된 결과의 비트스트림에 대하여 대역내 또는 대역외(in-band or out-of-band)로 신택스 엘리먼트를 보내고, 제어를 종료 블록 399에 넘긴다. 신택스 엘리먼트는, 예를 들어, 디코더에 의한 표시된 블록들에 대한 CABAC 및/또는 CAVLC의 적용을 선택적으로 디스에이블하도록 보내질 수 있다.
도 4를 참조하면, 일례의 비디오 디코딩 프로세스가 참조 번호 400으로 표시되어 있다.
디코딩 프로세스(400)는 시작 블록 405를 포함하며, 제어를 기능 블록 407에 넘긴다. 기능 블록 407에서는, 적용가능한 경우(즉, 이러한 블록들이 실제로 비트스트림 내에 존재하는 경우), 비트스트림에 대하여 대역내 또는 대역외로 8x8 블록들의 존재를 표시하는 신택스 엘리먼트를 수신하고, 루프 제한 블록 410에 제어를 넘긴다. 신택스 엘리먼트는, 예를 들어, 디코딩 동안 표시된 블록들에 CABAC 및/또는 CAVLC의 적용을 선택적으로 디스에이블하도록 수신될 수 있다. 루프 제한 블록(410)은 비트스트림으로부터 이미지의 현재의 블록에 대한 루프를 시작하고, 제어를 기능 블록 415에 넘긴다. 기능 블록 415에서는 코딩된 레시듀얼 화상을 디코딩하고, 제어를 기능 블록 420으로 넘긴다. 기능 블록 420에서는 디코딩된 레시듀얼 화상을 역변환 및 역양자화하여 코딩된 레시듀얼 화상을 형성하며, 제어를 기능 블록 430에 넘긴다. 기능 블록 430에서는 코딩된 레시듀얼 화상을 예측 화상에 가산하여 코딩된 픽쳐 블록을 형성하며, 제어를 루프 제한 블록 435에 넘긴다. 루프 제한 블록(435)에서는 루프를 종료시키고, 제어를 종료 블록 499에 넘긴다.
도 5를 참조하면, 일례의 비디오 인코딩 프로세스가 참조 번호 500으로 표시되어 있다.
인코딩 프로세스(500)는 시작 블록(505)를 포함하며, 제어를 기능 블록 510에 넘긴다. 기능 블록 510에서는 coded_block_pattern 신택스 엘리먼트에 대한 매핑 프로세스에서 사용하기 위한 단색 채도 어레이 타입에 대한 표를 선택하는 것을 포함하여 초기화를 수행하며, 제어를 루프 제한 블록 512에 넘긴다. 루프 제한 블록 512에서는 이미지의 각 블록에 대한 루프를 시작하고, 제어를 기능 블록 515에 넘긴다. 기능 블록 515에서는 현재의 이미지 블록에 대한 움직임 보상된 또는 공간 예측된 화상을 형성하고, 제어를 기능 블록 530에 넘긴다. 기능 블록 520에서는 현재의 이미지 블록에서 움직임 보상된 또는 공간 예측된 화상을 감산하여 예측 레시듀얼 화상을 형성하고, 제어를 기능 블록 530에 넘긴다. 기능 블록 530에서는 예측 레시듀얼 정보를 변환 및 양자화하고, 제어를 기능 블록 535에 넘긴다. 기능 블록 535에서는 예측 레시듀얼 화상을 역변환 및 역양자화하여 코딩된 예측 레시듀얼 화상을 형성하고, 제어를 기능 블록 545에 넘긴다. 기능 블록 545에서는 코딩된 레시듀얼 화상을 예측 화상에 가산하여 코딩된 픽쳐 블록을 형성하고, 제어를 종료 루프 블록 550에 넘긴다. 종료 루프 블록 550에서는 루프를 종료시키고, 제어를 기능 블록 555에 넘긴다. 기능 블록 555에서는 적어도 이미지에 대하여 인코딩된 결과의 비트스트림에 대하여 대역내 또는 대역외로 coded_block_pattern 신택스 엘리먼트를 보내고, 제어를 종료 블록 599에 넘긴다.
도 6을 참조하면, 일례의 비디오 디코딩 프로세스가 참조 번호 600으로 표시되어 있다.
디코딩 프로세스(600)는 시작 블록 605를 포함하며, 제어를 기능 블록 607에 넘긴다. 기능 블록 607에서는 비트스트림에 대하여 대역내 또는 대역외로 (단색 채도 어레이 타입을 사용하여 이전에 매핑된) coded_block_pattern 신택스 엘리먼트를 수신하고, 제어를 루프 제한 블록 610에 넘긴다. 루프 제한 블록 610에서는 비트스트림으로부터 화상의 현재의 블록에 대한 루프를 시작하고, 제어를 기능 블록 615에 넘긴다. 기능 블록 615는 코딩된 레시듀얼 화상을 엔트로피 디코딩하고, 제어를 기능 블록 620에 넘긴다. 기능 블록 620에서는 디코딩된 레시듀얼 화상을 역변환 및 역양자화하여 코딩된 레시듀얼 화상을 형성하고, 제어를 기능 블록 630에 넘긴다. 기능 블록 630에서는 코딩된 레시듀얼 화상을 예측 화상에 가산하여 코딩된 픽쳐 블록을 형성하고, 제어를 루프 제한 블록 635에 넘긴다. 루프 제한 블록 635에서는 루프를 종료시키고, 제어를 종료 블록 699에 넘긴다.
간단함과 명료함을 위하여, 도 3 내지 도 6은 인코딩 및 디코딩 이미지 블록들 각각에 있어서 포함된 모든 단계들을 나타내고 있지 않을 수 있다는 것을 이해하기 바란다.
이하, 본 발명의 많은 장점들/특징들 중 일부에 대하여 설명하며, 그 중 일부는 상기에서 언급하였다. 예를 들어, 하나의 장점/특징은, 샘플이 2개의 채도 어레이와 1개의 휘도 어레이를 포함하는 식으로 이미지 데이터의 샘플을 인코딩하는 인코딩 프로파일에 따라서 이미지 데이터를 결과의 비트스트림으로 인코딩하기 위한 인코더를 포함하는 장치이다. 2개의 채도 어레이 각각은 휘도 어레이와 동일한 높이 및 동일한 폭을 갖는다. 인코더는 신택스 엘리먼트를 사용하여 결과의 비트스트림에서 적어도 하나의 8x8 블록의 존재를 표시한다.
또 다른 장점/특징은 전술한 인코더를 갖는 장치로서, 신택스 엘리먼트가 CABAC(Context Adaptive Binary Arithmetic Coding)에 대하여 적어도 하나의 8x8 블록의 존재를 표시한다.
또 다른 장점/특징은 전술한 인코더을 갖는 장치로서, 신택스 엘리먼트가 디코더에 의해 적어도 하나의 8x8 블록에 대하여 CABAC(Context Adaptive Binary Arithmetic Coding)의 적용을 선택적으로 디스에이블하기 위하여 적어도 하나의 8x8 블록의 존재를 표시한다.
또 다른 장점/특징은 전술한 인코더를 갖는 장치로서, 인코딩 프로파일이 ISO/IEC MPEG-4 Part 10 AVC 표준/ITU-T H.264 권고안의 HIGH 4:4:4 프로파일이다.
또한, 또 다른 장점/특징은 전술한 인코더를 갖는 장치로서, 인코딩 프로파일이 HIGH 4:4:4 인트라 프로파일, CAVLC 4:4:4 인트라 프로파일, 및 HIGH 4:4:4 예측 프로파일 중 어느 하나이다.
또한, 또 다른 장점/특징은 전술한 인코더를 갖는 장치로서, 신택스 엘리먼트가 이전에는 사용되지 않은 것이다.
또한, 또 다른 장점/특징은 전술한 인코더를 갖는 장치로서, 신택스 엘리먼트가 하이 레벨 신택스 엘리먼트이다.
또한, 또 다른 장점/특징은 전술한 인코더를 갖는 장치로서, 하이 레벨 신택스 엘리먼트가 슬라이스 헤더 레벨, SEI(Supplemental Enhancement Information) 레벨, 픽쳐 파라미터 셋트 레벨, 시퀀스 파라미터 셋트 레벨, 및 네트워크 추상화 계층 유닛 헤더 레벨 중 적어도 하나에 위치한다.
또한, 또 다른 장점/특징은 전술한 인코더를 갖는 장치로서, 신택스 엘리먼트가 결과의 비트스트림에 대하여 대역내(in-band) 및 대역외(out-of-band) 중 하나로 보내진다.
또한, 또 다른 장점/특징은 샘플이 2개의 채도 어레이와 1개의 휘도 어레이를 포함하도록 이미지 데이터의 샘플을 인코딩하는 인코딩 프로파일에 따라서 이미지 데이터를 결과의 비트스트림으로 인코딩하는 인코더를 갖는 장치이다. 2개의 채도 어레이 각각은 휘도 어레이와 동일한 높이 및 동일한 폭을 갖는다. 인코더는 CAVLC를 사용하여 이미지 데이터를 인코딩하며, 단색 채도 어레이 타입을 사용하여 코딩된 블록 패턴 신택스 엘리먼트에 대한 매핑 프로세스를 수행한다.
본 발명의 이러한 그리고 기타의 특징 및 장점들은 당업자라면 본 명세서의 교시에 기초하여 용이하게 확인될 수 있다. 본 발명의 교시는 하드웨어, 소프트웨어, 펌웨어, 특수 목적 프로세서, 또는 그 조합들의 다양한 형태로서 구현될 수 있는 것으로 이해되어야 한다.
더 바람직하게는, 본 발명의 교시는 하드웨어와 소프트웨어의 조합으로서 구현된다. 또한, 소프트웨어는 프로그램 저장 장치 상에서 실체적으로 수록된 어플리케이션 프로그램으로서 구현될 수 있다. 어플리케이션 프로그램은 임의의 적절한 아키텍쳐를 포함하는 기계에 업로드되어 이에 의해 실행될 수 있다. 바람직하게는, 기계는 하나 이상의 CPU(Central Processing Unit), RAN(Random Access Memory), 및 입출력(I/O) 인터페이스 등의 하드웨어를 갖는 컴퓨터 플랫폼 상에 구현된다. 컴퓨터 플랫폼은 또한 운영 체제 및 마이크로인스트럭션 코드를 포함할 수도 있다. 본 명세서에 기재한 각종 프로세스와 기능들은 CPU에 의해 실행될 수 있는 마이크로인스트럭션 코드의 일부 또는 어플리케이션 프로그램의 일부 또는 그 임의의 조합일 수 있다. 또한, 각종 기타의 주변 장치들은 추가의 데이터 저장장치 및 인쇄 장치 등의 컴퓨터 플랫폼에 연결될 수 있다.
첨부 도면들에 도시된 구성요소의 시스템 성분들과 방법들 중 일부는 소프트웨어로 구현되는 것이 바람직하기 때문에, 시스템 성분들 또는 프로세스 기능 블록들 사이의 실제적인 연결은 본 발명이 프로그램되는 방식에 따라서 상이할 수 있다는 것을 더 이해하기 바란다. 당업자라면, 본 명세서의 교시가 주어지면, 본 발명의 이러한 구현예 또는 구성예 또는 유사한 구현예 또는 구성예를 상정할 수 있을 것이다.
예시적인 실시예들을 첨부 도면을 참조하여 본 명세서에서 설명하였지만, 본 발명은 이러한 구체적인 실시예들에 한하지 않으며, 본 발명의 개념 또는 범주를 일탈하지 않고서 당업자에 의해 다양한 변경예와 변형예가 이루어질 수 있다는 것을 이해할 수 있을 것이다. 이러한 변경예와 변형예 전부는 첨부된 청구항들에 명기된 바와 같이 본 발명의 범주내에 포함되는 것이다.

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  1. 방법에 있어서,
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