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KR102383301B1 - Display driving device and display device including the same - Google Patents

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KR102383301B1
KR102383301B1 KR1020170100087A KR20170100087A KR102383301B1 KR 102383301 B1 KR102383301 B1 KR 102383301B1 KR 1020170100087 A KR1020170100087 A KR 1020170100087A KR 20170100087 A KR20170100087 A KR 20170100087A KR 102383301 B1 KR102383301 B1 KR 102383301B1
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display
clock
period
signal
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최하나
박종민
임헌용
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주식회사 엘엑스세미콘
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Abstract

본 발명은 디스플레이 구동 장치를 개시한다. 상기 디스플레이 구동 장치는, 데이터에 클럭이 임베디드된 입력 신호로부터 제1 클럭 신호를 복원하는 클럭 데이터 복원 회로; 디스플레이 패널의 터치를 감지하는 리드 아웃 회로; 및 상기 리드 아웃 회로를 구동시키기 위해, 상기 클럭 데이터 복원 회로에 의해 복원된 상기 제1 클럭 신호 또는 내부에서 생성한 제2 클럭 신호 중 어느 하나를 제3 클럭 신호로서 상기 리드 아웃 회로에 제공하는 선택부;를 포함한다.The present invention discloses a display driving device. The display driving device may include: a clock data recovery circuit configured to recover a first clock signal from an input signal in which a clock is embedded in data; a read-out circuit for sensing a touch on the display panel; and selecting to provide either the first clock signal restored by the clock data recovery circuit or the second clock signal generated therein as a third clock signal to the read-out circuit in order to drive the read-out circuit includes;

Description

디스플레이 구동 장치 및 이를 포함하는 디스플레이 장치{DISPLAY DRIVING DEVICE AND DISPLAY DEVICE INCLUDING THE SAME}Display driving device and display device including same

본 발명은 디스플레이 장치에 관한 것으로, 더 상세하게는 터치 감지가 가능한 디스플레이 패널을 구동하는 디스플레이 구동 장치 및 이를 포함하는 디스플레이 장치에 관한 것이다.The present invention relates to a display device, and more particularly, to a display driving device for driving a touch-sensitive display panel, and a display device including the same.

터치 감지가 가능한 디스플레이 패널은 스마트 단말기와 같은 휴대용 단말기뿐만 아니라 노트북, 모니터, 가전 제품 등의 다양한 전자기기에 적용되고 있다. 이러한 디스플레이 패널은 터치 센서의 위치에 따라 애드 온(Add on) 타입과 인 셀(In-cell) 타입으로 구분될 수 있으며, 디스플레이 패널의 슬림화를 위해 공통 전극과 같은 기존의 구성을 터치 센싱 전극으로 활용하는 인 셀 타입의 터치 기술이 디스플레이 장치에 적용되고 있다.A touch-sensitive display panel is being applied not only to portable terminals such as smart terminals, but also to various electronic devices such as notebook computers, monitors, and home appliances. Such a display panel can be divided into an add-on type and an in-cell type according to the location of the touch sensor. In order to slim the display panel, an existing configuration such as a common electrode is used as a touch sensing electrode. The utilized in-cell type touch technology is being applied to a display device.

상기와 같은 디스플레이 패널을 구동하는 디스플레이 구동 장치는 디스플레이 패널의 터치를 감지하는 리드 아웃 회로를 포함할 수 있다. 종래 기술에 의한 디스플레이 구동 장치는 외부로부터 싱글 엔디드 타입의 TTL 입력인 클럭 신호(ECLK)를 수신하여 리드 아웃 회로를 구동시킨다. 그런데, 종래 기술에 의한 디스플레이 구동 장치는 TTL 입력인 클럭 신호를 이용하여 리드 아웃 회로를 구동시키므로 EMI(Electro Magnetic Interference)에 취약한 단점이 있다.The display driving apparatus for driving the display panel as described above may include a read-out circuit for sensing a touch of the display panel. A display driving apparatus according to the related art receives a clock signal ECLK, which is a single-ended TTL input, from the outside, and drives a readout circuit. However, the display driving apparatus according to the related art has a disadvantage in that it is vulnerable to EMI (Electro Magnetic Interference) because the readout circuit is driven using a clock signal that is a TTL input.

본 발명이 해결하고자 하는 기술적 과제는 EMI를 저감하는 디스플레이 구동 장치 및 이를 포함하는 디스플레이 장치를 제공하는데 있다.The technical problem to be solved by the present invention is to provide a display driving device for reducing EMI and a display device including the same.

본 발명의 실시예에 따른 디스플레이 구동 장치는, 데이터에 클럭이 임베디드된 입력 신호로부터 제1 클럭 신호를 복원하는 클럭 데이터 복원 회로; 디스플레이 패널의 터치를 감지하는 리드 아웃 회로; 및 상기 리드 아웃 회로를 구동시키기 위해, 상기 클럭 데이터 복원 회로에 의해 복원된 상기 제1 클럭 신호 또는 내부에서 생성한 제2 클럭 신호 중 어느 하나를 제3 클럭 신호로서 상기 리드 아웃 회로에 제공하는 선택부;를 포함한다.A display driving apparatus according to an embodiment of the present invention includes: a clock data recovery circuit for recovering a first clock signal from an input signal in which a clock is embedded in data; a read-out circuit for sensing a touch on the display panel; and selecting to provide either the first clock signal restored by the clock data recovery circuit or the second clock signal generated therein as a third clock signal to the read-out circuit in order to drive the read-out circuit includes;

본 발명의 실시예에 따른 디스플레이 구동 장치는, 데이터에 클럭이 임베디드된 입력 신호로부터 제1 클럭 신호를 생성하는 제1 클럭 소스; 내부 발진에 의해서 미리 설정된 주파수의 제2 클럭 신호를 생성하는 제2 클럭 소스; 및 상기 제1 및 제2 클럭 신호 중 어느 하나를 제3 클럭 신호로서 선택하며, 상기 제3 클럭 신호를 터치 감지를 위한 리드 아웃 회로에 제공하는 선택부;를 포함한다.A display driving apparatus according to an embodiment of the present invention includes: a first clock source for generating a first clock signal from an input signal in which a clock is embedded in data; a second clock source generating a second clock signal of a preset frequency by internal oscillation; and a selection unit that selects one of the first and second clock signals as a third clock signal and provides the third clock signal to a readout circuit for touch sensing.

본 발명의 실시예에 따른 디스플레이 장치는, 데이터에 클럭을 임베디드한 입력 신호를 제공하는 타이밍 컨트롤러; 및 상기 입력 신호로부터 제1 클럭 신호를 복원하고, 디스플레이 온 및 오프 기간에 따라 상기 제1 클럭 신호 또는 내부에서 생성한 제2 클럭 신호 중 어느 하나를 제3 클럭 신호로서 선택하며, 상기 제3 클럭 신호를 터치를 감지하는데 이용하는 디스플레이 구동 장치;를 포함한다.A display apparatus according to an embodiment of the present invention includes: a timing controller providing an input signal in which a clock is embedded in data; and recovering a first clock signal from the input signal, and selecting either the first clock signal or an internally generated second clock signal as a third clock signal according to a display on and off period, and the third clock signal and a display driving device that uses a signal to sense a touch.

본 발명의 실시예들에 따르면, 데이터에 클럭이 임베디드된 입력 신호로부터 복원된 클럭 신호 또는 내부에서 생성된 클럭 신호를 이용하여 디스플레이 패널의 터치를 감지하므로 싱글 엔디드 타입의 TTL 입력인 클럭 신호에 따른 EMI를 저감시킬 수 있다.According to embodiments of the present invention, the touch of the display panel is sensed using a clock signal restored from an input signal in which a clock is embedded in data or a clock signal generated internally, so that the touch EMI can be reduced.

도 1은 본 발명의 일 실시예에 따른 디스플레이 구동 장치 및 이를 포함하는 디스플레이 장치의 블록도이다.
도 2는 도 1의 동작을 설명하기 위한 타이밍도이다.
도 3은 본 발명의 다른 실시예에 따른 디스플레이 구동 장치 및 이를 포함하는 디스플레이 장치의 블록도이다.
도 4는 도 1 및 도 3에서 클럭 신호가 임베디드된 입력 신호를 예시한 도면이다.1 is a block diagram of a display driving apparatus and a display apparatus including the same according to an embodiment of the present invention.
FIG. 2 is a timing diagram for explaining the operation of FIG. 1 .
3 is a block diagram of a display driving apparatus and a display apparatus including the same according to another embodiment of the present invention.
4 is a diagram illustrating an input signal in which a clock signal is embedded in FIGS. 1 and 3 .

이하, 첨부된 도면을 참조하여 본 발명의 바람직한 실시예를 상세하게 설명한다. 본 명세서 및 특허청구범위에 사용된 용어는 통상적이거나 사전적 의미로 한정되어 해석되지 아니하며, 본 발명의 기술적 사항에 부합하는 의미와 개념으로 해석되어야 한다.Hereinafter, preferred embodiments of the present invention will be described in detail with reference to the accompanying drawings. The terms used in the present specification and claims are not limited to a conventional or dictionary meaning, and should be interpreted in a meaning and concept consistent with the technical matters of the present invention.

본 명세서에 기재된 실시예와 도면에 도시된 구성은 본 발명의 바람직한 실시예이며, 본 발명의 기술적 사상을 모두 대변하는 것이 아니므로, 본 출원 시점에서 이들을 대체할 수 있는 다양한 균등물과 변형예들이 있을 수 있다.The embodiments described in this specification and the configurations shown in the drawings are preferred embodiments of the present invention, and do not represent all of the technical spirit of the present invention, so various equivalents and modifications that can replace them at the time of the present application there may be

도 1은 본 발명의 일 실시예에 따른 디스플레이 구동 장치(20) 및 이를 포함하는 디스플레이 장치의 블록도이다.1 is a block diagram of a display driving device 20 and a display device including the same according to an embodiment of the present invention.

도 1을 참고하면, 디스플레이 장치는 타이밍 컨트롤러(10), 디스플레이 구동 장치(20), 마이크로 컨트롤러(30) 및 디스플레이 패널(40)을 포함한다.Referring to FIG. 1 , the display device includes a timing controller 10 , a display driving device 20 , a microcontroller 30 , and a display panel 40 .

타이밍 컨트롤러(10)는 호스트 시스템(도시되지 않음)으로부터 영상 데이터와 타이밍 신호들을 수신하고, 영상 데이터에 대해 화질 보상 등의 영상 처리를 수행하며, 데이터(영상 및 제어 데이터)에 클럭이 임베디드된 차동의 입력 신호(CEDA, CEDB)를 디스플레이 구동 장치(20)에 제공한다. The timing controller 10 receives image data and timing signals from a host system (not shown), performs image processing such as image quality compensation on the image data, and differentially embeds a clock in data (image and control data). of the input signals CEDA and CEDB are provided to the display driving device 20 .

디스플레이 구동 장치(20)는 입력 신호(CEDA, CEDB)로부터 제1 클럭 신호(PCLK) 및 데이터(DATA)를 복원하고, 복원된 제1 클럭 신호(PCLK)와 데이터(DATA)를 이용하여 디스플레이 패널(40)을 구동시키고, 복원된 제1 클럭 신호(PCLK)를 이용하여 디스플레이 패널(40)의 터치를 감지한다. 여기서, 디스플레이 패널(40)은 터치 감지가 가능한 디스플레이 패널로서, 픽셀들이 매트릭스 형태로 배열된 픽셀 어레이를 통해 영상을 표시하고, 공통 전극 겸용 터치 전극을 이용하여 커패시턴스 방식으로 터치 여부를 감지할 수 있다. 이와 같은 디스플레이 구동 장치(20)는 클럭 데이터 복원 회로(22), 데이터 구동 회로(24), 오실레이터(32), 선택부(34), 및 리드 아웃 회로(36)를 포함한다.The display driving apparatus 20 restores the first clock signal PCLK and data DATA from the input signals CEDA and CEDB, and uses the restored first clock signal PCLK and data DATA to display the display panel 40 is driven, and a touch of the display panel 40 is sensed using the restored first clock signal PCLK. Here, the display panel 40 is a touch-sensing display panel that displays an image through a pixel array in which pixels are arranged in a matrix form, and detects touch in a capacitive manner using a common electrode and touch electrode. . Such a display driving device 20 includes a clock data recovery circuit 22 , a data driving circuit 24 , an oscillator 32 , a selection unit 34 , and a readout circuit 36 .

클럭 데이터 복원 회로(22)는 입력 신호(CEDA, CEDB)로부터 제1 클럭 신호(PCLK)와 영상 및 제어 데이터(DATA)를 복원하고, 복원된 제1 클럭 신호(PCLK)와 영상 및 제어 데이터(DATA)를 데이터 구동 회로(24)에 제공하고, 복원된 제1 클럭 신호(PCLK)를 선택부(34)에 제공한다.The clock data recovery circuit 22 restores the first clock signal PCLK and the image and control data DATA from the input signals CEDA and CEDB, and the restored first clock signal PCLK and the image and control data DATA. DATA) is provided to the data driving circuit 24 , and the restored first clock signal PCLK is provided to the selector 34 .

데이터 구동 회로(24)는 영상 데이터의 계조 값에 대응하는 소스 신호(Sn)를 디스플레이 패널(40)에 제공한다. 이러한 데이터 구동 회로(24)는 영상 데이터를 래치하는 래치부(도시되지 않음), 영상 데이터의 계조 값에 대응하는 소스 신호(Sn)로 변환하는 디지털 아날로그 컨버터(도시되지 않음), 소스 신호(Sn)를 버퍼링하여 디스플레이 패널(40)에 출력하는 출력 버퍼(도시되지 않음) 등을 포함할 수 있다.The data driving circuit 24 provides a source signal Sn corresponding to a grayscale value of image data to the display panel 40 . The data driving circuit 24 includes a latch unit (not shown) for latching image data, a digital-to-analog converter (not shown) for converting a source signal Sn corresponding to a grayscale value of the image data, and a source signal Sn ) may include an output buffer (not shown) for buffering and outputting to the display panel 40 .

오실레이터(32)는 내부 발진에 의해 미리 설정된 주파수의 제2 클럭 신호(OSC_CLK)를 생성하고, 이를 선택부(34)에 제공한다. 오실레이터(32)는 디스플레이 오프 기간에 제2 클럭 신호(OSC_CLK)를 생성하고, 디스플레이 온 기간에 디스에이블되는 것으로 구성할 수 있다. 여기서, 디스플레이 오프 기간은 타이밍 컨트롤러(10)가 오프된 셧 다운 기간으로서, 입력 신호(CEDA, CEDB)가 디스플레이 구동 장치(20)로 입력되지 않는 기간으로 정의될 수 있으며, 디스플레이 온 기간은 타이밍 컨트롤로로부터 입력 신호(CEDA, CEDB)가 입력되어 디스플레이 패널(40)에 영상이 표시되는 기간으로 정의될 수 있다. 일례로, 오실레이터(32)는 마이크로 컨트롤러(30)로부터 제어 신호(CS)를 수신하도록 구성할 수 있다. 오실레이터(32)는 제어 신호(CS)에 응답하여 인에이블 또는 디스에이블될 수 있다. 여기서, 제어 신호(CS)는 디스플레이 온 기간에 오실레이터(32)를 디스에이블시키기 위한 로직 레벨을 가지고, 디스플레이의 오프 기간에 오실레이터(32)를 인에이블시키기 위한 로직 레벨을 갖는다.The oscillator 32 generates a second clock signal OSC_CLK of a preset frequency by internal oscillation, and provides it to the selector 34 . The oscillator 32 may be configured to generate the second clock signal OSC_CLK in the display-off period and to be disabled in the display-on period. Here, the display off period is a shutdown period in which the timing controller 10 is turned off, and may be defined as a period in which the input signals CEDA and CEDB are not input to the display driving device 20 , and the display on period is the timing control period. It may be defined as a period in which an image is displayed on the display panel 40 when the input signals CEDA and CEDB are inputted. For example, the oscillator 32 may be configured to receive the control signal CS from the microcontroller 30 . The oscillator 32 may be enabled or disabled in response to the control signal CS. Here, the control signal CS has a logic level for disabling the oscillator 32 during the display on period and has a logic level for enabling the oscillator 32 during the display off period.

선택부(34)는 클럭 데이터 복원 회로(22)에 의해 복원된 제1 클럭 신호(PCLK) 또는 오실레이터(32)에 의해 생성된 제2 클럭 신호(OSC_CLK) 중 하나를 디스플레이 패널(40)의 터치를 감지하는데 이용되는 제3 클럭 신호(CLK)로서 선택하고, 제3 클럭 신호(CLK)를 리드 아웃 회로(36)에 제공한다. 이러한 선택부(34)는 디스플레이 온 기간에 제1 클럭 신호(PCLK)를 제3 클럭 신호(CLK)로서 선택하고, 디스플레이 오프 기간에 제2 클럭 신호(OSC_CLK)를 제3 클럭 신호(CLK)로서 선택한다.The selector 34 applies one of the first clock signal PCLK restored by the clock data recovery circuit 22 or the second clock signal OSC_CLK generated by the oscillator 32 to the touch of the display panel 40 . is selected as the third clock signal CLK used for sensing and provides the third clock signal CLK to the readout circuit 36 . The selector 34 selects the first clock signal PCLK as the third clock signal CLK during the display-on period, and selects the second clock signal OSC_CLK as the third clock signal CLK during the display-off period. choose

일례로, 선택부(34)는 마이크로 컨트롤러(30)의 제어 신호(CS)에 응답하여 제1 클럭 신호(PCLK)와 제2 클럭 신호(OSC_CLK) 중 하나를 제3 클럭 신호(CLK)로서 선택하고, 제3 클럭 신호(CLK)를 리드 아웃 회로(36)에 제공한다. 제어 신호(CS)는 디스플레이 온 기간에 제1 클럭 신호(PCLK)를 선택하기 위한 로직 레벨을 가지고, 디스플레이의 오프 기간에 제2 클럭 신호(OSC_CLK)를 선택하기 위한 로직 레벨을 갖는다. 즉, 선택부(34)는 디스플레이 온 기간에 입력 신호로부터 복원한 제1 클럭 신호(PCLK)를 제3 클럭 신호(CLK)로서 리드 아웃 회로(36)에 제공하고, 디스플레이 오프 기간에 내부에서 미리 설정된 주파수로 생성한 제2 클럭 신호(OSC_CLK)를 제3 클럭 신호(CLK)로서 리드 아웃 회로(36)에 제공한다.For example, the selector 34 selects one of the first clock signal PCLK and the second clock signal OSC_CLK as the third clock signal CLK in response to the control signal CS of the microcontroller 30 . and provides the third clock signal CLK to the readout circuit 36 . The control signal CS has a logic level for selecting the first clock signal PCLK during the display on period and has a logic level for selecting the second clock signal OSC_CLK during the display off period. That is, the selector 34 provides the first clock signal PCLK restored from the input signal in the display-on period as the third clock signal CLK to the read-out circuit 36 , and in the display-off period, internally in advance. The second clock signal OSC_CLK generated at the set frequency is provided to the readout circuit 36 as the third clock signal CLK.

리드 아웃 회로(36)는 선택부(34)로부터 제공되는 제3 클럭 신호(CLK)를 이용하여 디스플레이 패널(40)의 터치를 감지하고, 감지 데이터(Tdata)를 출력한다. 감지 데이터(Tdata)는 마이크로 컨트롤러(30)에 제공될 수 있다. 여기서, 디스플레이 패널(40)은 터치 겸용 디스플레이 기능을 가지며, 픽셀 어레이에 포함되는 터치 전극들을 포함할 수 있다. 일례로, 터치 전극들 각각은 신호 라인들을 통해서 리드 아웃 회로(36)에 각각 접속되며, 터치 점 크기를 고려하여 다수의 픽셀을 포함하는 일정 크기로 형성될 수 있다. 리드 아웃 회로(36)는 선택부(34)의 클럭 신호(CLK)에 응답하여 디스플레이 패널(40)의 터치 전극에 터치 구동 신호(Tx)를 제공하고, 해당 터치 전극으로부터 피드백 신호(Rx)를 수신할 수 있다. 리드 아웃 회로(36)는 각 터치 전극에 대한 터치 구동 신호(Tx)와 피드백 신호(Rx)를 차동 증폭하여 터치로 인한 커패시턴스 변화로 터치 여부를 감지할 수 있다. The read-out circuit 36 detects a touch of the display panel 40 using the third clock signal CLK provided from the selector 34 , and outputs sensing data Tdata. The sensed data Tdata may be provided to the microcontroller 30 . Here, the display panel 40 has a touch display function and may include touch electrodes included in the pixel array. For example, each of the touch electrodes is respectively connected to the readout circuit 36 through signal lines, and may be formed to have a predetermined size including a plurality of pixels in consideration of the size of the touch point. The read-out circuit 36 provides a touch driving signal Tx to the touch electrode of the display panel 40 in response to the clock signal CLK of the selector 34 , and receives a feedback signal Rx from the corresponding touch electrode. can receive The read-out circuit 36 may differentially amplify the touch driving signal Tx and the feedback signal Rx for each touch electrode to detect whether a touch has occurred based on a capacitance change due to the touch.

리드 아웃 회로(36)는 디스플레이 온 기간에 제3 클럭 신호(CLK)로서 선택된 제1 클럭 신호(PCLK)에 응답하여 디스플레이 패널(40)의 터치 전극에 터치 구동 신호(Tx)를 제공하고, 디스플레이 패널(40)의 터치 전극으로부터 피드백 신호(Rx)를 수신한다. 리드 아웃 회로(36)는 피드백 신호(Rx)를 디지털 신호인 감지 데이터(Tdata)로 변환하고, 이를 마이크로 컨트롤러(30)에 제공한다. 마이크로 컨트롤러(30)는 터치로 인한 커패시턴스 변화에 따른 감지 데이터(Tdata)의 변화로 디스플레이 패널(40)의 터치 여부 및 터치 좌표를 감지할 수 있다. 일례로, 리드 아웃 회로(36)는 복원된 제1 클럭 신호(PCLK)를 미리 설정된 값으로 분주하는 분주기를 포함할 수 있으며, 분주된 내부 클럭 신호를 이용하여 디스플레이 패널(40)의 터치 전극에 터치 구동 신호(Tx)를 제공할 수 있다.The read-out circuit 36 provides the touch driving signal Tx to the touch electrode of the display panel 40 in response to the first clock signal PCLK selected as the third clock signal CLK during the display-on period, A feedback signal Rx is received from the touch electrode of the panel 40 . The read-out circuit 36 converts the feedback signal Rx into sensing data Tdata, which is a digital signal, and provides it to the microcontroller 30 . The microcontroller 30 may detect whether the display panel 40 is touched and touch coordinates by a change in the sensed data Tdata according to a capacitance change due to a touch. For example, the read-out circuit 36 may include a divider for dividing the restored first clock signal PCLK by a preset value, and the touch electrode of the display panel 40 using the divided internal clock signal A touch driving signal Tx may be provided to the .

리드 아웃 회로(36)는 디스플레이 오프 기간에 제3 클럭 신호(CLK)로서 선택된 제2 클럭 신호(OSC_CLK)에 응답하여 디스플레이 패널(40)의 터치 전극에 터치 구동 신호(Tx)를 제공하고, 디스플레이 패널(40)의 터치 전극으로부터 피드백 신호(Rx)를 수신하며, 터치로 인한 커패시턴스 변화로 디스플레이 패널(40)의 터치 여부를 감지할 수 있다. 디스플레이 오프 기간에는 디스플레이 패널(42)의 터치 여부만을 감지하기 때문에 오실레이터(32)의 제2 클럭 신호(OSC_CLK)에 변동이 발생해도 터치 여부를 충분히 감지할 수 있다. 일례로, 디스플레이 오프 기간에 터치 여부를 감지하는 것은 액정 화면이 꺼진 상태에서 화면을 두드려 온 시키는 스마트폰 등의 노크 온 기능을 수행하는데 이용될 수 있다. The readout circuit 36 provides the touch driving signal Tx to the touch electrode of the display panel 40 in response to the second clock signal OSC_CLK selected as the third clock signal CLK during the display off period, A feedback signal Rx may be received from the touch electrode of the panel 40 , and whether the display panel 40 is touched may be sensed by a capacitance change due to the touch. In the display-off period, only whether the display panel 42 is touched is sensed, so even if a change occurs in the second clock signal OSC_CLK of the oscillator 32, the touch can be sufficiently detected. For example, detecting whether or not a touch is made during the display-off period may be used to perform a knock-on function of a smart phone that taps on the screen in a state in which the liquid crystal screen is turned off.

리드 아웃 회로(36)는 디스플레이 온 기간에 제3 클럭 신호(CLK)로서 선택된 제1 클럭 신호(PCLK)에 응답하여 디스플레이 패널(40)의 터치를 감지하고, 디스플레이 오프 기간에 제3 클럭 신호(CLK)로서 선택된 제2 클럭 신호(OSC_CLK)에 응답하여 디스플레이 패널(40)의 터치를 감지할 수 있다. 여기서, 제1 클럭 신호(PCLK)는 디스플레이 온 구간에 미리 설정된 값으로 분주될 수 있다.The read-out circuit 36 detects a touch of the display panel 40 in response to the first clock signal PCLK selected as the third clock signal CLK in the display-on period, and the third clock signal CLK in the display-off period A touch of the display panel 40 may be sensed in response to the second clock signal OSC_CLK selected as CLK). Here, the first clock signal PCLK may be divided by a preset value during the display-on period.

마이크로 컨트롤러(30)는 제어 신호(CS)를 디스플레이 구동 장치(20)의 선택부(34)에 제공한다. 마이크로 컨트롤러(30)는 디스플레이 오프 기간에 선택부(34)가 오실레이터에 의해 생성된 제2 클럭 신호(OSC_CLK)를 선택하도록 제어한다. 그리고, 마이크로 컨트롤러(30)는 디스플레이 온 기간에 선택부(34)가 클럭 데이터 복원 회로(22)에 의해 복원된 제1 클럭 신호(PCLK)를 선택하도록 제어한다. 일례로, 마이크로 컨트롤러(30)는 디스플레이 온 기간에 로우 로직 레벨의 제어 신호(CS)를 제공하고, 디스플레이 오프 기간에 하이 로직 레벨의 제어 신호(CS)를 제공할 수 있다. 그러면, 선택부(34)는 디스플레이 온 기간에 로우 로직 레벨의 제어 신호(CS)에 응답하여 제1 클럭 신호(PCLK)를 선택하고, 디스플레이 오프 기간에 하이 로직 레벨의 제어 신호(CS)에 응답하여 제2 클럭 신호(OSC_CLK)를 선택할 수 있다. 여기서, 제어 신호(CS)는 마이크로 컨트롤러(30)와 디스플레이 구동 장치(20) 간의 인터페이스, 예를 들면 SPI를 통하여 제어 패킷으로 전송될 수 있다. 그리고, 마이크로 컨트롤러(30)는 리드 아웃 회로(36)로부터 감지 데이터(Tdata)를 수신하고, 터치로 인한 감지 데이터(Tdata)의 변화로 디스플레이 패널(40)의 터치 여부 및 터치 좌표를 판단할 수 있다.The microcontroller 30 provides the control signal CS to the selection unit 34 of the display driving device 20 . The microcontroller 30 controls the selector 34 to select the second clock signal OSC_CLK generated by the oscillator during the display-off period. In addition, the microcontroller 30 controls the selector 34 to select the first clock signal PCLK restored by the clock data recovery circuit 22 during the display-on period. For example, the microcontroller 30 may provide the control signal CS of a low logic level in the display-on period and provide the control signal CS of a high logic level in the display-off period. Then, the selector 34 selects the first clock signal PCLK in response to the control signal CS of the low logic level in the display-on period, and responds to the control signal CS of the high logic level in the display-off period Thus, the second clock signal OSC_CLK may be selected. Here, the control signal CS may be transmitted as a control packet through an interface between the microcontroller 30 and the display driving device 20 , for example, SPI. Then, the microcontroller 30 may receive the sensing data Tdata from the readout circuit 36, and determine whether the display panel 40 is touched and the touch coordinates by a change in the sensing data Tdata due to the touch. there is.

본 실시예에 따르면, 디스플레이 온 기간에 입력 신호(CEDA, CEDB)로부터 제1 클럭 신호(PCLK)를 복원하는 클럭 데이터 복원 회로(22)를 제1 클럭 소스로 이용하고, 디스플레이 오프 기간에 미리 설정된 주파수로 제2 클럭 신호(OSC_CLK)를 생성하는 오실레이터(32)를 제2 클럭 소스로 이용한다.According to the present embodiment, the clock data recovery circuit 22 that recovers the first clock signal PCLK from the input signals CEDA and CEDB during the display-on period is used as the first clock source, and preset in the display-off period is set in the display-on period. The oscillator 32 that generates the second clock signal OSC_CLK with a frequency is used as the second clock source.

도 2는 도 1의 동작을 설명하기 위한 타이밍도이다.FIG. 2 is a timing diagram for explaining the operation of FIG. 1 .

도 1 및 도 2를 참고하면, 디스플레이 구동 장치(20)는 디스플레이 온 기간에 입력 신호(CEDA, CEDB)로부터 복원된 제1 클럭 신호(PCLK)를 이용하여 리드 아웃 회로(36)를 구동시키고, 디스플레이 오프 기간에 오실레이터(32)의 제2 클럭 신호(OSC_CLK)를 이용하여 리드 아웃 회로(36)를 구동시킨다. 일례로, 디스플레이 오프 기간에 디스플레이 패널(42)의 터치 여부를 감지하는 것은 액정 화면이 꺼진 상태에서 화면을 두드려 온 시키는 스마트폰 등의 노크 온 기능을 수행하는데 이용될 수 있다. 디스플레이 오프 기간에는 디스플레이 패널(40)의 터치 여부만을 감지하기 때문에 오실레이터(32)의 제2 클럭 신호(OSC_CLK)를 이용하여 터치 여부를 충분히 감지할 수 있다.1 and 2, the display driving device 20 drives the readout circuit 36 using the first clock signal PCLK restored from the input signals CEDA and CEDB during the display on period, In the display-off period, the readout circuit 36 is driven using the second clock signal OSC_CLK of the oscillator 32 . For example, sensing whether the display panel 42 is touched during the display-off period may be used to perform a knock-on function such as a smart phone that taps on the screen while the liquid crystal screen is off. In the display-off period, only whether the display panel 40 is touched is sensed, and thus, the touch can be sufficiently detected using the second clock signal OSC_CLK of the oscillator 32 .

그리고, 본 실시예는 디스플레이 온 기간에 입력 신호(CEDA, CEDB)로부터 복원된 제1 클럭 신호(PCLK)를 분주하고 분주된 내부 클럭 신호(도시되지 않음)를 이용하여 디스플레이 패널(40)의 터치 여부와 터치 좌표 등을 감지하는 것으로 구성할 수 있다. 터치 좌표는 호스트 시스템이 터치 좌표와 연계된 명령이나 애플리케이션을 실행하는데 이용될 수 있다. 호스트 시스템은 태블릿이나 스마트폰의 시스템, 컴퓨터, TV 시스템, 셋탑 박스 등이 될 수 있다. 복원된 제1 클럭 신호(PCLK)를 분주하는 분주기(도시되지 않음)는 리드 아웃 회로(36)에 포함될 수 있다. 또는 분주기는 클럭 데이터 복원 회로(22) 내에 포함되거나 클럭 데이터 복원 회로(22)와 리드 아웃 회로(36) 사이에 위치될 수 있다.In addition, in the present embodiment, the first clock signal PCLK restored from the input signals CEDA and CEDB is divided during the display-on period, and the touch of the display panel 40 is performed using the divided internal clock signal (not shown). It can be configured to detect presence and touch coordinates. The touch coordinates may be used by the host system to execute a command or application associated with the touch coordinates. The host system may be a system of a tablet or smartphone, a computer, a TV system, a set-top box, or the like. A divider (not shown) for dividing the restored first clock signal PCLK may be included in the readout circuit 36 . Alternatively, the divider may be included in the clock data recovery circuit 22 or located between the clock data recovery circuit 22 and the readout circuit 36 .

도 3은 본 발명의 다른 실시예에 따른 디스플레이 구동 장치 및 이를 포함하는 디스플레이 장치의 블록도이다. 도 1의 실시예와 중복되는 구성은 도 1의 설명으로 대체하거나 간략하게 설명한다.3 is a block diagram of a display driving apparatus and a display apparatus including the same according to another embodiment of the present invention. The configuration overlapping with the embodiment of FIG. 1 will be replaced with the description of FIG. 1 or will be briefly described.

도 3을 참고하면, 디스플레이 장치는 타이밍 컨트롤러(10), 디스플레이 구동 장치(20), 및 디스플레이 패널(40)을 포함한다.Referring to FIG. 3 , the display device includes a timing controller 10 , a display driving device 20 , and a display panel 40 .

타이밍 컨트롤러(10)는 영상 데이터에 대해 화질 보상 등의 영상 처리를 수행하고, 디스플레이 구동 장치(20)의 동작 타이밍을 제어하기 위한 제어 데이터를 생성하며, 영상 및 제어 데이터와 클럭을 차동의 입력 신호(CEDA, CEDB)에 임베드시킨다. 그리고, 타이밍 컨트롤러(10)는 데이터에 클럭이 임베디드된 차동의 입력 신호(CEDA, CEDB)를 디스플레이 구동 장치(20)에 제공한다.The timing controller 10 performs image processing such as image quality compensation on the image data, generates control data for controlling the operation timing of the display driving device 20 , and converts the image and control data and a clock to a differential input signal (CEDA, CEDB). In addition, the timing controller 10 provides differential input signals CEDA and CEDB in which a clock is embedded in data to the display driving device 20 .

디스플레이 구동 장치(20)는 입력 신호(CEDA, CEDB)로부터 제1 클럭 신호(PCLK)와 데이터(DATA)를 복원하고, 복원된 제1 클럭 신호(PCLK)와 데이터(DATA)를 이용하여 디스플레이 패널(40)을 구동시키며, 제1 클럭 신호(PCLK)를 이용하여 디스플레이 패널(40)의 터치 여부를 감지하도록 제어한다. 이와 같은 디스플레이 구동 장치(20)는 클럭 데이터 복원 회로(22), 데이터 구동 회로(24), 오실레이터(32), 선택부(34), 및 리드 아웃 회로(36)를 포함한다.The display driving apparatus 20 restores the first clock signal PCLK and the data DATA from the input signals CEDA and CEDB, and uses the restored first clock signal PCLK and the data DATA for the display panel (40) is driven, and control is performed to detect whether the display panel 40 is touched by using the first clock signal PCLK. Such a display driving device 20 includes a clock data recovery circuit 22 , a data driving circuit 24 , an oscillator 32 , a selection unit 34 , and a readout circuit 36 .

클럭 데이터 복원 회로(22)는 입력 신호(CEDA, CEDB)로부터 제1 클럭 신호(PCLK)와 데이터(DATA)를 복원하고, 복원된 제1 클럭 신호(PCLK)와 데이터(DATA)를 데이터 구동 회로(24)에 제공하고, 복원된 제1 클럭 신호(PCLK)를 선택부(34)에 제공한다. The clock data recovery circuit 22 restores the first clock signal PCLK and the data DATA from the input signals CEDA and CEDB, and uses the restored first clock signal PCLK and the data DATA as the data driving circuit 24 , and the restored first clock signal PCLK is provided to the selection unit 34 .

그리고, 클럭 데이터 복원 회로(22)는 락 신호(LOCK)를 선택부(34)에 제공한다. 여기서, 락 신호(LOCK)는 디스플레이 온 및 오프 기간에 따라 서로 다른 로직 레벨을 갖는다. 일례로, 클럭 데이터 복원 회로(22)는 차동의 입력 신호(CEDA, CEDB)가 수신되는 기간 즉 디스플레이 온 기간에는 하이 로직 레벨의 락 신호(LOCK)를 선택부(34)에 제공하고, 디스플레이 오프 기간에는 로우 레벨의 락 신호(LOCK)를 선택부(34)에 제공할 수 있다.In addition, the clock data recovery circuit 22 provides the lock signal LOCK to the selection unit 34 . Here, the lock signal LOCK has different logic levels according to the display on and off periods. For example, the clock data recovery circuit 22 provides the lock signal LOCK of a high logic level to the selection unit 34 during a period in which the differential input signals CEDA and CEDB are received, that is, during the display-on period, and the display is turned off. During the period, a low-level lock signal LOCK may be provided to the selector 34 .

오실레이터(32)는 내부 발진에 의해 미리 설정된 주파수의 제2 클럭 신호(OSC_CLK)를 생성하고, 제2 클럭 신호(OSC_CLK)를 선택부(34)에 제공한다. 일례로, 오실레이터(32)는 디스플레이 온 기간에 디스에이블되고, 디스플레이 오프 기간에 인에이블되는 것으로 구성할 수 있다. 일례로, 오실레이터(32)는 마이크로 컨트롤러(30)로부터 제어 신호(CS)를 수신하도록 구성할 수 있다. 오실레이터(32)는 제어 신호(CS)에 응답하여 인에이블 또는 디스에이블될 수 있다. 여기서, 제어 신호(CS)는 디스플레이 온 기간에 오실레이터(32)를 디스에이블시키기 위한 로직 레벨을 가지고, 디스플레이의 오프 기간에 오실레이터(32)를 인에이블시키기 위한 로직 레벨을 갖는다.선택부(34)는 락 신호(LOCK)에 응답하여 제1 클럭 신호(PCLK)와 제2 클럭 신호(OSC_CLK) 중 하나를 제3 클럭 신호(CLK)로서 선택하고, 제3 클럭 신호(CLK)를 리드 아웃 회로(36)에 제공한다. 일례로, 선택부(34)는 디스플레이 온 기간에 하이 로직 레벨의 락 신호(LOCK)에 응답하여 제1 클럭 신호(PCLK)를 선택하고, 디스플레이 오프 기간에 로우 로직 레벨의 락 신호(LOCK)에 응답하여 제2 클럭 신호(OSC_CLK)를 선택한다. 즉, 선택부(34)는 디스플레이 온 기간에 클럭 데이터 복원 회로(22)에 의해 복원된 제1 클럭 신호(PCLK)를 제3 클럭 신호(CLK)로서 선택하고, 디스플레이 오프 기간에 제2 클럭 신호(OSC_CLK)를 제3 클럭 신호(CLK)로서 선택하며, 제3 클럭 신호(CLK)를 리드 아웃 회로(36)에 제공한다. The oscillator 32 generates a second clock signal OSC_CLK of a preset frequency by internal oscillation and provides the second clock signal OSC_CLK to the selector 34 . For example, the oscillator 32 may be configured to be disabled during the display-on period and enabled during the display-off period. For example, the oscillator 32 may be configured to receive the control signal CS from the microcontroller 30 . The oscillator 32 may be enabled or disabled in response to the control signal CS. Here, the control signal CS has a logic level for disabling the oscillator 32 during the display on period, and has a logic level for enabling the oscillator 32 during the display off period. Selector 34 selects one of the first clock signal PCLK and the second clock signal OSC_CLK as the third clock signal CLK in response to the lock signal LOCK, and applies the third clock signal CLK to the readout circuit ( 36) is provided. For example, the selector 34 selects the first clock signal PCLK in response to the high logic level lock signal LOCK during the display-on period, and selects the first clock signal PCLK for the low logic level lock signal LOCK during the display-off period. In response, the second clock signal OSC_CLK is selected. That is, the selector 34 selects the first clock signal PCLK restored by the clock data recovery circuit 22 in the display-on period as the third clock signal CLK, and in the display-off period, the second clock signal (OSC_CLK) is selected as the third clock signal CLK, and the third clock signal CLK is provided to the readout circuit 36 .

리드 아웃 회로(36)는 선택부(34)로부터 제3 클럭 신호(CLK)로서 제공되는 제1 클럭 신호(PCLK) 또는 제2 클럭 신호(OSC_CLK)에 응답하여 디스플레이 패널(40)의 터치를 감지한다. 일례로, 리드 아웃 회로(36)는 디스플레이 온 기간에는 제1 클럭 신호(PCLK)에 응답하여 디스플레이 패널(40)의 터치 전극에 터치 구동 신호(Tx)를 제공하고, 디스플레이 오프 기간에는 제2 클럭 신호(OSC_CLK)에 응답하여 디스플레이 패널(40)의 터치 전극에 터치 구동 신호(Tx)를 제공한다. 그리고, 리드 아웃 회로(36)는 디스플레이 패널(40)의 터치 전극으로부터 피드백 신호(Rx)를 수신하며, 터치로 인한 커패시턴스 변화로 디스플레이 패널(40)의 터치 여부를 감지한다.The readout circuit 36 detects a touch of the display panel 40 in response to the first clock signal PCLK or the second clock signal OSC_CLK provided as the third clock signal CLK from the selector 34 . do. For example, the read-out circuit 36 provides the touch driving signal Tx to the touch electrode of the display panel 40 in response to the first clock signal PCLK during the display-on period, and the second clock signal during the display-off period. The touch driving signal Tx is provided to the touch electrode of the display panel 40 in response to the signal OSC_CLK. In addition, the read-out circuit 36 receives the feedback signal Rx from the touch electrode of the display panel 40 , and detects whether the display panel 40 is touched by capacitance change due to the touch.

리드 아웃 회로(36)는 디스플레이 온 기간에 제3 클럭 신호(CLK)로서 선택된 제1 클럭 신호(PCLK)에 응답하여 디스플레이 패널(40)의 터치를 감지하고, 디스플레이 오프 기간에 제3 클럭 신호(CLK)로서 선택된 제2 클럭 신호(OSC_CLK)에 응답하여 디스플레이 패널(40)의 터치를 감지할 수 있다. 여기서, 제1 클럭 신호(PCLK)는 디스플레이 온 구간에 미리 설정된 값으로 분주될 수 있다.The read-out circuit 36 detects a touch of the display panel 40 in response to the first clock signal PCLK selected as the third clock signal CLK in the display-on period, and the third clock signal CLK in the display-off period A touch of the display panel 40 may be sensed in response to the second clock signal OSC_CLK selected as CLK). Here, the first clock signal PCLK may be divided by a preset value during the display-on period.

도 4는 도 1 및 도 3에서 클럭 신호가 임베디드된 입력 신호(CEDA, CEDB)를 예시한 도면이다.4 is a diagram illustrating input signals CEDA and CEDB in which clock signals are embedded in FIGS. 1 and 3 .

타이밍 컨트롤러(10)와 디스플레이 구동 장치(20) 간의 데이터의 통신은 다양한 방식으로 구현될 수 있다. 본 실시예는 CEDS(Clock Embedded Data Signaling) 방식으로 입력 신호(CEDA, CEDB)를 전송할 수 있다. 상기한 CEDS 방식은 클럭(CK)이 데이터에 임베디드된 포맷을 갖도록 데이터를 패킷화하여 전송하는 통신 방식으로 정의될 수 있다. Communication of data between the timing controller 10 and the display driving device 20 may be implemented in various ways. In this embodiment, the input signals CEDA and CEDB may be transmitted using a clock embedded data signaling (CEDS) method. The above-described CEDS method may be defined as a communication method in which data is packetized and transmitted so that the clock CK has a format embedded in the data.

도 4에 도시한 바와 바와 같이, 클럭(CK)이 임베디드된 입력 신호(CED A/B)는 데이터 패킷들로 전송될 수 있다. 일례로, 하나의 패킷은 28UI(unit interval)을 가지며, 각 패킷은 4UI의 구분자와 24UI의 데이터를 포함할 수 있다. 4UI의 구분자는 더미(DMY)와 클럭(CK)을 포함하고 24UI의 데이터는 영상 및 제어 데이터를 포함할 수 있다. 도 4에서 구분자는 "0011"로 표현된 4비트 데이터이며, 4비트 데이터 중, "00"이 더미(DMY)에 해당하는 비트이고, "11"이 클럭(CK)에 해당하는 비트이다. 구분자는 모든 패킷에 대하여 동일한 비트 수 및 동일한 데이터 값으로 적용될 수 있다.As shown in FIG. 4 , the input signal CED A/B in which the clock CK is embedded may be transmitted as data packets. As an example, one packet has 28 UI (unit interval), and each packet may include 4 UI identifiers and 24 UI data. The separator of 4UI may include a dummy (DMY) and a clock (CK), and data of 24UI may include image and control data. In FIG. 4 , the delimiter is 4-bit data expressed as “0011”. Among the 4-bit data, “00” is a bit corresponding to the dummy DMY, and “11” is a bit corresponding to the clock CK. The delimiter may be applied with the same number of bits and the same data value for all packets.

클럭 데이터 복원 회로(22)는 "00"으로 입력되는 더미(DMY) 비트를 통해서 패킷 데이터를 구분할 수 있으며, "11"로 입력되는 클럭(CK)를 통해서 제1 클럭 신호(PCLK)의 에지를 복원하고, 내부 로직 회로를 통해서 28UI을 가지는 제1 클럭 신호(PCLK)를 복원할 수 있다. 그리고, 클럭 데이터 복원 회로(22)는 제1 클럭 신호(PCLK)를 이용하여 샘플링 클럭 신호들을 생성할 수 있으며, 샘플링 클럭 신호들을 이용하여 데이터를 복원할 수 있다. The clock data recovery circuit 22 may distinguish the packet data through the dummy (DMY) bit input as “00” and detect the edge of the first clock signal PCLK through the clock CK input as “11”. restored, and the first clock signal PCLK having 28 UI may be restored through an internal logic circuit. In addition, the clock data recovery circuit 22 may generate sampling clock signals using the first clock signal PCLK, and may recover data using the sampling clock signals.

클럭 데이터 복원 회로(22)에 의해 복원된 제1 클럭 신호(PCLK)는 디스플레이 온 기간에 리드 아웃 회로(36)에 제공되고, 디스플레이 패널(40)의 터치 여부와 터치 좌표를 감지하는데 이용될 수 있다. 제1 클럭 신호(PCLK)는 디스플레이 패널(40)의 터치 여부와 터치 좌표를 감지하는데 이용할 수 있도록 미리 설정된 값으로 분주될 수 있다. 일례로, 데이터 전송 속도가 2.0Gb/s인 경우 제1 클럭 신호(PCLK)는 71.4Mhz의 주파수를 가지며, 4분주 클럭 17.85Mhz의 내부 클럭 신호로 분주될 수 있다. 데이터 전송 속도가 1.2 Gb/s인 경우 제1 클럭 신호(PCLK)는 42.8Mhz의 주파수를 가지며, 2분주 클럭 21.4Mhz, 또는 4분주 클럭 10.4Mhz의 내부 클럭 신호로 분주될 수 있다.본 발명의 실시예들에 따르면, 데이터에 클럭이 임베디드된 입력 신호(CEDA, CEDB)로부터 복원된 제1 클럭 신호(PCLK) 또는 내부에서 생성된 제2 클럭 신호(OSC_CLK)를 이용하여 디스플레이 패널(40)의 터치를 감지하므로 싱글 엔디드 타입의 TTL 입력인 클럭 신호(ECLK)에 따른 EMI를 저감시킬 수 있다.The first clock signal PCLK restored by the clock data recovery circuit 22 may be provided to the read-out circuit 36 during the display-on period, and may be used to detect whether the display panel 40 is touched and touch coordinates. there is. The first clock signal PCLK may be divided into a preset value to be used to detect whether the display panel 40 is touched and touch coordinates. For example, when the data transmission rate is 2.0 Gb/s, the first clock signal PCLK has a frequency of 71.4 Mhz and may be divided into an internal clock signal of 17.85 Mhz divided by 4 clocks. When the data transmission rate is 1.2 Gb/s, the first clock signal PCLK has a frequency of 42.8Mhz and may be divided into an internal clock signal of 21.4Mhz clock divided by 2 or 10.4Mhz clock divided by quarter. According to embodiments, the display panel 40 is displayed using the first clock signal PCLK restored from the input signals CEDA and CEDB in which the clock is embedded in data or the second clock signal OSC_CLK generated therein. Since the touch is sensed, EMI according to the clock signal ECLK, which is a single-ended TTL input, can be reduced.

10: 타이밍 컨트롤러 20: 디스플레이 구동 장치
30: 마이크로 컨트롤러 40: 디스플레이 패널
22: 클럭 데이터 복원 회로 24: 데이터 구동 회로
32: 오실레이터 34: 선택부
36: 리드 아웃 회로10: timing controller 20: display driving device
30: microcontroller 40: display panel
22: clock data recovery circuit 24: data driving circuit
32: oscillator 34: select part
36: readout circuit

Claims (15)

데이터에 클럭이 임베디드된 입력 신호로부터 제1 클럭 신호를 복원하는 클럭 데이터 복원 회로;
디스플레이 패널의 터치를 감지하는 리드 아웃 회로; 및
상기 리드 아웃 회로를 구동시키기 위해, 상기 클럭 데이터 복원 회로에 의해 복원된 상기 제1 클럭 신호 또는 내부에서 생성한 제2 클럭 신호 중 어느 하나를 제3 클럭 신호로서 상기 리드 아웃 회로에 제공하는 선택부;
를 포함하고,
디스플레이의 온 기간에, 상기 입력 신호로부터 복원된 상기 제1 클럭 신호를 미리 설정된 값으로 분주시키고, 분주한 내부 클럭 신호를 이용하여 상기 리드 아웃 회로를 구동시키는 디스플레이 구동 장치.a clock data recovery circuit for recovering a first clock signal from an input signal having a clock embedded in data;
a read-out circuit for sensing a touch on the display panel; and
In order to drive the read-out circuit, a selection unit that provides either the first clock signal restored by the clock data recovery circuit or the second clock signal generated therein as a third clock signal to the read-out circuit ;
including,
A display driving apparatus for dividing the first clock signal restored from the input signal by a preset value during an on-period of the display and driving the read-out circuit using the divided internal clock signal. 제 1 항에 있어서, 상기 선택부는,
상기 클럭이 수신되지 않는 기간에 대응하여 상기 제2 클럭 신호를 상기 제3 클럭 신호로서 선택하는 디스플레이 구동 장치.According to claim 1, wherein the selection unit,
A display driving apparatus for selecting the second clock signal as the third clock signal corresponding to a period in which the clock is not received. 제 1 항에 있어서, 상기 선택부는,
디스플레이 온 기간에 상기 제1 클럭 신호를 제3 클럭 신호로서 선택하고, 디스플레이 오프 기간에 상기 제2 클럭 신호를 상기 제3 클럭 신호로서 선택하는 디스플레이 구동 장치.According to claim 1, wherein the selection unit,
A display driving apparatus for selecting the first clock signal as a third clock signal in a display-on period and selecting the second clock signal as the third clock signal in a display-off period. 제 1 항에 있어서,
미리 설정된 주파수의 상기 제2 클럭 신호를 생성하며, 상기 제2 클럭 신호를 상기 선택부에 제공하는 오실레이터;를 더 포함하는 디스플레이 구동 장치.The method of claim 1,
and an oscillator that generates the second clock signal of a preset frequency and provides the second clock signal to the selection unit. 제 1 항에 있어서, 상기 선택부는,
마이크로 컨트롤러로부터 디스플레이 온 기간 및 디스플레이 오프 기간에 따라 각각 대응하는 서로 다른 로직 레벨을 가지는 제어 신호를 수신하는 디스플레이 구동 장치.According to claim 1, wherein the selection unit,
A display driving apparatus for receiving a control signal having different logic levels corresponding to each of a display-on period and a display-off period from a microcontroller. 제 5 항에 있어서, 상기 선택부는,
상기 디스플레이 온 기간에 대응하는 로직 레벨의 상기 제어 신호에 응답하여 상기 제1 클럭 신호를 선택하고, 상기 디스플레이 오프 기간에 대응하는 로직 레벨의 상기 제어 신호에 응답하여 상기 제2 클럭 신호를 선택하는 디스플레이 구동 장치.According to claim 5, wherein the selection unit,
a display for selecting the first clock signal in response to the control signal having a logic level corresponding to the display on period and selecting the second clock signal in response to the control signal having a logic level corresponding to the display off period drive. 삭제delete 제 1 항에 있어서,
상기 클럭 데이터 복원 회로는, 디스플레이 온 및 오프 기간에 따라 각각 대응하는 서로 다른 로직 레벨을 가지는 락 신호를 상기 선택부에 제공하고,
상기 선택부는, 상기 디스플레이 온 기간에 대응하는 로직 레벨의 상기 락 신호에 응답하여 상기 제1 클럭 신호를 선택하고, 상기 디스플레이 오프 기간에 대응하는 로직 레벨의 상기 락 신호에 응답하여 상기 제2 클럭 신호를 선택하는 디스플레이 구동 장치.The method of claim 1,
the clock data recovery circuit provides a lock signal having different logic levels corresponding to respective display on and off periods to the selection unit;
The selector may select the first clock signal in response to the lock signal having a logic level corresponding to the display-on period, and the second clock signal in response to the lock signal having a logic level corresponding to the display-off period. Display driving device to select. 데이터에 클럭이 임베디드된 입력 신호로부터 제1 클럭 신호를 생성하는 제1 클럭 소스;
내부 발진에 의해서 미리 설정된 주파수의 제2 클럭 신호를 생성하는 제2 클럭 소스; 및
상기 제1 및 제2 클럭 신호 중 어느 하나를 제3 클럭 신호로서 선택하며, 상기 제3 클럭 신호를 터치 감지를 위한 리드 아웃 회로에 제공하는 선택부;
를 포함하는 디스플레이 구동 장치.a first clock source for generating a first clock signal from an input signal having a clock embedded in data;
a second clock source generating a second clock signal of a preset frequency by internal oscillation; and
a selector selecting one of the first and second clock signals as a third clock signal and providing the third clock signal to a readout circuit for touch sensing;
A display driving device comprising a. 제 9 항에 있어서, 상기 선택부는,
상기 클럭이 수신되지 않는 기간에 대응하여 상기 제2 클럭 신호를 상기 제3 클럭 신호로서 선택하는 디스플레이 구동 장치.10. The method of claim 9, wherein the selection unit,
A display driving apparatus for selecting the second clock signal as the third clock signal corresponding to a period in which the clock is not received. 제 9 항에 있어서, 상기 선택부는,
디스플레이 온 기간에 상기 제1 클럭 신호를 상기 제3 클럭 신호로서 선택하고, 디스플레이 오프 기간에 상기 제2 클럭 신호를 상기 제3 클럭 신호로서 선택하는 디스플레이 구동 장치.10. The method of claim 9, wherein the selection unit,
A display driving apparatus for selecting the first clock signal as the third clock signal in a display-on period and selecting the second clock signal as the third clock signal in a display-off period. 데이터에 클럭을 임베디드한 입력 신호를 제공하는 타이밍 컨트롤러; 및
상기 입력 신호로부터 제1 클럭 신호를 복원하고, 디스플레이 온 및 오프 기간에 따라 상기 제1 클럭 신호 또는 내부에서 생성한 제2 클럭 신호 중 어느 하나를 제3 클럭 신호로서 선택하며, 상기 제3 클럭 신호를 터치를 감지하는데 이용하는 디스플레이 구동 장치;
를 포함하는 디스플레이 장치.a timing controller that provides an input signal with a clock embedded in data; and
recovering a first clock signal from the input signal, selecting either the first clock signal or an internally generated second clock signal as a third clock signal according to a display on and off period, and the third clock signal a display driving device used to sense a touch;
A display device comprising a. 제 12 항에 있어서,
상기 디스플레이 온 및 오프 기간에 따라 각각 대응하는 서로 다른 로직 레벨을 가지는 제어 신호를 상기 디스플레이 구동 장치에 제공하는 마이크로 컨트롤러;를 더 포함하고,
상기 디스플레이 구동 장치는, 상기 제어 신호에 응답하여 상기 디스플레이 온 기간에 상기 제1 클럭 신호를 상기 디스플레이 오프 기간에 상기 제2 클럭 신호를, 상기 제3 클럭 신호로서 선택하는 디스플레이 장치.13. The method of claim 12,
Further comprising; a microcontroller for providing control signals having different logic levels corresponding to each other according to the display on and off periods to the display driving device;
The display driving apparatus is configured to select the first clock signal in the display-on period and the second clock signal in the display-off period as the third clock signal in response to the control signal. 제 12 항에 있어서, 상기 디스플레이 구동 장치는,
상기 입력 신호로부터 상기 제1 클럭 신호와 데이터를 복원하는 클럭 데이터 복원 회로;
상기 데이터의 계조에 대응하는 소스 신호들을 상기 디스플레이 패널에 제공하는 데이터 구동 회로;
상기 디스플레이 패널의 터치를 감지하는 리드 아웃 회로; 및
상기 리드 아웃 회로를 구동시키기 위해, 상기 클럭 데이터 복원 회로에 의해복원된 상기 제1 클럭 신호 또는 내부에서 생성한 상기 제2 클럭 신호 중 어느 하나를 제3클럭 신호로서 선택하며, 상기 제3 클럭 신호를 상기 리드 아웃 회로에 제공하는 선택부;
를 포함하는 디스플레이 장치.13. The method of claim 12, wherein the display driving device,
a clock data recovery circuit for recovering the first clock signal and data from the input signal;
a data driving circuit for providing source signals corresponding to grayscales of the data to the display panel;
a read-out circuit for detecting a touch of the display panel; and
In order to drive the read-out circuit, any one of the first clock signal restored by the clock data recovery circuit or the second clock signal generated therein is selected as a third clock signal, and the third clock signal a selection unit providing to the read-out circuit;
A display device comprising a. 제 14 항에 있어서,
상기 클럭 데이터 복원 회로는, 상기 디스플레이 온 및 오프 기간에 따라 서로 다른 로직 레벨을 가지는 락 신호를 상기 선택부에 제공하고,
상기 선택부는, 상기 락 신호에 응답하여 상기 디스플레이 온 기간에 상기 제1 클럭 신호를 상기 디스플레이 오프 기간에 상기 제2 클럭 신호를, 상기 제3 클럭 신호로서 선택하는 디스플레이 장치.15. The method of claim 14,
the clock data recovery circuit provides a lock signal having different logic levels according to the display on and off periods to the selection unit;
The selector may be configured to select the first clock signal in the display-on period, the second clock signal in the display-off period, and the third clock signal in response to the lock signal.
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