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KR102322707B1 - 유기전계발광표시장치와 이의 구동방법 - Google Patents

유기전계발광표시장치와 이의 구동방법 Download PDF

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KR102322707B1
KR102322707B1 KR1020140188863A KR20140188863A KR102322707B1 KR 102322707 B1 KR102322707 B1 KR 102322707B1 KR 1020140188863 A KR1020140188863 A KR 1020140188863A KR 20140188863 A KR20140188863 A KR 20140188863A KR 102322707 B1 KR102322707 B1 KR 102322707B1
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transistor
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time
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박동원
권용철
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엘지디스플레이 주식회사
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Abstract

본 발명은 표시 패널, 스캔 구동부 및 데이터 구동부를 포함하는 유기전계발광표시장치에 관한 것이다. 표시 패널을 서브 픽셀을 가지며 영상을 표시한다. 스캔 구동부는 표시 패널에 스캔신호를 공급한다. 데이터 구동부는 표시 패널에 서브프레임 단위로 배열된 데이터신호를 공급하되, 서브프레임마다 서브 픽셀에 데이터신호를 전달하는 어드레싱 시간, 서브 픽셀을 발광하는 발광 시간 및 서브 픽셀에 저장된 데이터전압을 삭제하는 삭제 시간이 포함되도록 데이터신호를 구성한다. 삭제 시간은 서브 픽셀의 발광 시간을 제어하는 제1노드와 제2노드가 쇼트됨에 따라 발생한다.

Description

유기전계발광표시장치와 이의 구동방법{Organic Light Emitting Display Device and Driving Method thereof}
본 발명은 유기전계발광표시장치와 이의 구동방법에 관한 것이다.
유기전계발광표시장치에 사용되는 유기전계발광소자는 두 개의 전극 사이에 발광층이 형성된 자발광소자이다. 유기전계발광소자는 전자(electron) 주입전극(cathode)과 정공(hole) 주입전극(anode)으로부터 각각 전자와 정공을 발광층 내부로 주입시켜, 주입된 전자와 정공이 결합한 엑시톤(exciton)이 여기 상태로부터 기저상태로 떨어질 때 발광하는 소자이다.
유기전계발광표시장치는 매트릭스 형태로 배치된 복수의 서브 픽셀을 포함하는 표시 패널에 스캔신호, 데이터신호 및 전원 등이 공급되면, 선택된 서브 픽셀이 발광을 하게 됨으로써 영상을 표시할 수 있다.
유기전계발광표시장치의 구동 방식에는 표시 패널에 전류 또는 전압을 공급하여 구동하는 아날로그 구동 방식과 발광 시간을 조절하는 디지털 구동 방식이 있다. 디지털 구동 방식은 ADS(Address Display Separation) 구동 방식과 AWD(Address While Display) 구동 방식을 포함한다.
AWD 구동 방식은 서브프레임들의 길이가 서로 다른 가중치 시간(weighted time 또는 발광 시간)을 갖도록 구현된다. AWD 구동 방식은 서브프레임마다 서브 픽셀을 턴온 및 턴오프하고 이때 서브 픽셀의 턴온 시간의 누적에 비례하여 휘도가 결정된다.
종래에 제안된 AWD 구동 방식은 1 수평 어드레싱 시간(1V addressing)보다 짧은 하위 서브프레임에만 데이터신호를 삭제하는 삭제 시간(erase)을 삽입한다. 이 때문에, 종래에 제안된 AWD 구동 방식은 이전 서브프레임에 대한 서브 픽셀의 상태(턴온 또는 턴오프)에 따라 현재 서브프레임에 대한 서브 픽셀의 실제 휘도를 결정하는 전압이 달라지는 오차가 발생한다. 그 결과, 종래에 제안된 AWD 구동 방식은 오차 발생 요인으로 인하여 화질 편차가 유발되는바 이의 개선이 요구된다.
상술한 배경기술의 문제점을 해결하기 위한 본 발명은 화질 편차가 유발되는 문제를 개선하고 구동의 정확도를 높이고 표시품질을 향상하는 것이다.
상술한 과제 해결 수단으로 본 발명은 표시 패널, 스캔 구동부 및 데이터 구동부를 포함하는 유기전계발광표시장치에 관한 것이다. 표시 패널을 서브 픽셀을 가지며 영상을 표시한다. 스캔 구동부는 표시 패널에 스캔신호를 공급한다. 데이터 구동부는 표시 패널에 서브프레임 단위로 배열된 데이터신호를 공급하되, 서브프레임마다 서브 픽셀에 데이터신호를 전달하는 어드레싱 시간, 서브 픽셀을 발광하는 발광 시간 및 서브 픽셀에 저장된 데이터전압을 삭제하는 삭제 시간이 포함되도록 데이터신호를 구성한다. 삭제 시간은 서브 픽셀의 발광 시간을 제어하는 제1노드와 제2노드가 쇼트됨에 따라 발생한다.
서브 픽셀은 제1노드와 제2노드를 초기화하는 초기화 시간과 서브 픽셀의 커패시터에 저장된 데이터전압을 삭제하기 위한 삭제 시간이 구분되어 발생할 수 있다.
삭제 시간은 프레임마다 데이터라인과 구동 트랜지스터의 게이트전극의 노드를 쇼트하여 커패시터에 저장된 데이터전압을 삭제할 수 있다.
서브 픽셀은 제A스캔라인에 게이트전극이 연결되고 제1데이터라인에 제1전극이 연결되고 커패시터의 일단에 제2전극이 연결된 제1트랜지스터와, 제B스캔라인에 게이트전극이 연결되고 제1데이터라인에 제1전극이 연결되고 커패시터의 타단에 제2전극이 연결된 제2트랜지스터와, 제1트랜지스터의 제2전극에 일단이 연결되고 구동 트랜지스터의 게이트전극과 제2트랜지스터의 제2전극에 타단이 연결된 커패시터와, 커패시터에 게이트전극이 연결되고 제1전원라인에 제1전극이 연결되고 유기 발광다이오드의 애노드전극에 제2전극이 연결된 구동 트랜지스터와, 구동 트랜지스터의 제2전극에 애노드전극이 연결되고 제2전원라인에 캐소드전극이 연결된 유기 발광다이오드를 포함할 수 있다.
삭제 시간은 프레임마다 커패시터의 양단의 노드를 쇼트하여 커패시터에 저장된 데이터전압을 삭제할 수 있다.
서브 픽셀은 제A스캔라인에 게이트전극이 연결되고 제1데이터라인에 제1전극이 연결되고 커패시터의 일단에 제2전극이 연결된 제1트랜지스터와, 제B스캔라인에 게이트전극이 연결되고 커패시터의 일단에 제1전극이 연결되고 커패시터의 타단에 제2전극이 연결된 제2트랜지스터와, 제1트랜지스터의 제2전극 및 제2트랜지스터의 제1전극에 일단이 연결되고 구동 트랜지스터의 게이트전극과 제2트랜지스터의 제2전극에 타단이 연결된 커패시터와, 커패시터에 게이트전극이 연결되고 제1전원라인에 제1전극이 연결되고 유기 발광다이오드의 애노드전극에 제2전극이 연결된 구동 트랜지스터와, 구동 트랜지스터의 제2전극에 애노드전극이 연결되고 제2전원라인에 캐소드전극이 연결된 유기 발광다이오드를 포함할 수 있다.
삭제 시간은 프레임마다 구동 트랜지스터의 게이트전극과 소오스전극 또는 드레인전극의 양단의 노드를 쇼트하여 커패시터에 저장된 데이터전압을 삭제할 수 있다.
서브 픽셀은 제A스캔라인에 게이트전극이 연결되고 제1데이터라인에 제1전극이 연결되고 커패시터의 일단에 제2전극이 연결된 제1트랜지스터와, 제B스캔라인에 게이트전극이 연결되고 커패시터의 타단과 구동 트랜지스터의 게이트전극에 제1전극이 연결되고 구동 트랜지스터의 제2전극에 제2전극이 연결된 제2트랜지스터와, 제1트랜지스터의 제2전극 및 제2트랜지스터의 제1전극에 일단이 연결되고 구동 트랜지스터의 게이트전극과 제2트랜지스터의 제2전극에 타단이 연결된 커패시터와, 커패시터에 게이트전극이 연결되고 제1전원라인에 제1전극이 연결되고 유기 발광다이오드의 애노드전극에 제2전극이 연결된 구동 트랜지스터와, 구동 트랜지스터의 제2전극에 애노드전극이 연결되고 제2전원라인에 캐소드전극이 연결된 유기 발광다이오드를 포함할 수 있다.
다른 측면에서 본 발명은 유기전계발광표시장치의 구동방법에 관한 것이다. 이 구동방법은 서브 픽셀에 연결된 제A스캔라인을 통해 제A스캔신호를 공급함과 더불어 서브 픽셀에 데이터신호를 전달하고 데이터신호를 데이터전압으로 저장하는 어드레싱 시간과, 데이터전압에 대응하여 빛을 발광하는 발광 시간과, 서브 픽셀에 연결된 제B스캔라인을 통해 제B스캔신호를 공급하고 서브 픽셀에 저장된 데이터전압을 삭제하는 삭제 시간을 포함한다. 서브 픽셀은 서브프레임마다 어드레싱 시간, 발광 시간 및 삭제 시간이 발생하고, 삭제 시간은 서브 픽셀의 발광 시간을 제어하는 제1노드와 제2노드가 쇼트됨에 따라 발생한다.
서브 픽셀은 제1노드와 제2노드를 초기화하는 초기화 시간과 서브 픽셀의 커패시터에 저장된 데이터전압을 삭제하기 위한 삭제 시간이 구분되어 발생할 수 있다.
본 발명은 서브프레임에 대한 서브 픽셀의 실제 휘도를 결정하는 전압이 달라지는 오차 발생 요인으로 인하여 화질 편차가 유발되는 문제를 개선할 수 있는 효과가 있다. 또한, 본 발명은 적은 개수의 소자로 오차 발생 요인을 제거(또는 방지)하여 구동의 정확도를 높이고 표시품질을 향상할 수 있는 효과가 있다.
도 1은 본 발명의 제1실시예에 따른 유기전계발광표시장치의 개략적인 구성도.
도 2는 종래 AWD 구동 방식을 설명하기 위한 도면.
도 3은 본 발명에 따른 AWD 구동 방식을 설명하기 위한 도면.
도 4는 본 발명의 제1실시예에 따른 서브 픽셀의 회로 구성 예시도.
도 5는 도 4에 도시된 서브 픽셀의 구동 파형 예시도.
도 6은 본 발명의 제2실시예에 따른 서브 픽셀의 회로 구성 예시도.
도 7은 도 6에 도시된 서브 픽셀의 구동 파형 예시도.
도 8은 본 발명의 제3실시예에 따른 서브 픽셀의 회로 구성 예시도.
도 9는 도 8에 도시된 서브 픽셀의 구동 파형 예시도.
도 10은 본 발명의 제4실시예에 따른 서브 픽셀의 회로 구성 예시도.
도 11은 도 10에 도시된 서브 픽셀의 구동 파형 예시도.
이하, 본 발명의 실시를 위한 구체적인 내용을 첨부된 도면을 참조하여 설명한다.
<제1실시예>
도 1은 본 발명의 제1실시예에 따른 유기전계발광표시장치의 개략적인 구성도이고, 도 2는 종래 AWD 구동 방식을 설명하기 위한 도면이며, 도 3은 본 발명에 따른 AWD 구동 방식을 설명하기 위한 도면이다.
도 1에 도시된 바와 같이, 본 발명의 제1실시예에 따른 유기전계발광표시장치에는 영상 처리부(110), 타이밍 제어부(120), 데이터 구동부(130), 스캔 구동부(140) 및 표시 패널(150)이 포함된다.
영상 처리부(110)는 외부로부터 공급된 데이터신호(DATA)와 더불어 데이터 인에이블 신호(DE) 등을 출력한다. 영상 처리부(110)는 데이터 인에이블 신호(DE) 외에도 수직 동기신호, 수평 동기신호 및 클럭신호 중 하나 이상을 출력할 수 있으나 이 신호들은 설명의 편의상 생략 도시한다.
타이밍 제어부(120)는 영상 처리부(110)로부터 데이터 인에이블 신호(DE) 또는 수직 동기신호, 수평 동기신호 및 클럭신호 등을 포함하는 구동신호와 더불어 데이터신호(DATA)를 공급받는다. 타이밍 제어부(120)는 구동신호에 기초하여 스캔 구동부(140)의 동작 타이밍을 제어하기 위한 게이트 타이밍 제어신호(GDC)와 데이터 구동부(130)의 동작 타이밍을 제어하기 위한 데이터 타이밍 제어신호(DDC)를 출력한다.
데이터 구동부(130)는 타이밍 제어부(120)로부터 공급된 데이터 타이밍 제어신호(DDC)에 응답하여 타이밍 제어부(120)로부터 공급되는 데이터신호(DATA)를 샘플링하고 래치하여 감마 기준전압으로 변환하여 출력한다. 데이터 구동부(130)는 데이터라인들(DL1 ~ DLn)을 통해 서브프레임(또는 서브필드) 단위로 배열된 데이터신호(DATA)를 출력한다. 데이터 구동부(130)는 IC(Integrated Circuit) 형태로 형성된다.
스캔 구동부(140)는 타이밍 제어부(120)로부터 공급된 게이트 타이밍 제어신호(GDC)에 응답하여 게이트전압의 레벨을 시프트시키면서 스캔신호를 출력한다. 스캔 구동부(140)는 스캔라인들(GL1 ~ GLm)을 통해 스캔신호를 출력한다. 스캔 구동부(140)는 IC(Integrated Circuit) 형태로 형성되거나 표시 패널(150)에 게이트인패널(Gate In Panel) 방식으로 형성된다.
표시 패널(150)은 데이터 구동부(130) 및 스캔 구동부(140)로부터 공급된 데이터신호(DATA) 및 스캔신호에 대응하여 영상을 표시한다. 표시 패널(150)은 영상을 표시하는 서브 픽셀들(SP)을 포함한다.
서브 픽셀은 구조에 따라 전면발광(Top-Emission) 방식, 배면발광(Bottom-Emission) 방식 또는 양면발광(Dual-Emission) 방식으로 형성된다. 서브 픽셀들(SP)은 적색 서브 픽셀, 녹색 서브 픽셀 및 청색 서브 픽셀을 포함하거나 백색 서브 픽셀, 적색 서브 픽셀, 녹색 서브 픽셀 및 청색 서브 픽셀을 포함한다. 서브 픽셀들(SP)은 발광 특성에 따라 하나 이상 다른 발광 면적을 가질 수 있다.
도 2에 도시된 바와 같이, 종래 AWD(Address While Display) 구동 방식은 1 프레임(1frame)(또는 1 수직 어드레싱 시간; 1V addressing time)의 데이터신호가 서브프레임들(SF1 ~ SF5)로 구성된다. 서브프레임들(SF1 ~ SF5)은 서로 다른 가중치 시간(weighted time 또는 발광 시간)을 갖도록 구성된다.
상위 서브프레임들(SF1 ~ SF3)은 어드레싱 시간(addressing)과 발광 시간(Emission)으로 구성되는 반면, 하위 서브프레임들(SF4, SF5)은 어드레싱 시간(addressing), 발광 시간(Emission) 및 삭제 시간(Erase)으로 구성된다.
앞서 설명한 바와 같이, AWD 구동 방식은 유기 발광다이오드의 발광 시간(Emission)을 조절하는 디지털 구동 방식이다. 디지털 구동 방식은 한 프레임(1frame)을 다수의 서브프레임(SF1 ~ SF4)으로 나누어 발광 시간(Emission)의 비율로 계조를 결정하게 된다.
AWD 구동 방식은 하나의 서브프레임의 어드레싱이 종료되어야만 다음 서브프레임의 어드레싱이 이루어진다. 이 때문에, 하나의 서브프레임의 어드레싱 시간이 해당 서브프레임의 발광 시간보다 길 경우, 다음 서브프레임의 어드레싱이 시작되기 전까지 시간을 보유하기 위해 데이터신호를 삭제하는 시간이 필요하다.
각 서브프레임은 각각 하나의 비트(bit)를 나타내며, 각 서브프레임의 발광 시간은 대략 2배씩 증가하거나 감소하게 된다. 제1서브프레임(SF1)은 5개의 서브프레임 중에서 발광 시간(Emission)이 가장 긴 것을 의미하고, 제5서브프레임(SF5)은 5개의 서브프레임 중에서 발광 시간(Emission)이 가장 짧은 것을 의미한다. 도면에 따르면 발광 시간은 SF1 > SF2 >SF3 > SF4 > SF5이 된다.
AWD 구동 방식은 서브프레임마다 서브 픽셀을 턴온 및 턴오프하고 이때 서브 픽셀의 턴온 시간의 누적에 비례하여 휘도가 결정된다. 그런데, 종래에 제안된 AWD 구동 방식은 1 수평 어드레싱 시간(1V addressing)보다 짧은 하위 서브프레임들(SF4, SF5)에만 데이터신호를 삭제하는 삭제 시간(Erase)을 삽입한다.
이 때문에, 종래에 제안된 AWD 구동 방식은 이전 서브프레임에 대한 서브 픽셀의 상태(턴온 또는 턴오프)에 따라 현재 서브프레임에 대한 서브 픽셀의 실제 휘도를 결정하는 전압이 달라지는 오차가 발생한다. 그 결과, 종래에 제안된 AWD 구동 방식은 오차 발생 요인으로 인하여 화질 편차가 유발되는바 이의 개선이 요구된다.
도 3에 도시된 바와 같이, 본 발명의 제1실시예에 따른 AWD 구동 방식은 1 프레임(1frame)의 데이터신호가 서브프레임들(SF1 ~ SF5)로 구성된다. 서브프레임들(SF1 ~ SF5)은 서로 다른 가중치 시간(weighted time 또는 발광 시간)을 갖도록 구성된다.
본 발명의 제1실시예에 따른 AWD 구동 방식은 종래에 제안된 AWD 구동 방식에서 유발되는 오차 발생으로 인한 화질 편차 유발을 방지하기 위해 모든 서브프레임들(SF1 ~ SF5)이 어드레싱 시간(addressing), 발광 시간(Emission) 및 삭제 시간(Erase)으로 구성된다.
이렇듯, 본 발명의 제1실시예에 따른 AWD 구동 방식은 이전 서브프레임에 대한 서브 픽셀의 상태(턴온 또는 턴오프)에 따라 현재 서브프레임에 대한 서브 픽셀의 실제 휘도를 결정하는 전압이 달라지는 오차를 해소하기 위해 서브프레임마다 삭제 시간(Erase)(또는 reset)을 기입한다. 삭제 시간은 발광 시간을 제어할 수 있는 제1노드와 제2노드를 쇼트 하는 동작으로 정의된다.
본 발명의 제1실시예는 서브프레임마다 삭제 시간(Erase)을 두고 서브 픽셀을 구동할 수 있도록, 서브 픽셀의 회로 구성을 다음과 같이 설계한다.
도 4는 본 발명의 제1실시예에 따른 서브 픽셀의 회로 구성 예시도이고, 도 5는 도 4에 도시된 서브 픽셀의 구동 파형 예시도이다.
도 4에 도시된 바와 같이, 본 발명의 제1실시예에 따른 서브 픽셀에는 제1트랜지스터(T1), 제2트랜지스터(T2), 커패시터(Cst), 구동 트랜지스터(DT) 및 유기 발광다이오드(OLED)가 포함된다.
제1트랜지스터(T1)는 제A스캔라인(SNA)에 게이트전극이 연결되고 제1데이터라인(DL1)에 제1전극이 연결되고 커패시터(Cst)의 일단에 제2전극이 연결된다. 제1트랜지스터(T1)는 제A스캔라인(SNA)을 통해 공급된 제A스캔신호에 대응하여 동작한다. 제1트랜지스터(T1)가 턴온되면 제1데이터라인(DL1)을 통해 공급된 데이터신호는 데이터전압 형태로 커패시터(Cst)에 저장된다.
제2트랜지스터(T2)는 제B스캔라인(SNB)에 게이트전극이 연결되고 제1데이터라인(DL1)에 제1전극이 연결되고 커패시터(Cst)의 타단에 제2전극이 연결된다. 제2트랜지스터(T2)는 제B스캔라인(SNB)을 통해 공급된 제B스캔신호에 대응하여 동작한다. 제2트랜지스터(T2)가 턴온되면 커패시터(Cst)에 저장된 데이터전압은 삭제된다.
커패시터(Cst)는 제1트랜지스터(T1)의 제2전극에 일단이 연결되고 구동 트랜지스터(DT)의 게이트전극과 제2트랜지스터(T2)의 제2전극에 타단이 연결된다. 커패시터(Cst)는 저장된 데이터전압을 구동 트랜지스터(DT)의 게이트전극에 제공한다.
구동 트랜지스터(DT)는 커패시터(Cst)에 게이트전극이 연결되고 제1전원라인(EVDD)에 제1전극이 연결되고 유기 발광다이오드(OLED)의 애노드전극에 제2전극이 연결된다. 구동 트랜지스터(DT)는 커패시터(Cst)에 저장된 데이터전압에 대응하여 동작한다.
유기 발광다이오드(OLED)는 구동 트랜지스터(DT)의 제2전극에 애노드전극이 연결되고 제2전원라인(EVSS)에 캐소드전극이 연결된다. 유기 발광다이오드(OLED)는 구동 트랜지스터(DT)가 턴온된 시간에 대응하여 빛을 발광한다.
위의 설명에서 제1전극과 제2전극은 트랜지스터의 특성이나 방향에 따라 트랜지스터의 소오스전극과 드레인전극 또는 드레인전극과 소오스전극으로 정의될 수 있다.
본 발명의 제1실시예에 따른 서브 픽셀은 제A스캔라인(SNA)과 제B스캔라인(SNB) 이상 2 개의 스캔라인을 통해 공급된 스캔신호에 대응하여 동작한다. 제A스캔라인(SNA)과 제B스캔라인(SNB)은 제1스캔라인(GL1)에 포함된다. 본 발명의 제1실시예에 따른 서브 픽셀에 포함된 제1트랜지스터(T1)와 제2트랜지스터(T2)는 P타입으로 구성되므로 이의 구동 파형은 다음의 도 5와 같다.
제A스캔라인(SNA)에는 제A스캔신호(Scan)가 공급된다. 제A스캔라인(SNA)을 통해 공급된 제A스캔신호(Scan)(로직로우;L 부분)는 서브 픽셀에 데이터신호를 전달하는 어드레싱 시간을 정의한다. 제A스캔라인(SNA)을 통해 로직로우(L)에 해당하는 제A스캔신호(Scan)가 공급되면 서브 픽셀은 어드레싱 시간에 대응하여 데이터신호(Vdata)를 데이터전압으로 저장하게 된다.
제B스캔라인(SNB)에는 제B-1스캔신호(Reset)와 제B-2스캔신호(Erase)가 공급된다. 제B스캔라인(SNB)을 통해 공급된 제B-1스캔신호(Reset)(로직로우;L 부분)는 서브 픽셀을 초기화하는 초기화 시간을 정의한다. 제B스캔라인(SNB)을 통해 로직로우(L)에 해당하는 제B-1스캔신호(Reset)가 공급되면 서브 픽셀은 초기화 시간에 대응하여 제1트랜지스터(T1)와 커패시터(Cst) 사이의 노드를 초기화하게 된다.
제B-1스캔신호(Reset)를 이용한 초기화 시간은 데이터신호(Vdata)가 공급되기 전에 발생할 수 있다. 그리고 제B-1스캔신호(Reset)가 발생하는 시점은 제A스캔신호(Scan)가 로직로우(L)로 떨어지는 시점에 동기되거나 이보다 조금 빠른 시점 또는 조금 느린 시점이 될 수도 있다.
제B스캔라인(SNB)을 통해 공급된 제B-2스캔신호(Reset)(로직로우;L 부분)는 서브 픽셀에 저장된 데이터전압을 삭제하는 삭제 시간을 정의한다. 제B스캔라인(SNB)을 통해 로직로우(L)에 해당하는 제B-2스캔신호(Erase)가 공급되면 서브 픽셀은 삭제 시간에 대응하여 데이터전압을 삭제하게 된다. 제B-2스캔신호(Erase)가 발생하는 시점은 각 서브 픽셀의 발광 시간이 종료되는 시점에 대응된다.
한편, 제B-1스캔신호(Reset)와 제B-2스캔신호(Reset)는 제2트랜지스터(T2)를 턴온하여 제1트랜지스터(T1)와 커패시터(Cst) 사이의 노드를 쇼트시키는 방식으로 이들 커패시터(Cst)의 전위를 삭제 하지만 기능적으로는 위와 같이 다르기 때문에 구분하였음을 참조한다.
한편, 데이터라인을 통해 전달되는 데이터전압은 어드레싱 시간에 대응하여 서브 픽셀을 발광시킬 수 있는 전압으로 공급되지만, 초기화 시간 또는 삭제 시간에 대응하여 서브 픽셀을 비발광(턴오프)할 수 있는 전압으로 가변될 수 있다.
도 4 및 도 5를 통해 알 수 있듯이, 본 발명의 제1실시예에서는 제B스캔라인(SNB)을 통해 공급된 제B-1 및 제B-2스캔신호(Reset, Erase)를 이용하여 제2트랜지스터(T2)를 구동하고, 이를 기반으로 서브 픽셀을 초기화 구동함은 물론 삭제 구동하는 것을 일례로 설명하였다.
초기화 시간은 삭제 시간 이후 어드레싱 시간까지 되돌아 오는 긴 텀으로 인한 노드의 변화 문제(기생 성분 등에 의한 문제)를 미연에 방지하고자 삽입된 시 간이므로 이는 생략 가능하다. 그러므로, 제B스캔라인(SNB)을 통해 공급된 제B-2스캔신호(Erase)만 이용하여 서브 픽셀을 삭제 구동할 수도 있음은 물론이다. 즉, 초기화 시간은 생략하고 삭제 시간만 사용할 수 있다. 아울러, 도 5에 도시된 구동 파형은 하나의 예시일 뿐 목적 및 효과 등에 따라 이와 다른 형태로 구동 파형을 정립할 수도 있다.
<제2실시예>
도 6은 본 발명의 제2실시예에 따른 서브 픽셀의 회로 구성 예시도이고, 도 7은 도 6에 도시된 서브 픽셀의 구동 파형 예시도이다.
도 6에 도시된 바와 같이, 본 발명의 제2실시예에 따른 서브 픽셀에는 제1트랜지스터(T1), 제2트랜지스터(T2), 커패시터(Cst), 구동 트랜지스터(DT) 및 유기 발광다이오드(OLED)가 포함된다.
제1트랜지스터(T1)는 제A스캔라인(SNA)에 게이트전극이 연결되고 제1데이터라인(DL1)에 제1전극이 연결되고 커패시터(Cst)의 일단에 제2전극이 연결된다. 제1트랜지스터(T1)는 제A스캔라인(SNA)을 통해 공급된 제A스캔신호에 대응하여 동작한다. 제1트랜지스터(T1)가 턴온되면 제1데이터라인(DL1)을 통해 공급된 데이터신호는 데이터전압 형태로 커패시터(Cst)에 저장된다.
제2트랜지스터(T2)는 제B스캔라인(SNB)에 게이트전극이 연결되고 커패시터(Cst)의 일단에 제1전극이 연결되고 커패시터(Cst)의 타단에 제2전극이 연결된다. 제2트랜지스터(T2)는 제B스캔라인(SNB)을 통해 공급된 제B스캔신호에 대응하여 동작한다. 제2트랜지스터(T2)가 턴온되면 커패시터(Cst)에 저장된 데이터전압은 삭제된다.
커패시터(Cst)는 제1트랜지스터(T1)의 제2전극 및 제2트랜지스터(T2)의 제1전극에 일단이 연결되고 구동 트랜지스터(DT)의 게이트전극과 제2트랜지스터(T2)의 제2전극에 타단이 연결된다. 커패시터(Cst)는 저장된 데이터전압을 구동 트랜지스터(DT)의 게이트전극에 제공한다.
구동 트랜지스터(DT)는 커패시터(Cst)에 게이트전극이 연결되고 제1전원라인(EVDD)에 제1전극이 연결되고 유기 발광다이오드(OLED)의 애노드전극에 제2전극이 연결된다. 구동 트랜지스터(DT)는 커패시터(Cst)에 저장된 데이터전압에 대응하여 동작한다.
유기 발광다이오드(OLED)는 구동 트랜지스터(DT)의 제2전극에 애노드전극이 연결되고 제2전원라인(EVSS)에 캐소드전극이 연결된다. 유기 발광다이오드(OLED)는 구동 트랜지스터(DT)가 턴온된 시간에 대응하여 빛을 발광한다.
위의 설명에서 제1전극과 제2전극은 트랜지스터의 특성이나 방향에 따라 트랜지스터의 소오스전극과 드레인전극 또는 드레인전극과 소오스전극으로 정의될 수 있다.
본 발명의 제2실시예에 따른 서브 픽셀은 제A스캔라인(SNA)과 제B스캔라인(SNB) 이상 2 개의 스캔라인을 통해 공급된 스캔신호에 대응하여 동작한다. 제A스캔라인(SNA)과 제B스캔라인(SNB)은 제1스캔라인(GL1)에 포함된다. 본 발명의 제2실시예에 따른 서브 픽셀에 포함된 제1트랜지스터(T1)와 제2트랜지스터(T2)는 P타입으로 구성되므로 이의 구동 파형은 다음의 도 7과 같다.
제A스캔라인(SNA)에는 제A스캔신호(Scan)가 공급된다. 제A스캔라인(SNA)을 통해 공급된 제A스캔신호(Scan)(로직로우;L 부분)는 서브 픽셀에 데이터신호를 전달하는 어드레싱 시간을 정의한다. 제A스캔라인(SNA)을 통해 로직로우(L)에 해당하는 제A스캔신호(Scan)가 공급되면 서브 픽셀은 어드레싱 시간에 대응하여 데이터신호(Vdata)를 데이터전압으로 저장하게 된다.
제B스캔라인(SNB)에는 제B-1스캔신호(Reset)와 제B-2스캔신호(Erase)가 공급된다. 제B스캔라인(SNB)을 통해 공급된 제B-1스캔신호(Reset)(로직로우;L 부분)는 서브 픽셀을 초기화하는 초기화 시간을 정의한다. 제B스캔라인(SNB)을 통해 로직로우(L)에 해당하는 제B-1스캔신호(Reset)가 공급되면 서브 픽셀은 초기화 시간에 대응하여 커패시터(Cst)의 양단의 노드를 초기화하게 된다.
제B-1스캔신호(Reset)를 이용한 초기화 시간은 데이터신호(Vdata)가 공급되기 전에 발생할 수 있다. 그리고 제B-1스캔신호(Reset)가 발생하는 시점은 제A스캔신호(Scan)가 로직로우(L)로 떨어지는 시점에 동기되거나 이보다 조금 빠른 시점 또는 조금 느린 시점이 될 수도 있다.
제B스캔라인(SNB)을 통해 공급된 제B-2스캔신호(Reset)(로직로우;L 부분)는 서브 픽셀에 저장된 데이터전압을 삭제하는 삭제 시간을 정의한다. 제B스캔라인(SNB)을 통해 로직로우(L)에 해당하는 제B-2스캔신호(Erase)가 공급되면 서브 픽셀은 삭제 시간에 대응하여 데이터전압을 삭제하게 된다. 제B-2스캔신호(Erase)가 발생하는 시점은 각 서브 픽셀의 발광 시간이 종료되는 시점에 대응된다.
한편, 제B-1스캔신호(Reset)와 제B-2스캔신호(Reset)는 제2트랜지스터(T2)를 턴온하여 커패시터(Cst)의 양단의 노드를 쇼트시키는 방식으로 커패시터(Cst)의 전위를 삭제 하지만 기능적으로는 위와 같이 다르기 때문에 구분하였음을 참조한다.
한편, 데이터라인을 통해 전달되는 데이터전압은 어드레싱 시간에 대응하여 서브 픽셀을 발광시킬 수 있는 전압으로 공급되지만, 초기화 시간 또는 삭제 시간에 대응하여 서브 픽셀을 비발광(턴오프)할 수 있는 전압으로 가변될 수 있다.
도 6 및 도 7을 통해 알 수 있듯이, 본 발명의 제2실시예에서는 제B스캔라인(SNB)을 통해 공급된 제B-1 및 제B-2스캔신호(Reset, Erase)를 이용하여 제2트랜지스터(T2)를 구동하고, 이를 기반으로 서브 픽셀을 초기화 구동함은 물론 삭제 구동하는 것을 일례로 설명하였다.
초기화 시간은 삭제 시간 이후 어드레싱 시간까지 되돌아 오는 긴 텀으로 인한 노드의 변화 문제(기생 성분 등에 의한 문제)를 미연에 방지하고자 삽입된 시 간이므로 이는 생략 가능하다. 그러므로, 제B스캔라인(SNB)을 통해 공급된 제B-2스캔신호(Erase)만 이용하여 서브 픽셀을 삭제 구동할 수도 있음은 물론이다. 즉, 초기화 시간은 생략하고 삭제 시간만 사용할 수 있다. 아울러, 도 7에 도시된 구동 파형은 하나의 예시일 뿐 목적 및 효과 등에 따라 이와 다른 형태로 구동 파형을 정립할 수도 있다.
<제3실시예>
도 8은 본 발명의 제3실시예에 따른 서브 픽셀의 회로 구성 예시도이고, 도 9는 도 8에 도시된 서브 픽셀의 구동 파형 예시도이다.
도 8에 도시된 바와 같이, 본 발명의 제3실시예에 따른 서브 픽셀에는 제1트랜지스터(T1), 제2트랜지스터(T2), 커패시터(Cst), 구동 트랜지스터(DT) 및 유기 발광다이오드(OLED)가 포함된다.
제1트랜지스터(T1)는 제A스캔라인(SNA)에 게이트전극이 연결되고 제1데이터라인(DL1)에 제1전극이 연결되고 커패시터(Cst)의 일단에 제2전극이 연결된다. 제1트랜지스터(T1)는 제A스캔라인(SNA)을 통해 공급된 제A스캔신호에 대응하여 동작한다. 제1트랜지스터(T1)가 턴온되면 제1데이터라인(DL1)을 통해 공급된 데이터신호는 데이터전압 형태로 커패시터(Cst)에 저장된다.
제2트랜지스터(T2)는 제B스캔라인(SNB)에 게이트전극이 연결되고 커패시터(Cst)의 타단과 구동 트랜지스터(DT)의 게이트전극에 제1전극이 연결되고 구동 트랜지스터(DT)의 제2전극에 제2전극이 연결된다. 제2트랜지스터(T2)는 제B스캔라인(SNB)을 통해 공급된 제B스캔신호에 대응하여 동작한다. 제2트랜지스터(T2)가 턴온되면 구동 트랜지스터(DT)의 게이트전극의 노드와 제2전극의 노드는 쇼트되고, 제2전극을 통해 흐르는 높은 전압(예컨대 Vgs = 0 보다 높은 전압이 인가되므로)에 의해 구동 트랜지스터(DT)는 턴오프된다. 그리고 이와 더불어, 커패시터(Cst)에 저장된 데이터전압 또한 제2전극을 통해 흐르는 높은 전압에 의해 삭제된다.
커패시터(Cst)는 제1트랜지스터(T1)의 제2전극 및 제2트랜지스터(T2)의 제1전극에 일단이 연결되고 구동 트랜지스터(DT)의 게이트전극과 제2트랜지스터(T2)의 제2전극에 타단이 연결된다. 커패시터(Cst)는 저장된 데이터전압을 구동 트랜지스터(DT)의 게이트전극에 제공한다.
구동 트랜지스터(DT)는 커패시터(Cst)에 게이트전극이 연결되고 제1전원라인(EVDD)에 제1전극이 연결되고 유기 발광다이오드(OLED)의 애노드전극에 제2전극이 연결된다. 구동 트랜지스터(DT)는 커패시터(Cst)에 저장된 데이터전압에 대응하여 동작한다.
유기 발광다이오드(OLED)는 구동 트랜지스터(DT)의 제2전극에 애노드전극이 연결되고 제2전원라인(EVSS)에 캐소드전극이 연결된다. 유기 발광다이오드(OLED)는 구동 트랜지스터(DT)가 턴온된 시간에 대응하여 빛을 발광한다.
위의 설명에서 제1전극과 제2전극은 트랜지스터의 특성이나 방향에 따라 트랜지스터의 소오스전극과 드레인전극 또는 드레인전극과 소오스전극으로 정의될 수 있다.
본 발명의 제3실시예에 따른 서브 픽셀은 제A스캔라인(SNA)과 제B스캔라인(SNB) 이상 2 개의 스캔라인을 통해 공급된 스캔신호에 대응하여 동작한다. 제A스캔라인(SNA)과 제B스캔라인(SNB)은 제1스캔라인(GL1)에 포함된다. 본 발명의 제3실시예에 따른 서브 픽셀에 포함된 제1트랜지스터(T1)와 제2트랜지스터(T2)는 P타입으로 구성되므로 이의 구동 파형은 다음의 도 9와 같다.
제A스캔라인(SNA)에는 제A스캔신호(Scan)가 공급된다. 제A스캔라인(SNA)을 통해 공급된 제A스캔신호(Scan)(로직로우;L 부분)는 서브 픽셀에 데이터신호를 전달하는 어드레싱 시간을 정의한다. 제A스캔라인(SNA)을 통해 로직로우(L)에 해당하는 제A스캔신호(Scan)가 공급되면 서브 픽셀은 어드레싱 시간에 대응하여 데이터신호(Vdata)를 데이터전압으로 저장하게 된다.
제B스캔라인(SNB)에는 제B-1스캔신호(Reset)와 제B-2스캔신호(Erase)가 공급된다. 제B스캔라인(SNB)을 통해 공급된 제B-1스캔신호(Reset)(로직로우;L 부분)는 서브 픽셀을 초기화하는 초기화 시간을 정의한다. 제B스캔라인(SNB)을 통해 로직로우(L)에 해당하는 제B-1스캔신호(Reset)가 공급되면 서브 픽셀은 초기화 시간에 대응하여 구동 트랜지스터(DT)의 게이트전극의 노드와 제2전극의 노드를 쇼트하여 초기화하게 된다.
제B-1스캔신호(Reset)를 이용한 초기화 시간은 데이터신호(Vdata)가 공급되기 전에 발생할 수 있다. 그리고 제B-1스캔신호(Reset)가 발생하는 시점은 제A스캔신호(Scan)가 로직로우(L)로 떨어지는 시점에 동기되거나 이보다 조금 빠른 시점 또는 조금 느린 시점이 될 수도 있다.
제B스캔라인(SNB)을 통해 공급된 제B-2스캔신호(Reset)(로직로우;L 부분)는 서브 픽셀에 저장된 데이터전압을 삭제하는 삭제 시간을 정의한다. 제B스캔라인(SNB)을 통해 로직로우(L)에 해당하는 제B-2스캔신호(Erase)가 공급되면 서브 픽셀은 삭제 시간에 대응하여 데이터전압을 삭제하게 된다. 제B-2스캔신호(Erase)가 발생하는 시점은 각 서브 픽셀의 발광 시간이 종료되는 시점에 대응된다.
한편, 제B-1스캔신호(Reset)와 제B-2스캔신호(Reset)는 제2트랜지스터(T2)를 턴온하여 구동 트랜지스터(DT)의 게이트전극의 노드와 제2전극의 노드를 쇼트시키는 방식으로 커패시터(Cst)의 전위를 삭제 하지만 기능적으로는 위와 같이 다르기 때문에 구분하였음을 참조한다.
한편, 데이터라인을 통해 전달되는 데이터전압은 어드레싱 시간에 대응하여 서브 픽셀을 발광시킬 수 있는 전압으로 공급되지만, 초기화 시간 또는 삭제 시간에 대응하여 서브 픽셀을 비발광(턴오프)할 수 있는 전압으로 가변될 수 있다.
도 8 및 도 9를 통해 알 수 있듯이, 본 발명의 제3실시예에서는 제B스캔라인(SNB)을 통해 공급된 제B-1 및 제B-2스캔신호(Reset, Erase)를 이용하여 제2트랜지스터(T2)를 구동하고, 이를 기반으로 서브 픽셀을 초기화 구동함은 물론 삭제 구동하는 것을 일례로 설명하였다.
초기화 시간은 삭제 시간 이후 어드레싱 시간까지 되돌아 오는 긴 텀으로 인한 노드의 변화 문제(기생 성분 등에 의한 문제)를 미연에 방지하고자 삽입된 시 간이므로 이는 생략 가능하다. 그러므로, 제B스캔라인(SNB)을 통해 공급된 제B-2스캔신호(Erase)만 이용하여 서브 픽셀을 삭제 구동할 수도 있음은 물론이다. 즉, 초기화 시간은 생략하고 삭제 시간만 사용할 수 있다. 아울러, 도 9에 도시된 구동 파형은 하나의 예시일 뿐 목적 및 효과 등에 따라 이와 다른 형태로 구동 파형을 정립할 수도 있다.
<제4실시예>
도 10은 본 발명의 제4실시예에 따른 서브 픽셀의 회로 구성 예시도이고, 도 11은 도 10에 도시된 서브 픽셀의 구동 파형 예시도이다.
도 10에 도시된 바와 같이, 본 발명의 제4실시예에 따른 서브 픽셀에는 제1트랜지스터(T1), 제2트랜지스터(T2), 커패시터(Cst), 구동 트랜지스터(DT) 및 유기 발광다이오드(OLED)가 포함된다.
제1트랜지스터(T1)는 제A스캔라인(SNA)에 게이트전극이 연결되고 제1데이터라인(DL1)에 제1전극이 연결되고 커패시터(Cst)의 일단에 제2전극이 연결된다. 제1트랜지스터(T1)는 제A스캔라인(SNA)을 통해 공급된 제A스캔신호에 대응하여 동작한다. 제1트랜지스터(T1)가 턴온되면 제1데이터라인(DL1)을 통해 공급된 데이터신호는 데이터전압 형태로 커패시터(Cst)에 저장된다.
제2트랜지스터(T2)는 제B스캔라인(SNB)에 게이트전극이 연결되고 커패시터(Cst)의 일단에 제1전극이 연결되고 커패시터(Cst)의 타단에 제2전극이 연결된다. 제2트랜지스터(T2)는 제B스캔라인(SNB)을 통해 공급된 제B스캔신호에 대응하여 동작한다. 제2트랜지스터(T2)가 턴온되면 커패시터(Cst)에 저장된 데이터전압은 삭제된다.
커패시터(Cst)는 제1트랜지스터(T1)의 제2전극 및 제2트랜지스터(T2)의 제1전극에 일단이 연결되고 구동 트랜지스터(DT)의 게이트전극과 제2트랜지스터(T2)의 제2전극에 타단이 연결된다. 커패시터(Cst)는 저장된 데이터전압을 구동 트랜지스터(DT)의 게이트전극에 제공한다.
구동 트랜지스터(DT)는 커패시터(Cst)에 게이트전극이 연결되고 제1전원라인(EVDD)에 제1전극이 연결되고 유기 발광다이오드(OLED)의 애노드전극에 제2전극이 연결된다. 구동 트랜지스터(DT)는 커패시터(Cst)에 저장된 데이터전압에 대응하여 동작한다.
유기 발광다이오드(OLED)는 구동 트랜지스터(DT)의 제2전극에 애노드전극이 연결되고 제2전원라인(EVSS)에 캐소드전극이 연결된다. 유기 발광다이오드(OLED)는 구동 트랜지스터(DT)가 턴온된 시간에 대응하여 빛을 발광한다.
위의 설명에서 제1전극과 제2전극은 트랜지스터의 특성이나 방향에 따라 트랜지스터의 소오스전극과 드레인전극 또는 드레인전극과 소오스전극으로 정의될 수 있다.
본 발명의 제4실시예에 따른 서브 픽셀은 제A스캔라인(SNA)과 제B스캔라인(SNB) 이상 2 개의 스캔라인을 통해 공급된 스캔신호에 대응하여 동작한다. 제A스캔라인(SNA)과 제B스캔라인(SNB)은 제1스캔라인(GL1)에 포함된다. 본 발명의 제4실시예에 따른 서브 픽셀에 포함된 제1트랜지스터(T1)와 제2트랜지스터(T2)는 N타입으로 구성되므로 이의 구동 파형은 다음의 도 11과 같다.
제A스캔라인(SNA)에는 제A스캔신호(Scan)가 공급된다. 제A스캔라인(SNA)을 통해 공급된 제A스캔신호(Scan)(로직하이;H 부분)는 서브 픽셀에 데이터신호를 전달하는 어드레싱 시간을 정의한다. 제A스캔라인(SNA)을 통해 로직하이(H)에 해당하는 제A스캔신호(Scan)가 공급되면 서브 픽셀은 어드레싱 시간에 대응하여 데이터신호(Vdata)를 데이터전압으로 저장하게 된다.
제B스캔라인(SNB)에는 제B-1스캔신호(Reset)와 제B-2스캔신호(Erase)가 공급된다. 제B스캔라인(SNB)을 통해 공급된 제B-1스캔신호(Reset)(로직하이;H 부분)는 서브 픽셀을 초기화하는 초기화 시간을 정의한다. 제B스캔라인(SNB)을 통해 로직하이(H)에 해당하는 제B-1스캔신호(Reset)가 공급되면 서브 픽셀은 초기화 시간에 대응하여 커패시터(Cst)의 양단의 노드를 초기화하게 된다.
제B-1스캔신호(Reset)를 이용한 초기화 시간은 데이터신호(Vdata)가 공급되기 전에 발생할 수 있다. 그리고 제B-1스캔신호(Reset)가 발생하는 시점은 제A스캔신호(Scan)가 로직하이(H)로 올라가는 시점에 동기되거나 이보다 조금 빠른 시점 또는 조금 느린 시점이 될 수도 있다.
제B스캔라인(SNB)을 통해 공급된 제B-2스캔신호(Reset)(로직하이;H 부분)는 서브 픽셀에 저장된 데이터전압을 삭제하는 삭제 시간을 정의한다. 제B스캔라인(SNB)을 통해 로직하이(H)에 해당하는 제B-2스캔신호(Erase)가 공급되면 서브 픽셀은 삭제 시간에 대응하여 데이터전압을 삭제하게 된다. 제B-2스캔신호(Erase)가 발생하는 시점은 각 서브 픽셀의 발광 시간이 종료되는 시점에 대응된다.
한편, 제B-1스캔신호(Reset)와 제B-2스캔신호(Reset)는 제2트랜지스터(T2)를 턴온하여 커패시터(Cst)의 양단의 노드를 쇼트시키는 방식으로 커패시터(Cst)의 전위를 삭제 하지만 기능적으로는 위와 같이 다르기 때문에 구분하였음을 참조한다.
한편, 데이터라인을 통해 전달되는 데이터전압은 어드레싱 시간에 대응하여 서브 픽셀을 발광시킬 수 있는 전압으로 공급되지만, 초기화 시간 또는 삭제 시간에 대응하여 서브 픽셀을 비발광(턴오프)할 수 있는 전압으로 가변될 수 있다.
도 10 및 도 11을 통해 알 수 있듯이, 본 발명의 제4실시예에서는 제B스캔라인(SNB)을 통해 공급된 제B-1 및 제B-2스캔신호(Reset, Erase)를 이용하여 제2트랜지스터(T2)를 구동하고, 이를 기반으로 서브 픽셀을 초기화 구동함은 물론 삭제 구동하는 것을 일례로 설명하였다.
초기화 시간은 삭제 시간 이후 어드레싱 시간까지 되돌아 오는 긴 텀으로 인한 노드의 변화 문제(기생 성분 등에 의한 문제)를 미연에 방지하고자 삽입된 시 간이므로 이는 생략 가능하다. 그러므로, 제B스캔라인(SNB)을 통해 공급된 제B-2스캔신호(Erase)만 이용하여 서브 픽셀을 삭제 구동할 수도 있음은 물론이다. 즉, 초기화 시간은 생략하고 삭제 시간만 사용할 수 있다. 아울러, 도 11에 도시된 구동 파형은 하나의 예시일 뿐 목적 및 효과 등에 따라 이와 다른 형태로 구동 파형을 정립할 수도 있다.
한편, 본 발명의 제1 내지 제4실시예는 디지털 구동시 오차 발생 요인을 제거(또는 방지)하여 구동의 정확도를 높일 수 있는 삭제 시간을 용이하게 적용할 수 있는 서브 픽셀을 이용한다. 이로 인하여, 본 발명은 AWD 구동 방식은 물론 어드레싱 시간과 발광 시간이 분리된 ADS(Address Display Separation) 구동 방식에도 적용 가능하다.
한편, 본 발명의 제1 내지 제4실시예는 서브프레임이 최하위 비트(LSB)부터 최상위 비트(MSB)까지 순차적으로 배치된 것을 일례로 하였다. 그러나, 이는 하나의 예시일 뿐, 서브프레임은 광중심을 다양한 형태로 구성하기 위해 최하위 비트(LSB)부터 최상위 비트(MSB)까지 랜덤하게 배치될 수도 있다. 또한, 본 발명의 제1 내지 제4실시예는 한 프레임 내에 서브프레임이 5개로 구성된 것을 일례로 하였다. 그러나, 이는 하나의 예시일 뿐, 서브프레임의 개수는 4개, 6개, 8개 등 다양한 개수로 구성될 수 있다.
이상 본 발명은 서브프레임에 대한 서브 픽셀의 실제 휘도를 결정하는 전압이 달라지는 오차 발생 요인으로 인하여 화질 편차가 유발되는 문제를 개선할 수 있는 효과가 있다. 또한, 본 발명은 적은 개수의 소자로 오차 발생 요인을 제거(또는 방지)하여 구동의 정확도를 높이고 표시품질을 향상할 수 있는 효과가 있다.
이상 첨부된 도면을 참조하여 본 발명의 실시예를 설명하였지만, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술 분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시 예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 한다. 아울러, 본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어진다. 또한, 특허청구범위의 의미 및 범위 그리고 그 등가 개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
110: 영상 처리부 120: 타이밍 제어부
130: 데이터 구동부 140: 스캔 구동부
150: 표시 패널 SF1 ~ SF5: 서브프레임들
Erase: 삭제 시간 T1: 제1트랜지스터
T2: 제2트랜지스터 Cst: 커패시터
DT: 구동 트랜지스터 OLED: 유기 발광다이오드

Claims (10)

  1. 서브 픽셀을 갖는 표시 패널;
    상기 표시 패널에 스캔신호를 공급하는 스캔 구동부; 및
    상기 표시 패널에 서브프레임 단위로 배열된 데이터신호를 공급하는 데이터 구동부를 포함하며,
    상기 데이터 구동부는 서브프레임마다 상기 서브 픽셀에 데이터신호를 전달하는 어드레싱 시간, 상기 서브 픽셀을 발광하는 발광 시간 및 상기 서브 픽셀에 저장된 데이터전압을 삭제하는 삭제 시간이 포함되도록 상기 데이터신호를 구성하며,
    상기 삭제 시간은 상기 서브 픽셀의 발광 시간을 제어하는 제1노드와 제2노드가 쇼트됨에 따라 발생하고,
    상기 서브 픽셀은
    상기 제1노드와 상기 제2노드를 초기화하는 초기화 시간과 상기 서브 픽셀의 커패시터에 저장된 데이터전압을 삭제하기 위한 상기 삭제 시간이 구분되어 발생하는 것을 특징으로 하는 유기전계발광표시장치.
  2. 삭제
  3. 제1항에 있어서,
    상기 삭제 시간은
    프레임마다 데이터라인과 구동 트랜지스터의 게이트전극의 노드를 쇼트하여 커패시터에 저장된 데이터전압을 삭제하는 것을 특징으로 하는 유기전계발광표시장치.
  4. 제3항에 있어서,
    상기 서브 픽셀은
    제A스캔라인에 게이트전극이 연결되고 제1데이터라인에 제1전극이 연결되고 상기 커패시터의 일단에 제2전극이 연결된 제1트랜지스터와, 제B스캔라인에 게이트전극이 연결되고 상기 제1데이터라인에 제1전극이 연결되고 상기 커패시터의 타단에 제2전극이 연결된 제2트랜지스터와, 상기 제1트랜지스터의 제2전극에 일단이 연결되고 구동 트랜지스터의 게이트전극과 상기 제2트랜지스터의 제2전극에 타단이 연결된 상기 커패시터와, 상기 커패시터에 게이트전극이 연결되고 제1전원라인에 제1전극이 연결되고 유기 발광다이오드의 애노드전극에 제2전극이 연결된 상기 구동 트랜지스터와, 상기 구동 트랜지스터의 제2전극에 애노드전극이 연결되고 제2전원라인에 캐소드전극이 연결된 상기 유기 발광다이오드를 포함하는 유기전계발광표시장치.
  5. 제1항에 있어서,
    상기 삭제 시간은
    프레임마다 커패시터의 양단의 노드를 쇼트하여 상기 커패시터에 저장된 데이터전압을 삭제하는 것을 특징으로 하는 유기전계발광표시장치.
  6. 제5항에 있어서,
    상기 서브 픽셀은
    제A스캔라인에 게이트전극이 연결되고 제1데이터라인에 제1전극이 연결되고 상기 커패시터의 일단에 제2전극이 연결된 제1트랜지스터와, 제B스캔라인에 게이트전극이 연결되고 상기 커패시터의 일단에 제1전극이 연결되고 상기 커패시터의 타단에 제2전극이 연결된 제2트랜지스터와, 상기 제1트랜지스터의 제2전극 및 상기 제2트랜지스터의 제1전극에 일단이 연결되고 구동 트랜지스터의 게이트전극과 상기 제2트랜지스터의 제2전극에 타단이 연결된 상기 커패시터와, 상기 커패시터에 게이트전극이 연결되고 제1전원라인에 제1전극이 연결되고 유기 발광다이오드의 애노드전극에 제2전극이 연결된 상기 구동 트랜지스터와, 상기 구동 트랜지스터의 제2전극에 애노드전극이 연결되고 제2전원라인에 캐소드전극이 연결된 상기 유기 발광다이오드를 포함하는 유기전계발광표시장치.
  7. 제1항에 있어서,
    상기 삭제 시간은
    프레임마다 구동 트랜지스터의 게이트전극과 소오스전극 또는 드레인전극의 양단의 노드를 쇼트하여 커패시터에 저장된 데이터전압을 삭제하는 것을 특징으로 하는 유기전계발광표시장치.
  8. 제7항에 있어서,
    상기 서브 픽셀은
    제A스캔라인에 게이트전극이 연결되고 제1데이터라인에 제1전극이 연결되고 상기 커패시터의 일단에 제2전극이 연결된 제1트랜지스터와, 제B스캔라인에 게이트전극이 연결되고 상기 커패시터의 타단과 구동 트랜지스터의 게이트전극에 제1전극이 연결되고 상기 구동 트랜지스터의 제2전극에 제2전극이 연결된 제2트랜지스터와, 상기 제1트랜지스터의 제2전극 및 상기 제2트랜지스터의 제1전극에 일단이 연결되고 상기 구동 트랜지스터의 게이트전극과 상기 제2트랜지스터의 제2전극에 타단이 연결된 상기 커패시터와, 상기 커패시터에 게이트전극이 연결되고 제1전원라인에 제1전극이 연결되고 유기 발광다이오드의 애노드전극에 제2전극이 연결된 상기 구동 트랜지스터와, 상기 구동 트랜지스터의 제2전극에 애노드전극이 연결되고 제2전원라인에 캐소드전극이 연결된 상기 유기 발광다이오드를 포함하는 유기전계발광표시장치.
  9. 서브 픽셀에 연결된 제A스캔라인을 통해 제A스캔신호를 공급함과 더불어 상기 서브 픽셀에 데이터신호를 전달하고 상기 데이터신호를 데이터전압으로 저장하는 어드레싱 시간과,
    상기 데이터전압에 대응하여 빛을 발광하는 발광 시간과,
    상기 서브 픽셀에 연결된 제B스캔라인을 통해 제B스캔신호를 공급하고 상기 서브 픽셀에 저장된 데이터전압을 삭제하는 삭제 시간을 포함하며,
    상기 서브 픽셀은 서브프레임마다 상기 어드레싱 시간, 상기 발광 시간 및 상기 삭제 시간이 발생하고, 상기 삭제 시간은 상기 서브 픽셀의 발광 시간을 제어하는 제1노드와 제2노드가 쇼트됨에 따라 발생하고,
    상기 서브 픽셀은
    상기 제1노드와 상기 제2노드를 초기화하는 초기화 시간과 상기 서브 픽셀의 커패시터에 저장된 데이터전압을 삭제하기 위한 상기 삭제 시간이 구분되어 발생하는 것을 특징으로 하는 유기전계발광표시장치의 구동방법.
  10. 삭제
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