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KR0142150B1 - 붕소 질화물을 에칭하기 위한 방법 - Google Patents

붕소 질화물을 에칭하기 위한 방법

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KR0142150B1
KR0142150B1 KR1019940004533A KR19940004533A KR0142150B1 KR 0142150 B1 KR0142150 B1 KR 0142150B1 KR 1019940004533 A KR1019940004533 A KR 1019940004533A KR 19940004533 A KR19940004533 A KR 19940004533A KR 0142150 B1 KR0142150 B1 KR 0142150B1
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Abstract

본 발명은 실리콘, 탄소 또는 게르마늄과 같은 원소 주기율표의 IVA족의 원소로 붕소 질화물층을 도핑하는 단계를 포함하는 붕소 질화물의 에칭 방법을 제공한다. 붕소 질화물층이 도프된 후, 이것은 붕소 질화물을 도핑하기 전에 가능하지 않은 고온 인산, 플루오르화 수소산 또는 완충된 플루오르화 수소산으로 습식 에칭과 같은 기술로 에칭될 수 있다.

Description

붕소 질화물을 에칭하기 위한 방법
본 발명은 붕소 질화물을 에칭하기 위한 방법에 관한 것으로, 특히 붕소 질화물의 에칭률을 증가시키기 위한 방법에 관한 것이다. 이것은 예를 들면, 실리콘, 탄소 또는 게르마늄과 같은 IVA족의 원소로 붕소 질화물을 도프시킴으로써 달성된다.
반도체 디바이스 제조의 분야에 있어서, 도전층들을 분리시키기 위하여 통상적으로 절연층이 사용된다. 이러한 층간 절연막으로서 플라즈마 증강형 화학 진공 증착법(Plasma-Enhanced Chemical Vapor Deposition:PECVD)을 사용하여 인가된 실리콘 질화물층이 사용되어 왔다. 실리콘 질화물막은 습기 및 알칼리 금속 이온에 대한 높은 차단 효과 뿐만 아니라 우수한 절연 특성을 갖는다. 부가적으로, 실리콘 질화물 절연층은 공형특성(Conformal Step Coverage Characteristics) 및 높은 균열 저항 특성을 나타낸다. 1987년도 일본국 응용 물리학 저널 (Japanese Journal of Applied Physics) 26, 페이지 660-665의 엠. 마에다 (M. Maeda) 및 티. 마키노 (T. Makino)에 의해 기술된 내용을 참조하시오.
그러나, 실리콘 질화물 절연층에는 소정의 단점이 있다. 이러한 단점으로는 인 실리케이트 유리 (Phosphorous-Silicate Glass:PSG) 및 실리콘 이산화물 절연층에 비해 유전 상수가 높다는 것인데, 이것은 비교적 큰 기생 캐패시턴스 및 디바이스간의 비교적 긴 전파 지연 시간을 초래한다. 엠. 마에다(M. Maeda) 및 티. 마키노 (T. Makino)에 의해 기술된 상기 논문을 참조하시오.
따라서, 낮은 유전 상수, 공형특성, 우수한 절연 특성 및 높은 균열 저항을 갖는 다른 유전체 또는 절연막 물질에 대한 필요성이 계속 존재하여 왔다. 이러한 필요성에 대응하여, 대기 화학 진공 증착(CVD) 또는 PECVD에 의해 형성된 붕소질화물막이 고안되었다. 이들 붕소 질화물막은 높은 절연성을 띠고, 화학적으로 비활성 물질이며, 열적으로 안정하다. 또한, 이러한 막들은 낮은 유전 상수를 가진다.
그러나, 붕소 질화물막이 유용성을 가지기 위해서는 현재의 반도체 디바이스 제조 공정에 적합해야만 한다. 따라서, 이에 적합한 에칭 기술이 사용되어야만 한다.
습식 에칭 공정 (Wet Etching Process)은 반도체 디바이스 제조 공정에서 일반적으로 사용된다. 일반적인 습식 에칭제는 예를 들면, 불화 수소산 (Hydrofluoric Acid:HF), 완충된 불화 수소산 (Buffered Hydrofluoric Acid:BHF), 고온 인산 (Hot Phosphoric Acid)를 포함한다. 이들 에칭제는 붕소 질화물을 에칭할 수 없기 때문에, 현재의 반도체 디바이스 제조 공정은 붕소 질화물 절연층을 사용하기에 적합하지 않다.
따라서, 붕소 질화물이 반도체 디바이스의 제조에 사용되도록 종래의 에칭제를 사용하여 붕소 질화물을 에칭하는 방법이 필요하다. 붕소 질화물을 에칭할 수 있게 되면 붕소 질화물을 사용하여 그 물질의 양호한 절연층 특성을 이용할 수 있는 장점이 있다.
따라서, 본 발명의 목적은 붕소 질화물의 에칭 방법을 제공하기 위한 것이다. 이 방법은 현재의 반도체 제조 공정에 적합해야만 한다.
간단히 상술한 바와 같이, 본 발명은 붕소 질화물을 에칭하기 위한 방법을 포함한다. 이것은 원소 주기율표의 IVA족에서 선택된 원소로서 붕소 질화물층을 도프시킴으로써 달성된다. IVA족 원소는 실리콘, 탄소, 게르마늄, 주석 및 납을 포함한다. 각각의 이들 원소는 붕소 질화물과 유사한 구조를 갖고, 최종적으로 도프된 붕소 질화물은 동일한 육각형의 결합 구조를 유지하면서 약간 더 비정질로 된다. 붕소 질화물층이 도프된 후, 이것은 예를 들면 고온 인산과 같은 통상의 습식 에칭제를 사용하여 에칭될 수 있다.
도핑 레벨은 붕소 질화물의 에칭률을 제어하기 위하여 사용될 수 있다. 일반적으로, 약 20 %까지의 작은 양의 도펀트가 붕소 질화물 막의 물성을 손상시키지 않고 사용될 수 있다. 양호하게는 약 2 % 내지 약 10 % 범위의 도펀트가 사용된다.
따라서, 붕소 질화물의 도핑은 종래의 습식 에칭 기술을 사용하여 붕소 질화물을 에칭하기 위한 능력을 향상시킨다. 이것은 붕소 질화물을 반도체 디바이스에서 절연층으로 이용하여, 붕소 질화물의 절연 특성을 이용할 수 있는 장점을 가진다.
상술한 바와 같이, 본 발명의 넓은 개념은 붕소 질화물을 에칭하기 위한 방법에 관한 것이다. 붕소 질화물층은 실리콘, 탄소 또는 게르마늄과 같은 원소 주기율표의 IVA족에서 선택된 원소로 도프된다. 그 다음, 붕소 질화물의 도프된 층은 습식 에칭제 (약 165 ℃의 고온 인산, 불화 수소산 및 완충된 불화 수소산과 같은 질화물 에칭제)와 같은 적합한 에칭제를 사용하여 에칭된다. 일반적으로, 도펀트의 양은 원자 조성비 약 20 %, 양호하게는 원자 조성비 약 2 % 내지 약 10 % 까지의 범위일 수 있다. 도펀트의 낮은 농도는 절연층으로서 붕소 질화물의 특성에 역으로 영향을 미치지 않는다. 도펀트의 양은 붕소 질화물의 에칭률을 제어하기 위하여 변경될 수 있다.
한 실시예에 있어서, PECVD 붕소 질화물막은 다음과 같은 조건 하에서 적합한 반응기(reactor)에서 증착되고 도프된다.
AME 5000 반응기 시스템 (실란 가스 분배 차단기)
압력 : 4.4 Torrs
온도 : 400 ℃
전극 간격 : 1.0cm
전력 밀도 : 2.0 w/㎠
가스 흐름 속도 : 질소 2,000-20,000 sccm
B2H6(N2의 1%) 1,000 sccm
NH30-70 sccm
SiH4(SixBN에 대해) 1-5 sccm
균일성 (6 시그마) 5-10 %
증착률(nm/min) 100(BN에 대해)
100-140(SixBN에 대해)
굴절률 1.75-1.8(BN 및 SixBN에 대해)
상술한 바와 같이, 낮은 농도로 실리콘 도프된 (5 % atomic %) 붕소 질화물막을 형성하기 위하여 작은 양의 실란 (SiH₄)이 추가된다. 붕소 질화물막은 우수한 두께 균일성 및 수증기에 대한 안정성을 갖는다. X선 광전자 분광기(X-ray Photoelectron Spectroscopic: XPS ) 분석은 5 sccm의 흐름으로 증착된 막이 깊이 두께를 통해 균일하게 분포된 5 atomic %보다 작은 실리콘 함유량을 가짐을 보여준다. 1-4 sccm SiH₄로 증착된 막은 막 벌크에서 5 atomic % 보다 작은 실리콘 도핑함량을 가진다. 푸우리에 변환 적외선 (Fourier Transform Infrared : FTIR) 및 투과 전자 현미경 (Transmission Electron Microscopy : TEM) 분석은 저농도 실리콘 도핑으로 증착된 막이 계속 동일한 육각형의 결합 구조를 가질지라도 더 비정질로 되는 것을 나타낸다. 붕소 질화물 (BN) 및 저농도로 실리콘이 도프된 BN (SiBN) 막은 고온 인산 (165℃)으로 에칭되고, 저압 화학 진공 증착 (Low Pressure Chemical Vapor Deposition : LPCVD) 실리콘 질화물막은 기준으로 사용된다.
표1은 붕소 질화물, 저농도 실리콘 도프된 붕소 질화물 및 고온 인산으로 에칭된 LPCVD 실리콘 질화물막 에칭률 및 에칭 선택성을 나타낸다. 저 레벨 실란도핑 (2-5 sccm SiH₄, 즉 5 atomic % Si 함유량보다 적은)은 3배 이상의 크기로 에칭률을 향상시킴을 알 수 있다. 또한 에칭률은 LPCVD 실리콘 질화물보다 훨씬 더 크므로, 절연층으로서 붕소 질화물을 사용하는 것이 가능해진다.
저농도 실리콘 도프된 붕소 질화물의 향상된 에칭률은 BN에 비해 적게 도프된 SiXBN의 비정질 특성이 크기 때문이다. 저농도로 도프된 (5 atomic %) 상태에서, 건식 에칭 작용에서의 중요한 변화는 발견되지 않고, 육각형의 결합이 아직 존재하기 때문에 단지 BN 특성의 작은 변화가 발생한다.
도프된 BN이 동일한 육각형의 결합 구조를 유지하면서 약간 더 비정질로 되기 때문에, 반응 가스 (reactant gas)로서, CH₄ 또는 GeH₄을 사용하여 탄소 또는 게르마늄을 낮은 레벨로 도핑하면 붕소 질화물의 에칭률을 유사하게 향상시킬 수 잇다. 다른 IVA 족 원소를 사용하여도 유사한 결과가 얻어진다.
본 발명의 다른 실시예에 있어서, 불화 수소산 용액의 붕소 질화물의 에칭률은 표2에 도시한 바와 같이 실리콘 도핑의 증가에 따라 향상된다.
상술한 바와 같은 SixBN막의 화학 조성은 다음과 같다 (상대적인 atomic %):
또한, 본 발명의 원리는 ⅢA족 및 VA족 원소로 구성된 다른 화합물로 확장될 수 있다. 예를 들면, 붕소 인화물은 실리콘과 같은 IVA족 원소로 도프될 때에 붕소 질화물과 유사한 절연 및 에칭 특성을 나타낼 수 잇다.
본 발명은 양호한 실시예에 대해 상세히 설명되었지만, 본 분야에 숙련되 기술자들이라면 본 발명의 범위를 벗어나지 않고서 양호한 실시예를 여러 가지로 변형 및 변경시킬 수 있다. 그러므로, 본 발명은 첨부된 특허 청구의 범위에 의하여만 제한된다.

Claims (4)

  1. 인산 (phosphoric acid)으로 붕소 질화물(boron nitride)을 습식 에칭하는 방법에 있어서, 상기 붕소 질화물에 실리콘, 탄소 및 게르마늄으로 이루어진 원소군으로부터 선택된 원소를 원자 조성비 20% (20% by atomic composition) 까지 도핑시킴으로써 상기 붕소 질화물의 습식 에칭률을 향상시키는 방법.
  2. 붕소 질화물을 습식 에칭시키는 방법에 있어서, (a) 상기 붕소 질화물에 탄소, 실리콘 및 게르마늄으로 이루어진 원소군으로부터 선택된 원소를 원자 조성비 20% 까지 도핑시키는 단계, 및 (b) 상기 붕소 질화물을 인산에 노출시키는 단계를 포함하는 방법.
  3. 제1항에 있어서, 상기 인산이 약 165℃의 온도인 방법.
  4. 제1항에 있어서, 상기 붕소 질화물에 상기 원소를 원자 조성비 2% 내지 10%로 도핑하는방법.
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