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JPS6063609A - 数値制御装置 - Google Patents

数値制御装置

Info

Publication number
JPS6063609A
JPS6063609A JP17070983A JP17070983A JPS6063609A JP S6063609 A JPS6063609 A JP S6063609A JP 17070983 A JP17070983 A JP 17070983A JP 17070983 A JP17070983 A JP 17070983A JP S6063609 A JPS6063609 A JP S6063609A
Authority
JP
Japan
Prior art keywords
bus
data
processor
processors
sub
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP17070983A
Other languages
English (en)
Inventor
Mitsuo Kurakake
鞍掛　三津雄
Takashi Yamauchi
孝 山内
Jiro Kinoshita
次朗 木下
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fanuc Corp
Original Assignee
Fanuc Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fanuc Corp filed Critical Fanuc Corp
Priority to JP17070983A priority Critical patent/JPS6063609A/ja
Priority to PCT/JP1984/000444 priority patent/WO1985001365A1/ja
Priority to EP84903450A priority patent/EP0156921A1/en
Publication of JPS6063609A publication Critical patent/JPS6063609A/ja
Pending legal-status Critical Current

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    • G—PHYSICS
    • G05—CONTROLLING; REGULATING
    • G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
    • G05B19/00—Programme-control systems
    • G05B19/02—Programme-control systems electric
    • G05B19/18—Numerical control [NC], i.e. automatically operating machines, in particular machine tools, e.g. in a manufacturing environment, so as to execute positioning, movement or co-ordinated operations by means of programme data in numerical form
    • G05B19/414—Structure of the control system, e.g. common controller or multiprocessor systems, interface to servo, programmable interface controller
    • G05B19/4148—Structure of the control system, e.g. common controller or multiprocessor systems, interface to servo, programmable interface controller characterised by using several processors for different functions, distributed (real-time) systems
    • G—PHYSICS
    • G05—CONTROLLING; REGULATING
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    • G05B19/4141—Structure of the control system, e.g. common controller or multiprocessor systems, interface to servo, programmable interface controller characterised by a controller or microprocessor per axis
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    • G05B2219/30—Nc systems
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 発明の技術分野 本発明は、単一のメインプロセッサと６数のサブプロセ
ッサを備えた数値制御装置に関するものである。
従来技術と問題点 一般に数値制御装置は、制御対象群ごとに割当てられた
複数のサブプロセッサとこれら各サブプロセッサの連係
動作等を制御する単一のメインプロセッサを備えている
。従来、この種の数値制御装置では、メインプロセッサ
と各サブプロセッサ間のデータの授受のみが許容され、
各サブプロセッサ相互間の直接のデータ授受は許容され
ていなかった。即ち、各サブプロセッサは、メインプロ
セッサを介して間接的にデータ授受を行っていた。
しかしながら、このような従来装置では、サブプロセッ
サ相互間のデータ授受に時間がかかるため、制御速度や
精度が低下するという問題があった。例えば、各サブプ
ロセッサの制御対象であるモータ等を同期運転させる場
合、各サブプロセンサがモータの回転角度や速度に関す
るデータを相互に授受する必要があるが、このデータ授
受をメインプロセソザ経由で間接的に行っていたため時
間がかかり、制御速度や精度の低下を招くという問題が
あった。
発明の目的 本発明は上記従来の問題点に鑑みてなされたものであり
、その目的は２サブプロセッサ相互間の高速のデータ授
受を可能とする数値制御装置を提供することにある。
発明の構成 上記目的を達成する本発明は、メインプロセッサ及び各
サブプロセッサ間のデータ授受に加えて各ザブプロセッ
サ相互間に直接データの授受を許容する手段を備えるよ
うに構成されている。
以下９本発明の更に詳細を実施例によって説明する。
発明の実施例 図は本発明の一実施例の構成ブロック図であり、１０は
メインプロセッサ、２０．３０はそれぞれサブプロセッ
サ、４０はシステムハス、５０はバスアービタである。
メインプロセッサ１ｏ及び各サブプロセッサ２０．３０
のそれぞれにおいて、１１，２１．３１はＣＰ（Ｊ、１
２，２２．３２はＲＯＭ、１３．２３．３３はＲＡＭ、
１４．　２４．３４はパスバッファ、１５，２５．３５
はバスバッファ制御回路、１６，２６．３６は内部バス
、１７．２７．３７はバス切替え回路である。
各プロセッサ内のＣＰＵＩＩ、２１．３１は。
相手方のプロセッサのＲＡＭに対してデータの読取り又
は書込みを行う必要が生じると、それぞれパスバッファ
制御回路１５，２５．３５及びバス使用要求線５１．５
２．５３を介してバスアービタ５０にシステムハス４０
の使用要求を発する。
ハスアービタ５０ば、各プロセッサからの競合するシス
テムハス使用要求を所定の優先順位に従って処理し、バ
ス使用許可線５４，５５．５６を介して各パスバッファ
制御回路１５．２５．３５のうちいずれか１つにハス使
用許可を与える。このバス使用許可を受けたパスバッフ
ァ制御回路は自己のＣＰＵにその旨を通知すると共に、
自己のバスバッファを制御して内部ハスをシステムバス
４０に接続する。上記バス使用許可の通知を受けたプロ
セッサのＣＰＵは、システムバス４０及び相手方のハス
切替え回路を介して相手方のＲＡＭからデータを読取り
、又はこれにデータを書込む。
発明の詳細 な説明したように２本発明は、メインプロセッサ及び各
サブプロセッサ間のデータ授受に加えて各サブプロセッ
サ相互間に直接データの授受を許容する手段を備えるよ
うに構成されているので、ザブプロセッサ相互間で直接
高速のデータ授受が可能となり、制御速度や精度を向上
出来るという利点がある。
【図面の簡単な説明】
図は２本発明の一実施例の構成ブロック図である。 １０・・メインプロセッサ、２０．３０・・サブプロセ
ッサ、４０・・システムハス、５０・・ハスアービタで
ある。

Claims (1)

  1. 【特許請求の範囲】 単一のメインプロセッサと複数のサブプロセッサを備え
    た数値制御装置において。 メインプロセッサ及び各サブプロセッサ間並びに各サブ
    プロセッサ相互間に直接データの授受を許容する手段を
    備えたことを特徴とする数値制御装置。
JP17070983A 1983-09-16 1983-09-16 数値制御装置 Pending JPS6063609A (ja)

Priority Applications (3)

Application Number Priority Date Filing Date Title
JP17070983A JPS6063609A (ja) 1983-09-16 1983-09-16 数値制御装置
PCT/JP1984/000444 WO1985001365A1 (fr) 1983-09-16 1984-09-13 Dispositif de commande numerique
EP84903450A EP0156921A1 (en) 1983-09-16 1984-09-13 Numerical control apparatus

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP17070983A JPS6063609A (ja) 1983-09-16 1983-09-16 数値制御装置

Publications (1)

Publication Number Publication Date
JPS6063609A true JPS6063609A (ja) 1985-04-12

Family

ID=15909942

Family Applications (1)

Application Number Title Priority Date Filing Date
JP17070983A Pending JPS6063609A (ja) 1983-09-16 1983-09-16 数値制御装置

Country Status (3)

Country Link
EP (1) EP0156921A1 (ja)
JP (1) JPS6063609A (ja)
WO (1) WO1985001365A1 (ja)

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Also Published As

Publication number Publication date
WO1985001365A1 (fr) 1985-03-28
EP0156921A1 (en) 1985-10-09

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