JPH1063216A - エレクトロクロミック素子の駆動装置 - Google Patents
エレクトロクロミック素子の駆動装置Info
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- JPH1063216A JPH1063216A JP8241033A JP24103396A JPH1063216A JP H1063216 A JPH1063216 A JP H1063216A JP 8241033 A JP8241033 A JP 8241033A JP 24103396 A JP24103396 A JP 24103396A JP H1063216 A JPH1063216 A JP H1063216A
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Abstract
(57)【要約】
【課題】 低消費電力かつ高い応答性を有するＥＣＤの
駆動装置を実現する。 【解決手段】 ＥＣＤの駆動装置において、ＥＣＤの発
色状態に応じた電圧を得るための電圧検出回路３と、該
電圧検出回路３の出力と基準電圧Ｅ１とを比較するため
のヒステリシス特性を有する比較器５と、ＥＣＤを駆動
する駆動回路１とを設ける。ＥＣＤの電圧と基準電圧Ｅ
１との差が前記比較器５のヒステリシス電圧幅より小さ
い場合にはＥＣＤに電圧を印加せず、ＥＣＤの電圧と基
準電圧Ｅ１との差が前記ヒステリシス電圧幅より大きい
場合にはＥＣＤ素子を所望の発色状態に向けて駆動する
よう電圧を印加する。また、比較器５のヒステリシス電
圧幅以上の大きさを有する副基準電圧Ｅ２を設定し、基
準電圧を変化させた場合に迅速に応答可能とする。
駆動装置を実現する。 【解決手段】 ＥＣＤの駆動装置において、ＥＣＤの発
色状態に応じた電圧を得るための電圧検出回路３と、該
電圧検出回路３の出力と基準電圧Ｅ１とを比較するため
のヒステリシス特性を有する比較器５と、ＥＣＤを駆動
する駆動回路１とを設ける。ＥＣＤの電圧と基準電圧Ｅ
１との差が前記比較器５のヒステリシス電圧幅より小さ
い場合にはＥＣＤに電圧を印加せず、ＥＣＤの電圧と基
準電圧Ｅ１との差が前記ヒステリシス電圧幅より大きい
場合にはＥＣＤ素子を所望の発色状態に向けて駆動する
よう電圧を印加する。また、比較器５のヒステリシス電
圧幅以上の大きさを有する副基準電圧Ｅ２を設定し、基
準電圧を変化させた場合に迅速に応答可能とする。
Description
【０００１】
【発明の属する技術分野】本発明は、エレクトロクロミ
ック素子の駆動装置に関し、特にエレクトロクロミック
素子の記憶性を活用することにより消費電力を大幅に低
減することができるようにした駆動装置に関する。
ック素子の駆動装置に関し、特にエレクトロクロミック
素子の記憶性を活用することにより消費電力を大幅に低
減することができるようにした駆動装置に関する。
【０００２】
【従来の技術】従来、エレクトロクロミック素子（以
下、ＥＣＤと略す）を濃度階調性を持たせつつ駆動する
技術として、例えば特開昭６４−３１１３１号および特
開昭６４−３１１３２号に開示されたものが知られてい
る。
下、ＥＣＤと略す）を濃度階調性を持たせつつ駆動する
技術として、例えば特開昭６４−３１１３１号および特
開昭６４−３１１３２号に開示されたものが知られてい
る。
【０００３】これらの従来技術の方法では、ＥＣＤに電
圧を印加しない期間にＥＣＤの両端の電圧を検出し、検
出した電圧を基準電圧と比較してＥＣＤに印加する電圧
の方向を決定していた。この方法によれば、ＥＣＤ両端
の電圧がＥＣＤの発色濃度に対応することから、所望の
発色濃度に対応する基準電圧を設定し、ＥＣＤ両端の電
圧がこの基準電圧と等しくなるようにすることで、ＥＣ
Ｄを任意の所望の発色濃度に制御することが可能であっ
た。
圧を印加しない期間にＥＣＤの両端の電圧を検出し、検
出した電圧を基準電圧と比較してＥＣＤに印加する電圧
の方向を決定していた。この方法によれば、ＥＣＤ両端
の電圧がＥＣＤの発色濃度に対応することから、所望の
発色濃度に対応する基準電圧を設定し、ＥＣＤ両端の電
圧がこの基準電圧と等しくなるようにすることで、ＥＣ
Ｄを任意の所望の発色濃度に制御することが可能であっ
た。
【０００４】
【発明が解決しようとする課題】ところが、上述のよう
な従来の駆動方法では、ＥＣＤに電圧を印加しないでそ
の両端の電圧を検出している期間以外は、ＥＣＤには必
ず発色あるいは消色のいずれかの方向に電圧が印加され
ていた。このため、ＥＣＤ両端の電圧が基準電圧からわ
ずかにずれただけで、このずれを補う方向に常に電圧が
印加され、ＥＣＤにはほぼ継続的に電流が流れていた。
な従来の駆動方法では、ＥＣＤに電圧を印加しないでそ
の両端の電圧を検出している期間以外は、ＥＣＤには必
ず発色あるいは消色のいずれかの方向に電圧が印加され
ていた。このため、ＥＣＤ両端の電圧が基準電圧からわ
ずかにずれただけで、このずれを補う方向に常に電圧が
印加され、ＥＣＤにはほぼ継続的に電流が流れていた。
【０００５】このため、従来の方法では、電圧を印加し
なくても発色状態を保つというＥＣＤの記憶性を十分に
活用しておらず、しかもＥＣＤに継続的に電流が流れる
ため消費電力が大きくなるという不都合があった。
なくても発色状態を保つというＥＣＤの記憶性を十分に
活用しておらず、しかもＥＣＤに継続的に電流が流れる
ため消費電力が大きくなるという不都合があった。
【０００６】本発明は、上記従来技術における問題点に
鑑み、ＥＣＤの駆動装置において、ＥＣＤの記憶性を十
分に活用すると共に、少ない消費電力で所望の発色濃度
に駆動できるようにすることを目的とする。
鑑み、ＥＣＤの駆動装置において、ＥＣＤの記憶性を十
分に活用すると共に、少ない消費電力で所望の発色濃度
に駆動できるようにすることを目的とする。
【０００７】
【課題を解決するための手段】本発明の第１の態様に係
わるエレクトロクロミック素子の駆動装置においては、
前記エレクトロクロミック素子両端の電圧を検出する回
路と、前記エレクトロクロミック素子両端の電圧が所定
の発色状態に対応する基準電圧に対し予め定められた電
圧範囲内にあるか否かを判定する回路と、前記エレクト
ロクロミック素子両端の電圧が前記基準電圧に対し前記
予め定められた範囲内にない場合に前記エレクトロクロ
ミック素子に前記エレクトロクロミック素子両端の電圧
が前記基準電圧に向かう方向に駆動電圧を印加し、かつ
前記エレクトロクロミック素子両端電圧が前記基準電圧
に対し前記範囲内にある場合には前記エレクトロクロミ
ック素子に電圧を印加しないよう制御する駆動制御回路
とが設けられる。
わるエレクトロクロミック素子の駆動装置においては、
前記エレクトロクロミック素子両端の電圧を検出する回
路と、前記エレクトロクロミック素子両端の電圧が所定
の発色状態に対応する基準電圧に対し予め定められた電
圧範囲内にあるか否かを判定する回路と、前記エレクト
ロクロミック素子両端の電圧が前記基準電圧に対し前記
予め定められた範囲内にない場合に前記エレクトロクロ
ミック素子に前記エレクトロクロミック素子両端の電圧
が前記基準電圧に向かう方向に駆動電圧を印加し、かつ
前記エレクトロクロミック素子両端電圧が前記基準電圧
に対し前記範囲内にある場合には前記エレクトロクロミ
ック素子に電圧を印加しないよう制御する駆動制御回路
とが設けられる。
【０００８】このような構成に係わるＥＣＤの駆動装置
では、ＥＣＤ両端の電圧が基準電圧に対し所定範囲内に
なければＥＣＤに駆動電圧が印加されるが、ＥＣＤ両端
電圧が基準電圧に対し所定の範囲内にある場合には駆動
電圧は印加されない。したがって、ＥＣＤの駆動のため
の消費電力を大幅に低減できる。ＥＣＤは等価的には容
量と同様であり、記憶性を有している。したがって、駆
動電圧を印加しなくてもある程度長い時間、元の電圧を
維持することができる。但し実際にはＥＣＤのわずかな
リーク電流のためＥＣＤ両端の電圧は徐々に低下し、消
色していく。したがって、ＥＣＤ両端電圧が基準電圧に
対し前記所定の範囲内から外れた場合には再び駆動電圧
を印加すればよい。したがって、ＥＣＤに駆動電圧を印
加する時間は従来の方法と比較して大幅に短くすること
ができ、消費電力を大幅に低減できる。
では、ＥＣＤ両端の電圧が基準電圧に対し所定範囲内に
なければＥＣＤに駆動電圧が印加されるが、ＥＣＤ両端
電圧が基準電圧に対し所定の範囲内にある場合には駆動
電圧は印加されない。したがって、ＥＣＤの駆動のため
の消費電力を大幅に低減できる。ＥＣＤは等価的には容
量と同様であり、記憶性を有している。したがって、駆
動電圧を印加しなくてもある程度長い時間、元の電圧を
維持することができる。但し実際にはＥＣＤのわずかな
リーク電流のためＥＣＤ両端の電圧は徐々に低下し、消
色していく。したがって、ＥＣＤ両端電圧が基準電圧に
対し前記所定の範囲内から外れた場合には再び駆動電圧
を印加すればよい。したがって、ＥＣＤに駆動電圧を印
加する時間は従来の方法と比較して大幅に短くすること
ができ、消費電力を大幅に低減できる。
【０００９】この場合、前記予め定められた電圧範囲の
幅以上の大きさの副基準電圧を供給する回路を備え、前
記基準電圧を変更した時に前記基準電圧と前記エレクト
ロクロミック素子両端の電圧との差が該副基準電圧より
大きくなった場合に前記エレクトロクロミック素子に前
記エレクトロクロミック素子両端の電圧が前記基準電圧
に向かう方向に駆動電圧を印加すると好都合である。
幅以上の大きさの副基準電圧を供給する回路を備え、前
記基準電圧を変更した時に前記基準電圧と前記エレクト
ロクロミック素子両端の電圧との差が該副基準電圧より
大きくなった場合に前記エレクトロクロミック素子に前
記エレクトロクロミック素子両端の電圧が前記基準電圧
に向かう方向に駆動電圧を印加すると好都合である。
【００１０】すなわち、ＥＣＤの発色状態を変えるため
に基準電圧を変更した場合、ＥＣＤ両端の電圧を迅速に
変更された基準電圧に追従させることが必要である。こ
のため、基準電圧を変更したときに基準電圧とＥＣＤ両
端の電圧との差が前記副基準電圧より大きくなった場合
には、直ちに発色あるいは消色方向にＥＣＤに駆動電圧
を印加する。これによって、ＥＣＤ両端の電圧が新たな
基準電圧へと迅速に設定され速い応答性を得ることがで
きる。
に基準電圧を変更した場合、ＥＣＤ両端の電圧を迅速に
変更された基準電圧に追従させることが必要である。こ
のため、基準電圧を変更したときに基準電圧とＥＣＤ両
端の電圧との差が前記副基準電圧より大きくなった場合
には、直ちに発色あるいは消色方向にＥＣＤに駆動電圧
を印加する。これによって、ＥＣＤ両端の電圧が新たな
基準電圧へと迅速に設定され速い応答性を得ることがで
きる。
【００１１】本発明の第２の態様に係わるエレクトロク
ロミック素子の駆動装置においては、前記エレクトロク
ロミック素子の発色状態に応じた電圧を得るための電圧
検出回路と、エレクトロクロミック素子の所望の発色状
態に対応した基準電圧を設定する基準電圧設定回路と、
前記電圧検出回路の出力信号と前記基準電圧設定回路か
らの基準電圧とを比較するためのヒステリシス特性を有
する比較回路と、前記比較回路の出力に基づき、前記エ
レクトロクロミック素子の電圧と前記基準電圧との差が
前記比較回路によって決定されるヒステリシス電圧幅よ
り小さい場合には、前記エレクトロクロミック素子に電
圧を印加せず、前記エレクトロクロミック素子の電圧と
前記基準電圧との差が前記比較回路によって決定される
ヒステリシス電圧幅より大きい場合には前記エレクトロ
クロミック素子を所望の発色状態にする方向に電圧を印
加する駆動回路とが設けられる。
ロミック素子の駆動装置においては、前記エレクトロク
ロミック素子の発色状態に応じた電圧を得るための電圧
検出回路と、エレクトロクロミック素子の所望の発色状
態に対応した基準電圧を設定する基準電圧設定回路と、
前記電圧検出回路の出力信号と前記基準電圧設定回路か
らの基準電圧とを比較するためのヒステリシス特性を有
する比較回路と、前記比較回路の出力に基づき、前記エ
レクトロクロミック素子の電圧と前記基準電圧との差が
前記比較回路によって決定されるヒステリシス電圧幅よ
り小さい場合には、前記エレクトロクロミック素子に電
圧を印加せず、前記エレクトロクロミック素子の電圧と
前記基準電圧との差が前記比較回路によって決定される
ヒステリシス電圧幅より大きい場合には前記エレクトロ
クロミック素子を所望の発色状態にする方向に電圧を印
加する駆動回路とが設けられる。
【００１２】このような構成では、ＥＣＤを基準電圧に
相当する発色濃度に調整するために、前記電圧検出回路
によってＥＣＤの両端の電圧を検出する。そして、この
検出した電圧が基準電圧設定回路によって設定された基
準電圧に対し予め定められた範囲内にあるか否かを判定
するためにヒステリシス特性を有する比較回路を使用す
る。そして、ＥＣＤの電圧と基準電圧との差がヒステリ
シス電圧幅より小さい場合にはＥＣＤに電圧を印加せ
ず、ＥＣＤの電圧と基準電圧との差がヒステリシス電圧
幅より大きい場合にはＥＣＤを所望の発色状態に向けて
駆動するよう電圧を印加する。これによって、簡単な構
成でＥＣＤ両端の電圧が基準電圧に対し所定の範囲内に
あるか否かを判定することができる。そして、ＥＣＤの
電圧と基準電圧との差が前記ヒステリシス電圧幅の中に
ある場合には、ＥＣＤの記憶性を活かし電圧を印加しな
い状態、すなわち電気的に切り離された状態またはオフ
状態とすることができ、消費電力を大幅に低減できる。
相当する発色濃度に調整するために、前記電圧検出回路
によってＥＣＤの両端の電圧を検出する。そして、この
検出した電圧が基準電圧設定回路によって設定された基
準電圧に対し予め定められた範囲内にあるか否かを判定
するためにヒステリシス特性を有する比較回路を使用す
る。そして、ＥＣＤの電圧と基準電圧との差がヒステリ
シス電圧幅より小さい場合にはＥＣＤに電圧を印加せ
ず、ＥＣＤの電圧と基準電圧との差がヒステリシス電圧
幅より大きい場合にはＥＣＤを所望の発色状態に向けて
駆動するよう電圧を印加する。これによって、簡単な構
成でＥＣＤ両端の電圧が基準電圧に対し所定の範囲内に
あるか否かを判定することができる。そして、ＥＣＤの
電圧と基準電圧との差が前記ヒステリシス電圧幅の中に
ある場合には、ＥＣＤの記憶性を活かし電圧を印加しな
い状態、すなわち電気的に切り離された状態またはオフ
状態とすることができ、消費電力を大幅に低減できる。
【００１３】さらに、前記比較回路のヒステリシス電圧
幅以上の大きさを有する副基準電圧を供給する副基準電
圧発生回路と、前記エレクトロクロミック素子の電圧と
前記基準電圧との差を表す差電圧を出力する差電圧検出
回路と、前記差電圧と前記副基準電圧発生回路から供給
される副基準電圧とを比較し、前記基準電圧を変更した
時に前記差電圧が前記副基準電圧より大きくなれば前記
エレクトロクロミック素子に駆動電圧を印加して所望の
発色あるいは消色方向に制御するための第２の比較回路
とを設けることもできる。
幅以上の大きさを有する副基準電圧を供給する副基準電
圧発生回路と、前記エレクトロクロミック素子の電圧と
前記基準電圧との差を表す差電圧を出力する差電圧検出
回路と、前記差電圧と前記副基準電圧発生回路から供給
される副基準電圧とを比較し、前記基準電圧を変更した
時に前記差電圧が前記副基準電圧より大きくなれば前記
エレクトロクロミック素子に駆動電圧を印加して所望の
発色あるいは消色方向に制御するための第２の比較回路
とを設けることもできる。
【００１４】この場合も、ＥＣＤ両端の電圧と基準電圧
との差を表わす差電圧を検出し、この差電圧と前記副基
準電圧発生回路から供給される副基準電圧とを比較する
第２の比較回路を設ける。この第２の比較回路の出力に
基づき、例えば基準電圧が大きく変更された場合などに
はＥＣＤに直ちに駆動電圧が印加され、所望の発色ある
いは消色方向に迅速に駆動が行なわれる。
との差を表わす差電圧を検出し、この差電圧と前記副基
準電圧発生回路から供給される副基準電圧とを比較する
第２の比較回路を設ける。この第２の比較回路の出力に
基づき、例えば基準電圧が大きく変更された場合などに
はＥＣＤに直ちに駆動電圧が印加され、所望の発色ある
いは消色方向に迅速に駆動が行なわれる。
【００１５】また、前記駆動回路は、第１の電圧源と第
２の電圧源との間に直列接続された第１および第２のト
ランジスタと、前記第１の電圧源と前記第２の電圧源と
の間に直列接続された第３および第４のトランジスタと
を備え、前記エレクトロクロミック素子は前記第１およ
び第２のトランジスタの接続点と前記第３および第４の
トランジスタの接続点との間に接続され、前記エレクト
ロクロミック素子に駆動電圧を印加する場合は、前記第
２および第３のトランジスタを共にオフ状態、前記第１
および第４のトランジスタを共にオン状態として前記エ
レクトロクロミック素子に第１の方向で電圧を印加し、
または前記第１および第４のトランジスタを共にオフと
し前記第２および第３のトランジスタを共にオンとして
前記エレクトロクロミック素子に第２の方向で電圧を印
加し、かつ前記エレクトロクロミック素子に駆動電圧を
印加しない場合は、前記第１、第２、第３および第４の
トランジスタをすべてオフとすることにより前記エレク
トロクロミック素子を他の回路から電気的に切り離すよ
う構成することができる。
２の電圧源との間に直列接続された第１および第２のト
ランジスタと、前記第１の電圧源と前記第２の電圧源と
の間に直列接続された第３および第４のトランジスタと
を備え、前記エレクトロクロミック素子は前記第１およ
び第２のトランジスタの接続点と前記第３および第４の
トランジスタの接続点との間に接続され、前記エレクト
ロクロミック素子に駆動電圧を印加する場合は、前記第
２および第３のトランジスタを共にオフ状態、前記第１
および第４のトランジスタを共にオン状態として前記エ
レクトロクロミック素子に第１の方向で電圧を印加し、
または前記第１および第４のトランジスタを共にオフと
し前記第２および第３のトランジスタを共にオンとして
前記エレクトロクロミック素子に第２の方向で電圧を印
加し、かつ前記エレクトロクロミック素子に駆動電圧を
印加しない場合は、前記第１、第２、第３および第４の
トランジスタをすべてオフとすることにより前記エレク
トロクロミック素子を他の回路から電気的に切り離すよ
う構成することができる。
【００１６】このような構成では、前記第１〜第４のト
ランジスタをブリッジ構造に接続し、第１および第４の
トランジスタを共にオン状態とすればＥＣＤに第１の方
向で電圧を印加することができ、また第２および第３の
トランジスタを共にオンとすればＥＣＤに前記第１の方
向とは逆の第２の方向で電圧を印加することができる。
また、前記第１〜第４のトランジスタ全てをオフとする
ことによりＥＣＤを他の回路から電気的に完全に切り離
すことができる。したがって、簡単な回路構成で的確に
ＥＣＤの駆動および切り離しを行なうことが可能にな
る。
ランジスタをブリッジ構造に接続し、第１および第４の
トランジスタを共にオン状態とすればＥＣＤに第１の方
向で電圧を印加することができ、また第２および第３の
トランジスタを共にオンとすればＥＣＤに前記第１の方
向とは逆の第２の方向で電圧を印加することができる。
また、前記第１〜第４のトランジスタ全てをオフとする
ことによりＥＣＤを他の回路から電気的に完全に切り離
すことができる。したがって、簡単な回路構成で的確に
ＥＣＤの駆動および切り離しを行なうことが可能にな
る。
【００１７】また、以上のようなＥＣＤの駆動装置にお
いて、ＥＣＤ両端の電圧、すなわちＥＣＤの発色状態に
対応する電圧をＥＣＤに電圧を印加しないときに検出す
ると好都合である。このような構成によって駆動回路に
よる影響を受けることなくＥＣＤ両端の電圧を適切に検
出し、ＥＣＤの発色状態を正確に検知することが可能に
なる。
いて、ＥＣＤ両端の電圧、すなわちＥＣＤの発色状態に
対応する電圧をＥＣＤに電圧を印加しないときに検出す
ると好都合である。このような構成によって駆動回路に
よる影響を受けることなくＥＣＤ両端の電圧を適切に検
出し、ＥＣＤの発色状態を正確に検知することが可能に
なる。
【００１８】
【発明の実施の形態】以下、図面を参照して本発明に係
わるＥＣＤの駆動装置につき説明する。図１は、本発明
の一実施形態に係わるＥＣＤの駆動装置全体の構成を示
す。同図の駆動装置は、ＥＣＤ（Ｄ１）を駆動するため
のトランジスタＱ１，Ｑ２，Ｑ３，Ｑ４からなるブリッ
ジ型駆動回路１と、差電圧検出器３と、ヒステリシス特
性付き比較器５と、第２の差電圧検出器７と、第２の比
較器９と、駆動パルス発生器１１と、クロック発生器１
３と、基準電圧源１５と、副基準電圧源１７とを具備す
る。
わるＥＣＤの駆動装置につき説明する。図１は、本発明
の一実施形態に係わるＥＣＤの駆動装置全体の構成を示
す。同図の駆動装置は、ＥＣＤ（Ｄ１）を駆動するため
のトランジスタＱ１，Ｑ２，Ｑ３，Ｑ４からなるブリッ
ジ型駆動回路１と、差電圧検出器３と、ヒステリシス特
性付き比較器５と、第２の差電圧検出器７と、第２の比
較器９と、駆動パルス発生器１１と、クロック発生器１
３と、基準電圧源１５と、副基準電圧源１７とを具備す
る。
【００１９】駆動回路１は、電源Ｖｃｃと他の電源、例
えばグラウンド、との間に直列接続されたＰＮＰ型の第
１のトランジスタＱ１と、ＮＰＮ型の第２のトランジス
タＱ２を備えており、さらに電源Ｖｃｃとグラウンド間
に接続されたＰＮＰ型の第３のトランジスタＱ３とＮＰ
Ｎ型の第４のトランジスタＱ４とを備えている。第１の
トランジスタのエミッタおよび第３のトランジスタのエ
ミッタは共に電源Ｖｃｃに接続され、第２のトランジス
タＱ２のエミッタおよび第４のトランジスタのエミッタ
は共にグラウンドに接続されている。
えばグラウンド、との間に直列接続されたＰＮＰ型の第
１のトランジスタＱ１と、ＮＰＮ型の第２のトランジス
タＱ２を備えており、さらに電源Ｖｃｃとグラウンド間
に接続されたＰＮＰ型の第３のトランジスタＱ３とＮＰ
Ｎ型の第４のトランジスタＱ４とを備えている。第１の
トランジスタのエミッタおよび第３のトランジスタのエ
ミッタは共に電源Ｖｃｃに接続され、第２のトランジス
タＱ２のエミッタおよび第４のトランジスタのエミッタ
は共にグラウンドに接続されている。
【００２０】第１のトランジスタのコレクタと第２のト
ランジスタＱ２のコレクタとはいっしょに接続されて
（ノードＮ１）ＥＣＤの一方の端子に接続されている。
第３のトランジスタＱ３のコレクタと第４のトランジス
タＱ４のコレクタとはいっしょに接続されて（ノードＮ
２）ＥＣＤの他方の端子に接続されている。各トランジ
スタＱ１，Ｑ２，Ｑ３，Ｑ４のベースには駆動パルス発
生器１１から後に説明するように必要な駆動電圧が印加
される。
ランジスタＱ２のコレクタとはいっしょに接続されて
（ノードＮ１）ＥＣＤの一方の端子に接続されている。
第３のトランジスタＱ３のコレクタと第４のトランジス
タＱ４のコレクタとはいっしょに接続されて（ノードＮ
２）ＥＣＤの他方の端子に接続されている。各トランジ
スタＱ１，Ｑ２，Ｑ３，Ｑ４のベースには駆動パルス発
生器１１から後に説明するように必要な駆動電圧が印加
される。
【００２１】差電圧検出器３は演算増幅器Ｕ１および抵
抗Ｒ１，Ｒ２，Ｒ３，Ｒ４によって構成される。演算増
幅器Ｕ１の非反転入力端子は前記駆動回路１の第１の出
力端子Ｎ１から抵抗Ｒ３を介して接続され、反転入力端
子は前記駆動回路１の第２の出力端子Ｎ２から抵抗Ｒ１
を介して接続されている。抵抗Ｒ２は演算増幅器Ｕ１の
出力と反転入力端子との間に接続されている。抵抗Ｒ４
は演算増幅器Ｕ１の非反転入力端子とグラウンド間に接
続されている。このような構成により、差電圧検出器３
は駆動回路１の両出力端子Ｎ１，Ｎ２間の電圧、すなわ
ちＥＣＤ両端の電圧の差に応じた信号を出力する。
抗Ｒ１，Ｒ２，Ｒ３，Ｒ４によって構成される。演算増
幅器Ｕ１の非反転入力端子は前記駆動回路１の第１の出
力端子Ｎ１から抵抗Ｒ３を介して接続され、反転入力端
子は前記駆動回路１の第２の出力端子Ｎ２から抵抗Ｒ１
を介して接続されている。抵抗Ｒ２は演算増幅器Ｕ１の
出力と反転入力端子との間に接続されている。抵抗Ｒ４
は演算増幅器Ｕ１の非反転入力端子とグラウンド間に接
続されている。このような構成により、差電圧検出器３
は駆動回路１の両出力端子Ｎ１，Ｎ２間の電圧、すなわ
ちＥＣＤ両端の電圧の差に応じた信号を出力する。
【００２２】ヒステリシス特性付き比較器５は、演算増
幅器Ｕ２と抵抗Ｒ５，Ｒ６を備えている。演算増幅器Ｕ
２の非反転入力端子は抵抗Ｒ５を介して基準電圧源（Ｅ
１）１５に接続されている。演算増幅器Ｕ２の非反転入
力端子と出力との間には抵抗Ｒ６が接続されている。こ
のようなヒステリシス特性付き比較器５は、抵抗Ｒ５，
Ｒ６の値によって定められる所定のヒステリシス電圧幅
を有している。ヒステリシス特性付き比較器５の反転入
力は前記差電圧検出器３の出力に接続され、出力は駆動
パルス発生器１１に供給される。
幅器Ｕ２と抵抗Ｒ５，Ｒ６を備えている。演算増幅器Ｕ
２の非反転入力端子は抵抗Ｒ５を介して基準電圧源（Ｅ
１）１５に接続されている。演算増幅器Ｕ２の非反転入
力端子と出力との間には抵抗Ｒ６が接続されている。こ
のようなヒステリシス特性付き比較器５は、抵抗Ｒ５，
Ｒ６の値によって定められる所定のヒステリシス電圧幅
を有している。ヒステリシス特性付き比較器５の反転入
力は前記差電圧検出器３の出力に接続され、出力は駆動
パルス発生器１１に供給される。
【００２３】次に、差電圧検出器７は、演算増幅器Ｕ３
と抵抗Ｒ７，Ｒ８，Ｒ９，Ｒ１０とを備えている。演算
増幅器Ｕ３の非反転入力は抵抗Ｒ９を介して前記差電圧
検出器３の出力接続されかつ抵抗Ｒ１０を介してグラウ
ンドに接続されている。演算増幅器Ｕ３の反転入力は抵
抗Ｒ７を介して前記基準電圧源１５に接続されかつ抵抗
Ｒ８を介して該演算増幅器Ｕ３の出力に接続されてい
る。このような差電圧検出器７は、前記差電圧検出器３
の出力と基準電圧源１５から供給される基準電圧Ｅ１と
の差に対応する出力電圧を生成する。
と抵抗Ｒ７，Ｒ８，Ｒ９，Ｒ１０とを備えている。演算
増幅器Ｕ３の非反転入力は抵抗Ｒ９を介して前記差電圧
検出器３の出力接続されかつ抵抗Ｒ１０を介してグラウ
ンドに接続されている。演算増幅器Ｕ３の反転入力は抵
抗Ｒ７を介して前記基準電圧源１５に接続されかつ抵抗
Ｒ８を介して該演算増幅器Ｕ３の出力に接続されてい
る。このような差電圧検出器７は、前記差電圧検出器３
の出力と基準電圧源１５から供給される基準電圧Ｅ１と
の差に対応する出力電圧を生成する。
【００２４】比較器９は、比較器ユニットＵ４で構成さ
れている。比較器ユニットＵ４の反転入力は前記差電圧
検出器７の出力に接続され、非反転入力には副基準電圧
源（Ｅ２）１７からの副基準電圧が供給される。比較器
ユニットＵ４の出力は駆動パルス発生器１１に供給され
る。
れている。比較器ユニットＵ４の反転入力は前記差電圧
検出器７の出力に接続され、非反転入力には副基準電圧
源（Ｅ２）１７からの副基準電圧が供給される。比較器
ユニットＵ４の出力は駆動パルス発生器１１に供給され
る。
【００２５】駆動パルス発生器１１はクロック発生器１
３からのクロック信号に基づきかつヒステリシス特性付
き比較器５および比較器９の出力に基づき駆動パルスを
生成して前記駆動回路１の各トランジスタに供給する。
３からのクロック信号に基づきかつヒステリシス特性付
き比較器５および比較器９の出力に基づき駆動パルスを
生成して前記駆動回路１の各トランジスタに供給する。
【００２６】なお、ＥＣＤを駆動するためには、例えば
図２に示されるように、正電圧電源Ｅｐと負電圧電源Ｅ
ｎの出力電圧をスイッチＳ１によって切り換えてＥＣＤ
に供給する方法がある。この方法では、スイッチＳ１を
切り換えることでＥＣＤを発色状態または消色状態へと
駆動することができる。
図２に示されるように、正電圧電源Ｅｐと負電圧電源Ｅ
ｎの出力電圧をスイッチＳ１によって切り換えてＥＣＤ
に供給する方法がある。この方法では、スイッチＳ１を
切り換えることでＥＣＤを発色状態または消色状態へと
駆動することができる。
【００２７】あるいは、図３に示すように、図２のスイ
ッチＳ１の代わりにＰＮＰトランジスタＴ１とＮＰＮト
ランジスタＴ２を組合わせた回路を使用することもでき
る。この回路ではトランジスタＴ１またはＴ２をオンと
することによりそれぞれ例えば発色状態または消色状態
へとＥＣＤを駆動することができる。
ッチＳ１の代わりにＰＮＰトランジスタＴ１とＮＰＮト
ランジスタＴ２を組合わせた回路を使用することもでき
る。この回路ではトランジスタＴ１またはＴ２をオンと
することによりそれぞれ例えば発色状態または消色状態
へとＥＣＤを駆動することができる。
【００２８】図１に示す実施形態では、ＥＣＤの駆動回
路としてＰＮＰトランジスタとＮＰＮトランジスタを組
合わせたブリッジ型の回路構成を使用している。もちろ
ん、駆動方法としては他の方法でもよく、ＥＣＤに第１
の方向および第２の方向で駆動電圧を印加できるもので
あれば他の回路形式のものを使用することもできる。
路としてＰＮＰトランジスタとＮＰＮトランジスタを組
合わせたブリッジ型の回路構成を使用している。もちろ
ん、駆動方法としては他の方法でもよく、ＥＣＤに第１
の方向および第２の方向で駆動電圧を印加できるもので
あれば他の回路形式のものを使用することもできる。
【００２９】次に、図１の駆動装置の動作を詳細に説明
する。図１において、駆動回路１は、トランジスタＱ１
〜Ｑ４のオン・オフの組合わせにより多くの動作モード
をとることができるが、本発明では以下の３つの動作モ
ードを使用する。 （１）トランジスタＱ１，Ｑ４がオンでありかつトラン
ジスタＱ２，Ｑ３がオフの場合。この場合はＥＣＤには
図面中に実線で示すように左から右へと電流が流れる。 （２）トランジスタＱ２，Ｑ３がオンでありかつトラン
ジスタＱ１，Ｑ４がオフの場合。この場合は、ＥＣＤに
は図面中に破線で示すように右から左へ電流が流れる。
前記（１）の方向が発色方向とすれば（２）の方向は消
色方向となる。 （３）トランジスタＱ１〜Ｑ４が全てオフの場合。この
場合は、ＥＣＤは駆動回路から電気的に切り離され、Ｅ
ＣＤの記憶性によりオフ状態になる直前の状態、すなわ
ち発色あるいは消色状態、を保持する。
する。図１において、駆動回路１は、トランジスタＱ１
〜Ｑ４のオン・オフの組合わせにより多くの動作モード
をとることができるが、本発明では以下の３つの動作モ
ードを使用する。 （１）トランジスタＱ１，Ｑ４がオンでありかつトラン
ジスタＱ２，Ｑ３がオフの場合。この場合はＥＣＤには
図面中に実線で示すように左から右へと電流が流れる。 （２）トランジスタＱ２，Ｑ３がオンでありかつトラン
ジスタＱ１，Ｑ４がオフの場合。この場合は、ＥＣＤに
は図面中に破線で示すように右から左へ電流が流れる。
前記（１）の方向が発色方向とすれば（２）の方向は消
色方向となる。 （３）トランジスタＱ１〜Ｑ４が全てオフの場合。この
場合は、ＥＣＤは駆動回路から電気的に切り離され、Ｅ
ＣＤの記憶性によりオフ状態になる直前の状態、すなわ
ち発色あるいは消色状態、を保持する。
【００３０】このような各動作モードの内、上記（３）
のオフ状態の期間（以下、オフ期間という）を一定時間
間隔ごとに設け、この期間内にＥＣＤ両端の電圧をサン
プリングして検出する。
のオフ状態の期間（以下、オフ期間という）を一定時間
間隔ごとに設け、この期間内にＥＣＤ両端の電圧をサン
プリングして検出する。
【００３１】サンプリングの回数は、例えば、毎秒５０
回〜２０００回が実用的で、その中でも毎秒２００回〜
１０００回が視覚的に安定した発色状態を維持する上で
最適である。
回〜２０００回が実用的で、その中でも毎秒２００回〜
１０００回が視覚的に安定した発色状態を維持する上で
最適である。
【００３２】図４は、駆動パルス発生器１１において駆
動回路の各スイッチングトランジスタＱ１〜Ｑ４に供給
される駆動パルスを生成するための元になる制御パルス
ＤＰ１、およびＥＣＤの両端電圧を取り込むための制御
パルスＤＰ２の一例を示す。すなわち、駆動回路１の各
スイッチングトランジスタＱ１〜Ｑ４のベースに供給さ
れる各駆動パルスは前記制御パルスＤＰ１に基づき生成
される。制御パルスＤＰ１がハイレベルであるｔ１期間
中は、ＥＣＤに駆動電圧を供給する必要があれば、各ス
イッチングトランジスタＱ１〜Ｑ４のベースに所定のレ
ベルの電圧を加えてこれらのトランジスタの内必要なも
のをオンとすることができる。例えば、トランジスタＱ
１，Ｑ４をオン、トランジスタＱ２，Ｑ３をオフにして
ＥＣＤに実線で示す方向、すなわち左から右方向に電流
を流す場合は、トランジスタＱ１，Ｑ２のベースにはロ
ーレベルの駆動パルスを、トランジスタＱ３，Ｑ４のベ
ースにはハイレベルの駆動パルスを供給する。制御パル
スＤＰ１の期間ｔ２の間は、ＥＣＤはオフ状態とされこ
のｔ２期間中にＥＣＤ両端の電圧が差電圧検出器３によ
って検出され、ＥＣＤ両端電圧の差に対応する電圧が比
較器５などによって比較される。したがってｔ２期間中
は、駆動回路１のスイッチングトランジスタＱ１〜Ｑ４
は全てカットオフとされる。
動回路の各スイッチングトランジスタＱ１〜Ｑ４に供給
される駆動パルスを生成するための元になる制御パルス
ＤＰ１、およびＥＣＤの両端電圧を取り込むための制御
パルスＤＰ２の一例を示す。すなわち、駆動回路１の各
スイッチングトランジスタＱ１〜Ｑ４のベースに供給さ
れる各駆動パルスは前記制御パルスＤＰ１に基づき生成
される。制御パルスＤＰ１がハイレベルであるｔ１期間
中は、ＥＣＤに駆動電圧を供給する必要があれば、各ス
イッチングトランジスタＱ１〜Ｑ４のベースに所定のレ
ベルの電圧を加えてこれらのトランジスタの内必要なも
のをオンとすることができる。例えば、トランジスタＱ
１，Ｑ４をオン、トランジスタＱ２，Ｑ３をオフにして
ＥＣＤに実線で示す方向、すなわち左から右方向に電流
を流す場合は、トランジスタＱ１，Ｑ２のベースにはロ
ーレベルの駆動パルスを、トランジスタＱ３，Ｑ４のベ
ースにはハイレベルの駆動パルスを供給する。制御パル
スＤＰ１の期間ｔ２の間は、ＥＣＤはオフ状態とされこ
のｔ２期間中にＥＣＤ両端の電圧が差電圧検出器３によ
って検出され、ＥＣＤ両端電圧の差に対応する電圧が比
較器５などによって比較される。したがってｔ２期間中
は、駆動回路１のスイッチングトランジスタＱ１〜Ｑ４
は全てカットオフとされる。
【００３３】制御パルスＤＰ１のｔ２期間中に、ＥＣＤ
の両端の電圧の差に対応する電圧が差電圧検出器３によ
って出力されヒステリシス特性付き比較器５および第２
の差電圧検出器７に供給される。ヒステリシス特性付き
比較器５においては、この差に対応する電圧が基準電圧
源１５から供給される基準電圧Ｅ１と比較される。ヒス
テリシス特性付き比較器５は前記差電圧が基準電圧Ｅ１
から所定のヒステリシス電圧幅を超えて外れている場合
には、駆動パルス発生器１１に所定の論理レベルの出力
信号を与える。駆動パルス発生器１１は前記制御パルス
ＤＰ２の立上りの部分でヒステリシス特性付き比較器５
の出力電圧を取り込み、必要な駆動パルスを生成して駆
動回路１のスイッチングトランジスタに供給する。これ
によって、制御パルスＤＰ１のｔ１期間中のＥＣＤの発
色または消色状態への制御が行なわれる。また、ヒステ
リシス特性付き比較器５において、前記差電圧検出器３
からの差電圧が基準電圧Ｅ１からヒステリシス電圧幅以
内の値である場合には、駆動パルス発生器１１は制御パ
ルスｔ２の期間中に取り込んだ比較器５の出力に基づき
制御パルスＤＰ１のｔ１期間中においてＥＣＤをオフ状
態となるよう制御する。
の両端の電圧の差に対応する電圧が差電圧検出器３によ
って出力されヒステリシス特性付き比較器５および第２
の差電圧検出器７に供給される。ヒステリシス特性付き
比較器５においては、この差に対応する電圧が基準電圧
源１５から供給される基準電圧Ｅ１と比較される。ヒス
テリシス特性付き比較器５は前記差電圧が基準電圧Ｅ１
から所定のヒステリシス電圧幅を超えて外れている場合
には、駆動パルス発生器１１に所定の論理レベルの出力
信号を与える。駆動パルス発生器１１は前記制御パルス
ＤＰ２の立上りの部分でヒステリシス特性付き比較器５
の出力電圧を取り込み、必要な駆動パルスを生成して駆
動回路１のスイッチングトランジスタに供給する。これ
によって、制御パルスＤＰ１のｔ１期間中のＥＣＤの発
色または消色状態への制御が行なわれる。また、ヒステ
リシス特性付き比較器５において、前記差電圧検出器３
からの差電圧が基準電圧Ｅ１からヒステリシス電圧幅以
内の値である場合には、駆動パルス発生器１１は制御パ
ルスｔ２の期間中に取り込んだ比較器５の出力に基づき
制御パルスＤＰ１のｔ１期間中においてＥＣＤをオフ状
態となるよう制御する。
【００３４】前記差電圧検出器３の差電圧出力は第２の
差電圧検出器７にも入力され、前記基準電圧Ｅ１との差
に対応する電圧が得られる。この差電圧検出器７の出力
は第２の比較器９に供給され、副基準電圧源１７から供
給される副基準電圧Ｅ２と比較される。そして差電圧検
出器７の出力電圧が副基準電圧Ｅ２より大きければ比較
器９は例えばローレベルの制御信号を出力し駆動パルス
発生器１１に供給する。駆動パルス発生器１１は、これ
に応じて駆動回路１の所定のトランジスタに駆動パルス
を供給しＥＣＤを直ちに発色あるいは消色方向に駆動す
る。
差電圧検出器７にも入力され、前記基準電圧Ｅ１との差
に対応する電圧が得られる。この差電圧検出器７の出力
は第２の比較器９に供給され、副基準電圧源１７から供
給される副基準電圧Ｅ２と比較される。そして差電圧検
出器７の出力電圧が副基準電圧Ｅ２より大きければ比較
器９は例えばローレベルの制御信号を出力し駆動パルス
発生器１１に供給する。駆動パルス発生器１１は、これ
に応じて駆動回路１の所定のトランジスタに駆動パルス
を供給しＥＣＤを直ちに発色あるいは消色方向に駆動す
る。
【００３５】駆動パルス発生器１１は前記ヒステリシス
特性付き比較器５および第２の比較器９のいずれかから
ＥＣＤを駆動することを要求する制御信号が供給された
場合には、上述のように駆動回路１のスイッチングトラ
ンジスタＱ１〜Ｑ４の内必要なものをオンとしてＥＣＤ
に発色または消色方向への駆動電圧を印加する。これに
対し、ヒステリシス特性付き比較器５および第２の比較
器９のいずれもＥＣＤの駆動を指示する制御信号を出力
していなければ、駆動回路１の全てのスイッチングトラ
ンジスタＱ１〜Ｑ４をカットオフし、ＥＣＤを電気的に
切り離す。この状態では、ＥＣＤはほぼ切り離される直
前の電圧を維持するが、わずかなリーク電流のため両端
の電圧が徐々に低下し、消色する方向に向かう。
特性付き比較器５および第２の比較器９のいずれかから
ＥＣＤを駆動することを要求する制御信号が供給された
場合には、上述のように駆動回路１のスイッチングトラ
ンジスタＱ１〜Ｑ４の内必要なものをオンとしてＥＣＤ
に発色または消色方向への駆動電圧を印加する。これに
対し、ヒステリシス特性付き比較器５および第２の比較
器９のいずれもＥＣＤの駆動を指示する制御信号を出力
していなければ、駆動回路１の全てのスイッチングトラ
ンジスタＱ１〜Ｑ４をカットオフし、ＥＣＤを電気的に
切り離す。この状態では、ＥＣＤはほぼ切り離される直
前の電圧を維持するが、わずかなリーク電流のため両端
の電圧が徐々に低下し、消色する方向に向かう。
【００３６】図４に示される制御パルスを使用した場合
には、ＥＣＤ両端の電圧を検出するためのサンプリング
は毎秒５００回行なわれ、このようなサンプリングのた
めのオフ期間は制御パルスＤＰ１の１周期の５％（１０
０マイクロセカンド：μｓ）となる。
には、ＥＣＤ両端の電圧を検出するためのサンプリング
は毎秒５００回行なわれ、このようなサンプリングのた
めのオフ期間は制御パルスＤＰ１の１周期の５％（１０
０マイクロセカンド：μｓ）となる。
【００３７】次に、図５を参照して、ＥＣＤ両端の電圧
の変化、すなわちＥＣＤの発色度合の変化、を時系列的
に示しながら本発明の駆動装置の動作を具体的に説明す
る。
の変化、すなわちＥＣＤの発色度合の変化、を時系列的
に示しながら本発明の駆動装置の動作を具体的に説明す
る。
【００３８】まず、時刻ｔ＝０のときＥＣＤが消色状態
（ａ点）からスタートするものとする。この状態では、
ＥＣＤには両端電圧が上昇する方向に駆動電圧が印加さ
れ、Ａ部に向かって時間と共にＥＣＤ両端の電圧は増加
し、ＥＣＤはより高い濃度の発色状態へと変化してい
く。
（ａ点）からスタートするものとする。この状態では、
ＥＣＤには両端電圧が上昇する方向に駆動電圧が印加さ
れ、Ａ部に向かって時間と共にＥＣＤ両端の電圧は増加
し、ＥＣＤはより高い濃度の発色状態へと変化してい
く。
【００３９】ＥＣＤ両端の電圧がヒステリシス電圧幅を
含む基準電圧の上限値に達すると（ｂ点）、以後駆動回
路１はＥＣＤから切り離されオフ状態が継続する。ＥＣ
Ｄが理想的なものであればオフ状態ではＥＣＤにリーク
電流は存在しないが、実際にはＥＣＤの不完全性などか
らわずかにリークし、Ａ部に示すように、ＥＣＤ両端の
電圧は徐々に低下し、消色していく。すなわち、図５の
グラフでほぼ水平となっている箇所はオフ期間を示して
いる。本発明では、この期間はＥＣＤを駆動回路１から
切り離し電圧が印加されないようにしているので、消費
電力が大幅に低減できる。
含む基準電圧の上限値に達すると（ｂ点）、以後駆動回
路１はＥＣＤから切り離されオフ状態が継続する。ＥＣ
Ｄが理想的なものであればオフ状態ではＥＣＤにリーク
電流は存在しないが、実際にはＥＣＤの不完全性などか
らわずかにリークし、Ａ部に示すように、ＥＣＤ両端の
電圧は徐々に低下し、消色していく。すなわち、図５の
グラフでほぼ水平となっている箇所はオフ期間を示して
いる。本発明では、この期間はＥＣＤを駆動回路１から
切り離し電圧が印加されないようにしているので、消費
電力が大幅に低減できる。
【００４０】オフ期間にＥＣＤ両端の電圧が徐々に低下
し、やがてヒステリシス電圧を含む基準電圧の下限値に
達すると、ＥＣＤに電圧が印加され、発色状態となり、
再びヒステリシス電圧幅を含む基準電圧の上限値に達す
る。以後はこのような動作の繰り返しによってＥＣＤ両
端の電圧がヒステリシス電圧幅を含む基準電圧の上限値
と下限値との間に維持され、ほぼ基準電圧に対応する発
色状態が維持される。
し、やがてヒステリシス電圧を含む基準電圧の下限値に
達すると、ＥＣＤに電圧が印加され、発色状態となり、
再びヒステリシス電圧幅を含む基準電圧の上限値に達す
る。以後はこのような動作の繰り返しによってＥＣＤ両
端の電圧がヒステリシス電圧幅を含む基準電圧の上限値
と下限値との間に維持され、ほぼ基準電圧に対応する発
色状態が維持される。
【００４１】次に、基準電圧を変化させた場合の動作に
つき図５をも参照して説明する。 （１）基準電圧の変化幅が副基準電圧より小さいとき
は、上に述べた一連の動作が同様に行なわれる。すなわ
ち、新たに設定された基準電圧のヒステリシス電圧幅の
中で発色状態への電圧印加とオフ状態の２つをとる。し
たがって、発色濃度の変化はゆっくりしたものとなる。 （２）基準電圧の変化幅が副基準電圧より大きい場合
は、図１に示す第２の比較器９によってこの状態が検出
され、駆動パルス発生器１１が直ちにＥＣＤの発色ある
いは消色方向に電圧を印加する。これにより速い応答性
を得ることができる。すなわち、この場合は第２の比較
器９が効果的に機能し、基準電圧の値に応じてＥＣＤを
適切な方向に駆動する。 （３）基準電圧の変化幅が副基準電圧と全く同じ状態は
数学的には考えられるが、実際の回路では上記（１）ま
たは（２）のいずれかの状態となり、それぞれの状態に
応じた動作が行なわれる。
つき図５をも参照して説明する。 （１）基準電圧の変化幅が副基準電圧より小さいとき
は、上に述べた一連の動作が同様に行なわれる。すなわ
ち、新たに設定された基準電圧のヒステリシス電圧幅の
中で発色状態への電圧印加とオフ状態の２つをとる。し
たがって、発色濃度の変化はゆっくりしたものとなる。 （２）基準電圧の変化幅が副基準電圧より大きい場合
は、図１に示す第２の比較器９によってこの状態が検出
され、駆動パルス発生器１１が直ちにＥＣＤの発色ある
いは消色方向に電圧を印加する。これにより速い応答性
を得ることができる。すなわち、この場合は第２の比較
器９が効果的に機能し、基準電圧の値に応じてＥＣＤを
適切な方向に駆動する。 （３）基準電圧の変化幅が副基準電圧と全く同じ状態は
数学的には考えられるが、実際の回路では上記（１）ま
たは（２）のいずれかの状態となり、それぞれの状態に
応じた動作が行なわれる。
【００４２】図５に示す軌跡では、Ｂ部とＣ部に基準電
圧を副基準電圧より大きく変化させたときのＥＣＤ両端
の電圧変化の一例を示している。
圧を副基準電圧より大きく変化させたときのＥＣＤ両端
の電圧変化の一例を示している。
【００４３】Ｂ部は基準電圧を下げた場合を示し、ＥＣ
Ｄには消色方向に電圧が印加され、ヒステリシス電圧幅
を含む基準電圧の上限値に達するとオフ状態になること
が示されている。
Ｄには消色方向に電圧が印加され、ヒステリシス電圧幅
を含む基準電圧の上限値に達するとオフ状態になること
が示されている。
【００４４】Ｃ部は基準電圧を上げた場合を示し、ＥＣ
Ｄには発色方向に電圧が印加され、ヒステリシス電圧幅
を含む基準電圧の上限値に達するとオフ状態になること
が示されている。
Ｄには発色方向に電圧が印加され、ヒステリシス電圧幅
を含む基準電圧の上限値に達するとオフ状態になること
が示されている。
【００４５】本発明に係わるＥＣＤの駆動装置では、Ｅ
ＣＤの発色濃度は実際にはヒステリシス特性付き比較器
５のヒステリシス電圧幅の中で変化しているのであるか
ら、この電圧幅は実用上、濃度変化が目立たない程度と
することが望まれる。このヒステリシス電圧幅の設定は
エレクトロクロミック発色材の種類や素子構造などの差
異に応じて適宜変えることが望ましい場合もある。
ＣＤの発色濃度は実際にはヒステリシス特性付き比較器
５のヒステリシス電圧幅の中で変化しているのであるか
ら、この電圧幅は実用上、濃度変化が目立たない程度と
することが望まれる。このヒステリシス電圧幅の設定は
エレクトロクロミック発色材の種類や素子構造などの差
異に応じて適宜変えることが望ましい場合もある。
【００４６】一例として、エレクトロクロミック発色材
に酸化タングステンを使用した場合、発色時印加できる
最大電圧は１．２Ｖ〜１．５Ｖ程度であり、発色濃度変
化が目立たないＥＣＤ両端の電圧変化幅は０．０５Ｖ〜
０．２Ｖ程度である。したがって、ヒステリシス電圧幅
もこの０．０５Ｖ〜０．２Ｖ程度に設定するのが最適で
ある。
に酸化タングステンを使用した場合、発色時印加できる
最大電圧は１．２Ｖ〜１．５Ｖ程度であり、発色濃度変
化が目立たないＥＣＤ両端の電圧変化幅は０．０５Ｖ〜
０．２Ｖ程度である。したがって、ヒステリシス電圧幅
もこの０．０５Ｖ〜０．２Ｖ程度に設定するのが最適で
ある。
【００４７】同様に、前記副基準電圧はヒステリシス電
圧よりやや大きい程度、すなわち上記の例の場合では
０．１Ｖ〜０．３Ｖ程度に設定するのが最適である。
圧よりやや大きい程度、すなわち上記の例の場合では
０．１Ｖ〜０．３Ｖ程度に設定するのが最適である。
【００４８】
【発明の効果】以上のように、本発明によれば、ＥＣＤ
両端の電圧が所望の発色濃度に対応する基準電圧に対し
所定の電圧範囲内に入ると、すなわちほぼ一度設定され
た濃度に達すると、その設定を変化させない限り、ＥＣ
Ｄと駆動回路とを切り離したオフ状態とする。これによ
って、ＥＣＤをたえず駆動することがなくなり駆動のた
めの消費電力を大幅に低減できる。また、ＥＣＤ両端の
電圧が前記基準電圧から所定の電圧範囲以上離れた場合
には、ＥＣＤに駆動電圧が印加され、直ちに所望の発色
濃度に戻される。したがって、駆動装置の消費電力を大
幅に低減し、かつ高速度の応答が可能になる。
両端の電圧が所望の発色濃度に対応する基準電圧に対し
所定の電圧範囲内に入ると、すなわちほぼ一度設定され
た濃度に達すると、その設定を変化させない限り、ＥＣ
Ｄと駆動回路とを切り離したオフ状態とする。これによ
って、ＥＣＤをたえず駆動することがなくなり駆動のた
めの消費電力を大幅に低減できる。また、ＥＣＤ両端の
電圧が前記基準電圧から所定の電圧範囲以上離れた場合
には、ＥＣＤに駆動電圧が印加され、直ちに所望の発色
濃度に戻される。したがって、駆動装置の消費電力を大
幅に低減し、かつ高速度の応答が可能になる。
【００４９】また、本発明では、前記所定の電圧範囲の
幅以上の大きさの副基準電圧を設定し、前記基準電圧が
変更された場合に、この副基準電圧を使用して必要な場
合に直ちにＥＣＤを駆動するよう構成したから、基準電
圧が変化する場合にも高速度でＥＣＤ両端の電圧を追従
させることができ、迅速に所望の発色濃度に駆動するこ
とが可能になる。
幅以上の大きさの副基準電圧を設定し、前記基準電圧が
変更された場合に、この副基準電圧を使用して必要な場
合に直ちにＥＣＤを駆動するよう構成したから、基準電
圧が変化する場合にも高速度でＥＣＤ両端の電圧を追従
させることができ、迅速に所望の発色濃度に駆動するこ
とが可能になる。
【図１】本発明の一実施形態に係わるＥＣＤの駆動装置
の構成を示すブロック回路図である。
の構成を示すブロック回路図である。
【図２】ＥＣＤの駆動方法の一例を示す説明的電気回路
図である。
図である。
【図３】ＥＣＤの他の駆動方法の例を示す説明的電気回
路図である。
路図である。
【図４】図１のＥＣＤの駆動装置における駆動制御パル
スの一例を示す信号波形図である。
スの一例を示す信号波形図である。
【図５】本発明に係わるＥＣＤの駆動装置の動作を説明
するための、時間経過に応じたＥＣＤ両端の電圧（発色
濃度）を示す例示的電圧信号波形図である。
するための、時間経過に応じたＥＣＤ両端の電圧（発色
濃度）を示す例示的電圧信号波形図である。
１ 駆動回路 ３ 差電圧検出器 ５ ヒステリシス特性付き比較器 ７ 第２の差電圧検出器 ９ 第２の比較器 １１ 駆動パルス発生器 １３ クロック発生器 １５ 基準電圧源 １７ 副基準電圧源 Ｄ１ エレクトロクロミック素子（ＥＣＤ） Ｑ１，Ｑ２，Ｑ３，Ｑ４ スイッチングトランジスタ Ｕ１，Ｕ３ 演算増幅器 Ｕ２，Ｕ４ 比較器 Ｒ１，Ｒ２，…，Ｒ１０ 抵抗 Ｅ１ 基準電圧 Ｅ２ 副基準電圧
Claims (6)
- 【請求項１】 エレクトロクロミック素子の駆動装置で
あって、 前記エレクトロクロミック素子両端の電圧を検出する回
路と、 前記エレクトロクロミック素子両端の電圧が所定の発色
状態に対応する基準電圧に対し予め定められた電圧範囲
内にあるか否かを判定する回路と、 前記エレクトロクロミック素子両端の電圧が前記基準電
圧に対し前記予め定められた範囲内にない場合に前記エ
レクトロクロミック素子に前記エレクトロクロミック素
子両端の電圧が前記基準電圧に向かう方向に駆動電圧を
印加し、かつ前記エレクトロクロミック素子両端電圧が
前記基準電圧に対し前記範囲内にある場合には前記エレ
クトロクロミック素子に電圧を印加しないよう制御する
駆動制御回路と、 を具備することを特徴とするエレクトロクロミック素子
の駆動装置。 - 【請求項２】 さらに、前記予め定められた電圧範囲の
幅以上の大きさの副基準電圧を供給する回路を備え、前
記基準電圧を変更した時に前記基準電圧と前記エレクト
ロクロミック素子両端の電圧との差が該副基準電圧より
大きくなった場合に前記エレクトロクロミック素子に前
記エレクトロクロミック素子両端の電圧が前記基準電圧
に向かう方向に駆動電圧を印加することを特徴とする請
求項１に記載のエレクトロクロミック素子の駆動装置。 - 【請求項３】 エレクトロクロミック素子の駆動装置で
あって、 前記エレクトロクロミック素子の発色状態に応じた電圧
を得るための電圧検出回路と、 エレクトロクロミック素子の所望の発色状態に対応した
基準電圧を設定する基準電圧設定回路と、 前記電圧検出回路の出力信号と前記基準電圧設定回路か
らの基準電圧とを比較するためのヒステリシス特性を有
する比較回路と、 前記比較回路の出力に基づき、前記エレクトロクロミッ
ク素子の電圧と前記基準電圧との差が前記比較回路によ
って決定されるヒステリシス電圧幅より小さい場合に
は、前記エレクトロクロミック素子に電圧を印加せず、
前記エレクトロクロミック素子の電圧と前記基準電圧と
の差が前記比較回路によって決定されるヒステリシス電
圧幅より大きい場合には前記エレクトロクロミック素子
を所望の発色状態にする方向に電圧を印加する駆動回路
と、 を具備することを特徴とするエレクトロクロミック素子
の駆動装置。 - 【請求項４】 さらに、前記比較回路のヒステリシス電
圧幅以上の大きさを有する副基準電圧を供給する副基準
電圧発生回路と、 前記エレクトロクロミック素子の電圧と前記基準電圧と
の差を表す差電圧を出力する差電圧検出回路と、 前記差電圧と前記副基準電圧発生回路から供給される副
基準電圧とを比較し、前記基準電圧を変更した時に前記
差電圧が前記副基準電圧より大きくなれば前記エレクト
ロクロミック素子に駆動電圧を印加して所望の発色ある
いは消色方向に制御するための第２の比較回路と、 を具備することを特徴とする請求項３に記載のエレクト
ロクロミック素子の駆動装置。 - 【請求項５】 前記駆動回路は、第１の電圧源と第２の
電圧源との間に直列接続された第１および第２のトラン
ジスタと、前記第１の電圧源と前記第２の電圧源との間
に直列接続された第３および第４のトランジスタとを備
え、前記エレクトロクロミック素子は前記第１および第
２のトランジスタの接続点と前記第３および第４のトラ
ンジスタの接続点との間に接続され、 前記エレクトロクロミック素子に駆動電圧を印加する場
合は、前記第２および第３のトランジスタを共にオフ状
態、前記第１および第４のトランジスタを共にオン状態
として前記エレクトロクロミック素子に第１の方向で電
圧を印加し、または前記第１および第４のトランジスタ
を共にオフとし前記第２および第３のトランジスタを共
にオンとして前記エレクトロクロミック素子に第２の方
向で電圧を印加し、かつ前記エレクトロクロミック素子
に駆動電圧を印加しない場合は、前記第１、第２、第３
および第４のトランジスタをすべてオフとすることによ
り前記エレクトロクロミック素子を他の回路から電気的
に切り離すことを特徴とする請求項３または４に記載の
エレクトロクロミック素子の駆動装置。 - 【請求項６】 前記電圧検出回路は前記エレクトロクロ
ミック素子に電圧を印加しない時に前記エレクトロクロ
ミック素子の発色状態に対応する電圧を検出することを
特徴とする請求項３〜５のいずれか１項に記載のエレク
トロクロミック素子の駆動装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8241033A JPH1063216A (ja) | 1996-08-23 | 1996-08-23 | エレクトロクロミック素子の駆動装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8241033A JPH1063216A (ja) | 1996-08-23 | 1996-08-23 | エレクトロクロミック素子の駆動装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH1063216A true JPH1063216A (ja) | 1998-03-06 |
Family
ID=17068331
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8241033A Pending JPH1063216A (ja) | 1996-08-23 | 1996-08-23 | エレクトロクロミック素子の駆動装置 |
Country Status (1)
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