JPH03158044A - 装置内監視方式 - Google Patents
装置内監視方式Info
- Publication number
- JPH03158044A JPH03158044A JP1296088A JP29608889A JPH03158044A JP H03158044 A JPH03158044 A JP H03158044A JP 1296088 A JP1296088 A JP 1296088A JP 29608889 A JP29608889 A JP 29608889A JP H03158044 A JPH03158044 A JP H03158044A
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- JP
- Japan
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- blocks
- circuits
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- test
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- Pending
Links
- 230000005540 biological transmission Effects 0.000 claims abstract description 12
- 238000012544 monitoring process Methods 0.000 claims abstract description 9
- 238000012360 testing method Methods 0.000 abstract description 13
- 238000001514 detection method Methods 0.000 abstract description 6
- 238000000605 extraction Methods 0.000 abstract description 3
- 238000003780 insertion Methods 0.000 abstract description 3
- 230000037431 insertion Effects 0.000 abstract description 3
- 230000001960 triggered effect Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 3
- 235000001674 Agaricus brunnescens Nutrition 0.000 description 1
- 238000000034 method Methods 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
Landscapes
- Maintenance And Management Of Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、複数の送信ブロックと受信ブロックとを備え
る装置において、各ブロック間の接続状況を確認するた
めの監視方式に関するものである。
る装置において、各ブロック間の接続状況を確認するた
めの監視方式に関するものである。
複数の送信ブロックと受信ブロックとを備え、各送信ブ
ロックよシ対応する受信ブロックへ信号の送信を行なう
装置においては、信号の各フレーム毎に監視用の固定パ
ターンを挿入し、これＫよシ信号の受信状況を確認する
ものとなっている。
ロックよシ対応する受信ブロックへ信号の送信を行なう
装置においては、信号の各フレーム毎に監視用の固定パ
ターンを挿入し、これＫよシ信号の受信状況を確認する
ものとなっている。
しかし、固定パターンとしては各送信ブロック共通のも
のが用いられておシ、各送信ブロックと受信ブロックと
の間の接続に誤シがあっても、固定パターンによっては
接続状況の誤シを監視することができない欠点を生じて
いる。
のが用いられておシ、各送信ブロックと受信ブロックと
の間の接続に誤シがあっても、固定パターンによっては
接続状況の誤シを監視することができない欠点を生じて
いる。
前述の課題を解決するため、本発明はつぎの手段により
構成するものとなっている。
構成するものとなっている。
すなわち、上述の装置において、監使用の固定パターン
と各送信ブロック毎に個有の番号パターンとを信号の空
きビットへ挿入して送信し、番号パターンの検出によシ
対応する送信ブロックと受信ブロックとの間の接続状況
を監視するものとしている。
と各送信ブロック毎に個有の番号パターンとを信号の空
きビットへ挿入して送信し、番号パターンの検出によシ
対応する送信ブロックと受信ブロックとの間の接続状況
を監視するものとしている。
したがって、対応する送信ブロックと受信ブロックとの
間に接続状況の誤りがあれば、受信する番号パターンが
予定のものと異っておシ、直ちに接続状況の誤シを判断
することができる。
間に接続状況の誤りがあれば、受信する番号パターンが
予定のものと異っておシ、直ちに接続状況の誤シを判断
することができる。
以下、実施例を示す図によって本発明の詳細な説明する
。
。
第２図は全構成のブロック図であシ、複数の送信ブロッ
ク（以下、ａＴ）１０，２０．３０が設けであると共に
、これらの各々と対応する複数の受信ブロック（以下、
ＢＲ）１１．２１．３１が設けてあシ、互いに対応する
ＢＴｌｏ、２０．３０とＢＲｌｌ、２１．３１との間に
は、各個別の信号線１２．２２．３２により接続されて
おシ、各ＢＴ１０．２０．３０のテストパターン挿入回
路（以下、ＴＰＩ）１００，２００，３００において、
固定パターン生成回路（以下、ＦＰＧ ’） １（Ｎ
、２０１．３０１により発生した共通の固定パターン、
および、番号設定回路（以下、Ｎ５Ｔ）１０２，２０２
．３０２により設定した各個有の番号パターンが、信号
Ｓｌ＋８茸。
ク（以下、ａＴ）１０，２０．３０が設けであると共に
、これらの各々と対応する複数の受信ブロック（以下、
ＢＲ）１１．２１．３１が設けてあシ、互いに対応する
ＢＴｌｏ、２０．３０とＢＲｌｌ、２１．３１との間に
は、各個別の信号線１２．２２．３２により接続されて
おシ、各ＢＴ１０．２０．３０のテストパターン挿入回
路（以下、ＴＰＩ）１００，２００，３００において、
固定パターン生成回路（以下、ＦＰＧ ’） １（Ｎ
、２０１．３０１により発生した共通の固定パターン、
および、番号設定回路（以下、Ｎ５Ｔ）１０２，２０２
．３０２により設定した各個有の番号パターンが、信号
Ｓｌ＋８茸。
Ｓ、の空きビットへ挿入されたうえ、信号線１．２゜２
２．３２を介し、ＢＲｌｌ 、２１．３１へ各個に送信
されるものとなっている。
２．３２を介し、ＢＲｌｌ 、２１．３１へ各個に送信
されるものとなっている。
一方、ＢＲｌｌ、２１．３１においては、テストパター
ン抽出回路（以下、ＴＰＳ）１１０，２１０．３１０に
よシ固定パターンおよび番号パターンの抽出がなされた
うえ、テストパターン検出回路（以下、ＴＰＤ）１１１
，２１１．３１１において、固定パターンの検出および
番号パターンの検出が行なわれ、これによシ信号Ｓ１〜
Ｓ３の受信状況監視および相手側ＢＴ１０，２０．３０
との接続状況確認が行なわれる。
ン抽出回路（以下、ＴＰＳ）１１０，２１０．３１０に
よシ固定パターンおよび番号パターンの抽出がなされた
うえ、テストパターン検出回路（以下、ＴＰＤ）１１１
，２１１．３１１において、固定パターンの検出および
番号パターンの検出が行なわれ、これによシ信号Ｓ１〜
Ｓ３の受信状況監視および相手側ＢＴ１０，２０．３０
との接続状況確認が行なわれる。
第１図は、各信号Ｓｉ〜ｓ３のフォーマントを示し、フ
レームパルス（ａ）によシ定まるフレーム毎に、信号（
ｂ）のとおり、情報ビット４１の挿入されない空きビッ
トへ、固定パターン４２および番号パターン４３をテス
トパターン４４としてＴＰＩｉＱＱ。
レームパルス（ａ）によシ定まるフレーム毎に、信号（
ｂ）のとおり、情報ビット４１の挿入されない空きビッ
トへ、固定パターン４２および番号パターン４３をテス
トパターン４４としてＴＰＩｉＱＱ。
２００．３００によシ挿入しておシ、固定パタンン４２
が共通のものとしてＦＰＧｌｏｌ 、２０１．３（Ｈに
１７発生されるのに対し、番号パターン４３は、Ｎ５Ｔ
１０２．２０２，３０２によシ各個別に設定されるため
、テストパターン４４をＴＰＳｌｌｏ、２１０．３１０
において抽出のうえ、ＴＰＯｌｌｌ、２１１．３１１に
よシ番号パターン４３の示す番号と予定した番号との対
比を行なうことによシ、ＢＴｌｏ、２０．３０とＢＲＩ
ｔ、２１．３１との接続状況を確認することができる。
が共通のものとしてＦＰＧｌｏｌ 、２０１．３（Ｈに
１７発生されるのに対し、番号パターン４３は、Ｎ５Ｔ
１０２．２０２，３０２によシ各個別に設定されるため
、テストパターン４４をＴＰＳｌｌｏ、２１０．３１０
において抽出のうえ、ＴＰＯｌｌｌ、２１１．３１１に
よシ番号パターン４３の示す番号と予定した番号との対
比を行なうことによシ、ＢＴｌｏ、２０．３０とＢＲＩ
ｔ、２１．３１との接続状況を確認することができる。
以上の説明によシ明らかなとおり本発明によれば、監視
用の固定パターンのほか、各送信ブロック毎に個有の番
号パターンを信号の空きビットへ挿入して送信し、番号
パターンの検出によシ対応する送信ブロックとの受信ブ
ロックとの間の接続状況を監視・するものとしたことに
よシ、装置内の各ブロック間接続の誤シが直ちに判明し
、複数の送信ブロックおよび受信ブロックを有する装置
内の監視において顕著な効果が得られる。
用の固定パターンのほか、各送信ブロック毎に個有の番
号パターンを信号の空きビットへ挿入して送信し、番号
パターンの検出によシ対応する送信ブロックとの受信ブ
ロックとの間の接続状況を監視・するものとしたことに
よシ、装置内の各ブロック間接続の誤シが直ちに判明し
、複数の送信ブロックおよび受信ブロックを有する装置
内の監視において顕著な効果が得られる。
図は本発明の実施例を示し、第１図は信号のフォーマッ
トを示す図、第２図は全構成のブロック図である。 １０．２０．３０＠・・・送信ブロック、１１゜２１．
３１−・φ・受信ブロック、４２・−・拳固定パターン
、４３・・・・番号パターン、ｉｏｏ。 ２００．３００・・・・テストパターン挿入回路、１０
１．２０１．３０１・・赤・固定パターン生成回路、１
０２．２０２，３０２・・・・番号設定回路、１１０゜
２１０．３１０・・・・テストパターン抽出回路、１１
１．２１１．３１１・・・・テストパターン検出回路、
Ｓ１〜Ｓ、・・・Ｏ信号。
トを示す図、第２図は全構成のブロック図である。 １０．２０．３０＠・・・送信ブロック、１１゜２１．
３１−・φ・受信ブロック、４２・−・拳固定パターン
、４３・・・・番号パターン、ｉｏｏ。 ２００．３００・・・・テストパターン挿入回路、１０
１．２０１．３０１・・赤・固定パターン生成回路、１
０２．２０２，３０２・・・・番号設定回路、１１０゜
２１０．３１０・・・・テストパターン抽出回路、１１
１．２１１．３１１・・・・テストパターン検出回路、
Ｓ１〜Ｓ、・・・Ｏ信号。
Claims (1)
- 複数の送信ブロックと、該送信ブロックと対応する複数
の受信ブロックとを備え、各送信ブロックから対応する
受信ブロックへ信号の送信を行なう装置において、監視
用の固定パターンと各送信ブロック毎に個有の番号パタ
ーンとを前記信号の空きビットへ挿入して送信し、前記
番号パターンの検出により対応する送信ブロックと受信
ブロックとの間の接続状況を監視することを特徴とした
装置内監視方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1296088A JPH03158044A (ja) | 1989-11-16 | 1989-11-16 | 装置内監視方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1296088A JPH03158044A (ja) | 1989-11-16 | 1989-11-16 | 装置内監視方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03158044A true JPH03158044A (ja) | 1991-07-08 |
Family
ID=17828966
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1296088A Pending JPH03158044A (ja) | 1989-11-16 | 1989-11-16 | 装置内監視方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03158044A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05153199A (ja) * | 1991-11-29 | 1993-06-18 | Nec Corp | 信号伝送装置 |
| US6684351B1 (en) * | 2000-12-22 | 2004-01-27 | Applied Micro Circuits Corporation | System and method for diagnosing errors in multidimensional digital frame structure communications |
-
1989
- 1989-11-16 JP JP1296088A patent/JPH03158044A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05153199A (ja) * | 1991-11-29 | 1993-06-18 | Nec Corp | 信号伝送装置 |
| US6684351B1 (en) * | 2000-12-22 | 2004-01-27 | Applied Micro Circuits Corporation | System and method for diagnosing errors in multidimensional digital frame structure communications |
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