JPH08339232A - 基準電圧回路 - Google Patents
基準電圧回路Info
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- JPH08339232A JPH08339232A JP16494196A JP16494196A JPH08339232A JP H08339232 A JPH08339232 A JP H08339232A JP 16494196 A JP16494196 A JP 16494196A JP 16494196 A JP16494196 A JP 16494196A JP H08339232 A JPH08339232 A JP H08339232A
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- Japan
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- circuit
- current
- collector
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Abstract
(57)【要約】 （修正有）
【課題】 回路構成の簡略化とともに、電源電圧特性を
改善した基準電圧回路を提供する。 【解決手段】 電源側に第１及び第２のトランジスタ２
０、２２を接続した第１のカレントミラー回路、第３の
トランジスタ２８及び第４のトランジスタ２６を接続
し、第３のトランジスタのエミッタ面積を第４のトラン
ジスタのエミッタ面積より大きく設定した第２のカレン
トミラー回路、第３のトランジスタ２８のエミッタと接
地点との間に抵抗３０を接続して電流を発生する電流源
と、第１及び第２のカレントミラー回路に流れる電流を
取り出す第５のトランジスタ２４と、この第５のトラン
ジスタのコレクタと接地点との間に抵抗３２及びダイオ
ード３４からなる温度係数を相殺する回路を直列に接続
して電流を流すことにより、第５のトランジスタのコレ
クタ側から温度係数を持たない基準電圧を取り出す出力
回路とを備えたものである。
改善した基準電圧回路を提供する。 【解決手段】 電源側に第１及び第２のトランジスタ２
０、２２を接続した第１のカレントミラー回路、第３の
トランジスタ２８及び第４のトランジスタ２６を接続
し、第３のトランジスタのエミッタ面積を第４のトラン
ジスタのエミッタ面積より大きく設定した第２のカレン
トミラー回路、第３のトランジスタ２８のエミッタと接
地点との間に抵抗３０を接続して電流を発生する電流源
と、第１及び第２のカレントミラー回路に流れる電流を
取り出す第５のトランジスタ２４と、この第５のトラン
ジスタのコレクタと接地点との間に抵抗３２及びダイオ
ード３４からなる温度係数を相殺する回路を直列に接続
して電流を流すことにより、第５のトランジスタのコレ
クタ側から温度係数を持たない基準電圧を取り出す出力
回路とを備えたものである。
Description
【０００１】
【産業上の利用分野】この発明は、基準電圧回路に係
り、特に、温度係数を持たない基準電圧の発生に関す
る。
り、特に、温度係数を持たない基準電圧の発生に関す
る。
【０００２】
【従来の技術】図４は、この種の基準電圧回路として用
いられているバンドギャップ基本回路を示している。こ
の回路は、トランジスタ２、４、６、抵抗８、１０、１
２および定電流源１４から構成され、電源端子１６に電
圧Ｖccの電源を接続し、出力端子１８から温度係数を持
たない基準電圧Ｖref を取り出すことができる。
いられているバンドギャップ基本回路を示している。こ
の回路は、トランジスタ２、４、６、抵抗８、１０、１
２および定電流源１４から構成され、電源端子１６に電
圧Ｖccの電源を接続し、出力端子１８から温度係数を持
たない基準電圧Ｖref を取り出すことができる。
【０００３】すなわち、定電流源１４から電流ＩO を抵
抗８を介してトランジスタ２に流し込み、トランジスタ
２、４、６に流れる動作電流をＩ1 、Ｉ2 、Ｉ3 とす
る。トランジスタ２はコレクタ・ベース間を接続してダ
イオードとして構成されている。そこで、ダイオードの
温度係数は−２ｍＶ／℃、トランジスタ４に流れる動作
電流Ｉ2 および抵抗８は正の温度係数を持っている。
抗８を介してトランジスタ２に流し込み、トランジスタ
２、４、６に流れる動作電流をＩ1 、Ｉ2 、Ｉ3 とす
る。トランジスタ２はコレクタ・ベース間を接続してダ
イオードとして構成されている。そこで、ダイオードの
温度係数は−２ｍＶ／℃、トランジスタ４に流れる動作
電流Ｉ2 および抵抗８は正の温度係数を持っている。
【０００４】したがって、出力端子１８には、これらの
温度係数が加算され、温度係数を相殺して温度係数を持
たない基準電圧Ｖref が発生する。この基準電圧Ｖref
の値は約１．２Ｖである。
温度係数が加算され、温度係数を相殺して温度係数を持
たない基準電圧Ｖref が発生する。この基準電圧Ｖref
の値は約１．２Ｖである。
【０００５】
【発明が解決しようとする課題】このような基準電圧回
路では、(1)定電流源１４を構成する定電流回路を別途
設ける必要があること、(2)温度特性は良好であるが、
電源電圧Ｖccの変動が定電流源１４の出力電流ＩO に影
響を与え、動作電流Ｉ1 、Ｉ2 、Ｉ3 が変化するため、
基準電圧Ｖrefが変動し、電源電圧特性が低いことなど
の欠点がある。このため、定電流源１４は電源変動を受
け難いものとする必要がある。
路では、(1)定電流源１４を構成する定電流回路を別途
設ける必要があること、(2)温度特性は良好であるが、
電源電圧Ｖccの変動が定電流源１４の出力電流ＩO に影
響を与え、動作電流Ｉ1 、Ｉ2 、Ｉ3 が変化するため、
基準電圧Ｖrefが変動し、電源電圧特性が低いことなど
の欠点がある。このため、定電流源１４は電源変動を受
け難いものとする必要がある。
【０００６】そこで、この発明は、回路構成の簡略化と
ともに、電源電圧特性を改善した基準電圧回路を提供す
ることを目的とする。
ともに、電源電圧特性を改善した基準電圧回路を提供す
ることを目的とする。
【０００７】
【課題を解決するための手段】この発明の基準電圧回路
は、図１及び図２に例示するように、電源側に第１及び
第２のトランジスタ（２０、２２）のエミッタを接続
し、前記第２のトランジスタのベース・コレクタに前記
第１のトランジスタのベースを接続してなる第１のカレ
ントミラー回路が設置されるとともに、前記第２のトラ
ンジスタのベース・コレクタ側に第３のトランジスタ
（２８）のコレクタを接続し、前記第１のトランジスタ
のコレクタに第４のトランジスタ（２６）のベース・コ
レクタを接続し、前記第３のトランジスタのベースと前
記第４のトランジスタのベース・コレクタを共通に接続
し、前記第３のトランジスタのエミッタ面積を前記第４
のトランジスタのエミッタ面積より大きく設定した第２
のカレントミラー回路が設置され、前記第３のトランジ
スタのエミッタと接地点との間に抵抗（３０）を接続し
て電流を発生する電流源と、この電流源の前記第１のト
ランジスタのベースにベースを共通に接続するととも
に、前記電源側にエミッタを接続し、前記第１及び第２
のカレントミラー回路に流れる電流を取り出す第５のト
ランジスタ（２４）と、この第５のトランジスタのコレ
クタと前記接地点との間に抵抗（３２）及びダイオード
（３４）からなる回路を直列に接続して前記電流を流す
ことにより、前記第５のトランジスタのコレクタ側から
温度係数を持たない基準電圧を取り出す出力回路とを備
えたことを特徴とする。
は、図１及び図２に例示するように、電源側に第１及び
第２のトランジスタ（２０、２２）のエミッタを接続
し、前記第２のトランジスタのベース・コレクタに前記
第１のトランジスタのベースを接続してなる第１のカレ
ントミラー回路が設置されるとともに、前記第２のトラ
ンジスタのベース・コレクタ側に第３のトランジスタ
（２８）のコレクタを接続し、前記第１のトランジスタ
のコレクタに第４のトランジスタ（２６）のベース・コ
レクタを接続し、前記第３のトランジスタのベースと前
記第４のトランジスタのベース・コレクタを共通に接続
し、前記第３のトランジスタのエミッタ面積を前記第４
のトランジスタのエミッタ面積より大きく設定した第２
のカレントミラー回路が設置され、前記第３のトランジ
スタのエミッタと接地点との間に抵抗（３０）を接続し
て電流を発生する電流源と、この電流源の前記第１のト
ランジスタのベースにベースを共通に接続するととも
に、前記電源側にエミッタを接続し、前記第１及び第２
のカレントミラー回路に流れる電流を取り出す第５のト
ランジスタ（２４）と、この第５のトランジスタのコレ
クタと前記接地点との間に抵抗（３２）及びダイオード
（３４）からなる回路を直列に接続して前記電流を流す
ことにより、前記第５のトランジスタのコレクタ側から
温度係数を持たない基準電圧を取り出す出力回路とを備
えたことを特徴とする。
【０００８】このように構成したので、正の温度係数を
持つかあるいは温度特性を持たない抵抗、負の温度係数
を持つダイオードに正の温度係数を持つ電流が流れる結
果、正負の温度係数が相殺され、温度係数を持たない基
準電圧が得られる。
持つかあるいは温度特性を持たない抵抗、負の温度係数
を持つダイオードに正の温度係数を持つ電流が流れる結
果、正負の温度係数が相殺され、温度係数を持たない基
準電圧が得られる。
【０００９】また、この発明の基準電圧回路は、前記第
１及び第２のトランジスタに起動電流を流す起動回路を
備えたことを特徴とする。即ち、起動回路を付加して第
１及び第２のトランジスタに起動電流を流すことによ
り、起動が良好となって適正な動作が得られる。
１及び第２のトランジスタに起動電流を流す起動回路を
備えたことを特徴とする。即ち、起動回路を付加して第
１及び第２のトランジスタに起動電流を流すことによ
り、起動が良好となって適正な動作が得られる。
【００１０】
【発明の実施の形態】以下、この発明を図面に示した実
施形態を参照して詳細に説明する。
施形態を参照して詳細に説明する。
【００１１】図１は、この発明の基準電圧回路の第１の
実施形態を示している。図１において、第１のトランジ
スタ２０は、ベース・コレクタ間が共通に接続され、ダ
イオードを構成する。このトランジスタ２０のベース・
コレクタには第２のトランジスタ２２及び第５のトラン
ジスタ２４のベースが共通に接続され、第１及び第２の
トランジスタ２０、２２は第１のカレントミラー回路を
構成するとともに、第１のトランジスタ２０と第５のト
ランジスタ２４とは、トランジスタ２０のベース・コレ
クタにトランジスタ２４のベースが接続されてカレント
ミラー回路を構成し、定電流回路が構成されている。
実施形態を示している。図１において、第１のトランジ
スタ２０は、ベース・コレクタ間が共通に接続され、ダ
イオードを構成する。このトランジスタ２０のベース・
コレクタには第２のトランジスタ２２及び第５のトラン
ジスタ２４のベースが共通に接続され、第１及び第２の
トランジスタ２０、２２は第１のカレントミラー回路を
構成するとともに、第１のトランジスタ２０と第５のト
ランジスタ２４とは、トランジスタ２０のベース・コレ
クタにトランジスタ２４のベースが接続されてカレント
ミラー回路を構成し、定電流回路が構成されている。
【００１２】トランジスタ２０、２２に対応して設置さ
れた第３のトランジスタ２８及び第４のトランジスタ２
６は第２のカレントミラー回路を構成しており、トラン
ジスタ２６のエミッタ面積を１とし、このトランジスタ
２６のエミッタ面積に対してトランジスタ２８のエミッ
タ面積はｎ倍に設定され、エミッタ面積の大きいトラン
ジスタ２８のエミッタと接地点（ＧＮＤ）との間には抵
抗３０が接続されている。
れた第３のトランジスタ２８及び第４のトランジスタ２
６は第２のカレントミラー回路を構成しており、トラン
ジスタ２６のエミッタ面積を１とし、このトランジスタ
２６のエミッタ面積に対してトランジスタ２８のエミッ
タ面積はｎ倍に設定され、エミッタ面積の大きいトラン
ジスタ２８のエミッタと接地点（ＧＮＤ）との間には抵
抗３０が接続されている。
【００１３】また、トランジスタ２４のコレクタと接地
点との間には、抵抗３２およびダイオード３４からなる
直列回路が接続され、トランジスタ２４のコレクタに
は、これら素子の直列回路によって形成される基準電圧
Ｖref を取り出すための出力端子３６が形成されてい
る。
点との間には、抵抗３２およびダイオード３４からなる
直列回路が接続され、トランジスタ２４のコレクタに
は、これら素子の直列回路によって形成される基準電圧
Ｖref を取り出すための出力端子３６が形成されてい
る。
【００１４】そして、電源端子３８と接地点（ＧＮＤ）
との間には、図示していない電源が接続され、Ｖccはそ
の印加電圧である。
との間には、図示していない電源が接続され、Ｖccはそ
の印加電圧である。
【００１５】以上の構成に基づき、その動作を説明す
る。
る。
【００１６】定電流回路を構成しているトランジスタ２
０、２２、２４に流れる電流をＩ1、Ｉ2 、Ｉ3 とす
る。この場合、トランジスタ２０、２２が等しいもので
あるとすると、電流Ｉ1 、Ｉ2 は等しく、その値を電流
ＩO とする。
０、２２、２４に流れる電流をＩ1、Ｉ2 、Ｉ3 とす
る。この場合、トランジスタ２０、２２が等しいもので
あるとすると、電流Ｉ1 、Ｉ2 は等しく、その値を電流
ＩO とする。
【００１７】この電流ＩO は、トランジスタ２６、２８
のエミッタ面積比１／ｎおよび抵抗３０の値Ｒ1 により
決定され、すなわち、
のエミッタ面積比１／ｎおよび抵抗３０の値Ｒ1 により
決定され、すなわち、
【００１８】 ＩO ＝ＶT ・１n ｎ／Ｒ1 ・・・(1) となる。そして、トランジスタ２０に流れる電流Ｉ
O は、カレントミラー効果によってトランジスタ２４に
電流Ｉ3 として流れる。この電流は、正の温度係数を持
っており、出力端子３６に発生する基準電圧Ｖref は、
抵抗３２の抵抗値Ｒ2 と電流Ｉ3 との積によって発生す
る電圧降下とダイオード３４の順方向降下電圧との合成
値で与えられる。すなわち、
O は、カレントミラー効果によってトランジスタ２４に
電流Ｉ3 として流れる。この電流は、正の温度係数を持
っており、出力端子３６に発生する基準電圧Ｖref は、
抵抗３２の抵抗値Ｒ2 と電流Ｉ3 との積によって発生す
る電圧降下とダイオード３４の順方向降下電圧との合成
値で与えられる。すなわち、
【００１９】 Ｖref ＝ＩO ・Ｒ2 ＋ＶF （ＩO ） ＝（Ｒ2 ／Ｒ1 ）１n ｎ・ＶT ＋ＶT ・１n （ＩO ／ＩS ） ・・・(2)
【００２０】となる。ただし、ＶT ＝ｋ・Ｔ／ｑで与え
られ、ｋはボルツマン定数、ｑは電子の電荷、Ｔは絶対
温度、ＩS はトランジスタ２８の単位エミッタ当りの電
流であり、電流ＩO は式(1) で与えられる。
られ、ｋはボルツマン定数、ｑは電子の電荷、Ｔは絶対
温度、ＩS はトランジスタ２８の単位エミッタ当りの電
流であり、電流ＩO は式(1) で与えられる。
【００２１】式(2) において、温度係数を相殺するため
には、第１項および第２項の温度係数の絶対値が等しく
なれば良い。すなわち、第１項の温度係数を２ｍＶ／℃
に設定する。ただし、Ｒ1 、Ｒ2 が同じ特性を持つ抵抗
器で構成されれば、（Ｒ2 ／Ｒ1 ）１n ｎは温度によら
ず一定値となり、ＶT の温度係数は、ｄＶT ／ｄＴ＝ｋ
／ｑ＝0.086 ｍＶ／℃であるから、ｎ、Ｒ1 およびＲ2
の値を適当に選ぶことによって、第１項の温度係数を＋
２ｍＶ／℃に設定することができる。
には、第１項および第２項の温度係数の絶対値が等しく
なれば良い。すなわち、第１項の温度係数を２ｍＶ／℃
に設定する。ただし、Ｒ1 、Ｒ2 が同じ特性を持つ抵抗
器で構成されれば、（Ｒ2 ／Ｒ1 ）１n ｎは温度によら
ず一定値となり、ＶT の温度係数は、ｄＶT ／ｄＴ＝ｋ
／ｑ＝0.086 ｍＶ／℃であるから、ｎ、Ｒ1 およびＲ2
の値を適当に選ぶことによって、第１項の温度係数を＋
２ｍＶ／℃に設定することができる。
【００２２】一方、第２項の温度係数は、−２ｍＶ／℃
になり、この項は電流ＩO の変化に影響されるが、これ
に伴う順方向降下電圧ＶF の変化は微小であり、その温
度変化分を第１項に持たせることも可能である。たとえ
ば、−25℃から＋75℃の電流変化分は、Ｉ（＋75℃）／
Ｉ（−25℃）＝７／５＝2.9 ｄＢとなるが、これに伴う
ＶF の変化は９ｍＶであり、これに対し、電流が一定で
ある場合のＶF の温度変化は、200 ｍＶであるから、殆
ど無視できる程度の値である。
になり、この項は電流ＩO の変化に影響されるが、これ
に伴う順方向降下電圧ＶF の変化は微小であり、その温
度変化分を第１項に持たせることも可能である。たとえ
ば、−25℃から＋75℃の電流変化分は、Ｉ（＋75℃）／
Ｉ（−25℃）＝７／５＝2.9 ｄＢとなるが、これに伴う
ＶF の変化は９ｍＶであり、これに対し、電流が一定で
ある場合のＶF の温度変化は、200 ｍＶであるから、殆
ど無視できる程度の値である。
【００２３】この結果、抵抗３２に発生する正の温度係
数（２ｍＶ／℃）を持つ電圧降下と、ダイオード３４に
発生する負の温度係数（−２ｍＶ／℃）を持つ順方向降
下電圧ＶF との合成値、たとえば、1.2 Ｖが基準電圧と
して出力端子３６から取出すことができる。すなわち、
発生する基準電圧は、バンドギャップ電圧1.2 Ｖとな
る。
数（２ｍＶ／℃）を持つ電圧降下と、ダイオード３４に
発生する負の温度係数（−２ｍＶ／℃）を持つ順方向降
下電圧ＶF との合成値、たとえば、1.2 Ｖが基準電圧と
して出力端子３６から取出すことができる。すなわち、
発生する基準電圧は、バンドギャップ電圧1.2 Ｖとな
る。
【００２４】また、式(2) から明らかなように、電源電
圧Ｖccが関係していないことから、その値が変化して
も、トランジスタ２０、２２、２４で構成される定電流
回路は、カレントミラー比や抵抗３０、３２の抵抗値が
変化しない限り、一定電流が得られる。
圧Ｖccが関係していないことから、その値が変化して
も、トランジスタ２０、２２、２４で構成される定電流
回路は、カレントミラー比や抵抗３０、３２の抵抗値が
変化しない限り、一定電流が得られる。
【００２５】このため、電源電圧が変動しても安定した
定電圧特性が得られ、内部回路として定電流回路を設置
しているので、従来のバンドギャップ回路のように定電
流回路を別途設置する必要がなく、半導体集積回路によ
って一体的に構成できるので、回路構成も比較的簡略化
できる利点がある。
定電圧特性が得られ、内部回路として定電流回路を設置
しているので、従来のバンドギャップ回路のように定電
流回路を別途設置する必要がなく、半導体集積回路によ
って一体的に構成できるので、回路構成も比較的簡略化
できる利点がある。
【００２６】そして、第１の実施形態では、第１のトラ
ンジスタ２０、第３のトランジスタ２８をそれぞれダイ
オード構成としたが、図２に示す第２の実施形態のよう
に、トランジスタ２０、２８を通常のトランジスタと
し、第２のトランジスタ２２、第４のトランジスタ２６
をダイオード構成としてもよく、同様の効果が得られ
る。
ンジスタ２０、第３のトランジスタ２８をそれぞれダイ
オード構成としたが、図２に示す第２の実施形態のよう
に、トランジスタ２０、２８を通常のトランジスタと
し、第２のトランジスタ２２、第４のトランジスタ２６
をダイオード構成としてもよく、同様の効果が得られ
る。
【００２７】また、図１および図２に示す実施形態で
は、起動回路についての説明を省略しているが、図３に
示すように、トランジスタ３９および抵抗４０からなる
起動回路を付加することにより、トランジスタ２０、２
２から起動電流としてベース電流をトランジスタ３９側
に引き込んで起動を行なうことにより適正な動作を得る
ことができる。
は、起動回路についての説明を省略しているが、図３に
示すように、トランジスタ３９および抵抗４０からなる
起動回路を付加することにより、トランジスタ２０、２
２から起動電流としてベース電流をトランジスタ３９側
に引き込んで起動を行なうことにより適正な動作を得る
ことができる。
【００２８】
【発明の効果】以上説明したように、この発明によれ
ば、温度係数を持たない基準電圧を形成できるととも
に、電源電圧の変動による影響を回避することができ、
従来回路のような定電流回路を別途設置する必要がな
く、回路構成の簡略化をも図ることができる。
ば、温度係数を持たない基準電圧を形成できるととも
に、電源電圧の変動による影響を回避することができ、
従来回路のような定電流回路を別途設置する必要がな
く、回路構成の簡略化をも図ることができる。
【００２９】また、起動回路を備えて起動電流を流すこ
とにより、起動がより良好になって適正な動作を実現す
ることができる。
とにより、起動がより良好になって適正な動作を実現す
ることができる。
【図１】この発明の基準電圧回路の第１の実施形態を示
す回路図である。
す回路図である。
【図２】この発明の基準電圧回路の第２の実施形態を示
す回路図である。
す回路図である。
【図３】起動回路を付加した基準電圧回路を示す回路図
である。
である。
【図４】従来の基準電圧回路を示す回路図である。
２０ 第１のトランジスタ ２２ 第２のトランジスタ ２４ 第５のトランジスタ ２６ 第４のトランジスタ ２８ 第３のトランジスタ ３０、３２ 抵抗 ３４ ダイオード
Claims (2)
- 【請求項１】 電源側に第１及び第２のトランジスタの
エミッタを接続し、前記第２のトランジスタのベース・
コレクタに前記第１のトランジスタのベースを接続して
なる第１のカレントミラー回路が設置されるとともに、
前記第２のトランジスタのベース・コレクタ側に第３の
トランジスタのコレクタを接続し、前記第１のトランジ
スタのコレクタに第４のトランジスタのベース・コレク
タを接続し、前記第３のトランジスタのベースと前記第
４のトランジスタのベース・コレクタを共通に接続し、
前記第３のトランジスタのエミッタ面積を前記第４のト
ランジスタのエミッタ面積より大きく設定した第２のカ
レントミラー回路が設置され、前記第３のトランジスタ
のエミッタと接地点との間に抵抗を接続して電流を発生
する電流源と、 この電流源の前記第１のトランジスタのベースにベース
を共通に接続するとともに、前記電源側にエミッタを接
続し、前記第１及び第２のカレントミラー回路に流れる
電流を取り出す第５のトランジスタと、 この第５のトランジスタのコレクタと前記接地点との間
に抵抗及びダイオードからなる回路を直列に接続して前
記電流を流すことにより、前記第５のトランジスタのコ
レクタ側から温度係数を持たない基準電圧を取り出す出
力回路と、 を備えたことを特徴とする基準電圧回路。 - 【請求項２】 前記第１及び第２のトランジスタに起動
電流を流す起動回路を備えたことを特徴とする請求項１
記載の基準電圧回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16494196A JPH08339232A (ja) | 1996-06-25 | 1996-06-25 | 基準電圧回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16494196A JPH08339232A (ja) | 1996-06-25 | 1996-06-25 | 基準電圧回路 |
Related Parent Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59105793A Division JPH0789304B2 (ja) | 1984-05-25 | 1984-05-25 | 基準電圧回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08339232A true JPH08339232A (ja) | 1996-12-24 |
Family
ID=15802767
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16494196A Pending JPH08339232A (ja) | 1996-06-25 | 1996-06-25 | 基準電圧回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH08339232A (ja) |
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2000070421A1 (en) * | 1999-05-17 | 2000-11-23 | Maxim Integrated Products, Inc. | Low voltage current sources and methods |
| JP2005234674A (ja) * | 2004-02-17 | 2005-09-02 | Ricoh Co Ltd | 基準電圧発生回路 |
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