JPH06165212A - ビデオ信号処理用集積回路 - Google Patents
ビデオ信号処理用集積回路Info
- Publication number
- JPH06165212A JPH06165212A JP31674392A JP31674392A JPH06165212A JP H06165212 A JPH06165212 A JP H06165212A JP 31674392 A JP31674392 A JP 31674392A JP 31674392 A JP31674392 A JP 31674392A JP H06165212 A JPH06165212 A JP H06165212A
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- circuit
- digital
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- conversion
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Abstract
(57)【要約】
【目的】 本発明は、ビデオ信号処理用集積回路内にＹ
信号用Ｄ／Ａ変換回路とＣ信号用Ｄ／Ａ変換回路を内蔵
する場合のＹ信号とＣ信号の干渉を防止することを目的
とする。 【構成】 デジタル変換されたビデオ信号を外部接続さ
れたラインメモリを用いて輝度信号Ｙと色信号Ｃを分離
するライン間Ｙ／Ｃ分離回路とフレームメモリを用いて
輝度信号Ｙと色信号Ｃを分離するフレーム間Ｙ／Ｃ分離
回路を含むデジタル信号処理回路１３と、デジタル信号
処理回路から出力されるデジタルＹ信号とデジタルＣ信
号を各々アナログＹ信号とアナログＣ信号に変換するＹ
信号用Ｄ／Ａ変換回路１４及びＣ信号用Ｄ／Ａ変換回路
１５が同一集積回路上に集積されたビデオ信号処理用集
積回路において、Ｃ信号用Ｄ／Ａ変換回路１５の最小デ
ジタルビットに対応する電流源ＳC1の電流値ＩC1は、Ｙ
信号用Ｄ／Ａ変換回路１４の最小デジタルビットに対応
する電流源ＳY1の電流値ＩY1より小さく設定される。
信号用Ｄ／Ａ変換回路とＣ信号用Ｄ／Ａ変換回路を内蔵
する場合のＹ信号とＣ信号の干渉を防止することを目的
とする。 【構成】 デジタル変換されたビデオ信号を外部接続さ
れたラインメモリを用いて輝度信号Ｙと色信号Ｃを分離
するライン間Ｙ／Ｃ分離回路とフレームメモリを用いて
輝度信号Ｙと色信号Ｃを分離するフレーム間Ｙ／Ｃ分離
回路を含むデジタル信号処理回路１３と、デジタル信号
処理回路から出力されるデジタルＹ信号とデジタルＣ信
号を各々アナログＹ信号とアナログＣ信号に変換するＹ
信号用Ｄ／Ａ変換回路１４及びＣ信号用Ｄ／Ａ変換回路
１５が同一集積回路上に集積されたビデオ信号処理用集
積回路において、Ｃ信号用Ｄ／Ａ変換回路１５の最小デ
ジタルビットに対応する電流源ＳC1の電流値ＩC1は、Ｙ
信号用Ｄ／Ａ変換回路１４の最小デジタルビットに対応
する電流源ＳY1の電流値ＩY1より小さく設定される。
Description
【０００１】
【産業上の利用分野】本発明は、ＮＴＳＣ方式またはＰ
ＡＬ方式あるいはこれらに準拠したテレビジョンに使用
される集積回路に関し、特に、コンポジットビデオ信号
を輝度信号と色信号に分離する集積回路に関する。
ＡＬ方式あるいはこれらに準拠したテレビジョンに使用
される集積回路に関し、特に、コンポジットビデオ信号
を輝度信号と色信号に分離する集積回路に関する。
【０００２】
【従来の技術】近年、カラーテレビ受像機の各種性能
が、目覚ましい技術革新により大幅に改善されてきてい
る。特に、高画質化のなかでの最大のポイントは、高解
像度化であり、この高解像度化に大きく貢献しているの
がデジタル信号処理技術である。例えば、クリアビジョ
ン（ＩＤＴＶ）と呼ばれるテレビジョンでは、Ｙ／Ｃ分
離、ＹＣ処理、色復調、走査線補間、動き検出などが、
デジタル信号処理によって行われ、これらの集積回路化
が進んでいる。
が、目覚ましい技術革新により大幅に改善されてきてい
る。特に、高画質化のなかでの最大のポイントは、高解
像度化であり、この高解像度化に大きく貢献しているの
がデジタル信号処理技術である。例えば、クリアビジョ
ン（ＩＤＴＶ）と呼ばれるテレビジョンでは、Ｙ／Ｃ分
離、ＹＣ処理、色復調、走査線補間、動き検出などが、
デジタル信号処理によって行われ、これらの集積回路化
が進んでいる。
【０００３】図２は、従来のＩＤＴＶに用いられる動き
適応型三次元Ｙ／Ｃ分離回路のブロック図である。アナ
ログのコンポジットビデオ信号ＶSは、Ａ／Ｄ変換回路
１において、カラーバースト信号に同期したクロック信
号によって８ビットのデジタル信号に変換される。変換
されたデジタルビデオ信号は、ラインメモリ２及び３を
使用したライン間Ｙ／Ｃ分離回路４によって、デジタル
Ｙ信号とデジタルＣ信号に分離される。更に、変換され
たデジタルビデオ信号は、フレームメモリ５を使用した
フレーム間Ｙ／Ｃ分離回路６によってデジタルＹ信号と
デジタルＣ信号に分離される。ライン間Ｙ／Ｃ分離回路
４の出力とフレーム間Ｙ／Ｃ分離回路６の出力は、切り
換え回路７によって選択され、デジタルＹ信号はＹ信号
用Ｄ／Ａ変換回路８に出力され、デジタルＣ信号はＣ信
号用Ｄ／Ａ変換回路９に出力される。切り換え回路７を
制御する動き検出回路１０は、動画と静止画にそれぞれ
適したライン間Ｙ／Ｃ分離回路４とフレーム間Ｙ／Ｃ分
離回路６を選択するための回路であり、画素毎に動きを
検出しそれに応じたデジタルＹ信号とデジタルＣ信号を
選択する。検出の方法は、基本的には、輝度信号の低域
成分の１フレーム間差信号と色信号の２フレーム間差信
号をもとに動きを検出して、更にその動きの信号のノイ
ズ成分を除去したり、画像のエッジ付近でのジッタ成分
による動きを抑圧することによって最適な動き信号を作
り出す。
適応型三次元Ｙ／Ｃ分離回路のブロック図である。アナ
ログのコンポジットビデオ信号ＶSは、Ａ／Ｄ変換回路
１において、カラーバースト信号に同期したクロック信
号によって８ビットのデジタル信号に変換される。変換
されたデジタルビデオ信号は、ラインメモリ２及び３を
使用したライン間Ｙ／Ｃ分離回路４によって、デジタル
Ｙ信号とデジタルＣ信号に分離される。更に、変換され
たデジタルビデオ信号は、フレームメモリ５を使用した
フレーム間Ｙ／Ｃ分離回路６によってデジタルＹ信号と
デジタルＣ信号に分離される。ライン間Ｙ／Ｃ分離回路
４の出力とフレーム間Ｙ／Ｃ分離回路６の出力は、切り
換え回路７によって選択され、デジタルＹ信号はＹ信号
用Ｄ／Ａ変換回路８に出力され、デジタルＣ信号はＣ信
号用Ｄ／Ａ変換回路９に出力される。切り換え回路７を
制御する動き検出回路１０は、動画と静止画にそれぞれ
適したライン間Ｙ／Ｃ分離回路４とフレーム間Ｙ／Ｃ分
離回路６を選択するための回路であり、画素毎に動きを
検出しそれに応じたデジタルＹ信号とデジタルＣ信号を
選択する。検出の方法は、基本的には、輝度信号の低域
成分の１フレーム間差信号と色信号の２フレーム間差信
号をもとに動きを検出して、更にその動きの信号のノイ
ズ成分を除去したり、画像のエッジ付近でのジッタ成分
による動きを抑圧することによって最適な動き信号を作
り出す。
【０００４】このような動き適応型三次元Ｙ／Ｃ分離回
路を採用することによって、ドット妨害（色信号が輝度
信号に混入し、上下の色の境界に点状の妨害が発生する
現象）やクロスカラー（縞状の色がつく現象）を防止す
ることができる。従来は、ライン間Ｙ／Ｃ分離回路４、
フレーム間Ｙ／Ｃ分離回路６、切り換え回路７が１つの
集積回路、動き検出回路１０が１つの集積回路に集積さ
れ、ラインメモリ２及び３、フレームメモリ６、Ａ／Ｄ
変換回路１、及び、Ｄ／Ａ変換回路８及び９が外部接続
された構成であった。最近では、集積回路の微細化プロ
セスの進展により、集積度が向上し、動き適応型三次元
Ｙ／Ｃ分離回路のビデオ信号処理をする集積回路内にＡ
／Ｄ変換回路１やＤ／Ａ変換回路８及び９を内蔵するこ
とが可能になった。
路を採用することによって、ドット妨害（色信号が輝度
信号に混入し、上下の色の境界に点状の妨害が発生する
現象）やクロスカラー（縞状の色がつく現象）を防止す
ることができる。従来は、ライン間Ｙ／Ｃ分離回路４、
フレーム間Ｙ／Ｃ分離回路６、切り換え回路７が１つの
集積回路、動き検出回路１０が１つの集積回路に集積さ
れ、ラインメモリ２及び３、フレームメモリ６、Ａ／Ｄ
変換回路１、及び、Ｄ／Ａ変換回路８及び９が外部接続
された構成であった。最近では、集積回路の微細化プロ
セスの進展により、集積度が向上し、動き適応型三次元
Ｙ／Ｃ分離回路のビデオ信号処理をする集積回路内にＡ
／Ｄ変換回路１やＤ／Ａ変換回路８及び９を内蔵するこ
とが可能になった。
【０００５】
【発明が解決しようとする課題】しかし、同一のビデオ
信号処理用集積回路内に複数のＤ／Ａ変換回路を内蔵し
た場合、互いの信号間の干渉が問題となった。特に、分
離されたＹ信号とＣ信号をＤ／Ａ変換した場合、Ｃ信号
は特定周波数の色搬送波上で変調された信号であるた
め、これがＹ信号に干渉すると、水平同期信号などの様
々な成分と結合してビートを発生し、これがテレビ画面
上に周期的な縞模様状の妨害として現れた。このような
干渉によるビート妨害を抑えるためには、集積回路のパ
ターン設計において細心の注意と経験を要する。また、
設計段階で干渉を防ぐ合理的な手法が確率されていない
ため、集積回路が完成した後、その特性評価の結果によ
ってパターン・レイアウトの調整を要するので、非常に
繁雑であった。
信号処理用集積回路内に複数のＤ／Ａ変換回路を内蔵し
た場合、互いの信号間の干渉が問題となった。特に、分
離されたＹ信号とＣ信号をＤ／Ａ変換した場合、Ｃ信号
は特定周波数の色搬送波上で変調された信号であるた
め、これがＹ信号に干渉すると、水平同期信号などの様
々な成分と結合してビートを発生し、これがテレビ画面
上に周期的な縞模様状の妨害として現れた。このような
干渉によるビート妨害を抑えるためには、集積回路のパ
ターン設計において細心の注意と経験を要する。また、
設計段階で干渉を防ぐ合理的な手法が確率されていない
ため、集積回路が完成した後、その特性評価の結果によ
ってパターン・レイアウトの調整を要するので、非常に
繁雑であった。
【０００６】
【課題を解決するための手段】本発明は、上述した点に
鑑みて創作されたものであり、Ｙ信号用Ｄ／Ａ変換回路
とＣ信号用Ｄ／Ａ変換回路を各々デジタルデータに対応
して重み付けされた電流源を備えた電流加算型Ｄ／Ａ変
換回路で構成し、Ｃ信号用Ｄ／Ａ変換回路の最小デジタ
ルビットに対応する電流源の電流値がＹ信号用Ｄ／Ａ変
換回路の最小デジタルビットに対応する電流源の電流値
より小さく設定されることを特徴とする。
鑑みて創作されたものであり、Ｙ信号用Ｄ／Ａ変換回路
とＣ信号用Ｄ／Ａ変換回路を各々デジタルデータに対応
して重み付けされた電流源を備えた電流加算型Ｄ／Ａ変
換回路で構成し、Ｃ信号用Ｄ／Ａ変換回路の最小デジタ
ルビットに対応する電流源の電流値がＹ信号用Ｄ／Ａ変
換回路の最小デジタルビットに対応する電流源の電流値
より小さく設定されることを特徴とする。
【０００７】
【作用】Ｃ信号用Ｄ／Ａ変換回路の最小デジタルビット
に対応する電流源の電流値がＹ信号用Ｄ／Ａ変換回路の
最小デジタルビットに対応する電流源の電流値より小さ
くなるために、Ｃ信号の電流全体が圧縮される。従っ
て、Ｃ信号用Ｄ／Ａ変換回路に流れる電流がＹ信号用Ｄ
／Ａ変換回路に漏れる総量を少なくすることができるの
で、ビート妨害が減少する。
に対応する電流源の電流値がＹ信号用Ｄ／Ａ変換回路の
最小デジタルビットに対応する電流源の電流値より小さ
くなるために、Ｃ信号の電流全体が圧縮される。従っ
て、Ｃ信号用Ｄ／Ａ変換回路に流れる電流がＹ信号用Ｄ
／Ａ変換回路に漏れる総量を少なくすることができるの
で、ビート妨害が減少する。
【０００８】
【実施例】図１は、本発明の実施例を示すブロック図で
あり、動き適応型三次元Ｙ／Ｃ分離回路である。図にお
いて、集積回路１１には、アナログのコンポジットビデ
オ信号ＶSを８ビットのデジタル信号に変換するＡ／Ｄ
変換回路１２と、変換された８ビットのデジタル信号を
処理し、分離されたデジタルＹ信号とデジタルＣ信号を
出力するデジタル信号処理回路１３と、デジタルＹ信号
をアナログのＹ信号に変換するＹ信号用Ｄ／Ａ変換回路
１４と、デジタルＣ信号をアナログのＣ信号に変換する
Ｃ信号用Ｄ／Ａ変換回路１５が集積化される。ここで、
デジタル信号処理回路１３は、図２に示されたライン間
Ｙ／Ｃ分離回路４とフレーム間Ｙ／Ｃ分離回路６と切り
換え回路７を少なくとも含むものであり、場合によって
は動き検出回路１０をも含む。このデジタル信号処理回
路１３にはラインメモリ１６及び１７とフレームメモリ
１８が外部接続される。
あり、動き適応型三次元Ｙ／Ｃ分離回路である。図にお
いて、集積回路１１には、アナログのコンポジットビデ
オ信号ＶSを８ビットのデジタル信号に変換するＡ／Ｄ
変換回路１２と、変換された８ビットのデジタル信号を
処理し、分離されたデジタルＹ信号とデジタルＣ信号を
出力するデジタル信号処理回路１３と、デジタルＹ信号
をアナログのＹ信号に変換するＹ信号用Ｄ／Ａ変換回路
１４と、デジタルＣ信号をアナログのＣ信号に変換する
Ｃ信号用Ｄ／Ａ変換回路１５が集積化される。ここで、
デジタル信号処理回路１３は、図２に示されたライン間
Ｙ／Ｃ分離回路４とフレーム間Ｙ／Ｃ分離回路６と切り
換え回路７を少なくとも含むものであり、場合によって
は動き検出回路１０をも含む。このデジタル信号処理回
路１３にはラインメモリ１６及び１７とフレームメモリ
１８が外部接続される。
【０００９】Ｙ信号用Ｄ／Ａ変換回路１４は、８ビット
のデジタル信号に応じて重み付けされた電流源ＳY1〜Ｓ
Y8と、スイッチＳＷY1〜ＳＷY8と、印加されたデジタル
Ｙ信号に基づいてスイッチＳＷY1〜ＳＷY8のオン及びオ
フを制御する制御回路１４−１とから構成され、スイッ
チＳＷY1〜ＳＷY8の一端が共通に接続され、アナログＹ
信号出力となる。
のデジタル信号に応じて重み付けされた電流源ＳY1〜Ｓ
Y8と、スイッチＳＷY1〜ＳＷY8と、印加されたデジタル
Ｙ信号に基づいてスイッチＳＷY1〜ＳＷY8のオン及びオ
フを制御する制御回路１４−１とから構成され、スイッ
チＳＷY1〜ＳＷY8の一端が共通に接続され、アナログＹ
信号出力となる。
【００１０】一方、Ｃ信号用Ｄ／Ａ変換回路１５もＹ信
号用Ｄ／Ａ変換回路１４と同様の構成であり、８ビット
のデジタル信号に応じて重み付けされた電流源ＳC1〜Ｓ
C8と、スイッチＳＷC1〜ＳＷC8と、印加されたデジタル
Ｃ信号に基づいてスイッチＳＷC1〜ＳＷC8のオン及びオ
フを制御する制御回路１５−１から構成され、スイッチ
ＳＷC1〜ＳＷC8の一端が共通に接続され、アナログＣ信
号出力となる。
号用Ｄ／Ａ変換回路１４と同様の構成であり、８ビット
のデジタル信号に応じて重み付けされた電流源ＳC1〜Ｓ
C8と、スイッチＳＷC1〜ＳＷC8と、印加されたデジタル
Ｃ信号に基づいてスイッチＳＷC1〜ＳＷC8のオン及びオ
フを制御する制御回路１５−１から構成され、スイッチ
ＳＷC1〜ＳＷC8の一端が共通に接続され、アナログＣ信
号出力となる。
【００１１】ここで、Ｃ信号用Ｄ／Ａ変換回路１５の最
小ビットに対応する電流源ＳC1の電流値ＩC1は、Ｙ信号
用Ｄ／Ａ変換回路１４の最小ビットに対応する電流源Ｓ
Y1の電流値ＩY1より小さく設定される。例えば、ＩC1の
電流をＩY1の電流の１／２に設定すると、全体的にＣ信
号用Ｄ／Ａ変換回路１５に流れる電流は、Ｙ信号用Ｄ／
Ａ変換回路１４に流れる電流の１／２になる。従って、
Ｃ信号用Ｄ／Ａ変換回路１５に流れる電流がＹ信号用Ｄ
／Ａ変換回路１４に漏れる量を少なくすることができ
る。
小ビットに対応する電流源ＳC1の電流値ＩC1は、Ｙ信号
用Ｄ／Ａ変換回路１４の最小ビットに対応する電流源Ｓ
Y1の電流値ＩY1より小さく設定される。例えば、ＩC1の
電流をＩY1の電流の１／２に設定すると、全体的にＣ信
号用Ｄ／Ａ変換回路１５に流れる電流は、Ｙ信号用Ｄ／
Ａ変換回路１４に流れる電流の１／２になる。従って、
Ｃ信号用Ｄ／Ａ変換回路１５に流れる電流がＹ信号用Ｄ
／Ａ変換回路１４に漏れる量を少なくすることができ
る。
【００１２】また、Ｃ信号は、Ｙ信号に比べて最高周波
数帯域が低いため、Ｄ／Ａ変換の最小単位電流を減少さ
せてもＣ信号用Ｄ／Ａ変換回路１５の動作帯域上の影響
は少ない。一方、Ｙ信号は帯域が広いため、Ｃ信号用Ｄ
／Ａ変換回路１５への妨害は目立たない。さらに、集積
回路上においてＹ信号用Ｄ／Ａ変換回路１４とＣ信号用
Ｄ／Ａ変換回路１５の配置を離間し、パター設計上の対
策も施すことにより、本発明の効果を有効に生かすこと
ができる。
数帯域が低いため、Ｄ／Ａ変換の最小単位電流を減少さ
せてもＣ信号用Ｄ／Ａ変換回路１５の動作帯域上の影響
は少ない。一方、Ｙ信号は帯域が広いため、Ｃ信号用Ｄ
／Ａ変換回路１５への妨害は目立たない。さらに、集積
回路上においてＹ信号用Ｄ／Ａ変換回路１４とＣ信号用
Ｄ／Ａ変換回路１５の配置を離間し、パター設計上の対
策も施すことにより、本発明の効果を有効に生かすこと
ができる。
【００１３】
【発明の効果】上述の如く、本発明によれば、Ｙ信号用
Ｄ／Ａ変換回路１４とＣ信号用Ｄ／Ａ変換回路１５を内
蔵するビデオ信号処理用集積回路において、Ｄ／Ａ変換
回路間のビート妨害を低減できるため、より高画質を実
現できるものである。さらに、集積回路のパターン設計
が容易になり、集積回路完成までの時間が短縮される利
点を有している。
Ｄ／Ａ変換回路１４とＣ信号用Ｄ／Ａ変換回路１５を内
蔵するビデオ信号処理用集積回路において、Ｄ／Ａ変換
回路間のビート妨害を低減できるため、より高画質を実
現できるものである。さらに、集積回路のパターン設計
が容易になり、集積回路完成までの時間が短縮される利
点を有している。
【図１】本発明の実施例を示すブロック図である。
【図２】従来のビデオ信号処理回路を示すブロック図で
ある。
ある。
１１ 集積回路 １２ Ａ／Ｄ変換回路 １３ デジタル信号処理回路 １４ Ｙ信号用Ｄ／Ａ変換回路 １５ Ｃ信号用Ｄ／Ａ変換回路 １６、１７ ラインメモリ １８ フレームメモリ
Claims (1)
- 【請求項１】 デジタル変換されたビデオ信号を外部接
続されたラインメモリを用いて輝度信号Ｙと色信号Ｃを
分離するライン間Ｙ／Ｃ分離回路、及び／又は、フレー
ムメモリを用いて輝度信号Ｙと色信号Ｃを分離するフレ
ーム間Ｙ／Ｃ分離回路と、前記ライン間Ｙ／Ｃ分離回路
及び又はフレーム間Ｙ／Ｃ分離回路から出力されるデジ
タルＹ信号とデジタルＣ信号を各々アナログＹ信号とア
ナログＣ信号に変換するＹ信号用Ｄ／Ａ変換回路及びＣ
信号用Ｄ／Ａ変換回路が同一集積回路上に集積されたビ
デオ信号処理用集積回路において、前記Ｙ信号用Ｄ／Ａ
変換回路とＣ信号用Ｄ／Ａ変換回路は、各々デジタルデ
ータに対応して重み付けされた電流源を備えた電流加算
型Ｄ／Ａ変換回路で構成され、前記Ｃ信号用Ｄ／Ａ変換
回路の最小デジタルビットに対応する電流源の電流値
は、前記Ｙ信号用Ｄ／Ａ変換回路の最小デジタルビット
に対応する電流源の電流値より小さく設定されることを
特徴とするビデオ信号処理用集積回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31674392A JPH06165212A (ja) | 1992-11-26 | 1992-11-26 | ビデオ信号処理用集積回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31674392A JPH06165212A (ja) | 1992-11-26 | 1992-11-26 | ビデオ信号処理用集積回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06165212A true JPH06165212A (ja) | 1994-06-10 |
Family
ID=18080414
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP31674392A Pending JPH06165212A (ja) | 1992-11-26 | 1992-11-26 | ビデオ信号処理用集積回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06165212A (ja) |
Cited By (17)
| Publication number | Priority date | Publication date | Assignee | Title |
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| US11930263B2 (en) | 2021-01-25 | 2024-03-12 | Corephotonics Ltd. | Slim pop-out wide camera lenses |
| US11947247B2 (en) | 2020-12-01 | 2024-04-02 | Corephotonics Ltd. | Folded camera with continuously adaptive zoom factor |
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-
1992
- 1992-11-26 JP JP31674392A patent/JPH06165212A/ja active Pending
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