Nothing Special   »   [go: up one dir, main page]

JP6305492B1 - DC-DC converter - Google Patents

DC-DC converter Download PDF

Info

Publication number
JP6305492B1
JP6305492B1 JP2016214080A JP2016214080A JP6305492B1 JP 6305492 B1 JP6305492 B1 JP 6305492B1 JP 2016214080 A JP2016214080 A JP 2016214080A JP 2016214080 A JP2016214080 A JP 2016214080A JP 6305492 B1 JP6305492 B1 JP 6305492B1
Authority
JP
Japan
Prior art keywords
transformer
current
converter
voltage
surge suppression
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2016214080A
Other languages
Japanese (ja)
Other versions
JP2018074818A (en
Inventor
真央 川村
真央 川村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP2016214080A priority Critical patent/JP6305492B1/en
Application granted granted Critical
Publication of JP6305492B1 publication Critical patent/JP6305492B1/en
Publication of JP2018074818A publication Critical patent/JP2018074818A/en
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Landscapes

  • Dc-Dc Converters (AREA)

Abstract

【課題】カレントトランスを電流検知用として使用しつつ、カレントトランスのインダクンタス成分を使って、二次側ダイオードのリカバリサージ電圧を抑制するDC−DCコンバータを得る。【解決手段】トランス4と直列に電流を検知するカレントトランス3を接続することにより、カレントトランス3のインダクタ成分で半導体スイッチング素子Q1、Q2、Q3、Q4のスイッチング時のdi/dtを抑制すると共に、第1の整流ダイオード5、第2の整流ダイオード6のリカバリ電流に起因するサージのエネルギーを第1のサージ抑制ダイオード1および第2のサージ抑制ダイオード2によりバイパスする。【選択図】図1A DC-DC converter that suppresses a recovery surge voltage of a secondary diode using an inductance component of a current transformer while using the current transformer for current detection. By connecting a current transformer 3 that detects current in series with a transformer 4, the inductor component of the current transformer 3 suppresses di / dt during switching of semiconductor switching elements Q1, Q2, Q3, and Q4. The energy of surge caused by the recovery current of the first rectifier diode 5 and the second rectifier diode 6 is bypassed by the first surge suppression diode 1 and the second surge suppression diode 2. [Selection] Figure 1

Description

この発明は、DC−DCコンバータに関し、特には高電圧から低電圧へ降圧して大きな電力を伝送する絶縁型のDC−DCコンバータに関するものである。   The present invention relates to a DC-DC converter, and more particularly to an isolated DC-DC converter that transmits a large amount of power by stepping down from a high voltage to a low voltage.

近年においては、環境にやさしい自動車として電気自動車やハイブリッド自動車が開発されている。このような自動車は、従来の自動車同様に制御回路を動作させる補機用電池に加え、その電力により走行モータを動作させる駆動用電池を有している。このため、補機用電池に加えて駆動用電池を充電する必要がある。例えば、電気自動車の電動モータに電力を供給するための駆動用電池から補機用電池の充電を行うために必要な直流変換装置として絶縁降圧型のDC−DCコンバータ(以下、降圧コンバータ)がある。   In recent years, electric vehicles and hybrid vehicles have been developed as environmentally friendly vehicles. Such an automobile has a driving battery for operating a traveling motor by the electric power in addition to an auxiliary battery for operating a control circuit like a conventional automobile. For this reason, it is necessary to charge the driving battery in addition to the auxiliary battery. For example, there is an insulated step-down DC-DC converter (hereinafter referred to as a step-down converter) as a direct-current converter required for charging an auxiliary battery from a driving battery for supplying electric power to an electric motor of an electric vehicle. .

カーメーカーから降圧コンバータの小型化・低コスト化が望まれており、降圧コンバータの小型化、低コスト化のためには、トランス、リアクトル等の磁性部品の小型化が必須であり、スイッチング周波数の高周波化が望まれる。しかしながら、高周波駆動に伴い、ダイオードのリカバリ損失の増大、サージ電圧の増大等の問題が生じる。このため、素子の耐圧増加、損失増加、および電磁的な不干渉性および耐性、即ちEMC(Electro-Magnetic Compatibility)の悪化が懸念され、降圧コンバータの二次側整流回路に発生するサージ電圧を抑制することが求められる。   Miniaturization and cost reduction of step-down converters are desired by car manufacturers. To reduce the size and cost of step-down converters, it is essential to reduce the size of magnetic components such as transformers and reactors. Higher frequency is desired. However, with high frequency driving, problems such as increased recovery loss of the diode and increased surge voltage occur. For this reason, there is a concern that the breakdown voltage of the element will increase, the loss will increase, and electromagnetic incoherence and resistance, that is, EMC (Electro-Magnetic Compatibility) will deteriorate, and the surge voltage generated in the secondary side rectifier circuit of the step-down converter will be suppressed. It is required to do.

そこで、従来技術として、例えば国際公開WO2007/000830号公報(特許文献1)に開示されているように、絶縁トランスと、この絶縁トランスの一次巻線に直列接続されたゼロ電圧スイッチング用の共振コイルを備え、位相シフト制御で駆動されるフルブリッジ方式のスイッチング回路において、第1および第2の回生ダイオードを、絶縁トランスと共振コイルとの間に接続することによりサージ電圧を抑制するDC−DCコンバータが知られている。   Therefore, as disclosed in, for example, International Publication WO2007 / 000830 (Patent Document 1), an insulation transformer and a resonance coil for zero voltage switching connected in series to a primary winding of the insulation transformer. DC-DC converter that suppresses surge voltage by connecting first and second regenerative diodes between an isolation transformer and a resonance coil in a full-bridge switching circuit driven by phase shift control It has been known.

国際公開第WO2007/000830号International Publication No. WO2007 / 000830

しかしながら、特許文献1に開示された従来技術は位相シフト制御が前提であるため、共振リアクトルが必要となり、ハードスイッチング構成でこの回路を適用すると、共振リアクトル分のコスト、サイズが増加する。また、コンバータ回路には過電流保護のため、電流検知用のセンサ回路が必要であり、一次側の電流センサにカレントトランスを使用する場合は、カレントトランスのインダクタンス成分を考慮する必要がある。   However, since the prior art disclosed in Patent Document 1 is based on the premise of phase shift control, a resonant reactor is required. When this circuit is applied in a hard switching configuration, the cost and size of the resonant reactor increase. Further, the converter circuit requires a current detection sensor circuit for overcurrent protection. When a current transformer is used as the primary current sensor, it is necessary to consider the inductance component of the current transformer.

例えば、カレントトランスをフルブリッジ回路の前段に設ける場合は、スイッチング素子のターンオフ時にカレントトランスのインダクタンス成分によるサージ電圧が発生することになり、上記特許文献1に開示された従来技術の回路においてもこのサージ電圧を考慮しなければならない。このため、高周波化に伴い、カレントトランスによるサージ電圧が無視できなくなり、1次側素子の高耐圧化が必要になり、コストが増大する。一方、カレントトランス以外の方法として、ホール式の素子タイプの電流センサが考えられるが高価である。   For example, when the current transformer is provided in the front stage of the full bridge circuit, a surge voltage due to the inductance component of the current transformer is generated when the switching element is turned off. This is also the case with the prior art circuit disclosed in Patent Document 1. Surge voltage must be taken into account. For this reason, as the frequency increases, the surge voltage due to the current transformer cannot be ignored, and it is necessary to increase the breakdown voltage of the primary side element, which increases the cost. On the other hand, as a method other than the current transformer, a Hall type element type current sensor can be considered, but it is expensive.

この発明は、上記のような課題を解決するためになされたものであり、カレントトランスを電流検知用として使用しつつ、カレントトランスのインダクンタス成分を使って、二次側ダイオードのリカバリサージ電圧を抑制するDC−DCコンバータを得ることを目的とするものである。   The present invention has been made to solve the above-described problems, and suppresses the recovery surge voltage of the secondary diode using the current transformer's inductor component while using the current transformer for current detection. It is an object to obtain a DC-DC converter.

この発明に係るDC/DCコンバータは、入力電源と、一次巻線および二次巻線を備えた絶縁トランスと、上記一次巻線に直列に接続され、電流を検知するカレントトランスと、上記一次巻線と上記カレントトランスとの直列回路に接続されたフルブリッジ方式の半導体スイッチング回路と、上記二次巻線に接続された整流回路と、を有するDC−DCコンバータにおいて、
上記DC−DCコンバータは、上記一次巻線に接続された第1のサージ抑制ダイオードと第2のサージ抑制ダイオードとを備え、
上記カレントトランスと上記一次巻線との接続点に、上記第1のサージ抑制ダイオードのアノード端子と上記第2のサージ抑制ダイオードのカソード端子が接続され、
上記第1のサージ抑制ダイオードのカソード端子は、上記入力電源の正側に接続されると共に、上記第2のサージ抑制ダイオードのアノード端子は、上記入力電源の負側に接続されたことを特徴とする。
The DC / DC converter according to the present invention includes an input power supply, an insulating transformer having a primary winding and a secondary winding, a current transformer connected in series to the primary winding and detecting a current, and the primary winding. In a DC-DC converter having a full-bridge semiconductor switching circuit connected to a series circuit of a line and the current transformer, and a rectifier circuit connected to the secondary winding,
The DC-DC converter includes a first surge suppression diode and a second surge suppression diode connected to the primary winding,
An anode terminal of the first surge suppression diode and a cathode terminal of the second surge suppression diode are connected to a connection point between the current transformer and the primary winding,
The cathode terminal of the first surge suppression diode is connected to the positive side of the input power supply, and the anode terminal of the second surge suppression diode is connected to the negative side of the input power supply. To do.

また、この発明に係るDC/DCコンバータは、入力電源と、一次巻線および二次巻線を備えたトランスと、上記一次巻線に直列に接続され、電流を検知するカレントトランスと、上記一次巻線と上記カレントトランスとの直列回路に接続された2つの半導体スイッチング素子を備えたハーフブリッジ方式の半導体スイッチング回路と、上記二次巻線に接続された整流回路と、を有するDC−DCコンバータにおいて、
上記DC−DCコンバータは、上記一次巻線に接続された第1のサージ抑制ダイオードと第2のサージ抑制ダイオードとを備えると共に、上記カレントトランスの一端は上記2つの半導体スイッチング素子の間に接続され、他端が上記一次巻線に接続され、
上記カレントトランスと上記一次巻線との接続点に、上記第1のサージ抑制ダイオードのアノード端子と上記第2のサージ抑制ダイオードのカソード端子が接続され、
上記第1のサージ抑制ダイオードのカソード端子は、上記入力電源の正側に接続されると共に、上記第2のサージ抑制ダイオードのアノード端子は、上記入力電源の負側に接続されたことを特徴とする。
Further, DC / DC converter according to the present invention, an input power source, a transformer having a primary winding and a secondary winding, connected in series with the primary winding, a current transformer for detecting a current, the A DC-DC having a half-bridge type semiconductor switching circuit having two semiconductor switching elements connected to a series circuit of a primary winding and the current transformer, and a rectifier circuit connected to the secondary winding In the converter
The DC-DC converter, Rutotomoni comprises a first surge suppression diode and the second surge suppression diode connected to the primary winding, one end of the current transformer is connected between the two semiconductor switching elements The other end is connected to the primary winding,
An anode terminal of the first surge suppression diode and a cathode terminal of the second surge suppression diode are connected to a connection point between the current transformer and the primary winding,
The cathode terminal of the first surge suppression diode is connected to the positive side of the input power supply, and the anode terminal of the second surge suppression diode is connected to the negative side of the input power supply. To do.

この発明に係るDC/DCコンバータによれば、カレントトランスは電流検出機能を保ちつつ、サージ抑制機能を保有することができ、部品の簡素化が可能となり、その結果、より低損失で変換効率がよく、冷却装置などの放熱手段を簡素化できて小型化できるDC−DCコンバータを得ることができる。   According to the DC / DC converter according to the present invention, the current transformer can have a surge suppression function while maintaining a current detection function, and the parts can be simplified. As a result, conversion efficiency can be reduced with lower loss. It is possible to obtain a DC-DC converter that can simplify the heat dissipation means such as a cooling device and can be downsized.

この発明の実施の形態1に係るDC−DCコンバータの概略構成図である。It is a schematic block diagram of the DC-DC converter which concerns on Embodiment 1 of this invention. この発明の実施の形態1に係るDC―DCコンバータの半導体スイッチング素子の動作を示す説明図である。It is explanatory drawing which shows operation | movement of the semiconductor switching element of the DC-DC converter which concerns on Embodiment 1 of this invention. この発明の実施の形態1に係るDC−DCコンバータの動作時における各電圧電流波形を示す説明図である。It is explanatory drawing which shows each voltage current waveform at the time of operation | movement of the DC-DC converter which concerns on Embodiment 1 of this invention. この発明の実施の形態1に係るDC−DCを説明するための、フルブリッジ構成の半導体スイッチング素子とコンデンサとダイオードとで構成された一般的なDC−DCコンバータの回路図である。BRIEF DESCRIPTION OF THE DRAWINGS FIG. 1 is a circuit diagram of a general DC-DC converter composed of a full-bridge semiconductor switching element, a capacitor, and a diode for explaining DC-DC according to Embodiment 1 of the present invention; 図4における各半導体スイッチング素子がオン/オフしているときの電流経路を示す説明図である。FIG. 5 is an explanatory diagram showing a current path when each semiconductor switching element in FIG. 4 is turned on / off. 図4における各半導体スイッチング素子がオン/オフしているときの電流経路を示す説明図である。FIG. 5 is an explanatory diagram showing a current path when each semiconductor switching element in FIG. 4 is turned on / off. 図4における各半導体スイッチング素子がオン/オフしているときの電流経路を示す説明図である。FIG. 5 is an explanatory diagram showing a current path when each semiconductor switching element in FIG. 4 is turned on / off. 図4における整流用ダイオードの電流および電圧の経時変化を示す説明図である。FIG. 5 is an explanatory diagram showing temporal changes in current and voltage of the rectifying diode in FIG. 4. この発明の実施の形態1に係るDC−DCコンバータの各半導体スイッチング素子がオン/オフしているときの電流経路を示す説明図である。It is explanatory drawing which shows a current pathway when each semiconductor switching element of the DC-DC converter which concerns on Embodiment 1 of this invention is turned on / off. この発明の実施の形態1に係るDC−DCコンバータの整流用ダイオードの電流および電圧の経時変化を示す説明図である。It is explanatory drawing which shows the time-dependent change of the electric current and voltage of the rectifier diode of the DC-DC converter which concerns on Embodiment 1 of this invention. この発明の実施の形態2に係るDC−DCコンバータの概略構成図である。It is a schematic block diagram of the DC-DC converter which concerns on Embodiment 2 of this invention. この発明の実施の形態2に係るDC―DCコンバータの半導体スイッチング素子の動作を示す説明図である。It is explanatory drawing which shows operation | movement of the semiconductor switching element of the DC-DC converter which concerns on Embodiment 2 of this invention. この発明の実施の形態2に係るDC−DCコンバータの各半導体スイッチング素子がオン/オフしているときの電流経路を示す説明図である。It is explanatory drawing which shows a current pathway when each semiconductor switching element of the DC-DC converter which concerns on Embodiment 2 of this invention is turned on / off. この発明の実施の形態2に係るDC−DCコンバータの変形例を示す概略構成図である。It is a schematic block diagram which shows the modification of the DC-DC converter which concerns on Embodiment 2 of this invention.

以下、この発明に係るDC−DCコンバータの好適な実施の形態について図面を参照して説明する。なお、図面の説明においては、同一部分には同一符号を付し、重複する説明を省略する。   Preferred embodiments of a DC-DC converter according to the present invention will be described below with reference to the drawings. In the description of the drawings, the same portions are denoted by the same reference numerals, and redundant description is omitted.

実施の形態1.
図1は、この発明の実施の形態1に係るDC−DCコンバータの概略構成図である。図1に示すように、実施の形態1に係るDC−DCコンバータは、入力電圧Vの電圧をDC−DCコンバータにより絶縁し、任意の出力電圧Vを出力する。電気自動車やハイブリッド自動車においては、入力側には駆動用電池が接続され、出力側には補機用電池が接続される。
Embodiment 1 FIG.
1 is a schematic configuration diagram of a DC-DC converter according to Embodiment 1 of the present invention. As shown in FIG. 1, a DC-DC converter according to the first embodiment, the voltage of the input voltage V i is insulated by the DC-DC converter, and outputs any output voltage V o. In an electric vehicle or a hybrid vehicle, a driving battery is connected to the input side, and an auxiliary battery is connected to the output side.

DC−DCコンバータは、4つの半導体スイッチング素子(以下、スイッチング素子)Q1〜Q4と、2つのサージ抑制ダイオード、即ち、第1のサージ抑制ダイオード1および第2のサージ抑制ダイオード2と、電流を検知するカレントトランス3と、センタータップを有するトランス4と、2つの整流ダイオード、即ち、第1の整流ダイオード5および第2の整流ダイオード6と、平滑リアクトル7と、平滑コンデンサ8を備えて構成されている。   The DC-DC converter detects four semiconductor switching elements (hereinafter referred to as switching elements) Q1 to Q4, two surge suppression diodes, that is, a first surge suppression diode 1 and a second surge suppression diode 2, and a current. Current transformer 3, a transformer 4 having a center tap, two rectifier diodes, that is, a first rectifier diode 5 and a second rectifier diode 6, a smoothing reactor 7, and a smoothing capacitor 8. Yes.

次に、制御回路部9には、信号線10a、10bにより、それぞれ入力電圧検出回路11、出力電圧検出回路12で検出された電圧が入力される。また、カレントトランス3は、巻数比が1:nで構成されており、2次側は制御回路部9に接続されており、電流情報を電圧情報として制御回路部9に出力する。制御部13は通信線14aにより、制御回路部9から入力電圧検出回路11、出力電圧検出回路12の電圧情報、カレントトランス3による電流情報を取得する。また、制御部13は通信線14bにより、制御回路部9に対して制御指令を出力する。制御回路部9は制御部13からの制御指令に基づいて、ゲート駆動信号線15a〜15dにより、スイッチング素子Q1〜Q4をそれぞれ所定のデッドタイムを挟んでオン・オフ制御する。   Next, the voltages detected by the input voltage detection circuit 11 and the output voltage detection circuit 12 are input to the control circuit unit 9 through the signal lines 10a and 10b, respectively. Further, the current transformer 3 is configured with a turns ratio of 1: n, the secondary side is connected to the control circuit unit 9, and outputs current information to the control circuit unit 9 as voltage information. The control unit 13 acquires the voltage information of the input voltage detection circuit 11 and the output voltage detection circuit 12 and the current information by the current transformer 3 from the control circuit unit 9 through the communication line 14a. Further, the control unit 13 outputs a control command to the control circuit unit 9 through the communication line 14b. Based on a control command from the control unit 13, the control circuit unit 9 performs on / off control of the switching elements Q1 to Q4 with a predetermined dead time by the gate drive signal lines 15a to 15d.

入力電圧Vの後段には、4つのスイッチング素子Q1〜Q4が接続されており、例えば、これらのスイッチング素子Q1〜Q4として、MOSFETを用いることができる。また、スイッチング素子Q1、Q3のドレインは、入力電圧Vの正側に接続され、スイ
ッチング素子Q2、Q4のソースは、入力電圧Vの負側に接続される。
The subsequent stage of the input voltage V i, 4 one has switching elements Q1 to Q4 are connected, for example, as the switching elements Q1 to Q4, it is possible to use MOSFET. The drain of the switching element Q1, Q3 is connected to the positive side of the input voltage V i, the source of the switching elements Q2, Q4 is connected to the negative side of the input voltage V i.

トランス4の一次巻線の一端はカレントトランス3に接続され、他端はスイッチング素子Q1のソースとスイッチング素子Q2のドレインとの接続点に接続される。また、カレントトランス3の他端はスイッチング素子Q3のソースとスイッチング素子Q4のドレインとの接続点に接続される。   One end of the primary winding of the transformer 4 is connected to the current transformer 3, and the other end is connected to a connection point between the source of the switching element Q1 and the drain of the switching element Q2. The other end of the current transformer 3 is connected to a connection point between the source of the switching element Q3 and the drain of the switching element Q4.

カレントトランス3とトランス4の接続点には、第1のサージ抑制ダイオード1のアノード端子が接続され、第1のサージ抑制ダイオード1のカソード端子は入力電圧Vの正側に接続される。また、カレントトランス3とトランス4との接続点には、第2のサージ抑制ダイオード2のカソード端子が接続され、第2のサージ抑制ダイオード2のアノード端子は入力電圧Vの負側に接続されている。 The connection point of the current transformer 3 and the transformer 4, a first anode terminal of the surge suppressor diode 1 is connected, a first cathode terminal of the surge suppression diode 1 is connected to the positive side of the input voltage V i. Further, the connection point of the current transformer 3 and the transformer 4, a second cathode terminal of the surge suppression diode 2 is connected, a second anode terminal of the surge suppression diode 2 is connected to the negative side of the input voltage V i ing.

トランス4の二次側巻線に第1の整流ダイオード5と第2の整流ダイオード6を備えており、また、トランス4の二次側巻線に設けられた中間タップが出力電圧Vの負側に接続されている。トランス4の二次側巻線の両端には、それぞれ第1の整流ダイオード5、第2の整流ダイオード6のアノード端子が接続されている。また、第1の整流ダイオード5のカソード端子と第2の整流ダイオード6のカソード端子はそれぞれ接続されており、その接続点と出力電圧Vの正側が接続されている。 The secondary winding of the transformer 4 includes a first rectifier diode 5 and a second rectifier diode 6, and an intermediate tap provided in the secondary winding of the transformer 4 has a negative output voltage V o . Connected to the side. The anode terminals of the first rectifier diode 5 and the second rectifier diode 6 are connected to both ends of the secondary winding of the transformer 4, respectively. The positive side of the first cathode terminal of the cathode terminal and the second rectifying diode 6 of the rectifier diode 5 are connected respectively, the output voltage V o and the connection point is connected.

次に、実施の形態1に係るDC−DCコンバータの基本的な動作について、図2および図3を参照しながら説明する。なお、実施の形態1において例示するDC−DCコンバータは、一般的なフルブリッジ構成のDC−DCコンバータであり、スイッチング方式がハードスイッチング方式であるものを採用している。   Next, the basic operation of the DC-DC converter according to Embodiment 1 will be described with reference to FIGS. Note that the DC-DC converter exemplified in the first embodiment is a DC-DC converter having a general full-bridge configuration, and adopts a switching system that is a hard switching system.

図2は、実施の形態1に係るDC−DCコンバータのスイッチング素子Q1〜Q4の動作を示す説明図である。なお、図2中のTdcはスイッチング周期を示しており、tはデッドタイムを示している。 FIG. 2 is an explanatory diagram illustrating operations of the switching elements Q1 to Q4 of the DC-DC converter according to the first embodiment. In FIG. 2, T dc indicates a switching period, and t d indicates a dead time.

図2に示すように、スイッチング素子Q1、Q4をオンする場合、トランス4の一次側巻線(一次側)に流れる電流は、スイッチング素子Q1→トランス4(一次側)→カレントトランス3→スイッチング素子Q4の順に各経路を流れる。また、トランス4は、一次側から二次側に電力を伝達する。続いて、トランス4の二次側巻線(二次側)に流れる電流は、トランス4(二次側)→第2の整流ダイオード6→平滑リアクトル7の順に各経路を流れる。   As shown in FIG. 2, when switching elements Q1 and Q4 are turned on, the current flowing through the primary winding (primary side) of transformer 4 is switching element Q1 → transformer 4 (primary side) → current transformer 3 → switching element. Each route flows in the order of Q4. The transformer 4 transmits power from the primary side to the secondary side. Subsequently, the current flowing through the secondary winding (secondary side) of the transformer 4 flows through each path in the order of the transformer 4 (secondary side) → the second rectifier diode 6 → the smoothing reactor 7.

同様に、スイッチング素子Q2、Q3をオンする場合、トランス4の一次側に流れる電流は、スイッチング素子Q3→カレントトランス3→トランス4(一次側)→スイッチング素子Q2の順に各経路を流れる。続いて、トランス4の二次側巻線に流れる電流は、トランス4(二次側)→第1の整流ダイオード5→平滑リアクトル7の順に各経路を流れる。   Similarly, when the switching elements Q2 and Q3 are turned on, the current flowing to the primary side of the transformer 4 flows through each path in the order of the switching element Q3 → the current transformer 3 → the transformer 4 (primary side) → the switching element Q2. Subsequently, the current flowing through the secondary winding of the transformer 4 flows through each path in the order of the transformer 4 (secondary side) → the first rectifier diode 5 → the smoothing reactor 7.

図3は、実施の形態1に係るDC−DCコンバータの動作時における各電圧電流波形を示す説明図である。ここで、図3中の記号を次のように定義する。
tr1:トランス4の一次側電圧
tr1:トランス4の一次側電流
tr2:トランス4の二次側電圧
out:平滑リアクトル7に流れる電流
FIG. 3 is an explanatory diagram showing voltage and current waveforms during the operation of the DC-DC converter according to the first embodiment. Here, the symbols in FIG. 3 are defined as follows.
V tr1 : Transformer 4 primary side voltage I tr1 : Transformer 4 primary side current V tr2 : Transformer 4 secondary side voltage I out : Current flowing through the smoothing reactor 7

次に、第1の整流ダイオード5、第2の整流ダイオード6のリカバリによるサージが発
生するメカニズムについて、図4〜図8を参照しながら説明する。
図4は、実施の形態1に係るDC−DCコンバータを説明するための一般的な従来のDC−DCコンバータの回路図であって、フルブリッジ構成のスイッチング素子Q1〜Q4と、第1の整流ダイオード5、第2の整流ダイオード6とで構成された回路図である。ここで、トランス4の漏れインダクタンス成分、配線のインダクタンス成分をまとめてリアクトル40としており、その他の図1と同一部分には同一符号を付している。
Next, a mechanism for generating a surge due to recovery of the first rectifier diode 5 and the second rectifier diode 6 will be described with reference to FIGS.
FIG. 4 is a circuit diagram of a general conventional DC-DC converter for explaining the DC-DC converter according to the first embodiment. FIG. 4 shows switching elements Q1 to Q4 having a full bridge configuration and the first rectification. 3 is a circuit diagram including a diode 5 and a second rectifier diode 6. FIG. Here, the leakage inductance component of the transformer 4 and the inductance component of the wiring are collectively referred to as a reactor 40, and the other parts that are the same as in FIG.

図5から図7は、図4におけるスイッチング素子Q1〜Q4がオン/オフしているときの電流経路を示す説明図である。また、図5(a)〜図7(e)は、図4におけるDC−DCコンバータの回路を流れる電流経路の経時変化を示す図であり、図8は、図4における第1の整流ダイオード5の電流(≒ID5)および電圧(≒VD5)の経時変化を示す説明図である。 5 to 7 are explanatory diagrams showing current paths when the switching elements Q1 to Q4 in FIG. 4 are turned on / off. FIGS. 5A to 7E are diagrams showing the change over time of the current path flowing through the circuit of the DC-DC converter in FIG. 4, and FIG. 8 is the first rectifier diode 5 in FIG. It is explanatory drawing which shows the time-dependent change of the electric current (≒ ID5 ) and voltage (≒ VD5 ).

時刻t0において、スイッチング素子Q2、Q3がオン、スイッチング素子Q1、Q4がオフであるとき、トランス8の一次側および二次側に流れる各電流の経路は、図5(a)に矢印で示す経路となる。   At time t0, when the switching elements Q2 and Q3 are on and the switching elements Q1 and Q4 are off, the path of each current flowing through the primary side and the secondary side of the transformer 8 is a path indicated by an arrow in FIG. It becomes.

時刻t1において、スイッチング素子Q1〜Q4が全てオフになると、トランス4の一次側には電流が流れなくなる(実際は励磁電流などが流れるがここでは無視する)。
一方、トランス4の二次側には、平滑リアクトル7により直前(時刻t1以前)と同方向の電流が流れ続ける。これは、コイルで磁束の変化が発生すると、その磁束の変化を妨げるような方向に磁束が発生して誘導起電力が生じるというレンツの法則によるものであり、スイッチング素子Q1〜Q4が全てオフの瞬間においては、平滑リアクトル7は定電流源に相当する。また、スイッチング素子Q1〜Q4が全てオフであり、トランス4の一次側には電圧が発生しないので、トランス4の二次側にも電圧が発生しない。そのため、平滑リアクトル7を流れる電流の経路は、図5(b)に矢印で示す経路となる。
When all the switching elements Q1 to Q4 are turned off at time t1, no current flows on the primary side of the transformer 4 (actually an exciting current etc. flows but is ignored here).
On the other hand, the current in the same direction as immediately before (before time t1) continues to flow on the secondary side of the transformer 4 by the smoothing reactor 7. This is due to Lenz's law that when a change in the magnetic flux occurs in the coil, the magnetic flux is generated in a direction that prevents the change in the magnetic flux and an induced electromotive force is generated, and the switching elements Q1 to Q4 are all turned off. In the instant, the smoothing reactor 7 corresponds to a constant current source. Further, since all the switching elements Q1 to Q4 are off and no voltage is generated on the primary side of the transformer 4, no voltage is generated on the secondary side of the transformer 4. Therefore, the path of the current flowing through the smoothing reactor 7 is a path indicated by an arrow in FIG.

また、図8に示すように、時刻t=t1において、第1の整流ダイオード5の電流ID5(以下、電流ID5)の大きさがIであり、第1の整流ダイオード5の電圧VD5(以下、電圧VD5)の大きさがVである。 Further, as shown in FIG. 8, at time t = t1, the magnitude of the current I D5 (hereinafter, current I D5 ) of the first rectifier diode 5 is IF , and the voltage V of the first rectifier diode 5 D5 (hereinafter, voltage V D5) the size of which is V F.

時刻t2において、スイッチング素子Q1、Q4がオンになったとき、トランス4の一次側に電圧が発生するので、トランス4の二次側にも電圧が発生しようとする。しかしながら、平滑リアクトル7を流れる電流は、第1の整流ダイオード5、第2の整流ダイオード6に流れている(図6(c)中の破線矢印に相当)ので、トランス4の二次側では事実上短絡されることになる。このような場合、トランス4の二次側に流れる電流の経路は、図6(c)に示す実線矢印の経路となる。なお、図6(c)において、時刻t2から時間が経過するに従って、第2の整流ダイオード6に流れる電流が徐々に増加していく一方、第1の整流ダイオード5に流れる電流が減少していく。   At time t2, when the switching elements Q1 and Q4 are turned on, a voltage is generated on the primary side of the transformer 4, so that a voltage is also generated on the secondary side of the transformer 4. However, since the current flowing through the smoothing reactor 7 flows through the first rectifier diode 5 and the second rectifier diode 6 (corresponding to the broken-line arrow in FIG. 6C), the fact is present on the secondary side of the transformer 4. The top will be short-circuited. In such a case, the path of the current flowing on the secondary side of the transformer 4 is a path indicated by a solid arrow shown in FIG. In FIG. 6C, as time elapses from time t2, the current flowing through the second rectifier diode 6 gradually increases while the current flowing through the first rectifier diode 5 decreases. .

また、図8に示すように、時刻t2において、時刻t1と同様に、電流ID5の大きさがIであり、電圧VD5の大きさがVである。 Further, as shown in FIG. 8, at time t2, similarly to the time t1, the magnitude of the current I D5 is I F, the magnitude of the voltage V D5 is V F.

時刻t2から時間が経過するに従って、第1の整流ダイオード5の電流が減少し、順方向電流が0A以下となった瞬間、第1の整流ダイオード5には、リカバリ電流(または逆回復電流)が流れる。そして、第1の整流ダイオード5に流れるリカバリ電流の経路は、図6(d)に実線矢印で示す経路となる。なお、第1の整流ダイオード5において、順バイアスが与えられているオン状態から、バイアス方向(極性)が変化して逆バイアスが与えられても、蓄積されたキャリアによって通電が可能な状態がある。   As time elapses from time t2, the current of the first rectifier diode 5 decreases, and at the moment when the forward current becomes 0 A or less, the first rectifier diode 5 has a recovery current (or reverse recovery current). Flowing. The path of the recovery current flowing through the first rectifier diode 5 is the path indicated by the solid line arrow in FIG. Note that the first rectifier diode 5 can be energized by accumulated carriers even when a reverse bias is applied by changing the bias direction (polarity) from the ON state in which the forward bias is applied. .

また、図8に示すように、時刻t2から時間が経過するに従って、電流ID5の大きさがIから減少していき、0となる。このような場合、リカバリ電流が流れるので、電流ID5の大きさが0となった時刻から時間が経過するに従って、この大きさが0から増加していき、時刻t3では最大となる。さらに、時刻t2から時間が経過するに従って、電圧VD5の大きさがVから減少していき、時刻t3では0となる。 Further, as shown in FIG. 8, in accordance with a lapse of time from the time t2, the magnitude of the current I D5 is gradually decreased from I F, becomes zero. In such a case, since the recovery current flows, the magnitude increases from 0 as time elapses from the time when the magnitude of the current ID5 becomes 0, and becomes maximum at time t3. Further, according to the lapse of time from the time t2, the magnitude of the voltage V D5 gradually decreases from V F, a 0 at time t3.

このリカバリ電流は、トランス4の一次側にも流れる。ここで、第1の整流ダイオード5において、リカバリ動作過程では、蓄積されたキャリアが減少するにつれて、リカバリ電流が減少していき、最終的に流れなくなる。しかしながら、このリカバリ電流の減少率(=di/dt)とリアクトル40のインダクタンス成分(=L)によって、サージ電圧V(=L×di/dt)が発生する。このため、トランス電圧Vtr1には入力電圧(≒V)の電圧に加えこのサージ電圧Vが印加される。
:入力電圧
di/dt:整流ダイオードリカバリ電流の減少率
di’/dt:トランス4の一次側に流れる整流ダイオードリカバリ電流の減少率
N:トランス巻線比(N:1:1)
L:リアクトル40のインダクタンス成分
とすると、リカバリ発生時にトランス4の一次側に印加される電圧Vtr1は、次式(1)となる。
This recovery current also flows to the primary side of the transformer 4. Here, in the first rectifier diode 5, in the recovery operation process, as the accumulated carriers decrease, the recovery current decreases and finally does not flow. However, the surge voltage V L (= L × di / dt) is generated by the reduction rate of the recovery current (= di / dt) and the inductance component (= L) of the reactor 40. For this reason, the surge voltage V L is applied to the transformer voltage V tr1 in addition to the input voltage (≈V i ).
V i : Input voltage di / dt: Decreasing rate of rectifying diode recovery current di ′ / dt: Decreasing rate of rectifying diode recovery current flowing on the primary side of transformer 4 N: Transformer winding ratio (N: 1: 1)
L: Assuming that the inductance component of the reactor 40 is used, the voltage V tr1 applied to the primary side of the transformer 4 when recovery occurs is expressed by the following equation (1).

Figure 0006305492
Figure 0006305492

このため、トランス4の2次側に発生する電圧はVtr2は、次式(2)となる。 For this reason, the voltage V tr2 generated on the secondary side of the transformer 4 is expressed by the following equation (2).

Figure 0006305492
Figure 0006305492

このとき、トランス4はセンタータップ構造のため、第1の整流ダイオード5はトランス2次側電圧の2倍の電圧が印加される。このため、第1の整流ダイオード5の電圧VD5は、次式(3)となる。 At this time, since the transformer 4 has a center tap structure, a voltage twice as large as the transformer secondary side voltage is applied to the first rectifier diode 5. For this reason, the voltage V D5 of the first rectifier diode 5 is expressed by the following equation (3).

Figure 0006305492
Figure 0006305492

トランス4の1次側電圧Vtr1にはリアクトル40のインダクタンス成分によるサージ電圧Vと、入力電圧の電圧Vを合計した合計電圧Vtr1(=V+V)が印加され、トランス4の2次側電圧Vtr2には、トランス4の一次側電圧を1/N倍した電圧が発生し、第1の整流ダイオード5にはトランス4の2次側電圧Vtr2の2倍の電圧が印加される。例えば、時刻t4において、第1の整流ダイオード5の両端には、図7(e)に示すように、サージ電圧Vと、平滑コンデンサ8の電圧(V/2)を2×1/N倍した電圧が発生する。 The primary voltage V tr1 of the transformer 4 is applied with a total voltage V tr1 (= V i + V L ) obtained by summing the surge voltage V L due to the inductance component of the reactor 40 and the input voltage V i . the secondary voltage V tr2, the primary voltage of the transformer 4 1 / N times the voltage is generated twice the voltage of the first secondary voltage V tr2 of the transformer 4 to the rectifying diode 5 is applied Is done. For example, at time t4, as shown in FIG. 7E, the surge voltage V L and the voltage (V i / 2) of the smoothing capacitor 8 are 2 × 1 / N at both ends of the first rectifier diode 5. Doubled voltage is generated.

また、図8に示すように、時刻t3から時間が経過するに従って、電流ID5の大きさが減少していき、時刻t4以降で最終的に0となる。さらに、時刻t3から時間が経過するに従って、電圧VD5の大きさが0から増加していき、時刻t4ではサージ電圧Vの大きさが最大となるので、電圧VD5の大きさが最大となる。そして、時刻t4以降で電圧VD5の大きさが減少していき、最終的に入力電圧Vを2×1/N倍したものと同等となる。以上がサージ発生のメカニズムである。 Further, as shown in FIG. 8, as time elapses from time t3, the magnitude of current ID5 decreases and finally becomes 0 after time t4. Furthermore, as time elapses from time t3, the voltage V D5 increases from 0, and at time t4, the magnitude of the surge voltage V L becomes maximum, so that the voltage V D5 increases to the maximum. Become. Then, gradually decreases the magnitude of the voltage V D5 at time t4, the final input voltage V i becomes equal to 2 × 1 / N those times. The above is the mechanism of surge generation.

このように、DC−DCコンバータの第1の整流ダイオード5、第2の整流ダイオード6には、過大なサージ電圧が発生するので、一般的には、サージ電圧を抑制する回路が必要となる。しかしながら、スナバ回路を使用すると抵抗による発熱のため効率が悪化する。また、前述したように、従来技術に記載されているように、別途共振用スナバ回路を設けることは高コストである。   As described above, an excessive surge voltage is generated in the first rectifier diode 5 and the second rectifier diode 6 of the DC-DC converter, so that a circuit for suppressing the surge voltage is generally required. However, if a snubber circuit is used, the efficiency deteriorates due to heat generated by resistance. Further, as described above, as described in the prior art, it is expensive to separately provide a resonance snubber circuit.

そこで、図1に示すように、実施の形態1に係るDC−DCコンバータにおいては、電流を検知するカレントトランス3をトランス4と直列に挿入することで、カレントトランス3の一次側(主回路側)の励磁インダクタンス成分を使用し、スイッチング素子Q1、Q4とスイッチング素子Q2、Q3のターンオフ、ターンオン時のトランス電流の変化を緩やかにしている。そして、第1の整流ダイオード5および第2の整流ダイオード6のリカバリ電流により発生するカレントトランス3のサージ電圧は、カレントトランス3とトランス4との接続箇所に挿入した第1のサージ抑制ダイオード1および第2のサージ抑制ダイオード2によってサージを抑制し、防止している。   Therefore, as shown in FIG. 1, in the DC-DC converter according to the first embodiment, the current transformer 3 that detects current is inserted in series with the transformer 4, so that the primary side (main circuit side) of the current transformer 3. ), The change of the transformer current at the turn-off and turn-on of the switching elements Q1 and Q4 and the switching elements Q2 and Q3 is moderated. Then, the surge voltage of the current transformer 3 generated by the recovery current of the first rectifier diode 5 and the second rectifier diode 6 is the first surge suppression diode 1 inserted at the connection point between the current transformer 3 and the transformer 4 and Surge is suppressed and prevented by the second surge suppression diode 2.

次に、実施の形態1に係るDC−DCコンバータにおいて、サージが抑制されるメカニズムについて、図9を参照しながら説明する。
図9は、実施の形態1に係るDC−DCコンバータのスイッチング素子Q2、Q3、またはQ1、Q4がオン/オフしているときの電流経路を示す説明図である。また、図9(a)、図9(b)は、DC−DCコンバータの回路を流れる電流経路の経時変化を示す図である。
Next, a mechanism in which surge is suppressed in the DC-DC converter according to Embodiment 1 will be described with reference to FIG.
FIG. 9 is an explanatory diagram illustrating a current path when the switching elements Q2 and Q3 or Q1 and Q4 of the DC-DC converter according to Embodiment 1 are on / off. FIGS. 9A and 9B are diagrams showing a change with time of a current path flowing through the circuit of the DC-DC converter.

図9(a)は、スイッチング素子Q2、Q3がオン、スイッチング素子Q1、Q4がオフになったときの電流経路を図示したものである。上記で説明したとおり、スイッチング素子Q2、Q3がオンになり、第2の整流ダイオード6にはリカバリ電流が流れるが、カレントトランス3のインダクタンス成分により、リカバリ電流の減少率(=di/dt)は抑制される。一方、抑制されたリカバリ電流の減少率(=di/dt)とカレントトランス3のインダクタンス成分(=L)によりサージ電圧Vが発生するが、発生したサージ電圧Vが第1のサージ抑制ダイオード1の電圧Vを上回ったとき、第1のサージ抑制ダイオード1がオンする。つまり、カレントトランス3のサージ電圧はV>Vである期間は、常に、カレントトランス3→第1のサージ抑制ダイオード1→スイッチング素子Q3を流れる電流経路(図9(a)の破線矢印)が存在する。このため、トランス4の1次側電圧には入力電圧Vの直流電圧しか印加されないため、トランス4の二次側電圧にはサージは発生しない。 FIG. 9A illustrates a current path when the switching elements Q2 and Q3 are turned on and the switching elements Q1 and Q4 are turned off. As described above, the switching elements Q2 and Q3 are turned on, and the recovery current flows through the second rectifier diode 6. However, due to the inductance component of the current transformer 3, the reduction rate of the recovery current (= di / dt) is It is suppressed. On the other hand, the surge voltage V L is generated by the reduced rate of recovery current (= di / dt) and the inductance component (= L) of the current transformer 3, and the generated surge voltage V L is the first surge suppression diode. When the voltage Vf of 1 is exceeded, the first surge suppression diode 1 is turned on. That is, during the period in which the surge voltage of the current transformer 3 is VL > Vf , the current path that always flows through the current transformer 3 → the first surge suppression diode 1 → the switching element Q3 (broken arrow in FIG. 9A) Exists. Therefore, since not only the DC voltage of the input voltage V i is the voltage of the primary winding of the transformer 4 is applied, the surge is not generated in the secondary voltage of the transformer 4.

また、図9(b)は、スイッチング素子Q1、Q4がオン、スイッチング素子Q2、Q3がオフになったときの電流経路を図示したものである。カレントトランス3にサージ電圧が発生すると、第2のサージ抑制ダイオード2がオンする。つまり、カレントトランス3のサージ電圧はV>Vである期間は、常に、カレントトランス3→スイッチング素子Q4→第2のサージ抑制ダイオード2の経路で電流が流れる(図9(b)の破線矢印)。このときも、トランス4の1次側には入力電圧Vの直流電圧しか印加されないため、トランス4の二次側電圧にはサージは発生しない。従って、図10に示すように、第1の整流ダイオード5の電流ID5、電圧VD5は、実線で示すような経時変化特性が得られる。 FIG. 9B illustrates a current path when the switching elements Q1 and Q4 are turned on and the switching elements Q2 and Q3 are turned off. When a surge voltage is generated in the current transformer 3, the second surge suppression diode 2 is turned on. That is, during the period in which the surge voltage of the current transformer 3 is V L > V f , current always flows through the path of the current transformer 3 → the switching element Q4 → the second surge suppression diode 2 (the broken line in FIG. 9B). Arrow). In this case, since not only the DC voltage of the input voltage V i to the primary side of the transformer 4 is applied, the surge is not generated in the secondary voltage of the transformer 4. Therefore, as shown in FIG. 10, the current I D5 and the voltage V D5 of the first rectifier diode 5 have time-varying characteristics as indicated by the solid line.

以上から、実施の形態1に係るDC−DCコンバータは、低コストで特別なスナバ回路を必要とせず、カレントトランス3のインダクタンス成分と第1のサージ抑制ダイオード1および第2のサージ抑制ダイオード2を設けることで、電流検出の機能とサージ抑制機能を保有する。   From the above, the DC-DC converter according to the first embodiment does not require a special snubber circuit at low cost, and the inductance component of the current transformer 3, the first surge suppression diode 1 and the second surge suppression diode 2 are provided. By providing, it possesses a current detection function and a surge suppression function.

なお、上記実施の形態1では、カレントトランス3はスイッチング素子Q3とQ4の接続点と、トランス4の間に挿入されているが、これに限られるものではなく、例えば、スイッチング素子Q1とQ2の接続点と、トランス4の間に挿入されても良い。   In the first embodiment, the current transformer 3 is inserted between the connection point between the switching elements Q3 and Q4 and the transformer 4. However, the present invention is not limited to this. For example, the current transformer 3 includes the switching elements Q1 and Q2. It may be inserted between the connection point and the transformer 4.

また、上記実施の形態1では、スイッチング方式はハードスイッチングとしたが、これに限るものではなく、ソフトスイッチング方式、例えば位相シフト制御でもよく、この場合、同様の効果を奏するだけでなく、ソフトスイッチングに必要な共振リアクトルをカレントトランス3の励磁インダクタンス成分で補うことが可能となる。   In the first embodiment, the switching method is hard switching. However, the switching method is not limited to this, and a soft switching method, for example, phase shift control may be used. In this case, not only the same effect but also soft switching is achieved. It is possible to supplement the necessary resonance reactor with the exciting inductance component of the current transformer 3.

実施の形態2.
次に、この発明の実施の形態2に係るDC−DCコンバータについて説明する。
図11は、実施の形態2に係るDC−DCコンバータの概略構成図である。図11に示すように、実施の形態2のDC−DCコンバータは、2つのスイッチング素子と、2つのコンデンサを使用したハーフブリッジ構成のDC−DCコンバータである。この構成により、能動素子であるスイッチング素子の数を少なくすることができ、低コスト、小型化に繋がる。
Embodiment 2. FIG.
Next, a DC-DC converter according to Embodiment 2 of the present invention will be described.
FIG. 11 is a schematic configuration diagram of a DC-DC converter according to the second embodiment. As shown in FIG. 11, the DC-DC converter according to the second embodiment is a DC-DC converter having a half bridge configuration using two switching elements and two capacitors. With this configuration, the number of switching elements that are active elements can be reduced, leading to low cost and downsizing.

実施の形態2に係るDC−DCコンバータは、2つのコンデンサ、即ち、第1のコンデンサ90および第2のコンデンサ91と、2つのスイッチング素子Q3およびQ4と、2つのサージ抑制ダイオード、即ち、第1のサージ抑制ダイオード1および第2のサージ抑制ダイオード2と、電流を検知するカレントトランス3と、センタータップを有するトランス4と、2つの整流ダイオード、即ち、第1の整流ダイオード5および第2の整流ダイオード6と、平滑リアクトル7と、平滑コンデンサ8を備えて構成されている。   The DC-DC converter according to the second embodiment includes two capacitors, that is, a first capacitor 90 and a second capacitor 91, two switching elements Q3 and Q4, and two surge suppression diodes, that is, a first capacitor. Surge suppressor diode 1 and second surge suppressor diode 2, current transformer 3 for detecting current, transformer 4 having a center tap, and two rectifier diodes, that is, first rectifier diode 5 and second rectifier A diode 6, a smoothing reactor 7, and a smoothing capacitor 8 are provided.

次に、制御回路部9には、信号線10a、10bにより、それぞれ入力電圧検出回路11、出力電圧検出回路12で検出された電圧が入力される。また、カレントトランス3は巻数比が1:nで構成されており、2次側は制御回路部9に接続され、電流情報を電圧情報として制御回路部9に出力する。制御部13は通信線14aにより、制御回路部9から入力電圧検出回路11、出力電圧検出回路12の電圧情報、カレントトランス3による電流情報を取得する。また、制御部13は通信線14bにより、制御回路部9に対して制御指令を出力する。制御回路部9は制御部13からの制御指令に基づいて、ゲート駆動信号線15c、15dにより、スイッチング素子Q3、Q4をそれぞれ所定のデッドタイムを挟んでオン・オフ制御する。   Next, the voltages detected by the input voltage detection circuit 11 and the output voltage detection circuit 12 are input to the control circuit unit 9 through the signal lines 10a and 10b, respectively. The current transformer 3 is configured with a turns ratio of 1: n, and the secondary side is connected to the control circuit unit 9 and outputs current information to the control circuit unit 9 as voltage information. The control unit 13 acquires the voltage information of the input voltage detection circuit 11 and the output voltage detection circuit 12 and the current information by the current transformer 3 from the control circuit unit 9 through the communication line 14a. Further, the control unit 13 outputs a control command to the control circuit unit 9 through the communication line 14b. Based on a control command from the control unit 13, the control circuit unit 9 performs on / off control of the switching elements Q3 and Q4 with a predetermined dead time by the gate drive signal lines 15c and 15d.

入力電圧Vの後段には、2つのスイッチング素子Q3、Q4が接続されており、例えば、これらのスイッチング素子Q3、Q4として、MOSFETを用いることができる。また、スイッチング素子Q3のドレインは入力電圧Vの正側に接続され、スイッチング素子Q4のソースは入力電圧Vの負側に接続されている。同様に、入力電圧Vの後段には、第1のコンデンサ90、第2のコンデンサ91が接続されており、第1のコンデンサ90の一端は入力電圧Vの正側に接続され、第2のコンデンサ91の一端は入力電圧Vの負側に接続されている。 The subsequent stage of the input voltage V i, 2 two switching elements Q3, Q4 are connected, for example, as the switching elements Q3, Q4, it is possible to use MOSFET. The drain of the switching element Q3 is connected to the positive side of the input voltage V i, the source of the switching element Q4 is connected to the negative side of the input voltage V i. Similarly, a first capacitor 90 and a second capacitor 91 are connected to the subsequent stage of the input voltage V i , and one end of the first capacitor 90 is connected to the positive side of the input voltage V i , one end of the capacitor 91 is connected to the negative side of the input voltage V i.

トランス4の一次巻線の一端はカレントトランス3に接続され、他端は第1のコンデンサ90と第2のコンデンサ91との接続点に接続されている。また、カレントトランス3の他端はスイッチング素子Q3のソースとスイッチング素子Q4のドレインとの接続点に接続されている。   One end of the primary winding of the transformer 4 is connected to the current transformer 3, and the other end is connected to a connection point between the first capacitor 90 and the second capacitor 91. The other end of the current transformer 3 is connected to a connection point between the source of the switching element Q3 and the drain of the switching element Q4.

カレントトランス3とトランス4の接続点には、第1のサージ抑制ダイオード1のアノード端子が接続され、第1のサージ抑制ダイオード1のカソード端子は入力電圧Vの正側に接続されている。一方、カレントトランス3とトランス4との接続点には、第2のサージ抑制ダイオード2のカソード端子が接続され、第2のサージ抑制ダイオード2のアノード端子は入力電圧Vの負側に接続されている。 The connection point of the current transformer 3 and the transformer 4, a first anode terminal of the surge suppressor diode 1 is connected, a first cathode terminal of the surge suppression diode 1 is connected to the positive side of the input voltage V i. On the other hand, the connection point of the current transformer 3 and the transformer 4, a second cathode terminal of the surge suppression diode 2 is connected, a second anode terminal of the surge suppression diode 2 is connected to the negative side of the input voltage V i ing.

次に、実施の形態2に係るDC−DCコンバータの基本的な動作について、図12および図13を参照しながら説明する。なお、実施の形態2において例示するDC−DCコンバータは、一般的なハーフブリッジ構成のDC−DCコンバータであり、スイッチング方式がハードスイッチング方式であるものを採用している。   Next, the basic operation of the DC-DC converter according to Embodiment 2 will be described with reference to FIGS. Note that the DC-DC converter exemplified in the second embodiment is a DC-DC converter having a general half-bridge configuration, and adopts a switching system that is a hard switching system.

図12は、実施の形態2に係るDC/DCコンバータのスイッチング素子の動作を示す説明図である。図12に示すように、スイッチング素子Q3をオンする場合、トランス4の一次側巻線(一次側)に流れる電流は、第1のコンデンサ90→スイッチング素子Q3→カレントトランス3→トランス4(一次側)→第1のコンデンサ90の順に各経路を流れる。また、トランス4は、一次側から二次側に電力を伝達する。続いて、トランス4の二次側巻線(二次側)に流れる電流は、トランス4(二次側)→第1の整流ダイオード5→平滑リアクトル7の順に各経路を流れる。   FIG. 12 is an explanatory diagram showing the operation of the switching element of the DC / DC converter according to the second embodiment. As shown in FIG. 12, when the switching element Q3 is turned on, the current flowing through the primary winding (primary side) of the transformer 4 is the first capacitor 90 → the switching element Q3 → the current transformer 3 → the transformer 4 (primary side). ) → first capacitor 90 in this order. The transformer 4 transmits power from the primary side to the secondary side. Subsequently, the current flowing through the secondary winding (secondary side) of the transformer 4 flows through each path in the order of the transformer 4 (secondary side) → the first rectifier diode 5 → the smoothing reactor 7.

また、スイッチング素子Q4をオンする場合、トランス4の一次側に流れる電流は、第2のコンデンサ91→トランス4→カレントトランス3→スイッチング素子Q4→第2のコンデンサ91の順に各経路を流れる。続いて、トランス4の二次側巻線に流れる電流は、トランス4(二次側)→第2の整流ダイオード6→平滑リアクトル7の順に各経路を流れる。   When the switching element Q4 is turned on, the current flowing on the primary side of the transformer 4 flows through each path in the order of the second capacitor 91 → the transformer 4 → the current transformer 3 → the switching element Q4 → the second capacitor 91. Subsequently, the current flowing through the secondary winding of the transformer 4 flows through each path in the order of the transformer 4 (secondary side) → the second rectifier diode 6 → the smoothing reactor 7.

次に、実施の形態2に係るDC−DCコンバータにおいて、サージが抑制されるメカニズムについて、図13を参照しながら説明する。図13は、実施の形態2に係るDC−DCコンバータのスイッチング素子Q3、Q4がオン/オフしているときの電流経路を示す説明図である。また、図13(a)、図13(b)は、DC−DCコンバータの回路を流れる電流経路の経時変化を示す図である。   Next, the mechanism by which surge is suppressed in the DC-DC converter according to Embodiment 2 will be described with reference to FIG. FIG. 13 is an explanatory diagram showing a current path when the switching elements Q3 and Q4 of the DC-DC converter according to the second embodiment are on / off. FIGS. 13 (a) and 13 (b) are diagrams showing changes over time in the current path flowing through the circuit of the DC-DC converter.

図13(a)はスイッチング素子Q3がオン、スイッチング素子Q4がオフになったときの電流経路を図示したものである。上記で説明したとおり、スイッチング素子Q3がオンになり、第2の整流ダイオード6にはリカバリ電流が流れるが、カレントトランス3のインダクタンス成分によりこのリカバリ電流の減少率(=di/dt)は抑制される。一方、抑制されたリカバリ電流の減少率(=di/dt)とカレントトランス3のインダクタンス成分(=L)によりサージ電圧Vが発生するが、発生したサージ電圧Vが第1
のサージ抑制ダイオード1の電圧Vを上回ったとき、第1のサージ抑制ダイオード1がオンする。つまり、カレントトランス3のサージ電圧はV>Vである期間は、常に、カレントトランス3→第1のサージ抑制ダイオード1→スイッチング素子Q3を流れる電流経路(図13(a)の破線)が存在する。このため、トランス4の1次側には第1のコンデンサ90の直流電圧しか印加されないため、トランス4の二次側電圧にはサージは発生しない。
FIG. 13A illustrates a current path when the switching element Q3 is turned on and the switching element Q4 is turned off. As described above, the switching element Q3 is turned on, and the recovery current flows through the second rectifier diode 6, but the reduction rate (= di / dt) of the recovery current is suppressed by the inductance component of the current transformer 3. The On the other hand, the surge voltage V L is generated by the reduced rate of reduction of the recovery current (= di / dt) and the inductance component (= L) of the current transformer 3, but the generated surge voltage V L is the first.
When exceeding the voltage V F of the surge suppression diode 1, a first surge suppression diode 1 is turned on. In other words, the period surge voltage of the current transformer 3 is a V L> V F is always current transformer 3 → first surge suppression diode 1 → current path through the switching element Q3 (broken line in FIG. 13 (a)) is Exists. For this reason, since only the DC voltage of the first capacitor 90 is applied to the primary side of the transformer 4, no surge occurs in the secondary side voltage of the transformer 4.

また、図13(b)は、スイッチング素子Q4がオン、スイッチング素子Q3がオフになったときの電流経路を図示したものである。カレントトランス3にサージ電圧が発生すると、第2のサージ抑制ダイオード2がオンする。つまり、カレントトランス3のサージ電圧はV>Vである期間は、常に、カレントトランス3→スイッチング素子Q4→第2のサージ抑制ダイオード2の経路で電流が流れる(図13(b)の破線矢印)。このときも、トランス4の1次側には第2のコンデンサ91の直流電圧しか印加されないため、トランス4の二次側電圧にはサージは発生しない。従って、実施の形態1で説明した図10に示すように、第1の整流ダイオード5の電流ID5、電圧VD5は、実線矢印で示すような経時変化特性が得られ、リカバリによるサージ電圧は抑制される。 FIG. 13B shows a current path when the switching element Q4 is turned on and the switching element Q3 is turned off. When a surge voltage is generated in the current transformer 3, the second surge suppression diode 2 is turned on. In other words, the period surge voltage of the current transformer 3 is a V L> V F is always broken line of the current transformer 3 → switching element Q4 → the current flows in the second path of the surge suppression diode 2 (FIG. 13 (b) Arrow). Also at this time, since only the DC voltage of the second capacitor 91 is applied to the primary side of the transformer 4, no surge occurs in the secondary side voltage of the transformer 4. Therefore, as shown in FIG. 10 described in the first embodiment, the current I D5 and the voltage V D5 of the first rectifier diode 5 have the time-varying characteristics as indicated by solid arrows, and the surge voltage due to recovery is It is suppressed.

実施の形態2に係るDC−DCコンバータは、カレントトランス3の一端は、スイッチング素子Q3のソースとスイッチング素子Q4のドレインとの接続点に繋がっており、他端はトランス4に接続されているが、カレントトランス3の一端を第1のコンデンサ90、第2のコンデンサ91の接続点に繋げることはできない。これは、スイッチング素子Q3あるいはQ4がオンしたときに、カレントトランス3のサージ電圧Vが第1のコンデンサ90あるいは第2のコンデンサ91の電圧(≒V/2)+ダイオードの電圧Vを上回るまで、第1のサージ抑制ダイオード1あるいは第2のサージ抑制ダイオード2はオンしないため、少なくとも第1のコンデンサ90あるいは第2のコンデンサ91の電圧までのサージ電圧がトランス4に印加されてしまう。つまり、実施の形態2のハーフブリッジ構成では、カレントトランス3の挿入箇所はスイッチング素子Q3とQ4の接続点と、トランス4の間に接続される必要がある。 In the DC-DC converter according to the second embodiment, one end of the current transformer 3 is connected to a connection point between the source of the switching element Q3 and the drain of the switching element Q4, and the other end is connected to the transformer 4. One end of the current transformer 3 cannot be connected to the connection point between the first capacitor 90 and the second capacitor 91. This means that when the switching element Q3 or Q4 is turned on, the voltage V F of the voltage (≒ V i / 2) + diode of the surge voltage V L of the current transformer 3 is first capacitor 90 or the second capacitor 91 Since the first surge suppression diode 1 or the second surge suppression diode 2 is not turned on until the voltage exceeds, a surge voltage at least up to the voltage of the first capacitor 90 or the second capacitor 91 is applied to the transformer 4. That is, in the half-bridge configuration of the second embodiment, the insertion location of the current transformer 3 needs to be connected between the connection point of the switching elements Q3 and Q4 and the transformer 4.

以上から、実施の形態2に係るDC−DCコンバータは、実施の形態1と同等の効果を奏するだけでなく、スイッチング素子の数を減らせるため、駆動回路を削減でき、より低コスト、小型化を図ることができる。   From the above, the DC-DC converter according to the second embodiment not only has the same effect as the first embodiment, but also can reduce the number of switching elements, so that the drive circuit can be reduced, and the cost and size can be reduced. Can be achieved.

上記実施の形態2では、ハーフブリッジ構成としてスイッチング素子とコンデンサをそれぞれ二つずつ使用した構成としているが、これに限るものではなく、例えば図14に示すように、トランス4に直列にコンデンサ120を挿入する構成にしてもよい。図14の構成にすることで同様のサージ抑制効果を奏するだけでなく、部品点数を削減できる。   In the second embodiment, the half bridge configuration uses two switching elements and two capacitors. However, the present invention is not limited to this. For example, as shown in FIG. You may make it the structure inserted. The configuration shown in FIG. 14 not only provides the same surge suppression effect, but also reduces the number of parts.

上記各実施の形態において、トランス4の二次巻線の中間タップが出力電圧Vの負側に接続され、トランス4の二次側巻線の両端にはそれぞれ第1の整流ダイオード5、第2の整流ダイオード6のアノード端子が接続されているが、これに限るものではなく。中間タップが出力電圧Vの正側に接続され、トランス4の二次側巻線の両端にそれぞれ第1の整流ダイオード5、第2の整流ダイオード6のカソード端子が接続されている構成でもよい。第1の整流ダイオード5のアノード端子と第2の整流ダイオード6のアノード端子はそれぞれ接続されており、その接続点と出力電圧Vの負側が接続される。 In the above embodiments, is connected to the negative side of the intermediate tap output voltage V o of the secondary winding of the transformer 4, a first rectifier diode 5 respectively on both ends of the secondary winding of the transformer 4, the The anode terminals of the two rectifier diodes 6 are connected, but the present invention is not limited to this. Intermediate tap is connected to the positive side of the output voltage V o, the first rectifying diode 5 at both ends of the secondary winding of the transformer 4, the cathode terminal of the second rectifying diode 6 may be a configuration that is connected . The anode terminal of the first rectifier diode 5 and are respectively connected anode terminals of the second rectifier diode 6, the negative side of the connection point output voltage V o is connected.

上記各実施の形態において、DC−DCコンバータに使用する半導体スイッチング素子はシリコン(Si)半導体から成るスイッチング素子に限るものではなく、例えば、半導体スイッチング素子は、Si半導体よりもバンドギャップが広い非Si半導体材料から成るものでもよい。非Si半導体材料であるワイドバンドギャップ半導体としては、例えば
、炭化珪素、窒化ガリウム系材料、またはダイヤモンドがある。
In each of the above embodiments, the semiconductor switching element used in the DC-DC converter is not limited to a switching element made of a silicon (Si) semiconductor. For example, the semiconductor switching element has a band gap wider than that of a Si semiconductor. It may be made of a semiconductor material. Examples of the wide band gap semiconductor that is a non-Si semiconductor material include silicon carbide, a gallium nitride-based material, and diamond.

ワイドバンドギャップ半導体から成るスイッチング素子は、Si半導体ではユニポーラ動作が困難な高電圧領域で使用可能であり、スイッチング時に発生するスイッチング損失を大きく低減でき、電力損失の大きな低減が可能になる。また、電力損失が小さく、耐熱性も高いため、冷却部を備えてパワーモジュールを構成した場合、ヒートシンクの放熱フィンの小型化や、水冷部の空冷化が可能であるので、半導体モジュールの一層の小型化が可能になる。   A switching element made of a wide band gap semiconductor can be used in a high voltage region where it is difficult to perform a unipolar operation with a Si semiconductor, greatly reducing the switching loss generated during switching, and greatly reducing the power loss. In addition, since power loss is small and heat resistance is high, when a power module is configured with a cooling unit, the heat sink fins can be downsized and the water cooling unit can be air-cooled. Miniaturization is possible.

また、ワイドバンドギャップ半導体から成るスイッチング素子は、高周波スイッチング動作に適しており、高周波化の要求が大きいコンバータ回路に適用すると、スイッチング周波数の高周波化によって、コンバータ回路に接続されるリアクトルやコンデンサなどを小型化することもできる。よって、上記各実施の形態における半導体スイッチング素子は、炭化珪素などワイドギャップ半導体から成るスイッチング素子となる場合にも、同様な効果が得られる。   In addition, switching elements made of wide band gap semiconductors are suitable for high-frequency switching operations, and when applied to converter circuits where high frequency requirements are high, the switching frequency increases, so that reactors and capacitors connected to the converter circuit are added. It can also be miniaturized. Therefore, the same effect can be obtained when the semiconductor switching element in each of the above embodiments is a switching element made of a wide gap semiconductor such as silicon carbide.

また、ワイドギャップ半導体のなかでも窒化ガリウム系を材料としたトランジスタ、例えばGAN−HEMTの場合、ドレイン・ソース間の寄生容量(一般的にCossと呼ばれている)は、Si半導体に比べ十分小さく、これを使用することで確保するデッドタイムを短縮でき、引いては実効デューティの改善、高周波化に繋がる。   In addition, in the case of a transistor made of a gallium nitride material among wide gap semiconductors, for example, GAN-HEMT, the parasitic capacitance between the drain and the source (generally called Coss) is sufficiently smaller than that of the Si semiconductor. By using this, the dead time to be secured can be shortened, which leads to improvement of effective duty and higher frequency.

GAN−HEMTを使用することでスイッチング周波数が上がり、磁性部品の小型化が図られる。一方で、高周波駆動によりスイッチング時の電流の立ち上がり、立下り速度(≒di/dt)が急峻になりサージ電圧が増大するため、素子の高耐圧化、スナバ回路の追加が必要とされる。しかし、上記各実施の形態では、トランス4と直列にカレントトランス3を挿入することで、半導体スイッチング素子のドレイン・ソース間に流れる電流の立ち上がりは高速化する一方、カレントトランス3のインダクタンス成分により、トランス4に流れる電流の立ち上がり、立下り速度(≒di/dt)が緩和される。   By using GAN-HEMT, the switching frequency is increased and the magnetic component can be miniaturized. On the other hand, the rising and falling speeds (≈di / dt) at the time of switching become steep due to high-frequency driving and the surge voltage increases, so that it is necessary to increase the breakdown voltage of the element and add a snubber circuit. However, in each of the above embodiments, by inserting the current transformer 3 in series with the transformer 4, the rise of the current flowing between the drain and source of the semiconductor switching element is increased, while the inductance component of the current transformer 3 The rise and fall speeds (≈di / dt) of the current flowing through the transformer 4 are alleviated.

このため、従来は半導体スイッチング素子の高周波化、高速化に伴うサージ電圧の増加が懸念されていたが、上記各実施の形態では、半導体スイッチング素子は高速スイッチングによりスイッチング損失を低減できる一方、トランス側の電流はカレントトランス3のインダクタンス成分により抑制されるため、サージ電圧は増加しない。また、カレントトランス3のインダクタンス成分によるサージ電圧は第1のサージ抑制ダイオード1、第2のサージ抑制ダイオード2によりトランス4に印加されることを防ぐことが可能となる。   For this reason, there has been a concern about the increase in surge voltage due to higher frequency and higher speed of the semiconductor switching element in the past, but in each of the above embodiments, the semiconductor switching element can reduce switching loss by high speed switching, while the transformer side Is suppressed by the inductance component of the current transformer 3, so that the surge voltage does not increase. Further, it is possible to prevent the surge voltage due to the inductance component of the current transformer 3 from being applied to the transformer 4 by the first surge suppression diode 1 and the second surge suppression diode 2.

以上、この発明の実施の形態1及び2について説明したが、この発明は、その発明の範囲内において、各実施の形態を自由に組み合わせたり、各実施の形態を適宜、変形、省略することができる。   As described above, the first and second embodiments of the present invention have been described. However, within the scope of the present invention, the embodiments can be freely combined, or each embodiment can be appropriately modified or omitted. it can.

1 第1のサージ抑制ダイオード、2 第2のサージ抑制ダイオード、3 カレントトランス、4 トランス、5 第1の整流ダイオード、6 第2の整流ダイオード、7 平滑リアクトル、8 平滑コンデンサ、9 制御回路部、10a、10b 信号線、11 入力電圧検出回路、12 出力電圧検出回路、13 制御部、14a14b 通信線、15a、15b、15c、15d ゲート駆動信号線、40 リアクトル、90 第1のコンデンサ、91 第2のコンデンサ、120 コンデンサ、Q1、Q2、Q3、Q4 半導体スイッチング素子、V 入力電圧、V 出力電圧 1 first surge suppression diode, 2 second surge suppression diode, 3 current transformer, 4 transformer, 5 first rectifier diode, 6 second rectifier diode, 7 smoothing reactor, 8 smoothing capacitor, 9 control circuit unit, 10a, 10b signal line, 11 input voltage detection circuit, 12 output voltage detection circuit, 13 control unit, 14a14b communication line, 15a, 15b, 15c, 15d gate drive signal line, 40 reactor, 90 first capacitor, 91 second capacitor 120 capacitor, Q1, Q2, Q3, Q4 semiconductor switching elements, V i input voltage, V o output voltage

Claims (6)

入力電源と、一次巻線および二次巻線を備えたトランスと、上記一次巻線に直列に接続され、電流を検知するカレントトランスと、上記一次巻線と上記カレントトランスとの直列回路に接続されたフルブリッジ方式の半導体スイッチング回路と、上記二次巻線に接続された整流回路と、を有するDC−DCコンバータにおいて、
上記DC−DCコンバータは、上記一次巻線に接続された第1のサージ抑制ダイオードと第2のサージ抑制ダイオードとを備え、
上記カレントトランスと上記一次巻線との接続点に、上記第1のサージ抑制ダイオードのアノード端子と上記第2のサージ抑制ダイオードのカソード端子が接続され、
上記第1のサージ抑制ダイオードのカソード端子は、上記入力電源の正側に接続されると共に、上記第2のサージ抑制ダイオードのアノード端子は、上記入力電源の負側に接続されたことを特徴とするDC−DCコンバータ。
Connected to an input power source, a transformer having a primary winding and a secondary winding, a current transformer connected in series to the primary winding to detect current, and a series circuit of the primary winding and the current transformer In a DC-DC converter having a full-bridge semiconductor switching circuit and a rectifier circuit connected to the secondary winding,
The DC-DC converter includes a first surge suppression diode and a second surge suppression diode connected to the primary winding,
An anode terminal of the first surge suppression diode and a cathode terminal of the second surge suppression diode are connected to a connection point between the current transformer and the primary winding,
The cathode terminal of the first surge suppression diode is connected to the positive side of the input power supply, and the anode terminal of the second surge suppression diode is connected to the negative side of the input power supply. DC-DC converter.
上記DC−DCコンバータは、位相シフト制御で駆動されることを特徴とする請求項1に記載のDC−DCコンバータ。   The DC-DC converter according to claim 1, wherein the DC-DC converter is driven by phase shift control. 入力電源と、一次巻線および二次巻線を備えたトランスと、上記一次巻線に直列に接続され、電流を検知するカレントトランスと、上記一次巻線と上記カレントトランスとの直列回路に接続された2つの半導体スイッチング素子を備えたハーフブリッジ方式の半導体スイッチング回路と、上記二次巻線に接続された整流回路と、を有するDC−DCコンバータにおいて、
上記DC−DCコンバータは、上記一次巻線に接続された第1のサージ抑制ダイオードと第2のサージ抑制ダイオードとを備えると共に、上記カレントトランスの一端は上記2つの半導体スイッチング素子の間に接続され、他端が上記一次巻線に接続され、
上記カレントトランスと上記一次巻線との接続点に、上記第1のサージ抑制ダイオードのアノード端子と上記第2のサージ抑制ダイオードのカソード端子が接続され、
上記第1のサージ抑制ダイオードのカソード端子は、上記入力電源の正側に接続されると共に、上記第2のサージ抑制ダイオードのアノード端子は、上記入力電源の負側に接続されたことを特徴とするDC−DCコンバータ。
Connected to an input power source, a transformer having a primary winding and a secondary winding, a current transformer connected in series to the primary winding to detect current, and a series circuit of the primary winding and the current transformer In a DC-DC converter having a half-bridge semiconductor switching circuit including the two semiconductor switching elements, and a rectifier circuit connected to the secondary winding,
The DC-DC converter, Rutotomoni comprises a first surge suppression diode and the second surge suppression diode connected to the primary winding, one end of the current transformer is connected between the two semiconductor switching elements The other end is connected to the primary winding,
An anode terminal of the first surge suppression diode and a cathode terminal of the second surge suppression diode are connected to a connection point between the current transformer and the primary winding,
The cathode terminal of the first surge suppression diode is connected to the positive side of the input power supply, and the anode terminal of the second surge suppression diode is connected to the negative side of the input power supply. DC-DC converter.
上記整流回路は、ダイオードからなる整流回路であることを特徴とする請求項1からの何れか一項に記載のDC−DCコンバータ。 The DC-DC converter according to any one of claims 1 to 3 , wherein the rectifier circuit is a rectifier circuit made of a diode. 上記整流回路は、上記二次巻線のセンタータップを出力の一端とし、上記二次巻線の両端に整流素子を接続してなるセンタータップ方式の整流回路であることを特徴とする請求項1からの何れか一項に記載のDC−DCコンバータ。 The rectifier circuit is a center tap type rectifier circuit in which a center tap of the secondary winding is one end of an output and a rectifier is connected to both ends of the secondary winding. The DC-DC converter as described in any one of 1-4 . 上記半導体スイッチング回路を構成する半導体スイッチング素子は、炭化ケイ素、窒化ガリウム系材料を用いたワイドバンドギャップ半導体であることを特徴とする請求項1からの何れか一項に記載のDC−DCコンバータ。 Semiconductor switching elements constituting the semiconductor switching circuit, silicon carbide, DC-DC converter according to claims 1, characterized in that the wide band gap semiconductor with a gallium nitride-based material in any one of 5 .
JP2016214080A 2016-11-01 2016-11-01 DC-DC converter Active JP6305492B1 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2016214080A JP6305492B1 (en) 2016-11-01 2016-11-01 DC-DC converter

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2016214080A JP6305492B1 (en) 2016-11-01 2016-11-01 DC-DC converter

Publications (2)

Publication Number Publication Date
JP6305492B1 true JP6305492B1 (en) 2018-04-04
JP2018074818A JP2018074818A (en) 2018-05-10

Family

ID=61828496

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2016214080A Active JP6305492B1 (en) 2016-11-01 2016-11-01 DC-DC converter

Country Status (1)

Country Link
JP (1) JP6305492B1 (en)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN110880869A (en) * 2018-09-05 2020-03-13 本田技研工业株式会社 Voltage converter

Family Cites Families (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6392266A (en) * 1986-10-02 1988-04-22 Nec Corp Power source circuit
JP4110477B2 (en) * 2004-06-07 2008-07-02 株式会社デンソー DC-DC converter
US20080043495A1 (en) * 2006-08-16 2008-02-21 Aaron Jungreis Clamp diode reset in a power converter
JP2015019509A (en) * 2013-07-11 2015-01-29 株式会社豊田自動織機 Power conversion device
EP3104508B1 (en) * 2014-02-05 2018-09-26 Mitsubishi Electric Corporation In-vehicle charger and surge-suppression method for in-vehicle charger

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN110880869A (en) * 2018-09-05 2020-03-13 本田技研工业株式会社 Voltage converter

Also Published As

Publication number Publication date
JP2018074818A (en) 2018-05-10

Similar Documents

Publication Publication Date Title
JP6184529B2 (en) In-vehicle charger, surge suppression method for in-vehicle charger
JP5642245B1 (en) Car charger
JP4013995B2 (en) DC-DC converter
US9787190B2 (en) Power conversion device and in-vehicle power supply device equipped with same
JP5333485B2 (en) Power converter
JP5911553B1 (en) DC converter
JP2015159711A (en) Switching power supply and power converter
JP2015181329A (en) Electric power conversion system
KR20100115087A (en) A bidirectional dc-dc converter and methods of controlling the same
JP6009003B2 (en) DC / DC converter
JP2015201942A (en) Power conversion device
JP6305492B1 (en) DC-DC converter
JP2011211886A (en) Dc power supply, power converter
JP4577772B2 (en) Bidirectional current regulator
JP6132882B2 (en) Power converter
JP6293242B1 (en) Power converter
JP2015139312A (en) Switching power supply arrangement and electric power converter unit
JP6485366B2 (en) Phase shift type full bridge type power supply circuit
EP1657755A1 (en) Electric power transforming apparatus
WO2021156981A1 (en) Switching converter
JP2016005379A (en) Power supply circuit and power factor improvement circuit
CN115956336A (en) Nitride based AC-DC converter

Legal Events

Date Code Title Description
TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20180206

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20180306

R151 Written notification of patent or utility model registration

Ref document number: 6305492

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R151

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250