Nothing Special   »   [go: up one dir, main page]

JP6140575B2 - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法 Download PDF

Info

Publication number
JP6140575B2
JP6140575B2 JP2013174868A JP2013174868A JP6140575B2 JP 6140575 B2 JP6140575 B2 JP 6140575B2 JP 2013174868 A JP2013174868 A JP 2013174868A JP 2013174868 A JP2013174868 A JP 2013174868A JP 6140575 B2 JP6140575 B2 JP 6140575B2
Authority
JP
Japan
Prior art keywords
gas
frequency power
film
processing container
high frequency
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2013174868A
Other languages
English (en)
Other versions
JP2015043386A (ja
Inventor
小川 和人
和人 小川
克典 平井
克典 平井
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Tokyo Electron Ltd
Original Assignee
Tokyo Electron Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Tokyo Electron Ltd filed Critical Tokyo Electron Ltd
Priority to JP2013174868A priority Critical patent/JP6140575B2/ja
Priority to US14/467,182 priority patent/US9082720B2/en
Priority to KR1020140110633A priority patent/KR102260339B1/ko
Priority to CN201410426160.2A priority patent/CN104425242B/zh
Priority to CN201710069319.3A priority patent/CN107068557B/zh
Publication of JP2015043386A publication Critical patent/JP2015043386A/ja
Application granted granted Critical
Publication of JP6140575B2 publication Critical patent/JP6140575B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3105After-treatment
    • H01L21/311Etching the insulating layers by chemical or physical means
    • H01L21/31105Etching inorganic layers
    • H01L21/31111Etching inorganic layers by chemical means
    • H01L21/31116Etching inorganic layers by chemical means by dry-etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01JELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
    • H01J37/00Discharge tubes with provision for introducing objects or material to be exposed to the discharge, e.g. for the purpose of examination or processing thereof
    • H01J37/32Gas-filled discharge tubes
    • H01J37/32009Arrangements for generation of plasma specially adapted for examination or treatment of objects, e.g. plasma sources
    • H01J37/32018Glow discharge
    • H01J37/32027DC powered
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01JELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
    • H01J37/00Discharge tubes with provision for introducing objects or material to be exposed to the discharge, e.g. for the purpose of examination or processing thereof
    • H01J37/32Gas-filled discharge tubes
    • H01J37/32009Arrangements for generation of plasma specially adapted for examination or treatment of objects, e.g. plasma sources
    • H01J37/32082Radio frequency generated discharge
    • H01J37/32091Radio frequency generated discharge the radio frequency energy being capacitively coupled to the plasma
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/302Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
    • H01L21/306Chemical or electrical treatment, e.g. electrolytic etching
    • H01L21/3065Plasma etching; Reactive-ion etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/302Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
    • H01L21/306Chemical or electrical treatment, e.g. electrolytic etching
    • H01L21/308Chemical or electrical treatment, e.g. electrolytic etching using masks
    • H01L21/3081Chemical or electrical treatment, e.g. electrolytic etching using masks characterised by their composition, e.g. multilayer masks, materials
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3105After-treatment
    • H01L21/311Etching the insulating layers by chemical or physical means
    • H01L21/31144Etching the insulating layers by chemical or physical means using masks

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Chemical & Material Sciences (AREA)
  • General Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Plasma & Fusion (AREA)
  • Analytical Chemistry (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • General Chemical & Material Sciences (AREA)
  • Inorganic Chemistry (AREA)
  • Drying Of Semiconductors (AREA)

Description

本発明の実施形態は、半導体装置の製造方法に関するものである。
半導体デバイスの製造工程においては、プラズマエッチングといった処理が用いられる。プラズマエッチングには、電子デバイスの構造の微細化に伴い、微細なパターンを精度よく形成することが求められている。例えば、被エッチング層に対して、深いホールを精度よく形成することが求められている。
また、深いホールを形成するプラズマエッチングにより製造される半導体装置の一種として、3次元構造を有するNAND型フラッシュメモリデバイスが知られている。3次元構造を有するNAND型フラッシュメモリデバイスの製造においては、誘電率の異なる二つの層が交互に設けられることによって構成される多層膜のエッチングを行って、当該多層膜に深いホールを形成する工程が行われる。
このような深いホールを形成するためのプラズマエッチングとしては、特許文献1に記載されたプラズマエッチングが知られている。特許文献1のプラズマエッチングでは、複数種のガスのうち少なくとも1種のガスの流量を第1の期間内において第1の流量に設定する第1工程と、当該ガスの流量を第2の期間内において第1の流量とは異なる第2の流量に設定する第2工程とからなるサイクルが、プラズマを消失させることなく繰り返される。
特開2011−165769号公報
特許文献1に記載されたプラズマエッチングでは、反応生成物がマスクの表面に堆積することによって、マスクに対して被エッチング層を高い選択比でエッチングすることが可能となるが、次のような問題を有している。即ち、反応生成物がマスクの表面に不均一に堆積することに起因して、被エッチング層に形成されるホールが延びる方向がエッチングの進行に伴って変化する現象が発生する。以下、本明細書では、被エッチング層に形成されるホールといった空間が延びる方向が、エッチングの進行に伴って変化する現象、即ち、当該空間が延びる方向が、被エッチング層の膜厚方向の途中から変化する現象を「空間の方向変化」ということがある。
このような背景から、マスクに対する被エッチング層のエッチングの選択比を維持し、且つ、被エッチング層に形成される空間の方向変化を抑制することが必要になっている。
本発明の一側面に係る半導体装置の製造方法は、互いに異なる誘電率を有し、且つ、交互に積層された第1の膜及び第2の膜を含む多層膜を、プラズマ処理装置の処理容器内において、マスクを介してエッチングする半導体装置の製造方法であって、(a)フルオロカーボンガス、フルオロハイドロカーボンガス、及び酸素ガスを含む第1のガスを処理容器内に供給し、該第1のガスを励起させる工程と、(b)酸素ガス及び希ガスを含む第2のガスを処理容器内に供給し、該第2のガスを励起させる工程と、を含み、各々が第1のガスを励起させる工程及び第2のガスを励起させる工程を含む複数のサイクルが行われる。
この製造方法では、第1のガスを励起させる工程(a)において、多層膜がエッチングされる。この工程(a)では、発生する反応生成物がマスクの表面に堆積する。そして、工程(b)において、マスクの表面に堆積した反応生成物が部分的に除去され、マスクの表面における反応生成物の厚みの不均一性が低減される。本製造方法では、これら工程(a)及び(b)を含むサイクルが繰り返される。したがって、工程(b)において残された反応生成物によりマスクを保護して選択比を維持し、且つ、多層膜に形成される空間の方向変化を低減することが可能となる。
一形態では、少なくとも第1のガスを励起させる工程において、処理容器内に設けられた下部電極への高周波電力の供給及び該高周波電力の供給の停止を交互に繰り返し、高周波電力が下部電極へ供給されている期間内において、下部電極と対面配置された上部電極に第1の負の直流電圧を印加し、高周波電力の供給が停止されている期間内において、第1の負の直流電圧の絶対値よりも大きい絶対値を有する第2の負の直流電圧を上部電極に印加してもよい。この形態では、高周波電力の供給されていない期間にプラズマが消失する。また、この期間では、上部電極に印加される第2の負の直流電圧により、正イオンが上部電極に引きつけられる。これにより、上部電極からの二次電子が放出される。放出された二次電子は、多層膜を含む被処理体に照射される。その結果、マスクが改質される。したがって、選択比が更に改善される。また、二次電子によって被処理体の帯電状態が中和される。したがって、高周波電力が下部電極に供給されている期間に発生するプラズマ中の正イオンの直進性が高められる。その結果、多層膜に形成される空間の垂直性が更に高められる。
以上説明したように、本発明の一側面及び実施形態によれば、マスクに対する被エッチング層のエッチングの選択比を維持し、且つ、被エッチング層に形成される空間の方向変化を抑制することが可能となる。
一実施形態に係る半導体装置の製造方法を示す流れ図である。 工程ST1において準備されるウエハの一例を示す図である。 プラズマ処理装置の一例を概略的に示す図である。 図3に示すバルブ群、流量制御器群、及びガスソース群を詳細に示す図である。 工程ST2においてエッチングされている状態のウエハを示す図である。 工程ST3において保護膜の厚みの不均一性が低減された状態のウエハを示す図である。
以下、図面を参照して種々の実施形態について詳細に説明する。なお、各図面において同一又は相当の部分に対しては同一の符号を附すこととする。
図1は、一実施形態に係る半導体装置の製造方法を示す流れ図である。図1に示す方法MTは、例えば、3次元構造を有するNANDフラッシュメモリの製造に用いることができるものであり、工程ST1、工程S2、及び工程ST3を含んでいる。工程ST1は、被処理体(以下、「ウエハ」という)Wを準備する工程であり、工程ST2は、ウエハWの多層膜をエッチングするために、プラズマ処理装置の処理容器内で第1のガスを励起する工程であり、工程ST3は、エッチングにより生成された反応生成物を部分的に除去するために、プラズマ処理装置の処理容器内で第2のガスを励起する工程である。
方法MTは、第2のガスを励起する工程ST3の後、第1のガスを励起する工程ST2に戻る。即ち、第1のガスを励起する工程ST2と第2のガスを励起する工程ST3とを含むサイクルが複数回繰り返される。
図2は、工程ST1において準備されるウエハの一例を示す図である。図2に示すウエハWは、下地層UL、多層膜IL、及び、マスクMSKを有する。下地層ULは、基板上に設けられた多結晶シリコン製の層であり得る。この下地層UL上には、多層膜ILが設けられている。多層膜ILは、誘電率の異なる二つの誘電体膜IL1及びIL2が交互に積層された構造を有している。一実施形態では、誘電体膜IL1は酸化シリコン膜であり、誘電体膜IL2は窒化シリコン膜である。誘電体膜IL1の厚みは、例えば、5nm〜50nmであり、誘電体膜IL2の厚みは、例えば、10nm〜75nmである。誘電体膜IL1及びIL2の積層数は、例えば、12層の酸化シリコン膜及び12層の窒化シリコン膜であり、合計24層以上積層されていてもよい。多層膜IL上には、マスクMSKが設けられている。マスクMSKは、多層膜ILにホール又はトレンチといった深い空間を形成するためのパターンを有している。マスクMSKは、例えば、アモルファスカーボン製であり得る。或いは、マスクMSKは、有機ポリマーから構成されていてもよい。
再び図1を参照する。方法MTの工程ST1では、ウエハWが並行平板型プラズマ処理装置の処理容器内に準備される。以下、方法MTの実施に用いることが可能なプラズマ処理装置の一例について説明する。図3は、プラズマ処理装置の一例を概略的に示す図であり、当該プラズマ処理装置の断面図における構造を示している。
図3に示すプラズマ処理装置10は、容量結合型平行平板プラズマエッチング装置であり、略円筒状の処理容器12を備えている。処理容器12の内壁面は、陽極酸化処理されたアルミニウムから構成されている。この処理容器12は保安接地されている。
処理容器12の底部上には、絶縁材料から構成された略円筒上の支持部14が設けられている。支持部14は、処理容器12内において、処理容器12の底部から鉛直方向に延在している。支持部14は、処理容器12内に設けられた載置台PDを支持している。具体的には、図3に示すように、支持部14は、当該支持部14の内壁面において載置台PDを支持し得る。
載置台PDは、その上面においてウエハWを保持する。載置台PDは、下部電極(電極部)16及び支持部18を含み得る。下部電極16は、例えばアルミニウムといった金属から構成されており、略円盤形状をなしている。この下部電極16の上面の上には、支持部18が設けられている。
支持部18は、ウエハWを支持するものであり、ベース部18a及び静電チャック18bを含んでいる。ベース部18aは、例えばアルミニウムといった金属製から構成されており、略円盤形状をなしている。ベース部18aは、下部電極16上に設置されており、下部電極16に電気的に接続されている。静電チャック18bは、ベース部18aの上に設けられている。静電チャック18bは、導電膜である電極を一対の絶縁層又は絶縁シート間に配置した構造を有している。静電チャック18bの電極には、直流電源22が電気的に接続されている。この静電チャック18bは、直流電源22からの直流電圧により生じたクーロン力等の静電力によりウエハWを吸着保持することができる。
支持部18のベース部18aの周縁部上には、ウエハWの周縁及び静電チャック18bを囲むようにフォーカスリングFRが配置されている。フォーカスリングFRは、エッチングの均一性を向上させるために設けられている。フォーカスリングFRは、エッチング対象の膜の材料によって適宜選択される材料から構成されており、例えば、石英から構成され得る。
ベース部18の内部には、冷媒流路24が設けられている。冷媒流路24は、一実施形態に係る温調機構を構成している。冷媒流路24には、外部に設けられたチラーユニットから配管26a,26bを介して所定温度の冷媒が循環供給される。このように循環される冷媒の温度を制御することにより、支持部18上によって支持されたウエハWの温度が制御される。
また、プラズマ処理装置10には、ガス供給ライン28が設けられている。ガス供給ライン28は、伝熱ガス供給機構からの伝熱ガス、例えばHeガスを、静電チャック18bの上面とウエハWの裏面との間に供給する。
また、プラズマ処理装置10は、上部電極30を備えている。上部電極30は、載置台PDの上方において、当該載置台PDと対向配置(対面配置)されている。下部電極16と上部電極30とは、互いに略平行に設けられている。これら上部電極30と下部電極16との間には、ウエハWにプラズマ処理を行うための処理空間Sが画成されている。
上部電極30は、絶縁性遮蔽部材32を介して、処理容器12の上部に支持されている。この上部電極30は、電極板34及び電極支持体36を含み得る。電極板34は、処理空間Sに面しており、複数のガス吐出孔34を画成している。この電極板34は、ジュール熱の少ない低抵抗の導電体又は半導体から構成され得る。
電極支持体36は、電極板34を着脱自在に支持するものであり、例えばアルミニウムといった導電性材料から構成され得る。この電極支持体36は、水冷構造を有し得る。電極支持体36の内部には、ガス拡散室36aが設けられている。このガス拡散室36aからは、ガス吐出孔34aに連通する複数のガス通流孔36bが下方に延びている。また、電極支持体36には、ガス拡散室36aに処理ガスを導くガス導入口36cが形成されており、このガス導入口36cには、ガス供給管38が接続されている。
ガス供給管38には、バルブ群42及び流量制御器群44を介して、ガスソース群40が接続されている。図4は、図3に示すバルブ群、流量制御器群、及びガスソース群を詳細に示す図である。図4に示すように、ガスソース群40は、複数(N個)のガスソース401〜404を含んでいる。ガスソース401〜404はそれぞれ、Cガス、CHガス、Oガス、及びArガスのソースである。なお、ガスソース401は、任意のフルオロカーボンガスのソースであることができ、ガスソース402は、任意のフルオロハイドロカーボンガスのソースであることができる。フルオロカーボンガスとしては、Cガスの他に、Cガス、CFガスが例示され、フルオロハイドロカーボンガスとしては、CHガスの他に、CHFガス、CHFガスが例示される。また、ガスソース403は、任意の酸素ガスのソースであることができ、ガスソース404は、任意の希ガスのソースであることができる。
流量制御器群44は、複数(N個)の流量制御器441〜444を含んでいる。流量制御器441〜444は、対応のガスソースから供給されるガスの流量を制御する。これら流量制御器441〜444は、マスフローコントローラ(MFC)であってもよく、FCSであってもよい。バルブ群42は、複数(N個)のバルブ421〜424を含んでいる。ガスソース401〜404はそれぞれ、流量制御器441〜444及びバルブ421〜424を介して、ガス供給管38に接続されている。ガスソース401〜404のガスは、ガス供給管38からガス拡散室36aに至り、ガス通流孔36b及びガス吐出孔34aを介して処理空間Sに吐出される。
図3に戻り、プラズマ処理装置10は、接地導体12aを更に備え得る。接地導体12aは、略円筒状をなしており、処理容器12の側壁から上部電極30の高さ位置よりも上方に延びるように設けられている。
また、プラズマ処理装置10では、処理容器12の内壁に沿ってデポシールド46が着脱自在に設けられている。デポシールド46は、支持部14の外周にも設けられている。デポシールド46は、処理容器12にエッチング副生物(デポ)が付着することを防止するものであり、アルミニウム材にY等のセラミックスを被覆することにより構成され得る。
処理容器12の底部側においては、支持部14と処理容器12の内壁との間に排気プレート48が設けられている。排気プレート48は、例えば、アルミニウム材にY等のセラミックスを被覆することにより構成され得る。この排気プレート48の下方において処理容器12には、排気口12eが設けられている。排気口12eには、排気管52を介して排気装置50が接続されている。排気装置50は、ターボ分子ポンプなどの真空ポンプを有しており、処理容器12内を所望の真空度まで減圧することができる。また、処理容器12の側壁にはウエハWの搬入出口12gが設けられており、この搬入出口12gはゲートバルブ54により開閉可能となっている。
処理容器12の内壁には、導電性部材(GNDブロック)56が設けられている。導電性部材56は、高さ方向においてウエハWと略同じ高さに位置するように、処理容器12の内壁に取り付けられている。この導電性部材56は、グランドにDC的に接続されており、異常放電防止効果を発揮する。なお、導電性部材56はプラズマ生成領域に設けられていればよく、その設置位置は図3に示す位置に限られるものではない。
また、プラズマ処理装置10は、第1の高周波電源62及び第2の高周波電源64を更に備えている。第1の高周波電源62は、プラズマ生成用の第1の高周波(RF:Radio Frequency)電力を発生する電源であり、27〜100MHzの周波数、一例においては40MHzの高周波電力を発生する。第1の高周波電源62は、整合器66を介して下部電極16に接続されている。整合器66は、第1の高周波電源62の出力インピーダンスと負荷側(下部電極16側)の入力インピーダンスを整合させるための回路である。
第2の高周波電源64は、ウエハWにイオンを引き込むための第2の高周波電力、即ち高周波バイアス電力を発生する電源であり、400kHz〜13.56MHzの範囲内の周波数、一例においては3MHzの高周波電力を発生する。第2の高周波電源64は、整合器68を介して下部電極16に接続されている。整合器68は、第2の高周波電源64の出力インピーダンスと負荷側(下部電極16側)の入力インピーダンスを整合させるための回路である。
また、プラズマ処理装置10は、直流電源部70を更に備えている。直流電源部70は、上部電極30に接続されている。直流電源70は、負の直流電圧を発生し、当該直流電圧を上部電極30に与えることが可能である。
また、一実施形態において、制御部Cntは、第1の高周波電源62及び第2の高周波電源64からの高周波電力が、当該高周波電力のONとOFFがパルス状に切り換えられて下部電極16に供給されるよう、第1の高周波電源62及び第2の高周波電源64に制御信号を送出することができる。また、制御部Cntは、高周波電力がONとなっている期間(高周波電力が供給されている期間)における第1の負の直流電圧の絶対値よりも大きい絶対値を有する第2の負の直流電圧が、高周波電力がOFFになっている期間(高周波電力の供給が停止されている期間)に上部電極30に印加されるよう、直流電源部70に制御信号を送出することができる。なお、第1の高周波電源62及び第2の高周波電源64の高周波電力のON及びOFFの周波数は、例えば、1Hz〜40Hzである。ここで、高周波電力のON及びOFFの周波数とは、第1の高周波電源62及び第2の高周波電源64の高周波電力がONの期間とOFFの期間とからなる期間を1周期とする周波数である。また、1周期において高周波電力がONの期間を占めるデューティー比は、例えば、50%〜90%である。また、直流電源部の直流電圧値の切り換えは、第1の高周波電源62及び第2の高周波電源64の高周波電力のON及びOFFの切り換えに同期され得る。
再び図1を参照して、方法MTの説明を続ける。工程ST1では、処理容器12内に搬送されたウエハWが載置台PD上に配置され、静電チャック18bによって吸着保持される。次いで、方法MTでは、工程ST2が行われる。
工程ST2では、第1のガスが処理容器12内で励起される。このため、ガスソース群40からの処理ガスが処理容器12内に供給され、処理容器12内の圧力が所定の圧力に設定される。この処理ガスは、フルオロカーボンガス、フルオロハイドロカーボンガス、及び酸素ガスを含む第1のガスである。例えば、第1のガスは、Cガス、CHガス、及びOガスを含む。また、工程ST2では、第1の高周波電源62及び第2の高周波電源64からの高周波電力が下部電極16に与えられる。工程ST2における各種条件は、例えば、以下に示される範囲内の条件に設定される。
・Cガスの流量:15〜150sccm
・CHガスの流量:15〜150sccm
・Oガスの流量:20〜200sccm
・第1の高周波電源62の高周波電力の周波数:27〜100MHz
・第1の高周波電源62の高周波電力:500〜2700W
・第2の高周波電源64の高周波電力の周波数:400k〜13MHz
・第2の高周波電源64の高周波電力:5000〜7800W
・処理容器12内の圧力:2.00〜5.32Pa(15mT〜40mT)
また、一実施形態では、第1の高周波電源62及び第2の高周波電源64の高周波電力のONとOFFがパルス状に同期させて切り換えられてもよい。また、第1の高周波電源62及び第2の高周波電源64の高周波電力のONとOFFの切り換えに同期させて、上述したように、上部電極30に印加される負の直流電圧の絶対値の大小が切り換えられてもよい。この形態では、高周波電力がONであるときにプラズマが生成され、高周波電力がOFFであるときに、ウエハW直上のプラズマが消失する。また、高周波電力がOFFであるときに上部電極30に印加される負の直流電圧により、正イオンが上部電極30に引き込まれて衝突する。これにより、上部電極30から二次電子が放出され、放出された二次電子は、マスクMSKを改質する。したがって、マスクMSKのエッチング耐性を向上させ、選択比が更に改善される。また、二次電子は、ウエハWの帯電状態を中和し、その結果、後続のエッチング時に多層膜ILに形成されたホール又はトレンチといった空間内へのイオンの直進性が高められる。したがって、多層膜ILに形成される空間の垂直性が更に高められる。なお、第1の高周波電源62及び第2の高周波電源64の高周波電力のONとOFFの切り換えに関する条件、及び、上部電極30に印加される負の直流電圧の条件は、例えば、次の通りである。
・高周波電力のONとOFFの周波数:1〜40Hz
・一周期において高周波電力がONの期間が占めるデューティー比:50〜90%
・高周波電力がONの期間の負の直流電圧の絶対値:−150〜−500V
・高周波電力がOFFの期間の負の直流電圧の絶対値:−350〜−1000V
この工程ST2では、処理容器12内において第1のガスが励起されることにより、プラズマが生成される。これにより、多層膜ILがエッチングされる。図5は、工程ST2においてエッチングされている状態のウエハを示す図である。図5に示すように、マスクMSKの開口部の下方において、多層膜ILがエッチングされる。また、工程ST2では、処理ガスに含まれる炭素を含有する保護膜PFがマスクMSKの表面に付着する。このとき、保護膜PFはマスクMSKの表面に不均一な厚みで堆積する。次いで、方法MTでは、工程ST3が行われる。
工程ST3では、第2のガスが処理容器12内で励起される。このため、ガスソース群40からの処理ガスが処理容器12内に供給され、処理容器12内の圧力が所定の圧力に設定される。この処理ガスは、酸素ガス及び希ガスを含む第2のガスである。例えば、第2のガスは、Oガス及びArガスを含む。また、工程ST3では、第1の高周波電源62及び第2の高周波電源64からの高周波電力が下部電極16に与えられる。工程ST3における各種条件は、例えば、以下に示される範囲内の条件に設定される。
・Oガスの流量:10〜1000sccm
・Arガスの流量:0〜1000sccm
・第1の高周波電源62の高周波電力の周波数:27〜100MHz
・第1の高周波電源62の高周波電力:200〜2700W
・第2の高周波電源64の高周波電力の周波数:400k〜13MHz
・第2の高周波電源64の高周波電力:0〜3000W
・処理容器12内の圧力:1.33〜13.3Pa(10mT〜100mT)
この工程ST3では、処理容器12内において第2のガスが励起されることにより、プラズマが生成される。これにより、マスクMSKの表面に不均一な厚みで堆積した保護膜PFが部分的に取り除かれる。図6は、工程ST3において保護膜の厚みの不均一性が低減された状態のウエハを示す図である。図6に示すように、マスクMSKの表面に不均一な厚みで堆積した保護膜PFが部分的に取り除かれることにより、残された保護膜PFの厚みの不均一性が低減されている。次いで、方法MTでは、工程ST2に戻って再びウエハWのエッチングを行う。
再び繰り返される工程ST2では、工程ST3において厚みの不均一性が低減された保護膜PFにより、マスクMSKを保護して選択比を維持することができる。これに加えて、保護膜PFの厚みの不均一性が低減されているので、多層膜ILに形成されるホール又はトレンチといった空間が延びる方向が、この保護膜PFの厚みの不均一性に起因して、多層膜ILの膜厚方向の途中から変化することを抑制することができる。この工程ST2では、再び処理ガスに含まれる炭素を含有する保護膜PFがマスクMSKの表面に付着し、不均一な厚みで保護膜PFが堆積する。次いで、方法MTでは、再び工程ST3が行われ、保護膜PFが部分的に除去される。
このように、方法MTでは、ウエハWのエッチングを行う工程ST2と、マスクMSKの表面に堆積した保護膜PFを部分的に除去する工程ST3と、を含むサイクルが複数回行われる。したがって、工程ST3において厚みの不均一性が低減された保護膜PFによりマスクMSKを保護して選択比を維持しつつ、多層膜ILに形成される空間の方向変化を抑制することが可能となる。
以上、本発明の好適な実施形態について説明したが、本発明は上記実施形態に限定されるものではなく、各請求項に記載した要旨を変更しない範囲で変形し、又は他のものに適用したものであってもよい。
10…プラズマ処理装置、12…処理容器、16…下部電極、62…第1の高周波電源、64…第2の高周波電源、IL1…誘電体膜(第1の膜)、IL2…誘電体膜(第2の膜)、MSK…マスク、MT…半導体装置の製造方法。

Claims (4)

  1. 互いに異なる誘電率を有し、且つ、交互に積層された第1の膜及び第2の膜を含む多層膜を、プラズマ処理装置の処理容器内において、マスクを介してエッチングする半導体装置の製造方法であって、
    フルオロカーボンガス、フルオロハイドロカーボンガス、及び酸素ガスを含む第1のガスを前記処理容器内に供給し、該第1のガスを励起させる工程と、
    酸素ガス及び希ガスを含む第2のガスを前記処理容器内に供給し、該第2のガスを励起させる工程と、
    を含み、
    各々が前記第1のガスを励起させる工程及び前記第2のガスを励起させる工程を含む複数のサイクルが行われ、
    少なくとも前記第1のガスを励起させる工程において、前記処理容器内に設けられた下部電極への高周波電力の供給及び該高周波電力の供給の停止を交互に繰り返し、
    前記高周波電力が前記下部電極へ供給されている期間内において、前記下部電極と対面配置された上部電極に第1の負の直流電圧を印加し、前記高周波電力の供給が停止されている期間内において、前記第1の負の直流電圧の絶対値よりも大きい絶対値を有する第2の負の直流電圧を前記上部電極に印加する、
    製造方法。
  2. 前記第1の膜と前記第2の膜は、合計24層以上積層されていることを特徴とする請求項に記載の製造方法。
  3. 前記第1の膜は酸化シリコン膜であり、前記第2の膜は窒化シリコン膜である、請求項1又は2に記載の製造方法。
  4. 前記マスクは、アモルファスカーボン製である、請求項1〜の何れか一項に記載の製造方法。
JP2013174868A 2013-08-26 2013-08-26 半導体装置の製造方法 Active JP6140575B2 (ja)

Priority Applications (5)

Application Number Priority Date Filing Date Title
JP2013174868A JP6140575B2 (ja) 2013-08-26 2013-08-26 半導体装置の製造方法
US14/467,182 US9082720B2 (en) 2013-08-26 2014-08-25 Semiconductor device manufacturing method
KR1020140110633A KR102260339B1 (ko) 2013-08-26 2014-08-25 반도체 장치의 제조 방법
CN201410426160.2A CN104425242B (zh) 2013-08-26 2014-08-26 半导体器件的制造方法
CN201710069319.3A CN107068557B (zh) 2013-08-26 2014-08-26 半导体器件的制造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2013174868A JP6140575B2 (ja) 2013-08-26 2013-08-26 半導体装置の製造方法

Publications (2)

Publication Number Publication Date
JP2015043386A JP2015043386A (ja) 2015-03-05
JP6140575B2 true JP6140575B2 (ja) 2017-05-31

Family

ID=52480747

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2013174868A Active JP6140575B2 (ja) 2013-08-26 2013-08-26 半導体装置の製造方法

Country Status (4)

Country Link
US (1) US9082720B2 (ja)
JP (1) JP6140575B2 (ja)
KR (1) KR102260339B1 (ja)
CN (2) CN104425242B (ja)

Families Citing this family (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN203481491U (zh) * 2013-08-23 2014-03-12 富士康(昆山)电脑接插件有限公司 电连接器
JP6423643B2 (ja) * 2014-08-08 2018-11-14 東京エレクトロン株式会社 多層膜をエッチングする方法
CN105810579B (zh) * 2015-01-16 2019-12-06 东京毅力科创株式会社 蚀刻方法
JP6339961B2 (ja) * 2015-03-31 2018-06-06 東京エレクトロン株式会社 エッチング方法
JP6339963B2 (ja) * 2015-04-06 2018-06-06 東京エレクトロン株式会社 エッチング方法
JP6438831B2 (ja) * 2015-04-20 2018-12-19 東京エレクトロン株式会社 有機膜をエッチングする方法
JP6498022B2 (ja) * 2015-04-22 2019-04-10 東京エレクトロン株式会社 エッチング処理方法
JP6504989B2 (ja) * 2015-05-14 2019-04-24 東京エレクトロン株式会社 エッチング方法
CN106298502B (zh) * 2015-05-18 2019-04-09 中微半导体设备(上海)股份有限公司 一种利用等离子体对多层材料刻蚀的方法
JP6494424B2 (ja) * 2015-05-29 2019-04-03 東京エレクトロン株式会社 エッチング方法
JP6529357B2 (ja) * 2015-06-23 2019-06-12 東京エレクトロン株式会社 エッチング方法
JP6557588B2 (ja) * 2015-12-04 2019-08-07 株式会社日立ハイテクノロジーズ ドライエッチング方法
KR20180097763A (ko) * 2016-01-20 2018-08-31 어플라이드 머티어리얼스, 인코포레이티드 측방향 하드마스크 리세스 감소를 위한 하이브리드 탄소 하드마스크
JP6552477B2 (ja) * 2016-12-22 2019-07-31 東京エレクトロン株式会社 エッチング方法
JP6878174B2 (ja) * 2017-06-29 2021-05-26 東京エレクトロン株式会社 プラズマエッチング方法及びプラズマエッチング装置

Family Cites Families (18)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07211492A (ja) * 1994-01-18 1995-08-11 Semiconductor Energy Lab Co Ltd プラズマ処理方法及びプラズマ処理装置
JP2002025979A (ja) * 2000-07-03 2002-01-25 Hitachi Ltd 半導体集積回路装置の製造方法
WO2006099538A2 (en) * 2005-03-15 2006-09-21 Nanodynamics, Inc. Devices with ultrathin structures and method of making same
JP5461759B2 (ja) * 2006-03-22 2014-04-02 東京エレクトロン株式会社 プラズマ処理装置、プラズマ処理方法及び記憶媒体
US8129283B2 (en) * 2007-02-13 2012-03-06 Hitachi High-Technologies Corporation Plasma processing method and plasma processing apparatus
KR100866735B1 (ko) * 2007-05-01 2008-11-03 주식회사 하이닉스반도체 반도체 소자의 미세 패턴 형성 방법
CN101903977A (zh) * 2007-12-21 2010-12-01 朗姆研究公司 光刻胶两次图案化
JP5213496B2 (ja) * 2008-03-31 2013-06-19 東京エレクトロン株式会社 プラズマエッチング方法及びコンピュータ読み取り可能な記憶媒体
JP5390846B2 (ja) * 2008-12-09 2014-01-15 東京エレクトロン株式会社 プラズマエッチング装置及びプラズマクリーニング方法
JP5221403B2 (ja) * 2009-01-26 2013-06-26 東京エレクトロン株式会社 プラズマエッチング方法、プラズマエッチング装置および記憶媒体
KR101060611B1 (ko) * 2009-07-03 2011-08-31 주식회사 하이닉스반도체 매립게이트를 구비한 반도체장치 제조 방법
US8323521B2 (en) * 2009-08-12 2012-12-04 Tokyo Electron Limited Plasma generation controlled by gravity-induced gas-diffusion separation (GIGDS) techniques
JP5608384B2 (ja) * 2010-02-05 2014-10-15 東京エレクトロン株式会社 半導体装置の製造方法及びプラズマエッチング装置
JP5916056B2 (ja) * 2010-08-23 2016-05-11 東京エレクトロン株式会社 プラズマ処理方法及びプラズマ処理装置
KR20120022251A (ko) * 2010-09-01 2012-03-12 삼성전자주식회사 플라즈마 식각방법 및 그의 장치
JP5701654B2 (ja) * 2011-03-23 2015-04-15 東京エレクトロン株式会社 基板処理方法
US8598040B2 (en) * 2011-09-06 2013-12-03 Lam Research Corporation ETCH process for 3D flash structures
JP6154820B2 (ja) * 2012-11-01 2017-06-28 東京エレクトロン株式会社 プラズマ処理方法及びプラズマ処理装置

Also Published As

Publication number Publication date
US20150056817A1 (en) 2015-02-26
CN107068557B (zh) 2020-12-29
JP2015043386A (ja) 2015-03-05
KR20150024277A (ko) 2015-03-06
CN104425242A (zh) 2015-03-18
CN104425242B (zh) 2017-04-12
CN107068557A (zh) 2017-08-18
US9082720B2 (en) 2015-07-14
KR102260339B1 (ko) 2021-06-03

Similar Documents

Publication Publication Date Title
JP6140575B2 (ja) 半導体装置の製造方法
KR102426264B1 (ko) 에칭 방법
US9039913B2 (en) Semiconductor device manufacturing method
JP6423643B2 (ja) 多層膜をエッチングする方法
JP6230930B2 (ja) 半導体装置の製造方法
JP6267953B2 (ja) 半導体装置の製造方法
EP2911187A1 (en) Etching method
JP6339961B2 (ja) エッチング方法
JP6230898B2 (ja) エッチング方法
JP2016225437A (ja) エッチング方法
JP6454492B2 (ja) 多層膜をエッチングする方法
US9418863B2 (en) Method for etching etching target layer
US9613824B2 (en) Etching method
JP2016219771A (ja) エッチング方法

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20160506

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20170222

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20170228

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20170411

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20170425

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20170501

R150 Certificate of patent or registration of utility model

Ref document number: 6140575

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250