JP3027009B2 - 設計取り込みシステム - Google Patents
設計取り込みシステムInfo
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- JP3027009B2 JP3027009B2 JP2405424A JP40542490A JP3027009B2 JP 3027009 B2 JP3027009 B2 JP 3027009B2 JP 2405424 A JP2405424 A JP 2405424A JP 40542490 A JP40542490 A JP 40542490A JP 3027009 B2 JP3027009 B2 JP 3027009B2
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- Japan
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F30/00—Computer-aided design [CAD]
- G06F30/30—Circuit design
- G06F30/32—Circuit design at the digital level
- G06F30/33—Design verification, e.g. functional simulation or model checking
- G06F30/3308—Design verification, e.g. functional simulation or model checking using simulation
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F30/00—Computer-aided design [CAD]
- G06F30/30—Circuit design
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F30/00—Computer-aided design [CAD]
- G06F30/30—Circuit design
- G06F30/32—Circuit design at the digital level
- G06F30/33—Design verification, e.g. functional simulation or model checking
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- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Evolutionary Computation (AREA)
- Geometry (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Design And Manufacture Of Integrated Circuits (AREA)
Description
【0001】
【産業上の利用分野】本発明は、技術設計に関するもの
であり、とりわけこうした設計を文書化しシミュレート
するためのコンピュータ・システムに関するものであ
る。さらに詳述すると、本発明は、技術設計の文書化、
解析及び合成を行なうためのコンピュータ化された設計
取り込みシステム(design capture system) に関するも
のである。
であり、とりわけこうした設計を文書化しシミュレート
するためのコンピュータ・システムに関するものであ
る。さらに詳述すると、本発明は、技術設計の文書化、
解析及び合成を行なうためのコンピュータ化された設計
取り込みシステム(design capture system) に関するも
のである。
【0002】
【従来技術】高性能のグラフィクス・ワークステーショ
ンが使えるようになったことにより、電子設計、機械設
計及びソフトウェア設計といった技術上の設計を取り込
む(capture) ため、いくつかのツールが開発された。こ
のような設計を取り込めば、これに関して、たとえば論
理シミュレーションやプリント基板レイアウト等の解
析、合成及び評価を行なうことができる。解析、合成ま
たは評価を行なうための多くのツールが現に存在し、将
来、さらに多くのものがきっと開発されることになるだ
ろう。
ンが使えるようになったことにより、電子設計、機械設
計及びソフトウェア設計といった技術上の設計を取り込
む(capture) ため、いくつかのツールが開発された。こ
のような設計を取り込めば、これに関して、たとえば論
理シミュレーションやプリント基板レイアウト等の解
析、合成及び評価を行なうことができる。解析、合成ま
たは評価を行なうための多くのツールが現に存在し、将
来、さらに多くのものがきっと開発されることになるだ
ろう。
【0003】歴史的には、回路シミュレーションのよう
な設計図取り込みシステム(設計の文書化及び解析ツー
ルに用いられる)は別個に開発された。さらに最近にな
って、これらを組み合わせて単一の設計取り込みシステ
ムとすることで、それらを設計に利用しやすくした。こ
のようなシステムでは先ず設計者が設計をグラフィクス
・システムに入力し、このシステムが目視検査のためそ
の設計を表示する。設計の入力後、その設計は、評価の
ため、解析ツールに送られることもあるし、プリント回
路レイアウトのような合成ツールに送られることもあ
る。これらのツールの性質及びサイズのため、それらツ
ールは別個に、またしばしば別々の会社で開発されてき
た。
な設計図取り込みシステム(設計の文書化及び解析ツー
ルに用いられる)は別個に開発された。さらに最近にな
って、これらを組み合わせて単一の設計取り込みシステ
ムとすることで、それらを設計に利用しやすくした。こ
のようなシステムでは先ず設計者が設計をグラフィクス
・システムに入力し、このシステムが目視検査のためそ
の設計を表示する。設計の入力後、その設計は、評価の
ため、解析ツールに送られることもあるし、プリント回
路レイアウトのような合成ツールに送られることもあ
る。これらのツールの性質及びサイズのため、それらツ
ールは別個に、またしばしば別々の会社で開発されてき
た。
【0004】普通は、単一の会社からのシステムが文書
化、シミュレーション及びプリント回路レイアウトをサ
ポートする。これらのツールは全て単一の供給元から得
られるので、文書化に用いられるグラフィック記号及び
シミュレーションに用いられる回路モデルは互いにリン
クされている。しかしながら、特定の回路部品のモデル
が設計取り込みシステム上にない場合、あるいは精度の
レベルの異なるいくつかのシミュレーションを行ないた
い場合には、問題が生じる。半導体部品は業界の成長率
が高くまた入手が容易なため、モデル作成者が遅れをと
らないようにするのは困難であった。その結果モデル化
を行なういくつかの異なる会社及びいくつかの異なるモ
デル化技法が現れ、1つの部品に対して、しばしばいく
つかの異なるモデルが存在することになった。例えば、
挙動シミュレーションやゲート・レベル・シミュレーシ
ョンのためにいろいろな精度のレベルで回路をシミュレ
ートしたり、あるいはまた論理、タイミングまたは故障
解析のようないろいろなシミュレーション解析を行なう
ため、いろいろなモデルがしばしば求められる。
化、シミュレーション及びプリント回路レイアウトをサ
ポートする。これらのツールは全て単一の供給元から得
られるので、文書化に用いられるグラフィック記号及び
シミュレーションに用いられる回路モデルは互いにリン
クされている。しかしながら、特定の回路部品のモデル
が設計取り込みシステム上にない場合、あるいは精度の
レベルの異なるいくつかのシミュレーションを行ないた
い場合には、問題が生じる。半導体部品は業界の成長率
が高くまた入手が容易なため、モデル作成者が遅れをと
らないようにするのは困難であった。その結果モデル化
を行なういくつかの異なる会社及びいくつかの異なるモ
デル化技法が現れ、1つの部品に対して、しばしばいく
つかの異なるモデルが存在することになった。例えば、
挙動シミュレーションやゲート・レベル・シミュレーシ
ョンのためにいろいろな精度のレベルで回路をシミュレ
ートしたり、あるいはまた論理、タイミングまたは故障
解析のようないろいろなシミュレーション解析を行なう
ため、いろいろなモデルがしばしば求められる。
【0005】部品のグラフィックス・シンボルとそのモ
デルはリンクしているので、異なるモデルはそれぞれ固
有のシンボルを持っている。取り込まれている回路等の
設計図(以下、回路と称する)を異なるモデルに関して
シミュレートしたい場合、ユーザは今あるシンボルを新
しいシンボルに変換し、新しいシンボルを用いて回路を
書き直さなければならない。シンボルの変換が容易でな
い場合には問題が生じる。ユーザが古いシンボルを削除
し、新しいシンボルを回路に挿入しなければならないの
で、この変換には時間がかかる。
デルはリンクしているので、異なるモデルはそれぞれ固
有のシンボルを持っている。取り込まれている回路等の
設計図(以下、回路と称する)を異なるモデルに関して
シミュレートしたい場合、ユーザは今あるシンボルを新
しいシンボルに変換し、新しいシンボルを用いて回路を
書き直さなければならない。シンボルの変換が容易でな
い場合には問題が生じる。ユーザが古いシンボルを削除
し、新しいシンボルを回路に挿入しなければならないの
で、この変換には時間がかかる。
【0006】さらに、グラフィクス・シンボルはかなり
の記憶スペースを必要とするので、別個にシンボルを記
憶すると、設計取り込みシステムにおける貴重なディス
ク記憶スペースを占有することになる。異なるモデル毎
に異なるシンボルを開発する、余分なシンボル開発時間
が必要になる。異なるモデルがかなりの共有情報を有し
ている場合がよくあるが、これらのモデルは完全に独立
しているため、1つのモデルからもう1つのモデルへ変
換する際、この情報は、シンボルと共に変換したり、あ
るいは再び生成しなければならにない。これはデータの
完全性(data integrity)に影響を与える可能性がある。
新しい供給業者からのモデルの組み込み(integration)
には、新しいグラフィクス・ライブラリの組み込みが必
要になるので、組み込みが遅延し複雑になる。また、組
み合わさったシンボルとモデルを使って、各モデル開発
者はシンボルとモデルとの間の色々なユーザ・インター
フェイスを自由に作り出すので、このユーザ・インター
フェイスは異なるモデル間で一貫性がない場合がよくあ
る。
の記憶スペースを必要とするので、別個にシンボルを記
憶すると、設計取り込みシステムにおける貴重なディス
ク記憶スペースを占有することになる。異なるモデル毎
に異なるシンボルを開発する、余分なシンボル開発時間
が必要になる。異なるモデルがかなりの共有情報を有し
ている場合がよくあるが、これらのモデルは完全に独立
しているため、1つのモデルからもう1つのモデルへ変
換する際、この情報は、シンボルと共に変換したり、あ
るいは再び生成しなければならにない。これはデータの
完全性(data integrity)に影響を与える可能性がある。
新しい供給業者からのモデルの組み込み(integration)
には、新しいグラフィクス・ライブラリの組み込みが必
要になるので、組み込みが遅延し複雑になる。また、組
み合わさったシンボルとモデルを使って、各モデル開発
者はシンボルとモデルとの間の色々なユーザ・インター
フェイスを自由に作り出すので、このユーザ・インター
フェイスは異なるモデル間で一貫性がない場合がよくあ
る。
【0007】従って、当該技術においては、設計取り込
みシステムが有している複数の回路モデルに対して単一
のグラフィクス・シンボルを用いる設計取り込みシステ
ムが必要とされている。さらに、別のモデルが選択され
ても、回路の図形表示を描き直す必要のないようなシス
テムが必要とされている。さらに、シンボル・ライブラ
リの記憶スペースを縮小し、シンボル開発時間を短縮す
るようなシステムが必要とされている。さらに、また、
諸部品に共通なデータを共通ロケーションに保持してお
くことにより、データの完全性を高め、記憶スペースを
縮小するようなシステムが必要とされている。また、一
貫したユーザ・インターフェイスを持つシステムを提供
することが必要されている。さらに、新しいシンボルを
組み込む必要をなくすことにより、新しいモデルの組み
込みを容易にするようなシステムが必要とされている。
みシステムが有している複数の回路モデルに対して単一
のグラフィクス・シンボルを用いる設計取り込みシステ
ムが必要とされている。さらに、別のモデルが選択され
ても、回路の図形表示を描き直す必要のないようなシス
テムが必要とされている。さらに、シンボル・ライブラ
リの記憶スペースを縮小し、シンボル開発時間を短縮す
るようなシステムが必要とされている。さらに、また、
諸部品に共通なデータを共通ロケーションに保持してお
くことにより、データの完全性を高め、記憶スペースを
縮小するようなシステムが必要とされている。また、一
貫したユーザ・インターフェイスを持つシステムを提供
することが必要されている。さらに、新しいシンボルを
組み込む必要をなくすことにより、新しいモデルの組み
込みを容易にするようなシステムが必要とされている。
【0008】
【発明が解決しようとする課題】本発明の課題は、1つ
の電子部品に1つのグラフィック・シンボルがあり、こ
のシンボルは複数の図路モデルの任意の1つともリンク
させることができる回路取り込みシステムを提供するこ
とにある。
の電子部品に1つのグラフィック・シンボルがあり、こ
のシンボルは複数の図路モデルの任意の1つともリンク
させることができる回路取り込みシステムを提供するこ
とにある。
【0009】本発明のもう1つの課題は、回路部品にリ
ンクさせるモデルを変更しても、この部品のグラフィッ
ク・シンボルやその部品を用いた回路を描き直す必要の
ないようなシステムを提供することにある。
ンクさせるモデルを変更しても、この部品のグラフィッ
ク・シンボルやその部品を用いた回路を描き直す必要の
ないようなシステムを提供することにある。
【0010】本発明のさらにもう1つの課題は、モデル
に必要な記憶スペースを縮小するようなシステムを提供
することにある。
に必要な記憶スペースを縮小するようなシステムを提供
することにある。
【0011】本発明のもう1つの課題は、最初のモデル
に続いて開発される全てのモデルのためにシンボルを開
発する必要をなくすことによって、部品モデルの開発に
必要な時間を短縮することにある。
に続いて開発される全てのモデルのためにシンボルを開
発する必要をなくすことによって、部品モデルの開発に
必要な時間を短縮することにある。
【0012】本発明のもう1つの課題は、システムへの
回路の入力が完了すると、モデルがこの回路の部品へリ
ンクできるようにしたシステムを提供することにある。
回路の入力が完了すると、モデルがこの回路の部品へリ
ンクできるようにしたシステムを提供することにある。
【0013】このシステムのもう1つの課題は、新しい
モデルを回路上の全ての部品にリンクする単一のコマン
ドを提供することにある。
モデルを回路上の全ての部品にリンクする単一のコマン
ドを提供することにある。
【0014】本発明のさらにもう1つの課題は、用いら
れるべきモデル毎に、そのモデルに固有のパラメータを
入力し、モデル間での切りかえ時に、このパラメータ情
報を維持できるようにすることにある。
れるべきモデル毎に、そのモデルに固有のパラメータを
入力し、モデル間での切りかえ時に、このパラメータ情
報を維持できるようにすることにある。
【0015】本発明のもう1つの課題は、複数のモデル
に共通したデータを単一のロケーションに保持すること
によって、データの完全性を高めることにある。
に共通したデータを単一のロケーションに保持すること
によって、データの完全性を高めることにある。
【0016】もう1つの課題は、シンボルの導入及び維
持が最初のモデルにしか必要ではないようにして、この
システムへのモデルの導入及びその維持に要する時間を
短縮することにある。
持が最初のモデルにしか必要ではないようにして、この
システムへのモデルの導入及びその維持に要する時間を
短縮することにある。
【0017】
【発明の概要】本発明の一実施例によれば、以上の及び
その他の課題は、部品にリンクしたグラフィック・シン
ボルが、部品を処理するツールが用いるモデルから分離
される、回路取り込み及び設計検証システムにおいて達
成される。各部品は接ぎ穂(scion) すなわちリンク・ペ
ージにリンクしたグラフィクス・シンボルを備えてい
る。リンク・ページにはまた、部品に用いることができ
るモデルの各々につき1つずつの、複数のカプラ(coupl
er) も含まれている。ある部品ファクシミリに共通した
特徴を有するモデルは、1つのモデル・タイプとしてグ
ループにまとめられる。
その他の課題は、部品にリンクしたグラフィック・シン
ボルが、部品を処理するツールが用いるモデルから分離
される、回路取り込み及び設計検証システムにおいて達
成される。各部品は接ぎ穂(scion) すなわちリンク・ペ
ージにリンクしたグラフィクス・シンボルを備えてい
る。リンク・ページにはまた、部品に用いることができ
るモデルの各々につき1つずつの、複数のカプラ(coupl
er) も含まれている。ある部品ファクシミリに共通した
特徴を有するモデルは、1つのモデル・タイプとしてグ
ループにまとめられる。
【0018】このシステムは、回路中の各部品毎にモデ
ル・タイプを選択し、リンクできるようにし、また、部
品がいつでも新しいモデル・タイプにリンクできるよう
にする。このシステムはまた、全ての部品についてのモ
デル・タイプへのリンクを単一のコマンドで変更できる
ようにする。ユーザがこのシステムに回路を入力し、次
にこの回路中で用いられている部品毎にモデル・タイプ
を選択すると、その結果、部品毎に特定のモデルが選択
される。もし望むならば、ユーザは部品に対するデフォ
ルトのモデル・タイプを承諾することもできる。全ての
部品についてモデル・タイプの選択がすむと、ユーザ
は、システムに対して、シミュレータまたは他の解析ま
たは合成ツールに対して回路を記述するネットリスト
(netlist)の作成を要求する。ネットリストの
作成にあたって、部品毎に、カプラからパラメータが抽
出され、ツールによって用いられるネットリストへ納め
られる。
ル・タイプを選択し、リンクできるようにし、また、部
品がいつでも新しいモデル・タイプにリンクできるよう
にする。このシステムはまた、全ての部品についてのモ
デル・タイプへのリンクを単一のコマンドで変更できる
ようにする。ユーザがこのシステムに回路を入力し、次
にこの回路中で用いられている部品毎にモデル・タイプ
を選択すると、その結果、部品毎に特定のモデルが選択
される。もし望むならば、ユーザは部品に対するデフォ
ルトのモデル・タイプを承諾することもできる。全ての
部品についてモデル・タイプの選択がすむと、ユーザ
は、システムに対して、シミュレータまたは他の解析ま
たは合成ツールに対して回路を記述するネットリスト
(netlist)の作成を要求する。ネットリストの
作成にあたって、部品毎に、カプラからパラメータが抽
出され、ツールによって用いられるネットリストへ納め
られる。
【0019】ユーザが異なるツールの使用を望む場合、
ユーザはこのシステムに命じて、部品にリンクしたモデ
ルをこの第2のツールに適した新しいモデルに変更させ
る。このシステムは次に新しいモデルと第2のツールに
固有のパラメータを利用して、異なるフォーマットであ
るかもしれない新しいネットリストを作成する。このシ
ステムはまた、最初のツールに関する元のモデル・リン
クを維持し、もう一度最初のツールに変更しても、部品
のリンクをやり直さなくてもすむようにする。
ユーザはこのシステムに命じて、部品にリンクしたモデ
ルをこの第2のツールに適した新しいモデルに変更させ
る。このシステムは次に新しいモデルと第2のツールに
固有のパラメータを利用して、異なるフォーマットであ
るかもしれない新しいネットリストを作成する。このシ
ステムはまた、最初のツールに関する元のモデル・リン
クを維持し、もう一度最初のツールに変更しても、部品
のリンクをやり直さなくてもすむようにする。
【0020】
【実施例】以下の説明は、本発明の現在考えられる最良
の実施態に関するものである。この説明は制限的意味で
とらえるべきではなく、単に本発明の一般原理を明らか
にするためのものである。本発明の範囲は、本願特許請
求の範囲にもとづいて判断されなければならない。
の実施態に関するものである。この説明は制限的意味で
とらえるべきではなく、単に本発明の一般原理を明らか
にするためのものである。本発明の範囲は、本願特許請
求の範囲にもとづいて判断されなければならない。
【0021】図1に、本発明を取り入れたコンピュータ
・システムのブロック図を示す。ここで、図1を参照す
ると、コンピュータ・システム100 には、本発明のソフ
トウェアの命令を処理する処理要素102 が含まれてい
る。処理要素102 は、システム・バス104 を介してこの
システムの残りの部分に接続されている。設計者がキー
ボード106 を用いて回路を入力すると、このシステムは
グラフィクス・ディスプレイ108 によって設計者に対し
てその回路を表示する。例えば、マウス、トラック・ボ
ール、または、デジタイザといったグラフィクス入力デ
バイス116 を用いて入力することもできる。表示に用い
られるグラフィクス・シンボル及びモデルは、ディスク
112 に記憶されており、ディスク・コントローラ110 及
びシステム・バス104 を介してアクセスされる。メモリ
114 は、処理要素102 が設計取り込みシステムのソフト
ウェアを実行する間にそのソフトウェアを記憶したり回
路データ及びリンク・ページを記憶したりするのに用い
られる。
・システムのブロック図を示す。ここで、図1を参照す
ると、コンピュータ・システム100 には、本発明のソフ
トウェアの命令を処理する処理要素102 が含まれてい
る。処理要素102 は、システム・バス104 を介してこの
システムの残りの部分に接続されている。設計者がキー
ボード106 を用いて回路を入力すると、このシステムは
グラフィクス・ディスプレイ108 によって設計者に対し
てその回路を表示する。例えば、マウス、トラック・ボ
ール、または、デジタイザといったグラフィクス入力デ
バイス116 を用いて入力することもできる。表示に用い
られるグラフィクス・シンボル及びモデルは、ディスク
112 に記憶されており、ディスク・コントローラ110 及
びシステム・バス104 を介してアクセスされる。メモリ
114 は、処理要素102 が設計取り込みシステムのソフト
ウェアを実行する間にそのソフトウェアを記憶したり回
路データ及びリンク・ページを記憶したりするのに用い
られる。
【0022】図2に電子回路等の設計の入力及び処理プ
ロセスに関するフロー・チャートを示す。ここで図2を
参照すると、ここに入った後、ブロック202 は設計者が
入力した設計グラフィクスを取り込む。このブロックに
おいて、設計者は設計取り込みシステムに対して設計に
用いられている部品を識別し、またこれらの部品の各種
ピン間の接続ワイヤを識別する。ブロック202 の実行中
及びその完了後、取り込まれた設計が、グラフィクス・
ディスプレイ108 (図1)によって設計者に表示され
る。設計の取り込みがすむと、ブロック204 は、この設
計を処理して設計者のために何らかの機能を果たす処理
ツールを選択する。例えば、ユーザはデジタル設計の機
能をシミュレートする論理シミュレータを選択すること
ができる。処理ツールの選択がすむと、ブロック206 は
取り込まれた設計の部品を選択されたツールに連関した
モデルにリンクする。次に、ブロック208 は取り込まれ
た設計のグラフィクスと、ブロック206 が選択したモデ
ルとを組み合わせて、取り込まれた設計の部品、これら
の部品を接続するワイヤ及び選択されたモデルについ
て、これらの部品に関連するパラメータを記述するネッ
トリストを作成する。次に、ブロック210 は、ブロック
208 で作成されたネットリストを用いて、選択されたツ
ールを実行し、ユーザが望む機能を果す。次に、ブロッ
ク212 は、設計の処理に別のツールを使用するか否かを
決定し、使用する場合にはブロック212 からブロック20
4 へ戻り次のツールを選択する。それ以上の処理が望ま
れていなければ、ブロック212 が設計取り込みシステム
を脱出する。
ロセスに関するフロー・チャートを示す。ここで図2を
参照すると、ここに入った後、ブロック202 は設計者が
入力した設計グラフィクスを取り込む。このブロックに
おいて、設計者は設計取り込みシステムに対して設計に
用いられている部品を識別し、またこれらの部品の各種
ピン間の接続ワイヤを識別する。ブロック202 の実行中
及びその完了後、取り込まれた設計が、グラフィクス・
ディスプレイ108 (図1)によって設計者に表示され
る。設計の取り込みがすむと、ブロック204 は、この設
計を処理して設計者のために何らかの機能を果たす処理
ツールを選択する。例えば、ユーザはデジタル設計の機
能をシミュレートする論理シミュレータを選択すること
ができる。処理ツールの選択がすむと、ブロック206 は
取り込まれた設計の部品を選択されたツールに連関した
モデルにリンクする。次に、ブロック208 は取り込まれ
た設計のグラフィクスと、ブロック206 が選択したモデ
ルとを組み合わせて、取り込まれた設計の部品、これら
の部品を接続するワイヤ及び選択されたモデルについ
て、これらの部品に関連するパラメータを記述するネッ
トリストを作成する。次に、ブロック210 は、ブロック
208 で作成されたネットリストを用いて、選択されたツ
ールを実行し、ユーザが望む機能を果す。次に、ブロッ
ク212 は、設計の処理に別のツールを使用するか否かを
決定し、使用する場合にはブロック212 からブロック20
4 へ戻り次のツールを選択する。それ以上の処理が望ま
れていなければ、ブロック212 が設計取り込みシステム
を脱出する。
【0023】図3は、シンボルを複数のモデルの1つに
リンクする能力を持つ単一のシンボルを示す図である。
ここで図3を参照すると、取り込まれた設計300 が示さ
れており、図2のフロー・チャートを用いて取り込むこ
とができる設計を例示している。取り込まれた設計300
は、第1の部品302 、第2の部品304 及び第3の部品30
6 を有している。これらの部品は全てワイヤ307 によっ
て接続されている。破線316 は第2の部品304 が、複数
のモデル308 、310 、312 または314 の1つにリンクで
きる単一のグラフィクス・シンボルを持っていることを
表わしている。
リンクする能力を持つ単一のシンボルを示す図である。
ここで図3を参照すると、取り込まれた設計300 が示さ
れており、図2のフロー・チャートを用いて取り込むこ
とができる設計を例示している。取り込まれた設計300
は、第1の部品302 、第2の部品304 及び第3の部品30
6 を有している。これらの部品は全てワイヤ307 によっ
て接続されている。破線316 は第2の部品304 が、複数
のモデル308 、310 、312 または314 の1つにリンクで
きる単一のグラフィクス・シンボルを持っていることを
表わしている。
【0024】図4は単一のシンボルから複数モデルへの
リンクを示す図である。ここで図4を参照すると、本発
明では、グラフィクス・ページ402 及び接ぎ穂すなわち
リンク・ページ404 によって、回路の部品についてのシ
ンボルを表わす。グラフィクス・ページ402 には、部品
のシンボルが回路中で用いられる度に、グラフィクス・
ディスプレイ108 (図1)に表示されるグラフィック・
イメージが納められている。部品シンボルの一部をなす
リンク・ページ404 は、このシンボルをリンクさせるこ
とができる全てのツール及びモデルを定義している。例
えば、図4に示すシンボルは、2つのツールA406及びB4
08にリンクできる。ユーザは、ツール処理の開始時に、
どの処理を行ないたいかに従って、ツールAまたはツー
ルBの選択を行なう。この例について説明を続けると、
ツールA406 内において、このシンボルは2つのモデル
・タイプA1及びA2にリンクできる。このシンボルは
現在モデル・タイプ・パラメータ406 及びモデル・カプ
ラ410 を介してモデルA1_74LS×××にリンクしてい
る。モデル・タイプはそれぞれ、シミュレーションの精
度というような共通の特性を備えるモデルの1つのファ
ミリーを定義し、タイプ内において、各部品はモデルを
有している。このシステムでは、ユーザは全ての部品に
ついてのモデル・タイプのパラメータを単一のコマンド
で変更でき、従ってツール内の1つのモデルからそのツ
ール内のもう1つのモデルへ容易に変更できる。また、
回路内の異なるシンボルは、異なるモデル・タイプにリ
ンクすることができるし、あるいは全て同じモデル・タ
イプにリンクすることもできる。こうして、例えば、回
路内のマイクロプロセッサ及びそのメモリは機能レベル
のみでシミュレートし、一方、他の部品はゲート・レベ
ルでシミュレートすることができる。
リンクを示す図である。ここで図4を参照すると、本発
明では、グラフィクス・ページ402 及び接ぎ穂すなわち
リンク・ページ404 によって、回路の部品についてのシ
ンボルを表わす。グラフィクス・ページ402 には、部品
のシンボルが回路中で用いられる度に、グラフィクス・
ディスプレイ108 (図1)に表示されるグラフィック・
イメージが納められている。部品シンボルの一部をなす
リンク・ページ404 は、このシンボルをリンクさせるこ
とができる全てのツール及びモデルを定義している。例
えば、図4に示すシンボルは、2つのツールA406及びB4
08にリンクできる。ユーザは、ツール処理の開始時に、
どの処理を行ないたいかに従って、ツールAまたはツー
ルBの選択を行なう。この例について説明を続けると、
ツールA406 内において、このシンボルは2つのモデル
・タイプA1及びA2にリンクできる。このシンボルは
現在モデル・タイプ・パラメータ406 及びモデル・カプ
ラ410 を介してモデルA1_74LS×××にリンクしてい
る。モデル・タイプはそれぞれ、シミュレーションの精
度というような共通の特性を備えるモデルの1つのファ
ミリーを定義し、タイプ内において、各部品はモデルを
有している。このシステムでは、ユーザは全ての部品に
ついてのモデル・タイプのパラメータを単一のコマンド
で変更でき、従ってツール内の1つのモデルからそのツ
ール内のもう1つのモデルへ容易に変更できる。また、
回路内の異なるシンボルは、異なるモデル・タイプにリ
ンクすることができるし、あるいは全て同じモデル・タ
イプにリンクすることもできる。こうして、例えば、回
路内のマイクロプロセッサ及びそのメモリは機能レベル
のみでシミュレートし、一方、他の部品はゲート・レベ
ルでシミュレートすることができる。
【0025】モデルA1のカプラA1410 はディスク11
2 に納められたモデル422 へのポイントを含んでいる。
また、モデルA2のカプラ412 は、これもまたディスク
112 に納められたそのモデル426 へのポイントを含んで
いる。カプラ410 には2つのパラメータ、すなわちDELA
Y(遅延)414とEXFILE416 が含まれている。これらのパラ
メータはツールAの実行開始時に設計取り込みシステム
がツールAに対して送るネットリストの作成に用いられ
る。カプラ412 もまたカプラ410 のDELAY パラメータ41
4 に相当するDELAY パラメータ418 を含んでいる。モデ
ル・タイプとカプラは共に、シンボル402 と複数のモデ
ル422 、426 との間にリンクを形成する。別の実施例と
しては、グラフィクスとリンクを組み合わせて単一のペ
ージとすることができる。
2 に納められたモデル422 へのポイントを含んでいる。
また、モデルA2のカプラ412 は、これもまたディスク
112 に納められたそのモデル426 へのポイントを含んで
いる。カプラ410 には2つのパラメータ、すなわちDELA
Y(遅延)414とEXFILE416 が含まれている。これらのパラ
メータはツールAの実行開始時に設計取り込みシステム
がツールAに対して送るネットリストの作成に用いられ
る。カプラ412 もまたカプラ410 のDELAY パラメータ41
4 に相当するDELAY パラメータ418 を含んでいる。モデ
ル・タイプとカプラは共に、シンボル402 と複数のモデ
ル422 、426 との間にリンクを形成する。別の実施例と
しては、グラフィクスとリンクを組み合わせて単一のペ
ージとすることができる。
【0026】図5は、シンボルと、このシンボルにリン
クされたツール、モデル及びパラメータを示す階層図で
ある。ここで図5を参照すると、シンボル502は、ツ
ール1504、ツール2 506及びツールM508
で示された複数のツールの1つにリンクできる。これら
のツールは各々、複数のモデルを有することができる。
そのようなモデルとして、ここではツール1にリンクさ
れたモデル1 510、モデル2 512及びモデルN
514で示されている。シンボルについての各モデル
は複数のパラメータを持つことができる。そのようなパ
ラメータは、ここではモデル2 512に送られるPA
RAMI 516、PARAM2 518及びPARA
MP 520で示されている。こうして、単一のグラフ
ィック・イメージを持つ単一の部品シンボルが、取り込
まれた設計を用いて多様な機能を果たすために、複数の
ツール及びモデルとともに用いられる。モデルはツール
にリンクされているので、設計者が別のツールを用いて
別の種類の処理を実行しようとする場合、設計取り込み
システムに対してこの新しいツールの定義を行なえば、
自動的に新しいモデルとパラメータの組が取り込まれた
回路のシンボルにリンクされる。設計者は、単一の設計
を各種の精度レベルでシミュレートするために必要とな
るかもしれない複数のモデルのうちの任意1つを特定の
ツール内で各シンボルにリンクすることができる。この
構成の階層のため、設計取り込みシステムに新しいツー
ルを組み込む際に各部品に新しいシンボルを統合する必
要がなく、従って各ツールを組み込む際にかなりの時間
が節約される。全てのツールに対して単一のシンボルが
用いられるので、設計取り込みシステムにおいて、かな
りの記憶スペースの節約にもなる。ユーザも、モデルま
たはツールを変更する際、新しいツール、従って新しい
モデルの組を用いることになってもグラフィクス・スク
リーンに回路を描き直す必要がなくなるため、かなりの
時間の節約になる。また、この結果、ツール変更時に1
つのグラフィクス・シンボルから別のグラフィクス・シ
ンボルへの変換が不要になるので、かなりのユーザ時間
が節約される。また、この階層のため設計者はいつでも
モデルとツールの選択が行なえるので、回路を設計取り
込みシステムにいつ入力するかについての制約がなくな
る。
クされたツール、モデル及びパラメータを示す階層図で
ある。ここで図5を参照すると、シンボル502は、ツ
ール1504、ツール2 506及びツールM508
で示された複数のツールの1つにリンクできる。これら
のツールは各々、複数のモデルを有することができる。
そのようなモデルとして、ここではツール1にリンクさ
れたモデル1 510、モデル2 512及びモデルN
514で示されている。シンボルについての各モデル
は複数のパラメータを持つことができる。そのようなパ
ラメータは、ここではモデル2 512に送られるPA
RAMI 516、PARAM2 518及びPARA
MP 520で示されている。こうして、単一のグラフ
ィック・イメージを持つ単一の部品シンボルが、取り込
まれた設計を用いて多様な機能を果たすために、複数の
ツール及びモデルとともに用いられる。モデルはツール
にリンクされているので、設計者が別のツールを用いて
別の種類の処理を実行しようとする場合、設計取り込み
システムに対してこの新しいツールの定義を行なえば、
自動的に新しいモデルとパラメータの組が取り込まれた
回路のシンボルにリンクされる。設計者は、単一の設計
を各種の精度レベルでシミュレートするために必要とな
るかもしれない複数のモデルのうちの任意1つを特定の
ツール内で各シンボルにリンクすることができる。この
構成の階層のため、設計取り込みシステムに新しいツー
ルを組み込む際に各部品に新しいシンボルを統合する必
要がなく、従って各ツールを組み込む際にかなりの時間
が節約される。全てのツールに対して単一のシンボルが
用いられるので、設計取り込みシステムにおいて、かな
りの記憶スペースの節約にもなる。ユーザも、モデルま
たはツールを変更する際、新しいツール、従って新しい
モデルの組を用いることになってもグラフィクス・スク
リーンに回路を描き直す必要がなくなるため、かなりの
時間の節約になる。また、この結果、ツール変更時に1
つのグラフィクス・シンボルから別のグラフィクス・シ
ンボルへの変換が不要になるので、かなりのユーザ時間
が節約される。また、この階層のため設計者はいつでも
モデルとツールの選択が行なえるので、回路を設計取り
込みシステムにいつ入力するかについての制約がなくな
る。
【0027】図6は本発明の設計取り込みシステムにお
けるシンボルの使用例を示す。ここで図6を参照する
と、AND ゲート604 、JKフリップ・フロップ606 及びNA
NDゲート608 がいくつかの入力と1つの出力とともに相
互接続された回路602 が示されている。AND ゲート604
は対応するリンク・ページ610 を持っている。リンク・
ページ610 はモデル・タイプAについてのモデル・タイ
プ・パラメータ及びモデルA_7408についてのモデル・
カプラを含み、遅延パラメータ2を有し、ツール×に用
いられる。フリップ・フロップ606 は対応するリンク・
ページ612 を持つ。リンクページはモデル・タイプAに
ついてのモデル・タイプ・パラメータ及びモデルA_74
74についてのモデル・カプラを含み、遅延パラメータ3
を有し、ツール×に用いられる。NANDゲート608 は、対
応するリンク・ページ614 を持つ。リンク・ページ614
はモデルBについてのモデル・タイプ・パラメータ及び
モデルB_7400についてのモデル・カプラを含み、遅延
パラメータを有し、これまたツール×に用いられる。
けるシンボルの使用例を示す。ここで図6を参照する
と、AND ゲート604 、JKフリップ・フロップ606 及びNA
NDゲート608 がいくつかの入力と1つの出力とともに相
互接続された回路602 が示されている。AND ゲート604
は対応するリンク・ページ610 を持っている。リンク・
ページ610 はモデル・タイプAについてのモデル・タイ
プ・パラメータ及びモデルA_7408についてのモデル・
カプラを含み、遅延パラメータ2を有し、ツール×に用
いられる。フリップ・フロップ606 は対応するリンク・
ページ612 を持つ。リンクページはモデル・タイプAに
ついてのモデル・タイプ・パラメータ及びモデルA_74
74についてのモデル・カプラを含み、遅延パラメータ3
を有し、ツール×に用いられる。NANDゲート608 は、対
応するリンク・ページ614 を持つ。リンク・ページ614
はモデルBについてのモデル・タイプ・パラメータ及び
モデルB_7400についてのモデル・カプラを含み、遅延
パラメータを有し、これまたツール×に用いられる。
【0028】回路602 の回路接続とリンク・ページ610
、612 及び614 が、設計取り込みシステムによって組
み合わせられ、ネットリスト616 が作成される。ネット
リスト616 は回路602 の全接続を示しており、リンク・
ページに見出される回路の部品に対応付けられたパラメ
ータを含む。ネットリスト616 において、遅延パラメー
タが2つのモデルA_7408はシンボルU1にリンクして
いる。シンボルU1のピンは、接続される順番に示され
ている。すなわち、リストの最初にあるIN2 はピン1に
接続され、リストの2番目にあるIN3 はピン2に接続さ
れ、リストの3番目にあるNETXはピン3に接続される。
同様に、モデルA_7474はシンボルU2にリンクされ、
U2のピン接続が記述されている。U3は、モデルB_
7400にリンクされ、そのピン接続も記述されている。
、612 及び614 が、設計取り込みシステムによって組
み合わせられ、ネットリスト616 が作成される。ネット
リスト616 は回路602 の全接続を示しており、リンク・
ページに見出される回路の部品に対応付けられたパラメ
ータを含む。ネットリスト616 において、遅延パラメー
タが2つのモデルA_7408はシンボルU1にリンクして
いる。シンボルU1のピンは、接続される順番に示され
ている。すなわち、リストの最初にあるIN2 はピン1に
接続され、リストの2番目にあるIN3 はピン2に接続さ
れ、リストの3番目にあるNETXはピン3に接続される。
同様に、モデルA_7474はシンボルU2にリンクされ、
U2のピン接続が記述されている。U3は、モデルB_
7400にリンクされ、そのピン接続も記述されている。
【0029】いったん設計取り込みシステムによってネ
ットリスト616 が構築されると、ネットリストはそれ以
上の処理に備えてツール×618 に送られる。ツール×は
論理シミュレータ、回路のプリント回路を生成するため
のプリント回路レイアウト・ツールまたはその他のタイ
プの解析あるいは合成ツールであってよい。
ットリスト616 が構築されると、ネットリストはそれ以
上の処理に備えてツール×618 に送られる。ツール×は
論理シミュレータ、回路のプリント回路を生成するため
のプリント回路レイアウト・ツールまたはその他のタイ
プの解析あるいは合成ツールであってよい。
【0030】以上の例で示すように、特定のツール内で
回路部品を特定のモデルにリンクする方法であるため、
例えばツールYといった別のツールに変更し、この新し
いツールのために異なるフォーマットを持つ新しいネッ
トリストを設計取り込みシステムに生成させるのは極め
て簡単である。また、このシステムは、全リンク・ペー
ジ上のモデル・タイプ・パラメータを大域的に変更する
ことによって、全てのシンボルに用いられているモデル
を変更することができる。さらに、同じ名前の全てのパ
ラメータに関する値も、このシステムによって大域的に
変更することができる。
回路部品を特定のモデルにリンクする方法であるため、
例えばツールYといった別のツールに変更し、この新し
いツールのために異なるフォーマットを持つ新しいネッ
トリストを設計取り込みシステムに生成させるのは極め
て簡単である。また、このシステムは、全リンク・ペー
ジ上のモデル・タイプ・パラメータを大域的に変更する
ことによって、全てのシンボルに用いられているモデル
を変更することができる。さらに、同じ名前の全てのパ
ラメータに関する値も、このシステムによって大域的に
変更することができる。
【0031】図7は、複数ツール内で複数モデルに用い
られているシンボルを示す。ここで、図7を参照する
と、取り込まれた設計702 は、例えば、ツール1 704、
ツール2 706、ツール3 708またはツールM 710といっ
た複数のツールの1つに用いることができ、取り込まれ
た設計702 の各部品をこれらの各ツール内で複数のモデ
ルの1つにリンクすることができる。
られているシンボルを示す。ここで、図7を参照する
と、取り込まれた設計702 は、例えば、ツール1 704、
ツール2 706、ツール3 708またはツールM 710といっ
た複数のツールの1つに用いることができ、取り込まれ
た設計702 の各部品をこれらの各ツール内で複数のモデ
ルの1つにリンクすることができる。
【0032】以上の方法及び装置は、広範なコンピュー
タ化設計取り込みシステムに有効である。それらは、複
数のモデルへリンクできる単一のシンボルを用いるあら
ゆる設計取り込みシステムに適している。こうしたシス
テムの例には、ソフトウェア設計取り込みシステムや、
機械的設計取り込みシステムがある。これで本発明の現
在のところ望ましい実施例についての説明を終えた。今
や明らかなように、本発明の目的は完全に達成されてい
るが、当該技術の熟練者であれば理解できるように、本
発明の精神及び範囲を逸脱することなく、構成及び回路
上の多くの変更や、本発明の多種多様な実施例及び用途
が自ずと明らかになるであろう。ここにおける開示及び
説明は例示を意図したものであり本発明に制限を加える
意味のものではなく、本発明の技術的範囲の定義は特許
請求の範囲がもっと適切に行なっている。
タ化設計取り込みシステムに有効である。それらは、複
数のモデルへリンクできる単一のシンボルを用いるあら
ゆる設計取り込みシステムに適している。こうしたシス
テムの例には、ソフトウェア設計取り込みシステムや、
機械的設計取り込みシステムがある。これで本発明の現
在のところ望ましい実施例についての説明を終えた。今
や明らかなように、本発明の目的は完全に達成されてい
るが、当該技術の熟練者であれば理解できるように、本
発明の精神及び範囲を逸脱することなく、構成及び回路
上の多くの変更や、本発明の多種多様な実施例及び用途
が自ずと明らかになるであろう。ここにおける開示及び
説明は例示を意図したものであり本発明に制限を加える
意味のものではなく、本発明の技術的範囲の定義は特許
請求の範囲がもっと適切に行なっている。
【図1】本発明を用いるコンピュータ・システムのブロ
ック図である。
ック図である。
【図2】電子設計を入力する過程のフローチャートであ
る。
る。
【図3】複数のモデルについて用いられる単一のシンボ
ルを示す図である。
ルを示す図である。
【図4】単一のシンボルと複数のモデルとの間のリンク
を示す図である。
を示す図である。
【図5】シンボルとそのシンボルにリンクされているツ
ール、モデル及びパラメータを示す階層図である。
ール、モデル及びパラメータを示す階層図である。
【図6】シンボルとシステム中におけるその使い方の例
を示す図である。
を示す図である。
【図7】複数のツール内において複数のモデルについて
使用されるシンボルを示す図である。
使用されるシンボルを示す図である。
100:コンピュータ・システム 102:処理要素 104:システム・バス 106:キーボード 108:グラフィクス・ディスプレイ 110:ディスク・コントローラ 112:ディスク 114:メモリ 116:グラフィクス入力デバイス 300:取り込まれた設計 308,310,312,314:モデル 402:グラフィクス・ページ 404:リンク・ページ 410,412:モデル・カプラ 422,426:モデル 502:シンボル 504,506,508:ツール 510,512,514:モデル 516,518,520:パラメータ 602:回路 610,612,614:リンク・ページ 616:ネットリスト 618:ツール 702:取り込まれた設計 704,706,708,710:ツール
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 情報処理学会研究報告 vol.86, no.2,p44.5.1−44.5.8, 久野巧ほか,「設計支援システムにおけ る設計対象の階層的表現法とその応用」 (58)調査した分野(Int.Cl.7,DB名) G06F 17/50
Claims (12)
- 【請求項1】ユーザによる設計の入力および処理を可能
にするための、複数のシンボルおよび複数のモデルタイ
プを有する設計取り込みシステムであって、 選択されたシンボルのリストを受け入れる手段および前
記選択されたシンボル間の接続のリストを受け入れる手
段を備えた、前記設計取り込みシステムのユーザから設
計を取り込む手段と、 前記選択されたシンボルの各々についてのリンクページ
と、 前記選択されたシンボルの各々を前記リンクページのう
ちの1つにリンクする手段と、 前記複数のモデルタイプの各々について1つずつ設けら
れた、前記リンクページの各々に含まれる複数のカプラ
と、 前記カプラの各々を前記モデルタイプのうちの対応する
1つにリンクする手段と、 任意のときにユーザから前記選択されたシンボルのすべ
てについて1つのモデルタイプの選択を受け入れる手段
と、 前記選択されたシンボルの各々を、ユーザから受け入れ
た前記モデルタイプの選択によって同定されたモデルタ
イプにリンクされた前記複数のカプラのうちの1つにリ
ンクする手段と を有することを特徴とする設計取り込みシステム。 - 【請求項2】ユーザから前記カプラの各々に含まれるパ
ラメータの1以上の値を受け入れる手段を含むことを特
徴とする請求項1記載のシステム。 - 【請求項3】前記接続のリストを前記パラメータ値と組
み合わせてネットリストを生成する手段を含むことを特
徴とする請求項2記載のシステム。 - 【請求項4】すべてのカプラに含まれる共通のパラメー
タ名を持つすべてのパラメータについてパラメータ値を
設定する手段を含むことを特徴とする請求項2記載のシ
ステム。 - 【請求項5】前記受け入れ手段が前記ユーザから前記選
択されたシンボルのすべてについて他の1つのモデルタ
イプの選択を受け入れると、前記選択されたシンボルの
すべてを新たなカプラにリンクし直す手段を含むことを
特徴とする請求項1記載のシステム。 - 【請求項6】ユーザによる設計の入力および処理を可能
にするための設計取り込みシステムであって、前記シス
テムは複数のシンボルおよび複数のツールを有し、前記
ツールは各々少なくとも1つのモデルタイプを有し、前
記システムは、 選択されたシンボルのリストを受け入れる手段および前
記選択されたシンボル間の接続のリストを受け入れる手
段を備えた、前記設計取り込みシステムのユーザから設
計図を取り込む手段と、 前記選択されたシンボルの各々についてのリンクページ
と、 前記選択されたシンボルの各々を前記リンクページのう
ちの対応する1つにリンクする手段と、 前記ツールの各々の中の前記少なくとも1つのモデルタ
イプの各々について1つずつ設けられた、前記リンクペ
ージの各々に含まれる複数のカプラと、 前記カプラの各々を前記モデルタイプのうちの対応する
1つにリンクする手段と、 任意のときにユーザからのツールの選択を受け入れる手
段と、 任意のときに前記ユーザから前記選択されたシンボルの
すべてについて1つのモデルタイプの選択を受け入れる
手段と、 前記選択されたシンボルの各々を、ユーザから受け入れ
た前記ツールの選択によって同定された前記モデルタイ
プおよび前記ツールにリンクされた前記複数のカプラの
うちの1つにリンクする手段と を有することを特徴とする設計取り込みシステム。 - 【請求項7】ユーザから前記カプラの各々のパラメータ
の1以上の値を受け入れる手段を含むことを特徴とする
請求項6記載のシステム。 - 【請求項8】すべてのモデルカプラの中の共通のパラメ
ータ名を持つすべてのパラメータについてパラメータ値
を変更する手段を含むことを特徴とする請求項7記載の
システム。 - 【請求項9】前記接続のリストを前記パラメータ値と組
み合わせて前記複数のツールによって用いられるネット
リストを生成する手段を含むことを特徴とする請求項7
記載のシステム。 - 【請求項10】前記受け入れ手段が前記ユーザから前記
選択されたシンボルのすべてについて他の1つのモデル
タイプの選択を受け入れると、前記選択されたシンボル
のすべてを前記リンクページの中の前記複数のカプラの
うちの異なる1つにリンクし直す手段を含むことを特徴
とする請求項7記載のシステム。 - 【請求項11】前記再リンクの後、前記パラメータ値を
前記カプラのすべてに保持する手段を含むことを特徴と
する請求項10記載のシステム。 - 【請求項12】前記複数のツールの各々にさらにモデル
を追加する手段を含むことを特徴とする請求項6記載の
システム。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US07/451,208 US5164911A (en) | 1989-12-15 | 1989-12-15 | Schematic capture method having different model couplers for model types for changing the definition of the schematic based upon model type selection |
US451208 | 1999-11-29 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH03257671A JPH03257671A (ja) | 1991-11-18 |
JP3027009B2 true JP3027009B2 (ja) | 2000-03-27 |
Family
ID=23791244
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2405424A Expired - Fee Related JP3027009B2 (ja) | 1989-12-15 | 1990-12-05 | 設計取り込みシステム |
Country Status (3)
Country | Link |
---|---|
US (1) | US5164911A (ja) |
EP (1) | EP0433066A3 (ja) |
JP (1) | JP3027009B2 (ja) |
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---|---|---|---|---|
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US5544067A (en) | 1990-04-06 | 1996-08-06 | Lsi Logic Corporation | Method and system for creating, deriving and validating structural description of electronic system from higher level, behavior-oriented description, including interactive schematic design and simulation |
US5544066A (en) * | 1990-04-06 | 1996-08-06 | Lsi Logic Corporation | Method and system for creating and validating low level description of electronic design from higher level, behavior-oriented description, including estimation and comparison of low-level design constraints |
US5222030A (en) * | 1990-04-06 | 1993-06-22 | Lsi Logic Corporation | Methodology for deriving executable low-level structural descriptions and valid physical implementations of circuits and systems from high-level semantic specifications and descriptions thereof |
US5867399A (en) * | 1990-04-06 | 1999-02-02 | Lsi Logic Corporation | System and method for creating and validating structural description of electronic system from higher-level and behavior-oriented description |
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US5572437A (en) * | 1990-04-06 | 1996-11-05 | Lsi Logic Corporation | Method and system for creating and verifying structural logic model of electronic design from behavioral description, including generation of logic and timing models |
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US5541849A (en) * | 1990-04-06 | 1996-07-30 | Lsi Logic Corporation | Method and system for creating and validating low level description of electronic design from higher level, behavior-oriented description, including estimation and comparison of timing parameters |
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