JP2723699B2 - Ｔｕ−３ポインター付替処理方式 - Google Patents
Ｔｕ−３ポインター付替処理方式Info
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- JP2723699B2 JP2723699B2 JP3192329A JP19232991A JP2723699B2 JP 2723699 B2 JP2723699 B2 JP 2723699B2 JP 3192329 A JP3192329 A JP 3192329A JP 19232991 A JP19232991 A JP 19232991A JP 2723699 B2 JP2723699 B2 JP 2723699B2
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04J—MULTIPLEX COMMUNICATION
- H04J3/00—Time-division multiplex systems
- H04J3/02—Details
- H04J3/06—Synchronising arrangements
- H04J3/07—Synchronising arrangements using pulse stuffing for systems with different or fluctuating information rates or bit rates
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04J—MULTIPLEX COMMUNICATION
- H04J3/00—Time-division multiplex systems
- H04J3/02—Details
- H04J3/06—Synchronising arrangements
- H04J3/062—Synchronisation of signals having the same nominal but fluctuating bit rates, e.g. using buffers
- H04J3/0623—Synchronous multiplexing systems, e.g. synchronous digital hierarchy/synchronous optical network (SDH/SONET), synchronisation with a pointer process
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Computer Hardware Design (AREA)
- Time-Division Multiplex Systems (AREA)
Description
【０００１】
【産業上利用分野】本発明はデジタル伝送装置に用いら
れる処理方式に関し、特に、同期系であるＳＤＨ（Ｓｙ
ｎｃｈｒｏｎｏｕｓ Ｄｉｇｉｔａｌ Ｈｉｅｒａｒｃ
ｙ）を用いたデータ伝送に用いられる処理方式に関す
る。
れる処理方式に関し、特に、同期系であるＳＤＨ（Ｓｙ
ｎｃｈｒｏｎｏｕｓ Ｄｉｇｉｔａｌ Ｈｉｅｒａｒｃ
ｙ）を用いたデータ伝送に用いられる処理方式に関す
る。
【０００２】
【従来の技術】従来から、ＳＤＨを用いたデータ伝送
（以下単にデータ伝送という）が知られており、このＳ
ＤＨはＣＥＰＴ系ＳＰＥＣ．Ｃ．Ｃ．Ｉ．Ｔ．Ｔ．のＧ
７０７，Ｇ７０８、及びＧ７０９によって規定されてい
る。上記のデータ伝送では、まずＧ７０７で示される非
同期３４Ｍ信号をコンテナ３（以下Ｃ−３という）にマ
ッピングする。そして、このＣ−３をバーチャルコンテ
ナ３（以下ＶＣ−３という）にマッピングする。次に、
このＶＣ−３をＴＵポインターを有するトリビュータリ
ーユニット３（以下ＴＵ−３という）にマッピングす
る。さらに、三つのＴＵ−３を多重化した後、Ｐａｓｓ
Ｏｖｅｒ Ｈｅａｄ（以下ＰＯＨという）付きのＶＣ
−４にマッピングする。そして、このＶＣ−４をＡＵポ
インターを備えるアドミニストレイティブユニット４
（以下ＡＵ−４という）にマッピングし、さらに、Ｓｅ
ｃｔｉｏｎ Ｏｖｅｒ Ｈｅａｄ（以下ＳＯＨという）
付きシンクロナストランスポートモジュール１（以下Ｓ
ＴＭ−１という）にマッピングして信号を伝送する。一
方、ＳＴＭ−１からの信号を受信した際には、上述と逆
の動作を行って信号を生成している。
（以下単にデータ伝送という）が知られており、このＳ
ＤＨはＣＥＰＴ系ＳＰＥＣ．Ｃ．Ｃ．Ｉ．Ｔ．Ｔ．のＧ
７０７，Ｇ７０８、及びＧ７０９によって規定されてい
る。上記のデータ伝送では、まずＧ７０７で示される非
同期３４Ｍ信号をコンテナ３（以下Ｃ−３という）にマ
ッピングする。そして、このＣ−３をバーチャルコンテ
ナ３（以下ＶＣ−３という）にマッピングする。次に、
このＶＣ−３をＴＵポインターを有するトリビュータリ
ーユニット３（以下ＴＵ−３という）にマッピングす
る。さらに、三つのＴＵ−３を多重化した後、Ｐａｓｓ
Ｏｖｅｒ Ｈｅａｄ（以下ＰＯＨという）付きのＶＣ
−４にマッピングする。そして、このＶＣ−４をＡＵポ
インターを備えるアドミニストレイティブユニット４
（以下ＡＵ−４という）にマッピングし、さらに、Ｓｅ
ｃｔｉｏｎ Ｏｖｅｒ Ｈｅａｄ（以下ＳＯＨという）
付きシンクロナストランスポートモジュール１（以下Ｓ
ＴＭ−１という）にマッピングして信号を伝送する。一
方、ＳＴＭ−１からの信号を受信した際には、上述と逆
の動作を行って信号を生成している。
【０００３】
【発明が解決しようとする課題】しかしながら、従来の
データ伝送の場合、ＴＵ−３ポインターの付け替えを行
うことができないという問題点がある。
データ伝送の場合、ＴＵ−３ポインターの付け替えを行
うことができないという問題点がある。
【０００４】本発明の目的はＴＵ−３ポインターの付け
替えを行うことのできる処理方式を提供することにあ
る。
替えを行うことのできる処理方式を提供することにあ
る。
【０００５】
【課題を解決するための手段】本発明によればＣＥＰＴ
系ＳＰＥＣ．Ｃ．Ｃ．Ｉ．Ｔ．Ｔ． Ｇ．７０７，７０
８，７０９によって規定されているＳｙｎｃｈｒｏｎｏ
ｕｓ ＤｉｇｉｔａｌＨｉｅｒａｒｃｙ（ＳＤＨ）にお
いて、Ｇ．７０７にて示される非同期３４Ｍ信号をＣ−
３というＣｏｎｔａｉｎｅｒ３にマッピングし、Ｃ−３
をＶＣ−３（Ｖｉｒｔｒａｌ Ｃｏｎｔａｉｎｅｒ３に
マッピングし、ＶＣ−３をＴＵポインターを持つＴＵ−
３（Ｔｒｉｂｕｔａｒｙ Ｕｎｉｔ３）にマッピングし
さらに３つのＴＵ−３を多重化し、ＰＯＨ（Ｐａｓｓ
Ｏｖｅｒ Ｈｅａｄ）のついたＶＣ−４にマッピングし
ＶＣ−４をＡＵ−ポインターを持つＡＵ−４（Ａｄｍｉ
ｎｉｓｔｒａｔｉｖｅ Ｕｎｉｔ４）にマッピングしさ
らにＳＯＨ（Ｓｅｃｔｉｏｎ Ｏｖｅｒ Ｈｅａｄ）の
ついたＳＴＭ−１（Ｓｙｎｃｈｒｏｎｏｕｓ Ｔｒａｎ
ｓｐｏｒｔ Ｍｏｄｕｌｅ１）にマッピングして伝送す
る又、ＳＴＭ−１の信号を受信し以上の逆の動作を行う
装置において２方向（Ｗｅｓｔ→Ｅａｓｔ方向、Ｅａｓ
ｔ→Ｗｅｓｔ方向）のＳＴＭ−１を受信するオプション
を持ち、又前記３４Ｍ信号をＳＴＭ−１信号にする際Ｓ
ＴＭ−１の周波数の１／３のものを３つ作り（以後ＳＴ
Ｍ−１／３と略記）又前記２方向のＳＴＭ−１信号をそ
れぞれＳＴＭ−１／３の信号３つに多重分離しそれら合
計９つのＳＴＭ−１／３の信号を１つのモジュールユニ
ットに入力する際において、１つのＴＵ−３データを含
むＳＴＭ−１／３の信号（この信号の周波数はすでに装
置側のものに乗り換えられているが）を入力の際まちま
ちであったＡ１（ＳＯＨの中の１つのバイト）位相をＵ
ｎｉｔ内の絶対位相（ある決められたＡ１位相）に合わ
せてＳＴＭ−１／３の形で出力する方式において、入力
されたＳＴＭ−１／３信号のＡＵポインターにて発生し
たポジティブ又は、ネガティブのスタッフをＡＵポイン
ター値はポジティブ、ネガティブスタッフは発生させな
いで常に０とし、ＴＵ−３のポインターを付替えること
によりデータの遅れを発生させないようにし、又ＡＵポ
インターにて発生していたポジティブ、ネガティブスタ
ッフをＴＵ−３レベルのポジティブ、ネガティブスタッ
フに置き換えて、ＳＴＭ−１／３にて出力することを特
徴とするＴＵ−３ポインター付替処理方式が得られる。
系ＳＰＥＣ．Ｃ．Ｃ．Ｉ．Ｔ．Ｔ． Ｇ．７０７，７０
８，７０９によって規定されているＳｙｎｃｈｒｏｎｏ
ｕｓ ＤｉｇｉｔａｌＨｉｅｒａｒｃｙ（ＳＤＨ）にお
いて、Ｇ．７０７にて示される非同期３４Ｍ信号をＣ−
３というＣｏｎｔａｉｎｅｒ３にマッピングし、Ｃ−３
をＶＣ−３（Ｖｉｒｔｒａｌ Ｃｏｎｔａｉｎｅｒ３に
マッピングし、ＶＣ−３をＴＵポインターを持つＴＵ−
３（Ｔｒｉｂｕｔａｒｙ Ｕｎｉｔ３）にマッピングし
さらに３つのＴＵ−３を多重化し、ＰＯＨ（Ｐａｓｓ
Ｏｖｅｒ Ｈｅａｄ）のついたＶＣ−４にマッピングし
ＶＣ−４をＡＵ−ポインターを持つＡＵ−４（Ａｄｍｉ
ｎｉｓｔｒａｔｉｖｅ Ｕｎｉｔ４）にマッピングしさ
らにＳＯＨ（Ｓｅｃｔｉｏｎ Ｏｖｅｒ Ｈｅａｄ）の
ついたＳＴＭ−１（Ｓｙｎｃｈｒｏｎｏｕｓ Ｔｒａｎ
ｓｐｏｒｔ Ｍｏｄｕｌｅ１）にマッピングして伝送す
る又、ＳＴＭ−１の信号を受信し以上の逆の動作を行う
装置において２方向（Ｗｅｓｔ→Ｅａｓｔ方向、Ｅａｓ
ｔ→Ｗｅｓｔ方向）のＳＴＭ−１を受信するオプション
を持ち、又前記３４Ｍ信号をＳＴＭ−１信号にする際Ｓ
ＴＭ−１の周波数の１／３のものを３つ作り（以後ＳＴ
Ｍ−１／３と略記）又前記２方向のＳＴＭ−１信号をそ
れぞれＳＴＭ−１／３の信号３つに多重分離しそれら合
計９つのＳＴＭ−１／３の信号を１つのモジュールユニ
ットに入力する際において、１つのＴＵ−３データを含
むＳＴＭ−１／３の信号（この信号の周波数はすでに装
置側のものに乗り換えられているが）を入力の際まちま
ちであったＡ１（ＳＯＨの中の１つのバイト）位相をＵ
ｎｉｔ内の絶対位相（ある決められたＡ１位相）に合わ
せてＳＴＭ−１／３の形で出力する方式において、入力
されたＳＴＭ−１／３信号のＡＵポインターにて発生し
たポジティブ又は、ネガティブのスタッフをＡＵポイン
ター値はポジティブ、ネガティブスタッフは発生させな
いで常に０とし、ＴＵ−３のポインターを付替えること
によりデータの遅れを発生させないようにし、又ＡＵポ
インターにて発生していたポジティブ、ネガティブスタ
ッフをＴＵ−３レベルのポジティブ、ネガティブスタッ
フに置き換えて、ＳＴＭ−１／３にて出力することを特
徴とするＴＵ−３ポインター付替処理方式が得られる。
【０００６】
【実施例】次に本発明について図面を参照して説明す
る。
る。
【０００７】図１は、本発明による処理方式が適用され
た処理回路のブロックダイアグラムである。図１及び図
２を参照して、この処理回路には、まずＳＴＭ−１／３
の形の８パラレル展開されたデータ８本、パリティデー
タ含めると合計９本の６．４８Mb/sのスピードを持つデ
ータが入力される。それと同時に、６．４８ＭのＣＬ
Ｋ、ＤＳＴＦ ＰＬＳ（これはＳＴＭ−１において存在
するＳＯＨバイトとＡＵポインターにて発生するポジテ
ィブ又はネガティブスタッフの部分がアクティブローと
して出力されている）、ＰＯＨ ＰＬＳ（これは、ＡＵ
ポインターにて示されるＳＴＭ−１の信号の中のＪ１の
部分がアクティブローとして出力。）等のパルスが入力
される。まずデータ９本の方は、ＲＥＴＩＭＥＢＬＯＣ
Ｋ１に入りこのブロックに入ってすぐＤフリップフロッ
プにてリタイミングされる。このリタイミングされたデ
ータは、ＭＥＭ．ＢＬＯＣＫ６に入るのであるが、その
前にＴＵ−３のポインター解析を行う。ＰＧ１ ＢＬＯ
ＣＫ３にてＴＵ−３のH1，H2（ＡＵのＨ１，Ｈ２と区別
する為に○をつけて表記）を打ち抜くパルスＨ１ＣＬ
Ｋ，Ｈ２ＣＬＫを生成し、同様にＦＨ ＧＥＮ．ＢＬＯ
ＣＫ５、ＰＴＲ ＡＮＡＬＹ．ＢＬＯＣＫ４を制御する
ためのパルス、ＣＬＫ等を生成する。ＴＵ−３Ｈ１，Ｈ
２ ＤＥＴＥＣＴ ＢＬＯＣＫ２においてＨ１ＣＬＫ，
Ｈ２ＣＬＫはデータ中のＴＵ−３のH1，H2バイトを打ち
抜き、打ち抜かれたH1，H2バイトは、ＰＴＲ ＡＮＡＬ
Ｙ．ＢＬＯＣＫ４にてポインター値の解析が行われ、ポ
ジティブスタッフ、ネガティブスタッフＬＯＰ，ＡＩＳ
等の検出を行いＰＤＳＴＦ，ＮＤＳＴＦ，ＣＨＬＯＰ
ＯＵＴ，ＣＨＡＩＳ ＯＵＴ等のパルスとして各ブロッ
クに出力する。尚ポインター値を解析した際、ＴＵ−３
のJ1位置を示すアドレス情報Ａ０〜Ａ９をＦＨ ＧＥ
Ｎ．ＢＬＯＣＫ５に送出する。ＦＨ ＧＥＮ．ＢＬＯＣ
Ｋ５は、J1のある位置においてアクティブハイのパルス
をＭＥＭ．ＢＬＯＣＫ６に送出する。このＭＥＭ．ＢＬ
ＯＣＫ６にてＡＵのポインター値は常に０とし又ＡＵポ
インターにて発生していたポジティブ又はネガティブの
スタッフをＴＵポインターＨ１，Ｈ２，Ｈ３バイトにて
吸収する作業を行いデータ９本をＴＵ−３ Ｈ１，Ｈ２
ＰＴＲ ＩＮＳ ＢＬＯＣＫ７に送出する。この際書
き込まれたJ1パルス又このＭＥＭ．ＢＬＯＣＫ６にて発
生したＴＵ−３ポジティブデマンド、ネガティブマンド
パルスＰＳＤ，ＮＳＤをＴＵ−３ Ｈ１，Ｈ２ ＰＴＲ
ＧＥＮ．ＢＬＯＣＫ８に送出する。ＴＵ−３ Ｈ１，Ｈ
２ ＰＴＲ ＧＥＮ．ＢＬＯＣＫ８においては、常にＴ
Ｕ−３のポインター値を与える為のカウンターが０〜７
６５迄（７６５迄カウントアップしたら０に戻る）回っ
ておりＭＥＭ．ＢＬＯＣＫ６よりＦＨ ＯＵＴJ1パルス
が来たらカウンターを０に戻す。又、ＰＳＤ，ＮＳＤ要
求をもらい、それを解析し（１度スタッフ操作を行った
らあと３ｆｒａｍｅｓはやってはならない）それをＰＳ
ＴＦ，ＮＳＴＦ情報としてＰＧ２ＢＬＯＣＫ９に渡す。
ＰＧ２ ＢＬＯＣＫ９において８kHz 周期のＰＯＨ Ｐ
ＬＳＲを外よりもらいそれを基準としてＳＴＭ−１／３
のＳＯＨ，ＰＯＨとＴＵ−３のＨ１，Ｈ２，Ｈ３，Ｒを
抜き、ＴＵ−３のポジティブカタッフ、ネガティブスタ
ッフを反映させたＲＣＬＫを作成しＭＥＭ．ＢＬＯＣＫ
６に渡す。ＴＵ−３ Ｈ１，Ｈ２ ＰＴＲ ＩＮＳ Ｂ
ＬＯＣＫ７においては、ＰＧ２より発生しているＨ１〜
Ｈ４ ＰＬＳのタイミングにてＴＵ−３ Ｈ１，Ｈ２
ＰＴＲ ＧＥＮ．ＢＬＯＣＫ８にて発生しているポイン
ター値を挿入しJ1の位置を示すポインター値を付替えて
本装置の外にデータを出力する。
た処理回路のブロックダイアグラムである。図１及び図
２を参照して、この処理回路には、まずＳＴＭ−１／３
の形の８パラレル展開されたデータ８本、パリティデー
タ含めると合計９本の６．４８Mb/sのスピードを持つデ
ータが入力される。それと同時に、６．４８ＭのＣＬ
Ｋ、ＤＳＴＦ ＰＬＳ（これはＳＴＭ−１において存在
するＳＯＨバイトとＡＵポインターにて発生するポジテ
ィブ又はネガティブスタッフの部分がアクティブローと
して出力されている）、ＰＯＨ ＰＬＳ（これは、ＡＵ
ポインターにて示されるＳＴＭ−１の信号の中のＪ１の
部分がアクティブローとして出力。）等のパルスが入力
される。まずデータ９本の方は、ＲＥＴＩＭＥＢＬＯＣ
Ｋ１に入りこのブロックに入ってすぐＤフリップフロッ
プにてリタイミングされる。このリタイミングされたデ
ータは、ＭＥＭ．ＢＬＯＣＫ６に入るのであるが、その
前にＴＵ−３のポインター解析を行う。ＰＧ１ ＢＬＯ
ＣＫ３にてＴＵ−３のH1，H2（ＡＵのＨ１，Ｈ２と区別
する為に○をつけて表記）を打ち抜くパルスＨ１ＣＬ
Ｋ，Ｈ２ＣＬＫを生成し、同様にＦＨ ＧＥＮ．ＢＬＯ
ＣＫ５、ＰＴＲ ＡＮＡＬＹ．ＢＬＯＣＫ４を制御する
ためのパルス、ＣＬＫ等を生成する。ＴＵ−３Ｈ１，Ｈ
２ ＤＥＴＥＣＴ ＢＬＯＣＫ２においてＨ１ＣＬＫ，
Ｈ２ＣＬＫはデータ中のＴＵ−３のH1，H2バイトを打ち
抜き、打ち抜かれたH1，H2バイトは、ＰＴＲ ＡＮＡＬ
Ｙ．ＢＬＯＣＫ４にてポインター値の解析が行われ、ポ
ジティブスタッフ、ネガティブスタッフＬＯＰ，ＡＩＳ
等の検出を行いＰＤＳＴＦ，ＮＤＳＴＦ，ＣＨＬＯＰ
ＯＵＴ，ＣＨＡＩＳ ＯＵＴ等のパルスとして各ブロッ
クに出力する。尚ポインター値を解析した際、ＴＵ−３
のJ1位置を示すアドレス情報Ａ０〜Ａ９をＦＨ ＧＥ
Ｎ．ＢＬＯＣＫ５に送出する。ＦＨ ＧＥＮ．ＢＬＯＣ
Ｋ５は、J1のある位置においてアクティブハイのパルス
をＭＥＭ．ＢＬＯＣＫ６に送出する。このＭＥＭ．ＢＬ
ＯＣＫ６にてＡＵのポインター値は常に０とし又ＡＵポ
インターにて発生していたポジティブ又はネガティブの
スタッフをＴＵポインターＨ１，Ｈ２，Ｈ３バイトにて
吸収する作業を行いデータ９本をＴＵ−３ Ｈ１，Ｈ２
ＰＴＲ ＩＮＳ ＢＬＯＣＫ７に送出する。この際書
き込まれたJ1パルス又このＭＥＭ．ＢＬＯＣＫ６にて発
生したＴＵ−３ポジティブデマンド、ネガティブマンド
パルスＰＳＤ，ＮＳＤをＴＵ−３ Ｈ１，Ｈ２ ＰＴＲ
ＧＥＮ．ＢＬＯＣＫ８に送出する。ＴＵ−３ Ｈ１，Ｈ
２ ＰＴＲ ＧＥＮ．ＢＬＯＣＫ８においては、常にＴ
Ｕ−３のポインター値を与える為のカウンターが０〜７
６５迄（７６５迄カウントアップしたら０に戻る）回っ
ておりＭＥＭ．ＢＬＯＣＫ６よりＦＨ ＯＵＴJ1パルス
が来たらカウンターを０に戻す。又、ＰＳＤ，ＮＳＤ要
求をもらい、それを解析し（１度スタッフ操作を行った
らあと３ｆｒａｍｅｓはやってはならない）それをＰＳ
ＴＦ，ＮＳＴＦ情報としてＰＧ２ＢＬＯＣＫ９に渡す。
ＰＧ２ ＢＬＯＣＫ９において８kHz 周期のＰＯＨ Ｐ
ＬＳＲを外よりもらいそれを基準としてＳＴＭ−１／３
のＳＯＨ，ＰＯＨとＴＵ−３のＨ１，Ｈ２，Ｈ３，Ｒを
抜き、ＴＵ−３のポジティブカタッフ、ネガティブスタ
ッフを反映させたＲＣＬＫを作成しＭＥＭ．ＢＬＯＣＫ
６に渡す。ＴＵ−３ Ｈ１，Ｈ２ ＰＴＲ ＩＮＳ Ｂ
ＬＯＣＫ７においては、ＰＧ２より発生しているＨ１〜
Ｈ４ ＰＬＳのタイミングにてＴＵ−３ Ｈ１，Ｈ２
ＰＴＲ ＧＥＮ．ＢＬＯＣＫ８にて発生しているポイン
ター値を挿入しJ1の位置を示すポインター値を付替えて
本装置の外にデータを出力する。
【０００８】ＡＬＭ．ＢＬＯＣＫ１０にて行っているこ
とは、他のＢＬＯＣＫ、特にＰＴＲ．ＡＮＡＬＹ ＢＬ
ＯＣＫ４にて発生しているＡＬＭ情報ＬＯＰ，ＡＩＳ等
とＭＥＭ．ＢＬＯＣＫ６においてのカウンター（書き込
み側と読み出し側両方供）を常に監視してＡＬＭ情報と
してこのＢＬＯＣＫ外に出力を行う。
とは、他のＢＬＯＣＫ、特にＰＴＲ．ＡＮＡＬＹ ＢＬ
ＯＣＫ４にて発生しているＡＬＭ情報ＬＯＰ，ＡＩＳ等
とＭＥＭ．ＢＬＯＣＫ６においてのカウンター（書き込
み側と読み出し側両方供）を常に監視してＡＬＭ情報と
してこのＢＬＯＣＫ外に出力を行う。
【０００９】
【発明の効果】以上説明したように本発明では、ＳＴＭ
−１／３信号の中にＴＵ−３信号を含んでいる際、ＡＵ
ポインターの示すＪ１がＳＴＭ−１／３中にフローティ
ングしている時、ある決められた絶対的な位相のＡ１
（ＳＯＨに含まれる）を先頭にＪ１の値を０（ＡＵポイ
ンターのＨ３のとなり）としＴＵ−３のJ1の位置を示
す。H1，H2の値を付替えることによりデータを出力する
ことができるという効果を有する。
−１／３信号の中にＴＵ−３信号を含んでいる際、ＡＵ
ポインターの示すＪ１がＳＴＭ−１／３中にフローティ
ングしている時、ある決められた絶対的な位相のＡ１
（ＳＯＨに含まれる）を先頭にＪ１の値を０（ＡＵポイ
ンターのＨ３のとなり）としＴＵ−３のJ1の位置を示
す。H1，H2の値を付替えることによりデータを出力する
ことができるという効果を有する。
【図１】本発明が適用された処理回路の一実施例を示す
図である。
図である。
【図２】図１に示す処理回路の動作を説明するための図
である。
である。
１ リタイミングブロック（ＲＥＴＩＭＥ ＢＬＯＣ
Ｋ） ２ ＴＵ−３ Ｈ１，Ｈ２検出ブロック（ＴＵ−３
Ｈ１，Ｈ２ ＤＥＴＥＣＴ ＢＬＯＣＫ） ３ ＰＧ１ブロック（ＰＧ１ ＢＬＯＣＫ） ４ ＰＴＲ解析ブロック（ＰＴＲ ＡＮＡＬＹ．ＢＬ
ＯＣＫ） ５ ＦＨ発生ブロック（ＦＨ ＧＥＮ．ＢＬＯＣＫ） ６ メインブロック（ＭＥＭ．ＢＬＯＣＫ） ７ ＴＵ−３ Ｈ１，Ｈ２ ＰＴＲ挿入ブロック（Ｔ
Ｕ−３ Ｈ１，Ｈ２ ＰＴＲ ＩＮＳ．ＢＬＯＣＫ） ８ ＴＵ−３ Ｈ１，Ｈ２ ＰＴＲ発生ブロック（Ｔ
Ｕ−３ Ｈ１，Ｈ２ ＰＴＲ ＧＥＮ．ＢＬＯＣＫ） ９ ＰＧ２ブロック（ＰＧ２ ＢＬＯＣＫ） １０ アラームブロック（ＡＬＭ ＢＬＯＣＫ）
Ｋ） ２ ＴＵ−３ Ｈ１，Ｈ２検出ブロック（ＴＵ−３
Ｈ１，Ｈ２ ＤＥＴＥＣＴ ＢＬＯＣＫ） ３ ＰＧ１ブロック（ＰＧ１ ＢＬＯＣＫ） ４ ＰＴＲ解析ブロック（ＰＴＲ ＡＮＡＬＹ．ＢＬ
ＯＣＫ） ５ ＦＨ発生ブロック（ＦＨ ＧＥＮ．ＢＬＯＣＫ） ６ メインブロック（ＭＥＭ．ＢＬＯＣＫ） ７ ＴＵ−３ Ｈ１，Ｈ２ ＰＴＲ挿入ブロック（Ｔ
Ｕ−３ Ｈ１，Ｈ２ ＰＴＲ ＩＮＳ．ＢＬＯＣＫ） ８ ＴＵ−３ Ｈ１，Ｈ２ ＰＴＲ発生ブロック（Ｔ
Ｕ−３ Ｈ１，Ｈ２ ＰＴＲ ＧＥＮ．ＢＬＯＣＫ） ９ ＰＧ２ブロック（ＰＧ２ ＢＬＯＣＫ） １０ アラームブロック（ＡＬＭ ＢＬＯＣＫ）
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平３−229537（ＪＰ，Ａ) 米国特許4967410（ＵＳ，Ａ) 米国特許5033064（ＵＳ，Ａ) 米国特許5040170（ＵＳ，Ａ) 国際公開90／6645（ＷＯ，Ａ)
Claims (1)
- 【請求項１】 ＣＥＰＴ系ＳＰＥＣ．Ｃ．Ｃ．Ｉ．Ｔ．
Ｔ． Ｇ．７０７，７０８，７０９によって規定されて
いるシンクロナスディジタルハイアラーキ（ＳＤＨ）
で、Ｇ．７０７にて示される非同期３４Ｍ信号をコンテ
ナ３にマッピングし、コンテナ３をバーチャルコンテナ
３にマッピングしバーチャルコンテナ３をＴＵポインタ
ーを有するトリビュータリーユニット３にマッピングし
さらに３つのＴＵ−３を多重化し、ＰＯＨ（Ｐａｓｓ
Ｏｖｅｒ Ｈｅａｄ）のついたバーチャルコンテナ４に
マッピングしバーチャルコンテナ４をＡＵポインターを
有するアドミニストレイティブユニット４にマッピング
し、さらにＳＯＨ（Ｓｅｃｔｉｏｎ Ｏｖｅｒ Ｈｅａ
ｄ）付のシンクロナストランスポートモジュール１にマ
ッピングして伝送し、シンクロナストランスポートモジ
ュール１の信号を受信し、上記と逆の動作を行う処理装
置において２方向シンクロナストランスポートモジュー
ル１をＳＴＭ−１として受信するオプション手段を持
ち、前記３４Ｍ信号をＳＴＭ−１信号にする際ＳＴＭ−
１の周波数の１／３のものをＳＴＭ−１／３として３つ
作り、前記２方向のＳＴＭ−１信号をそれぞれＳＴＭ−
１／３の信号３つに多重分離しそれら合計９つのＳＴＭ
−１／３の信号を１つのモジュールユニットに入力する
際、１つのＴＵ−３データを含むＳＴＭ−１／３の信号
をＡ１位相をユニット内の絶対位相に合わせてＳＴＭ−
１／３の形で出力する際に、入力されたＳＴＭ−１／３
信号のＡＵポインターにて発生したポジティブ又はネガ
ティブのスタッフをＡＵポインター値は常に０とし、Ｔ
Ｕ−３のポインターを付替え、ＡＵポインターにて発生
していたポジティブ、ネガティブスタッフをＴＵ−３レ
ベルのポジティブ、ネガティブスタッフに置き換えてＳ
ＴＭ−１／３にて出力することを特徴とするＴＵ−３ポ
インター付替処理方式。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3192329A JP2723699B2 (ja) | 1991-07-31 | 1991-07-31 | Ｔｕ−３ポインター付替処理方式 |
| US07/917,409 US5331630A (en) | 1991-07-31 | 1992-07-23 | Renewal method and apparatus for AU-4 and TU-3 pointers of synchronous digital hierarchy |
| EP92113009A EP0525770B1 (en) | 1991-07-31 | 1992-07-30 | Method and apparatus for renewing AU-4 and TU-3 pointers of synchronous digital hierarchy |
| DE69223557T DE69223557T2 (de) | 1991-07-31 | 1992-07-30 | Vorrichtung und Verfahren zur Erneuerung von AU-4 und TU-3 Zeigern der digitalen synchronen Hierarchien |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3192329A JP2723699B2 (ja) | 1991-07-31 | 1991-07-31 | Ｔｕ−３ポインター付替処理方式 |
Publications (2)
| Publication Number | Publication Date |
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