JP2539082B2 - デ―タ転送装置 - Google Patents
デ―タ転送装置Info
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- JP2539082B2 JP2539082B2 JP2187436A JP18743690A JP2539082B2 JP 2539082 B2 JP2539082 B2 JP 2539082B2 JP 2187436 A JP2187436 A JP 2187436A JP 18743690 A JP18743690 A JP 18743690A JP 2539082 B2 JP2539082 B2 JP 2539082B2
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- ram
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Description
【発明の詳細な説明】 〔概要〕 入力データのレートを変換して後続回路に転送するデ
ータ転送装置に関し、 簡単な回路構成で、入力データ中の無効データを省
き、かつ、１データ当りのレートを遅くして転送するこ
とを目的とし、 時系列データを入力されるRAMと、時系列データをRAM
に書込むための所定書込みアドレスを指定する書込みア
ドレスカウンタと、RAMから一時系列データの範囲内で
データレートを変換して有効データのみを読出すための
所定読出しアドレスを指定する読出しアドレスカウンタ
とにて構成する。
ータ転送装置に関し、 簡単な回路構成で、入力データ中の無効データを省
き、かつ、１データ当りのレートを遅くして転送するこ
とを目的とし、 時系列データを入力されるRAMと、時系列データをRAM
に書込むための所定書込みアドレスを指定する書込みア
ドレスカウンタと、RAMから一時系列データの範囲内で
データレートを変換して有効データのみを読出すための
所定読出しアドレスを指定する読出しアドレスカウンタ
とにて構成する。
〔産業上の利用分野〕 本発明は、入力データのレートを変換して後続回路に
転送するデータ転送装置に関する。
転送するデータ転送装置に関する。
例えば赤外線撮像装置では、入射赤外光を光電変換す
るIRCCD検知器の出力データを転送し、後続回路で種々
の処理、例えば画像処理等を行なう。この場合、一般
に、IRCCD検知器の出力データにはテレビジョン表示画
面に不必要なデータ（無効データ）も出力されている。
そこで、この無効データを省き、又、１データ当りのレ
ートを遅くして後続回路での画像処理を容易に行なうよ
うにする必要がある。
るIRCCD検知器の出力データを転送し、後続回路で種々
の処理、例えば画像処理等を行なう。この場合、一般
に、IRCCD検知器の出力データにはテレビジョン表示画
面に不必要なデータ（無効データ）も出力されている。
そこで、この無効データを省き、又、１データ当りのレ
ートを遅くして後続回路での画像処理を容易に行なうよ
うにする必要がある。
第４図は従来の一例のブロック図を示す。同図におい
て、IRCCD検知器１からの出力時系列データ（第３図
（Ａ））はFIFO（first−in first−out）メモリ２に供
給され、マスク信号発生回路３からのマスク信号（第３
図（Ｂ））にて無効のデータ（ｎ個）が省かれて有効デ
ータ（Ｎ個）のみ書込みクロックCLK1によって書込まれ
る。FIFOメモリ２に書込まれたＮ個の有効データは、書
込みクロックCLK1の周波数よりも低い周波数の読出しク
ロックCLK2にて読出される。このようにして、入力デー
タ中の無効データは省かれて有効データのみレートに変
換されて取出され、後続の走査変換回路４に供給され
る。走査変換回路４に供給されたデータはここでインタ
レース走査を行なうテレビジョン受信機の表示に必要な
形態になるように走査変換され、テレビジョン受信機に
供給されて画像表示される。
て、IRCCD検知器１からの出力時系列データ（第３図
（Ａ））はFIFO（first−in first−out）メモリ２に供
給され、マスク信号発生回路３からのマスク信号（第３
図（Ｂ））にて無効のデータ（ｎ個）が省かれて有効デ
ータ（Ｎ個）のみ書込みクロックCLK1によって書込まれ
る。FIFOメモリ２に書込まれたＮ個の有効データは、書
込みクロックCLK1の周波数よりも低い周波数の読出しク
ロックCLK2にて読出される。このようにして、入力デー
タ中の無効データは省かれて有効データのみレートに変
換されて取出され、後続の走査変換回路４に供給され
る。走査変換回路４に供給されたデータはここでインタ
レース走査を行なうテレビジョン受信機の表示に必要な
形態になるように走査変換され、テレビジョン受信機に
供給されて画像表示される。
第４図に示す従来例は、無効データを省くためのマス
ク信号を発生するマスク信号発生回路３を必要とし、
又、FIFOメモリ２の出力データをテレビジョン画像表示
に必要な形態になるように走査変換するための走査変換
回路４を必要とする等、回路構成が複雑になる問題点が
あった。
ク信号を発生するマスク信号発生回路３を必要とし、
又、FIFOメモリ２の出力データをテレビジョン画像表示
に必要な形態になるように走査変換するための走査変換
回路４を必要とする等、回路構成が複雑になる問題点が
あった。
本発明は、簡単な回路構成で、入力データ中の無効デ
ータを省き、かつ、１データ当りのレートを遅くして転
送できるデータ転送装置を提供することを目的とする。
ータを省き、かつ、１データ当りのレートを遅くして転
送できるデータ転送装置を提供することを目的とする。
第１図は本発明の原理図を示す。同図中、20はRAM
で、一定時間内に無効データと有効データとが存在する
時系列データを入力される。21は書込みアドレスカウン
タで、時系列データをRAM20に書込むための所定書込み
アドレスを指定する。22は読出しアドレスカウンタで、
RAM20から一時系列データの範囲内でデータレートを変
換して有効データのみを読出すための所定読出しアドレ
スを指定する。又、読出しアドレスの順序は、テレビジ
ョン受像機の画像表示に必要な形態になるように設定さ
れている。
で、一定時間内に無効データと有効データとが存在する
時系列データを入力される。21は書込みアドレスカウン
タで、時系列データをRAM20に書込むための所定書込み
アドレスを指定する。22は読出しアドレスカウンタで、
RAM20から一時系列データの範囲内でデータレートを変
換して有効データのみを読出すための所定読出しアドレ
スを指定する。又、読出しアドレスの順序は、テレビジ
ョン受像機の画像表示に必要な形態になるように設定さ
れている。
読出しアドレスによる読出しの際、無効データを省い
て有効データのみとすることにより、一定時間内のデー
タ数が減り、１データ当りのレートが遅くなり、後続回
路における信号処理が容易になる。本発明ではこのよう
な動作をRAM20を用いて実施しているため、FIFOメモリ
及びマスク信号発生回路を用いている従来例に比して回
路構成が簡単になる。又、読出しアドレスの順序をテレ
ビジョン受像機の画像表示に必要な形態になるように設
定しているので、上記従来例のような走査変換回路を必
要とせず、この点からも回路構成が簡単になる。
て有効データのみとすることにより、一定時間内のデー
タ数が減り、１データ当りのレートが遅くなり、後続回
路における信号処理が容易になる。本発明ではこのよう
な動作をRAM20を用いて実施しているため、FIFOメモリ
及びマスク信号発生回路を用いている従来例に比して回
路構成が簡単になる。又、読出しアドレスの順序をテレ
ビジョン受像機の画像表示に必要な形態になるように設
定しているので、上記従来例のような走査変換回路を必
要とせず、この点からも回路構成が簡単になる。
第２図は本発明の一実施例のブロック図を示す。同図
中、10はRAMで、書込みアドレスカウンタ11にて発生さ
れた書込みアドレスによってIRCCD検知器１からの出力
時系列データ（第３図（Ａ））を書込み、一方、読出し
アドレスカウンタ12にて発生された読出しアドレスによ
ってランダム時系列データ（第３図（Ｃ））を読出す。
アドレスカウンタ11,12は同期パルス（第３図（Ｄ））
にて同期をとられて駆動される。
中、10はRAMで、書込みアドレスカウンタ11にて発生さ
れた書込みアドレスによってIRCCD検知器１からの出力
時系列データ（第３図（Ａ））を書込み、一方、読出し
アドレスカウンタ12にて発生された読出しアドレスによ
ってランダム時系列データ（第３図（Ｃ））を読出す。
アドレスカウンタ11,12は同期パルス（第３図（Ｄ））
にて同期をとられて駆動される。
ここで、IRCCD検知器１からレート1/Tで出力された時
系列データ（第３図（Ａ）に示す如く、Ｎ個の有効デー
タ及びｎ個の無効データにて構成される）はレート の書込みクロックCLK11で駆動されるアドレスカウンタ1
1からの書込みアドレスによってRAM10に書込まれてここ
に一時保存される。保存された時系列データは、レート
T/Nの読出しクロックCLK12（書込みクロックCLK11より
も低い周波数）で駆動されるアドレスカウンタ12からの
読出しアドレス（書込まれた有効データのアドレスに対
応）によって有効データ（第３図（Ｃ））のみ読出され
る。この場合、読出しアドレスの順序を、インタレース
走査を行なうテレビジョン受像機の画像表示に必要な形
態になるように設定しておけば、ここで、走査変換が行
なわれることになる。又、その出力レートは である。
系列データ（第３図（Ａ）に示す如く、Ｎ個の有効デー
タ及びｎ個の無効データにて構成される）はレート の書込みクロックCLK11で駆動されるアドレスカウンタ1
1からの書込みアドレスによってRAM10に書込まれてここ
に一時保存される。保存された時系列データは、レート
T/Nの読出しクロックCLK12（書込みクロックCLK11より
も低い周波数）で駆動されるアドレスカウンタ12からの
読出しアドレス（書込まれた有効データのアドレスに対
応）によって有効データ（第３図（Ｃ））のみ読出され
る。この場合、読出しアドレスの順序を、インタレース
走査を行なうテレビジョン受像機の画像表示に必要な形
態になるように設定しておけば、ここで、走査変換が行
なわれることになる。又、その出力レートは である。
第３図より明らかな如く、時間Ｔ内にＮ個の有効デー
タ及びｎ個の無効データが存在している時系列データ
（同図（Ａ））中、Ｎ個の有効データを時間Ｔ内に分散
させて走査中変換されたランダム時系列データ（同図
（Ｃ））とすると、１データ当りのレートが遅くなり、
かつ、ｎ個の無効データが省かれ、後続回路での処理が
容易になり、しかも消費電力が小さくなる。本発明で
は、以上の動作をRAM10を用いて実現しているので、第
４図に示す従来例に比して回路構成が簡単になる。即
ち、本発明はRAM10を用いた構成としているため、無効
データ削除、レート変換、走査変換の３つの動作を第４
図に示す従来例に比して簡単な回路構成で実現できる。
タ及びｎ個の無効データが存在している時系列データ
（同図（Ａ））中、Ｎ個の有効データを時間Ｔ内に分散
させて走査中変換されたランダム時系列データ（同図
（Ｃ））とすると、１データ当りのレートが遅くなり、
かつ、ｎ個の無効データが省かれ、後続回路での処理が
容易になり、しかも消費電力が小さくなる。本発明で
は、以上の動作をRAM10を用いて実現しているので、第
４図に示す従来例に比して回路構成が簡単になる。即
ち、本発明はRAM10を用いた構成としているため、無効
データ削除、レート変換、走査変換の３つの動作を第４
図に示す従来例に比して簡単な回路構成で実現できる。
以上説明した如く、本発明によれば、RAMを用いて書
込み及び読出しを行なっているので、従来例に比して簡
単な回路構成で無効データ削除、レート変換、走査変換
を行なうことができ、システムを小形、安価に構成でき
る。
込み及び読出しを行なっているので、従来例に比して簡
単な回路構成で無効データ削除、レート変換、走査変換
を行なうことができ、システムを小形、安価に構成でき
る。
第１図は本発明の原理図、 第２図は本発明の一実施例のブロック図、 第３図は従来及び本発明の動作ダイミングチャート、 第４図は従来の一例のブロック図である。 図において、 １はIRCCD検出器、 10,20はRAM、 11,21は書込みアドレスカウンタ、 12,22は読出しアドレスカウンタ を示す。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 宮崎 伸司 神奈川県川崎市中原区上小田中1015番地 富士通株式会社内 (72)発明者 松本 保志 神奈川県川崎市中原区上小田中1015番地 富士通株式会社内 (56)参考文献 特開 昭64−69178（ＪＰ，Ａ) 特開 昭56−40882（ＪＰ，Ａ) 特開 昭56−146384（ＪＰ，Ａ)
Claims (2)
- 【請求項１】一定時間内に無効データと有効データとが
存在する時系列データを入力され、該有効データのみを
出力転送するデータ転送装置において、 上記時系列データを入力されるRAM（ランダム・アクセ
ス・メモリ）（20）と、 上記時系列データを該RAM（20）に書込むための所定書
込みアドレスを指定する書込みアドレスカウンタ（21）
と、 上記RAM（20）から一時系列データの範囲内でデータレ
ートを変換して上記有効データのみを読出すための所定
読出しアドレスを指定する読出しアドレスカウンタ（2
2）とよりなることを特徴とするデータ転送装置。 - 【請求項２】上記読出しアドレスの順序は、テレビジョ
ン受像機の画像表示に必要な形態になるように設定した
ことを特徴とする請求項１記載のデータ転送装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2187436A JP2539082B2 (ja) | 1990-07-16 | 1990-07-16 | デ―タ転送装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2187436A JP2539082B2 (ja) | 1990-07-16 | 1990-07-16 | デ―タ転送装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0477033A JPH0477033A (ja) | 1992-03-11 |
| JP2539082B2 true JP2539082B2 (ja) | 1996-10-02 |
Family
ID=16206030
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2187436A Expired - Fee Related JP2539082B2 (ja) | 1990-07-16 | 1990-07-16 | デ―タ転送装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2539082B2 (ja) |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5640882A (en) * | 1979-09-11 | 1981-04-17 | Nippon Electric Co | Image memory unit |
| JPS56146384A (en) * | 1980-04-15 | 1981-11-13 | Matsushita Electric Ind Co Ltd | Memory device |
| JPS6469178A (en) * | 1987-09-10 | 1989-03-15 | Sharp Kk | Composite video signal processor |
-
1990
- 1990-07-16 JP JP2187436A patent/JP2539082B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0477033A (ja) | 1992-03-11 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |