Nothing Special   »   [go: up one dir, main page]

JP2020098867A - レーザアニール方法および薄膜トランジスタの製造方法 - Google Patents

レーザアニール方法および薄膜トランジスタの製造方法 Download PDF

Info

Publication number
JP2020098867A
JP2020098867A JP2018236398A JP2018236398A JP2020098867A JP 2020098867 A JP2020098867 A JP 2020098867A JP 2018236398 A JP2018236398 A JP 2018236398A JP 2018236398 A JP2018236398 A JP 2018236398A JP 2020098867 A JP2020098867 A JP 2020098867A
Authority
JP
Japan
Prior art keywords
silicon film
laser
region
irradiation
amorphous silicon
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2018236398A
Other languages
English (en)
Inventor
水村 通伸
Michinobu Mizumura
通伸 水村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
V Technology Co Ltd
Original Assignee
V Technology Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by V Technology Co Ltd filed Critical V Technology Co Ltd
Priority to JP2018236398A priority Critical patent/JP2020098867A/ja
Priority to KR1020217008104A priority patent/KR20210103457A/ko
Priority to PCT/JP2019/047135 priority patent/WO2020129600A1/ja
Priority to CN201980076602.6A priority patent/CN113169050A/zh
Priority to TW108145262A priority patent/TW202036679A/zh
Publication of JP2020098867A publication Critical patent/JP2020098867A/ja
Pending legal-status Critical Current

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02656Special treatments
    • H01L21/02664Aftertreatments
    • H01L21/02667Crystallisation or recrystallisation of non-monocrystalline semiconductor materials, e.g. regrowth
    • H01L21/02675Crystallisation or recrystallisation of non-monocrystalline semiconductor materials, e.g. regrowth using laser beams
    • H01L21/02683Continuous wave laser beam
    • BPERFORMING OPERATIONS; TRANSPORTING
    • B23MACHINE TOOLS; METAL-WORKING NOT OTHERWISE PROVIDED FOR
    • B23KSOLDERING OR UNSOLDERING; WELDING; CLADDING OR PLATING BY SOLDERING OR WELDING; CUTTING BY APPLYING HEAT LOCALLY, e.g. FLAME CUTTING; WORKING BY LASER BEAM
    • B23K26/00Working by laser beam, e.g. welding, cutting or boring
    • B23K26/02Positioning or observing the workpiece, e.g. with respect to the point of impact; Aligning, aiming or focusing the laser beam
    • B23K26/06Shaping the laser beam, e.g. by masks or multi-focusing
    • B23K26/064Shaping the laser beam, e.g. by masks or multi-focusing by means of optical elements, e.g. lenses, mirrors or prisms
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02518Deposited layers
    • H01L21/02521Materials
    • H01L21/02524Group 14 semiconducting materials
    • H01L21/02532Silicon, silicon germanium, germanium
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02518Deposited layers
    • H01L21/02587Structure
    • H01L21/0259Microstructure
    • H01L21/02595Microstructure polycrystalline
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02518Deposited layers
    • H01L21/02587Structure
    • H01L21/0259Microstructure
    • H01L21/02598Microstructure monocrystalline
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/20Deposition of semiconductor materials on a substrate, e.g. epitaxial growth solid phase epitaxy
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/26Bombardment with radiation
    • H01L21/263Bombardment with radiation with high-energy radiation
    • H01L21/268Bombardment with radiation with high-energy radiation using electromagnetic radiation, e.g. laser radiation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/66007Multistep manufacturing processes
    • H01L29/66075Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
    • H01L29/66227Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
    • H01L29/66409Unipolar field-effect transistors
    • H01L29/66477Unipolar field-effect transistors with an insulated gate, i.e. MISFET
    • H01L29/66742Thin film unipolar transistors
    • H01L29/6675Amorphous silicon or polysilicon transistors
    • H01L29/66765Lateral single gate single channel transistors with inverted structure, i.e. the channel layer is formed after the gate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate
    • H01L29/786Thin film transistors, i.e. transistors with a channel being at least partly a thin film

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Manufacturing & Machinery (AREA)
  • Optics & Photonics (AREA)
  • High Energy & Nuclear Physics (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Chemical & Material Sciences (AREA)
  • Ceramic Engineering (AREA)
  • Electromagnetism (AREA)
  • Health & Medical Sciences (AREA)
  • Toxicology (AREA)
  • Plasma & Fusion (AREA)
  • Mechanical Engineering (AREA)
  • Recrystallisation Techniques (AREA)
  • Thin Film Transistor (AREA)

Abstract

【課題】移動度の高い多結晶シリコン膜や疑似単結晶シリコン膜などを必要な領域に選択的に形成することができるレーザアニール方法を提供すること。【解決手段】非晶質シリコン膜の改質を行う改質予定領域にレーザ光を照射して前記改質予定領域を結晶化シリコン膜に改質させるレーザアニール方法であって、前記改質予定領域の外側の前記非晶質シリコン膜に微結晶シリコンでなる種結晶領域を形成する第1のレーザ光の照射を行う第1照射工程と、前記種結晶領域を起点として、前記非晶質シリコン膜の表面に第2のレーザ光の照射を行って前記改質予定領域内の前記非晶質シリコン膜が前記結晶化シリコン膜になるように結晶成長させる第2照射工程と、を備える【選択図】図1

Description

本発明は、レーザアニール方法および薄膜トランジスタの製造方法に関する。
薄膜トランジスタ(TFT:Thin Film Transistor)は、液晶ディスプレイ(LCD:Liquid Crystal Display)、有機ELディスプレイ(OLED:Organic Electroluminescence Display)などの薄型ディスプレイ(FPD:Flat Panel Display)をアクティブ駆動するためのスイッチング素子として用いられている。薄膜トランジスタ(以下、TFTという)の半導体層の材料としては、非晶質シリコン(a−Si:amorphous Silicon)や、多結晶シリコン(p−Si:polycrystalline Silicon)などが用いられている。
非晶質シリコンは、電子の動き易さの指標である移動度(μ)が低い。このため、非晶質シリコンでは、さらに高密度・高精細化が進むFPDで要求される高移動度には対応しきれない。そこで、FPDにおけるスイッチング素子としては、非晶質シリコンよりも移動度が大幅に高い多結晶シリコンでチャネル半導体層を形成することが好ましい。多結晶シリコン膜を形成する方法としては、エキシマレーザを使ったエキシマレーザアニール(ELA:Excimer Laser Annealing)装置で、非晶質シリコン膜にレーザ光を照射し、非晶質シリコンを再結晶化させて多結晶シリコンを形成する方法がある。
従来のレーザアニール方法として、基板全面に形成された非晶質シリコン膜に対して、TFT形成領域(チャネル半導体層領域)のみに、レーザパルス光を用いたエキシマレーザアニールを施して多結晶シリコン膜を部分的に形成する技術が知られている(例えば、特許文献1参照)。この方法では、TFT形成領域に対して、レーザパルス光のビームスポットがTFT形成領域全体に照射可能となるようにマイクロレンズの配置が設定されている。
特開2010−283073号公報
しかしながら、エキシマレーザのパルス光照射によって形成される多結晶シリコンは、結晶粒径が数10〜数100nm程度である。この程度の結晶粒径では、さらに高い移動度を満足することができない。現在でも、FPDにおける画素トランジスタをオン・オフするドライバ回路のTFTはチャネル半導体層領域に高い移動度が要求されている。さらに、FPDにおいては、その大型化、高解像度化、動画特性の高速化に伴って、画素のスイッチング素子としてのTFTにおいても高移動度化が要望される。
本発明は、上記の課題に鑑みてなされたものであって、移動度の高い多結晶シリコン膜や疑似単結晶シリコン膜などを必要な領域に選択的に形成することができるレーザアニール方法を提供することを目的とする。また、本発明は、高い移動度を持つ高性能な薄膜トランジスタの製造方法を提供することを目的とする。
上述した課題を解決し、目的を達成するために、本発明の態様は、非晶質シリコン膜の改質を行う改質予定領域にレーザ光を照射して前記改質予定領域を結晶化シリコン膜に改質させるレーザアニール方法であって、前記改質予定領域の外側の前記非晶質シリコン膜に微結晶シリコンでなる種結晶領域を形成する第1のレーザ光の照射を行う第1照射工程と、前記種結晶領域を起点として、前記非晶質シリコン膜の表面に第2のレーザ光の照射を行って前記改質予定領域内の前記非晶質シリコン膜が前記結晶化シリコン膜になるように結晶成長させる第2照射工程と、を備えることを特徴とする。
上記態様としては、前記非晶質シリコン膜は、表面にゲート配線が形成された基板の上に、ゲート絶縁膜を介して成膜されており、前記改質予定領域は、前記ゲート配線に重なる領域に形成された前記非晶質シリコン膜に設定された薄膜トランジスタのチャネル半導体層となる領域であり、前記種結晶領域は、前記ゲート配線の長手方向に直交する方向の外側に配置されることが好ましい。
上記態様としては、前記第1照射工程の前記第1のレーザ光の照射における照射エネルギー量は、前記非晶質シリコン膜が種結晶として微結晶化する条件に設定し、前記第2照射工程の前記第2のレーザ光の照射は、連続発振レーザ光を用いて連続照射することが好ましい。
上記態様としては、前記第1のレーザ光は、前記第2照射工程で用いる前記連続発振レーザ光をON−OFF変調して照射することが好ましい。
上記態様としては、前記第1照射工程と前記第2照射工程は、レーザ光を選択的に反射させてレーザビームを前記改質予定領域内へ選択的に照射させる空間光変調器と、を用いて行うことが好ましい。
上記態様としては、前記空間光変調器は、多数のマイクロミラーがマトリクス状に配置され、該マイクロミラーのそれぞれが個別に、前記非晶質シリコン膜の表面へのレーザビームの照射状態と非照射状態とに切り換え可能に選択駆動されることが好ましい。
上記態様としては、前記第1照射工程は、複数のマイクロレンズがマトリクス状に配置されたマイクロレンズアレイを用いて前記改質予定領域の外側へ複数のレーザパルスビームを照射し、前記第2照射工程は、前記マイクロレンズアレイを用いて前記改質予定領域へ複数の連続発振レーザ光のレーザビームを照射することが好ましい。
上記態様としては、前記結晶化シリコン膜は、多結晶シリコン膜、疑似単結晶シリコン膜から選ばれることが好ましい。
本発明の他の態様としては、薄膜トランジスタの製造方法であって、基板上に、順次、ゲート配線と、ゲート絶縁膜と、非晶質シリコン膜と、が形成されてなるゲート基板における、前記非晶質シリコン膜に設定したチャネル半導体層となる改質予定領域の外側で、かつ前記ゲート配線に対して当該ゲート配線の長手方向に直交する方向の外側に、第1のレーザ光の照射を行って微結晶シリコンでなる種結晶領域を形成する第1照射工程と、前記種結晶領域を起点として、前記非晶質シリコン膜の表面に第2のレーザ光の照射を行って前記改質予定領域内の前記非晶質シリコン膜が結晶化シリコン膜になるように結晶成長させる第2照射工程と、前記第2照射工程が施された前記非晶質シリコン膜の上に全面に金属膜を成膜する工程と、前記金属膜上にソース配線およびドレイン配線となる領域のエッチング用マスクをパターニングする工程と、前記エッチング用マスクを用いてエッチングを行って、前記エッチング用マスクで覆われずに露出する前記金属膜と、前記金属膜のエッチング後に露出する前記種結晶領域を含む非晶質シリコン膜と、を除去することを特徴とする。
上記態様としては、前記第1照射工程の前記第1のレーザ光の照射における照射エネルギー量は、前記非晶質シリコン膜が種結晶として微結晶化する条件に設定し、前記第2照射工程の前記第2のレーザ光の照射は、連続発振レーザ光を用いて連続照射することが好ましい。
上記態様としては、前記第1のレーザ光は、前記第2照射工程で用いる前記連続発振レーザ光をON−OFF変調して照射することが好ましい。
上記態様としては、前記第1照射工程と前記第2照射工程は、レーザ光を選択的に反射させてレーザビームを前記改質予定領域内へ選択的に照射させる空間光変調器と、を用いて行うことが好ましい。
上記態様としては、前記空間光変調器は、多数のマイクロミラーがマトリクス状に配置され、該マイクロミラーのそれぞれが個別に、前記非晶質シリコン膜の表面へのレーザビームの照射状態と非照射状態とに切り換え可能に選択駆動されることが好ましい。
上記態様としては、前記第1照射工程は、複数のマイクロレンズがマトリクス状に配置されたマイクロレンズアレイを用いて前記改質予定領域の外側へ複数のレーザ変調ビームを照射し、前記第2照射工程は、前記マイクロレンズアレイを用いて前記改質予定領域へ複数の連続発振レーザ光のレーザビームを照射することが好ましい。
上記態様としては、前記結晶化シリコン膜は、多結晶シリコン膜、疑似単結晶シリコン膜から選ばれることが好ましい。
本発明に係るレーザアニール方法によれば、移動度の高い多結晶シリコン膜や疑似単結晶シリコン膜を必要な領域に選択的に形成でき、高性能なTFTを実現できる。本発明に係る薄膜トランジスタの製造方法によれば、少ないプロセス数で高性能なTFTの製造を実現できる。
図1は、本発明の第1の実施の形態に係るレーザアニール方法を示すフローチャートである。 図2は、本発明の第1の実施の形態に係るレーザアニール方法に用いるレーザアニール装置の概略構成図である。 図3は、本発明の第1の実施の形態に係るレーザアニール方法に用いるレーザアニール装置におけるマイクロミラーの配置例を模式的に示す説明図である。 図4は、非晶質シリコン膜に対してレーザ光を照射したときに形成される結晶構造が成立する領域を、照射するレーザ光のパワー密度条件と、非晶質シリコン膜(被処理基板)側のスキャン速度条件と、の観点から示すマップである。 図5は、本発明の実施の形態に係るレーザアニール方法において、種結晶領域を形成する第1照射工程を示す説明図である。 図6は、本発明の実施の形態に係るレーザアニール方法において、第1照射工程で形成した種結晶領域を起点にして第2照射を行う第2照射工程を開始した状態を示す説明図である。 図7は、本発明の実施の形態に係るレーザアニール方法において、第2照射工程により改質予定領域を全て疑似単結晶シリコン膜に改質した状態を示す説明図である。 図8−1は、本発明の実施の形態に係るレーザアニール方法において用いるゲート配線が形成されたガラス基板(ゲート基板)を示す工程平面図である。 図8−2は、本発明の実施の形態に係るレーザアニール方法において、非晶質シリコン膜が全面に形成されたガラス基板(ゲート基板)を示す工程平面図である。 図8−3は、本発明の実施の形態に係るレーザアニール方法において、非晶質シリコン膜が全面に形成されたガラス基板(ゲート基板)における改質予定領域を示す工程平面図である。 図8−4は、本発明の実施の形態に係るレーザアニール方法において、第1照射工程を施した状態を示す工程平面図である。 図8−5は、本発明の実施の形態に係るレーザアニール方法において、第2照射工程を施した状態を示す工程平面図である。 図8−6は、本発明の実施の形態に係るレーザアニール方法において、第2照射工程の後に、基板全体に金属膜を蒸着した状態を示す工程平面図である。 図8−7は、本発明の実施の形態に係るレーザアニール方法において、金属膜をパターニングしてソース・ドレインを形成した状態を示す工程平面図である。 図9は、図8−7におけるA−B線で切断した断面を示すA−B断面図である。 図10は、本発明の実施の形態に係るレーザアニール方法に用いるMLAレーザアニール装置における結像光学系を示す説明図である。 図11は、本発明の実施の形態に係るレーザアニール方法に用いるMLAレーザアニール装置における結像光学系を示す説明図である。
以下に、本発明の実施の形態に係るレーザアニール方法および薄膜トランジスタの製造方法の詳細を図面に基づいて説明する。但し、図面は模式的なものであり、各部材の数、各部材の寸法、寸法の比率、形状などは現実のものと異なることに留意すべきである。また、図面相互間においても互いの寸法の関係や比率や形状が異なる部分が含まれている。
本発明のレーザアニール方法では、非晶質シリコン膜の改質を行う改質予定領域にレーザ光を照射してこの改質予定領域を結晶化シリコン膜に改質させる場合に用いる。このレーザアニール方法は、改質予定領域の外側の前記非晶質シリコン膜に微結晶シリコンでなる種結晶領域を形成する第1のレーザ光の照射を行う第1照射工程と、種結晶領域を起点として、非晶質シリコン膜の表面に第2のレーザ光の照射を行って改質予定領域内の非晶質シリコン膜が結晶化シリコン膜になるように結晶成長させる第2照射工程と、を備える。
[実施の形態]
レーザアニール方法の説明に先駆けて、このレーザアニール方法でアニール処理を行う被処理基板の一例と、レーザアニール方法に用いるレーザアニール装置10と、について説明する。
(被処理基板)
図2に示すように、被処理基板1は、ガラス基板2と、このガラス基板2の表面に配置された複数のゲート配線3と、ガラス基板2およびゲート配線3の上に形成されたゲート絶縁膜4と、このゲート絶縁膜4の上に全面に堆積された非晶質シリコン膜5と、を備える。なお、この被処理基板1は、ゲート基板ともいう。被処理基板1は、最終的に薄膜トランジスタ(TFT)などが作り込まれたTFT基板となる。
本実施の形態では、被処理基板1は、レーザアニール処理において、ゲート配線3の長手方向に直交する方向に沿って搬送される。すなわち、このゲート配線3の長手方向は、図5から図7に示すように、搬送方向Tと直交する方向である。なお、図2に示したゲート配線3は、長手方向に沿って切断した状態を示す。図5から図7には、1本のゲート配線3を示すが、ガラス基板2には多数のゲート配線3が互いに平行をなして配置されている。また、被処理基板1には、所定の位置に図示しない複数のアライメントマークが設けられている。
図5から図7に示すように、ゲート配線3の上方に成膜された非晶質シリコン膜5には、矩形状の改質予定領域6が設定されている。この改質予定領域6は、最終的にはTFTのチャネル半導体層領域となる。この改質予定領域6は、ゲート配線3の長手方向に沿って形成されるTFTの数に応じて複数が設定されている。本実施の形態では、この改質予定領域6の幅寸法W(図5参照)は、ゲート配線3の幅と略同じ寸法に設定されている。
(レーザアニール装置の概略構成)
以下、図2から図4を用いて、本実施の形態に係るレーザアニール装置10の概略構成を説明する。図2に示すように、レーザアニール装置10は、基台11と、レーザ光源部12と、レーザビーム照射部13と、制御部14と、を備える。
本実施の形態では、アニール処理時にはレーザビーム照射部13は移動せず、被処理基板1を移動させるようになっている。基台11は、図示しない基板搬送手段を備えている。このレーザアニール装置10においては、被処理基板1を基台11の上に配置した状態で、図示しない基板搬送手段によって、搬送方向(スキャン方向)Tに向けて搬送する。図5から図7に示すように、この搬送方向Tは、ゲート配線3の長手方向と直交する方向である。
図2に示すように、レーザ光源部12は、連続発振レーザ光(CWレーザ光)を発振する光源としてのCWレーザ光源15と、このCWレーザ光をON−OFF変調して第1のレーザ光としてのCWレーザ変調光とするON−OFF信号発生器16と、これら連続発振レーザ光やCWレーザ変調光をレーザビーム照射部13側へ向けて出射する光出射部17と、を備える。このレーザ光源部12は、第2のレーザ光としてのCWレーザ光と、CWレーザ光源15から出射されたCWレーザ光をON−OFF変調した第1のレーザ光としてのCWレーザ変調光と、の2種類のレーザ光の出射ができるように設定されている。レーザ光源部12では、光出射部17から、レーザビーム照射部13における後述するデジタルマイクロミラーデバイス18側へ向けてレーザビームLBを出射する。
CWレーザ光源15としては、半導体レーザ、固体レーザ、液体レーザ、気体レーザなどの各種のレーザを用いることが可能である。
レーザビーム照射部13は、図示しない支持フレームなどにより、基台11の上方に配置されている。レーザビーム照射部13は、空間光変調器としてのデジタルマイクロミラーデバイス(DMD:Digital Micro-mirror Device, Texas Instruments 社の登録商標)18と、ダンパ(アブソーバ)19と、マイクロレンズアレイ20と、投影レンズ21と、を備える。
図2および図3に示すように、デジタルマイクロミラーデバイス(以下、DMDという)18は、駆動基板(CMOS基板)22と、多数のマイクロミラー(薄膜ミラー)23(23A〜23F:A〜Fの列にそれぞれ6つの符号を付す)と、を備えている。本実施の形態では、説明の便宜上、マイクロミラー23の数を36として説明するが、実際の数はハイビジョンの画素数以上である。マイクロミラー23は、一辺の長さが十数μm程度の正方形状に形成されている。駆動基板22には、多数のピクセル領域がマトリクス状に配置され、個々のピクセル領域にはCMOS SRAMセルが構成されている。
マイクロミラー23は、駆動基板22の上にそれぞれのCMOS SRAMセルに対応して配置されている。マイクロミラー23は、MEMS(Micro Electro Mechanical Systems)技術により設けられている。それぞれのマイクロミラー23は、2つの位置に移動可能に設けられている。具体的には、基板面に対して例えば、+10度の角度と−10度の角度をなす2つの位置に回転移動するようになっている。マイクロミラー23は、CMOS SRAMセル側からの出力データに対応して、上記2つの位置に変位するように駆動される。
図3に示すように、アレイを構成する多数のマイクロミラー23には、レーザ光源部12側からレーザビームLBが一括して入射するようになっている。そして、それぞれのマイクロミラー23(23A〜23F)は、上記の2つの位置に選択的に移動することにより、レーザビームLBの一部のレーザ光を2つの方向に反射するように設定されている。これら2つの方向のうちの一方の方向は、レーザビームLBの一部のレーザ光をダンパ19に向かわせる方向であり、2つの方向のうちの他方の方向は、レーザビームLBの一部のレーザ光を被処理基板1の表面に向かわせる方向である。
図2においては、DMD18の所定の列におけるそれぞれのマイクロミラー(23A1,23A2,23A3,23A4,23A5,23A6)から反射されたレーザ光を6本のレーザビームLBd1,LBd2,LBd3,LBd4,LBd5,LBd6で模式的に示している。本実施の形態では、マイクロミラー23A1,23A2,23A3,23A4,23A5,23A6を備える列を用いるが、他の列のマイクロミラー23を用いてもよい。
ダンパ19は、マイクロミラー23がオフ状態(例えば、駆動基板22に対する角度が−10度の状態、非照射状態)のときに、オフ状態のマイクロミラー23で反射されたレーザ光を受け入れる位置に配置されている。
マイクロレンズアレイ20は、オン状態(例えば、駆動基板22に対する角度が+10度の状態、照射状態)のマイクロミラー23で反射されたレーザビームLBd(LBd1〜LBd6など)は投影レンズ21に向けて集光し、投影レンズ21は、導入されたレーザビームLBd(LBd1〜LBd6など)を被処理基板1の表面に結像させるように設定されている。
制御部14は、基台11に設けられた図示しない基板搬送手段と、レーザ光源部12と、DMD18と、の制御を行う。具体的には、制御部14は、図示しない基板搬送手段を駆動制御して被処理基板1を搬送方向Tへ向けて所定の速度で移動させるように設定されている。また、制御部14は、図示しない位置検出手段から被処理基板1における改質予定領域6(図5から図7を参照)の位置情報が入力されるように設定されている。なお、位置検出手段は、被処理基板1に設けられた図示しないアライメントマークを検出し、その検出信号を制御部14に出力する。
また、制御部14は、レーザ光源部12と、レーザビーム照射部13と、を駆動制御して、被処理基板1に対して第1照射と第2照射とを行わせるように設定されている。
第1照射に際して、制御部14は、レーザ光源部12から第1のレーザ光としてのレーザ光を出射させる。本実施の形態においては、このレーザ光の出力は比較的低エネルギーに設定する。
第2照射に際しては、制御部14は、レーザ光源部12から第2のレーザ光としてのCWレーザ光を連続して出射させる。本実施の形態においては、CWレーザ光の出力は比較的高く設定している。第1照射および第2照射を行わないときは、レーザ光源部12をオフにするか、またはDMD18における全てのマイクロミラー23(23A〜23F)を、レーザビームLBをダンパ19に向けて反射させるオフ状態にするように設定されている。
制御部14は、改質予定領域6の上記位置情報データに基づいて、改質予定領域6が基台11に対して所定の位置に到達したときに、DMD18へ駆動信号を出力するように設定されている。上記駆動信号が入力されたDMD18は、所定の列のマイクロミラー23(例えば、23A1,23A2,23A3,23A4,23A5,23A6)をオン状態にするように制御される。
上記の複数のマイクロミラー23がオン状態になると、レーザ光源部12から出射されたレーザ光でなるレーザビームLBは、これらマイクロミラー23(23A1,23A2,23A3,23A4,23A5,23A6)で反射されて被処理基板1の表面に入射する。
図5に示すように、それぞれのマイクロミラー23から反射されたレーザビームLBd1,LBd2,LBd3,LBd4,LBd5,LBd6は、ゲート配線3の側方の、改質予定領域6の外側(周縁部の外側)にビームスポットを投影する(第1照射)。非晶質シリコン膜5に対して第1照射を行うことによって、図5に示すように、改質予定領域6の所定位置に種結晶領域5A1,5A2,5A3,5A4,5A5,5A6などが形成できる。なお、本実施の形態においては、これら種結晶領域5A1,5A2,5A3,5A4,5A5,5A6などを形成するために、微結晶化する条件のエネルギー量および被処理基板1のスキャン速度に条件設定されている。
また、制御部14は、上記位置情報に基づいて、レーザ光源部12およびレーザビーム照射部13を駆動制御して、改質予定領域6に対して第2照射を行うように設定されている。具体的には、上記の種結晶領域5A1,5A2,5A3,5A4,5A5,5A6などを起点として、第2のレーザ光としてのCWレーザ光のビームスポットを改質予定領域6側に位置する非晶質シリコン膜5の表面に投影させる。その後、ビームスポットの軌跡が改質予定領域6内を網羅して移動するように設定されている。なお、第2照射によってCWレーザ光のビームスポットが改質予定領域6を網羅するように移動させる方法については、後述するレーザアニール方法において説明する。
この第2照射によって、改質予定領域6内の非晶質シリコン膜5が結晶化シリコン膜としての疑似単結晶(以下、ラテラル結晶ともいう)シリコン膜5Bになるように条件設定されている。なお、この第2照射において、制御部14は、CWレーザ光源15から発振されたCWレーザ光をON−OFF信号発生器16をOFF状態として光出射部17から直接連続照射するように制御する。
図4は、非晶質シリコン膜5に対してレーザ光を照射したときに形成される結晶構造が成立する条件の領域を、照射するレーザ光のパワー密度条件と、非晶質シリコン膜(被処理基板)側のスキャン速度条件と、の観点から示すマップである。本実施の形態に係るレーザアニール装置10は、図4に示すような内容のマップが格納された図示しない記憶手段を備える。制御部14は、随時このマップを参照して、第1照射と第2照射を行う。
具体的には、制御部14は、第1照射に際して、被処理基板1のスキャン速度およびレーザ光源部12から出射するレーザ光PL(図5参照)のパワー密度が、図4に示すマップにおける微結晶領域の成立する条件になるように制御する。制御部14は、第2照射に際して、被処理基板1のスキャン速度およびレーザ光源部12から出射するCWレーザ光CWL(図6参照)のパワー密度が、図4に示すマップにおけるラテラル結晶(疑似単結晶)領域の成立する条件になるように制御する。
以上、本実施の形態に係るレーザアニール方法で用いる被処理基板1およびレーザアニール装置10について説明したが、以下に、これらを用いたレーザアニール方法および薄膜トランジスタの製造方法について説明する。
(レーザアニール方法および薄膜トランジスタの製造方法)
以下、本実施の形態に係るレーザアニール方法および薄膜トランジスタの製造方法を、図1のフローチャートを用いて説明する。なお、本実施の形態に係るレーザアニール方法は、薄膜トランジスタの製造方法に含めて説明する。本実施の形態に係るレーザアニール方法は、以下に説明する第1照射工程(ステップ4)と第2照射工程(ステップ5)とで構成されている(図1参照)。
まず、図8−1の工程平面図に示すように、ガラス基板2の上に複数のゲート配線3が平行をなすように形成する。その後、図2および図8−2に示すように、ゲート配線3が形成されたガラス基板2の全面に非晶質シリコン膜5を形成して被処理基板(ゲート基板)1を作製する(ステップ1)。
次に、被処理基板1を洗浄する(ステップ2)。洗浄した被処理基板1の非晶質シリコン膜5は、水素を含んでいるため、例えば、約450℃で数時間程度の脱水素処理を行う(ステップ3)。
図2に示すように、被処理基板1をレーザアニール装置10の基台11の上にセットして、搬送方向Tに沿って所定のスキャン速度で走行させる。
次に、第1照射工程を行う(ステップ4)。このステップ4において、制御部14は、図8−3に示すように、改質予定領域6の位置情報に基づいて改質予定領域6が所定の位置に到達したときに、DMD18へ駆動信号を出力する。駆動信号に基づいて、上記駆動信号が入力されたDMD18は、予め設定した列のマイクロミラー23A1,23A2,23A3,23A4,23A5,23A6をオン状態にする。
図5は、列をなす複数のマイクロミラー23A1,23A2,23A3,23A4,23A5,23A6のオン状態(オン状態のマイクロミラー23には斜線を付す)を示す。この状態で、レーザ光源部12から出射されたパルスレーザ光でなるレーザビームLBは、これらマイクロミラー23A1,23A2,23A3,23A4,23A5,23A6で反射されたレーザビームLBd1,LBd2,LBd3,LBd4,LBd5,LBd6となる。これらレーザビームLBd1,LBd2,LBd3,LBd4,LBd5,LBd6は、図5に示すレーザ光PLであり改質予定領域6の一辺部(搬送方向Tの下流側の縁部)近傍に一列をなすように入射する。
この結果、図5および図8−4に示すように、改質予定領域6の外側の領域であって、この改質予定領域6における搬送方向Tの下流側端縁部に沿って、種結晶領域5A1,5A2,5A3,5A4,5A5,5A6が形成される。これら種結晶領域5A1,5A2,5A3,5A4,5A5,5A6は、非晶質シリコン膜5が微結晶シリコンに変化したものである。なお、これら種結晶領域5A1,5A2,5A3,5A4,5A5,5A6の表面は、凹凸構造を有する。
次に、第2照射工程を行う(ステップ5)。図6、図7、および図8−5は、第2照射工程を示している。上記第1照射工程の終了直後、制御部14は、改質予定領域6の位置情報に基づいて、レーザ光源部12およびレーザビーム照射部13を駆動制御して、改質予定領域6に対して第2照射を開始する。
図6に示すように、この第2照射工程は、上記の種結晶領域5A1,5A2,5A3,5A4,5A5,5A6を起点として、第2のレーザ光としてのCWレーザ光CWLのビームスポットを非晶質シリコン膜5の表面に投影させてアニールを行う。図6および図7は、第2照射にも用いる複数のマイクロミラー23A1,23A2,23A3,23A4,23A5,23A6のオン状態(オン状態のマイクロミラー23には格子状の斜線を付す)を示す。このとき、種結晶領域5A1,5A2,5A3,5A4,5A5,5A6を構成する微結晶シリコンが種結晶として機能して、非晶質シリコン膜5が疑似単結晶(ラテラル結晶)化することを促進させて良質な疑似単結晶シリコン膜5Bが形成できる。
図7に示すように、それぞれのCWレーザ光CWLのビームスポットの軌跡が改質予定領域6の搬送方向Tの上流側の縁部(一辺)まで到達するまで第2照射を行う。この結果、図7および図8−5に示すように、改質予定領域6の全体に疑似単結晶シリコン膜5Bを成長させることができる。
上記ステップ4およびステップ5を経て形成された疑似単結晶シリコン膜5Bは、種結晶領域5A1,5A2,5A3,5A4,5A5,5A6を起点として、改質予定領域6の全体に疑似単結晶シリコン膜5Bでなるラテラル結晶膜が均一に形成される。疑似単結晶シリコン膜5Bは、移動度(電子移動度)が大きく高移動度のTFTの作製に適する。
なお、図5から図7に示すように、このレーザアニール方法では、種結晶領域5A1,5A2,5A3,5A4,5A5,5A6同士が間隔を置くように設定することにより、疑似単結晶シリコン膜5Bがゲート配線3の幅方向に成長し易くなる。
次に、図8−6に示すように、ステップ5を経て疑似単結晶シリコン膜5Bが形成された後、基板全面に金属膜7を、例えば、蒸着法にて形成する(ステップ6)。なお、この金属膜7の材料は、例えば、アルミニウム(Al)合金などである。
その後、金属膜7の上に、フォトリソグラフィー技術を用いて図示しないエッチング用マスクを形成する(ステップ7)。このエッチング用マスクは、金属膜7をソース・ドレイン電極に形成するためのレジストマスクである。
次に、図示しないエッチング用マスクを用いて、例えば、エッチャントとして混酸系のエッチング液を用いたウェットエッチングを行って、エッチング用マスクから露出する金属膜と、種結晶領域5A1,5A2,5A3,5A4,5A5,5A6を含む非晶質シリコン膜5の露出する領域を除去する(ステップ8)。
ステップ8を行った結果、図8−7に示すように、金属膜7は、ソース電極7Sとドレイン電極7Dとソースライン7SLなどに加工される。また、金属膜7のエッチングに続いて露出する、種結晶領域5A1,5A2,5A3,5A4,5A5,5A6を含む非晶質シリコン膜5も、エッチングされる。その結果、図8−7および図9に示すように、その領域の非晶質シリコン膜5が除去されて下地のゲート絶縁膜4が露出する。このようにして、TFT8の製造が完了する。
本実施の形態に係る薄膜トランジスタの製造方法では、種結晶領域5A1,5A2,5A3,5A4,5A5,5A6を改質予定領域6の外側に形成するため、チャネル半導体層領域となる改質予定領域6内に疑似単結晶シリコン膜5Bのみを形成でき、TFTの性能を高めることができる。
本実施の形態に係る薄膜トランジスタの製造方法では、疑似単結晶シリコン膜(多結晶シリコン膜を種結晶領域から成長させることも可能)を必要な領域に選択的に形成でき、凹凸構造を有する種結晶領域5A1,5A2,5A3,5A4,5A5,5A6は、後の金属膜7のエッチング工程で削除できる。このため、種結晶領域5A1,5A2,5A3,5A4,5A5,5A6を除去するための工程を特別に行う必要がない。
特に、本実施の形態に係る薄膜トランジスタの製造方法では、レーザ光PLとして、CWレーザ光CWLをON−OFF信号発生器16でON−OFF変調して用いるため、1つのレーザ光源部12において、レーザ光PLとCWレーザ光CWLとを実現でき、第1照射工程と第2照射工程とを1つの装置で円滑に行えるという効果がある。
本実施の形態に係る薄膜トランジスタの製造方法によれば、改質予定領域6がTFTのチャネル半導体層領域であるため、第2照射を経て形成された疑似単結晶シリコン膜5Bをそのままチャネル半導体層領域として用いることができる。したがって、本実施の形態によれば、チャネル半導体層領域を形成するための、フォトリソグラフィー工程やウェットエッチング工程などのパターニング工程、パターニング工程後のリンス・洗浄工程などが不要となり、TFT基板の製造プロセスを大幅に削減できる。
本実施の形態に係る薄膜トランジスタの製造方法では、空間光変調器としてDMD18を用いることにより、マイクロミラー23のオン・オフ動作だけで、レーザビームを改質予定領域6の幅方向に対して漸次連続するようにアニールを進行させることができる。このため、被処理基板1を幅方向に移動させたり、レーザビーム照射部13を被処理基板1の幅方向に移動させたりする必要がない。
(レーザアニール方法に用いる他のレーザアニール装置)
図10および図11は、本発明の実施の形態に係るレーザアニール方法に用いることができるMLAレーザアニール装置の結像光学系を示す。なお、このMLAレーザアニール装置の他の構成は、上記したレーザアニール装置10と同様であるため、その説明を省略する。
このMLAレーザアニール装置においては、図2に示すレーザ光源部12側から出射されたパルスレーザ光でなるレーザビームLBがミラー25で反射され、マスク26を介してマイクロレンズアレイ20の対応レンズの真下に改質予定領域6が到達したときに、レーザビームLB2を改質予定領域6に照射するように設定されている。このMLAレーザアニール装置では、本実施の形態におけるレーザアニール方法のステップ4で行う改質予定領域6の外側に種結晶領域を形成する第1照射工程に用いる。
このようなMLAレーザアニール装置では、マイクロレンズアレイ20を移動することにより、レーザ光の照射位置精度を向上することができる。
[その他の実施の形態]
以上、実施の形態について説明したが、この実施の形態の開示の一部をなす論述および図面はこの発明を限定するものであると理解すべきではない。この開示から当業者には様々な代替実施の形態、実施例および運用技術が明らかとなろう。
例えば、上記の実施の形態では、DMD18を用いたが、空間光変調器としては、光シャッタ機能を有する液晶セル、グレーティングライトバルブ(GLV:Grating Light Valve、シリコン・ライト・マシンズ社の登録商標)、薄膜マイクロミラーアレイ(TMA:Thin-film Micro mirror Array)などを用いることも可能である。
上記の実施の形態では、空間光変調器としてDMD18を用いたが、空間光変調器を用いずにレーザビームを移動させる他のビーム移動手段を用いる構成としてもよい。
上記の第1の実施の形態では、ON−OFF信号発生器16を用いて、レーザ光PLを発生させたが、マイクロミラー23を高速で振動させてパルス幅変調することにより、第1照射工程に適した低エネルギー密度にしてもよい。
上記の実施の形態では、結晶化シリコン膜として、疑似単結晶シリコン膜5Bを形成したが、種結晶領域から多結晶シリコン膜を成長させる構成としても勿論よい。この場合も、種結晶領域を起点として、良質な多結晶シリコン膜を形成することが可能となる。なお、多結晶シリコン膜を形成させるための第2のレーザ光としては、ELA装置から発振させるエキシマレーザ光を用いることも可能である。
上記の実施の形態では、TFTの構造として、ガラス基板2の上にゲート配線3がガラス基板2上に形成された所謂ボトムゲートタイプの構造であるが、所謂トップゲートタイプのTFTの製造にも適用することが可能である。
CWL CWレーザ光
LB レーザビーム
PL レーザ光
T 搬送方向
W 幅寸法
1 被処理基板
2 ガラス基板
3 ゲート配線
4 ゲート絶縁膜
5 非晶質シリコン膜
5A1,5A2,5A3,5A4,5A5,5A6 種結晶領域
5B 疑似単結晶シリコン(結晶化シリコン)膜
6 改質予定領域
7 金属膜
8 薄膜トランジスタ(TFT)
10 レーザアニール装置
11 基台
12 レーザ光源部
13 レーザビーム照射部
14 制御部
15 CWレーザ光源
16 ON−OFF信号発生器
17 光出射部
18 デジタルマイクロミラーデバイス(DMD、空間光変調器)
19 ダンパ
20 マイクロレンズアレイ
21 投影レンズ
22 駆動基板
23A1〜6 マイクロミラー
25ミラー
26 マスク

Claims (15)

  1. 非晶質シリコン膜の改質を行う改質予定領域にレーザ光を照射して前記改質予定領域を結晶化シリコン膜に改質させるレーザアニール方法であって、
    前記改質予定領域の外側の前記非晶質シリコン膜に微結晶シリコンでなる種結晶領域を形成する第1のレーザ光の照射を行う第1照射工程と、
    前記種結晶領域を起点として、前記非晶質シリコン膜の表面に第2のレーザ光の照射を行って前記改質予定領域内の前記非晶質シリコン膜が前記結晶化シリコン膜になるように結晶成長させる第2照射工程と、
    を備えるレーザアニール方法。
  2. 前記非晶質シリコン膜は、表面にゲート配線が形成された基板の上に、ゲート絶縁膜を介して成膜されており、
    前記改質予定領域は、前記ゲート配線に重なる領域に形成された前記非晶質シリコン膜に設定された薄膜トランジスタのチャネル半導体層となる領域であり、
    前記種結晶領域は、前記ゲート配線の長手方向に直交する方向の外側に配置される
    請求項1に記載のレーザアニール方法。
  3. 前記第1照射工程の前記第1のレーザ光の照射における照射エネルギー量は、前記非晶質シリコン膜が種結晶として微結晶化する条件に設定し、
    前記第2照射工程の前記第2のレーザ光の照射は、連続発振レーザ光を用いて連続照射する
    請求項1または請求項2に記載のレーザアニール方法。
  4. 前記第1のレーザ光は、前記第2照射工程で用いる前記連続発振レーザ光をON−OFF変調して照射する
    請求項3に記載のレーザアニール方法。
  5. 前記第1照射工程と前記第2照射工程は、レーザ光を選択的に反射させてレーザビームを前記改質予定領域内へ選択的に照射させる空間光変調器と、を用いて行う
    請求項1から請求項4のいずれか一項に記載のレーザアニール方法。
  6. 前記空間光変調器は、多数のマイクロミラーがマトリクス状に配置され、該マイクロミラーのそれぞれが個別に、前記非晶質シリコン膜の表面へのレーザビームの照射状態と非照射状態とに切り換え可能に選択駆動される
    請求項5に記載のレーザアニール方法。
  7. 前記第1照射工程は、複数のマイクロレンズがマトリクス状に配置されたマイクロレンズアレイを用いて前記改質予定領域の外側へ複数のレーザパルスビームを照射し、
    前記第2照射工程は、前記マイクロレンズアレイを用いて前記改質予定領域へ複数の前記連続発振レーザ光のレーザビームを照射する
    請求項1から請求項4のいずれか一項に記載のレーザアニール方法。
  8. 前記結晶化シリコン膜は、多結晶シリコン膜、疑似単結晶シリコン膜から選ばれる
    請求項1から請求項7のいずれか一項に記載のレーザアニール方法。
  9. 基板上に、順次、ゲート配線と、ゲート絶縁膜と、非晶質シリコン膜と、が形成されてなるゲート基板における、前記非晶質シリコン膜に設定したチャネル半導体層となる改質予定領域の外側で、かつ前記ゲート配線に対して当該ゲート配線の長手方向に直交する方向の外側に、第1のレーザ光の照射を行って微結晶シリコンでなる種結晶領域を形成する第1照射工程と、
    前記種結晶領域を起点として、前記非晶質シリコン膜の表面に第2のレーザ光の照射を行って前記改質予定領域内の前記非晶質シリコン膜が結晶化シリコン膜になるように結晶成長させる第2照射工程と、
    前記第2照射工程が施された前記非晶質シリコン膜の上に全面に金属膜を成膜する工程と、
    前記金属膜上にソース配線およびドレイン配線となる領域のエッチング用マスクをパターニングする工程と、
    前記エッチング用マスクを用いてエッチングを行って、前記エッチング用マスクで覆われずに露出する前記金属膜と、前記金属膜のエッチング後に露出する前記種結晶領域を含む非晶質シリコン膜と、を除去する
    薄膜トランジスタの製造方法。
  10. 前記第1照射工程の前記第1のレーザ光の照射における照射エネルギー量は、前記非晶質シリコン膜が種結晶として微結晶化する条件に設定し、
    前記第2照射工程の前記第2のレーザ光の照射は、連続発振レーザ光を用いて連続照射する
    請求項9に記載の薄膜トランジスタの製造方法。
  11. 前記第1のレーザ光は、前記第2照射工程で用いる前記連続発振レーザ光をON−OFF変調して照射する
    請求項10に記載の薄膜トランジスタの製造方法。
  12. 前記第1照射工程と前記第2照射工程は、レーザ光を選択的に反射させてレーザビームを前記改質予定領域内へ選択的に照射させる空間光変調器と、を用いて行う
    請求項9から請求項11のいずれか一項に記載の薄膜トランジスタの製造方法。
  13. 前記空間光変調器は、多数のマイクロミラーがマトリクス状に配置され、該マイクロミラーのそれぞれが個別に、前記非晶質シリコン膜の表面へのレーザビームの照射状態と非照射状態とに切り換え可能に選択駆動される
    請求項12に記載の薄膜トランジスタの製造方法。
  14. 前記第1照射工程は、複数のマイクロレンズがマトリクス状に配置されたマイクロレンズアレイを用いて前記改質予定領域の外側へ複数のレーザ変調ビームを照射し、
    前記第2照射工程は、前記マイクロレンズアレイを用いて前記改質予定領域へ複数の前記連続発振レーザ光のレーザビームを照射する
    請求項9から請求項11のいずれか一項に記載の薄膜トランジスタの製造方法。
  15. 前記結晶化シリコン膜は、多結晶シリコン膜、疑似単結晶シリコン膜から選ばれる
    請求項9から請求項14のいずれか一項に記載の薄膜トランジスタの製造方法。
JP2018236398A 2018-12-18 2018-12-18 レーザアニール方法および薄膜トランジスタの製造方法 Pending JP2020098867A (ja)

Priority Applications (5)

Application Number Priority Date Filing Date Title
JP2018236398A JP2020098867A (ja) 2018-12-18 2018-12-18 レーザアニール方法および薄膜トランジスタの製造方法
KR1020217008104A KR20210103457A (ko) 2018-12-18 2019-12-03 레이저 어닐 방법 및 박막 트랜지스터의 제조 방법
PCT/JP2019/047135 WO2020129600A1 (ja) 2018-12-18 2019-12-03 レーザアニール方法および薄膜トランジスタの製造方法
CN201980076602.6A CN113169050A (zh) 2018-12-18 2019-12-03 激光退火方法及薄膜晶体管的制造方法
TW108145262A TW202036679A (zh) 2018-12-18 2019-12-11 雷射退火方法及薄膜電晶體的製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2018236398A JP2020098867A (ja) 2018-12-18 2018-12-18 レーザアニール方法および薄膜トランジスタの製造方法

Publications (1)

Publication Number Publication Date
JP2020098867A true JP2020098867A (ja) 2020-06-25

Family

ID=71101443

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2018236398A Pending JP2020098867A (ja) 2018-12-18 2018-12-18 レーザアニール方法および薄膜トランジスタの製造方法

Country Status (5)

Country Link
JP (1) JP2020098867A (ja)
KR (1) KR20210103457A (ja)
CN (1) CN113169050A (ja)
TW (1) TW202036679A (ja)
WO (1) WO2020129600A1 (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN113634900A (zh) * 2021-07-21 2021-11-12 上海理工大学 一种使用增材制造技术制备镍基合金定向双晶的方法

Family Cites Families (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01276617A (ja) * 1988-04-27 1989-11-07 Seiko Epson Corp 半導体装置の製造方法
JP3942878B2 (ja) * 2001-11-28 2007-07-11 株式会社半導体エネルギー研究所 半導体装置の作製方法
JP3847172B2 (ja) * 2002-01-18 2006-11-15 住友重機械工業株式会社 結晶成長方法及びレーザアニール装置
JP2004342875A (ja) * 2003-05-16 2004-12-02 Fuji Photo Film Co Ltd レーザアニール装置
JP4092414B2 (ja) * 2004-11-29 2008-05-28 住友重機械工業株式会社 レーザアニール方法
KR101266273B1 (ko) * 2006-06-30 2013-05-22 엘지디스플레이 주식회사 액정표시소자의 제조방법
JP5471046B2 (ja) 2009-06-03 2014-04-16 株式会社ブイ・テクノロジー レーザアニール方法及びレーザアニール装置

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN113634900A (zh) * 2021-07-21 2021-11-12 上海理工大学 一种使用增材制造技术制备镍基合金定向双晶的方法

Also Published As

Publication number Publication date
TW202036679A (zh) 2020-10-01
WO2020129600A1 (ja) 2020-06-25
KR20210103457A (ko) 2021-08-23
CN113169050A (zh) 2021-07-23

Similar Documents

Publication Publication Date Title
JP2004311935A (ja) 単結晶シリコン膜の製造方法
KR20060050318A (ko) 열처리에 의해 얼라인먼트 마크를 형성한 반도체박막을가지는 반도체장치, 반도체박막의 결정화방법, 및반도체박막의 결정화장치
JP6623078B2 (ja) レーザアニール方法及びレーザアニール装置
JP5800292B2 (ja) レーザ処理装置
JP2003257855A (ja) 半導体薄膜の形成方法および半導体薄膜の形成装置
WO2020129600A1 (ja) レーザアニール方法および薄膜トランジスタの製造方法
WO2017067336A1 (zh) 阵列基板及其制作方法、显示面板、显示装置
JP7154592B2 (ja) レーザアニール方法およびレーザアニール装置
JP2010034366A (ja) 半導体処理装置および半導体処理方法
JP2006504262A (ja) 多結晶化方法、多結晶シリコン薄膜トランジスタの製造方法、及びそのためのレーザー照射装置
WO2020129562A1 (ja) レーザアニール装置
TWI574307B (zh) 利用順序橫向固化方法之結晶設備
WO2020129601A1 (ja) レーザアニール方法およびレーザアニール装置
JP4763983B2 (ja) 光変調素子、結晶化装置、結晶化方法、薄膜半導体基板の製造装置、薄膜半導体基板の製造方法、薄膜半導体装置、薄膜半導体装置の製造方法、表示装置及び位相シフタ
JP2007281465A (ja) 多結晶膜の形成方法
JP2007208174A (ja) レーザアニール技術、半導体膜、半導体装置、及び電気光学装置
JP7203417B2 (ja) レーザアニール方法、レーザアニール装置、およびtft基板
JP7161758B2 (ja) レーザアニール装置
JP2005276996A (ja) 平面表示装置の製造方法
JP2005197657A (ja) 多結晶シリコン薄膜トランジスタの多結晶シリコン膜の形成方法
JP2006054223A (ja) 半導体薄膜の結晶化方法、結晶化された半導体薄膜を有する基板、そして半導体薄膜の結晶化装置
WO2019107108A1 (ja) レーザ照射装置、レーザ照射方法及び投影マスク
JP4377442B2 (ja) 半導体薄膜の形成方法、半導体薄膜の形成装置、結晶化方法および結晶化装置
JP2007299911A (ja) 半導体膜の製造方法
JP2011139082A (ja) 光変調素子、結晶化装置、結晶化方法、薄膜半導体基板の製造装置、薄膜半導体基板の製造方法、薄膜半導体装置、薄膜半導体装置の製造方法および表示装置