JP2008083727A - Electrooptical device, driving method for electrooptical device, and electronic equipment - Google Patents
Electrooptical device, driving method for electrooptical device, and electronic equipment Download PDFInfo
- Publication number
- JP2008083727A JP2008083727A JP2007312127A JP2007312127A JP2008083727A JP 2008083727 A JP2008083727 A JP 2008083727A JP 2007312127 A JP2007312127 A JP 2007312127A JP 2007312127 A JP2007312127 A JP 2007312127A JP 2008083727 A JP2008083727 A JP 2008083727A
- Authority
- JP
- Japan
- Prior art keywords
- capacitor
- transistor
- pixel
- data
- scanning
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 238000000034 method Methods 0.000 title claims description 26
- 239000003990 capacitor Substances 0.000 claims abstract description 101
- 230000001360 synchronised effect Effects 0.000 claims description 12
- 230000003287 optical effect Effects 0.000 claims description 7
- 230000004044 response Effects 0.000 claims description 7
- 230000008878 coupling Effects 0.000 claims description 2
- 238000010168 coupling process Methods 0.000 claims description 2
- 238000005859 coupling reaction Methods 0.000 claims description 2
- 230000005611 electricity Effects 0.000 claims 1
- 101100191136 Arabidopsis thaliana PCMP-A2 gene Proteins 0.000 description 15
- 101100048260 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) UBX2 gene Proteins 0.000 description 15
- 238000010586 diagram Methods 0.000 description 14
- 101100422768 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) SUL2 gene Proteins 0.000 description 10
- 230000008859 change Effects 0.000 description 8
- 230000006870 function Effects 0.000 description 5
- 239000011159 matrix material Substances 0.000 description 3
- 230000004048 modification Effects 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 101000885321 Homo sapiens Serine/threonine-protein kinase DCLK1 Proteins 0.000 description 1
- 102100039758 Serine/threonine-protein kinase DCLK1 Human genes 0.000 description 1
- 206010047571 Visual impairment Diseases 0.000 description 1
- 230000004397 blinking Effects 0.000 description 1
- 230000000903 blocking effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000006872 improvement Effects 0.000 description 1
- 238000004020 luminiscence type Methods 0.000 description 1
- 230000002265 prevention Effects 0.000 description 1
Images
Classifications
-
- Y02B20/345—
-
- Y02B20/36—
Landscapes
- Electroluminescent Light Sources (AREA)
- Shift Register Type Memory (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Control Of El Displays (AREA)
Abstract
Description
本発明は、電流によって発光輝度が制御される電気光学素子を用いた電気光学装置、電気光学装置の駆動方法および電子機器に係り、特に、駆動電流の電流経路を遮断する技術に関する。 The present invention relates to an electro-optical device using an electro-optical element whose emission luminance is controlled by an electric current, a driving method of the electro-optical device, and an electronic apparatus, and more particularly to a technique for blocking a current path of a driving current.
近年、有機EL(Electronic Luminescence)素子を用いたフラットパネルディスプレイ(FPD)が注目されている。有機EL素子は、自己を流れる電流によって駆動する典型的な電流駆動型素子であり、その電流レベルに応じた輝度で自己発光する。有機EL素子を用いたアクティブマトリクス型ディスプレイの駆動方式は、電圧プログラム方式と電流プログラム方式とに大別される。 In recent years, flat panel displays (FPD) using organic EL (Electronic Luminescence) elements have attracted attention. The organic EL element is a typical current-driven element that is driven by a current flowing through the organic EL element, and self-lumines with a luminance corresponding to the current level. The driving method of an active matrix display using an organic EL element is roughly classified into a voltage program method and a current program method.
例えば、電圧プログラム方式に関する特許文献1には、有機EL素子に駆動電流を供給する電流経路中に、この経路を遮断するトランジスタ(同文献の図5に示すTFT3)を設けた画素回路が開示されている。このトランジスタは、1フレーム期間の前半においてオン状態に制御されるとともに、その後半においてオフ状態に制御される。したがって、トランジスタがオンして駆動電流が流れる前半期間では、その電流レベルに応じた輝度で有機EL素子が発光する。また、トランジスタがオフして駆動電流が遮断される後半期間では、有機EL素子が強制的に消灯するため、黒が表示される。このような手法はブリンキング(Blinking)と呼ばれており、この手法によって、人間の目が感じる残像を断ち切り、動画表示品質の改善を図ることができる。
For example,
また、例えば、特許文献2および特許文献3には、電流プログラム方式を用いた画素回路の構成が開示されている。特許文献2は、一対のトランジスタによって構成されたカレントミラー回路を用いた画素回路に関する。また、特許文献3は、有機EL素子に供給する駆動電流の設定源となる駆動トランジスタにおいて、その電流不均一性と閾値電圧変化との低減を図る画素回路に関する。
For example,
本発明の目的は、駆動電流に応じた輝度で発光する電気光学素子を用いた電気光学装置において、表示品質の改善を図ることである。 An object of the present invention is to improve display quality in an electro-optical device using an electro-optical element that emits light with luminance corresponding to a driving current.
かかる課題を解決するために、本発明の第1の電気光学装置は、複数の走査線と、複数のデータ線と、走査線とデータ線との交差に対応して配置された複数の画素と、走査線に走査信号を出力することにより、データの書込対象となる画素に対応する走査線を選択するとともに、走査信号と同期したパルス信号を出力する走査線駆動回路と、走査線駆動回路と協働し、書込対象となる画素に対応するデータ線にデータ電圧を出力するデータ線駆動回路とを有する電気光学装置を提供する。ここで、画素のそれぞれは、3つのトランジスタと、キャパシタと、電気光学素子とを有する。スイッチングトランジスタは、ソースまたはドレインの一方の端子がデータ線に接続され、走査信号によって制御される。キャパシタは、スイッチングトランジスタの他方の端子に接続され、データ電圧に応じた電荷を蓄積する。駆動トランジスタは、ゲートがスイッチングトランジスタの他方の端子とキャパシタとに共通接続され、キャパシタに蓄積された電荷に応じて、駆動電流を設定する。電気光学素子は、駆動電流に応じた輝度で発光する。制御トランジスタは、書込対象となる画素に対応する走査線が選択されてから、この走査線が次に選択されるまでの期間において、走査信号と同期したパルス信号に応じて、駆動電流の電流経路の導通と遮断を繰り返す。 In order to solve such a problem, a first electro-optical device of the present invention includes a plurality of scanning lines, a plurality of data lines, and a plurality of pixels arranged corresponding to intersections of the scanning lines and the data lines. A scanning line driving circuit for selecting a scanning line corresponding to a pixel to which data is to be written by outputting a scanning signal to the scanning line and outputting a pulse signal synchronized with the scanning signal; and a scanning line driving circuit And an electro-optical device having a data line driving circuit for outputting a data voltage to a data line corresponding to a pixel to be written. Here, each pixel includes three transistors, a capacitor, and an electro-optic element. The switching transistor has one of its source and drain terminals connected to the data line and is controlled by a scanning signal. The capacitor is connected to the other terminal of the switching transistor and accumulates electric charge according to the data voltage. The drive transistor has a gate commonly connected to the other terminal of the switching transistor and the capacitor, and sets a drive current according to the electric charge accumulated in the capacitor. The electro-optic element emits light with a luminance corresponding to the drive current. In the period from when the scanning line corresponding to the pixel to be written is selected until the next scanning line is selected, the control transistor is configured to drive the current of the drive current according to the pulse signal synchronized with the scanning signal. Repeat the path conduction and interruption.
上記の電気光学装置において、制御トランジスタは、書込対象となる画素に対応する走査線が選択されてから、この走査線が次に選択されるまでの期間のうち、前半の期間において、駆動電流の電流経路を遮断し続けるとともに、前半の期間に続く後半の期間において、駆動電流の電流経路の導通と遮断を繰り返すことが好ましい。 In the electro-optical device described above, the control transistor drives the drive current during the first half of the period from when the scan line corresponding to the pixel to be written is selected until the next scan line is selected. It is preferable to continue to cut off the current path of the driving current and repeat conduction and interruption of the current path of the driving current in the second half period following the first half period.
本発明の第2の電気光学装置は、複数の走査線と、複数のデータ線と、走査線とデータ線との交差に対応して配置された複数の画素と、走査線に第1の走査信号を出力することにより、データの書込対象となる画素に対応する走査線を選択するとともに、第1の走査信号と同期した第2の走査信号と、第1の走査信号と同期したパルス信号とを出力する走査線駆動回路と、走査線駆動回路と協働し、書込対象となる画素に対応するデータ線にデータ電圧を出力するデータ線駆動回路とを有する電気光学装置を提供する。ここで、画素のそれぞれは、4つのトランジスタと、2つのキャパシタと、電気光学素子とを有する。第1のスイッチングトランジスタは、ソースまたはドレインの一方の端子がデータ線に接続され、第1の走査信号によって制御される。第1のキャパシタは、一方の電極が第1のスイッチングトランジスタの他方の端子に接続されており、第2のキャパシタは、一方の電極に電源電位が印加されている。第2のスイッチングトランジスタは、ソースまたはドレインの一方の端子が第1のキャパシタの他方の電極と第2のキャパシタの他方の電極とに共通接続され、第2の走査信号によって制御される。駆動トランジスタは、ゲートが第2のスイッチングトランジスタの一方の端子と第1のキャパシタの他方の端子と第2のキャパシタの他方の端子とに共通接続され、ソースに第2のキャパシタの一方の電極が接続され、ドレインに第2のスイッチングトランジスタの他方の端子が接続されている。この駆動トランジスタは、データ電圧に応じた電荷を第2のキャパシタに蓄積させるとともに、第2のキャパシタに蓄積された電荷に応じて、駆動電流を設定する。電気光学素子は、駆動電流に応じた輝度で発光する。制御トランジスタは、書込対象となる画素に対応する走査線が選択されてから、この走査線が次に選択されるまでの期間において、第1のキャパシタと第2のキャパシタの容量結合を利用して駆動トランジスタのゲート・ソース間電圧を調整した後に、第1の走査信号と同期したパルス信号に応じて、駆動電流の電流経路の導通と遮断を繰り返す。 The second electro-optical device of the present invention includes a plurality of scanning lines, a plurality of data lines, a plurality of pixels arranged corresponding to the intersections of the scanning lines and the data lines, and the first scanning on the scanning lines. By outputting a signal, a scanning line corresponding to a pixel to which data is to be written is selected, a second scanning signal synchronized with the first scanning signal, and a pulse signal synchronized with the first scanning signal And a data line driving circuit that cooperates with the scanning line driving circuit and outputs a data voltage to a data line corresponding to a pixel to be written. Here, each pixel includes four transistors, two capacitors, and an electro-optic element. The first switching transistor has one of a source terminal and a drain terminal connected to the data line, and is controlled by a first scanning signal. One electrode of the first capacitor is connected to the other terminal of the first switching transistor, and a power supply potential is applied to one electrode of the second capacitor. The second switching transistor has one source or drain terminal commonly connected to the other electrode of the first capacitor and the other electrode of the second capacitor, and is controlled by the second scanning signal. The driving transistor has a gate commonly connected to one terminal of the second switching transistor, the other terminal of the first capacitor, and the other terminal of the second capacitor, and one electrode of the second capacitor is connected to the source. The other terminal of the second switching transistor is connected to the drain. The driving transistor accumulates electric charge according to the data voltage in the second capacitor and sets a driving current according to the electric charge accumulated in the second capacitor. The electro-optic element emits light with a luminance corresponding to the drive current. The control transistor uses capacitive coupling between the first capacitor and the second capacitor during a period from when the scanning line corresponding to the pixel to be written is selected until the next scanning line is selected. After the gate-source voltage of the driving transistor is adjusted, conduction and interruption of the current path of the driving current are repeated in accordance with the pulse signal synchronized with the first scanning signal.
上記の電気光学装置において、制御トランジスタは、走査線駆動回路より出力されるパルス信号によって導通制御されることが好ましい。この場合、走査線駆動回路は、書込対象となる画素に供給する走査信号と同期して、書込対象となる画素に供給するパルス信号を、高レベルと低レベルとが交互に繰り返されるパルス状にすることが好ましい。 In the above electro-optical device, it is preferable that the control transistor is conduction-controlled by a pulse signal output from the scanning line driving circuit. In this case, the scanning line driving circuit outputs a pulse signal that is supplied to the pixel to be written in a pulse that alternately repeats a high level and a low level in synchronization with the scanning signal supplied to the pixel to be written. It is preferable to make it into a shape.
また、上記の電気光学装置において、制御トランジスタは、書込対象となる画素に対応する走査線が選択されてから、この走査線が次に選択されるまでの期間のうち、駆動期間において、駆動電流の電流経路の導通と遮断を繰り返し、駆動期間を除く期間において、駆動電流の電流経路を遮断し続けることが好ましい。 Further, in the above electro-optical device, the control transistor is driven in the driving period in the period from when the scanning line corresponding to the pixel to be written is selected until the next scanning line is selected. It is preferable that the current path of the current is repeatedly turned on and off, and the current path of the drive current is continuously cut off during the period other than the drive period.
本発明の電子機器は、上述した電気光学装置が実装されてなる。 The electronic apparatus according to the present invention includes the above-described electro-optical device.
本発明の電気光学装置の駆動方法は、走査線とデータ線との交差に対応して配置された複数の画素と、走査線に走査信号を出力することにより、表示階調を示すデータの書込対象となる画素に対応する走査線を選択する走査線駆動回路と、走査線駆動回路と協働し、書込対象となる画素に対応するデータ線に表示階調に相当する大きさのデータ電圧を出力するデータ線駆動回路とを有する電気光学装置の駆動方法を提供する。この駆動方法は、書込対象となる画素に対応するデータ線にデータ電圧を出力する第1のステップと、書込対象となる画素が有する第1のキャパシタと第2のキャパシタに、データ線に供給されたデータ電圧に応じてデータの書き込みを行う第2のステップと、書込対象となる画素が有する駆動トランジスタによって、第2のキャパシタに蓄積された電荷に応じた駆動電流を設定し、設定された駆動電流を、駆動電流に応じた輝度で発光する電気光学素子に供給する第3のステップと、書込対象となる画素に対応する走査線が選択されてから、この走査線が次に選択されるまでの期間において、走査信号に同期して駆動電流の電流経路の導通と遮断を繰り返す第4のステップとを有する。 According to the driving method of the electro-optical device of the present invention, the writing of data indicating display gradation is performed by outputting a scanning signal to a plurality of pixels arranged corresponding to the intersection of the scanning line and the data line. A scanning line driving circuit for selecting a scanning line corresponding to the pixel to be embedded, and data corresponding to the display gradation in the data line corresponding to the pixel to be written in cooperation with the scanning line driving circuit. A method for driving an electro-optical device having a data line driving circuit for outputting a voltage is provided. This driving method includes a first step of outputting a data voltage to a data line corresponding to a pixel to be written, a first capacitor and a second capacitor of the pixel to be written, A second step of writing data in accordance with the supplied data voltage and a driving current corresponding to the charge accumulated in the second capacitor are set by the driving transistor of the pixel to be written and set. A third step of supplying the generated drive current to the electro-optical element that emits light with luminance according to the drive current, and a scan line corresponding to the pixel to be written is selected, and then the scan line is And a fourth step of repeating conduction and interruption of the current path of the drive current in synchronization with the scanning signal in the period until the selection.
上記の電気光学装置の駆動方法において、第2のステップが行われる前に、駆動トランジスタのゲート・ソース間電圧を調整する第5のステップをさらに有することが好ましい。 Preferably, the electro-optical device driving method further includes a fifth step of adjusting a gate-source voltage of the driving transistor before the second step is performed.
(第1の実施形態)
本実施形態は、電流プログラム方式を用いた電気光学装置に係り、特に、それぞれの画素がカレントミラー回路を含んでいるアクティブマトリクス型ディスプレイの表示制御に関する。ここで、「電流プログラム方式」とは、データ線に対するデータの供給を電流ベースで行う方式をいう。
(First embodiment)
The present embodiment relates to an electro-optical device using a current programming method, and more particularly to display control of an active matrix display in which each pixel includes a current mirror circuit. Here, the “current programming method” refers to a method of supplying data to the data line on a current basis.
図1は、電気光学装置のブロック構成図である。表示部1には、mドット×nライン分の画素2がマトリクス状(二次元平面的)に並んでいるとともに、水平方向に延在している水平ライン群Y1〜Ynと、垂直方向に延在しているデータ線群X1〜Xmとが配置されている。1つの水平ラインY(YはY1〜Ynの任意の1つを指す)は、2本の走査線と1本の信号線で構成されており、それぞれに対して、第1の走査信号SEL1、第2の走査信号SEL2、パルス信号PLSが出力される。これらの走査信号SEL1,SEL2は、基本的に、互いに排他的な論理レベルをとるが、一方の変化タイミングを若干ずらすこともある。それぞれの画素2は、水平ライン群Y1〜Ynとデータ線群X1〜Xmとの各交差に対応して配置されている。パルス信号PLSは、ある画素2が選択されてから、この画素2が次に選択されるまでの期間(本実施形態では1垂直走査期間)において、その画素2を構成する電気光学素子をインパルス駆動させる制御信号である。なお、本実施形態では、1つの画素2を画像の最小表示単位としているが、1つの画素2を複数のサブ画素で構成してもよい。また、図1では、各画素2に所定の固定電位Vdd,Vssを供給する電源線等が省略されている。
FIG. 1 is a block diagram of the electro-optical device. In the
制御回路5は、図示しない上位装置より入力される垂直同期信号Vs、水平同期信号Hs、ドットクロック信号DCLKおよび階調データD等に基づいて、走査線駆動回路3とデータ線駆動回路4とを同期制御する。この同期制御の下、走査線駆動回路3およびデータ線駆動回路4は、互いに協働して、表示部1の表示制御を行う。
The control circuit 5 connects the scanning
走査線駆動回路3は、シフトレジスタ、出力回路等を主体に構成されており、走査線に走査信号SEL1,SEL2を出力することによって、走査線を順番に選択していく。このような線順次走査により、1垂直走査期間において、所定の走査方向に(一般的には最上から最下に向かって)、1水平ライン分の画素群に相当する画素行が順番に選択されていく。
The scanning
一方、データ線駆動回路4は、シフトレジスタ、ラインラッチ回路、出力回路等を主体に構成されている。本実施形態において、データ線駆動回路4は、電流プログラム方式を用いる関係上、画素2の表示階調に相当するデータ(データ電圧Vdata)をデータ電流Idataへと変換する可変電流源を含む。データ線駆動回路4は、1水平走査期間において、今回データを書き込む画素行に対するデータ電流Idataの一斉出力と、次の水平走査期間で書き込みを行う画素行に関するデータの点順次的なラッチとを同時に行う。ある水平走査期間において、データ線Xの本数に相当するm個のデータが順次ラッチされる。そして、次の水平走査期間において、ラッチされたm個のデータは、データ電流Idataに変換された上で、それぞれのデータ線X1〜Xmに対して一斉に出力される。なお、データ線駆動回路4に対してフレームメモリ等(図示せず)から直接データを線順次的に入力する構成でも本発明を適用できるが、その場合においても本発明の主眼とする部分の動作は同様であるので説明を省略する。この場合、データ線駆動回路4にシフトレジスタを含む必要がなくなる。
On the other hand, the data
図2は、本実施形態に係る画素2の回路図である。1つの画素2は、有機EL素子OLED、能動素子である5つのトランジスタT1〜T5、および、データを保持するキャパシタCによって構成されている。ダイオードとして表記された有機EL素子OLEDは、自己に供給された駆動電流Ioledによって発光輝度が制御される電流駆動型の素子である。なお、この画素回路では、nチャネル型のトランジスタT1,T5と、pチャネル型のトランジスタT2〜T4とが用いられているが、これは一例であって、本発明はこれに限定されるものではない。
FIG. 2 is a circuit diagram of the
第1のスイッチングトランジスタT1のゲートは、第1の走査信号SEL1が供給される走査線に接続され、そのソースは、データ電流Idataが供給されるデータ線X(XはX1〜Xmの任意の1本を指す)に接続されている。また、第1のスイッチングトランジスタT1のドレインは、第2のスイッチングトランジスタT2のドレインと、プログラミングトランジスタT3のドレインとに共通接続されている。第2の走査信号SEL2がゲートに供給された第2のスイッチングトランジスタT2のソースは、カレントミラー回路を構成する一対のトランジスタT3,T4のゲートと、キャパシタCの一方の電極とに共通接続されている。プログラミングトランジスタT3のソース、駆動素子の一形態である駆動トランジスタT4のソースおよびキャパシタCの他方の電極には、電源電位Vddが印加されている。制御素子の一形態であって、パルス信号PLSがゲートに供給された制御トランジスタT5は、駆動電流Ioledの電流経路中、具体的には、駆動トランジスタT4のドレインと有機EL素子OLEDのアノード(陽極)との間に設けられている。この有機EL素子OLEDのカソード(陰極)には、電源電位Vddより低い電位Vssが印加されている。プログラミングトランジスタT3および駆動トランジスタT4は、両者のゲートが互いに接続されたカレントミラー回路を構成している。したがって、プログラミングトランジスタT3のチャネルを流れるデータ電流Idataの電流レベルと、駆動トランジスタT4のチャネルを流れる駆動電流Ioledの電流レベルとは、比例関係になる。 The gate of the first switching transistor T1 is connected to the scanning line to which the first scanning signal SEL1 is supplied, and the source thereof is the data line X to which the data current Idata is supplied (X is any one of X1 to Xm). Connected to a book). The drain of the first switching transistor T1 is commonly connected to the drain of the second switching transistor T2 and the drain of the programming transistor T3. The source of the second switching transistor T2 to which the second scanning signal SEL2 is supplied to the gate is commonly connected to the gates of the pair of transistors T3 and T4 constituting the current mirror circuit and one electrode of the capacitor C. Yes. A power supply potential Vdd is applied to the source of the programming transistor T3, the source of the driving transistor T4 which is one form of the driving element, and the other electrode of the capacitor C. The control transistor T5 to which the pulse signal PLS is supplied to the gate, which is one form of the control element, specifically in the current path of the drive current Ioled, specifically, the drain of the drive transistor T4 and the anode (anode) of the organic EL element OLED. ). A potential Vss lower than the power supply potential Vdd is applied to the cathode (cathode) of the organic EL element OLED. The programming transistor T3 and the driving transistor T4 constitute a current mirror circuit in which both gates are connected to each other. Therefore, the current level of the data current Idata flowing through the channel of the programming transistor T3 and the current level of the driving current Ioled flowing through the channel of the driving transistor T4 are in a proportional relationship.
図3は、本実施形態に係る画素2の駆動タイミングチャートである。走査線駆動回路3の線順次走査によって、ある画素2の選択が開始されるタイミングをt0とし、その画素2の選択が次に開始されるタイミングをt2とする。この1垂直走査期間t0〜t2は、前半のプログラミング期間t0〜t1と、後半の駆動期間t1〜t2とに分けられる。
FIG. 3 is a drive timing chart of the
まず、プログラミング期間t0〜t1では、画素2の選択によって、キャパシタCに対するデータの書き込みが行われる。タイミングt0において、第1の走査信号SEL1が高レベル(以下、「Hレベル」という)に立ち上がり、第1のスイッチングトランジスタT1がオンする。これにより、データ線XとプログラミングトランジスタT3のドレインとが電気的に接続される。この第1の走査信号SEL1の立ち上がりと同期して、第2の走査信号SEL2が低レベル(以下、「Lレベル」という)に立ち下がって、第2のスイッチングトランジスタT2もオンする。これにより、プログラミングトランジスタT3は、自己のゲートが自己のドレインに接続されたダイオード接続となり、非線形な抵抗素子として機能する。したがって、プログラミングトランジスタT3は、データ線Xより供給されたデータ電流Idataを自己のチャネルに流し、データ電流Idataに応じたゲート電圧Vgを自己のゲートに発生させる。プログラミングトランジスタT3のゲートに接続されたキャパシタCには、発生したゲート電圧Vgに応じた電荷が蓄積され、データが書き込まれる。
First, in the programming period t0 to t1, data is written to the capacitor C by selecting the
プログラミング期間t0〜t1では、パルス信号PLSがLレベルに維持されているため、制御トランジスタT5はオフのままである。したがって、カレントミラー回路を構成する一対のトランジスタT3,T4の閾値の関係に拘わらず、有機EL素子OLEDに対する電流経路が遮断され続ける。そのため、この期間t0〜t1において、有機EL素子OLEDは発光しない。 In the programming period t0 to t1, since the pulse signal PLS is maintained at the L level, the control transistor T5 remains off. Therefore, the current path to the organic EL element OLED is continuously cut off regardless of the threshold relationship between the pair of transistors T3 and T4 constituting the current mirror circuit. Therefore, during this period t0 to t1, the organic EL element OLED does not emit light.
つぎに、駆動期間t1〜t2では、キャパシタCの蓄積電荷に応じた駆動電流Ioledが有機EL素子OLEDを流れ、有機EL素子OLEDが発光する。まず、タイミングt1において、第1の走査信号SEL1がLレベルに立ち下がり、第1のスイッチングトランジスタT1がオフする。これにより、データ線XとプログラミングトランジスタT3のドレインとが電気的に分離され、プログラミングトランジスタT3に対するデータ電流Idataの供給が停止する。この第1の走査信号SEL1の立ち下がりと同期して、第2の走査信号SEL2がHレベルに立ち上がって、第2のスイッチングトランジスタT2もオフする。これにより、プログラミングトランジスタT3のゲートとドレインとの間が電気的に分離される。駆動トランジスタT4のゲートには、キャパシタCに蓄積された電荷によって、ゲート電圧Vg相当が印加される。 Next, in the driving period t1 to t2, the driving current Ioled corresponding to the accumulated charge of the capacitor C flows through the organic EL element OLED, and the organic EL element OLED emits light. First, at timing t1, the first scanning signal SEL1 falls to the L level, and the first switching transistor T1 is turned off. As a result, the data line X and the drain of the programming transistor T3 are electrically separated, and the supply of the data current Idata to the programming transistor T3 is stopped. In synchronization with the fall of the first scanning signal SEL1, the second scanning signal SEL2 rises to the H level, and the second switching transistor T2 is also turned off. Thereby, the gate and the drain of the programming transistor T3 are electrically separated. A gate voltage Vg equivalent is applied to the gate of the drive transistor T4 by the electric charge accumulated in the capacitor C.
タイミングt1における第1の走査信号SEL1の立ち下がりと同期して、それ以前はLレベルだったパルス信号PLSは、HレベルとLレベルとが交互に繰り返されるパルス状の波形へと変化する。このパルス波形は、画素2の次の選択が開始されるタイミングt2に至るまで継続される。これにより、パルス信号PLSによって導通制御される制御トランジスタT5は、オンとオフとを交互に繰り返すことになる。制御トランジスタT5がオンの場合、電源電位Vddから電位Vssに向かって、駆動トランジスタT4と制御トランジスタT5と有機EL素子OLEDとを介した電流経路が形成される。有機EL素子OLEDを流れる駆動電流Ioledは、その電流値を設定する駆動トランジスタT4のチャネル電流に相当し、キャパシタCの蓄積電荷に起因したゲート電圧Vgによって制御される。有機EL素子OLEDは、駆動電流Ioledに応じた輝度で発光する。上述したカレントミラー構成により、有機EL素子OLEDの発光輝度を規定する駆動電流Ioled(駆動トランジスタT4のチャネル電流)は、データ線Xより供給されたデータ電流Idata(プログラミングトランジスタT3のチャネル電流)に比例する。一方、制御トランジスタT5がオフの場合、駆動電流Ioledの電流経路が制御トランジスタT5によって強制的に遮断される。したがって、制御トランジスタT5のオフ期間では、有機EL素子OLEDの発光が一時的に停止し、黒表示となる。このように、駆動期間t1〜t2では、駆動電流Ioledの電流経路中に設けられた制御トランジスタT5のオンとオフとが複数回行われるため、有機EL素子OLEDの発光と非発光とが複数回繰り返される。
In synchronization with the fall of the first scanning signal SEL1 at the timing t1, the pulse signal PLS, which was previously at the L level, changes to a pulsed waveform in which the H level and the L level are alternately repeated. This pulse waveform is continued until the timing t2 when the next selection of the
このように、本実施形態では、制御トランジスタT5の導通制御により、画素2が選択されてから次に選択されるまでの期間t0〜t2において、駆動電流Ioledの電流経路の遮断が繰り返される。このため、駆動期間t1〜t2において、有機EL素子OLEDの発光と非発光とが複数回行われる。その結果、画素2の光学応答をインパルス型に近づけることができる。また、この期間t1〜t2において、有機EL素子OLEDが非発光となる期間(黒表示の期間)が分散されるため、表示画像のちらつきの低減を図ることができる。その結果、表示品質の一層の向上を図ることができる。それとともに、画素2の光学応答を改善することにより、動画表示等における疑似輪郭の発生も有効に抑制可能となる。
As described above, in the present embodiment, the current path of the drive current Ioled is repeatedly interrupted in the period t0 to t2 from the selection of the
また、本実施形態によれば、駆動電流Ioledの電流経路中に制御トランジスタT5を設けることにより、カレントミラー回路を構成する一対のトランジスタT3,T4の閾値の制約を解消できる。上述した特許文献1に開示されたカレントミラー回路を有する画素回路では、駆動電流Ioledの電流経路中に、制御トランジスタT5が設けられていない。そのため、駆動トランジスタT4の閾値は、プログラミングトランジスタT3の閾値よりも低くならないように設定する必要がある。なぜなら、この関係を具備しない場合、キャパシタCに対するデータの書き込みが十分に完了しないうちに、駆動トランジスタT4がオンしてしまい、これに起因したリーク電流によって、有機EL素子OLEDが発光してしまうからである。さらに、駆動トランジスタT4を完全にオフすることができずに有機EL素子OLEDを完全に消灯できない、つまり「黒」表示ができないという問題が発生する場合がある。これに対して、本実施形態のように、駆動電流Ioledの電流経路中に制御トランジスタT5を追加し、プログラミング期間t0〜t1中、これをオフさせておけば、トランジスタT3,T4の閾値の関係に依存することなく、駆動電流Ioledの電流経路を強制的に遮断できる。その結果、プログラミング期間t0〜t1において、駆動トランジスタT4のリーク電流に起因した有機EL素子OLEDの発光を確実に防止でき、表示品質の一層の向上を図ることができる。
In addition, according to the present embodiment, by providing the control transistor T5 in the current path of the drive current Ioled, it is possible to eliminate the threshold restriction of the pair of transistors T3 and T4 constituting the current mirror circuit. In the pixel circuit having the current mirror circuit disclosed in
なお、上述した実施形態では、駆動期間t1〜t2において、パルス信号PLSの波形をパルス状にした例について説明した。しかしながら、上述したリーク電流に起因した有機EL素子OLEDの発光防止のみに着目するならば、少なくともプログラミング期間t0〜t1において、制御トランジスタT5がオフしていれば足りる。したがって、例えば、図4に示すように、プログラミング期間t0〜t1ではパルス信号PLSをLレベルに維持し、これに続く駆動期間t1〜t2ではパルス信号PLSをHレベルに維持してもよい。また、第2のスイッチングトランジスタT2をnチャネル型に変更してT2のゲートに走査信号SEL1を接続する構成でも同様の効果が得られる。その場合は走査線SEL1が不要となるので画素を構成する回路規模が小さくなり、歩留まり向上や開口率向上に貢献できる。 In the above-described embodiment, the example in which the waveform of the pulse signal PLS is pulsed during the driving period t1 to t2 has been described. However, if attention is paid only to the prevention of light emission of the organic EL element OLED caused by the leakage current described above, it is sufficient that the control transistor T5 is turned off at least during the programming period t0 to t1. Therefore, for example, as shown in FIG. 4, the pulse signal PLS may be maintained at the L level during the programming period t0 to t1, and the pulse signal PLS may be maintained at the H level during the subsequent driving period t1 to t2. The same effect can be obtained by changing the second switching transistor T2 to the n-channel type and connecting the scanning signal SEL1 to the gate of T2. In this case, since the scanning line SEL1 is not necessary, the circuit scale constituting the pixel is reduced, which can contribute to improvement in yield and aperture ratio.
(第2の実施形態)
本実施形態は、駆動トランジスタがプログラミングトランジスタとしての機能も担う、電流プログラム方式における画素回路の構成に関する。なお、後述する各実施形態を含めて、電気光学装置の全体構成は、基本的には、1つの水平ラインYの構成を除いて、図1と同様である。本実施形態において、1つの水平ラインYは、走査信号SELが供給される1本の走査線と、パルス信号PLSが供給される1本の信号線とによって構成されている。
(Second Embodiment)
The present embodiment relates to a configuration of a pixel circuit in a current programming method in which a driving transistor also functions as a programming transistor. The overall configuration of the electro-optical device, including the embodiments described later, is basically the same as that of FIG. 1 except for the configuration of one horizontal line Y. In the present embodiment, one horizontal line Y is composed of one scanning line to which the scanning signal SEL is supplied and one signal line to which the pulse signal PLS is supplied.
図5は、本実施形態に係る画素2の回路図である。1つの画素2は、有機EL素子OLED、4つのトランジスタT1,T2,T4,T5およびキャパシタCによって構成されている。なお、本実施形態に係る画素回路において、トランジスタT1,T2,T4,T5のタイプはすべてpチャネル型であるが、これは一例であって、本発明はこれに限定されるものではない。
FIG. 5 is a circuit diagram of the
第1のスイッチングトランジスタT1のゲートは、走査信号SELが供給される走査線に接続され、そのソースは、データ電流Idataが供給されるデータ線Xに接続されている。第1のスイッチングトランジスタT1のドレインは、制御トランジスタT5のドレインと、駆動トランジスタT4のソースと、キャパシタCの一方の電極とに共通接続されている。キャパシタCの他方の電極は、駆動トランジスタT4のゲートと、第2のスイッチングトランジスタT2のソースとに共通接続されている。第2のスイッチングトランジスタT2のゲートは、第1のスイッチングトランジスタT1と同様に、走査信号SELが供給される走査線に接続されている。第2のスイッチングトランジスタT2のドレインは、駆動トランジスタT4のドレインと、有機EL素子OLEDのアノードとに共通接続されている。この有機EL素子OLEDのカソードには、電位Vssが印加されている。制御トランジスタT5のゲートは、パルス信号PLSが供給される信号線に接続され、そのソースには、電源電位Vddが印加されている。 The gate of the first switching transistor T1 is connected to the scanning line to which the scanning signal SEL is supplied, and the source thereof is connected to the data line X to which the data current Idata is supplied. The drain of the first switching transistor T1 is commonly connected to the drain of the control transistor T5, the source of the driving transistor T4, and one electrode of the capacitor C. The other electrode of the capacitor C is commonly connected to the gate of the driving transistor T4 and the source of the second switching transistor T2. Similarly to the first switching transistor T1, the gate of the second switching transistor T2 is connected to a scanning line to which the scanning signal SEL is supplied. The drain of the second switching transistor T2 is commonly connected to the drain of the driving transistor T4 and the anode of the organic EL element OLED. A potential Vss is applied to the cathode of the organic EL element OLED. The gate of the control transistor T5 is connected to a signal line to which the pulse signal PLS is supplied, and the power supply potential Vdd is applied to its source.
図6は、本実施形態に係る画素2の駆動タイミングチャートである。図5の画素回路では、1垂直走査期間t0〜t2のほぼ全体に亘って、有機EL素子OLEDに電流が流れるため、有機EL素子OLEDが発光する。上述した実施形態と同様に、1垂直走査期間t0〜t2は、プログラミング期間t0〜t1と駆動期間t1〜t2とに分けられる。
FIG. 6 is a drive timing chart of the
まず、プログラミング期間t0〜t1では、画素2の選択によって、キャパシタCに対するデータの書き込みが行われる。タイミングt0において、走査信号SELがLレベルに立ち下がり、スイッチングトランジスタT1,T2が共にオンする。これにより、データ線Xと駆動トランジスタT4のソースとが電気的に接続されるとともに、駆動トランジスタT4は、自己のゲートと自己のドレインとが電気的に接続されたダイオード接続となる。これにより、駆動トランジスタT4は、データ線Xより供給されたデータ電流Idataを自己のチャネルに流し、このデータ電流Idataに応じたゲート電圧Vgを自己のゲートに発生させる。駆動トランジスタT4のゲートとソースとの間に接続されたキャパシタCには、発生したゲート電圧Vgに応じた電荷が蓄積され、データが書き込まれる。このように、プログラミング期間t0〜t1において、駆動トランジスタT4は、キャパシタCにデータを書き込むプログラミングトランジスタとして機能する。
First, in the programming period t0 to t1, data is written to the capacitor C by selecting the
プログラミング期間t0〜t1では、パルス信号PLSがHレベルに維持されているため、制御トランジスタT5はオフのままである。したがって、電源電位Vddから電位Vssに向かう駆動電流Ioledの電流経路自体は遮断され続ける。しかしながら、データ線Xと電位Vssとの間に、第1のスイッチングトランジスタT1と駆動トランジスタT4と有機EL素子OLEDとを介した、データ電流Idataの電流経路が形成される。したがって、プログラミング期間t0〜t1においても、データ電流Idataに応じた輝度で有機EL素子OLEDが発光する。 In the programming period t0 to t1, since the pulse signal PLS is maintained at the H level, the control transistor T5 remains off. Therefore, the current path itself of the drive current Ioled from the power supply potential Vdd to the potential Vss continues to be cut off. However, a current path of the data current Idata is formed between the data line X and the potential Vss via the first switching transistor T1, the drive transistor T4, and the organic EL element OLED. Therefore, also in the programming period t0 to t1, the organic EL element OLED emits light with a luminance corresponding to the data current Idata.
つぎに、駆動期間t1〜t2では、キャパシタCに蓄積された電荷に応じた駆動電流Ioledが有機EL素子OLEDを流れ、有機EL素子OLEDが発光する。まず、駆動開始タイミングt1において、走査信号SELがHレベルに立ち上がり、スイッチングトランジスタT1,T2が共にオフする。これにより、データ電流Idataが供給されたデータ線Xと駆動トランジスタT4のソースとが電気的に分離され、駆動トランジスタT4のゲートとドレインとの間も電気的に分離される。駆動トランジスタT4のゲートには、キャパシタCの蓄積電荷に応じて、ゲート電圧Vg相当が印加される。 Next, in the driving period t1 to t2, the driving current Ioled corresponding to the electric charge accumulated in the capacitor C flows through the organic EL element OLED, and the organic EL element OLED emits light. First, at the drive start timing t1, the scanning signal SEL rises to the H level, and both the switching transistors T1 and T2 are turned off. As a result, the data line X supplied with the data current Idata and the source of the driving transistor T4 are electrically isolated, and the gate and drain of the driving transistor T4 are also electrically isolated. A gate voltage Vg equivalent is applied to the gate of the driving transistor T4 in accordance with the charge stored in the capacitor C.
タイミングt1における走査信号SELの立ち上がりと同期して、それ以前はHレベルだったパルス信号PLSは、パルス波形へと変化する。これにより、パルス信号PLSによって導通制御される制御トランジスタT5は、オンとオフとを交互に繰り返すことになる。制御トランジスタT5がオンの場合、駆動電流Ioledの電流経路が形成される。有機EL素子OLEDを流れる駆動電流Ioledは、キャパシタCの蓄積電荷に起因したゲート電圧Vgによって制御され、この電流レベルに応じた輝度で、有機EL素子OLEDが発光する。一方、制御トランジスタT5がオフの場合、駆動電流Ioledの電流経路が制御トランジスタT5によって強制的に遮断される。このような制御トランジスタT5の導通制御を通じて、駆動期間t1〜t2において、有機EL素子OLEDの発光が断続的に繰り返される。 In synchronization with the rise of the scanning signal SEL at the timing t1, the pulse signal PLS, which was at the H level before that, changes to a pulse waveform. As a result, the control transistor T5 whose conduction is controlled by the pulse signal PLS is alternately turned on and off. When the control transistor T5 is on, a current path for the drive current Ioled is formed. The drive current Ioled flowing through the organic EL element OLED is controlled by the gate voltage Vg caused by the accumulated charge in the capacitor C, and the organic EL element OLED emits light with a luminance corresponding to the current level. On the other hand, when the control transistor T5 is off, the current path of the drive current Ioled is forcibly cut off by the control transistor T5. Through such conduction control of the control transistor T5, light emission of the organic EL element OLED is intermittently repeated during the driving period t1 to t2.
本実施形態によれば、制御トランジスタT5の導通制御により、画素2が選択されてから次に選択されるまでの期間t0〜t2において、駆動電流Ioledの電流経路の遮断が複数回行われる。このため、駆動期間t1〜t2において、有機EL素子OLEDの発光と非発光とが繰り返される。その結果、第1の実施形態と同様に、画素2の光学応答をインパルス型に近づけることができ、かつ、黒表示を分散させることによって、表示画像のちらつきの低減を図ることができる。その結果、表示品質の一層の向上を図ることが可能となる。
According to the present embodiment, the current path of the drive current Ioled is interrupted a plurality of times during the period t0 to t2 from the selection of the
なお、本実施形態では、有機EL素子OLEDの断続的な発光を、駆動電流Ioledの電流経路中に存在する制御トランジスタT5の導通制御により行っている。しかしながら、例えば、図7または図8に示すように、駆動電流Ioledの電流経路中に、制御トランジスタT5とは別に第2の制御トランジスタT6を追加した場合でも、同様のことを実現できる。図7の画素回路では、第2の制御トランジスタT6を、第1の制御トランジスタT5のドレインと駆動トランジスタT4のソースとの間に設けている。また、図8の画素回路では、第2の制御トランジスタT6を、駆動トランジスタT4のドレインと有機EL素子OLEDのアノードとの間に設けている。第2の制御トランジスタT6は、一例として、nチャネル型のトランジスタであり、そのゲートには、パルス信号PLSが供給される。一方、第1の制御トランジスタT5のゲートには、制御信号GPが供給される。 In the present embodiment, intermittent light emission of the organic EL element OLED is performed by the conduction control of the control transistor T5 existing in the current path of the drive current Ioled. However, for example, as shown in FIG. 7 or FIG. 8, even when a second control transistor T6 is added separately from the control transistor T5 in the current path of the drive current Ioled, the same thing can be realized. In the pixel circuit of FIG. 7, the second control transistor T6 is provided between the drain of the first control transistor T5 and the source of the drive transistor T4. In the pixel circuit of FIG. 8, the second control transistor T6 is provided between the drain of the drive transistor T4 and the anode of the organic EL element OLED. As an example, the second control transistor T6 is an n-channel transistor, and a pulse signal PLS is supplied to the gate thereof. On the other hand, the control signal GP is supplied to the gate of the first control transistor T5.
図9は、図7または図8の画素2の駆動のタイミングチャートである。制御信号GPは、プログラミング期間t0〜t1において、Hレベルに維持される。したがって、駆動電流Ioledの電流経路は、制御信号GPで導通制御される制御トランジスタT5によって複数回遮断される。また、このプログラミング期間t0〜t1では、パルス信号PLSがHレベルになるため、第2の制御トランジスタT6がオンする。したがって、図5の画素回路と同様に、データ電流Idataの電流経路が形成されて、キャパシタCにデータが書き込まれるとともに、有機EL素子OLEDが発光する。続く駆動期間t1〜t2では、制御信号GPがHレベルになるとともに、パルス信号PLSがパルス波形になる。したがって、パルス信号PLSによる第2の制御トランジスタT6の導通制御を通じて、有機EL素子OLEDの発光が断続的に繰り返される。
FIG. 9 is a timing chart of driving of the
(第3の実施形態)
本実施形態は、駆動トランジスタがプログラミングトランジスタとしての機能も担う、電流プログラム方式における画素回路の構成に関する。本実施形態において、1つの水平ラインYは、走査信号SELが供給される1本の走査線と、パルス信号PLSが供給される1本の信号線とによって構成されている。
(Third embodiment)
The present embodiment relates to a configuration of a pixel circuit in a current programming method in which a driving transistor also functions as a programming transistor. In the present embodiment, one horizontal line Y is composed of one scanning line to which the scanning signal SEL is supplied and one signal line to which the pulse signal PLS is supplied.
図10は、本実施形態に係る画素2の回路図である。1つの画素2は、有機EL素子OLED、4つのトランジスタT1,T2,T4,T5およびキャパシタCによって構成されている。なお、本実施形態に係る画素回路では、nチャネル型のトランジスタT1,T2,T5とpチャネル型のトランジスタT4とが用いられているが、これは一例であって、本発明はこれに限定されるものではない。
FIG. 10 is a circuit diagram of the
第1のスイッチングトランジスタT1のゲートは、走査信号SELが供給される走査線に接続され、そのソースは、データ電流Idataが供給されるデータ線Xに接続されている。第1のスイッチングトランジスタT1のドレインは、第2のスイッチングトランジスタT2のソースと、駆動トランジスタT4のドレインと、制御トランジスタT5のドレインとに共通接続されている。第2のスイッチングトランジスタT2のゲートは、第1のスイッチングトランジスタT1と同様に、走査信号SELが供給される走査線に接続されている。第2のスイッチングトランジスタT2のドレインは、キャパシタCの一方の電極と、駆動トランジスタT4のゲートとに共通接続されている。キャパシタCの他方の電極と駆動トランジスタT4のソースとには、電源電位Vddが印加されている。パルス信号PLSがゲートに供給された制御トランジスタT5は、駆動トランジスタT4のドレインと有機EL素子OLEDのアノードとの間に設けられている。この有機EL素子OLEDのカソードには、電位Vssが印加されている。 The gate of the first switching transistor T1 is connected to the scanning line to which the scanning signal SEL is supplied, and the source thereof is connected to the data line X to which the data current Idata is supplied. The drain of the first switching transistor T1 is commonly connected to the source of the second switching transistor T2, the drain of the driving transistor T4, and the drain of the control transistor T5. Similarly to the first switching transistor T1, the gate of the second switching transistor T2 is connected to a scanning line to which the scanning signal SEL is supplied. The drain of the second switching transistor T2 is commonly connected to one electrode of the capacitor C and the gate of the driving transistor T4. A power supply potential Vdd is applied to the other electrode of the capacitor C and the source of the driving transistor T4. The control transistor T5 to which the pulse signal PLS is supplied to the gate is provided between the drain of the driving transistor T4 and the anode of the organic EL element OLED. A potential Vss is applied to the cathode of the organic EL element OLED.
図11は、本実施形態に係る画素2の駆動タイミングチャートである。上述した実施形態と同様、1垂直走査期間t0〜t2は、プログラミング期間t0〜t1と駆動期間t1〜t2とに分けられる。
FIG. 11 is a drive timing chart of the
まず、プログラミング期間t0〜t1では、画素2の選択によって、キャパシタCに対するデータの書き込みが行われる。タイミングt0において、走査信号SELがHレベルに立ち上がり、スイッチングトランジスタT1,T2が共にオンする。これにより、データ線Xと駆動トランジスタT4のドレインとが電気的に接続されるとともに、駆動トランジスタT4は、自己のゲートと自己のドレインとが電気的に接続されたダイオード接続となる。これにより、駆動トランジスタT4は、データ線Xより供給されたデータ電流Idataを自己のチャネルに流し、このデータ電流Idataに応じたゲート電圧Vgを自己のゲートに発生させる。駆動トランジスタT4のゲートに接続されたキャパシタCには、発生したゲート電圧Vgに応じた電荷が蓄積され、データが書き込まれる。このように、プログラミング期間t0〜t1において、駆動トランジスタT4は、キャパシタCにデータを書き込むプログラミングトランジスタとして機能する。
First, in the programming period t0 to t1, data is written to the capacitor C by selecting the
プログラミング期間t0〜t1では、パルス信号PLSがLレベルに維持されているため、制御トランジスタT5はオフのままである。したがって、有機EL素子OLEDに対する駆動電流Ioledの電流経路が遮断され続けるため、この期間t0〜t1において、有機EL素子OLEDは発光しない。 In the programming period t0 to t1, since the pulse signal PLS is maintained at the L level, the control transistor T5 remains off. Accordingly, since the current path of the drive current Ioled to the organic EL element OLED is continuously cut off, the organic EL element OLED does not emit light during this period t0 to t1.
つぎに、駆動期間t1〜t2では、キャパシタCに蓄積された電荷に応じた駆動電流Ioledが有機EL素子OLEDを流れ、有機EL素子OLEDが発光する。まず、駆動開始タイミングt1において、走査信号SELがLレベルに立ち下がり、スイッチングトランジスタT1,T2が共にオフする。これにより、データ電流Idataが供給されたデータ線Xと駆動トランジスタT4のドレインとが電気的に分離され、駆動トランジスタT4のゲートとドレインとの間も電気的に分離される。駆動トランジスタT4のゲートには、キャパシタCの蓄積電荷に応じて、ゲート電圧Vg相当が印加される。 Next, in the driving period t1 to t2, the driving current Ioled corresponding to the electric charge accumulated in the capacitor C flows through the organic EL element OLED, and the organic EL element OLED emits light. First, at the drive start timing t1, the scanning signal SEL falls to the L level, and both the switching transistors T1 and T2 are turned off. As a result, the data line X supplied with the data current Idata and the drain of the driving transistor T4 are electrically isolated, and the gate and drain of the driving transistor T4 are also electrically isolated. A gate voltage Vg equivalent is applied to the gate of the driving transistor T4 in accordance with the charge stored in the capacitor C.
タイミングt1における走査信号SELの立ち下がりと同期して、それ以前はLレベルだったパルス信号PLSは、パルス波形へと変化する。このパルス波形は、画素2の次の選択が開始されるタイミングt2に至るまで継続される。これにより、パルス信号PLSによって導通制御される制御トランジスタT5は、オンとオフとを交互に繰り返すことになる。制御トランジスタT5がオンの場合、駆動電流Ioledの電流経路が形成されるため、有機EL素子OLEDは、駆動電流Ioledに応じた輝度で発光する。一方、制御トランジスタT5がオフの場合、駆動電流Ioledの電流経路が制御トランジスタT5によって強制的に遮断される。このような制御トランジスタT5の導通制御を通じて、駆動電流Ioledの電流経路の遮断が繰り返されるため、有機EL素子OLEDの発光と非発光とが複数回行われる。
In synchronization with the fall of the scanning signal SEL at the timing t1, the pulse signal PLS, which was at the L level before, changes to a pulse waveform. This pulse waveform is continued until the timing t2 when the next selection of the
このように、本実施形態によれば、上述した実施形態と同様に、画素2の光学応答をインパルス型に近づけることができ、かつ、黒表示を分散させることによって、表示画像のちらつきの低減を図ることができる。その結果、表示品質の一層の向上を図ることができる。
As described above, according to the present embodiment, the optical response of the
(第4の実施形態)
本実施形態は、電圧プログラム方式における画素回路の構成に係り、特に、CC(Conductance Control)法と呼ばれるものに関する。ここで、「電圧プログラム方式」とは、データ線Xに対するデータの供給を電圧ベースで行う方式をいう。本実施形態において、1つの水平ラインYは、走査信号SELが供給される1本の走査線と、パルス信号PLSが供給される1本の信号線とによって構成されている。電圧プログラム方式では、データ電圧Vdataをデータ線Xにそのまま出力する関係上、データ線駆動回路4に可変電流源を設ける必要はない。
(Fourth embodiment)
The present embodiment relates to a configuration of a pixel circuit in a voltage program system, and particularly relates to what is called a CC (Conductance Control) method. Here, the “voltage programming method” refers to a method of supplying data to the data line X on a voltage basis. In the present embodiment, one horizontal line Y is composed of one scanning line to which the scanning signal SEL is supplied and one signal line to which the pulse signal PLS is supplied. In the voltage programming method, it is not necessary to provide a variable current source in the data
図12は、本実施形態に係る画素2の回路図である。1つの画素2は、有機EL素子OLED、3つのトランジスタT1,T4,T5およびキャパシタCによって構成されている。なお、本実施形態に係る画素回路では、トランジスタT1,T4,T5のタイプはすべてnチャネル型であるが、これは一例であって、本発明はこれに限定されるものではない。
FIG. 12 is a circuit diagram of the
スイッチングトランジスタT1のゲートは、走査信号SELが供給される走査線に接続され、そのドレインは、データ電圧Vdataが供給されるデータ線Xに接続されている。スイッチングトランジスタT1のソースは、キャパシタCの一方の電極と、駆動トランジスタT4のゲートとに共通接続されている。キャパシタCの他方の電極には電位Vssが印加されており、駆動トランジスタT4のドレインには電源電位Vddが印加されている。制御トランジスタT5は、パルス信号PLSによって導通制御され、そのソースは、有機EL素子OLEDのアノードに接続されている。この有機EL素子OLEDのカソードには、電位Vssが印加されている。 The gate of the switching transistor T1 is connected to the scanning line to which the scanning signal SEL is supplied, and the drain is connected to the data line X to which the data voltage Vdata is supplied. The source of the switching transistor T1 is commonly connected to one electrode of the capacitor C and the gate of the driving transistor T4. A potential Vss is applied to the other electrode of the capacitor C, and a power supply potential Vdd is applied to the drain of the driving transistor T4. The conduction of the control transistor T5 is controlled by the pulse signal PLS, and its source is connected to the anode of the organic EL element OLED. A potential Vss is applied to the cathode of the organic EL element OLED.
図13は、本実施形態に係る画素2の駆動タイミングチャートである。まず、タイミングt0において、走査線SELがHレベルに立ち上がり、スイッチングトランジスタT1がオンする。これにより、データ線Xに供給されたデータ電圧Vdataが、スイッチングトランジスタT1を介して、キャパシタCの一方の電極に印加され、データ電圧Vdata相当の電荷がキャパシタCに蓄積される(データの書き込み)。なお、タイミングt0からタイミングt1までの期間において、パルス信号PLSはLレベルに維持されるため、制御トランジスタT5はオフのままである。したがって、有機EL素子OLEDに対する駆動電流Ioledの電流経路が遮断されるため、前半の期間t0〜t1において、有機EL素子OLEDは発光しない。
FIG. 13 is a drive timing chart of the
前半の期間t0〜t1に続く後半の期間t1〜t2では、キャパシタCに蓄積された電荷に応じた駆動電流Ioledが有機EL素子OLEDを流れ、有機EL素子OLEDが発光する。タイミングt1では、走査信号SELがLレベルに立ち下がり、スイッチングトランジスタT1がオフする。これにより、キャパシタCの一方の電極に対するデータ電圧Vdataの印加が停止するが、キャパシタCの蓄積電荷によって、駆動トランジスタT4のゲートにはゲート電圧Vg相当が印加される。 In the second half period t1 to t2 following the first half period t0 to t1, the drive current Ioled corresponding to the charge accumulated in the capacitor C flows through the organic EL element OLED, and the organic EL element OLED emits light. At timing t1, the scanning signal SEL falls to the L level, and the switching transistor T1 is turned off. As a result, the application of the data voltage Vdata to one electrode of the capacitor C is stopped, but the gate voltage Vg equivalent is applied to the gate of the drive transistor T4 by the accumulated charge of the capacitor C.
タイミングt1における走査信号SELの立ち下がりと同期して、それ以前はLレベルだったパルス信号PLSは、パルス波形へと変化する。このパルス波形は、画素2の次の選択が開始されるタイミングt2に至るまで継続される。このような制御トランジスタT5の導通制御を通じて、駆動電流Ioledの電流経路の遮断が複数回行われるため、有機EL素子OLEDの発光と非発光とが繰り返される。
In synchronization with the fall of the scanning signal SEL at the timing t1, the pulse signal PLS, which was at the L level before, changes to a pulse waveform. This pulse waveform is continued until the timing t2 when the next selection of the
このように、本実施形態によれば、上述した実施形態と同様に、画素2の光学応答をインパルス型に近づけることができ、かつ、黒表示を分散させることによって、表示画像のちらつきの低減を図ることができる。その結果、表示品質の一層の向上を図ることができる。なお、本実施形態において、パルス信号PLSの波形をパルス状にする開始タイミングは、走査信号SELの立ち下がりタイミングt1と同じでもよいが、特に低階調データの書き込みの安定性を考慮するならば、これよりも所定の時間だけ早く設定してもよい。
As described above, according to the present embodiment, the optical response of the
(第5の実施形態)
本実施形態は、電圧プログラム方式の画素回路を駆動する画素回路の構成に関する。本実施形態において、1つの水平ラインYは、第1の走査信号および第2の走査信号がそれぞれ供給される2本の走査線と、パルス信号PLSが供給される1本の信号線とによって構成されている。
(Fifth embodiment)
The present embodiment relates to a configuration of a pixel circuit that drives a voltage-programmed pixel circuit. In the present embodiment, one horizontal line Y is constituted by two scanning lines to which the first scanning signal and the second scanning signal are respectively supplied, and one signal line to which the pulse signal PLS is supplied. Has been.
図14は、本実施形態に係る画素2の回路図である。1つの画素2は、有機EL素子OLED、4つのトランジスタT1,T2,T4,T5および2つのキャパシタC1,C2によって構成されている。なお、本実施形態に係る画素回路では、トランジスタT1,T2,T4,T5のタイプがすべてpチャネル型であるが、これは一例であって、本発明はこれに限定されるものではない。
FIG. 14 is a circuit diagram of the
第1のスイッチングトランジスタT1のゲートは、走査信号SELが供給される走査線が接続され、そのソースは、データ電圧Vdataが供給されるデータ線Xに接続されている。第1のスイッチングトランジスタT1のドレインは、第1のキャパシタC1の一方の電極に接続されている。また、第1のキャパシタC1の他方の電極は、第2のキャパシタC2の一方の電極と、第2のスイッチングトランジスタT2のソースと、駆動トランジスタT4のゲートとに共通接続されている。第2のキャパシタC2の他方の電極と駆動トランジスタT4のソースとには、電源電位Vddが印加されている。第2のスイッチングトランジスタT2のゲートには第2の走査信号SEL2が供給され、そのドレインは、駆動トランジスタT4のドレインと制御トランジスタT5のソースとに共通接続されている。パルス信号PLSがゲートに供給された制御トランジスタT5は、駆動トランジスタT4のドレインと有機EL素子OLEDのアノードとの間に設けられている。この有機EL素子OLEDのカソードには、電位Vssが印加されている。 The gate of the first switching transistor T1 is connected to the scanning line to which the scanning signal SEL is supplied, and the source is connected to the data line X to which the data voltage Vdata is supplied. The drain of the first switching transistor T1 is connected to one electrode of the first capacitor C1. The other electrode of the first capacitor C1 is commonly connected to one electrode of the second capacitor C2, the source of the second switching transistor T2, and the gate of the driving transistor T4. A power supply potential Vdd is applied to the other electrode of the second capacitor C2 and the source of the driving transistor T4. A second scanning signal SEL2 is supplied to the gate of the second switching transistor T2, and its drain is commonly connected to the drain of the driving transistor T4 and the source of the control transistor T5. The control transistor T5 to which the pulse signal PLS is supplied to the gate is provided between the drain of the driving transistor T4 and the anode of the organic EL element OLED. A potential Vss is applied to the cathode of the organic EL element OLED.
図15は、本実施形態に係る画素2の駆動タイミングチャートである。1垂直走査期間t0〜t4は、期間t0〜t1と、オートゼロ期間t1〜t2と、ロードデータ期間t2〜t3と、駆動期間t3〜t4とに分けられる。
FIG. 15 is a drive timing chart of the
まず、期間t0〜t1において、駆動トランジスタT4のドレインの電位が電位Vssに設定される。具体的には、タイミングt0において、第1および第2の走査信号SEL1,SEL2が共にLレベルに立ち下がって、第1および第2のスイッチングトランジスタT1,T2が共にオンする。この期間t0〜t1では、データ線Xに対して電源電位Vddが固定的に印加されているため、第1のキャパシタC1の一方の電極には電源電位Vddが印加される。また、この期間t0〜t1では、パルス信号PLSがLレベルに維持されているため、制御トランジスタT5がオンする。これにより、制御トランジスタT5と有機EL素子OLEDとを介した電流経路が形成され、駆動トランジスタT4のドレイン電位が電位Vssとなる。したがって、駆動トランジスタT4のソースを基準としたゲート電圧Vgsがマイナスになって、駆動トランジスタT4がオンする。 First, in the period t0 to t1, the drain potential of the drive transistor T4 is set to the potential Vss. Specifically, at timing t0, the first and second scanning signals SEL1, SEL2 both fall to L level, and both the first and second switching transistors T1, T2 are turned on. In this period t0 to t1, since the power supply potential Vdd is fixedly applied to the data line X, the power supply potential Vdd is applied to one electrode of the first capacitor C1. Further, during this period t0 to t1, since the pulse signal PLS is maintained at the L level, the control transistor T5 is turned on. As a result, a current path is formed through the control transistor T5 and the organic EL element OLED, and the drain potential of the drive transistor T4 becomes the potential Vss. Therefore, the gate voltage Vgs with respect to the source of the drive transistor T4 becomes negative, and the drive transistor T4 is turned on.
つぎに、オートゼロ期間t1〜t2において、駆動トランジスタT4のゲート電圧Vgsが閾値電圧Vthになる。この期間t1〜t2では、走査信号SEL1,SEL2は共にLレベルなので、スイッチングトランジスタT1,T2のオン状態が維持される。タイミングt1において、パルス信号PLSがHレベルに立ち上がり、制御トランジスタT5がオフになるが、第1のキャパシタC1の一方の電極には、データ線からの電源電位Vddの印加が継続される。駆動トランジスタT4のゲートには、自己のチャネルと第2のスイッチングトランジスタT2とを介して、自己のソースに印加された電源電位Vddが印加される。これにより、駆動トランジスタT4のゲート間電圧Vgsは、自己の閾値電圧Vthまで押し上げられ、ゲート電圧Vgsが閾値電圧Vthになった時点で、駆動トランジスタT4がオフになる。その結果、駆動トランジスタT4のゲートに接続された2つのキャパシタC1,C2の電極には、それぞれ閾値電圧Vthが印加されることになる。一方、キャパシタC1,C2の対向する電極には、データ線Xからの電源電位Vddが印加されているので、それぞれのキャパシタC1,C2の電位差は、電源電位Vddと閾値電圧Vthとの差(Vdd−Vth)に設定される(オートゼロ)。 Next, in the auto-zero period t1 to t2, the gate voltage Vgs of the drive transistor T4 becomes the threshold voltage Vth. During this period t1 to t2, since the scanning signals SEL1 and SEL2 are both at the L level, the switching transistors T1 and T2 are kept on. At timing t1, the pulse signal PLS rises to H level and the control transistor T5 is turned off, but the application of the power supply potential Vdd from the data line is continued to one electrode of the first capacitor C1. The power supply potential Vdd applied to the source of the drive transistor T4 is applied to the gate of the drive transistor T4 through the channel of the drive transistor T4 and the second switching transistor T2. As a result, the gate voltage Vgs of the drive transistor T4 is pushed up to its own threshold voltage Vth, and the drive transistor T4 is turned off when the gate voltage Vgs reaches the threshold voltage Vth. As a result, the threshold voltage Vth is applied to the electrodes of the two capacitors C1 and C2 connected to the gate of the driving transistor T4. On the other hand, since the power supply potential Vdd from the data line X is applied to the opposing electrodes of the capacitors C1 and C2, the potential difference between the capacitors C1 and C2 is the difference between the power supply potential Vdd and the threshold voltage Vth (Vdd). -Vth) (auto zero).
続くロードデータ期間t2〜t3において、オートゼロに設定されたキャパシタC1,C2に対するデータの書き込みが行われる。この期間t2〜t3において、第1の走査信号SEL1は、それ以前と同様にLレベルに維持され、パルス信号PLSも、それ以前と同様にHレベルに維持されている。したがって、第1のスイッチングトランジスタT1はオンしたままであり、制御トランジスタT5はオフしたままである。しかしながら、タイミングt2において、第2の走査信号SEL2がHレベルに立ち上がるため、第2のスイッチングトランジスタT2がオンからオフに変化する。また、データ電圧Vdataとして、従前の電源電位VddからΔVdataだけ低下させた電圧レベルがデータ線Xに印加される。変化量ΔVdataは、画素2に書き込むデータに応じた可変値であり、これにより、第1のキャパシタC1の電位差が低下する。このように第1のキャパシタC1の電位差を変化させると、キャパシタC1,C2の容量分割の関係に従い、第2のキャパシタC2の電位差も変化する。変化後の各キャパシタC1,C2の電位差は、オートゼロ期間t1〜t2での電位差(Vdd−Vth)から変化量ΔVdata相当を差し引いた値によって決まる。変化量ΔVdataに起因したキャパシタC1,C2の電位差の変化によって、それぞれのキャパシタC1,C2に対してデータが書き込まれる。
In the subsequent load data period t2 to t3, data is written to the capacitors C1 and C2 set to auto zero. During this period t2 to t3, the first scanning signal SEL1 is maintained at the L level as before, and the pulse signal PLS is also maintained at the H level as before. Therefore, the first switching transistor T1 remains on and the control transistor T5 remains off. However, since the second scanning signal SEL2 rises to the H level at the timing t2, the second switching transistor T2 changes from on to off. In addition, a voltage level that is reduced by ΔVdata from the previous power supply potential Vdd is applied to the data line X as the data voltage Vdata. The change amount ΔVdata is a variable value corresponding to the data written to the
最後に、駆動期間t3〜t4において、第2のキャパシタC2に蓄積された電荷に応じた駆動電流Ioledが有機EL素子OLEDを流れ、有機EL素子OLEDが発光する。タイミングt3において、第1の走査信号SEL1がHレベルに立ち上がり、第1のスイッチングトランジスタT1がオンからオフに変化する(第2のスイッチングトランジスタT2はオフのままである)。また、データ線Xの電圧は、電源電位Vddへと復帰する。これにより、データ電源電位Vddが印加されたデータ線Xと第1のキャパシタC1の一方の電極とが分離されるとともに、駆動トランジスタT4のゲートとドレインとの間も分離される。したがって、駆動トランジスタT4のゲートには、第2のキャパシタC2の蓄積電荷に応じた電圧(ソースを基準としたゲート電圧Vgs)が印加される。なお、駆動トランジスタT4を流れる電流Ids(駆動電流Ioledに相当)の算出式には、駆動トランジスタT4の閾値電圧Vthとゲート電圧Vgsとが変数として含まれる。しかしながら、ゲート電圧Vgsとして、第2のキャパシタC2の電位差(Vgsに相当)を代入した場合、駆動電流Ioledの算出式において、閾値電圧Vthが相殺される。その結果、駆動電流Ioledは、駆動トランジスタT4の閾値電圧Vthの影響を受けることなく、データ電圧の変化量ΔVdataのみに依存することになる。 Finally, in the driving period t3 to t4, the driving current Ioled corresponding to the electric charge accumulated in the second capacitor C2 flows through the organic EL element OLED, and the organic EL element OLED emits light. At timing t3, the first scanning signal SEL1 rises to the H level, and the first switching transistor T1 changes from on to off (the second switching transistor T2 remains off). In addition, the voltage of the data line X returns to the power supply potential Vdd. As a result, the data line X to which the data power supply potential Vdd is applied is separated from one electrode of the first capacitor C1, and the gate and drain of the driving transistor T4 are also separated. Therefore, a voltage (gate voltage Vgs with reference to the source) corresponding to the charge stored in the second capacitor C2 is applied to the gate of the driving transistor T4. The calculation formula for the current Ids flowing through the drive transistor T4 (corresponding to the drive current Ioled) includes the threshold voltage Vth and the gate voltage Vgs of the drive transistor T4 as variables. However, when the potential difference (corresponding to Vgs) of the second capacitor C2 is substituted as the gate voltage Vgs, the threshold voltage Vth is canceled out in the calculation formula of the drive current Ioled. As a result, the drive current Ioled is not affected by the threshold voltage Vth of the drive transistor T4 and depends only on the data voltage change amount ΔVdata.
駆動電流Ioledの電流経路は、電源電位Vddから電位Vssに向かって、駆動トランジスタT4と制御トランジスタT5と有機EL素子OLEDとを介した経路となる。この駆動電流Ioledは、駆動トランジスタT4のチャネル電流に相当し、第2のキャパシタC2の蓄積電荷に起因したゲート電圧Vgsによって制御される。駆動期間t3〜t4では、上述した各実施形態と同様に、パルス信号PLSがパルス状になるため、この信号PLSによって導通制御される制御トランジスタT5は、オンとオフとを交互に繰り返す。その結果、駆動電流Ioledの電流経路の遮断が繰り返されるため、有機EL素子OLEDの発光と非発光とが交互に行われる。 The current path of the drive current Ioled is a path through the drive transistor T4, the control transistor T5, and the organic EL element OLED from the power supply potential Vdd to the potential Vss. This drive current Ioled corresponds to the channel current of the drive transistor T4 and is controlled by the gate voltage Vgs caused by the accumulated charge in the second capacitor C2. In the drive periods t3 to t4, the pulse signal PLS is pulsed as in the above-described embodiments. Therefore, the control transistor T5 that is conduction-controlled by this signal PLS repeats ON and OFF alternately. As a result, since the current path of the drive current Ioled is repeatedly interrupted, the organic EL element OLED emits light and does not emit light alternately.
このように、本実施形態において、制御トランジスタT5は、駆動期間t3〜t4において、駆動電流Ioledの電流経路の遮断を繰り返し、この駆動期間t3〜t4を除く期間t0〜t3において、駆動電流Ioledの電流経路を遮断し続ける。これにより、上述した実施形態と同様に、画素2の光学応答をインパルス型に近づけることができ、かつ、黒表示を分散させることによって、表示画像のちらつきの低減を図ることができる。その結果、表示品質の一層の向上を図ることができる。なお、本実施形態では、タイミングt4において、パルス信号PLSのパルス波形を終了しているが、特に低階調データの書き込みの安定性を考慮するならば、タイミングt4よりも所定の時間だけ早く終了させてもよい。
As described above, in the present embodiment, the control transistor T5 repeatedly cuts off the current path of the drive current Ioled in the drive periods t3 to t4, and the drive current Ioled in the periods t0 to t3 excluding the drive periods t3 to t4. Continue to interrupt the current path. Thereby, similarly to the above-described embodiment, the optical response of the
なお、上述した各実施形態では、電気光学素子として有機EL素子OLEDを用いた例について説明した。しかしながら、本発明はこれに限定されるものではなく、それ以外の、駆動電流に応じた輝度で発光する電気光学素子に対して適用可能である。 In each of the above-described embodiments, the example in which the organic EL element OLED is used as the electro-optical element has been described. However, the present invention is not limited to this, and can be applied to other electro-optical elements that emit light at a luminance corresponding to the drive current.
また、上述した各実施形態に係る電気光学装置は、例えば、プロジェクタ、携帯電話機、携帯端末、モバイル型コンピュータ、パーソナルコンピュータ等を含む様々な電子機器に実装可能である。これらの電子機器に上述した電気光学装置を実装すれば、電子機器の商品価値を一層高めることができ、市場における電子機器の商品訴求力の向上を図ることができる。 In addition, the electro-optical device according to each of the embodiments described above can be mounted on various electronic devices including, for example, a projector, a mobile phone, a mobile terminal, a mobile computer, a personal computer, and the like. When the above-described electro-optical device is mounted on these electronic devices, the commercial value of the electronic devices can be further increased, and the product appeal of electronic devices in the market can be improved.
1‥表示部 2‥画素 3‥走査線駆動回路 4‥データ線駆動回路 5‥制御回路
T1 ‥第1のスイッチングトランジスタ T2 ‥第2のスイッチングトランジスタ
T3 ‥プログラミングトランジスタ T4 ‥駆動トランジスタ
T5 ‥制御トランジスタ T6 ‥第2の制御トランジスタ C ‥キャパシタ C1 ‥第1のキャパシタ C2 ‥第2のキャパシタ OLED‥有機EL素子
DESCRIPTION OF
Claims (15)
複数の走査線と、
複数のデータ線と、
前記走査線と前記データ線との交差に対応して配置された複数の画素と、
表示階調を示すデータの書込対象となる画素に対応する前記走査線を選択するとともに、前記走査信号と同期したパルス信号を出力する走査線駆動回路と、
前記走査線駆動回路と協働し、前記書込対象となる画素に対応する前記データ線にデータ電圧を出力するデータ線駆動回路とを有し、
前記画素のそれぞれは、
前記データ線に接続され、前記走査信号によって制御されるスイッチングトランジスタと、
前記スイッチングトランジスタに接続され、前記データ電圧に応じた電荷を蓄積するキャパシタと、
前記キャパシタに蓄積された電荷に応じて、駆動電流を設定する駆動トランジスタと、
前記駆動電流に応じた輝度で発光する電気光学素子と、
前記書込対象となる画素に対応する前記走査線が選択されてから、当該走査線が次に選択されるまでの期間において、前記走査信号と同期した前記パルス信号に応じて、前記駆動電流の電流経路の導通と遮断を繰り返す制御トランジスタと
を有することを特徴とする電気光学装置。 In an electro-optical device,
A plurality of scan lines;
Multiple data lines,
A plurality of pixels arranged corresponding to intersections of the scanning lines and the data lines;
A scanning line driving circuit that selects the scanning line corresponding to a pixel to be written with data indicating display gradation and outputs a pulse signal synchronized with the scanning signal;
A data line driving circuit that cooperates with the scanning line driving circuit and outputs a data voltage to the data line corresponding to the pixel to be written;
Each of the pixels
A switching transistor connected to the data line and controlled by the scanning signal;
A capacitor connected to the switching transistor and storing a charge corresponding to the data voltage;
A driving transistor for setting a driving current according to the electric charge accumulated in the capacitor;
An electro-optical element that emits light at a luminance corresponding to the drive current;
In the period from when the scanning line corresponding to the pixel to be written is selected until the next scanning line is selected, the drive current is changed according to the pulse signal synchronized with the scanning signal. An electro-optical device comprising: a control transistor that repeats conduction and interruption of a current path.
複数の走査線と、
複数のデータ線と、
前記走査線と前記データ線との交差に対応して配置された複数の画素と、
表示階調を示すデータの書込対象となる画素に対応する前記走査線を選択するとともに、前記第1の走査信号と同期した第2の走査信号と、前記第1の走査信号と同期したパルス信号とを出力する走査線駆動回路と、
前記走査線駆動回路と協働し、前記書込対象となる画素に対応する前記データ線に表示階調に相当する大きさのデータ電圧を出力するデータ線駆動回路とを有し、
前記画素のそれぞれは、
ソースまたはドレインの一方の端子が前記データ線に接続され、前記第1の走査信号によって制御される第1のスイッチングトランジスタと、
一方の電極が前記第1のスイッチングトランジスタの他方の端子に接続された第1のキャパシタと、
一方の電極に電源電位が印加された第2のキャパシタと、
ソースまたはドレインの一方の端子が前記第1のキャパシタの前記他方の電極と前記第2のキャパシタの前記他方の電極とに共通接続され、前記第2の走査信号によって制御される第2のスイッチングトランジスタと、
ゲートが前記第2のスイッチングトランジスタの前記一方の端子と前記第1のキャパシタの前記他方の端子と前記第2のキャパシタの前記他方の端子とに共通接続され、ソースに前記第2のキャパシタの前記一方の電極が接続され、ドレインに前記第2のスイッチングトランジスタの他方の端子が接続され、前記データ電圧に応じた電荷を前記第2のキャパシタに蓄積させるとともに、前記第2のキャパシタに蓄積された電荷に応じて、駆動電流を設定する駆動トランジスタと、
前記駆動電流に応じた輝度で発光する電気光学素子と、
前記書込対象となる画素に対応する前記走査線が選択されてから、当該走査線が次に選択されるまでの期間において、前記第1のキャパシタと前記第2のキャパシタの容量結合を利用して前記駆動トランジスタのゲート・ソース間電圧を調整した後に、前記第1の走査信号と同期した前記パルス信号に応じて、前記駆動電流の電流経路の導通と遮断を繰り返す制御トランジスタと
を有することを特徴とする電気光学装置。 In an electro-optical device,
A plurality of scan lines;
Multiple data lines,
A plurality of pixels arranged corresponding to intersections of the scanning lines and the data lines;
A second scanning signal synchronized with the first scanning signal and a pulse synchronized with the first scanning signal are selected while the scanning line corresponding to a pixel to be written with data indicating display gradation is selected. A scanning line driving circuit for outputting a signal;
A data line driving circuit that cooperates with the scanning line driving circuit and outputs a data voltage having a magnitude corresponding to a display gradation to the data line corresponding to the pixel to be written;
Each of the pixels
A first switching transistor having one source or drain terminal connected to the data line and controlled by the first scanning signal;
A first capacitor having one electrode connected to the other terminal of the first switching transistor;
A second capacitor having a power supply potential applied to one of the electrodes;
A second switching transistor in which one terminal of a source or a drain is commonly connected to the other electrode of the first capacitor and the other electrode of the second capacitor, and is controlled by the second scanning signal When,
A gate is commonly connected to the one terminal of the second switching transistor, the other terminal of the first capacitor, and the other terminal of the second capacitor, and a source of the second capacitor is connected to the second capacitor. One electrode is connected, the other terminal of the second switching transistor is connected to the drain, and electric charges corresponding to the data voltage are accumulated in the second capacitor and accumulated in the second capacitor. A drive transistor that sets a drive current according to the charge; and
An electro-optical element that emits light at a luminance corresponding to the drive current;
Capacitive coupling between the first capacitor and the second capacitor is used in a period from when the scanning line corresponding to the pixel to be written is selected until the next scanning line is selected. And a control transistor that repeatedly turns on and off the current path of the drive current in accordance with the pulse signal synchronized with the first scanning signal after adjusting the gate-source voltage of the drive transistor. Electro-optical device characterized.
前記書込対象となる画素に対応する前記データ線にデータ電圧を出力する第1のステップと、
前記書込対象となる前記画素が有する第1のキャパシタと第2のキャパシタに、前記データ線に供給された前記データ電圧に応じてデータの書き込みを行う第2のステップと、前記書込対象となる画素が有する駆動トランジスタによって、前記第2のキャパシタに蓄積された電荷に応じた駆動電流を設定し、当該駆動電流を、電気光学素子に供給する第3のステップと、
前記書込対象となる画素に対応する前記走査線が選択されてから、当該走査線が次に選択されるまでの期間において、前記走査信号に同期して前記駆動電流の電流経路の導通と遮断を繰り返す第4のステップ
とを有することを特徴とする電気光学装置の駆動方法。 A plurality of pixels arranged corresponding to intersections of the scanning lines and the data lines, a scanning line driving circuit for selecting the scanning lines corresponding to pixels to which data indicating display gradation is to be written, and the writing In a driving method of an electro-optical device having a data line driving circuit that outputs a data voltage to the data line corresponding to a pixel to be embedded,
A first step of outputting a data voltage to the data line corresponding to the pixel to be written;
A second step of writing data to the first capacitor and the second capacitor of the pixel to be written in accordance with the data voltage supplied to the data line; and A third step of setting a driving current corresponding to the electric charge accumulated in the second capacitor by a driving transistor included in the pixel, and supplying the driving current to the electro-optical element;
In the period from when the scanning line corresponding to the pixel to be written is selected until the scanning line is next selected, the current path of the drive current is turned on and off in synchronization with the scanning signal. And a fourth step of repeating the above. A method for driving an electro-optical device.
15. The method of driving an electro-optical device according to claim 14, wherein the repetition of conduction and interruption of the current path of the drive current is ended earlier by a predetermined time than when the scanning line is next selected.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2007312127A JP4412398B2 (en) | 2007-12-03 | 2007-12-03 | Electro-optical device, driving method of electro-optical device, and electronic apparatus |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2007312127A JP4412398B2 (en) | 2007-12-03 | 2007-12-03 | Electro-optical device, driving method of electro-optical device, and electronic apparatus |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2005299754A Division JP4075922B2 (en) | 2005-10-14 | 2005-10-14 | Electro-optical device, driving method of electro-optical device, and electronic apparatus |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2008083727A true JP2008083727A (en) | 2008-04-10 |
JP4412398B2 JP4412398B2 (en) | 2010-02-10 |
Family
ID=39354597
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2007312127A Expired - Fee Related JP4412398B2 (en) | 2007-12-03 | 2007-12-03 | Electro-optical device, driving method of electro-optical device, and electronic apparatus |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP4412398B2 (en) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP2105746A2 (en) | 2008-03-27 | 2009-09-30 | Fuji Jukogyo Kabushiki Kaisha | Method for measuring the turbulence intensity of a horizontal axis wind turbine |
US7953132B2 (en) | 2008-09-08 | 2011-05-31 | Funai Electric Co., Ltd. | Laser driver circuit and laser display |
US10290249B2 (en) | 2015-01-27 | 2019-05-14 | Seiko Epson Corporation | Driver, electro-optical apparatus, and electronic device |
US10417963B2 (en) | 2017-03-16 | 2019-09-17 | Seiko Epson Corporation | Electro-optical apparatus, electronic apparatus, and method for driving electro-optical apparatus |
CN113948032A (en) * | 2021-02-03 | 2022-01-18 | 友达光电股份有限公司 | Pixel circuit and driving method thereof |
-
2007
- 2007-12-03 JP JP2007312127A patent/JP4412398B2/en not_active Expired - Fee Related
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP2105746A2 (en) | 2008-03-27 | 2009-09-30 | Fuji Jukogyo Kabushiki Kaisha | Method for measuring the turbulence intensity of a horizontal axis wind turbine |
US7953132B2 (en) | 2008-09-08 | 2011-05-31 | Funai Electric Co., Ltd. | Laser driver circuit and laser display |
US10290249B2 (en) | 2015-01-27 | 2019-05-14 | Seiko Epson Corporation | Driver, electro-optical apparatus, and electronic device |
US10417963B2 (en) | 2017-03-16 | 2019-09-17 | Seiko Epson Corporation | Electro-optical apparatus, electronic apparatus, and method for driving electro-optical apparatus |
CN113948032A (en) * | 2021-02-03 | 2022-01-18 | 友达光电股份有限公司 | Pixel circuit and driving method thereof |
CN113948032B (en) * | 2021-02-03 | 2023-09-29 | 友达光电股份有限公司 | Pixel circuit and driving method thereof |
Also Published As
Publication number | Publication date |
---|---|
JP4412398B2 (en) | 2010-02-10 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP3707484B2 (en) | Electro-optical device, driving method of electro-optical device, and electronic apparatus | |
KR100594834B1 (en) | Electro-optic apparatus, method of driving the same, and electronic instrument | |
JP4023335B2 (en) | Electro-optical device, driving method of electro-optical device, and electronic apparatus | |
KR100605347B1 (en) | Electro-optical device, method of driving the same, and electronic apparatus | |
JP4608999B2 (en) | Electronic circuit driving method, electronic circuit, electronic device, electro-optical device, electronic apparatus, and electronic device driving method | |
JP4075922B2 (en) | Electro-optical device, driving method of electro-optical device, and electronic apparatus | |
JP2005099715A (en) | Driving method of electronic circuit, electronic circuit, electronic device, electrooptical device, electronic equipment and driving method of electronic device | |
JP2006330664A (en) | Light emitting display device and driving method thereof | |
JP2014219516A (en) | Pixel circuit and method of driving the same | |
JP5162807B2 (en) | Electro-optical device and electronic apparatus | |
JP4636195B2 (en) | Electro-optical device and electronic apparatus | |
JP4412398B2 (en) | Electro-optical device, driving method of electro-optical device, and electronic apparatus | |
JP3966270B2 (en) | Pixel circuit driving method, electro-optical device, and electronic apparatus | |
JP2011022462A (en) | Display device, driving method therefor, and electronics device | |
JP2009048212A (en) | Electrooptical device, driving method of the electrooptical device, and electronic equipment | |
JP2004325885A (en) | Optoelectronic device, method for driving optoelectronic device, and electronic equipment | |
JP4107101B2 (en) | Electro-optical device, driving method of electro-optical device, and electronic apparatus | |
JP2014232195A (en) | Display device and drive method thereof | |
JP4655497B2 (en) | Pixel circuit driving method, pixel circuit, electro-optical device, and electronic apparatus | |
JP4821381B2 (en) | Electro-optical device and electronic apparatus |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20091027 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20091109 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121127 Year of fee payment: 3 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 4412398 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121127 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20131127 Year of fee payment: 4 |
|
S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
LAPS | Cancellation because of no payment of annual fees |