Nothing Special   »   [go: up one dir, main page]

EP2248401B1 - Verfahren zur herstellung von leiterplatten mit bestückten bauelementen - Google Patents

Verfahren zur herstellung von leiterplatten mit bestückten bauelementen Download PDF

Info

Publication number
EP2248401B1
EP2248401B1 EP08872793A EP08872793A EP2248401B1 EP 2248401 B1 EP2248401 B1 EP 2248401B1 EP 08872793 A EP08872793 A EP 08872793A EP 08872793 A EP08872793 A EP 08872793A EP 2248401 B1 EP2248401 B1 EP 2248401B1
Authority
EP
European Patent Office
Prior art keywords
substrate
chip
masking
plasma
coating
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Not-in-force
Application number
EP08872793A
Other languages
English (en)
French (fr)
Other versions
EP2248401A2 (de
Inventor
Michael Bisges
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Maschinenfabrik Reinhausen GmbH
Scheubeck GmbH and Co
Original Assignee
Maschinenfabrik Reinhausen GmbH
Maschinenfabrik Reinhausen Gebrueder Scheubeck GmbH and Co KG
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Maschinenfabrik Reinhausen GmbH, Maschinenfabrik Reinhausen Gebrueder Scheubeck GmbH and Co KG filed Critical Maschinenfabrik Reinhausen GmbH
Publication of EP2248401A2 publication Critical patent/EP2248401A2/de
Application granted granted Critical
Publication of EP2248401B1 publication Critical patent/EP2248401B1/de
Not-in-force legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/02Apparatus or processes for manufacturing printed circuits in which the conductive material is applied to the surface of the insulating support and is thereafter removed from such areas of the surface which are not intended for current conducting or shielding
    • H05K3/04Apparatus or processes for manufacturing printed circuits in which the conductive material is applied to the surface of the insulating support and is thereafter removed from such areas of the surface which are not intended for current conducting or shielding the conductive material being removed mechanically, e.g. by punching
    • H05K3/046Apparatus or processes for manufacturing printed circuits in which the conductive material is applied to the surface of the insulating support and is thereafter removed from such areas of the surface which are not intended for current conducting or shielding the conductive material being removed mechanically, e.g. by punching by selective transfer or selective detachment of a conductive layer
    • H05K3/048Apparatus or processes for manufacturing printed circuits in which the conductive material is applied to the surface of the insulating support and is thereafter removed from such areas of the surface which are not intended for current conducting or shielding the conductive material being removed mechanically, e.g. by punching by selective transfer or selective detachment of a conductive layer using a lift-off resist pattern or a release layer pattern
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/10Details of components or other objects attached to or integrated in a printed circuit board
    • H05K2201/10613Details of electrical connections of non-printed components, e.g. special leads
    • H05K2201/10621Components characterised by their electrical contacts
    • H05K2201/10689Leaded Integrated Circuit [IC] package, e.g. dual-in-line [DIL]
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2203/00Indexing scheme relating to apparatus or processes for manufacturing printed circuits covered by H05K3/00
    • H05K2203/02Details related to mechanical or acoustic processing, e.g. drilling, punching, cutting, using ultrasound
    • H05K2203/0264Peeling insulating layer, e.g. foil, or separating mask
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2203/00Indexing scheme relating to apparatus or processes for manufacturing printed circuits covered by H05K3/00
    • H05K2203/09Treatments involving charged particles
    • H05K2203/095Plasma, e.g. for treating a substrate to improve adhesion with a conductor or for cleaning holes
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2203/00Indexing scheme relating to apparatus or processes for manufacturing printed circuits covered by H05K3/00
    • H05K2203/13Moulding and encapsulation; Deposition techniques; Protective layers
    • H05K2203/1333Deposition techniques, e.g. coating
    • H05K2203/1344Spraying small metal particles or droplets of molten metal
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2203/00Indexing scheme relating to apparatus or processes for manufacturing printed circuits covered by H05K3/00
    • H05K2203/14Related to the order of processing steps
    • H05K2203/1461Applying or finishing the circuit pattern after another process, e.g. after filling of vias with conductive paste, after making printed resistors
    • H05K2203/1469Circuit made after mounting or encapsulation of the components

Definitions

  • the invention relates to a method for producing printed circuit boards with at least one populated electronic component having two or more contacts, in particular a method for producing RFID labels.
  • An RFID tag consists of a carrier foil, an antenna structure and a chip connected to the antenna. The entire arrangement is provided on a carrier substrate.
  • An RFID tag of the type mentioned is for example from the US 7,102,520 B2 known. There is described such an arrangement in which on one side of the chip, a circumferential, multi-layer antenna structure is provided, which is in communication with a chip. In order to reduce the thickness of the entire assembly, the chip is arranged in a recess.
  • Another generic RFID label is from the WO 2006/057820 known. Again, a substrate is provided which forms the antenna structure and on which a chip is arranged to conduct.
  • a first disadvantage is that so far the production of the antenna structure and the chip contacting take place as separate, successive operating steps.
  • the positioning speed is limited and a high positioning accuracy can only be achieved with great technological effort.
  • the object of the invention is to avoid the disadvantages of the known technologies and a uniform method both for the production of printed conductors, d. H. conductive geometrical structures, for example in RFIDs of the antenna structure, as well as the electrical connection of the component or the components with this specify, are produced at high coating rates finely structured, purely metallic structures in the required layer thickness of 1 to 100 microns on temperature-sensitive substrates can.
  • the component to be contacted later with the conductor or antenna structure to be contacted is fixed on the substrate before the masking.
  • a negative masking of the conductor or antenna structure to be generated is subsequently printed.
  • the printing inks used are in particular uncrosslinked, d. H. oils, waxes and short chain polymers can be used.
  • a full-area metal layer is applied to the entire surface of the substrate by a plasma coating process.
  • plasma coating are particularly suitable plasma barrier discharges, in which a cold plasma is generated, which does not damage the temperature-sensitive substrate surface.
  • the contacts of the component or chip are also over-metallized in the method according to the invention and thus connected.
  • the negative mask including the metal layer lying thereon is removed and removed. This is particularly advantageous by peeling. This leaves only the metal structures directly on the Substrate have built adhesion, ie the conductor or antenna structure. On this conductor or antenna structure also remains the already finished contacted component.
  • the method can also be used for the production of conductive structures on both sides of the substrate by the substrate is rotated and the corresponding method steps or parts thereof are repeated analogously.
  • the inventive method has a number of advantages over the prior art: a high electrical conductivity of the conductor or antenna structure can be achieved; Depending on the type of contact and substrate, numerous metals such as copper, aluminum, zinc, nickel, tin and alloys thereof are freely selectable. Furthermore, the method allows high layer thicknesses of the generated conductive structures, whereby 3-D contours and vias are possible. Furthermore, the method allows, as already explained above, at the same time also the contacting of components or chips.
  • FIG. 1 the process of the invention is shown. It is assumed that a substrate on which an electronic component with at least two spatially separated contacts on one side A is first attached. This is the already mentioned chip of the RFID.
  • this side by plasma coating.
  • this completely coated side A is treated by a slug puller, preferably a pressure-sensitive adhesive tape, wherein the negative mask, including the metal layer lying thereon, is detached and removed. This is done particularly advantageously by peeling, wherein the pressure-sensitive adhesive tape is unrolled on the substrate surface.
  • a structure is also to be generated on the back of the substrate in order to produce HF RFID, for example, the steps from negative masking to detachment by means of a slug puller are repeated after rotating the substrate on its backside.
  • plasma coating for example those in which a direct arc discharge is generated.
  • plasmas generated by direct arc discharge have a significantly higher temperature, which can be problematic for sensitive substrates.

Landscapes

  • Engineering & Computer Science (AREA)
  • Manufacturing & Machinery (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Manufacturing Of Printed Wiring (AREA)
  • Electric Connection Of Electric Components To Printed Circuits (AREA)
  • Combinations Of Printed Boards (AREA)
  • Details Of Aerials (AREA)

Abstract

Die Erfindung betrifft ein Verfahren zur Herstellung von Leiterplatten mit kontaktierten Bauteilen, wobei zunächst das spater zu kontaktierende Bauteil auf einem Substrat fixiert wird, nachfolgend die Negativ-Struktur einer aufzubringenden metallischen Antennenstruktur aufgebracht wird, wiederum nachfolgend die gesamte Substratoberflache mittels Plasmabeschichtung mit einem metallischen Überzug versehen wird und abschließend mittels Slug-Puller o. ä. die Negativ-Struktur einschließlich der darauf haftenden metallischen Beschichtung vom Substrat wieder entfernt wird.

Description

  • Die Erfindung betrifft ein Verfahren zur Herstellung von Leiterplatten mit mindestens einem bestückten elektronischen Bauteil mit zwei oder mehr Kontakten, insbesondere ein Verfahren zur Herstellung von RFID-Etiketten.
  • Ein RFID-Etikett besteht aus einer Trägerfolie, einer Antennenstruktur und einem mit der Antenne verbundenen Chip. Die gesamte Anordnung ist auf einem Trägersubstrat vorgesehen. Ein RFID-Etikett der genannten Art ist beispielsweise aus der US 7,102,520 B2 bekannt. Dort ist eine solche Anordnung beschrieben, bei der auf einer Seite des Chips eine umlaufende, mehrlagige Antennenstruktur vorgesehen ist, die mit einem Chip in Verbindung steht. Um die Dicke der gesamten Anordnung zu reduzieren, ist der Chip in einer Vertiefung angeordnet.
  • Ein weiteres gattungsgemäßes RFID-Etikett ist aus der WO 2006/057820 bekannt. Auch hier ist ein Substrat vorgesehen, der die Antennenstruktur bildet und auf dem ein Chip leitend angeordnet ist.
  • Zur Herstellung solcher RFID-Etiketten sind bisher zahlreiche unterschiedliche Verfahren bekannt und es wird beispielhaft auf die US 2006/0220877 A1 verwiesen. Zum einen ist es bekannt, zunächst separat die Antennen herzustellen, wobei in vielen Fällen ein Siebdruck mit metallischen Pasten, Silberpasten etwa, erfolgt. Weiterhin sind hierfür Ätzprozesse bekannt, bei denen Folienlaminate (PET/Kupfer) mit einem Ätzresist bedruckt werden, anschließend die Feinstrukturen weggeätzt werden und somit das Negativ stehen bleibt. Ebenfalls zur Herstellung solcher Antennenanordnungen mögliche Sputter-Prozesse werden bislang kaum eingesetzt, da die notwendige Dicke der zu erzielenden Leiterbahnen der Antenne im Bereich von 5 bis 30 µm liegt. Diese Schichtdicken sind mit der Sputter-Technologie nicht wirtschaftlich zu erzielen.
  • Für die nachfolgende separate Chip-Kontaktierung sind ebenfalls verschiedene Verfahren bekannt. Beim "Pick-and-place" wird mittels optischer Erkennung die Position für den Chip auf der bereits hergestellten Antenne detektiert und der Chip positioniert und aufgesetzt. Anschließend wird der elektrische Kontakt mittels Klebe- oder Lötverfahren hergestellt. Da sich die "Pick-and-place"-Technologie für die immer kleiner werdenden Chips als zunehmend problematisch erwiesen hat, wird versucht, die Kontaktierungsflächen an diesen miniaturisierten Chips zu vergrößern. Insbesondere UHF-Chips werden von den Herstellern in Form von Straps als Rollenmaterial geliefert. Dabei sind Kontaktpads am Chip angebracht, die auch eine Rolle-zu-Rolle-Verarbeitung etwa auf Druckmaschinen erlauben.
  • Insgesamt sind die bekannten Verfahren zur Herstellung der eingangs genannten RFID-Chips kompliziert und weisen eine Reihe von Nachteilen auf. Ein erster Nachteil besteht darin, dass bisher die Herstellung der Antennenstruktur und die Chip-Kontaktierung als separate, nacheinander ablaufende Arbeitsschritte erfolgen.
  • Bei der Antennenherstellung besteht insbesondere bei den häufig verwendeten Siebdruckpasten der Nachteil, dass Lösemittel oder Polymere in den Pasten enthalten sind, was die elektrische Leitfähigkeit der aufgebrachten Antennenstruktur beeinträchtigt. Außerdem neigen derartige Antennenstrukturen oder Leiterbahnen generell zu Oxidation und Alterung.
  • Bei den ebenfalls häufig verwendeten Sputter-Verfahren können zwar sehr reine metallische Schichten abgeschieden werden, Schichtdicken über 1 µm, die für die Antennenstruktur erforderlich sind, können aber nur sehr aufwändig erzeugt werden.
  • Bei der nachfolgenden separaten Kontaktierung des elektronischen Bauteiles bzw. der elektronischen Bauteile ist die Positioniergeschwindigkeit begrenzt und eine hohe Positionierungsgenauigkeit nur mit großem technologischen Aufwand erreichbar.
  • Aufgabe der Erfindung ist es, die Nachteile der bekannten Technologien zu vermeiden und ein einheitliches Verfahren sowohl zur Herstellung von Leiterbahnen, d. h. leitenden geometrischen Strukturen, beispielsweise bei RFIDs der Antennenstruktur, als auch der elektrischen Verbindung des Bauteils bzw. der Bauteile mit dieser anzugeben, bei dem bei hohen Beschichtungsraten fein strukturierte, rein metallische Strukturen in der erforderlichen Schichtstärke von 1 bis 100 µm auf temperaturempfindlichen Substraten erzeugt werden können.
  • Diese Aufgabe wird durch ein Verfahren mit den Merkmalen des ersten Patentanspruches gelöst. Die Unteransprüche betreffen besonders vorteilhafte Weiterbildungen und Ausgestaltungen des erfindungsgemäßen Verfahrens.
  • Nach einem Merkmal des erfindungsgemäßen Verfahrens wird vor der Maskierung das später mit der noch herzustellenden Leiter- bzw. Antennenstruktur zu kontaktierende Bauteil auf dem Substrat fixiert. Nach einem weiteren Merkmal wird nachfolgend eine Negativmaskierung der zu erzeugenden Leiter- bzw. Antennenstruktur aufgedruckt. Die dabei verwendeten Druckfarben sind insbesondere unvernetzt, d. h. es können Öle, Wachse und kurzkettige Polymere verwendet werden. Nach einem weiteren Merkmal wird nachfolgend auf diese Negativ-Maskierung eine vollflächige Metallschicht auf der gesamten Oberfläche des Substrates mit einem Plasmabeschichtungsverfahren aufgebracht. Zur Plasmabeschichtung eignen sich besonders Plasma-Barriereentladungen, bei denen ein kaltes Plasma erzeugt wird, das die temperaturempfindliche Substratoberfläche nicht schädigt. Gleichzeitig mit der Leiter- bzw. Antennenherstellung werden beim erfindungsgemäßen Verfahren auch die Kontakte des Bauteils bzw. Chips übermetallisiert und somit angebunden.
  • Anschließend wird beim erfindungsgemäßen Verfahren mit einem sogenannten "Slug-Puller" die Negativ-Maske einschließlich der darauf liegenden Metallschicht abgelöst und entfernt. Dies erfolgt besonders vorteilhaft durch Peeling. Es verbleiben damit nur die Metallstrukturen, die direkt am Substrat Haftung aufgebaut haben, d. h. die Leiter- bzw. Antennenstruktur. Auf dieser Leiter- bzw. Antennenstruktur verbleibt ebenfalls das bereits fertig kontaktierte Bauteil.
  • In einer vorteilhaften Weiterbildung kann das Verfahren auch für die Herstellung von leitenden Strukturen auf beiden Seiten des Substrates verwendet werden, indem das Substrat gedreht wird und die entsprechenden Verfahrensschritte oder Teile davon analog wiederholt werden.
  • Auf besonders vorteilhafte Weise ist es beim erfindungsgemäßen Verfahren auch möglich, durch Kontaktierungen durch das Substrat hindurch, d. h. von einer Seite auf die andere, durch den Plasmastrahl, der die metallischen Bestandteile aufweist, elektrisch leitfähige Verbindungen zwischen den beiden Seiten herzustellen. Dies ist besonders bei der Herstellung von HF-RFID sinnvoll, da hier die Antenne aus einer Spule besteht, deren äußerer Kontakt mit dem inneren Kontakt wieder verbunden werden muss, um den Stromkreis zu schließen.
  • Insgesamt weist das erfindungsgemäße Verfahren eine Reihe von Vorteilen gegenüber dem Stand der Technik auf: Eine hohe elektrische Leitfähigkeit der Leiter- bzw. Antennenstruktur ist erzielbar; je nach Kontaktart und Substrat sind zahlreiche Metalle wie Kupfer, Aluminium, Zink, Nickel, Zinn und Legierungen davon frei wählbar. Weiterhin ermöglicht das Verfahren hohe Schichtdicken der erzeugten leitenden Strukturen, wobei auch 3-D-Konturen und Durchkontaktierungen möglich sind. Weiterhin ermöglicht das Verfahren, wie bereits weiter oben erläutert, gleichzeitig auch die Kontaktierung von Bauteilen bzw. Chips.
  • Insgesamt ist damit eine hohe Produktionsgeschwindigkeit bei niedrigen Kosten erreichbar.
  • Die Erfindung soll nachfolgend an Hand von Zeichnungen am Beispiel der Herstellung von RFID-Etiketten näher erläutert werden, sie ist jedoch nicht auf diesen Anwendungsfall beschränkt. Es zeigen:
  • Figur 1
    ein erfindungsgemäßes Verfahren in schematischer Darstellung der nacheinander ablaufenden einzelnen Verfahrensschritte
    Figur 2
    ein Substrat, a) nach der Befestigung des Chips und b) nach der anschließenden Negativ-Maskierung
    Figur 3
    wieder dieses Substrat a) beim Aufbringen der nachfolgenden Metallschicht mittels Plasmabeschichtung, b) nach dieser vollflächigen metallischen Beschichtung und c) in seitlicher Schnittdarstellung
    Figur 4
    dieses Substrat a) vor der Ablösung der nicht erforderlichen Metalloberfläche, b) nach dem Ablösen mittels Slug-Puller, hier gezeigt beispielsweise als Peeling-Verfahren und c) das fertige Ergebnis, nämlich die erzeugte Antennenstruktur mit kontaktiertem Chip Figur 5 einen solchen Chip a) mit Durchkontaktierung und einer Struktur auch auf der Rückseite, b) in diagonaler Schnittdarstellung und c) ein Detail daraus
    Figur 6
    ein weiteres Substrat mit einem anderen Chip mit abweichender Kontaktanordnung
    Figur 7
    eine zur Plasmabeschichtung besonders geeignete Plasmavorrichtung, die mit einer dielektrisch behinderten Barrierenentladung arbeitet und ein kaltes, für das Substrat besonders schonendes Plasma erzeugt.
  • In Figur 1 ist das erfindungsgemäße Verfahren dargestellt. Es wird ausgegangen von einem Substrat, auf dem zunächst ein elektronisches Bauteil mit mindestens zwei räumlich getrennten Kontakten auf einer Seite A befestigt wird. Dies ist der bereits angesprochene Chip des RFID.
  • Nachfolgend wird eine Negativ-Maskierung dieser Seite vorgenommen.
  • Wiederum nachfolgend erfolgt eine Metallbeschichtung dieser Seite mittels Plasmabeschichtung. Anschließend wird durch einen Slug-Puller, vorzugsweise ein Haftklebeband, diese vollständig beschichtete Seite A behandelt, wobei sich die Negativ-Maske einschließend der darauf liegenden Metallschicht ablöst und entfernt wird. Dies erfolgt besonders vorteilhaft durch Peelen, wobei das Haftklebeband auf der Substratoberfläche abgerollt wird.
  • Im Ergebnis verbleiben nur die Metallstrukturen, die direkt am Substrat Haftung aufgebaut haben, an diesem Substrat - dies ist die Positiv-Struktur der gewünschten Antenne.
  • Soll auch eine Struktur auf der Substratrückseite erzeugt werden, um beispielsweise einen HF-RFID zu erzeugen, werden die Schritte von der Negativ-Maskierung bis zur Ablösung mittels Slug-Puller nach Drehen des Substrats auf dessen Rückseite wiederholt.
  • Es wurde bereits erläutert, dass durch das erfindungsgemäße Aufbringen der Metallschicht durch Plasmabeschichtung auch Durchkontaktierungen von der einen Seite zur anderen Seite des Substrates möglich sind.
    • Figur 2 a) zeigt ein Substrat 1, auf dem ein RFID-Chip 2 mit Kontakt-Pads 3 befestigt ist. Die Befestigung erfolgt - dies ist in der Schnittdarstellung darunter gezeigt - durch eine Klebstoffschicht 4 auf dem Substrat 5.
    • Figur 2 b) zeigt diesen Chip nach der Negativ-Maskierung. Negativ-Maskierung heißt, dass die nicht bedruckte Antennenstruktur 6, die später als metallische Bahn erzeugt werden soll, frei bleibt. Hier ist eine Durchkontaktierung 7 gezeigt, die später eine elektrische Verbindung zu einem Rückseitenkontakt 10 auf der Rückseite des Chips darstellen wird. Ebenfalls gezeigt ist die bedruckte Negativ-Struktur 8 einschließlich des mitüberdruckten Chip-Bereiches 9.
  • Die darunter gezeigte Schnittdarstellung 2 c) zeigt noch einmal den Zusammenhang zwischen der bedruckten Negativstruktur 8 und den freien Strukturen 11.
  • Als Maskierungsmaterial wird Material mit einer geringen inneren Festigkeit verwendet. Dies können z. B. Öle, Wachse oder noch unvernetzte kurzkettige Polymere sein. Es eignen sich auch Maskierungsmaterialien, die spröde sind und beim Anlegen von Biegeschälkräften brechen, wie etwa getrocknete Salze.
    • Figur 3 a) zeigt das nachfolgende Aufbringen einer vollflächigen Metallschicht auf dem Substrat 5. Es ist zu sehen, dass diese abgeschiedene Metallschicht 21 vollflächig die gesamte Oberfläche einschließlich der Struktur in der Maske 22 und auch den aufgebrachten Chip überdeckt. Auf die hier nur andeutungsweise dargestellte Plasmaeinrichtung 20 wird später noch näher eingegangen.
    • Figur 3 b) zeigt noch einmal von oben die vollflächig abgeschiedene Metallschicht 21 auf der bedruckten Negativ-Struktur 8.
    • Figur 3 c) zeigt eben dies in seitlicher Schnittdarstellung.
  • Die Haftungskräfte sind beim erfindungsgemäßen Verfahren durch geeignete Materialwahl so einzustellen, dass die Plasmabeschichtung, die unmittelbar auf dem Substrat aufgebracht ist, eine stärkere Haftung zum Substrat selbst als zum nachfolgend in Verbindung mit Figur 4 beschriebenen Slug-Puller aufweist.
    • Figur 4 a) zeigt das Aufbringen eines Slug-Pullers, hier Haftklebebandes 30 mit Haftklebstoff 31 in Anpressrichtung 32 auf die vollflächige metallische Beschichtung.
    • Figur 4 b) zeigt das Ablösen. Das Haftklebeband 30 wird über eine Andruckrolle mit einem definierten Anpressdruck und mit der Haftseite hin zum Substrat auf dieses Substrat aufgepresst. Durch die räumliche Umlenkung des Haftklebebandes entstehen Kräfte senkrecht zum Substrat, die zur partiellen Ablösung der Beschichtung führen. Da die Haftkraft des Haftklebebandes hier geringer ist als die Haftung der Beschichtung der metallischen Beschichtung direkt auf dem Substrat werden diese Bereiche der leitenden Beschichtung nicht abgelöst. Hingegen werden die Bereiche der Negativ-Maskierung am Haftklebeband gebunden, d. h. von diesem abgelöst, da, wie weiter oben erläutert, die inneren Haftungskräfte des Maskierungsmaterials geringer sind als die Haftkraft des Haftklebebandes. Es ist zu sehen, dass am Haftklebeband 30 die abgelöste Metallschicht 33 einschließlich der Hohlräume 34 in der abgelösten Maskierung verbleibt. Auf dem Substrat 5 bleibt der Chip 36 sowohl die positive, direkt am Substrat haftende Metallstruktur 37.
    • Figur 4 c) zeigt den fertigen, hier beidseitig behandelten, RFID-Chip: Auf einem Substrat 1 ist eine Antennenstruktur 40 metallisch ausgebildet, die eine Durchkontaktierung 39 zu einer Rückseitenbrücke 10 aufweist und auf der, nach Entfernung der Maskierung, ein Chip 38 befestigt und kontaktiert ist.
  • Durch die Wahl der geeigneten Materialien ist verfahrensmäßig sichergestellt, dass nur die vorher maskierten Bereiche einschließlich der darauf aufliegenden Beschichtung am Haftklebeband haften bleiben und mit diesem entfernt werden.
    • Figur 5 a) zeigt noch einmal einen solchen Chip, hier mit einer äußeren Durchkontaktierung 50 und einer inneren, rückwärtigen Durchkontaktierung 51, die mittels einer Rückseitenbrücke 52 elektrisch leitend miteinander verbunden sind.
    • Figur 5 b) zeigt in diagonaler Schnittdarstellung noch einmal diesen Aufbau auf beiden Seiten des Substrats sowie die Antennenstruktur 53 auf dessen Oberseite.
    • Figur 5 c) zeigt eine Detailerstellung auf Figur 5 b). Hier ist zu sehen, dass eine Durchkontaktierung 54 aus einem Durchgangsloch 55 besteht, das eine Innenseitenmetallisierung 56 aufweist, die durch die vorangehende Metallbeschichtung mittels Plasmabeschichtung erzeugt worden ist. Eine
  • Rückseitenbrücke 57 stellt die elektrisch leitende Verbindung auf der unteren Seite des Chips her. Es soll hier nicht unerwähnt bleiben, dass ein gewisser Mindestdurchmesser des Durchgangsloches 55 notwendig ist, um mit Sicherheit ein Durchkontaktieren, d. h. eine vollständige Innenseitenmetallisierung 56 zu erreichen.
    • Figur 6 zeigt eine vergleichbare RFID-Anordnung, wiederum mit einer Antennenstruktur 68. Abweichend von der bisherigen Darstellung weist der Chip hier separate Kontakte auf, von denen ein Kontakt 67 gezeigt ist, der an die Antennenstruktur 68 elektrisch angebunden ist.
    • Figur 7 schließlich zeigt eine besonders geeignete Plasmavorrichtung 20 zur erfindungsgemäßen Metallbeschichtung nach der Negativ-Maskierung. Eine solche Plasmavorrichtung wird von der Anmelderin unter der Bezeichnung Plasmabrush® hergestellt und vertrieben. Sie weist eine äußere Elektrode 70 und eine innere, zentrale Elektrode 71 auf, die durch eine rohrförmige dielektrische Barriere 72 derart voneinander getrennt sind, dass ein konzentrischer Aufbau entsteht. Zwischen äußerer Elektrode 70 und innerer Elektrode 71 wird mittels Spannungsquelle 69 eine Wechselspannung angelegt. In der Folge wird ein homogenes, kaltes Plasma erzeugt, dem pulverförmige, leitfähige und schmelzbare Partikel zugeführt werden. Dieses Gemisch wird vollflächig auf die Substratoberfläche 1 aufgebracht und ergibt die erläuterte metallische Beschichtung im gewünschten Dickebereich.
  • Prinzipiell lassen sich für die Plasmabeschichtung auch andere Plasmavorrichtungen anwenden, beispielweise solche, bei denen eine direkte Bogenentladung erzeugt wird. Jedoch ist zu beachten, dass durch direkte Bogenentladung erzeugte Plasmen eine deutlich höhere Temperatur aufweisen, was bei empfindlichen Substraten problematisch sein kann.
  • Bezugszeichenaufstellung
  • 1 substrat (Folienbahn, Folienbogen, Papier)
    2 RFID-Chip
    3 Kontakt-Pads
    4 Klebstoffschicht
    5 Substrat
    6 Nicht bedruckte Antennenstruktur
    7 Durchkontaktierung für Rückseitenkontakt
    8 Bedruckte Negativ-Struktur
    9 Überdruckter Chip-Bereich
    10 Rückseitenbrücke
    11 Freie Strukturbereiche
    20 Erfindungsgemäße Vorrichtung Plasma-Beschichtungsanlage
    21 Abgeschiedene Metallschicht
    22 Abgeschiedene Metallstruktur in der Maskierung
    23
    30 Haftklebeband (Slug-Puller)
    31 Haftklebstoff
    32 Aufpressrichtung/-kraft
    33 Abgelöste Metallschicht
    34 Hohlräume in der abgelösten Druckmaske
    35 Auf dem Substrat anhaftende Metallstruktur
    36 Chip
    37 Metallstruktur
    38 Chip nach Entfernung der Druckmaskierung
    39 Durchkontaktierung
    40 Querschnitt der Antennenstruktur
    50 Durchkontaktierung außen
    51 Durchkontaktierung innen
    52 Rückseitenbrücke
    53 Antennenstruktur Oberseite
    54 Antennenstruktur mit Durchkontaktierung
    55 Durchgangsloch
    56 Innenseitenmetallisierung des Durchgangslochs
    57 Rückseitenbrücke mit Kontaktierung zur Oberseite
    58
    60 RFID-Chip
    61 Kontakt 1
    62 Kontakt 2
    63 Fadenförmige Maskierung (Nylonfaden, Draht)
    64 Metallisierung und Kontaktierung des Chips 1
    65 Kontakt unter der Metallisierung
    66 Metallisierung und Kontaktierung des Chips 2
    67 Chip mit Anbindung zur Antenne
    68 Antennenstruktur
    69 Spannungsquelle
    70 äußere Elektrode
    71 innere Elektrode

Claims (9)

  1. Verfahren zur Herstellung von Leiterplatten mit mindestens einem kontaktierten Bauteil (2),
    bei denen jeweils auf einem Substrat (1) eine elektrisch leitende geometrische Struktur vorgesehen ist, die mit den Kontakten (3) eines am Substrat (1) befestigten elektronischen Bauteils (2) elektrisch in Verbindung steht,
    aufweisend nachfolgende Verfahrensschritte in der folgenden Reihenfolge:
    - 1) Aufkleben des elektronischen Bauteiles (2) an seiner vorgegebenen Endposition auf einer Seite A des Substrates (1)
    - 2) Negativ-Maskierung der Seite A mit einem nicht leitenden, leicht wieder entfernbaren Material (8)
    - 3) vollflächige Metallbeschichtung der Seite A des Substrates (1) mittels einer Plasmabeschichtung (21)
    - 4) Ablösung der Negativ-Maskierung (8) einschließlich der darauf angeordneten Metallschicht (21) mittels Slug-Puller
    - 5) Freilegung der Positivstruktur (22) der Maskierung, d. h. der leitenden Struktur auf der Seite A des Substrates sowie des kontaktierten Bauteils (2) selbst.
  2. Verfahren nach Anspruch 1
    dadurch gekennzeichnet,
    dass die Verfahrensschritte 2) bis 5) auf der Rückseite B des Substrates (1) wiederholt werden.
  3. Verfahren nach Anspruch 1 oder 2,
    dadurch gekennzeichnet.
    dass zur Negativmaskierung (8) Öle, Wachse, kurzkettige Polymere oder andere Substanzen verwendet werden, deren Haftfestigkeit beim Peelen auf dem Substrat (1) geringer ist als die der nachfolgend aufgebrachten Metallbeschichtung (21) auf ihnen.
  4. Verfahren nach Anspruch 1 bis 3,
    dadurch gekennzeichnet,
    dass zur Plasmabeschichtung ein kaltes, mittels dielektrisch behinderter Entladung erzeugtes Plasma verwendet wird.
  5. Verfahren nach einem der Ansprüche 1 bis 4,
    dadurch gekennzeichnet,
    dass in das Plasma elektrisch leitendes aufschmelzbares Pulver mit Korngrößen von 100 nm bis 10 µm eingespeist wird.
  6. Verfahren nach Anspruch 5,
    dadurch gekennzeichnet,
    dass das elektrisch leitende Pulver metallisches Pulver ist.
  7. Verfahren nach Anspruch 1 bis 6,
    dadurch gekennzeichnet,
    dass die Entfernung mittels Slug-Puller durch Peeling erfolgt, derart, dass ein Haftklebeband oder ähnliches auf der beschichteten Oberfläche abgerollt wird.
  8. Verfahren nach einem der Ansprüche 1 bis 7,
    dadurch gekennzeichnet,
    dass die Dicke der erzeugten elektrisch leitenden Schicht, zum Beispiel einer Antennenstruktur 0,1 bis 100 µm beträgt.
  9. Verfahren nach einem der Ansprüche 1 bis 8,
    dadurch gekennzeichnet,
    dass das Verfahren zur Herstellung von RFID-Etiketten verwendet wird,
    wobei die leitende Struktur die Antennenstruktur des RFID ergibt und das kontaktierte Bauteil der RFID-Chip ist.
EP08872793A 2008-02-26 2008-12-10 Verfahren zur herstellung von leiterplatten mit bestückten bauelementen Not-in-force EP2248401B1 (de)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
DE200810011248 DE102008011248A1 (de) 2008-02-26 2008-02-26 Verfahren zur Herstellung von Leiterplatten mit bestückten Bauelementen
PCT/EP2008/010452 WO2009106114A2 (de) 2008-02-26 2008-12-10 Verfahren zur herstellung von leiterplatten mit bestückten bauelementen

Publications (2)

Publication Number Publication Date
EP2248401A2 EP2248401A2 (de) 2010-11-10
EP2248401B1 true EP2248401B1 (de) 2012-06-27

Family

ID=40550569

Family Applications (1)

Application Number Title Priority Date Filing Date
EP08872793A Not-in-force EP2248401B1 (de) 2008-02-26 2008-12-10 Verfahren zur herstellung von leiterplatten mit bestückten bauelementen

Country Status (4)

Country Link
EP (1) EP2248401B1 (de)
DE (1) DE102008011248A1 (de)
DK (1) DK2248401T3 (de)
WO (1) WO2009106114A2 (de)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE102012102806A1 (de) 2012-03-30 2013-10-02 Balluff Gmbh Elektrisches Gerät und Verfahren zur Herstellung einer Spuleneinrichtung
DE102014217186A1 (de) 2014-08-28 2016-03-03 Continental Automotive Gmbh Verfahren zum Herstellen eines Schaltungsträgers und Schaltungsträger für elektronische Bauelemente

Family Cites Families (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5059454A (en) * 1989-04-26 1991-10-22 Flex Products, Inc. Method for making patterned thin film
DE19807086A1 (de) * 1998-02-20 1999-08-26 Fraunhofer Ges Forschung Verfahren zum Beschichten von Oberflächen eines Substrates, Vorrichtung zur Durchführung des Verfahrens, Schichtsystem sowie beschichtetes Substrat
US6304232B1 (en) * 2000-02-24 2001-10-16 The Goodyear Tire & Rubber Company Circuit module
US6940408B2 (en) 2002-12-31 2005-09-06 Avery Dennison Corporation RFID device and method of forming
DE102004047357A1 (de) * 2004-09-29 2006-04-06 eupec Europäische Gesellschaft für Leistungshalbleiter mbH Elektrische Anordnung und Verfahren zum Herstellen einer elektrischen Anordnung
US20060109130A1 (en) 2004-11-22 2006-05-25 Hattick John B Radio frequency identification (RFID) tag for an item having a conductive layer included or attached
WO2006104792A1 (en) 2005-03-28 2006-10-05 Avery Dennison Corporation Method for making rfid device antennas

Also Published As

Publication number Publication date
WO2009106114A2 (de) 2009-09-03
DE102008011248A1 (de) 2009-09-03
EP2248401A2 (de) 2010-11-10
DK2248401T3 (da) 2012-10-08
WO2009106114A3 (de) 2009-11-05

Similar Documents

Publication Publication Date Title
DE3125518A1 (de) "duenne verdrahtungsanordnung"
EP2583539B1 (de) Mehrschichtiges folienelement
DE102014117245B4 (de) Verfahren zum Herstellen eines Halbleiterelements mit Substratadapter und damit hergestelltes Halbleiterelement mit Substratadapter und Verfahren zum Kontaktieren dieses Halbleiterelements
DE4203114C2 (de) Verfahren zum Herstellen einer Bandträgervorrichtung für Halbleitereinrichtungen
DE10145749A1 (de) Verfahren zur Herstellung einer strukturierten Metallschicht auf einem Trägerkörper und Trägerkörper mit einer strukturierten Metallschicht
DE102007030414B4 (de) Verfahren zur Herstellung einer elektrisch leitfähigen Struktur
DE19646441A1 (de) Elektrischer Widerstand und Verfahren zu seiner Herstellung
EP2248401B1 (de) Verfahren zur herstellung von leiterplatten mit bestückten bauelementen
EP3167481B1 (de) Verfahren zum herstellen eines substratadapters, und zum kontaktieren eines halbleiterelements
DE10254927B4 (de) Verfahren zur Herstellung von leitfähigen Strukturen auf einem Träger und Verwendung des Verfahrens
WO2021175542A1 (de) Temperatursensorverbund und verfahren zur herstellung eines temperatursensorverbundes
EP2124515B1 (de) Verfahren zur Herstellung einer elektrisch leitenden Schichtstruktur
DE19629269A1 (de) Vorrichtung und Verfahren zur Herstellung eines elektronischen Bauteils, insbesondere zur Herstellung einer Induktionsspule für Chipkarten
DE102018221148A1 (de) Verfahren zum Herstellen eines Substratadapters und Substratadapter zum Verbinden mit einem Elektronikbauteil
EP2043861A2 (de) Mehrschichtkörper mit elektrisch leitfähiger polymerschicht und verfahren zu dessen herstellung
EP1879435A2 (de) Elektrisch leitfähige Strukturen
DE2546443B2 (de) Zusammengesetzte Mikroschaltung und Verfahren zu ihrer Herstellung
EP1731007B1 (de) Multilayer-leiterplatte sowie verfahren zum herstellen einer solchen
EP1230679B1 (de) Verfahren zur herstellung eines trägerelementes für einen ic-baustein
DE102005059067A1 (de) Kapazitive Tastatureinrichtung und Verfahren zum Herstellen einer kapazitiven Tastatureinrichtung
DE10033507A1 (de) Verfahren und Vorrichtung zur Herstellung von elektrisch leitfähigen Mustern auf Trägern, sowie Folie dazu
WO2009062678A1 (de) Verfahren zur herstellung eines transponders auf einem substrat
EP1318706A1 (de) Verfahren und Vorrichtung zur Herstellung von elektrisch leitfähigen Mustern auf Trägern, sowie Folien dazu
DE10247746A1 (de) Herstellung von feinen und feinsten leitfähigen Strukturen, leitfähigen Microstrukturen als auch flächige Ausführungen auf Trägermaterialien 2D und 3D
WO2000057468A2 (de) Elektrische schaltung sowie verfahren zu deren herstellung

Legal Events

Date Code Title Description
PUAI Public reference made under article 153(3) epc to a published international application that has entered the european phase

Free format text: ORIGINAL CODE: 0009012

17P Request for examination filed

Effective date: 20090902

AK Designated contracting states

Kind code of ref document: A2

Designated state(s): AT BE BG CH CY CZ DE DK EE ES FI FR GB GR HR HU IE IS IT LI LT LU LV MC MT NL NO PL PT RO SE SI SK TR

AX Request for extension of the european patent

Extension state: AL BA MK RS

DAX Request for extension of the european patent (deleted)
REG Reference to a national code

Ref country code: DE

Ref legal event code: R079

Ref document number: 502008007635

Country of ref document: DE

Free format text: PREVIOUS MAIN CLASS: H05K0003140000

Ipc: H05K0003040000

17Q First examination report despatched

Effective date: 20120112

GRAP Despatch of communication of intention to grant a patent

Free format text: ORIGINAL CODE: EPIDOSNIGR1

RIC1 Information provided on ipc code assigned before grant

Ipc: H05K 3/32 20060101ALI20120213BHEP

Ipc: H05K 3/04 20060101AFI20120213BHEP

GRAS Grant fee paid

Free format text: ORIGINAL CODE: EPIDOSNIGR3

GRAA (expected) grant

Free format text: ORIGINAL CODE: 0009210

AK Designated contracting states

Kind code of ref document: B1

Designated state(s): AT BE BG CH CY CZ DE DK EE ES FI FR GB GR HR HU IE IS IT LI LT LU LV MC MT NL NO PL PT RO SE SI SK TR

REG Reference to a national code

Ref country code: GB

Ref legal event code: FG4D

Free format text: NOT ENGLISH

REG Reference to a national code

Ref country code: CH

Ref legal event code: EP

REG Reference to a national code

Ref country code: CH

Ref legal event code: NV

Representative=s name: ROTTMANN, ZIMMERMANN + PARTNER AG

REG Reference to a national code

Ref country code: AT

Ref legal event code: REF

Ref document number: 564745

Country of ref document: AT

Kind code of ref document: T

Effective date: 20120715

REG Reference to a national code

Ref country code: IE

Ref legal event code: FG4D

Free format text: LANGUAGE OF EP DOCUMENT: GERMAN

REG Reference to a national code

Ref country code: DE

Ref legal event code: R096

Ref document number: 502008007635

Country of ref document: DE

Effective date: 20120823

REG Reference to a national code

Ref country code: NL

Ref legal event code: T3

REG Reference to a national code

Ref country code: SE

Ref legal event code: TRGR

REG Reference to a national code

Ref country code: DK

Ref legal event code: T3

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: NO

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120927

Ref country code: LT

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120627

REG Reference to a national code

Ref country code: LT

Ref legal event code: MG4D

Effective date: 20120627

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: GR

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120928

Ref country code: HR

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120627

Ref country code: SI

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120627

Ref country code: LV

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120627

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: IS

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20121027

Ref country code: RO

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120627

Ref country code: SK

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120627

Ref country code: CZ

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120627

Ref country code: EE

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120627

Ref country code: CY

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120627

PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: DE

Payment date: 20121112

Year of fee payment: 5

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: PT

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20121029

Ref country code: PL

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120627

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: ES

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20121008

PLBE No opposition filed within time limit

Free format text: ORIGINAL CODE: 0009261

STAA Information on the status of an ep patent application or granted ep patent

Free format text: STATUS: NO OPPOSITION FILED WITHIN TIME LIMIT

26N No opposition filed

Effective date: 20130328

REG Reference to a national code

Ref country code: DE

Ref legal event code: R097

Ref document number: 502008007635

Country of ref document: DE

Effective date: 20130328

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: BG

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120927

Ref country code: MC

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20121231

REG Reference to a national code

Ref country code: IE

Ref legal event code: MM4A

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: IE

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20121210

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: MT

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120627

PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: DK

Payment date: 20131219

Year of fee payment: 6

Ref country code: GB

Payment date: 20131217

Year of fee payment: 6

Ref country code: CH

Payment date: 20131218

Year of fee payment: 6

Ref country code: SE

Payment date: 20131217

Year of fee payment: 6

Ref country code: AT

Payment date: 20131216

Year of fee payment: 6

PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: LU

Payment date: 20131217

Year of fee payment: 6

Ref country code: FR

Payment date: 20131213

Year of fee payment: 6

Ref country code: NL

Payment date: 20131216

Year of fee payment: 6

Ref country code: FI

Payment date: 20131216

Year of fee payment: 6

Ref country code: IT

Payment date: 20131217

Year of fee payment: 6

PGFP Annual fee paid to national office [announced via postgrant information from national office to epo]

Ref country code: BE

Payment date: 20131216

Year of fee payment: 6

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: TR

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20120627

REG Reference to a national code

Ref country code: DE

Ref legal event code: R119

Ref document number: 502008007635

Country of ref document: DE

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: HU

Free format text: LAPSE BECAUSE OF FAILURE TO SUBMIT A TRANSLATION OF THE DESCRIPTION OR TO PAY THE FEE WITHIN THE PRESCRIBED TIME-LIMIT

Effective date: 20081210

REG Reference to a national code

Ref country code: DE

Ref legal event code: R119

Ref document number: 502008007635

Country of ref document: DE

Effective date: 20140701

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: DE

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20140701

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: BE

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20141231

REG Reference to a national code

Ref country code: DK

Ref legal event code: EBP

Effective date: 20141231

REG Reference to a national code

Ref country code: NL

Ref legal event code: V1

Effective date: 20150701

REG Reference to a national code

Ref country code: NL

Ref legal event code: V1

Effective date: 20150701

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: LU

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20141210

Ref country code: FI

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20141210

Ref country code: SE

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20141211

REG Reference to a national code

Ref country code: CH

Ref legal event code: PL

REG Reference to a national code

Ref country code: SE

Ref legal event code: EUG

REG Reference to a national code

Ref country code: AT

Ref legal event code: MM01

Ref document number: 564745

Country of ref document: AT

Kind code of ref document: T

Effective date: 20141210

GBPC Gb: european patent ceased through non-payment of renewal fee

Effective date: 20141210

REG Reference to a national code

Ref country code: FR

Ref legal event code: ST

Effective date: 20150831

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: NL

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20150701

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: GB

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20141210

Ref country code: CH

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20141231

Ref country code: LI

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20141231

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: AT

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20141210

Ref country code: FR

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20141231

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: IT

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20141210

PG25 Lapsed in a contracting state [announced via postgrant information from national office to epo]

Ref country code: DK

Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES

Effective date: 20141231