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DE102006040960A1 - Flipchip-Bauelement, Multichip-Bauelement sowie ein Verfahren zur Herstellung eines Multichip-Bauelementes - Google Patents

Flipchip-Bauelement, Multichip-Bauelement sowie ein Verfahren zur Herstellung eines Multichip-Bauelementes Download PDF

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DE102006040960A1
DE102006040960A1 DE102006040960A DE102006040960A DE102006040960A1 DE 102006040960 A1 DE102006040960 A1 DE 102006040960A1 DE 102006040960 A DE102006040960 A DE 102006040960A DE 102006040960 A DE102006040960 A DE 102006040960A DE 102006040960 A1 DE102006040960 A1 DE 102006040960A1
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flip
chip
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contacting
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DE102006040960A
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English (en)
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Jürgen Grafe
Kimyung Yoon
Harry Hedler
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Qimonda AG
Original Assignee
Qimonda AG
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Publication date
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Abstract

Die Erfindung betrifft ein Flip-Chip-Bauelement (6), umfassend: ein Bauelementsubstrat (2) mit elektrisch ansteuerbaren Strukturen; mindestens eine Kontaktierungseinrichtung (10) zum Kontaktieren der elektrisch ansteuerbaren Strukturen, wobei die Kontaktierungseinrichtung eine Durchkontaktierung zwischen zwei einander gegenüberliegenden Oberflächen (6, 7) des Bauelementsubstrats (2) und Kontaktstrukturen (8, 9) an der Position der Durchkontaktierung auf beiden Oberflächen des Bauelementsubstrates (2) aufweist, so dass die Durchkontaktierung über die Kontaktstrukturen (8, 9) elektrisch von extern kontaktierbar ist.

Description

  • Die Erfindung betrifft ein Flipchip-Bauelement, ein Multichip-Bauelement, das mehrere solcher Flipchip-Bauelemente aufweist sowie ein Verfahren zur Herstellung eines Multichip-Bauelementes.
  • Als Flipchip-Bauelemente werden in der Regel integrierte Bauelemente bezeichnet, die ein Halbleitersubstrat mit integrierten Schaltungen aufweisen, die über eine unmittelbar auf dem Halbleitersubstrat aufgebrachte Umverdrahtungslage und darauf angeordneten ersten kontaktierbaren Kontakterhebungen wie z.B. Lothügel und dgl. als elektrische Bauelemente ohne ein zusätzliches Gehäuse vorgesehen werden. Dies hat den Vorteil, dass sie sehr geringe laterale Abmessungen und eine sehr geringe Baugröße aufweisen, aber trotzdem ohne zusätzliche Einrichtungen auf z.B. Leiterplatten aufgebracht werden können, so dass sie über auf den Leiterplatten vorgesehenen Leiterbahnen elektrisch kontaktiert werden können. Dazu werden sie kopfüber auf die Leiterplatte aufgesetzt und durch einen Reflow-Prozess, bei dem die Kontakterhebungen aufgeschmolzen werden, mit auf der Leiterplatte befindlichen Kontaktflächen verlötet. Ein Vorteil der Flipchip-Bauelemente besteht insbesondere darin, dass diese nicht zwingend Einhäusungsprozess, z.B. Molding-Prozess, nebst zusätzlichem Bonding-Prozess unterworfen werden müssen, der aufgrund einer erhöhten Temperatur bzw. sonstigen mechanischen Einflüssen zusätzlichen Stress auf das Bauelement ausübt, wodurch dieses beschädigt bzw. zerstört werden kann.
  • Multichip-Bauelemente weisen in der Regel mehrere Chips in einem Gehäuse auf. Es ist bislang kein Verfahren bekannt, mit dem sich mehrere Flipchip-Bauelemente in einem solchen Multichip-Bauelement vorsehen lassen, ohne eine Zwischenlage, eine Umverdrahtungslage und dgl. vorzusehen. Zwischenlagen sind in der Regel Substratscheiben mit Umverdrahtungsstrukturen und haben den Nachteil, dass diese die Bauhöhe des gesamten Multichip-Bauelements erheblich vergrößern und dadurch in der Regel die Anzahl der stapelbaren Chips erheblich beschränken.
  • Die in der Stapelanordnung eines solchen Multichip-Bauelements vorgesehenen Flipchip-Bauelemente weisen nur an einer Seite Kontaktstrukturen für die Kontaktierung auf, so dass beim Aufsetzen des Flipchip-Bauelements mit der mit den Kontakterhebungen versehenen Oberfläche auf Kontaktflächen auf einer weiteren Oberfläche keine weiteren Kontaktstrukturen auf der Oberseite des Flipchip-Bauelements mehr zugänglich sind. Daher kann bislang nur ein Flipchip-Bauelement in einer solchen Stapelanordnung eines Multichip- Bauelements vorgesehen werden, das vorzugsweise unmittelbar auf dem Gehäusesubstrat, das die Stapelanordnung trägt, aufgebracht wird. Das Flipchip-Bauelement kann so z.B. als unterstes Bauelement der Stapelanordnung unmittelbar auf einem Gehäusesubstrat vorgesehen sein oder bezüglich der Stapelanordnung auf einer gegenüberliegenden Seite des Gehäusesubstrats. Sollen mehrere Flipchip-Bauelemente in einer solchen Stapelanordnung gestapelt werden, ist – wie oben beschrieben – zwischen den Flipchip-Bauelementen ein Umverdrahtungs- und Abstandselement vorgesehen, das sowohl Kontaktstrukturen zum Befestigen von Bonddrähten für die Kontaktierung weiterer Chips als auch Kontaktstrukturen zum Kontaktieren der Kontakterhebungen eines weiteren darauf aufzusetzenden Flipchip-Bauelements aufweist. Dadurch wird die Bauhöhe einer solchen Stapelanordnung erheblich vergrößert, wodurch die maximale Anzahl der zu verwendenden Flipchip-Bauelemente begrenzt ist.
  • Es ist daher Aufgabe der vorliegenden Erfindung, ein Flipchip-Bauelement vorzusehen, das in einfacher Weise auf andere Flip-Chip-Bauelemente gestapelt werden kann, ohne dass ein Umverdrahtungselement zwischen den Flipchip-Bauelementen vorgesehen werden muss. Es ist weiterhin Aufgabe der Erfindung, ein Multichip-Bauelement mit geringer Bauhöhe zur Verfügung zu stellen, das mehrere Flipchip-Bauelemente umfasst.
  • Diese Aufgabe wird durch das Flipchip-Bauelement nach Anspruch 1 sowie das Multichip-Bauelement und das Verfahren zur Herstellung eines Multichip-Bauelementes gemäß den nebengeordneten Ansprüchen gelöst.
  • Weitere vorteilhafte Ausgestaltungen der Erfindung sind in den abhängigen Ansprüchen angegeben.
  • Gemäß einem Aspekt ist ein Flipchip-Bauelement mit einem Bauelementsubstrat mit elektrisch ansteuerbaren Strukturen und mit mindestens einer Kontaktierungseinrichtung zum Kontaktieren der elektrisch ansteuerbaren Strukturen vorgesehen. Die Kontaktierungseinrichtung weist eine Durchkontaktierung zwischen zwei einander gegenüberliegenden Oberflächen des Bauelementsubstrats und Kontaktstrukturen an der Position der Durchkontaktierung auf beiden Oberflächen des Bauelementsubstrats auf, so dass die Durchkontaktierung über die Kontaktstrukturen elektrisch von extern kontaktierbar ist. Weiterhin kann mindestens eine der Kontaktstrukturen eine Kontakterhebung aufweisen, die insbesondere als Lothügel ausgebildet sein kann.
  • Gemäß einer weiteren Ausführungsform können mehrere Kontaktierungseinrichtungen in dem Bauelementsubstrat angeordnet sein, wobei die Kontaktierungseinrichtungen auf beiden Oberflächen des Bauelementsubstrats Kontakterhebungen aufweisen. Alternativ kann mindestens eine der Kontaktstrukturen eine Kontaktfläche oder eine Kontaktvertiefung aufweisen.
  • Weiterhin können mehrere Kontaktierungseinrichtungen in dem Bauelementsubstrat angeordnet sein, wobei die Kontaktierungseinrichtungen auf beiden Oberflächen des Bauelementsubstrats Kontaktvertiefungen aufweisen. Alternativ kann die Kontaktierungsrichtung auf einer Oberfläche eine Kontakterhebung und auf einer gegenüberliegenden Oberfläche eine Kontaktvertiefung an der Position der Durchkontaktierung vorgesehen sein. Dabei kann die Querschnittsfläche der Kontaktvertiefung im Wesentlichen der Querschnittsfläche der Kontakterhebung entsprechen. Weiterhin können mindestens zwei der Kontaktierungseinrichtungen die Kontakterhebung an den verschiedenen Oberflächen des Bauelementsubstrats aufweisen.
  • Gemäß einem weiteren Aspekt ist ein Multichip-Bauelement mit zwei derartiger Flipchip-Bauelemente vorgesehen, die in einer Stapelanordnung angeordnet sind. Dabei sind die Kontaktierungseinrichtungen des ersten und des zweiten Flipchip-Bauelementes so positioniert, dass sie in Stapelrichtung der Stapelanordnung übereinander liegen und sich gegenseitig kontaktieren.
  • Insbesondere können die Kontaktstrukturen der einander kontaktierenden Kontaktierungseinrichtungen des ersten und des zweiten Flipchip-Bauelementes so ausgebildet sein, dass die Kontaktstruktur des ersten Flipchip-Bauelementes als Kontakterhebung und die Kontaktstruktur des zweiten Flipchip-Bauelementes als Kontaktvertiefung vorgesehen ist oder umgekehrt. Weiterhin können mehrere Kontaktierungseinrichtungen in jedem der Flipchip-Bauelemente an in der Stapelanordnung einander zugeordneten Positionen vorgesehen sein, wobei die mehreren Kontaktierungseinrichtungen jedes der Flipchip-Bauelemente auf eine der Oberflächen des entsprechenden Bauelementsubstrats entweder nur Kontaktvertiefungen oder nur Kontakterhebungen aufweisen.
  • Alternativ können mehrere Kontaktierungseinrichtungen in jedem der Flipchip-Bauelemente vorgesehen sein, die jeweils eine Kontakterhebung und eine Kontaktvertiefung aufweisen, wobei die mehreren Kontaktierungseinrichtungen auf einer der Oberflächen des Bauelementsubstrats eines der Flipchip-Bauelemente sowohl eine Kontakterhebung als auch eine Kontaktvertiefung aufweisen.
  • Weiterhin kann die Stapelanordnung der mehreren Flipchip-Bauelemente auf einem Leiterplattensubstrat angeordnet sein und von einem Gehäusematerial umschlossen sein.
  • Gemäß einem Aspekt ist ein Verfahren zur Herstellung eines Multichip-Bauelementes vorgesehen. Das Verfahren umfasst das Herstellen von mehreren Flipchip-Bauelementen, wobei jedes der Flipchip-Bauelemente ein Bauelementsubstrat mit mindestens einer Kontaktierungseinrichtung aufweist, die eine Durchkontaktierung zwischen zwei einander gegenüberliegenden Oberflächen des Bauelementsubstrats und einer Kontaktstruktur beidseitig des Bauelementsubstrats an der Position der Durchkontaktierung aufweist, so dass die Durchkontaktierung mit der Kontakterhebung elektrisch verbunden ist. Weiterhin werden die mit Durchkontaktierung versehenen Flipchip-Bauelemente in einer Stapelanordnung vorgesehen, wobei die Kontaktierungseinrichtung des ersten und des zweiten Bauelementsubstrats so positioniert werden, dass die in Stapelrichtung der Bauelementsubstrate übereinander liegen und einander unmittelbar kontaktieren.
  • Weiterhin können die Kontaktierungseinrichtungen des ersten und des zweiten Bauelementsubstrats so ausgebildet sein, dass eine Kontakterhebung der Kontaktierungseinrichtung eines der Bauelementsubstrate und eine Kontaktvertiefung der Kontaktierungseinrichtung des jeweils anderen Bauelementsubstrates aneinander anliegen, so dass sie einen elektrischen Kontakt bilden. Weiterhin kann vorgesehen sein, dass mehr als zwei Flipchip-Bauelemente in der Stapelanordnung vorgesehen werden, wobei zumindest als Kontakterhebung ausgebildete Kontaktstrukturen der Kontaktierungseinrichtungen mit einem Lotmaterial gebildet sind und wobei die Kontaktstrukturen der einander zugeordneten Kontaktierungseinrichtungen jedes der mehreren Flipchip-Bauelemente in einem gemeinsamen Reflow-Prozess miteinander verbunden werden.
  • Bevorzugte Ausführungsformen der Erfindung werden nachfolgend anhand der beigefügten Zeichnungen näher erläutert. Es zeigen:
  • 1 einen Ausschnitt aus einem Flipchip-Bauelement gemäß einer ersten Ausführungsform der vorliegenden Erfindung
  • 2 einen Ausschnitt aus einem Flipchip-Bauelement gemäß einer weiteren Ausführungsform der vorliegenden Erfindung;
  • 3 einen Ausschnitt aus einem Flipchip-Bauelement gemäß einer weiteren Ausführungsform der vorliegenden Erfindung;
  • 4 einen Ausschnitt aus einem Flipchip-Bauelement gemäß einer weiteren Ausführungsform der vorliegenden Erfindung;
  • 5 ein Multichip-Bauelement gemäß einer weiteren Ausführungsform der vorliegenden Erfindung;
  • 6 ein Multichip-Bauelement gemäß einer weiteren Ausführungsform der vorliegenden Erfindung; und
  • 7 Verfahrensschritte zum Herstellen eines Multichip-Bauelements gemäß einer weiteren Ausführungsform der vorliegenden Erfindung.
  • In 1 ist ein Flipchip-Bauelement 1 gemäß einer ersten Ausführungsform der Erfindung dargestellt. Das Flipchip-Bauelement 1 weist ein Bauelementsubstrat 2 auf, das in der Regel als ein Halbleitersubstrat, insbesondere als ein Siliziumsubstrat ausgebildet ist und in dem elektrisch ansteuerbare Strukturen, wie z.B. elektronische Schaltungen, Mikroaktuatoren, Mikrosensoren und dgl. angeordnet sind. Das Bauelementsubstrat 2 ist beidseitig durch Isolationsschichten 3 i soliert und durch Schutzschichten 4, die auf der jeweiligen Isolationsschicht 3 aufgebracht sind, vor äußeren Einflüssen geschützt. Statt dessen können auch mehrere Isolations- und/oder Schutzschichten 3, 4 vorgesehen werden oder auch nur eine gemeinsame Isolations-/Schutzschicht. Der dargestellte Ausschnitt eines Flipchip-Bauelementes 1 stellt lediglich einen Ausschnitt des Flipchip-Bauelementes dar.
  • In dem Bauelementsubstrat 2 und durch die Isolationsschichten 3 und die Schutzschichten 4 hindurch sind Durchgangsöffnungen 5 für Durchkontaktierungen vorgesehen, die eine elektrische Verbindung zwischen einer ersten Oberfläche 6 und einer zweiten Oberfläche 7 des Flipchip-Bauelements 1 bereitstellen sollen. Die Durchgangsöffnungen werden z.B. durch einen Atzprozess hergestellt, der von einer Seite des Bauelementsubstrats 2 vorgenommen wird, so dass Gräben gebildet werden, wobei das Bauelementsubstrat 2 nach dem erfolgten Atzen von der anderen Seite angreifend gedünnt wird, bis die zuvor geätzten Gräben von der dem Ätzangriff gegenüberliegenden Oberfläche geöffnet sind. Alternativ können die Durchkontaktierungen auch mithilfe eines Bohrverfahrens, insbesondere eines Laserbohrverfahrens, hergestellt werden.
  • Die Innenwände der Durchgangsöffnungen 5 können mithilfe eines Abscheideprozesses, insbesondere mithilfe eines Galvanisierprozesses mit einem leitfähigen Material, insbesondere mit einem Metall, beschichtet werden, so dass zwischen der ersten und der zweiten Oberfläche 6, 7 des Bauelements 1 in der Durchgangsöffnung 5 eine elektrisch leitende Verbindung entsteht. An den Öffnungen der Durchgangsöffnungen 5 an den Oberflächen 6, 7 des Flipchip-Bauelementes 1 können die Durchgangsöffnungen beidseitig des Flipchip-Bauelements 1 Verbreitungen aufweisen, die insbesondere als Kontaktvertiefungen 8 ausgebildet sind. Die Kontaktvertiefungen weisen daher einen größeren Querschnitt auf wie der Querschnitt der Durchgangsöffnung 5 im Bereich des Bauelementsubstrats 2.
  • Die Kontaktvertiefung 8 kann beispielsweise dadurch gebildet sein, dass die Isolationsschicht 3 von den Rändern der Durchgangsöffnung der Durchkontaktierung zurücksteht, so dass eine Stufe zwischen der Öffnung der Durchgangsöffnung 5 in dem Bauelementsubstrat 2 und der entsprechenden Isolationsschicht 3 gebildet wird. Auf gleiche Weise kann die Schutzschicht 4 so auf der Isolationsschicht 3 aufgebracht sein, dass die der Durchgangsöffnung 5 zugeordneten Ränder der Schutzschicht 4 hinter den Rändern der Isolationsschicht 3 zurücksteht, so dass eine weitere Stufe gebildet wird. Die durch die Durchgangsöffnung in dem Bauelementsubstrat 2, die Isolationsschichten 3, sowie die Schutzschichten 4 gebildete Struktur der Durchkontaktierung wird anschließend wie oben beschrieben durch einen Beschichtungsprozess mit einem leitfähigen Material beschichtet, so dass die Kontaktvertiefung 8 gebildet wird.
  • Im gezeigten Ausführungsbeispiel sind die Kontaktvertiefungen 8 auf der zweiten Oberfläche 7 des Flipchip-Bauelementes 1 mit Kontakterhebungen 9 in Form von Lothügeln versehen, die in die Kontaktvertiefung 8 auf der zweiten Oberfläche 7 eingebracht sind. Diese werden in geschmolzener Form eingebracht, so dass sich ein Teil des Lotmaterials der Kontakterhebung 9 aufgrund des Kapillareffekts in einen in der Durchgangsöffnung 5 gebildeten Kanal hineinzieht. Auf diese Weise wird ein Flipchip-Bauelement gebildet, das Kontaktierungseinrichtungen 10 mit Durchkontaktierungen aufweist, auf deren zweiten Oberfläche 7 Kontakterhebungen 9 aus einem Lotmaterial angeordnet sind, über die das Flipchip-Bauelement 1 elektrisch kontaktiert werden kann.
  • Weiterhin befinden sich Kontaktvertiefungen 8 auf der ersten Oberfläche 6 des Flipchip-Bauelements 1, die durch ein Aufsetzen von entsprechenden Kontakterhebungen eines weiteren Flipchip-Bauelements elektrisch kontaktiert werden können, so dass die durch die Durchkontaktierung die Kontakterhebung 9 auf der zweiten Oberfläche 7 sowie die Kontaktvertiefung 8 auf der ersten Oberfläche 6 gebildete Kontaktierungseinrichtungen 10 sowohl mit Kontaktflächen als auch durch weitere Kontakterhebungen, z.B. in Form von Lotkugeln, kontaktiert werden können, um die elektrisch ansteuerbaren Strukturen in dem Flipchip-Bauelement 1 elektrisch zu kontaktieren.
  • In den nachfolgenden Figuren bezeichnen gleiche Bezugszeichen Elemente gleicher oder vergleichbarer Funktionen.
  • In 2 ist eine weitere Ausführungsform eines Flipchip-Bauelements 1 dargestellt, wobei jedoch im Gegensatz zu der Ausführungsform der 1 die Durchgangsöffnung 5 nicht mithilfe eines Beschichtungsprozesses elektrisch leitend gemacht wird, sondern stattdessen die Wände der Durchgangsöffnung 5 mit einer weiteren Isolationsschicht 11 versehen werden, um die Durchkontaktierung gegenüber dem Substrat zu isolieren. Nun werden in einem ersten Schritt Kontakterhebungen 9 von der zweiten Oberfläche 7 auf an die Positionen der Durchgangsöffnungen 5 vorgesehen und optional, wie in 3 dargestellt ist, weitere Kontakterhebungen 12 auf die erste Oberfläche 6 des Flipchip-Bauelements 1 aufgebracht. Beim Aufbringen der Kontakterhebungen 9 auf die zweite Oberfläche des Flipchip-Bauelements 1 an den Positionen der Durchkontaktierungen 5 bzw. beim Aufbringen der weiteren Kontaktelemente 12 auf der ersten Oberfläche 6 des Flipchip-Bauelements 1 an den entsprechenden Positionen wird das Lotmaterial der Kontakterhebungen 9, 12 entsprechend verflüssigt, so dass es sich aufgrund des Kapillareffektes in einen Durchgangskanal der Durchgangsöffnung 5 hineinzieht. So gelangt das geschmolzene Lotmaterial von beiden Seiten in den Durchgangskanal hinein und die Lotmaterialien in dem Durchgangskanal kommen miteinander in Kontakt, so dass eine elektrische Kontaktierung der jeweiligen Kontakterhebung 9 und der jeweiligen weiteren Kontakterhebung 12 hergestellt wird. Dies hat den Vorteil, dass auf eine Beschichtung der Innenwände der Durchgngsöffnung 5 mit einem metallischen Material in einem Galvanisierprozess oder dgl. verzichtet werden kann.
  • Eine Kontaktierung mit einem weiteren Flipchip-Bauelement bei der Ausführungsform der 2 erfolgt dadurch, dass Kontakterhebungen eines weiteren Flipchip-Bauelements beim Aufeinanderstapeln in die entsprechende Kontaktvertiefung eingebracht und durch einen nachfolgenden Reflow-Prozess zieht das Lotmaterial durch den Kapillareffekt in die entsprechende Durchgangsöffnung 5 hinein und stellt den Kontakt her.
  • In 4 ist eine weitere Ausführungsform des Flipchip-Bauelementes 1 dargestellt. Die Ausführung der 4 unterscheidet sich von den Ausführungsformen der 1 und 2 dadurch, dass die Kontaktierungseinrichtung 10 auf einer Oberfläche des Flipchip-Bauelements 1 mit einer Kontakterhebung 9 und auf der entsprechend gegenüberliegenden Oberfläche des Flipchip-Bauelementes 1 mit einer Kontaktvertiefung 8 versehen ist. Dabei befinden sich bei mehreren Kontaktierungseinrichtungen 10 die Kontakterhebungen 9 auf verschiedenen Oberflächen des Flipchip-Bauelements 1, so dass auf beiden Oberflächen des Flipchip-Bauelementes sowohl Kontakterhebungen 9 als auch Kontaktvertiefungen vorgesehen sind.
  • Anstelle einer Kontaktvertiefung 8 kann die durch die Durchkontaktierung, die Isolationsschicht 3 und die Schutzschicht 4 gebildete Wanne vollständig mit einem leitfähigen Material gefüllt sein, so dass eine ebene Kontaktfläche zum Kontaktieren mit einer Kontakterhebung eines weiteren Flipchip-Bauelements 1 gebildet wird.
  • Wie in der Ausführungsform der 4 dargestellt ist, können auch Flipchip-Bauelemente 1 vorgesehen sein, die ganz oder teilweise mit Kontaktierungseinrichtungen 10 versehen sind, die auf beiden Oberflächen 6, 7 lediglich Kontaktvertiefungen und keine Kontakterhebungen aufweisen.
  • In 5 ist ein Multichip-Bauelement 20 gemäß einer weiteren Ausführungsform dargestellt. Das Multichip-Bauelement 20 umfasst ein Gehäusesubstrat 21 auf einer ersten Oberfläche 23, die vorzugsweise ebene Kontaktbereiche 22 aufweist und auf einer zweiten Oberfläche 25 Kontakterhebungen 24 in Form von Lotkugeln und dgl. Aufweist. Um den Multichip-Baustein von extern zu kontaktieren. Die Kontaktbereiche 22 und die weiteren Kontakterhebungen 24 sind über eine Umverdrahtungsstruktur 26 im Gehäusesubstrat 21 in definierter Weise elektrisch miteinander verbunden, so dass eine Kontaktierung von mit den Kontaktbereichen 22 verbundenen Flipchip-Bauelementen 30, 31 über die weiteren Kontakterhebungen 24 möglich ist.
  • Die Flipchip-Bauelemente 30, 31 des Multichip-Bauelements 20 entsprechen im Wesentlichen dem Flipchip-Bauelement 1 der 1. Die Flipchip-Bauelemente 30, 31 sind als eine Stapelanordnung auf die Kontaktbereiche 22 aufgebracht, indem ein erstes Flipchip-Bauelement 30 mit den auf seiner zweiten Oberfläche 7 aufgebrachten Kontakterhebungen 9 auf die Kontaktbereiche 22 aufgesetzt wird und indem das weitere Flipchip-Bauelement 31 so auf das bereits aufgebrachte Flipchip-Bauelement 30 aufgesetzt wird, dass die entsprechenden Kontakterhebungen 9 auf die Kontaktvertiefungen 8 auf der ersten Oberfläche 6 des unteren Flipchip-Bauelementes 30 aufgesetzt sind. Das Verbinden der Kontakterhebungen 9 mit den Kontaktbereichen 22 bzw. der Kontakterhebungen 9 mit den Kontaktvertiefungen 8 erfolgt durch einen Reflow-Prozess, d.h. durch Aufschmelzen der jeweiligen Kontakterhebungen 9 der Flipchip-Bauelemente 30, 31 in einem gemeinsamen Prozessschritt, so dass die Flipchip-Bauelemente 30, 31 nur einmalig gemeinsam einem Temperaturprozess unterzogen werden, um diese miteinander zu verbinden.
  • In 6 ist der Aufbau eines Multichip-Bauelements gemäß einer weiteren Ausführungsform dargestellt, die sich von der Ausführungsform der 5 dadurch unterscheidet, dass das erste (untere) Flipchip-Bauelement 30, das unmittelbar auf dem Gehäusesubstrat 21 aufgebracht ist, auf dessen erster Oberfläche sowohl Kontaktvertiefungen und Kontakterhebungen aufweist und wobei die zweite Oberfläche 7 des zweiten (oberen) Flipchip-Bauelementes 31, das auf dem ersten Flipchip-Bauelement 31 gestapelt wird, sowohl Kontakterhebungen 9 als auch Kontaktvertiefungen 8 aufweist, die der Anordnung der Kontaktvertiefungen 8 und Kontakterhebungen 9 der auf der ersten Oberfläche 6 des ersten Flipchip-Bauelementes 30 angeordneten Kontaktstrukturen in komplementärer Weise entsprechen. Auf diese Weise kann die Gefahr von Fehlplatzierungen durch eine geeignete Wahl eines Profils von Kontakterhebungen und -vertiefungen 9, 8 reduziert werden.
  • Es ist selbstverständlich möglich, auf diese Weise auch mehr als zwei Flipchip-Bauelemente aufeinander zu stapeln.
  • Nach dem Reflow-Prozess zum elektrischen Verbinden der Flipchip-Bauelemente 30, 31 mit den Gehäusesubstraten kann die Anordnung durch ein Aufbringen eines Gehäusematerials 27 verkapselt werden.
  • In 7 wird ein Verfahren zum Aufbau einer Stapelanordnung von mehr als zwei Flipchip-Bauelementen 40, 41, 42 schematisch dargestellt. Die Verfahrensstände der 7A bis 7C zeigen das Übereinander-Anordnen von mehreren Flipchip-Bauelementen 41, 42, die in ihrer Position zunächst mithilfe eines Klebers 45, der lateral zwischen den Kontakten der Flipchip-Bauelemente 40, 41, 42 und zwischen den Oberflächen der einzelnen Flipchip-Bauelemente 40, 41, 42 angeordnet ist, um diese zunächst in ihrer Position zu fixieren, wie dies in 7D gezeigt ist. Sind alle Flipchip-Bauelemente 40, 41, 42 aufeinandergestapelt, wird anschließend ein Reflow-Prozess für alle Verbindungen zwischen den Kontakterhebungen 9 und den Kontaktflächen bzw. den Kontaktvertiefungen 8 der Flipchip-Bauelemente vorgenommen, so dass sich das Lotmaterial der Kontakterhebungen 9 mit den Kontaktflächen bzw. den Kon taktvertiefungen 8 verbindet und so einen elektrisch leitfähige und zuverlässige Kontaktierung zwischen den Flipchip-Bauelementen 40, 41, 42 bereitstellt. Ein solcher gemeinsamer Reflow-Prozess hat den Vorteil, dass die Flipchip-Bauelemente 40, 41, 42 nur einmal einem Temperaturprozess zur elektrischen Kontaktierung unterzogen werden, so dass diese bei der Herstellung des Multichip-Bauelements einer geringeren Stressbelastung ausgesetzt sind.
  • 1
    Flipchip-Bauelement
    2
    Bauelementsubstrat
    3
    Isolationsschicht
    4
    Schutzschicht
    5
    Durchgangsöffnung
    6
    erste Oberfläche
    7
    zweite Oberfläche
    8
    Kontaktvertiefung
    9
    Kontakterhebung
    10
    Kontaktierungseinrichtung
    11
    weitere Isolationsschicht
    12
    weitere Kontakterhebung
    20
    Multichip-Bauelement
    21
    Gehäusesubstrat
    22
    Kontaktbereich
    23
    erste Oberfläche
    24
    dritte Kontakterhebung
    25
    zweite Oberfläche
    26
    Umverdrahtungsstruktur
    27
    Gehäusematerial
    30
    erstes Flipchip-Bauelement
    31
    zweites Flipchip-Bauelement
    40, 41, 42
    Flipchip-Bauelemente
    43
    Lotkugel
    44
    Kontaktfläche
    45
    Klebstoff

Claims (17)

  1. Flip-Chip-Bauelement (6) umfassend: ein Bauelementsubstrat (2) mit elektrisch ansteuerbaren Strukturen; mindestens eine Kontaktierungseinrichtung (10) zum Kontaktieren der elektrisch ansteuerbaren Strukturen, wobei die Kontaktierungseinrichtung eine Durchkontaktierung zwischen zwei einander gegenüberliegenden Oberflächen (6, 7) des Bauelementsubstrats (2) und Kontaktstrukturen (8, 9) an der Position der Durchkontaktierung auf beiden Oberflächen des Bauelementsubstrates (2) aufweist, so dass die Durchkontaktierung über die Kontaktstrukturen (8, 9) elektrisch von extern kontaktierbar ist.
  2. Flip-Chip Bauelement (1) nach Anspruch 1, wobei mindestens eine der Kontaktstrukturen (8, 9) eine Kontakterhebung (9) aufweist.
  3. Flip-Chip Bauelement (1) nach Anspruch 2, wobei die Kontakterhebung (9) als Lotkugel ausgebildet ist.
  4. Flip-Chip Bauelement (1) nach Anspruch 1, wobei mehrere Kontaktierungseinrichtungen (10) in dem Bauelementsubstrat (2) angeordnet sind, wobei die Kontaktierungseinrichtungen (10) auf beiden Oberflächen (8, 7) des Bauelementsubstrates (2) Kontakterhebungen (9) aufweisen.
  5. Flip-Chip Bauelement (1) nach Anspruch 1, wobei mindestens eine der Kontaktstrukturen (8, 9) eine Kontaktfläche oder eine Kontaktvertiefung (8) aufweist.
  6. Flip-Chip Bauelement (1) nach Anspruch 5, wobei mehrere Kontaktierungseinrichtungen (10) in dem Bauelementsubstrat (2) angeordnet sind, wobei die Kontaktierungseinrichtungen (10) auf beiden Oberflächen (6, 7) des Bauelementsubstrates (2) Kontaktvertiefungen (8) aufweisen.
  7. Flip-Chip Bauelement (1) nach Anspruch 2 oder 3, wobei die Kontaktierungseinrichtung (10) an der der Kontakterhebung (9) gegenüberliegenden Oberfläche des Bauelementsubstrats (2) eine Kontaktvertiefung (8) bezüglich der Oberfläche des Bauelementsubstrats (2) aufweist.
  8. Flip-Chip Bauelement (1) nach Anspruch 7, wobei die Querschnittsfläche der Kontaktvertiefung (8) im wesentlichen der Querschnittsfläche der Kontakterhebung (9) entspricht.
  9. Flip-Chip Bauelement (1) nach Anspruch 7 oder 8, wobei mindestens zwei der Kontaktierungseinrichtungen die Kontakterhebung an den verschiedenen Oberflächen des Bauelementsubstrats aufweisen.
  10. Multichip-Bauelement (20) mit einem ersten Flip-Chip-Bauelement (30) nach einem der Ansprüche 1 bis 9 und einem zweiten Flip-Chip-Bauelement (31) nach einem der Ansprüche 1 bis 9, wobei das erste Flip-Chip-Bauelement (30) und das zweite Flip-Chip-Bauelement (31) in einer Stapelanordnung vorgesehen sind, wobei die Kontaktierungseinrichtungen (10) des ersten und des zweiten Flip-Chip-Bauelementes (30, 31) so positioniert sind, dass sie in Stapelrichtung der Stapelanordnung übereinander liegen und sich gegenseitig unmittelbar kontaktieren.
  11. Multichip-Bauelement (20) nach Anspruch 10, wobei die Kontaktstrukturen (8, 9) der einander kontaktierenden Kontaktierungseinrichtungen (10) des ersten und des zweiten Flip-Chip-Bauelementes (30, 31) so ausgebildet sind, dass die Kontaktstruktur (8, 9) des ersten Flip-Chip-Bauelementes (30) als Kontakterhebung (9) und die Kontaktstruktur (8, 9) des zweiten Flip-Chip-Bauelementes (31) als Kontaktvertiefung (8) vorgesehen ist oder umgekehrt.
  12. Multichip-Bauelement (20) nach Anspruch 10 oder 11, wobei mehrere Kontaktierungseinrichtungen (10) in jedem der Flip-Chip-Bauelemente (30, 31) an in der Stapelanordnung einander zugeordneten Positionen vorgesehen sind, wobei die mehreren Kontaktierungseinrichtungen (10) jedes der Flip-Chip-Bauelemente (30, 31) auf einer der Oberflächen des entsprechenden Bauelementsubstrates (2) entweder nur Kontaktvertiefungen (8) oder nur Kontakterhebungen (9) aufweisen.
  13. Multichip-Bauelement (20) nach Anspruch 10 oder 11, wobei mehrere Kontaktierungseinrichtungen in jedem der Flip-Chip-Bauelemente (30, 31) vorgesehen sind, die jeweils eine Kontakterhebung (9) und eine Kontaktvertiefung (8) aufweisen, wobei die mehreren Kontaktierungseinrichtungen (10) auf einer der Oberflächen des Bauelementsubstrates (2) eines der Flip-Chip-Bauelemente (30, 31) sowohl eine Kontakterhebung (9) als auch eine Kontaktvertiefung (8) aufweisen.
  14. Multichip-Bauelement (20) nach einem der Ansprüche 10 bis 13, wobei die Stapelanordnung der mehreren Flip- Chip-Bauelemente (30, 31) auf einem Leiterplattensubstrat (21) angeordnet ist und/oder von einem Gehäusematerial (27) umschlossen ist.
  15. Verfahren zur Herstellung eines Multi-Chip-Bauelementes 20), mit folgenden Schritten: – Herstellen von mehreren Flip-Chip-Bauelementen, wobei jedes der Flip-Chip-Bauelementen (30, 31) ein Bauelementsubstrat (2) mit mindestens einer Kontaktierungseinrichtung (10) aufweist, die eine Durchkontaktierung zwischen zwei einander gegenüberliegenden Oberflächen des Bauelementsubstrat (2) und eine Kontaktstruktur (8, 9) beidseitig des Bauelementsubstrates (2) an der Position der Durchkontaktierung aufweist, so dass die Durchkontaktierung mit der Kontakterhebung elektrisch verbunden ist, – Vorsehen der mit Durchkontaktierungen versehenen Flip-Chip-Bauelemente (30, 31) in einer Stapelanordnung, wobei die Kontaktierungseinrichtung (10) des ersten und des zweiten Bauelementsubstrates (2) so positioniert werden, dass sie in Stapelrichtung der Bauelementsubstrate (2) übereinander liegen und einander unmittelbar kontaktieren.
  16. Verfahren nach Anspruch 15, wobei die Kontaktierungseinrichtungen (10) des ersten und des zweiten Bauelementsubstrates (2) so ausgebildet sind, dass eine Kontakterhebung (9) der Kontaktierungseinrichtung (10) eines der Bauelementsubstrate (2) und eine Kontaktvertiefung (8) der Kontaktierungseinrichtung (10) des jeweils anderen Bauelementsubstrates (2) aneinander anliegen, so dass sie einen elektrischen Kontakt bilden.
  17. Verfahren nach Anspruch 15 oder 16, wobei mehr als zwei Flip-Chip-Bauelemente (30, 31) in der Stapelanordnung vorgesehen werden, wobei zumindest als Kontakterhebung (9) ausgebildete Kontaktstrukturen (8, 9) der Kontaktierungseinrichtungen mit einem Lotmaterial gebildet sind und wobei die Kontaktstrukturen der einander zugeordneten Kontaktierungseinrichtungen jedes der mehreren Flip-Chip-Bauelemente (30, 31) in einem gemeinsamen Reflow-Prozess miteinander verbunden werden.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP2597677A1 (de) * 2011-11-23 2013-05-29 austriamicrosystems AG Halbleitervorrichtung mit Substratdurchgang, der von einer Lötkugel abgedeckt wird, und zugehöriges Herstellungsverfahren

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4761681A (en) * 1982-09-08 1988-08-02 Texas Instruments Incorporated Method for fabricating a semiconductor contact and interconnect structure using orientation dependent etching and thermomigration
US6002177A (en) * 1995-12-27 1999-12-14 International Business Machines Corporation High density integrated circuit packaging with chip stacking and via interconnections
DE10205026C1 (de) * 2002-02-07 2003-05-28 Bosch Gmbh Robert Halbleitersubstrat mit einem elektrisch isolierten Bereich, insbesondere zur Vertikalintegration

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4761681A (en) * 1982-09-08 1988-08-02 Texas Instruments Incorporated Method for fabricating a semiconductor contact and interconnect structure using orientation dependent etching and thermomigration
US6002177A (en) * 1995-12-27 1999-12-14 International Business Machines Corporation High density integrated circuit packaging with chip stacking and via interconnections
DE10205026C1 (de) * 2002-02-07 2003-05-28 Bosch Gmbh Robert Halbleitersubstrat mit einem elektrisch isolierten Bereich, insbesondere zur Vertikalintegration

Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP2597677A1 (de) * 2011-11-23 2013-05-29 austriamicrosystems AG Halbleitervorrichtung mit Substratdurchgang, der von einer Lötkugel abgedeckt wird, und zugehöriges Herstellungsverfahren
WO2013075947A1 (en) * 2011-11-23 2013-05-30 Ams Ag Semiconductor device with through-substrate via covered by a solder ball and related method of production
US9553039B2 (en) 2011-11-23 2017-01-24 Ams Ag Semiconductor device with through-substrate via covered by a solder ball and related method of production
US9735101B2 (en) 2011-11-23 2017-08-15 Ams Ag Semiconductor device with through-substrate via covered by a solder ball
US9773729B2 (en) 2011-11-23 2017-09-26 Ams Ag Method of producing a semiconductor device with through-substrate via covered by a solder ball
US9870988B2 (en) 2011-11-23 2018-01-16 Ams Ag Method of producing a semiconductor device with through-substrate via covered by a solder ball

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