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CN107316619B - Goa电路及液晶显示装置 - Google Patents

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Abstract

本发明涉及一种GOA电路及液晶显示装置。该GOA电路包括：第N级GOA单元包括上拉控制电路，上拉电路，下拉电路，下拉维持电路，以及自举电容(Cb)；第一时钟信号(CK(N))输入该上拉电路，该第N级GOA单元的级传信号输出端(ST(N))与该上拉电路连接；该上拉控制电路包括：第一薄膜晶体管(T11)，其栅极连接第N－m级GOA单元的级传信号输出端，源极和漏极分别连接第二薄膜晶体管(T12)的栅极和输入第二时钟信号(XCK(N))；该第二薄膜晶体管(T12)的源极和漏极分别连接该第N－m级GOA单元的级传信号输出端和节点(Q(N))。本发明还提供了相应的液晶显示装置。本发明的GOA电路及液晶显示装置能够使各级GOA单元的Q节点输出波形表现一致。

Description

GOA电路及液晶显示装置
技术领域
本发明涉及液晶显示器领域，尤其涉及一种GOA电路及液晶显示装置。
背景技术
液晶显示器(Liquid Crystal Display，LCD)等平面显示装置因具有高画质、省电、机身薄及应用范围广等优点，而被广泛的应用于手机、电视、个人数字助理、数字相机、笔记本电脑、台式计算机等各种消费性电子产品，成为显示装置中的主流。
主动式液晶显示器中，每个子像素具有一个薄膜晶体管(TFT)，其栅极(Gate)连接至水平扫描线，漏极(Drain)连接至垂直方向的数据线，源极(Source)则连接至像素电极。在水平扫描线上施加足够的电压，会使得该条水平扫描线上的所有TFT打开，此时该条水平扫描线上的像素电极会与垂直方向上的数据线连通，从而将数据线上的显示信号电压写入像素，控制不同液晶的透光度进而达到控制色彩的效果。目前主动式液晶显示面板水平扫描线的驱动主要由面板外接的芯片(IC)来完成，外接的IC可以控制各级水平扫描线的逐级充电和放电。阵列基板行驱动(Gate Driver On Array，简称GOA)技术，也就是利用现有薄膜晶体管液晶显示器阵列(Array)制程将栅极(Gate)行扫描驱动信号电路制作在Array基板上，实现对Gate逐行扫描的驱动方式。
现有的GOA电路，通常包括级联的多个GOA单元，每一级GOA单元对应驱动一级水平扫描线。GOA单元的主要结构包括上拉电路(pull-high circuit)，上拉控制电路，下拉电路(pull-down circuit)和下拉维持电路(pull-down holding circuit)，以及负责电位抬高的自举(Boast)电容等，上拉控制电路也可以称为预充电路(pre-charge circuit)；上拉电路主要负责将时钟信号(Clock)输出为栅极信号；上拉控制电路负责控制上拉电路的打开时间，一般连接前面级GOA电路传递过来的级传信号或者栅极信号；下拉电路负责在第一时间将栅极信号拉低为低电位，即关闭栅极信号；下拉维持电路则负责将栅极输出信号和上拉电路的栅极信号(通常称为Q点)维持在关闭状态(即负电位)；自举电容则负责Q点的二次抬升，这样有利于上拉电路的G(N)输出。
因为GOA技术可以节省栅极芯片(gate IC)、实现窄边框(narrow border)等优势，目前GOA技术已经广泛的运用于面板设计当中，因此设计新型的GOA电路是有必要的。但是，目前使用启动信号STV作为GOA开启信号以及Q点预充电信号的情况下，前几级Q点波形由于预充电时间差异，会出现波形不一致的情况。
参见图1，现有的普通GOA电路架构主要由上拉控制电路(包含T11)，上拉电路(包含T21，T22)，下拉电路，下拉维持电路，和自举电容Cb等组成。其中，对于第N级GOA单元，其上拉控制电路连接第N-4级GOA单元的级传信号输出端ST(N-4)和栅极信号输出端G(N-4)，负责控制上拉电路的打开时间以及对节点Q(N)预充电；上拉电路连接时钟信号CK(N)和第N级GOA单元的级传信号输出端ST(N)，负责将时钟信号CK(N)通过第N级的栅极信号输出端G(N)输出至对应的水平扫描线以及输出第N级GOA单元的级传信号；下拉电路负责拉低第N级的栅极信号输出端G(N)的电位；下拉维持电路用于维持拉低第N级的栅极信号输出端G(N)的电位和上拉电路的节点Q(N)的电位，以使栅极信号输出端G(N)所输出栅极信号维持在关闭状态。
参见图2及图3，图2为现有的普通GOA电路架构中节点Q输出信号示意图，横轴为时间，纵轴为电压，显示了1至8级GOA单元中节点Q的波形；图3为现有的普通GOA电路架构中CK输入信号与STV输入信号对应波形示意图，横轴为时间，纵轴为电压，显示了启动信号STV和输入1至6级各级GOA单元的高频时钟信号CK，由图3可见各级GOA单元的高频时钟信号CK为正常CK输出波形，CK波形顺序产生，无相对提前输出。由于上拉控制电路需要输入第N-4级GOA单元的级传信号和栅极信号来启动，所以GOA电路的最初几级需要输入启动信号STV代替级传信号作为GOA开启信号以及Q节点预充电信号，从而造成前三级Q节点输出波形与正常级Q节点输出不一致(参见图2)。
发明内容
因此，本发明的目的在于提供一种GOA电路，使其各级GOA单元的Q节点输出波形表现一致。
本发明的另一目的在于提供一种液晶显示装置，使其GOA电路中各级GOA单元的Q节点输出波形表现一致。
为实现上述目的，本发明提供了一种GOA电路，包括：多个级联的GOA单元，其中第N级GOA单元对第N级水平扫描线的充电进行控制，该第N级GOA单元包括上拉控制电路，上拉电路，下拉电路，下拉维持电路，以及自举电容；该上拉电路，下拉维持电路，下拉电路和自举电容分别与该第N级GOA单元的节点和栅极信号输出端连接，该第N级GOA单元的第一时钟信号输入该上拉电路，该第N级GOA单元的级传信号输出端与该上拉电路连接，该上拉控制电路与该第N级GOA单元的节点连接；该上拉控制电路包括：
第一薄膜晶体管，其栅极连接第N－m级GOA单元的级传信号输出端，m为自然数，源极和漏极分别连接第二薄膜晶体管的栅极和输入该第N级GOA单元的第二时钟信号，该第二时钟信号与第一时钟信号相位相反；
该第二薄膜晶体管的源极和漏极分别连接该第N－m级GOA单元的级传信号输出端和该第N级GOA单元的节点。
其中，一启动信号输入前m级GOA单元中的第N－m级GOA单元的级传信号输出端。
其中，该第一薄膜晶体管的栅极连接第N－4级GOA单元的级传信号输出端，该第二薄膜晶体管的源极和漏极分别连接该第N－4级GOA单元的级传信号输出端和该第N级GOA单元的节点。
其中，一启动信号输入前四级GOA单元中的第N－4级GOA单元的级传信号输出端。
其中，该GOA电路包括波形相同、初始相位不同的八种第一时钟信号。
其中，所述八种第一时钟信号的初始相位按照π/4的相位差等差排列。
其中，该GOA电路包括波形相同、初始相位不同的两种或两种以上的第一时钟信号。
其中，该GOA电路基于非晶硅薄膜晶体管制备。
其中，所述上拉电路包括：
第三薄膜晶体管，其栅极连接该第N级GOA单元的节点，源极和漏极分别连接该第N级GOA单元的栅极信号输出端和输入该第一时钟信号；
第四薄膜晶体管，其栅极连接该第N级GOA单元的节点，源极和漏极分别连接该第N级GOA单元的级传信号输出端和输入该第一时钟信号。
本发明还提供了一种液晶显示装置，包括上述的GOA电路。
综上，本发明的GOA电路及液晶显示装置能够提升各级GOA单元中节点Q的表现，使各级GOA单元的Q节点输出波形表现一致。
附图说明
下面结合附图，通过对本发明的具体实施方式详细描述，将使本发明的技术方案及其他有益效果显而易见。
附图中，
图1为现有的普通GOA电路架构示意图；
图2为现有的普通GOA电路架构中节点Q输出信号示意图；
图3为现有的普通GOA电路架构中CK输入信号与STV输入信号对应波形示意图；
图4为本发明GOA电路架构一较佳实施例的示意图；
图5为本发明GOA电路架构一较佳实施例中CK输入信号与STV输入信号对应波形示意图；
图6为本发明GOA电路架构一较佳实施例中节点Q输出信号示意图。
具体实施方式
参见图4，其为本发明GOA电路架构一较佳实施例的示意图，主要由上拉控制电路(包含T11和T12)，上拉电路(包含T21，T22)，下拉电路，下拉维持电路，和自举电容Cb等组成。其中，对于第N级GOA单元，其上拉控制电路负责控制上拉电路的打开时间以及对节点Q(N)预充电；上拉电路连接高频时钟信号CK(N)和第N级GOA单元的级传信号输出端ST(N)，负责将时钟信号CK(N)通过第N级的栅极信号输出端G(N)输出至对应的水平扫描线以及输出第N级GOA单元的级传信号；下拉电路负责拉低第N级的栅极信号输出端G(N)的电位；下拉维持电路用于维持拉低第N级的栅极信号输出端G(N)的电位和上拉电路的节点Q(N)的电位，以使栅极信号输出端G(N)所输出栅极信号维持在关闭状态。自举电容Cb则负责节点Q(N)的二次抬升，这样有利于上拉电路的输出。
在此较佳实施例中，该薄膜晶体管T11的栅极连接第N－4级GOA单元的级传信号输出端ST(N－4)，薄膜晶体管T12的源极和漏极分别连接该第N－4级GOA单元的级传信号输出端ST(N－4)和该第N级GOA单元的节点Q(N)。此时需要提供启动信号STV输入前四级GOA单元中的第N－4级GOA单元的级传信号输出端(ST(N－4))，从而开启整个GOA电路以及作为节点Q(N)的预充电信号。
图4中所示上拉控制电路具体结构仅用于举例说明本发明，本发明通过改变上拉控制电路，新增一颗命名为T12的TFT，使得各级GOA单元的节点Q(N)点输出波形表现一致，避免驱动T21的电压不一致。本发明只在现有GOA电路基础上，增加一颗薄膜晶体管T12；原先STV输入信号无需做变更；改变后上拉控制电路一般来说包括：薄膜晶体管T11，其栅极连接第N－m级GOA单元的级传信号输出端，m为自然数(图4所示为m＝4时电路架构)，源极和漏极分别连接薄膜晶体管T12的栅极和输入时钟信号XCK(N)，时钟信号(XCK(N))与时钟信号CK(N)相位相反；薄膜晶体管T12的源极和漏极分别连接该第N－m级GOA单元的级传信号输出端和该第N级GOA单元的节点Q(N)。对于前m级GOA单元，需要启动信号STV输入前m级GOA单元中的第N－m级GOA单元的级传信号输出端。
在图4所示的较佳实施例中，上拉电路具体包括：薄膜晶体管T21，其栅极连接该节点Q(N)，源极和漏极分别连接栅极信号输出端G(N)和输入时钟信号CK(N)；薄膜晶体管T22，其栅极连接节点Q(N)，源极和漏极分别连接第N级GOA单元的级传信号输出端ST(N)和输入时钟信号CK(N)。
参见图5，其为本发明GOA电路架构该较佳实施例中CK输入信号与STV输入信号对应波形示意图，横轴为时间，纵轴为电压。该较佳实施例中，该GOA电路包括波形相同、初始相位不同的八种第一时钟信号(CK(N))，具体为CK1～CK8，初始相位按照π/4的相位差等差排列。对于大尺寸高分辨率面板，一般都会采用多个高频时钟信号的方式来驱动，各个GOA单元分别对应其中一个时钟信号。参见图5，若为8个时钟信号，则CK5(XCK1)～CK8(XCK4)四个时钟信号在STV开启时，提前开启；STV信号下降沿对应CK5(XCK1)第二个上升沿。
一般来说，本发明的GOA电路包括波形相同、初始相位不同的两种或两种以上的时钟信号CK(N)，该GOA电路基于非晶硅薄膜晶体管制备。本发明提出了一种新型的GOA电路的设计方案，在原有GOA电路基础上，增加一个TFT，即可使得所有级数的Q节点输出波形表现一致，本发明适用于所有非晶硅(a-si)、时钟信号数目大于或等于2的GOA电路。本发明的GOA电路可以应用于相应的液晶显示装置中。
图6为本发明GOA电路架构一较佳实施例中节点Q输出信号示意图，横轴为时间，纵轴为电压，可见前三级Q节点输出波形与正常级Q节点输出一致。
综上，本发明的GOA电路及液晶显示装置能够提升各级GOA单元中节点Q的表现，使各级GOA单元的Q节点输出波形表现一致。
以上所述，对于本领域的普通技术人员来说，可以根据本发明的技术方案和技术构思作出其他各种相应的改变和变形，而所有这些改变和变形都应属于本发明后附的权利要求的保护范围。

Claims (10)

1.一种GOA电路，其特征在于，包括：多个级联的GOA单元，其中第N级GOA单元对第N级水平扫描线的充电进行控制，该第N级GOA单元包括上拉控制电路，上拉电路，下拉电路，下拉维持电路，以及自举电容(Cb)；该上拉电路，下拉维持电路，下拉电路和自举电容(Cb)分别与该第N级GOA单元的节点(Q(N))和栅极信号输出端(G(N))连接，该第N级GOA单元的第一时钟信号(CK(N))输入该上拉电路，该第N级GOA单元的级传信号输出端(ST(N))与该上拉电路连接，该上拉控制电路与该第N级GOA单元的节点(Q(N))连接；该上拉控制电路包括：
第一薄膜晶体管(T11)，其栅极连接第N－m级GOA单元的级传信号输出端，m为自然数，源极和漏极分别连接第二薄膜晶体管(T12)的栅极和输入该第N级GOA单元的第二时钟信号(XCK(N))，该第二时钟信号(XCK(N))与第一时钟信号(CK(N))相位相反；
该第二薄膜晶体管(T12)的源极和漏极分别连接该第N－m级GOA单元的级传信号输出端和该第N级GOA单元的节点(Q(N))。
2.如权利要求1所述的GOA电路，其特征在于，一启动信号输入前m级GOA单元中的第N－m级GOA单元的级传信号输出端。
3.如权利要求1所述的GOA电路，其特征在于，该第一薄膜晶体管(T11)的栅极连接第N－4级GOA单元的级传信号输出端(ST(N－4))，该第二薄膜晶体管(T12)的源极和漏极分别连接该第N－4级GOA单元的级传信号输出端(ST(N－4))和该第N级GOA单元的节点(Q(N))。
4.如权利要求3所述的GOA电路，其特征在于，一启动信号输入前四级GOA单元中的第N－4级GOA单元的级传信号输出端(ST(N－4))。
5.如权利要求3所述的GOA电路，其特征在于，该GOA电路包括波形相同、初始相位不同的八种第一时钟信号(CK(N))。
6.如权利要求5所述的GOA电路，其特征在于，所述八种第一时钟信号(CK(N))的初始相位按照π/4的相位差等差排列。
7.如权利要求1所述的GOA电路，其特征在于，该GOA电路包括波形相同、初始相位不同的两种或两种以上的第一时钟信号(CK(N))。
8.如权利要求1所述的GOA电路，其特征在于，该GOA电路基于非晶硅薄膜晶体管制备。
9.如权利要求1所述的GOA电路，其特征在于，所述上拉电路包括：
第三薄膜晶体管(T21)，其栅极连接该第N级GOA单元的节点(Q(N))，源极和漏极分别连接该第N级GOA单元的栅极信号输出端(G(N))和输入该第一时钟信号(CK(N))；
第四薄膜晶体管(T22)，其栅极连接该第N级GOA单元的节点(Q(N))，源极和漏极分别连接该第N级GOA单元的级传信号输出端(ST(N))和输入该第一时钟信号(CK(N))。
10.一种液晶显示装置，其特征在于，包括如权利要求1～9任一项所述的GOA电路。
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