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CN105810143B - 一种数据驱动电路及其驱动方法和有机发光显示器 - Google Patents

一种数据驱动电路及其驱动方法和有机发光显示器 Download PDF

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CN105810143B CN201410834484.XA CN201410834484A CN105810143B CN 105810143 B CN105810143 B CN 105810143B CN 201410834484 A CN201410834484 A CN 201410834484A CN 105810143 B CN105810143 B CN 105810143B
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Abstract

本发明所述的一种数据驱动电路，具有数据信号复用结构，还包括用于连接电源的电源线，以及与所述电源线连接的第二晶体管；第二晶体管的源极与所述电源线电连接，第二晶体管的栅极电连接至同一行所述控制线；所述第二晶体管的漏极分别电连接至不同的所述信号线，连接点位于所述第一晶体管与所述显示区域之间。通过在信号线中接入补偿电源使得像素单元初始化，以减少像素单元中寄生电容的影响，从而有效提高应用其的所述有机发光显示装置的响应特性和显示特性。

Description

一种数据驱动电路及其驱动方法和有机发光显示器
技术领域
本发明涉及显示技术领域，具体涉及一种可有效提高显示装置响应特性的数据驱动电路及其驱动方法和有机发光显示器。
背景技术
平板显示器具有完全平面化、轻、薄、省电等特点,是图像显示器发展的必然趋势和研究焦点。在各种类型的平板显示装置中，由于有源矩阵有机发光显示装置(英文全称为Active Matrix Organic Light Emitting Display，简称AMOLED)使用自发光的有机发光二极管(英文全称为Organic Light Emitting Diode，简称OLED)来显示图像，具有响应时间短，使用低功耗进行驱动，相对更好的亮度和颜色纯度的特性，所以有机发光显示装置已经成为下一代显示装置的焦点。
对于大型有源矩阵有机发光显示装置，包括位于扫描线和数据线的交叉区域的多个像素单元。如图1所示，传统的有源矩阵有机发光显示面板包括数据驱动器20、扫描驱动器30以及像素单元11、12…nm等。由所述数据驱动器20发出的数据信号由驱动芯片提供，通常，一列像素单元需要一个数据信号，m列像素单元则需要m个数据信号D1、D2…Dm。因为驱动芯片的成本较高，且其成本和驱动芯片的面积是正比关系，过多的数据信号会占用更多的芯片面积，从而提高驱动芯片的成本，所以很多公司会使用数据信号复用(Mux/Demux)的结构来减少驱动信号的数量，从而减少驱动芯片的面积，来降低驱动芯片的成本。
图2是一种采用数据信号复用结构的AMOLED面板示意图，它在图1所示的传统AMOLED像素电路的基础上，增加了m个P型开关晶体管和2个开关晶体管控制信号Sel_1和Sel_2。这种面板减少了一半数据驱动器的数据信号线的数量，从原来的m个减少为m/2个。实验证明，在某些特定的条件下，采用数据复用结构的AMOLED面板可能存在显示异常的问题。
如图2和图3所示，在第1列数据线数据信号写入周期T1中：t1时间内，开关晶体管T1打开，数据信号线D1高电平信号(5V)传送到显示区内的信号线D1’上；t2时间内，开关晶体管t2打开，数据信号线D1高电平信号传送到显示区内的信号线D2’上。在第2列数据线数据信号写入周期T2中：在t3时间内，开关晶体管T1打开，数据信号线D1低电平传送到显示区内的信号线D1’上，像素单元21被加载低电平；而此时信号线D2’处于悬空状态，由于信号线寄生电容的存在，D2’会保持t1时间段内的高电平状态，像素单元22会被施加高电平。在t4时间内，开关晶体管T2打开，数据信号线D1的低电平信号传送到显示区内的信号线D2’上；但是由于在t3时间内，像素单元22已经被施加高电平，所以在t4时间，像素单元22会难以接受有效的低电平信号，这样AMOLED面板就会出现显示异常的现象。
同时，技术人员研发出另一种数据信号复用结构的AMOLED面板，如图4所示，增加了m个P型开关晶体管和3个开关晶体管控制信号Sel_1、Sel_2和Sel_3。这种面板减少了2/3的数据驱动器20的数据信号线的数量，从原来的m个减少为m/3个。
如图4和图5所示：Sel_1、Sel_2和Sel_3均为周期信号，S1、S2…Sn为扫描线；Sel_1、Sel_2和Sel_3在t1、t2…t3n的时间内信号顺序为低电平，使开关晶体管T1、T2…Tm顺序的打开，将数据驱动器信号线D1…D(m/3)上的信号顺序的分配到显示区内的信号线D1’…Dm’中。与图2中所示的数据驱动电路相同，使用图4中所示的数据驱动电路的AMOLED面板也会出现某些显示异常现象。
尽管图2和图4中所述数据驱动电路可以有效减少驱动芯片，从而可以降低生产成本的问题，但是均存在响应延迟，从而导致显示异常的问题。
发明内容
为此，本发明所要解决的是现有AMOLED的数据驱动电路所存在的响应延迟，从而导致显示异常的问题，提供一种可有效提高显示器件响应特性的数据驱动电路及其驱动方法和应用。
为解决上述技术问题，本发明采用的技术方案如下：
本发明所述的一种数据驱动电路，通过m/i列数据线与数据驱动器电连接、通过n行扫描线与扫描驱动器电连接；
各数据线远离数据驱动器的一端连接有i列信号线，各扫描线分别与设置在显示区域中的每行像素单元电连接，各信号线分别与设置在显示区域中的每列像素单元电连接；
各信号线中连接数据线与显示区域的区段内还连接有第一晶体管，所述数据驱动电路还包括连接数据驱动器的i行控制线；
与同一数据线连接的i个第一晶体管的栅极分别电连接至不同的控制线；
i为大于或等于2的自然数，m为i的整数倍非零自然数，n为非零自然数；
所述数据驱动电路还包括电源线，以及与所述电源线连接的m-m/i个第二晶体管，所述电源线用于连接至电源；
各所述第二晶体管的源极均与所述电源线电连接，各所述第二晶体管的栅极电连接至同一行所述控制线；所述第二晶体管的漏极分别电连接至不同的所述信号线，连接点位于所述第一晶体管与所述显示区域之间。
优选地，连接同一所述信号线的所述第一晶体管与所述第二晶体管的栅极连接不同的所述控制线。
优选地，所述电源的电压值小于或等于0V。
优选地，所有所述第一晶体管均为P型晶体管。
优选地，所有所述第二晶体管为沟道极性相同的场效应管。
更优选地，所述第二晶体管为P型场效应管。
本发明所述的数据驱动电路的驱动方法，将每列所述数据线的数据信号写入周期分为i个时间阶段；在每个所述时间阶段，各所述控制线顺次设置为低电平；
在第1个所述时间阶段，与低电平的所述控制线连接的第二晶体管打开，与所述第二晶体管连接的所述信号线与所述电源导通，其所在列的各像素单元被初始化。
优选地，在每个所述时间阶段，与低电平的所述控制线连接的第一晶体管打开，与所述第一晶体管连接的所述信号线与所述数据线导通，其所在列的各像素单元数据信号写入。
优选地，所述初始化的电压值小于或等于0V。
本发明所述的一种有机发光显示器，包括所述的数据驱动电路。
本发明的上述技术方案相比现有技术具有以下优点：
本发明所述的一种数据驱动电路，通过数据线与数据驱动器电连接、通过扫描线与扫描驱动器电连接；各数据线远离数据驱动器的一端连接有i列信号线，各扫描线分别与设置在显示区域中的每行像素单元电连接，各信号线分别与设置在显示区域中的每列像素单元电连接；各信号线中连接数据线与显示区域的区段内还连接有第一晶体管，所述数据驱动电路还包括连接数据驱动器的控制线；与同一数据线连接的i个第一晶体管的栅极分别与控制线电连接；所述数据驱动电路还包括电源线，以及连接在所述电源线上的m(i-1)/i个第二晶体管，即(m-m/i)个第二晶体管。所述电源线用于连接至电源；第二晶体管的源极与所述电源线电连接，所述第二晶体管的漏极分别电连接至与同一数据线连接的i列信号线中的i-1列信号线上，连接点位于第一晶体管与显示区域之间；所述第二晶体管的栅极电连接至未连接所述第二晶体管漏极的所述控制线上。通过在信号线中接入补偿电源使得像素单元初始化，以减少像素单元中寄生电容的影响，从而有效提高应用其的所述有机发光显示器的响应特性和显示特性。
附图说明
为了使本发明的内容更容易被清楚的理解，下面根据本发明的具体实施例并结合附图，对本发明作进一步详细的说明，其中
图1是现有技术中一种有机发光显示器件的数据驱动电路图；
图2是现有技术中另一种有机发光显示器件的数据驱动电路图；
图3是图2和图6中所述数据驱动电路图的控制信号时序图；
图4是现有技术中另一种有机发光显示器件的数据驱动电路图；
图5是图4和图7中所述数据驱动电路图的控制信号时序图；
图6是本发明实施例1中所述数据驱动电路图；
图7是本发明实施例2中所述数据驱动电路图。
图中附图标记表示为：20-数据驱动器、30-扫描驱动器、40-显示区域、50-电源线、Vref-电源、D1-第1列数据线、D2-第2列数据线、D(m-1)-第m-1列数据线、Dm-第m列数据线、D(m/2)-第m/2列数据线、D(m/3)-第m/3列数据线、S1-第1行扫描线、S2-第2行扫描线、Sn-第n行扫描线、D1’-第1列信号线、D2’-第2列信号线、Dm-1’-第m-1列信号线、Dm’-第m列信号线、T1-第1列第一晶体管、T2-第2列第一晶体管、Tm-1-第m-1列第一晶体管、Tm-第m列第一晶体管、T2’-第2列第二晶体管、T3’-第3列第二晶体管、Tm-1’-第m-1列第二晶体管、Tm’-第m列第二晶体管、Sel_1-第1行控制线、Sel_2-第2行控制线、Sel_3-第3行控制线；11、12、13…1(m-2)、1(m-1)、1m、21、22、23…2(m-2)、2(m-1)、2m…n1、n2、n3…n(m-2)、n(m-1)、nm-像素单元。
具体实施方式
为使本发明的目的、技术方案和优点更加清楚，下面将结合附图对本发明实施方式作进一步地详细描述。
以下参照附图描述根据本发明的特定示例性实施例。这里，当将第一元件描述为“连接”到第二元件时，第一元件可以直接连接至第二元件，或经过一个或多个附加元件间接连接至第二元件。进一步的，为了清楚起见，简明省略了对于充分理解本发明而言不是必须的某些元件。此外，相同的附图标记始终指代相同的元件。
实施例1
本实施例提供一种数据驱动电路，如图6所示，所述数据驱动电路通过m/i列数据线D1、…D(m/2)与数据驱动器20电连接、通过n行扫描线S1、S2、…Sn与扫描驱动器30电连接，本实施例中，i的取值为2。
第1列数据线D1远离数据驱动器20的一端连接有第1列信号线D1’和第2列信号线D2’，相同的，第j列数据线Dj远离数据驱动器20的一端连接有第2j-1列信号线D2j-1’和第2j列信号线D2j’，j＝1、2、3、…m/2；第m/2列数据线D(m/2)远离数据驱动器20的一端连接有2根信号线：第m-1列信号线Dm-1’和第m列信号线Dm’。所述数据驱动电路还包括设置在显示区域40中各像素单元11、12、…1(m-1)、1m、21、22…2(m-1)、2m…n1、n2…n(m-1)、nm，本实施例中所述显示区域40中设置有n行m列所述像素单元，各所述扫描线S1、S2…Sn分别与设置在显示区域40中的每行所述像素单元电连接，各所述信号线D1’、D2’、…Dm-1’、Dm’分别与设置在所述显示区域40中的每列所述像素单元电连接。即第m列信号线Dm’与第n行扫描线Sn均连接至第n行第m列的所述像素单元nm。
各所述信号线D1’、D2’、…Dm-1’、Dm’中连接所述数据线D(m/2)与所述显示区域40的区段内还连接有第一晶体管T1、T2、…Tm-1、Tm，所述数据驱动电路还包括连接数据驱动器20的2行控制线Sel_1、Sel_2；所述第一晶体管T1、T2、…Tm-1、Tm优选为P型晶体管。
与第1列数据线D1连接的2个第一晶体管T1、T2的栅极分别与不同的控制线Sel_1、Sel_2电连接；
相同的，与同一所述数据线Dj连接的2个第一晶体管T2j-1、T2j的栅极分别与不同的控制线Sel_1、Sel_2电连接,j＝1、2、3、…m/2；
与第m/2列数据线D(m/2)连接的2个第一晶体管Tm-1、Tm的栅极分别与控制线Sel_1、Sel_2电连接。
所述数据驱动电路还包括电源线50，以及与所述电源线50连接的m/2个第二晶体管T2’、…Tm’，所述电源线50用于连接至电源Vref；所述电源Vref的电压值小于或等于0V，本实施例优选为0V。
各所述第二晶体管T2’、…Tm’的源极均与所述电源线50电连接，栅极电连接至同一行所述控制线Sel_1；第j列所述第二晶体管Tj’的漏极分别电连接至第j列信号线Dj’上，连接点位于第j列所述第一晶体管Tj与所述显示区域40之间,j＝2、4、6、…、m。即，第2列第二晶体管T2’的源极与所述电源线50电连接，其漏极连接至第2列信号线D2’上，连接点位于第2列第一晶体管T2与所述显示区域40之间。
连接同一所述信号线D2’、D4’、…Dm-2’、Dm’的所述第一晶体管T2、T4、…Tm-2、Tm与所述第二晶体管T2’、T4’、…Tm-2’、Tm’的栅极连接不同的所述控制线，在本实施例中分别连接Sel_2、Sel_1。具体的，本实施例中，所述第2列第二晶体管T2’的栅极电连接至所述控制线Sel_1上，同列的第一晶体管T2的栅极连接至所述控制线Sel_2上；….所述第m列第二晶体管Tm’的栅极电连接至所述控制线Sel_1上，同列的第一晶体管Tm的栅极连接至所述控制线Sel_2上。
所有所述第二晶体管T2’、…Tm’为沟道极性相同的场效应管，本实施例中优选为P型场效应管。
作为本发明的其他实施例，数据线可以为m/i列，与每列数据线端部连接的信号线可以为i列，所述控制线为i行，所述第二晶体管的数量为m(i-1)/i个，也可以说第二晶体管的数量为(m-m/i)个，i为大于或等于2的自然数，m为i的整数倍非零自然数，均可以实现本发明的目的，属于本发明的保护范围。
所述数据驱动电路的驱动方法为，将每列数据线的数据信号写入周期(Tj，j＝1、2、3…n)分为i个时间阶段，本实施例为2个时间段(t1、t2)，以第二行像素单元为例，如图3所示：
第1列数据线D1的数据信号写入周期T1，第1列数据线D1传输高电平。
在t1时间内，所述控制线Sel_1低电平、所述控制线Sel_2高电平，第1列第一晶体管T1、第2列第二晶体管T2’打开，第2列第一晶体管T2关闭；第1列数据线D1高电平传送到显示区域40内的第1列信号线D1’上，信号线D1’上的数据信号加载到第1列像素单元11、21、…n1；第2列信号线D2’连接到电源Vref上，第2列信号线D2’被初始化，加载至第2列像素单元12、22、…n2的电压为0V。
在t2时间内，所述控制线Sel_2低电平、所述控制线Sel_1高电平，第2列第一晶体管T2打开，第1列第一晶体管T1、第2列第二晶体管T2’关闭；第1列数据线D1高电平信号传送到显示区域40内的第2列信号线D2’上，信号线D2’上的数据信号加载到第2列像素单元12、22、…n2。
第2列数据线D1的数据信号写入周期T2，第1列数据线D1传输低电平。
在t3时间内，所述控制线Sel_1低电平、所述控制线Sel_2高电平，第1列第一晶体管T1、第2列第二晶体管T2’打开，第2列第一晶体管T2关闭；第1列数据线D1的低电平传送到显示区域40内的第1列信号线D1’上，第1列像素单元11、21、…n1被施加低电平；第2列信号线D2’连接到电源Vref上，第2列像素单元12、22、…n2在数据信号写入周期T1内的高电平被初始化为0V。
在t4时间内，所述控制线Sel_2低电平、所述控制线Sel_1高电平，第2列第一晶体管T2打开，第1列第一晶体管T1、第2列第二晶体管T2’关闭；第1列数据线D1的低电平传送到显示区域40内的第2列信号线D2’上；由于在t3时间内，第2列像素单元12、22、…n2的电压被初始化为0V，所以在t4时间，第2列像素单元12、22、…n2能够接受第2列信号线D2’的有效低电平信号。
因此，应用所述数据驱动电路的所述有机发光显示器件可以不受来自信号线与像素单元中的寄生电容影响，响应及时且无残影现象产生，正常显示。
实施例2
本实施例提供一种数据驱动电路，如图7所示，具体电路结构同实施例1，唯一不同的是i为3,即每列数据线远离所述数据驱动器20的一端连接有3列信号线，所述控制线为3行，所述第二晶体管的数量为2m/3个，m为3的整数倍非零自然数。
具体的，第1列数据线D1远离数据驱动器20的一端连接有第1列信号线D1’、第2列信号线D2’和第3列信号线D3’，相同的，第j列数据线Dj远离数据驱动器20的一端连接有第3j-2列信号线D3j-2’、第3j-1列信号线D3j-1’和第3j列信号线D3j’，j＝1、2、3、…m/3；第m/3列数据线D(m/3)远离数据驱动器20的一端连接有3根信号线：第m-2列信号线Dm-2’、第m-1列信号线Dm-1’和第m列信号线Dm’。
各所述信号线D1’、D2’、…Dm-1’、Dm’中连接所述数据线D(m/3)与所述显示区域40的区段内还连接有第一晶体管T1、T2、…Tm-1、Tm，所述数据驱动电路还包括连接数据驱动器20的3行控制线Sel_1、Sel_2、Sel_3；所述第一晶体管T1、T2、…Tm-1、Tm优选为P型晶体管。
与第1列数据线D1连接的3个第一晶体管T1、T2、T3的栅极分别与不同的控制线Sel_1、Sel_2、Sel_3电连接；
相同的，与同一所述数据线Dj连接的3个第一晶体管T3j-2、T3j-1、T3j的栅极分别与不同的控制线Sel_1、Sel_2、Sel_3电连接,j＝1、2、3、…m/3；
与第m/3列数据线D(m/3)连接的3个第一晶体管Tm-2、Tm-1、Tm的栅极分别与控制线Sel_1、Sel_2、Sel_3电连接。
所述数据驱动电路还包括电源线50，以及与所述电源线50连接的2m/3个第二晶体管T2’T3’、…Tm-1’、Tm’，所述电源线50用于连接至电源Vref；所述电源Vref的电压值小于或等于0V，本实施例优选为0V。
也就是说，每一列数据线远离数据驱动器20的一端所连接的3根信号线中，后两根信号线与电源线50之间会分别设置一第二晶体管，例如，数据线D1连接3根信号线D1’、D2’、D3’，信号线D2’和D3’与电源线50之间分别设置第二晶体管T2’和T3’，依次类推，数据线D(m/3)连接3根信号线Dm-2’、Dm-1’、Dm’，信号线Dm-1’和Dm’与电源线50之间分别设置第二晶体管Tm-1’和Tm’.
具体的，各所述第二晶体管T2’T3’、…Tm-1’、Tm’的源极均与所述电源线50电连接，栅极电连接至同一行所述控制线Sel_1；第j列所述第二晶体管Tj’的漏极分别电连接至第j列信号线Dj’上，连接点位于第j列所述第一晶体管Tj与所述显示区域40之间,j＝2、3、5、6、…、m-1、m。即，第2列第二晶体管T2’的源极与所述电源线50电连接，其漏极连接至第2列信号线D2’上，连接点位于第2列第一晶体管T2与所述显示区域40之间。
连接同一所述信号线D2’、D3’、…Dm-1’、Dm’的所述第一晶体管T2、T3、…Tm-1、Tm与所述第二晶体管T2’、T3’、…Tm-1’、Tm’的栅极连接不同的所述控制线。
所有所述第二晶体管T2’、…Tm’为沟道极性相同的场效应管，本实施例中优选为P型场效应管。
作为本发明的其他实施例，数据线可以为m/i列，与每列数据线端部连接的信号线可以为i列，所述控制线为i行，所述第二晶体管的数量为m(i-1)/i个，也可以说第二晶体管的数量为(m-m/i)个，i为大于或等于2的自然数，m为i的整数倍非零自然数，均可以实现本发明的目的，属于本发明的保护范围。
所述数据驱动电路的驱动方法，如图5所示，将每列数据线数据信号写入周期(Tj，j＝1、2、3…n)分为3个时间阶段。
在t1时间内，各所述控制线Sel_1低电平，所述控制线Sel_2、Sel_3高电平，第1列第一晶体管T1、第2列第二晶体管T2’、第3列第二晶体管T3’打开，第2列第一晶体管T2、第3列第一晶体管T3关闭；
第1列信号线D1’上的数据信号会分别加载到第1列像素单元11、21、…n1，第2列信号线D2’、第3列信号线D3’连接到电源Vref上，第2列像素单元12、22、…n2以及第3列像素单元13、23、…n3的电压被初始化为0V。
在t2时间内，所述控制线Sel_2低电平，所述控制线Sel_1、所述控制线Sel_3高电平，第2列第一晶体管T2打开，第1列第一晶体管T1、第2列第二晶体管T2’、第3列第一晶体管T3、第3列第二晶体管T3’关闭；
第1列数据线D1的电平信号传送到显示区域40内的第2列信号线D2’上，信号线D2’上的数据信号加载到第2列像素单元12、22、…n2。
在t3时间内，所述控制线Sel_3低电平，所述控制线Sel_1、所述控制线Sel_2高电平，第3列第一晶体管T3打开，第1列第一晶体管T1、第2列第一晶体管T2、第2列第二晶体管T2’、第3列第二晶体管T3’关闭；第3列信号线D3’上的数据信号会分别加载到第3列像素单元13、23、…n3上。
这就使得，在下一列数据线数据信号写入周期开始前，每列信号线所在列的像素单元被初始化，不受来自像素单元和信号线中的寄生电容影响，响应及时且无残影现象产生，确保正常显示。
本发明还提供了一种包括上述数据驱动电路的有机发光显示器，具体结构不再赘述。所述有机发光显示器不受来自像素单元和信号线中的寄生电容影响，响应及时且无残影现象产生。
显然，上述实施例仅仅是为清楚地说明所作的举例，而并非对实施方式的限定。对于所属领域的普通技术人员来说，在上述说明的基础上还可以做出其它不同形式的变化或变动。这里无需也无法对所有的实施方式予以穷举。而由此所引伸出的显而易见的变化或变动仍处于本发明的保护范围之中。

Claims (9)

1.一种数据驱动电路，通过m/i列数据线与数据驱动器电连接、通过n行扫描线与扫描驱动器电连接；
各数据线远离数据驱动器的一端连接有i列信号线，各扫描线分别与设置在显示区域中的每行像素单元电连接，各信号线分别与设置在显示区域中的每列像素单元电连接；
各信号线中连接数据线与显示区域的区段内还连接有第一晶体管，所述数据驱动电路还包括连接数据驱动器的i行控制线；
与同一数据线连接的i个第一晶体管的栅极分别电连接至不同的控制线；
i为大于或等于2的自然数，m为i的整数倍非零自然数，n为非零自然数；
其特征在于，
所述数据驱动电路还包括电源线，以及与所述电源线连接的m-m/i个第二晶体管，所述电源线用于连接至电源；
各所述第二晶体管的源极均与所述电源线电连接，各所述第二晶体管的栅极电连接至同一行所述控制线；所述第二晶体管的漏极分别电连接至不同的所述信号线，连接点位于所述第一晶体管与所述显示区域之间；
连接同一所述信号线的所述第一晶体管与所述第二晶体管的栅极连接不同的所述控制线。
2.根据权利要求1所述的数据驱动电路，其特征在于，所述电源的电压值小于或等于0V。
3.根据权利要求1所述的数据驱动电路，其特征在于，所有所述第一晶体管均为P型晶体管。
4.根据权利要求1-3任一所述的数据驱动电路，其特征在于，所有所述第二晶体管为沟道极性相同的场效应管。
5.根据权利要求4所述的数据驱动电路，其特征在于，所述第二晶体管为P型场效应管。
6.一种权利要求1-5任一项所述的数据驱动电路的驱动方法，其特征在于，将每列所述数据线的数据信号写入周期分为i个时间阶段；在每个所述时间阶段，各所述控制线顺次设置为低电平；
在第1个所述时间阶段，与低电平的所述控制线连接的第二晶体管打开，与所述第二晶体管连接的所述信号线与所述电源导通，其所在列的各像素单元被初始化。
7.根据权利要求6所述的驱动方法，其特征在于，在每个所述时间阶段，与低电平的所述控制线连接的第一晶体管打开，与所述第一晶体管连接的所述信号线与所述数据线导通，其所在列的各像素单元数据信号写入。
8.根据权利要求6所述的驱动方法，其特征在于，所述初始化的电压值小于或等于0V。
9.一种有机发光显示器，其特征在于，包括权利要求1-5任一所述的数据驱动电路。
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