JP7099789B2 - Printed circuit board - Google Patents
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Description
本発明は、プリント回路基板に関する。 The present invention relates to a printed circuit board.
電子部品の高機能化、軽薄短小化への要求に伴って、電子部品の内部に装着されるプリント回路基板においても高機能化、軽薄短小化が要求されている。プリント回路基板の軽薄短小化のためには、回路パターンを微細に設計し、内部に様々な機能を担う半導体素子を配置して高機能化を実現している。 With the demand for higher functionality and lighter, thinner, shorter and smaller electronic components, there is also a demand for higher functionality and lighter, thinner, shorter and smaller printed circuit boards mounted inside electronic components. In order to make the printed circuit board lighter, thinner, shorter, and smaller, the circuit pattern is designed finely, and semiconductor elements that carry out various functions are arranged inside to achieve high functionality.
プリント回路基板の内部に半導体素子を配置するためには、基板の内部にキャビティを形成することができ、キャビティの下部にバンプ構造物を形成して、半導体素子と回路パターンとの間の電気的な信号伝逹を可能にすることができる。 In order to place the semiconductor element inside the printed circuit board, a cavity can be formed inside the substrate, a bump structure is formed at the bottom of the cavity, and the electrical between the semiconductor element and the circuit pattern. It is possible to enable various signal transmission.
一方、チップが配置されたプリント回路基板は、上下に積層されることにより積層型パッケージ又はパッケージオンパッケージ(POP、Package On Package)等の半導体パッケージを形成することができる。
なお、積層型パッケージの場合は、チップの厚さにより上下パッケージ間の間隔が一定に維持され積層される構造であって、一定の間隔を維持するために金属ポスト等の構造物を用いることができる。
On the other hand, the printed circuit board on which the chips are arranged can be laminated vertically to form a semiconductor package such as a laminated package or a package-on-package (POP, Package On Package).
In the case of a laminated package, the structure is such that the space between the upper and lower packages is maintained at a constant level depending on the thickness of the chip, and a structure such as a metal post may be used to maintain the constant space. can.
本発明の一側面に係るプリント回路基板は、金属ポスト上に金属ポストが形成され、電子素子に接続される接続部を含むことができる。ここで、接続部と下部金属ポストの高さを同一に形成することで、接続部及び、金属ポストの一部を露出させる保護層の厚さを容易に調整することができる。 The printed circuit board according to one aspect of the present invention may include a connection portion in which a metal post is formed on a metal post and is connected to an electronic element. Here, by forming the height of the connecting portion and the lower metal post to be the same, the thickness of the connecting portion and the protective layer that exposes a part of the metal post can be easily adjusted.
本明細書で使用した用語は、ただ特定の実施例を説明するために使用したものであり、本発明を限定するものではない。単数の表現は、文脈上明白に異なる意味ではない限り、複数の表現を含む。
本願において、ある部分がある構成要素を「含む」とする場合、これは特に言及しない限り、他の構成要素を除外することではなく、他の構成要素をさらに含むことができることを意味する。
The terms used herein are used solely to illustrate specific embodiments and are not intended to limit the invention. A singular expression includes multiple expressions unless they have distinctly different meanings in the context.
In the present application, when a component is referred to as "contains" a component, this does not mean that the other component is excluded, but that the other component can be further included, unless otherwise specified.
また、明細書の全般において、「上に」とは、対象部分の上または下に位置することを意味し、必ずしも重力方向を基準にして上側に位置することを意味するものではない。
また、「結合」とは、各構成要素の間の接触関係において、各構成要素の間に物理的に直接接触する場合のみを意味するものではなく、他の構成が各構成要素の間に介在され、その他の構成に構成要素がそれぞれ接触している場合まで包括する概念として使用する。
本明細書において、第1、第2等の用語は、多様な構成要素を説明するために使用され、上記構成要素が上記用語により限定されることはない。上記用語は、一つの構成要素を他の構成要素から区別する目的にだけに使用される。
Further, in the whole specification, "above" means that it is located above or below the target portion, and does not necessarily mean that it is located above or above the gravity direction.
Further, "bonding" does not mean only the case where each component is in direct physical contact with each other in the contact relationship between the components, and other components intervene between the components. It is used as an inclusive concept until the components are in contact with each other.
In the present specification, terms such as 1st and 2nd are used to describe various components, and the above components are not limited by the above terms. The above term is used only for the purpose of distinguishing one component from the other.
図面に示された各構成の大きさ及び厚さは、説明の便宜上、任意で示したものであって、本発明が必ずしもそれらに限定されることはない。
以下に、本発明に係るプリント回路基板及びその製造方法の実施例を添付図面に基づいて詳細に説明し、添付図面に基づいて説明するに当たって、同一または対応する構成要素には同一の図面符号を付し、これについての重複説明を省略する。
The sizes and thicknesses of the configurations shown in the drawings are optional for convenience of explanation, and the present invention is not necessarily limited thereto.
Hereinafter, examples of the printed circuit board and the method for manufacturing the printed circuit board according to the present invention will be described in detail with reference to the accompanying drawings, and the same drawing reference numerals will be given to the same or corresponding components in the description based on the attached drawings. It is attached, and the duplicate explanation about this is omitted.
[実施例]
[第1実施例]
図1は、本発明の第1実施例に係るプリント回路基板1000を概略的に示す断面図であり、図2は、本発明の第1実施例に係るプリント回路基板1000の一部を拡大した拡大図である。
図1及び図2を参照すると、第1実施例に係るプリント回路基板1000は、回路パターン1と、絶縁層10と、第1保護層20と、第1金属ポスト100と、第2金属ポスト200と、接続部300と、を含む。
[Example]
[First Example]
FIG. 1 is a sectional view schematically showing a printed
Referring to FIGS. 1 and 2, the printed
回路パターン1は、絶縁層10の内部に形成され、絶縁層10から一面が露出するように形成されることができる。
第1金属ポスト100は、回路パターン1上に形成可能であり、絶縁層10から露出された一面に形成されることができる。
第1金属ポスト100は、一定の高さで形成され、パッケージ上にパッケージを積層するに使用されることができる。
The
The
The
接続部300は、絶縁層10から一面が露出された回路パターン1の一面に形成されることができ、電子素子が配置され、電子素子との電気的な信号伝逹を必要とする回路パターン1上に形成されることができる。
接続部300は、プリント回路基板1000に配置される電子素子との電気的な接続のために、絶縁層10から突出して形成されることができる。
一方、接続部300の高さh1は、第1金属ポスト100の高さh2と実質的に同一の高さで形成されることができる。
The
The
On the other hand, the height h1 of the connecting
第1保護層20は、絶縁層10上に形成され、第1金属ポスト100の一部または接続部300の一部が露出するように、開口部を形成することができる。
第1保護層20から第1金属ポスト100の一部または接続部300の一部が露出するように、第1保護層20の一部をエッチングして除去することができる。
したがって、第1金属ポスト100の高さは、上記第1保護層20の高さよりも高く形成されることができる。
第1保護層20は、ソルダーレジスト層を含む概念である。
The first
A part of the first
Therefore, the height of the
The first
第2金属ポスト200は、第1金属ポスト100上に形成可能であり、例えば、第1保護層20の開口部から一部が露出した第1金属ポスト100上に形成されることができる。
第1金属ポスト100を形成した後に第2金属ポスト200が形成され、第1金属ポスト100の幅W1と第2金属ポスト200の幅W2とは互いに異なってもよい。
本発明の第1実施例に係るプリント回路基板において、第1金属ポスト100の幅W1は、第2金属ポスト200の幅W2よりも狭く形成されることができる。
第1金属ポスト100と第2金属ポスト200は、同一の材質で形成されてもよく、または相互異なる材質で形成されてもよい。
The
The
In the printed circuit board according to the first embodiment of the present invention, the width W1 of the
The
第1金属ポスト100と第2金属ポスト200は、実質的に同一の高さで形成されることができる。第1金属ポスト100の高さまたは第2金属ポスト200の高さは、上記回路パターン1の高さよりも高く形成されることができる。第1金属ポスト100または第2金属ポスト200は、銅(Cu)で形成されることができ、その材質に制限はない。
The
第2保護層30は、第1保護層20上に形成可能であり、接続部300の側面及び第2金属ポスト200の一部が露出するように、開口部が形成されることができる。
The second
本発明の実施例によれば、金属ポストと接続部との高さの差による保護層の高さを異なるように形成することが容易である。 According to the embodiment of the present invention, it is easy to form the protective layer so that the height of the protective layer differs due to the difference in height between the metal post and the connecting portion.
金属ポストの高さが接続部の高さよりも高く形成される場合、金属ポストの周辺に形成される保護層は接続部の周辺よりも厚く形成される必要がある。 If the height of the metal post is formed higher than the height of the connection, the protective layer formed around the metal post needs to be formed thicker than the periphery of the connection.
従来技術によれば、位置に応じて保護層のエッチングの程度を異なるようにして、金属ポストの周辺に形成される保護層を接続部の周辺よりも厚く形成している。
上記のように、エッチングの程度を位置に応じて異なるようにすることは、保護層の厚さが均一に形成されないという問題点を有する。
本発明の実施例によれば、接続部300を第1金属ポスト100と同一の高さで形成し、接続部と金属ポストとの高さの差による第1保護層のエッチングの深さの制御問題を解決することができる。
[第2実施例]
According to the prior art, the degree of etching of the protective layer is made different depending on the position, and the protective layer formed around the metal post is formed thicker than the periphery of the connection portion.
As described above, making the degree of etching different depending on the position has a problem that the thickness of the protective layer is not uniformly formed.
According to the embodiment of the present invention, the
[Second Example]
図3は、本発明の第2実施例に係るプリント回路基板2000を概略的に示す断面図であり、図4は、本発明の第2実施例に係るプリント回路基板2000の一部を拡大した拡大図である。
図3及び図4を参照すると、第2実施例に係るプリント回路基板2000において、第1金属ポスト100の幅W1は、第2金属ポスト200の幅W2よりも広く形成されることができる。
第2金属ポスト200は、第1金属ポスト100が形成された後に形成され、その幅が異なる。
[第3実施例]
FIG. 3 is a sectional view schematically showing the printed
Referring to FIGS. 3 and 4, in the printed
The
[Third Example]
図5は、本発明の第3実施例に係るプリント回路基板3000を概略的に示す断面図である。
図5を参照すると、第3実施例に係るプリント回路基板3000は、第2金属ポスト200上に形成される第3金属ポスト400をさらに含むことができる。
一方、本発明の一実施例に係るプリント回路基板に形成される金属ポストは、その積層数を制限せずに形成することができる。
FIG. 5 is a sectional view schematically showing a printed
Referring to FIG. 5, the printed
On the other hand, the metal post formed on the printed circuit board according to the embodiment of the present invention can be formed without limiting the number of layers thereof.
<プリント回路基板の製造方法>
図6aから図6hは、本発明の一実施例に係るプリント回路基板の製造工程を概略的に示す断面図である。
以下では、図6aから図6hを参照して、本発明の一実施例に係るプリント回路基板の製造工程を説明する。
<Manufacturing method of printed circuit board>
6a to 6h are sectional views schematically showing a manufacturing process of a printed circuit board according to an embodiment of the present invention.
Hereinafter, the manufacturing process of the printed circuit board according to the embodiment of the present invention will be described with reference to FIGS. 6a to 6h.
図6aを参照すると、本発明の一実施例に係るプリント回路基板の製造工程は、回路パターン1が形成された絶縁層10の一面にシード層7を形成するステップを含むことができる。
一方、絶縁層10に回路パターン1を形成する方法は、アディティブ法(additive process)、セミアディティブ法(SAP、semi additive process)、モディファイドセミアディティブ法(MSAP、modified semi additive process)、サブトラックティブ法(Subtractive Process)等を用いて形成することができ、その方法に制限はない。
シード層7を形成するステップにおいてシード層7は、デタッチコア基板が除去された絶縁層10の一面に形成されることができる。
Referring to FIG. 6a, the process of manufacturing a printed circuit board according to an embodiment of the present invention can include a step of forming a
On the other hand, the methods for forming the
In the step of forming the
図6bを参照すると、本発明の一実施例に係るプリント回路基板の製造工程は、シード層7上に第1金属ポスト100、接続部300を形成するステップを含むことができる。
第1金属ポスト100、接続部300を形成するステップにおいて、第1金属ポスト100と接続部300は、回路パターンを形成する方式と同一のメッキ工程により行われることができる。
第1金属ポスト100、接続部300は、同一のメッキ工程により形成され、その高さが実質的に同一に形成されることができる。
Referring to FIG. 6b, the process of manufacturing a printed circuit board according to an embodiment of the present invention can include a step of forming a
In the step of forming the
The
図6cを参照すると、本発明の一実施例に係るプリント回路基板の製造工程は、シード層7を除去するステップを含むことができる。
シード層7は、エッチング液を用いて除去することができ、エッチング液は、シード層7のみを選択的に除去することができる。
Referring to FIG. 6c, the process of manufacturing a printed circuit board according to an embodiment of the present invention can include a step of removing the
The
図6dを参照すると、本発明の一実施例に係るプリント回路基板の製造工程は、シード層7が除去された絶縁層10の一面に第1保護層20を形成するステップを含むことができる。
第1保護層20は、第1金属ポスト100及び接続部300の高さよりも高い高さS1で絶縁層10上に積層されることができる。
Referring to FIG. 6d, the process of manufacturing a printed circuit board according to an embodiment of the present invention can include a step of forming a first
The first
図6eを参照すると、本発明の一実施例に係るプリント回路基板の製造工程は、接続部300の一部と第1金属ポスト100の一部とが第1保護層20から露出するように、第1保護層20をエッチングするステップを含むことができる。
第1金属ポスト100の高さと接続部300の高さとは、実質的に同一であるので、接続部300の周辺に形成される第1保護層20の高さと第1金属ポスト100の周辺に形成される第1保護層20の高さを異なるように形成する必要がない。
Referring to FIG. 6e, in the process of manufacturing a printed circuit board according to an embodiment of the present invention, a part of the
Since the height of the
図6fを参照すると、本発明の一実施例に係るプリント回路基板の製造工程は、第1金属ポスト100上に第2金属ポスト200を形成するステップを含むことができる。
第2金属ポスト200は、第1金属ポスト100上に形成され、一定の高さ以上の金属ポストを形成することができる。
Referring to FIG. 6f, the process of manufacturing a printed circuit board according to an embodiment of the present invention can include a step of forming a
The
図6gを参照すると、本発明の一実施例に係るプリント回路基板の製造工程は、第1保護層20上に第2保護層30を形成するステップを含むことができる。
第2保護層30は、電子素子を配置するための空間を確保して形成することができる。このため、第2保護層30は、第2金属ポスト200上に形成され、接続部300上の電子素子が配置される部分を除いて形成されることが好ましい。
Referring to FIG. 6g, the process of manufacturing a printed circuit board according to an embodiment of the present invention can include a step of forming a second
The second
図6hを参照すると、本発明の一実施例に係るプリント回路基板の製造工程は、第2保護層30の一部をエッチングして第2金属ポスト200の一部が露出するように開口部35を形成するステップを含むことができる。
第2金属ポスト200の一部が露出されて、電気的な接続が可能となるようにできる。
Referring to FIG. 6h, in the process of manufacturing the printed circuit board according to the embodiment of the present invention, the
A portion of the
本発明の実施例に係るプリント回路基板の製造工程は、金属ポストと接続部との高さの差による周辺の保護層の厚さの制御問題をより容易に解決することができる。
本発明の実施例に係るプリント回路基板は、金属ポストが多重積層される構造を有することができ、金属ポストが単一の構造物で形成される構造に比べてプリント回路基板の積層をより安定に行うことができる。
The printed circuit board manufacturing process according to the embodiment of the present invention can more easily solve the problem of controlling the thickness of the peripheral protective layer due to the difference in height between the metal post and the connection portion.
The printed circuit board according to the embodiment of the present invention can have a structure in which metal posts are multi-stacked, and the stacking of printed circuit boards is more stable than in a structure in which the metal posts are formed by a single structure. Can be done.
以上、本発明の一実施例について説明したが、当該技術分野で通常の知識を有する者であれば特許請求の範囲に記載の本発明の思想から逸脱しない範囲内で、構成要素の付加、変更、削除または追加等により本発明を様々に修正及び変更することができ、これも本発明の権利範囲内に含まれるものといえよう。 Although one embodiment of the present invention has been described above, if the person has ordinary knowledge in the technical field, addition or modification of the constituent elements is made within the range not deviating from the idea of the present invention described in the claims. The present invention can be variously modified and modified by deletion, addition, etc., and it can be said that this is also included in the scope of the present invention.
1 回路パターン
10 絶縁層
20 第1保護層
30 第2保護層
35 開口部
100 第1金属ポスト
200 第2金属ポスト
300 接続部
1000、2000、3000 プリント回路基板
1
Claims (10)
前記絶縁層の内部に形成され、前記絶縁層の一面から露出する回路パターンと、
前記回路パターン上に形成され、平面上において前記絶縁層のセンター領域に配置される接続部と、
前記回路パターン上に形成され、平面上において前記絶縁層のセンター領域を囲むサイド領域に配置される第1金属ポストと、
前記絶縁層上に形成され、前記第1金属ポストまたは前記接続部の一部が露出するように開口部が形成された第1保護層と、
前記第1保護層に形成された開口部から露出する第1金属ポスト上に形成され、前記第1金属ポストの上面と前記第1金属ポストの側面の一部とを覆う第2金属ポストと、を含み、
前記第2金属ポストは、前記第1保護層の一部を覆い、
前記第1金属ポストの高さは、前記第1保護層の高さよりも高く形成されるプリント回路基板。 Insulation layer and
A circuit pattern formed inside the insulating layer and exposed from one surface of the insulating layer ,
A connection portion formed on the circuit pattern and arranged in the center region of the insulating layer on a plane ,
A first metal post formed on the circuit pattern and arranged in a side region surrounding the center region of the insulating layer on a plane.
A first protective layer formed on the insulating layer and having an opening so as to expose a part of the first metal post or the connecting portion.
A second metal post formed on a first metal post exposed from an opening formed in the first protective layer and covering an upper surface of the first metal post and a part of a side surface of the first metal post. Including
The second metal post covers a part of the first protective layer.
A printed circuit board formed so that the height of the first metal post is higher than the height of the first protective layer.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR10-2016-0096084 | 2016-07-28 | ||
KR1020160096084A KR102559345B1 (en) | 2016-07-28 | 2016-07-28 | Printed circuit board |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2018019077A JP2018019077A (en) | 2018-02-01 |
JP7099789B2 true JP7099789B2 (en) | 2022-07-12 |
Family
ID=61075174
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2017131564A Active JP7099789B2 (en) | 2016-07-28 | 2017-07-04 | Printed circuit board |
Country Status (2)
Country | Link |
---|---|
JP (1) | JP7099789B2 (en) |
KR (1) | KR102559345B1 (en) |
Families Citing this family (2)
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-
2016
- 2016-07-28 KR KR1020160096084A patent/KR102559345B1/en active IP Right Grant
-
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---|---|
JP2018019077A (en) | 2018-02-01 |
KR20180013018A (en) | 2018-02-07 |
KR102559345B1 (en) | 2023-07-25 |
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Legal Events
Date | Code | Title | Description |
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A621 | Written request for application examination |
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A977 | Report on retrieval |
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A131 | Notification of reasons for refusal |
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C60 | Trial request (containing other claim documents, opposition documents) |
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A911 | Transfer to examiner for re-examination before appeal (zenchi) |
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C21 | Notice of transfer of a case for reconsideration by examiners before appeal proceedings |
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TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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A61 | First payment of annual fees (during grant procedure) |
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|
R150 | Certificate of patent or registration of utility model |
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