Nothing Special   »   [go: up one dir, main page]

JP2022119993A - データ符号化方法及び装置、記憶媒体、並びにプロセッサ - Google Patents

データ符号化方法及び装置、記憶媒体、並びにプロセッサ Download PDF

Info

Publication number
JP2022119993A
JP2022119993A JP2022091958A JP2022091958A JP2022119993A JP 2022119993 A JP2022119993 A JP 2022119993A JP 2022091958 A JP2022091958 A JP 2022091958A JP 2022091958 A JP2022091958 A JP 2022091958A JP 2022119993 A JP2022119993 A JP 2022119993A
Authority
JP
Japan
Prior art keywords
ldpc
matrix
bit
sequence
real number
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2022091958A
Other languages
English (en)
Other versions
JP7565976B2 (ja
Inventor
リー,リーグアン
Liguang Li
シュー,ジュン
Jun Xu
シュー,ジン
Jin Xu
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
ZTE Corp
Original Assignee
ZTE Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by ZTE Corp filed Critical ZTE Corp
Publication of JP2022119993A publication Critical patent/JP2022119993A/ja
Application granted granted Critical
Publication of JP7565976B2 publication Critical patent/JP7565976B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L1/00Arrangements for detecting or preventing errors in the information received
    • H04L1/004Arrangements for detecting or preventing errors in the information received by using forward error control
    • H04L1/0041Arrangements at the transmitter end
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M13/00Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
    • H03M13/03Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words
    • H03M13/05Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words using block codes, i.e. a predetermined number of check bits joined to a predetermined number of information bits
    • H03M13/11Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words using block codes, i.e. a predetermined number of check bits joined to a predetermined number of information bits using multiple parity bits
    • H03M13/1102Codes on graphs and decoding on graphs, e.g. low-density parity check [LDPC] codes
    • H03M13/1148Structural properties of the code parity-check or generator matrix
    • H03M13/116Quasi-cyclic LDPC [QC-LDPC] codes, i.e. the parity-check matrix being composed of permutation or circulant sub-matrices
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M13/00Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
    • H03M13/03Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words
    • H03M13/05Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words using block codes, i.e. a predetermined number of check bits joined to a predetermined number of information bits
    • H03M13/11Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words using block codes, i.e. a predetermined number of check bits joined to a predetermined number of information bits using multiple parity bits
    • H03M13/1102Codes on graphs and decoding on graphs, e.g. low-density parity check [LDPC] codes
    • H03M13/1148Structural properties of the code parity-check or generator matrix
    • H03M13/116Quasi-cyclic LDPC [QC-LDPC] codes, i.e. the parity-check matrix being composed of permutation or circulant sub-matrices
    • H03M13/1162Array based LDPC codes, e.g. array codes
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M13/00Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
    • H03M13/27Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes using interleaving techniques
    • H03M13/2703Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes using interleaving techniques the interleaver involving at least two directions
    • H03M13/2707Simple row-column interleaver, i.e. pure block interleaving
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M13/00Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
    • H03M13/63Joint error correction and other techniques
    • H03M13/6306Error control coding in combination with Automatic Repeat reQuest [ARQ] and diversity transmission, e.g. coding schemes for the multiple transmission of the same information or the transmission of incremental redundancy
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M13/00Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
    • H03M13/63Joint error correction and other techniques
    • H03M13/635Error control coding in combination with rate matching
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L1/00Arrangements for detecting or preventing errors in the information received
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L1/00Arrangements for detecting or preventing errors in the information received
    • H04L1/0001Systems modifying transmission characteristics according to link quality, e.g. power backoff
    • H04L1/0009Systems modifying transmission characteristics according to link quality, e.g. power backoff by adapting the channel coding
    • H04L1/0013Rate matching, e.g. puncturing or repetition of code symbols
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L1/00Arrangements for detecting or preventing errors in the information received
    • H04L1/004Arrangements for detecting or preventing errors in the information received by using forward error control
    • H04L1/0056Systems characterized by the type of code used
    • H04L1/0057Block codes
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L1/00Arrangements for detecting or preventing errors in the information received
    • H04L1/004Arrangements for detecting or preventing errors in the information received by using forward error control
    • H04L1/0056Systems characterized by the type of code used
    • H04L1/0061Error detection codes
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L1/00Arrangements for detecting or preventing errors in the information received
    • H04L1/004Arrangements for detecting or preventing errors in the information received by using forward error control
    • H04L1/0056Systems characterized by the type of code used
    • H04L1/0071Use of interleaving
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L1/00Arrangements for detecting or preventing errors in the information received
    • H04L1/12Arrangements for detecting or preventing errors in the information received by using return channel
    • H04L1/16Arrangements for detecting or preventing errors in the information received by using return channel in which the return channel carries supervisory signals, e.g. repetition request signals
    • H04L1/18Automatic repetition systems, e.g. Van Duuren systems
    • H04L1/1812Hybrid protocols; Hybrid automatic repeat request [HARQ]
    • H04L1/1819Hybrid protocols; Hybrid automatic repeat request [HARQ] with retransmission of additional or different redundancy
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L1/00Arrangements for detecting or preventing errors in the information received
    • H04L1/12Arrangements for detecting or preventing errors in the information received by using return channel
    • H04L1/16Arrangements for detecting or preventing errors in the information received by using return channel in which the return channel carries supervisory signals, e.g. repetition request signals
    • H04L1/18Automatic repetition systems, e.g. Van Duuren systems
    • H04L1/1867Arrangements specially adapted for the transmitter end
    • H04L1/1874Buffer management

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Physics & Mathematics (AREA)
  • Probability & Statistics with Applications (AREA)
  • Theoretical Computer Science (AREA)
  • Mathematical Physics (AREA)
  • Quality & Reliability (AREA)
  • Error Detection And Correction (AREA)
  • Detection And Prevention Of Errors In Transmission (AREA)

Abstract

【課題】データ符号化方法及び装置、記憶媒体並びにプロセッサを提供する。【解決手段】データ符号化方法は、送信されるべきデータを取得して、送信されるべきデータに準巡回低密度パリティ検査(LDPC)符号化を行ってLDPC符号語系列を取得し、LDPC符号語系列をインターリーブしてインターリーブLDPC符号語系列を取得する。開始位置からインターリーブLDPC符号語系列に巡回ビット選択を行ってレートマッチ符号語系列を取得して、開始位置を所定のパラメータに従って決定し、レートマッチ符号語系列を送信する。【選択図】図1

Description

[関連出願の相互参照]
本出願は、2017年8月11日に出願の中国特許出願第201710687764.6号の優先権を主張するものであり、その開示が全体として引用により本明細書に援用される。
本発明は、通信の分野に関し、特に、データ符号化方法及び装置、記憶媒体並びにプロセッサに関する。
関連技術では、準巡回低密度パリティ検査(LDPC)符号化プロセスにおいて、一旦より多くのパディングビットが出現すると、LDPC符号の符号化又は復号化効率が低下する問題に対して、LDPC符号化が行われるときにパディングビットが可能な限り少ない又はパッドビットが全くないように、トランスポートブロックサイズ(TBS)テーブル設計ルールが提供される。トランスポートブロック内の各符号ブロック群の符号ブロック数が異なり得るという事実によって引き起こされる一部のキャスク効果(cask effects)の問題に対して、一部の符号ブロック群がより多くの符号ブロックを有するときに引き起こされる全体的性能不足を回避するために各符号ブロック群の符号ブロック数が等しいように、符号ブロック分割方法におけるKmax設計法が提供され、そして高次変調又はフェーディングチャネルにおける準巡回LDPC符号化の性能不足の問題に対して、準巡回LDPC符号化の性能は符号語インターリーブ法で改善される。
実際の通信システムでは、実際に伝送される必要があるトランスポートブロックのビット数が必ずしも準巡回LDPC符号化基底行列によってサポートされるシステムビット長に等しいわけではないので、トランスポートブロックに符号ブロック分割が行われる必要があり、そしてビットがパディングされる必要がある。しかしながら、トランスポートブロックに行われる符号ブロック分割及びパディングビットは、符号化及び復号化率の低下、高エネルギー消費、並びにデータ通信の堅牢性に対する影響などの、不安定な伝送の問題を引き起こすことになる。
伝送されるべきデータに準巡回LDPC符号化を行った後の不安定な伝送の問題の効果的解決策は関連技術に存在しない。
本発明の実施形態は、伝送されるべきデータに準巡回LDPC符号化を行った後の不安定な伝送という関連技術の問題を少なくとも解決する、データ符号化方法及び装置、記憶媒体、並びにプロセッサを提供する。
本発明の実施形態によれば、データ符号化方法が提供される。本方法は、情報パケットビット系列に準巡回LDPC符号化を行ってLDPC符号語系列を取得し、そしてLDPC符号語系列に従って一次元有限長環状バッファのサイズを決定することと、複数の所定の冗長バージョン値から冗長バージョン値を選択し、そして選択した冗長バージョン値及び既定のパラメータに従って一次元有限長環状バッファにおける伝送されるべきビット系列を読み取るための開始位置を決定することであって、既定のパラメータは、リフティングサイズ、基本グラフ行列の全列数、基本グラフ行列の全行数、基本グラフ行列のシステム列数、又は情報パケットビット系列の長さの少なくとも一つを含むことと、開始位置から特定の長さのデータビットを順次読み取って伝送されるべきビット系列を形成し、そして伝送されるべきビット系列を送信することとを含む。
本発明の別の実施形態によれば、データ符号化装置が更に提供される。本装置は、送信されるべきデータを取得するように構成される取得モジュールと、送信されるべきデータに準巡回LDPC符号化を行ってLDPC符号語系列を取得し、そしてLDPC符号語系列をインターリーブしてインターリーブLDPC符号語系列を取得するように構成されるインターリーブモジュールと、開始位置からインターリーブLDPC符号語系列に巡回ビット選択を行ってレートマッチ符号語系列を取得するように構成されており、開始位置が所定のパラメータに従って決定され、所定のパラメータは、冗長バージョン、リフティングサイズ、基本グラフ行列の全列数、基本グラフ行列の全行数、基本グラフ行列のシステム列数、又は情報パケットビット系列の長さの少なくとも一つを含む選択モジュールと、レートマッチ符号語系列を送信するように構成される送信モジュールとを含む。
本発明の別の実施形態によれば、記憶媒体が更に提供される。本記憶媒体は、実行されると上述のデータ符号化方法を実行する内蔵プログラムを含む。
本発明の別の実施形態によれば、プロセッサが更に提供される。本プロセッサは、実行されると上記に示した任意選択の実施形態において上述のデータ符号化方法を実行するプログラムを実行するために使用される。
本発明を通して、送信されるべきデータが取得され;送信されるべきデータに準巡回LDPC符号化が行われてLDPC符号語系列を取得し、そしてLDPC符号語系列がインターリーブされてインターリーブLDPC符号語系列を取得し;開始位置からインターリーブLDPC符号語系列に巡回ビット選択が行われてレートマッチ符号語系列を取得し、ここで開始位置が所定のパラメータに従って決定されており;そしてレートマッチ符号語系列が送信される。上記解決策は、伝送されるべきデータに準巡回LDPC符号化を行った後の不安定な伝送という関連技術の問題を解決して、準巡回LDPC符号化後の安定した伝送を達成する。
本明細書に記載される図面は本発明の更なる理解を提供するために使用され、且つ本出願の一部を形成する。本発明において例証的な実施形態及びその記載は、本発明を説明するために使用されるのであって、不適切な仕方で本発明を限定するためではない。
本発明の実施形態に係るデータ符号化方法のフローチャートである。 本発明の好適な実施形態に係るLDPC符号化データ処理方法のフローチャートである。
本出願の実施形態は移動通信ネットワーク(5G移動通信ネットワークを含むが、これに限定されない)を提供する。ネットワークのネットワークアーキテクチャがネットワーク側装置(基地局など)及び端末を含んでもよい。ネットワークアーキテクチャで実行可能な情報伝送方法が実施形態において提供される。本出願の実施形態によって提供される情報伝送方法の実行環境がネットワークアーキテクチャに限定されないことが留意されるべきである。
本発明の実施形態を詳細に記載する前に、デジタル通信システムにおける符号化方法の関連技術を簡潔に記載する。
関連技術におけるデジタル通信システムは一般に三つの部分:送信端、チャネル及び受信端を含む。送信端は、情報系列にチャネル符号化を行って符号化された符号語を取得し、符号化された符号語をインターリーブし、そしてインターリーブビットを変調シンボルへマッピングし、次いで通信チャネル情報に従って変調シンボルを処理及び伝送することができる。チャネルでは、多経路及び移動などの要因による特定のチャネル応答が、歪んだデータ伝送という結果になり、そして雑音及び干渉がデータ伝送を更に悪化させることになる。受信端は、チャネルを通過した後の変調シンボルデータを受信し、ここで変調シンボルデータはこの時点で既に歪められており、そして特定の処理を行って元の情報系列を復元する必要がある。
情報系列を符号化するための送信端によって使用される符号化方法に従って、受信端は、受信データに対応する処理を行って元の情報系列を確実に復元することができる。一般に、符号化方法は順方向誤り訂正(FEC)符号化に基づく。FEC符号化は情報系列に多少の冗長情報を付加し、そして受信端は冗長情報で元の情報系列を確実に復元することができる。
一部の一般的なFEC符号化として、畳込み符号、ターボ符号及びLDPC符号を含む。FEC符号化プロセスでは、ビット数kの情報系列にFEC符号化が行われてnビットのFEC符号化された符号語(n-k冗長ビットを含む)を取得し、FEC符号化率はk/nである。LDPC符号は、非常に疎なパリティ検査行列又は二部グラフで定義される線形ブロック符号である。LDPC符号の検査行列の疎性は低複雑性符号化及び復号化を達成するのを促進し、したがってLDPCをより実用的にする。様々な実践及び理論により、LDPC符号が加算性白色ガウス雑音(AWGN)下でシャノン限界に非常に近い最高のチャネル符号化性能を有することを証明している。LDPC符号のパリティ検査行列では、各行がパリティ検査符号である。或るインデックスの位置の要素値が各行で1に等しければ、それは、この位置のビットがパリティ検査符号に参加することを意味し、要素値が0に等しければ、それは、この位置のビットがパリティ検査符号に参加しないことを意味する。
構造化特性により、準巡回LDPC符号が主流の応用例になった。例えば、準巡回LDPC符号は、IEEE802.11ac、IEEE802.11ad、IEEE802.11aj、IEEE802.16e、IEEE802.11n、マイクロ波通信及び光ファイバ通信に広く適用されており、且つ第五世代(5G)移動通信におけるデータチャネル符号化体系として採用されている。準巡回LDPC符号のパリティ検査行列Hは、M×Z行及びN×Z列を有する行列であり、これはM×N個の部分行列から構成される。各部分行列はZ×Zのサイズの基底置換行列の異なるべきである、すなわち、各部分行列はZ×Zのサイズの単位行列の幾つかの値の巡回シフト後に取得される。
数学的観点から単位行列の巡回シフトをより簡単に記載するために、準巡回LDPC符号のパリティ検査行列は以下の数式として書くことができる。
Figure 2022119993000002
hbij=-1であれば、
Figure 2022119993000003
はZ×Zのサイズの全零行列であり、そうでなければ、標準置換行列Pの非負整数べき乗である。標準置換行列Pは次の通りに書かれる。
Figure 2022119993000004
この定義により、Z及び指数hbijは各区分行列を一意に識別することができる。或る区分行列が全零行列であれば、区分行列は「-1」若しくは空値によって又は他の形式で表現されることができる。区分行列が単位行列のsの巡回シフトを通じて取得される場合、区分行列はsに等しい。全てのhbijが準巡回LDPC符号の基底行列Hbを構成することができ、これは次の通りに書くことができる。
Figure 2022119993000005
したがって、基底行列Hbは二種類の要素:全零正方行列を示す要素、及び一般に0から(Z-1)の範囲内の整数によって表現される、単位行列の巡回シフトの値を示す要素を含む。基底行列Hbは、基底検査行列又はシフト値行列又は置換値行列又は基底パリティ検査行列又はパリティ検査行列と称することができる。基底行列Hbでは、全零行列を示す要素が要素「0」と置き換えられ、そして他の要素が要素「1」と置き換えられれば、準巡回LDPC符号化の基本グラフ行列又はテンプレート行列が取得されることができる。基本グラフ行列は表の形態でも記述されてもよい。例えば、基本グラフ行列の「1」の位置又は基底行列における単位行列の巡回シフトの値を示す要素の位置を示すために、行及び列インデックス対が使用される。したがって、準巡回LDPC符号の基底行列は、準巡回LDPC符号のテンプレート行列及び一群のシフト値(又は係数)に従って決定されることができる。基底置換行列又は全零正方行列の次元Zは、シフトサイズ/リフティングサイズ又は拡大係数又は部分行列サイズとして定義されることができる。
したがって、構造化LDPC符号は、基底検査行列Hb及びリフティングサイズZによって一意に決定されることができる。例えば、基底行列Hb(二行及び四列)は4のリフティングサイズzに対応し、そして次の通りに書かれる。
Figure 2022119993000006
基底行列Hbに対応するテンプレート行列は次の通りに書かれる。
Figure 2022119993000007
基底行列Hb及びリフティングサイズZに従って取得されるパリティ検査行列Hは次の通りに書かれる。
Figure 2022119993000008
準巡回LDPC符号化は、基底行列Hb及びリフティングサイズZに従って決定されるパリティ検査行列に従って直接行われることができる。LDPC符号の定義によれば、H×C=0が満たされており、Hは[Hs Hp]を含む。ここでHsはパリティ検査行列のシステム列部の行列であり、Hpはパリティ検査行列の検査列部の行列である。Cは[Cs Cp]を含むことができ、ここでCsはLDPC符号のシステムビット系列(情報ビット、既知のビット)であり、CpはLDPC符号の検査ビット系列(未知のビット)である。LDPC符号化プロセスは、検査ビット系列を計算するプロセスである。したがって、Hs×Cs=Hp×Cp、次いで検査ビット系列Cpが計算されることができる、すなわち、Cp=inv(Hp)×Hs×Csであり、式中、式inv(x)は行列xの二値反転を表現する。したがって、パリティ検査行列の検査列の行列は、準巡回LDPC符号化系列が[Cs Cp]であるように、正方行列且つ二値可逆でなければならない。もちろん、準巡回LDPC符号化系列は、各Zビットブロックの巡回シフトを通じて計算されることもできる。
データ伝送のプロセスで、本出願人は、LDPC符号のために、トランスポートブロックにおいて符号ブロック分割が行われてビットがパディングされるとき、パッドビットが符号化又は復号化を支援するために使用され、実際には伝送に関与しないことが分かるが、符号化及び復号化のプロセスで、より多くのパッドビットが出現すれば、符号器又は復号器が多少の無用の演算を実行することになり、それによって符号化及び復号化率を低下させ且つ高エネルギー消費を引き起こす。トランスポートブロックの長さが大きければ、符号ブロック数はこの時点で大きい。フィードバックを容易にし且つ処理効率を改善するために、全てのLDPC符号ブロックが複数の符号ブロック群に分割される必要がある。ここで各符号ブロック群は幾つかのLDPC共学ブロックを含んでおり、そして符号ブロック群の単位で肯定応答又は否定応答(ACK/NACK)フィードバックが受信されて、受信端でデータ再伝送が行われる。符号ブロック群の設計が符号ブロック分割のプロセスに考慮されなければ、符号ブロックが符号ブロック群へ分割されるときに各符号ブロック群の符号ブロック数が異なることになり、これは一部のキャスク効果を引き起こし、そしてデータ通信の堅牢性に影響を及ぼすことになる。準巡回LDPC符号化が或る構造化特性を有するので、一部の高次変調又はフェーディングチャネルにおいて、LDPC符号は、性能不足に関連した多少の問題を有し得る。したがって、符号語ビットはバースト雑音をランダム化するためにインターリーブされる必要があり、それによってバースト雑音下の準巡回LDPC符号語の性能を改善する。
[実施形態1]
本実施形態はデータ符号化方法を提供する。図1は、本発明の実施形態に係るデータ符号化方法のフローチャートである。図1に図示されるように、本方法は下記するステップを含む。
ステップS102で、情報パケットビット系列に準巡回LDPC符号化が行われてLDPC符号語系列を取得し、そしてLDPC符号語系列に従って一次元有限長環状バッファのサイズが決定される。
ステップS104で、複数の所定の冗長バージョン値から冗長バージョン値が選択され、そして選択した冗長バージョン値及び既定のパラメータに従って一次元有限長環状バッファにおける伝送されるべきビット系列を読み取るための開始位置が決定される。ここで、既定のパラメータは、リフティングサイズ、基本グラフ行列の全列数、基本グラフ行列の全行数、基本グラフ行列のシステム列数、又は情報パケットビット系列の長さの少なくとも一つを含む。
ステップS106で、開始位置から特定の長さのデータビットが順次読み取られて伝送されるべきビット系列を形成し、そして伝送されるべきビット系列が送信される。
上記ステップを通して、情報パケットビット系列に準巡回LDPC符号化が行われてLDPC符号語系列を取得し、そしてLDPC符号語系列に従って一次元有限長環状バッファのサイズが決定され;複数の所定の冗長バージョン値から冗長バージョン値が選択され、そして選択した冗長バージョン値及び既定のパラメータに従って一次元有限長環状バッファにおける伝送されるべきビット系列を読み取るための開始位置が決定される。ここで、既定のパラメータは、リフティングサイズ、基本グラフ行列の全列数、基本グラフ行列の全行数、基本グラフ行列のシステム列数、又は情報パケットビット系列の長さの少なくとも一つを含んでいる。そして開始位置から特定の長さのデータビットが順次読み取られて伝送されるべきビット系列を形成し、そして伝送されるべきビット系列が送信される。上記解決策は、伝送されるべきデータに準巡回LDPC符号化を行った後の不安定な伝送という関連技術の問題を解決して、準巡回LDPC符号化後の安定した伝送を達成する。
一実施形態において、上記ステップは基地局又は端末によって実行されてもよいが、これに限定されない。
一実施形態において、LDPC符号語系列がインターリーブされてインターリーブLDPC符号語系列を取得される。そしてこのステップは、LDPC符号語系列にブロックインターリーブを行うことを含み、ここでインターリーブ行列の行数が準巡回LDPC符号化パラメータに従って決定され、準巡回LDPC符号化パラメータは、リフティングサイズ、基本グラフ行列の全列数、基本グラフ行列の全行数、又は基本グラフ行列のシステム列数の少なくとも一つを含む。インターリーブ行列は、行列内のデータが列に沿って入力され、そして列に沿って出力される方式でインターリーブされる。
一実施形態において、インターリーブ行列の行数は準巡回LDPCリフティングサイズの正整数因数に等しいか、又は準巡回LDPC符号化のリフティングサイズの正整数倍数に等しい。
一実施形態において、インターリーブ行列の行数は準巡回LDPC符号化の基本グラフ行列の全列数の正整数因数に等しいか、又は準巡回LDPC符号化の基本グラフ行列の全列数の正整数倍数に等しい。
一実施形態において、インターリーブ法は、所定の列順に従ってそれぞれ出力を行ってインターリーブ符号語系列を取得することを更に含む。
一実施形態において、列内インターリーブ法が変調次数に従って決定される。
任意選択で、変調次数がM0より大きいという条件で、列内インターリーブ法が実行される。ここで、M0は1より大きい整数である。
一実施形態において、開始位置は冗長バージョン、リフティングサイズ及び基本グラフ行列の全列数に従って決定される。
一実施形態において、RVである冗長バージョンに対応する開始位置は以下の式を介して計算される:
第一の式:S=α×funtion(β×(nb/G)×RV+χ)×Z+δ;
第一の式中、nbは基本グラフ行列の全列数であり、Zはリフティングサイズであり、αは正整数であり、Gは0より大きい実数であり、βは正実数であり、χは非負実数であり、δは整数であり、function(x)は実数xを最も近い整数に丸めることを表現する;
又は第二の式:S=α×(β×funtion(λ×nb/G)×RV+χ)×Z+δ;
第二の式中、nbは基本グラフ行列の全列数であり、Zはリフティングサイズであり、αは正整数であり、Gは0より大きい実数であり、βは正整数であり、λは正実数であり、χは非負実数であり、δは整数であり、function(x)は実数xを最も近い整数に丸めることを表現する;
又は第三の式:S=α×(β×funtion(λ×nb×Z/G)×RV+χ)+δ;
第三の式中、nbは基本グラフ行列の全列数であり、Zはリフティングサイズであり、Gは0より大きい実数であり、αは正整数であり、βは正整数であり、λは正実数であり、χは非負実数であり、δは整数であり、function(x)は実数xを最も近い整数に丸めることを表現する。
一実施形態において、開始位置は冗長バージョン、リフティングサイズ、基本グラフ行列の全列数及び情報パケットビット系列の長さに従って決定される。
一実施形態において、RViである冗長バージョンに対応する開始位置は以下の式の一つを介して計算される:
=α×(β×funtion((K+mb×Z)/G)×RV+χ)+δ;及び S=α×(β×funtion((K+mb×Z)/G)+χ)×RV+δ;
上記二つの式中、Kは情報パケットビット系列の長さであり、Zはリフティングサイズであり、Gは0より大きい実数であり、αは正整数であり、βは正整数であり、λは正実数であり、χは非負実数であり、δは整数であり、function(x)は実数xを最も近い整数に丸めることを表現する。
一実施形態において、LDPC符号語系列がインターリーブされてインターリーブLDPC符号語系列を取得するステップは、LDPC符号語系列内の第S0のビットから第S1のビットまでの全てのビットをインターリーブすることを含み、ここでS0及びS1は正整数であり、S1はS0より大きい。
一実施形態において、LDPC符号語系列内の第S0のビットから第S1のビットまでの全てのビットがインターリーブされるステップは、インターリーブ行列に従ってLDPC符号語系列内の第S0のビットから第S1のビットまでの全てのビットにブロックインターリーブを行うことを含み、ここでブロックインターリーブ行列の列数がZ0であり、Z0は準巡回LDPC符号化パラメータによって決定され、準巡回LDPC符号化パラメータは、リフティングサイズ、基本グラフ行列の全列数、基本グラフ行列の全行数、基本グラフ行列のシステム列数、又は情報パケットビット系列長の少なくとも一つを含む。
一実施形態において、Z0はLDPC符号化リフティングサイズの正整数因数に等しい。
一実施形態において、Z0はZに等しく、ZはLDPC符号化リフティングサイズであり、S0は2×Zに等しく、S1はE×Z-1に等しく、ここでEは2より大きい整数である。
一実施形態において、Eはkb、kb+1、kb+2、kb+3又はkb+4に等しく、ここでkbはLDPC符号化の基本グラフ行列のシステム列数である。
一実施形態において、Z0は以下のパラメータ:S0、S1及び変調次数によって決定される。ここで、変調次数は、各変調シンボルによって搬送されるビット数である。
一実施形態において、Z0は以下の式を介して計算される:
Figure 2022119993000009
、式中、Mは変調次数であり且つ正整数である。
一実施形態において、S1の値は以下のパラメータの少なくとも一つを介して決定される:送信されるべきデータに符号ブロック分割が行われた後に取得される情報パケットビット系列の長さ、及び伝送されるべきビット系列の長さ。
一実施形態において、LDPC符号化率RがR0以下であるときに、LDPC符号語系列内の第S0のビットから第S1のビットまでの全てのビットがインターリーブ行列に従ってインターリーブされる。ここで、R0は3/4以上1未満の実数であり、LDPC符号化率Rは情報パケットビット系列の長さ及び伝送されるべきビット系列の長さの商に等しい。
本発明を好適な実施形態に関連して以下に詳細に記載する。
[好適な実施形態1]
本実施形態は、新無線アクセス技術(NR)通信システムに適用されることができる準巡回LDPC符号化データ処理方法を提供する。本任意選択の実施形態で提供される方法は、ロングタームエボリューション(LTE)移動通信システム又は将来の5G移動通信システム又は他の無線若しくは有線通信システムに適用されることができ、そしてデータ伝送方向は、基地局が端末ユーザにデータを送信する方向(サービスデータのダウンリンク伝送)である、又はデータ伝送方向は、端末ユーザが基地局にデータを送信する方向(サービスデータのアップリンク伝送)である。端末ユーザは、モバイル装置、アクセス端末、ユーザ端末、ユーザ局、ユーザユニット、移動局、遠隔局、遠隔端末、ユーザエージェント、ユーザ機器、ユーザ装置、又は他の用語で名付けられる装置を含む。基地局としては、ノードBと称されてもよいアクセスポイント(AP)、無線ネットワーク制御装置(RNC)、発展型ノードB(eNB)、基地局制御装置(BSC)、基地局制御装置(BTS)、基地局(BS)、送受信機能(TF)、無線ルータ、無線送受信機、基本サービスユニット、拡張サービスユニット、無線基地局(RBS)、又は他の品目で名付けられる他の装置を含む。
本任意選択の実施形態の一態様によれば、本任意選択の実施形態は、新無線アクセス技術(新RAT)における拡張モバイルブロードバンド(eMBB)シナリオ、超信頼且つ低遅延通信(URLLC)シナリオ又は大容量マシンタイプ通信(mMTC)シナリオに適用されることができる準巡回LDPC符号化データ処理方法を提供する。
図2は、本発明の好適な実施形態に係るLDPC符号化データ処理方法のフローチャートである。図2に図示されるように、本方法は下記するステップを含む。
ステップS201で、伝送されるべきソースデータパケットの長さ情報が取得され、そして現在送信される必要がある、伝送されるべきソースデータパケットの長さ(TBSとしても知られている)が制御情報に従ってTBSテーブルから決定される。ここで、制御情報はダウンリンク若しくはアップリンク制御情報又は他のシステム情報から取得されることができる。
ステップS202で、符号ブロック分割が行われる。伝送されるべきソースデータパケットは最長情報ブロックの長さKmaxに従って分割される。ここで、分割後に取得される情報パケットビット系列数は
Figure 2022119993000010
であり、そして符号ブロック分割後に取得される情報パケットビット系列の長さが
Figure 2022119993000011
及び
Figure 2022119993000012
を含み、式中、Kは情報パケットビット系列の長さであり且つ正整数であり、Kmaxは正整数であり、Lは各情報パケットビット系列へ付加される巡回冗長検査(CRC)系列の長さである。
ステップS203で、CRC系列が付加される。符号ブロック分割後に取得される各情報ビットブロックへビット数LのCRC系列が付加される。ここで、Lは0より大きい整数である。
ステップS204で、ビットがパディングされる。CRC系列が付加された情報ビットブロックにサブビットがパディングされる。ここで、サブビットは、符号化を支援するために使用されるだけであり、伝送には関与しない。
ステップS205で、準巡回LDPC符号化が行われる。符号ブロック分割後に取得される各情報パケットビット系列の長さに従って、LDPC符号化によって使用されるリフティングサイズが決定され、取得したリフティングサイズ情報に従ってLDPC符号化の検査行列が決定及び計算され、そして検査行列及びLDPC符号化リフティングサイズに従って各情報パケットビット系列に準巡回LDPC符号化が行われてLDPC符号語系列を取得する。
準巡回LDPC符号化の基本グラフ行列は二種類の基本グラフ行列:基本グラフ1及び基本グラフ2を含む。基本グラフ行列、基本グラフ1、の行及び列数はそれぞれ46及び68である、すなわち、基本グラフ行列の全列数は68であり、基本グラフ行列の全行数は46であり、そして基本グラフ行列のシステム列数は68-46=22である。基本グラフ行列、基本グラフ2、の行及び列数はそれぞれ42及び52である、すなわち、基本グラフ行列の全列数は52であり、基本グラフ行列の全行数は42であり、そして基本グラフ行列のシステム列数は52-42=10である。基本グラフ行列の全列数が68である又は基本グラフ行列の全行数が46である又は基本グラフ行列のシステム列数が22であるという事実に従って、基本グラフ行列に対応するインデックスが1(基本グラフ1)であると決定することができる。基本グラフ行列の全列数が52である又は基本グラフ行列の全行数が42である又は基本グラフ行列のシステム列数が10であるという事実に従って、基本グラフ行列に対応するインデックスが2(基本グラフ2)であると決定することができる。例えば、表1は、基本グラフ1及び基本グラフ2における行インデックス(i)のあらゆる値1の要素の位置を示す、すなわち、同位置は巡回置換単位行列位置と置き換えられることができる。表2は、八つのリフティングサイズセットを含む、基本グラフ1によってサポートされるリフティングサイズを示す。表4は、同じく八つのリフティングサイズセットを含む、基本グラフ2によってサポートされるリフティングサイズを示す。上記リフティングサイズ情報に従ってリフティングサイズセットのセットインデックスiLSが決定される。基本グラフ1に対応する各リフティングサイズセットのシフト値行列がセットインデックスiLSに従って表3から取得され、基本グラフ2に対応する各リフティングサイズセットのシフト値行列がセットインデックスに従って表5から取得され、次いで現在のリフティングサイズZcに対応する基本グラフ行列が式:Pi,j=mod(Vi,j,Z)に従って取得されることができる。情報パケットビット系列のサイズが2560以下であり且つ符号率が2/3以下であれば、基本グラフ2が選択され、そうでなければ、基本グラフ1が選択される。表1において、第一列が基本グラフ1及び基本グラフ2の行インデックス(i)を示し、第二列が基本グラフ1の列インデックス(j)を示し、そして[i,j]が基本グラフ1のあらゆる値1の要素の位置を決定し;この他、第三列が基本グラフ2の列インデックス(j)を示すことが留意される。表3及び表4は、基本グラフ1及び基本グラフ2に対応する八つのシフト値行列をそれぞれ示し、ここでiは行インデックスを示し、jは列インデックスを示し、iLSはリフティングサイズセットのセットインデックスを示す。
表1 基本グラフ1及び基本グラフ2が以下の表1に示される。
Figure 2022119993000013
Figure 2022119993000014
表2 基本グラフ1のリフティングサイズが以下の表2に示される。
Figure 2022119993000015
表3 基本グラフ1のシフト値が以下の表3に示される。
Figure 2022119993000016
Figure 2022119993000017
Figure 2022119993000018
Figure 2022119993000019
Figure 2022119993000020
Figure 2022119993000021
表4 基本グラフ2のリフティングサイズが以下の表4に示される。
Figure 2022119993000022
表5 基本グラフ2のシフト値が以下の表5に示される。
Figure 2022119993000023
Figure 2022119993000024
Figure 2022119993000025
Figure 2022119993000026
ステップS206で、インターリーブが行われる。インターリーブは、LDPC符号語系列をインターリーブしてインターリーブLDPC符号語系列を取得することである。インターリーブ法は、LDPC符号語系列にブロックインターリーブを行うことを含み、ここでインターリーブ行列の行数が準巡回LDPC符号化パラメータに従って決定され、準巡回LDPC符号化パラメータは、リフティングサイズ、基本グラフ行列の全列数、基本グラフ行列の全行数、又は基本グラフ行列のシステム列数の少なくとも一つを含む。
具体的な一実施形態において、インターリーブ行列の行数は準巡回LDPCリフティングサイズの正整数因数に等しいか、又は準巡回LDPC符号化のリフティングサイズの正整数倍数に等しい。
具体的な一実施形態において、インターリーブ行列の行数は準巡回LDPC符号化の基本グラフ行列の全列数の正整数因数に等しいか、又は準巡回LDPC符号化の基本グラフ行列の全列数の正整数倍数に等しい。
具体的な一実施形態において、インターリーブ行列は、行列内のデータが列に沿って入力され、そして列に沿って出力される方式でインターリーブされる。
具体的な一実施形態において、インターリーブ法で、所定の列順に従って出力が行われてインターリーブ符号語系列を取得する。
具体的な一実施形態において、インターリーブ法で、インターリーブ行列内の列に列内インターリーブが行われる。ここで、列内インターリーブ法としては、巡回シフトインターリーブ及びランダム系列インターリーブを含む。好ましくは、列内インターリーブ法は変調次数に従って決定される。好ましくは、変調次数が2より大きいという条件で、列内インターリーブ法が実行される。
インターリーブ法は、所定のインターリーブインデックス系列に従ってLDPC符号語系列内の第S0のビットから第S1のビットまでの全てのビットをインターリーブ符号語系列の第S0のビットから第S1のビットまでのビットへマッピングすることを含み、ここでS0は正整数であり、S1はS0より大きい整数である。
所定のインターリーブインデックス系列はブロックインターリーブ方式で取得され、ブロックインターリーブ行列の列数がZ0であり、Z0は正整数である。
更なる具体的な一実施形態において、Z0はLDPC符号化リフティングサイズの正整数因数に等しい。
更なる具体的な一実施形態において、Z0はZに等しく、ZはLDPC符号化リフティングサイズであり、S0は2×Zに等しく、S1はE×Z-1に等しく、ここでEは2より大きい整数である。更には、Eはkb、kb+1、kb+2、kb+3又はkb+4に等しく、ここでkbはLDPC符号化の基本グラフ行列のシステム列数である。
好ましくは、更なる具体的な一実施形態において、S0はkb×Zに等しく、S1はE×Z-1に等しく、ここでZはLDPC符号化リフティングサイズであり、Eはkb+Δmbに等しく、Δmbは0より大きい整数であり、kbはLDPC符号化の基本グラフ行列のシステム列数である。更には、Δmbは以下のパラメータの組合せの一つに従って決定される:組合せ1、LDPC符号化の基本グラフ行列のシステム列数及び符号化率から成る;組合せ2、情報パケットビット系列の長さ、伝送されるべきビット系列の長さ及びLDPC符号化リフティングサイズから成る;並びに組合せ3、伝送されるべきビット系列に含まれるLDPC符号検査ビット数及びLDPC符号化リフティングサイズから成る。
更なる具体的な一実施形態において、Z0は以下のパラメータ:S0、S1及び変調次数によって決定される。ここで、変調次数は、各変調シンボルによって搬送されるビット数である。好ましくは、Z0は以下の式を介して計算される:
Figure 2022119993000027
、式中、Mは変調次数であり且つ正整数である。
更なる具体的な一実施形態において、S1の具体値は以下のパラメータ:情報パケットビット系列の長さ及び伝送されるべきビット系列の長さによって決定される。
更なる具体的な一実施形態において、符号率RがR0以下であるときに、ブロックインターリーブが行われる。ここで、R0は3/4以上1未満の実数であり、符号率Rは、情報パケットビット系列の長さが伝送されるべきビット系列の長さで割られた後に取得される値に等しい。
上記インターリーブ法は以下の有益な効果を有する:LDPC符号語が効果的にランダム化されることができ、LDPC符号が高次変調(例えば、64直交振幅変調(QAM)及び256QAM)におけるより良好な性能優位性を取得することができ、そしてフェーディングチャネルにおけるLDPC符号の性能が効果的に改善されることができる。
ステップS207で、レートマッチングが行われる。開始位置からインターリーブLDPC符号語系列に巡回ビット選択が行われてレートマッチ符号語系列を取得する。開始位置は所定のパラメータに従って決定される。ここで、所定のパラメータは、冗長バージョン、リフティングサイズ、基本グラフ行列の全列数、基本グラフ行列の全行数、基本グラフ行列のシステム列数、又は情報パケットビット系列の長さの少なくとも一つを含む。
更なる具体的な一実施形態において、開始位置は冗長バージョン、リフティングサイズ及び基本グラフ行列の全列数に従って決定される。更には、RViである冗長バージョンに対応する開始位置は以下の式を介して計算される:
=α×funtion(β×(nb/G)×RV+χ)×Z+δ、
式中、nbは基本グラフ行列の全列数であり、Zはリフティングサイズであり、αは正整数であり、Gは0より大きい実数であり、βは正実数であり、χは非負実数であり、δは整数であり、function(x)は実数xを最も近い整数に丸めることを表現する。
更には、RVである冗長バージョンに対応する開始位置は以下の式を介して計算される:S=α×(β×funtion(λ×nb/G)×RV+χ)×Z+δ。
式中、nbは基本グラフ行列の全列数であり、Zはリフティングサイズであり、αは正整数であり、Gは0より大きい実数であり、βは正整数であり、λは正実数であり、χは非負実数であり、δは整数であり、function(x)は実数xを最も近い整数に丸めることを表現する。
更には、RVである冗長バージョンに対応する開始位置は以下の式を介して計算される:S=α×(β×funtion(λ×nb×Z/G)×RV+χ)+δ。
式中、nbは基本グラフ行列の全列数であり、Zはリフティングサイズであり、Gは0より大きい実数であり、αは正整数であり、βは正整数であり、λは正実数であり、χは非負実数であり、δは整数である。式中、function(x)は実数xを最も近い整数に丸めることを表現する。
更なる具体的な一実施形態において、開始位置は冗長バージョン、リフティングサイズ、基本グラフ行列の全行数及び情報パケットビット系列の長さに従って決定される。更には、RVである冗長バージョンに対応する開始位置は以下の式の一つを介して計算される:S=α×(β×funtion((K+mb×Z)/G)×RV+χ)+δ及びS=α×(β×funtion((K+mb×Z)/G)+χ)×RV+δ、
上記式中、Kは情報パケットビット系列の長さであり、Zはリフティングサイズであり、Gは0より大きい実数であり、αは正整数であり、βは正整数であり、λは正実数であり、χは非負実数であり、δは整数であり、function(x)は実数xを最も近い整数に丸めることを表現する。
インターリーブ符号語系列に巡回ビット選択が行われる。インターリーブ符号語系列内の第2×Zのビットからテールビットまでのビットが一つの環状バッファに記憶され、そして冗長バージョンに従って環状バッファから順次Nビットが取得されて伝送されるべきビット系列を形成する。
ステップS208で、コンスタレーション変調が行われる。伝送されるべきビット系列が複数のビットパケットへ分割され、複数のビットパケットがコンスタレーション変調シンボルへマッピングされ、そしてコンスタレーション変調シンボルが送信される。好適な実施形態において、複数のビットパケットがコンスタレーション変調シンボルへマッピングされる前に、ビットパケット内のビットがそれぞれインターリーブされ、そして各インターリーブビットパケットがコンスタレーション変調シンボルへマッピングされる。コンスタレーション変調シンボルの変調次数はMであり、そして変調次数は各コンスタレーション変調シンボルによって搬送されるビット数を表現する。コンスタレーションシンボル変調としては以下:二進位相シフトキーイング(BPSK)、直交位相シフトキーイング(QPSK)、16QAM、64QAM又は256QAMの一つを含み、そして対応する変調次数はそれぞれ1、2、4、6及び8である。好ましくは、具体的な一実施形態において、ビットパケット内インターリーブは変調次数に従って決定される。例えば、変調次数がM1より大きいという条件で、インターリーブ法が実行される。ここで、M1は2、3、4、5又は6に等しい。好ましくは、ビットパケット内インターリーブとしては、巡回シフトインターリーブ及びランダムインデックス系列インターリーブを含む。好ましくは、全てのコンスタレーション変調シンボルにおける任意の隣接するF個のコンスタレーションシンボルのインターリーブ法は様々であり、ここでFは正整数である。別の実施形態において、G0個のビットパケット内インターリーブ法が存在し、G0個の方法は様々である。ビットパケット内ビットインターリーブはG0個の方法からG1個の方法を選択して、或る順に従って順次各ビットパケット内のビットをインターリーブする。別の実施形態において、複数のビットパケット内インターリーブ法セットが存在し、そして変調次数に従って複数のインターリーブ法セットからビットパケット内インターリーブ法が決定される。
上述の実施形態の記載から、上記した実施形態における方法がソフトウェアに加えて必要な汎用ハードウェアプラットフォームによって実装され得る、又はもちろんハードウェアによって実装され得ることが当業者にとって明らかであろう。しかしながら、多くの場合、前者が好適な実装方式である。この理解に基づいて、本発明によって提供される解決策は実質的に、又は関連技術に関与する部分が、ソフトウェア製品の形態で具現化され得る。コンピュータソフトウェア製品は、記憶媒体(リードオンリメモリ(ROM)/ランダムアクセスメモリ(RAM)、磁気ディスク又は光ディスクなど)に記憶されて、端末装置(移動電話、コンピュータ、サーバ、ネットワーク装置等であり得る)が本開示の各実施形態に係る方法を実行することを可能にするための幾つかの命令を含む。
[実施形態2]
本実施形態はデータ符号化装置を更に提供する。本装置は、上述の実施形態及び好適な実装例を実装するために使用され、記載してきたことは繰り返さない。以下に使用するように、用語「モジュール」は、所定の機能を実装することが可能なソフトウェア、ハードウェア又はその組合せであり得る。下記する実施形態における本装置は好ましくはソフトウェアによって実装されるが、ハードウェアによる又はソフトウェア及びハードウェアの組合せによる実装も可能であり且つ考えられ得る。
本発明の別の実施形態によれば、データ符号化装置が更に提供される。本装置は、取得モジュール、インターリーブモジュール、選択モジュール及び送信モジュールを含む。
取得モジュールは、送信されるべきデータを取得するように構成される。
インターリーブモジュールは取得モジュールに接続され、且つ送信されるべきデータに準巡回LDPC符号化を行ってLDPC符号語系列を取得し、そしてLDPC符号語系列をインターリーブしてインターリーブLDPC符号語系列を取得するように構成される。
選択モジュールはインターリーブモジュールに接続され、且つ開始位置からインターリーブLDPC符号語系列に巡回ビット選択を行ってレートマッチ符号語系列を取得するように構成される。ここで、開始位置が所定のパラメータに従って決定される。所定のパラメータは、冗長バージョン、リフティングサイズ、基本グラフ行列の全列数、基本グラフ行列の全行数、基本グラフ行列のシステム列数、又は情報パケットビット系列の長さの少なくとも一つを含む。
送信モジュールは選択モジュールに接続され、且つレートマッチ符号語系列を送信するように構成される。
実施形態1における方法のステップが本実施形態における装置によって実行されることができることが追加されるべきである。
上記した様々なモジュールがソフトウェア又はハードウェアによって実装され得ることが留意されるべきである。ハードウェアによる実装は以下の方式で行われ得るが、必ずしも行われ得るわけではない:上記した様々なモジュールが同じプロセッサに設けられる、又は上記した様々なモジュールが任意の組合せ形態でそれらのそれぞれのプロセッサに設けられる。
[実施形態3]
本発明の別の実施形態によれば、プロセッサが更に提供される。本プロセッサは、実行されると上記した任意選択の実施形態のいずれか一つの方法を実行するプログラムを実行するために使用される。
[実施形態4]
本発明の別の実施形態によれば、記憶媒体が更に提供される。本記憶媒体は、実行されると上記した任意選択の実施形態のいずれか一つの方法を実行する内蔵プログラムを含む。
明らかに、本発明の上述のモジュール又はステップの各々が汎用コンピューティング装置によって実装され得る、モジュール又はステップが単一のコンピューティング装置に集中され得る又は多数のコンピューティング装置から成るネットワーク上に分散され得る、更に代替的に、モジュール又はステップがコンピューティング装置によって実行可能なプログラムコードによって実装されて、その結果モジュール又はステップが記憶デバイスに記憶されてコンピューティング装置によって実行され得ることが当業者によって理解されるはずである。一部の状況では、例示若しくは記載したステップは本明細書に記載したものと異なる順序で実行され得る、又はモジュール若しくはステップは別々に様々な集積回路モジュールにされ得る、又はその多数のモジュール若しくはステップが実装のために単一の集積回路モジュールにされ得る。このように、本発明はハードウェア及びソフトウェアの任意の特定の組合せに限定されない。
上記は単に本発明の好適な実施形態であり、本発明を限定するとは意図されない。当業者にとって、本出願は様々な変更及び変形を有し得る。本発明の趣旨及び原理内でなされるいかなる変更、等価な置換、改善等も本発明の範囲内に収まるはずである。

Claims (10)

  1. 低密度パリティ検査(LDPC)データ符号化方法であって、
    情報パケットビット系列にLDPC符号化を行うことによってLDPC符号語系列を取得することと、
    前記LDPC符号化列をインタリーブしてインタリーブLDPC符号語系列を取得することであって、前記インタリーブLDPC符号語系列を取得することは、所定のインタリーブインデックス系列に従って、前記インタリーブ符号語系列の第S0のビットから第S1のビットまでのビットに、前記LDPC符号語系列の第S0のビットから第S1のビットまでのビットをマッピングすることを含み、S0は正の整数であり、S1はS0よりも大きい整数であり、S0は2×Zに等しく、Zはリフティングサイズであり、S1は前記情報パケットビット系列又は伝送されるべきビット系列の長さにより決定される、ことと、
    開始位置からインターリーブLDPC符号語系列に巡回ビット選択が行われてレートマッチ符号語系列を取得し、
    前記レートマッチ符号化系列を送信する
    ことを特徴とする低密度パリティ検査(LDPC)データ符号化方法。
  2. 前記開始位置は冗長バージョン、前記リフティングサイズ、前記情報パケットビット系列の長さに従って決定される、請求項1に記載のLDPCデータ符号化方法。
  3. RVである前記冗長バージョンに対応する前記開始位置が以下の式を介して計算される:
    第一の式:S=α×function(β×(nb/G)×RV+χ)×Z+δ; 前記第一の式中、nbは前記基本グラフ行列の前記全列数であり、Zは前記リフティングサイズであり、αは正整数であり、Gは0より大きい実数であり、βは正実数であり、χは非負実数であり、δは整数であり、function(x)は実数xを最も近い整数に丸めることを表現する、請求項1に記載のLDPCデータ符号化方法。
  4. RVである前記冗長バージョンに対応する前記開始位置が以下の式を介して計算される:
    第二の式:S=α×(β×function(λ×nb/G)×RV+χ)×Z+δ;
    前記第二の式中、nbは前記基本グラフ行列の前記全列数であり、Zは前記リフティングサイズであり、αは正整数であり、Gは0より大きい実数であり、βは正整数であり、λは正実数であり、χは非負実数であり、δは整数であり、function(x)は前記実数xを最も近い整数に丸めることを表現する、請求項1に記載のLDPCデータ符号化方法。
  5. RVである前記冗長バージョンに対応する前記開始位置が以下の式を介して計算される:
    前記第三の式中、nbは前記基本グラフ行列の前記全列数であり、Zは前記リフティングサイズであり、Gは0より大きい実数であり、αは正整数であり、βは正整数であり、λは正実数であり、χは非負実数であり、δは整数であり、function(x)は前記実数xを最も近い整数に丸めることを表現する、請求項1に記載のLDPCデータ符号化方法。
  6. 前記所定のインターリーブインデックス系列は、ブロックインターリーブの方法により取得され、
    ブロックインターリーブ行列の列数がZ0であり、Z0は準巡回LDPC符号化パラメータにより決定され、
    前記準巡回符号化パラメータは、前記リフティングサイズ、基本グラフ行列の全列数、前記基本グラフ行列の全行数、前記基本ベース行列のシステム列数、又は前記情報パケットビット系列の長さの少なくとも1つを含む、請求項1に記載のLDPCデータ符号化方法。
  7. S1は前記リフティングサイズの正整数倍に等しい、請求項1に記載のLDPCデータ符号化方法。
  8. 前記レートマッチ符号語系列を送信することが、
    前記レートマッチ符号語系列を複数のビットパケットに分割し、
    前記複数のビットパケットの各ビットパケット内のビットをインタリーブし、
    各インタリーブされたビットパケットを今スタレーション変調シンボルにマッピングすることを含む、請求項1に記載のLDPCデータ符号化方法。
  9. プロセッサを有する装置であって、請求項1~8のいずれか1項に記載の方法を実行するプログラムを実行するように構成された装置。
  10. 内蔵プログラムを含み、実行されると、前記プログラムが請求項1~9のいずれか一項に記載の方法を実行する、記憶媒体。
JP2022091958A 2017-08-11 2022-06-07 データ符号化方法及び装置、記憶媒体、並びにプロセッサ Active JP7565976B2 (ja)

Applications Claiming Priority (4)

Application Number Priority Date Filing Date Title
CN201710687764.6A CN109391360B (zh) 2017-08-11 2017-08-11 数据编码方法及装置
CN201710687764.6 2017-08-11
JP2020507602A JP7361017B2 (ja) 2017-08-11 2018-07-09 データ符号化方法及び装置、記憶媒体、並びにプロセッサ
PCT/CN2018/095037 WO2019029309A1 (zh) 2017-08-11 2018-07-09 数据编码方法、装置、存储介质及处理器

Related Parent Applications (1)

Application Number Title Priority Date Filing Date
JP2020507602A Division JP7361017B2 (ja) 2017-08-11 2018-07-09 データ符号化方法及び装置、記憶媒体、並びにプロセッサ

Publications (2)

Publication Number Publication Date
JP2022119993A true JP2022119993A (ja) 2022-08-17
JP7565976B2 JP7565976B2 (ja) 2024-10-11

Family

ID=65271031

Family Applications (2)

Application Number Title Priority Date Filing Date
JP2020507602A Active JP7361017B2 (ja) 2017-08-11 2018-07-09 データ符号化方法及び装置、記憶媒体、並びにプロセッサ
JP2022091958A Active JP7565976B2 (ja) 2017-08-11 2022-06-07 データ符号化方法及び装置、記憶媒体、並びにプロセッサ

Family Applications Before (1)

Application Number Title Priority Date Filing Date
JP2020507602A Active JP7361017B2 (ja) 2017-08-11 2018-07-09 データ符号化方法及び装置、記憶媒体、並びにプロセッサ

Country Status (8)

Country Link
US (2) US11239946B2 (ja)
EP (1) EP3667963A4 (ja)
JP (2) JP7361017B2 (ja)
KR (1) KR102343780B1 (ja)
CN (2) CN109391360B (ja)
AU (1) AU2018314548C1 (ja)
RU (1) RU2742912C1 (ja)
WO (1) WO2019029309A1 (ja)

Families Citing this family (12)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP2525496A1 (en) * 2011-05-18 2012-11-21 Panasonic Corporation Bit-interleaved coding and modulation (BICM) with quasi-cyclic LDPC codes
CN108809509B (zh) * 2017-05-05 2021-01-22 电信科学技术研究院 低密度奇偶校验码的基础图选择方法及装置
CA3073980C (en) 2017-09-11 2022-11-01 Zte Corporation Methods and apparatus for processing ldpc coded data
WO2020167088A1 (en) * 2019-02-15 2020-08-20 Samsung Electronics Co., Ltd. Method and apparatus for transmission or reception of data in communication system
EP3954072B1 (en) * 2019-05-10 2024-05-22 Samsung Electronics Co., Ltd. Method and apparatus for data transmission in wireless communication system
CN112367088B (zh) * 2020-10-27 2023-03-21 上海宇航系统工程研究所 一种基于索引矩阵的编码方法及装置
US11764911B2 (en) * 2021-04-05 2023-09-19 Nokia Technologies Oy Method of shifting redundancy version for the transmission of a transport block over multiple slots
WO2023090480A1 (ko) * 2021-11-18 2023-05-25 엘지전자 주식회사 무선 통신 시스템에서 무선 신호 송수신 방법 및 장치
CN114760662A (zh) * 2022-04-25 2022-07-15 北京星河亮点技术股份有限公司 一种低时延速率匹配方法、装置、电子设备及存储介质
CN118473590A (zh) * 2023-02-09 2024-08-09 中兴通讯股份有限公司 一种数据传输方法、通信装置及存储介质
CN118473592A (zh) * 2023-02-09 2024-08-09 中兴通讯股份有限公司 数据传输方法、通信装置及存储介质
CN116318552B (zh) * 2023-03-15 2023-09-22 归芯科技(深圳)有限公司 Turbo码的交织或解交织方法及其器件、通信芯片和装置

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20110239075A1 (en) * 2007-06-12 2011-09-29 Jun Xu Channel coding, modulating and mapping method for hybrid automatic repeat request of low density parity check code
US20170149528A1 (en) * 2015-11-24 2017-05-25 Samsung Electronics Co., Ltd. Method and apparatus for channel encoding/decoding in a communication or broadcasting system

Family Cites Families (23)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1252935C (zh) * 2002-12-13 2006-04-19 清华大学 基于低密度奇偶检验编码的信源信道联合编码方法
KR100744343B1 (ko) 2003-12-19 2007-07-30 삼성전자주식회사 이동 통신 시스템에서 불균일 오류 확률을 갖는 부호화에따른 데이터 송수신 방법 및 장치
KR100860504B1 (ko) * 2005-06-09 2008-09-26 삼성전자주식회사 이동통신 시스템에서 송수신 장치 및 방법
CN101034953B (zh) * 2006-03-06 2010-06-23 诺基亚西门子通信系统技术(北京)有限公司 应用低密度奇偶校验码进行数据传输的方法
US8024633B2 (en) * 2007-05-10 2011-09-20 Telefonaktiebolaget Lm Ericsson (Publ) Method and apparatus for combined packet retransmission and soft decoding of combined packets in a wireless communication network
CN101188428B (zh) * 2007-12-10 2012-09-05 中兴通讯股份有限公司 一种ldpc码的有限长度循环缓存的速率匹配方法
CN101227259B (zh) * 2008-01-11 2013-06-05 中兴通讯股份有限公司 一种有限长度循环缓存速率匹配的数据读取方法
BRPI0918057A2 (pt) * 2008-09-02 2019-09-24 Panasonic Corp dispositivo de comunicação sem fio e método de comunicação sem fio.
US8612820B2 (en) * 2009-04-11 2013-12-17 Qualcomm Incorporated Apparatus and methods for interleaving in a forward link only system
CN102035617B (zh) * 2009-09-29 2015-04-01 中兴通讯股份有限公司 一种通信系统中信道编码的速率匹配方法和装置
CN102075196B (zh) * 2010-12-10 2014-02-19 清华大学 多码率多码长qc-ldpc码编码方法及编码调制系统
WO2014200303A1 (en) 2013-06-14 2014-12-18 Samsung Electronics Co., Ltd. Apparatuses and methods for encoding and decoding of parity check codes
KR102146803B1 (ko) * 2013-06-14 2020-08-21 삼성전자주식회사 패리티 검사 부호의 부호화 장치, 그의 부호화 방법, 복호화 장치 및 그의 복호화 방법
EP3131219B1 (en) 2014-04-30 2023-11-15 Huawei Technologies Co., Ltd. Puncturing of ldpc codes
CN105811996B (zh) * 2014-12-30 2019-12-06 华为技术有限公司 一种基于准循环ldpc的数据处理方法及系统
CN107026654B (zh) * 2016-02-02 2019-06-18 中国科学院声学研究所 一种准循环多进制低密度奇偶校验码的快速频域编码方法
US10291356B2 (en) * 2016-05-11 2019-05-14 Futurewei Technologies, Inc. Decoding procedures in systems with codeblock segmentation
EP3522378A4 (en) * 2016-09-30 2020-09-16 LG Electronics Inc. -1- LDPC QC CODE RATE ADAPTATION PROCESS AND ASSOCIATED DEVICE
US10447312B2 (en) * 2016-11-25 2019-10-15 Lg Electronics Inc. Method of performing interleaving using LDPC and communication apparatus therefor
US10348329B2 (en) * 2017-02-13 2019-07-09 Qualcomm Incorporated Low density parity check (LDPC) circular buffer rate matching
US10778366B2 (en) * 2017-03-31 2020-09-15 Qualcomm Incorporated Techniques for rate matching and interleaving in wireless communications
JP2019004245A (ja) * 2017-06-13 2019-01-10 シャープ株式会社 端末装置、基地局装置、および、通信方法
CN109150420B (zh) * 2017-06-19 2022-02-25 华为技术有限公司 信息处理的方法、装置、通信设备和通信系统

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20110239075A1 (en) * 2007-06-12 2011-09-29 Jun Xu Channel coding, modulating and mapping method for hybrid automatic repeat request of low density parity check code
US20170149528A1 (en) * 2015-11-24 2017-05-25 Samsung Electronics Co., Ltd. Method and apparatus for channel encoding/decoding in a communication or broadcasting system

Non-Patent Citations (3)

* Cited by examiner, † Cited by third party
Title
NOKIA, ALCATEL-LUCENT SHANGHAI BELL: "Interleaving for LDPC[online]", 3GPP TSG RAN WG1 NR AD-HOC#2 R1-1711538, JPN6023035343, 30 June 2017 (2017-06-30), ISSN: 0005139356 *
ZTE, ZTE MICROELECTRONICS: "Bit rearrangement of LDPC for high order modulation[online]", 3GPP TSG RAN WG1 MEETING #88 R1-1701601, JPN6023035345, 17 February 2017 (2017-02-17), ISSN: 0005139357 *
ZTE: "Consideration on coding chain for eMBB data channel[online]", 3GPP TSG RAN WG1 MEETING #89 R1-1707177, JPN6023035344, 19 May 2017 (2017-05-19), ISSN: 0005139358 *

Also Published As

Publication number Publication date
CN109391360A (zh) 2019-02-26
CN114679185A (zh) 2022-06-28
JP7361017B2 (ja) 2023-10-13
EP3667963A1 (en) 2020-06-17
US20220158758A1 (en) 2022-05-19
US20200304235A1 (en) 2020-09-24
JP2020529806A (ja) 2020-10-08
AU2018314548B2 (en) 2021-05-20
RU2742912C1 (ru) 2021-02-11
US11239946B2 (en) 2022-02-01
AU2018314548A1 (en) 2020-04-02
JP7565976B2 (ja) 2024-10-11
KR20200051634A (ko) 2020-05-13
AU2018314548C1 (en) 2021-09-09
WO2019029309A1 (zh) 2019-02-14
EP3667963A4 (en) 2020-08-26
CN109391360B (zh) 2022-04-12
KR102343780B1 (ko) 2021-12-27
US11791933B2 (en) 2023-10-17

Similar Documents

Publication Publication Date Title
JP7565976B2 (ja) データ符号化方法及び装置、記憶媒体、並びにプロセッサ
CN107888198B (zh) 准循环ldpc编译码方法、装置及ldpc编译码器
US11139835B2 (en) Method and apparatus for data processing with structured LDPC codes
JP7464521B2 (ja) Ldpcコード化データを処理する方法および装置
US10038576B2 (en) Method and apparatus for transmitting and receiving data in a communication system
CN109417392B (zh) Ldpc码的编解码方法及系统
KR101503058B1 (ko) 저밀도 패리티 검사 부호를 사용하는 통신 시스템에서의 채널 부호화/복호화 방법 및 장치
JP6871396B2 (ja) 情報を処理するための方法および装置、通信デバイス、ならびに通信システム
CN108631925B (zh) 一种准循环低密度奇偶校验编码处理方法及装置
US8495459B2 (en) Channel-encoding/decoding apparatus and method using low-density parity-check codes
CN109120374B (zh) 准循环低密度奇偶校验编码设计方法及装置
CN107733440B (zh) 多边类型结构化ldpc处理方法及装置
CN107733442B (zh) 结构化ldpc码的处理方法及装置
KR101503655B1 (ko) 저밀도 패리티 검사 부호를 사용하는 통신 시스템에서 채널 부호/복호 방법 및 장치

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20220701

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20230718

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20230829

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20231129

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A821

Effective date: 20231129

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20240227

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20240618

A911 Transfer to examiner for re-examination before appeal (zenchi)

Free format text: JAPANESE INTERMEDIATE CODE: A911

Effective date: 20240625

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20240924

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20241001

R150 Certificate of patent or registration of utility model

Ref document number: 7565976

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150